JP7319199B2 - シフトレジスタユニット、ゲート駆動回路及び表示装置 - Google Patents
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Description
入力段階において、第1ノードN1に入力信号を書き込むことで出力回路200をオンにすることと、
出力段階において、出力回路200が出力端子Outputにクロック信号を出力することと、
リセット段階において、リセット回路300が第2ノードN2のレベルによる制御下でオンになり、出力端子Outputをリセットすることと、
リセット保持段階において、第1ノードN1に対して充電することにより、出力回路200が第1ノードN1のレベルによる制御下でオフ状態を保持することと、を含む。
(1)本発明の実施例の図面は、本発明の実施例に係る構成のみに関し、他の構成について一般的なデザインを参照することができる。
(2)矛盾しない限り、本発明の実施例及び実施例における特徴は、お互いに組み合わせにより新たな実施例を得ることができる。
Claims (11)
- 入力回路と、出力回路と、リセット回路と、制御回路と、リセット安定回路とを含むシフトレジスタユニットであって、
前記入力回路は、入力開始信号に応じて第1ノードに入力信号を書き込むように配置され、
前記出力回路は、前記第1ノードのレベルによる制御下で、出力端子に準備出力信号を出力するように配置され、
前記リセット回路は、第2ノードのレベルによる制御下で、前記出力端子をリセットするように配置され、
前記制御回路は、制御信号に応じて前記第2ノードに第1電圧信号を与えるように配置され、
前記リセット安定回路は、リセット安定信号に応じて前記第1ノードに第2電圧信号を与えるように配置され、
前記リセット安定回路は、第1トランジスタと、第2トランジスタとを含み、
記リセット安定信号は、第1リセット安定信号と、第2リセット安定信号とを含み、
前記第1トランジスタのゲート電極は、前記第2ノードに接続されて前記第2ノードのレベルを前記第1リセット安定信号とするように配置され、
記第1トランジスタの第1電極は、第1クロック信号線に接続され、第1クロック信号を前記第2リセット安定信号として受信するように配置され、
記第1トランジスタの第2電極は、前記第2トランジスタのゲート電極に接続されるように配置され、
前記第2トランジスタの第1電極は、第2電圧端子に接続されて前記第2電圧信号を受信するように配置され、
前記第2トランジスタの第2電極は、前記第1ノードに接続されるように配置され、
前記制御回路は、第8トランジスタを含み、
前記制御信号は、第1制御信号を含み、
前記第8トランジスタのゲート電極は、第2クロック信号線に接続されて第2クロック信号を前記第1制御信号として受信するように配置され、
前記第8トランジスタの第1電極は、第1電圧端子に接続されて前記第1電圧信号を受信するように配置され、
前記第8トランジスタの第2電極は、前記第2ノードに接続されるように配置され、
前記シフトレジスタユニットは、出力安定回路をさらに含み、
前記出力安定回路は、前記第1電圧信号の制御下で、前記出力端子の信号レベルの変化によってオン又はオフになるように配置され、
前記出力安定回路は、第10トランジスタを含み、
前記第10トランジスタのゲート電極は、第1電圧端子に接続されて前記第1電圧信号を受信するように配置され、
前記第10トランジスタの第1電極は、前記入力回路及び前記リセット安定回路に接続されるように配置され、
前記第10トランジスタの第2電極は、前記第1ノードに接続されるように配置され、
前記シフトレジスタユニットの信号タイミングは、出力段階を有し、
前記出力段階において、前記第1クロック信号がオンレベルに変化する前に前記第2クロック信号がオフレベルに変化し、前記第2ノードが予めリセットされ、前記出力端子が予め前記リセット回路によりリセットされる、
シフトレジスタユニット。 - 前記入力回路は、第5トランジスタを含み、
前記第5トランジスタのゲート電極は、第2クロック信号線に接続されて第2クロック信号を前記入力開始信号として受信するように配置され、
記第5トランジスタの第1電極は、入力信号線に接続されて前記入力信号を受信するように配置され、
記第5トランジスタの第2電極は、前記第1ノードに接続されるように配置される、
請求項1に記載のシフトレジスタユニット。 - 前記出力回路は、第6トランジスタと、第1コンデンサとを含み、
前記第6トランジスタのゲート電極は、前記第1ノードに接続されるように配置され、
記第6トランジスタの第1電極は、第1クロック信号線に接続され、第1クロック信号を前記準備出力信号として受信するように配置され、
記第6トランジスタの第2電極は、前記出力端子とするように配置され、
前記第1コンデンサの第1電極は、前記第6トランジスタのゲート電極に接続されるように配置され、
記第1コンデンサの第2電極は、前記第6トランジスタの第2電極に接続されるように配置される、
請求項1又は2に記載のシフトレジスタユニット。 - 前記リセット回路は、第7トランジスタと、第2コンデンサとを含み、
前記第7トランジスタのゲート電極は、前記第2ノードに接続されるように配置され、
記第7トランジスタの第1電極は、第2電圧端子に接続されて前記第2電圧信号を受信するように配置され、
記第7トランジスタの第2電極は、前記出力端子に接続されるように配置され、
前記第2コンデンサの第1電極は、前記第7トランジスタのゲート電極に接続されるように配置され、
記第2コンデンサの第2電極は、前記第7トランジスタの第1電極に接続されるように配置される、
請求項1~3のいずれか1項に記載のシフトレジスタユニット。 - 前記制御回路は、更に、第9トランジスタを含み、
前記制御信号は、更に、第2制御信号を含み、
前記第9トランジスタのゲート電極は、前記入力回路に接続されて前記入力回路から入力される前記入力信号を前記第2制御信号として受信するように配置され、
前記第9トランジスタの第1電極は、前記第2クロック信号線に接続されて前記第2クロック信号を受信するように配置され、
前記第9トランジスタの第2電極は、前記第8トランジスタの第2電極に接続されるように配置される、
請求項1~4のいずれか1項に記載のシフトレジスタユニット。 - トランジスタはP型トランジスタであり、
前記P型トランジスタの活性層材料は低温ポリシリコンを含む、
請求項1~5のいずれか1項に記載のシフトレジスタユニット。 - 前記制御回路が第9トランジスタを含み、かつ、前記出力安定回路が第10トランジスタ又は出力安定トランジスタを含む場合、前記第9トランジスタと、前記第10トランジスタ又は前記出力安定トランジスタとは、デュアルゲート薄膜トランジスタである、
請求項1に記載のシフトレジスタユニット。 - シフトレジスタユニットであって、
ゲート電極が第1ノードに接続され、第1電極が第1クロック信号線に接続されて第1クロック信号を受信し、第2電極が出力端子に接続されるように配置される第11トランジスタと、
第1電極が前記第11トランジスタのゲート電極に接続され、第2電極が前記第11トランジスタの第2電極に接続されるように配置される第3コンデンサと、
ゲート電極が第1電圧端子に接続されて第1電圧信号を受信し、第1電極と、前記第1ノードに接続されるように配置される第2電極と、をさらに含むように配置される第12トランジスタと、
ゲート電極が第2クロック信号線に接続されて第2クロック信号を受信し、第1電極が入力端子に接続されて入力信号を受信し、第2電極が前記第12トランジスタの第1電極に接続されるように配置される第13トランジスタと、
ゲート電極が第2ノードに接続され、第1電極が第2電圧端子に接続されて第2電圧信号を受信し、第2電極が前記第11トランジスタの第2電極に接続されるように配置される第14トランジスタと、
第1電極が前記第14トランジスタのゲート電極に接続され、第2電極が前記第14トランジスタの第1電極に接続されるように配置される第4コンデンサと、
ゲート電極が前記第2ノードに接続され、第1電極が前記第1クロック信号線に接続されて前記第1クロック信号を受信するように配置される第15トランジスタと、
ゲート電極が前記第15トランジスタの第2電極に接続され、第1電極が前記第2電圧端子に接続されて前記第2電圧信号を受信し、第2電極が前記第12トランジスタの第1電極に接続されるように配置される第16トランジスタと、
ゲート電極が前記第2クロック信号線に接続されて前記第2クロック信号を受信し、第1電極が前記第1電圧端子に接続されて前記第1電圧信号を受信し、第2電極が前記第2ノードに接続されるように配置される第17トランジスタと、
ゲート電極が前記第13トランジスタの第2電極に接続され、第1電極が前記第2クロック信号線に接続されて前記第2クロック信号を受信し、第2電極が前記第2ノードに接続されるように配置される第18トランジスタと、を含み、
前記シフトレジスタユニットの信号タイミングは、出力段階を有し、
前記出力段階において、前記第1クロック信号がオンレベルに変化する前に前記第2クロック信号がオフレベルに変化し、前記第2ノードが予めリセットされ、前記出力端子が予めリセット回路によりリセットされる、
シフトレジスタユニット。 - カスケード接続されている複数のシフトレジスタユニットを含み、
前記複数のシフトレジスタユニットは、P個の第1シフトレジスタユニットを含み、
前記第1シフトレジスタユニットには、請求項1~8のいずれか1項に記載のシフトレジスタユニットが採用され、
Pは1より大きい整数である、
ゲート駆動回路。 - 請求項9に記載のゲート駆動回路を含む、
表示装置。 - 複数本の走査線と、複数行に配列された複数の画素ユニットをさらに含み、前記複数本の走査線は、前記複数行の画素ユニットに対応して接続され、前記ゲート駆動回路における複数のシフトレジスタユニットの出力端子は、前記複数本の走査線に対応して接続され、第N段の前記シフトレジスタユニットの出力端子は、更に第N+1段の前記シフトレジスタユニットの入力回路に接続されて前記入力信号を供給し、Nは0より大きい整数である、
請求項10に記載の表示装置。
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