JP7282048B2 - 電力用半導体装置およびその製造方法 - Google Patents

電力用半導体装置およびその製造方法 Download PDF

Info

Publication number
JP7282048B2
JP7282048B2 JP2020021758A JP2020021758A JP7282048B2 JP 7282048 B2 JP7282048 B2 JP 7282048B2 JP 2020021758 A JP2020021758 A JP 2020021758A JP 2020021758 A JP2020021758 A JP 2020021758A JP 7282048 B2 JP7282048 B2 JP 7282048B2
Authority
JP
Japan
Prior art keywords
bonding
semiconductor device
power semiconductor
heat sink
solder
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2020021758A
Other languages
English (en)
Other versions
JP2021128988A (ja
Inventor
紀和 境
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP2020021758A priority Critical patent/JP7282048B2/ja
Priority to US17/077,854 priority patent/US11387352B2/en
Priority to DE102021100177.3A priority patent/DE102021100177A1/de
Priority to CN202110178885.4A priority patent/CN113257768A/zh
Publication of JP2021128988A publication Critical patent/JP2021128988A/ja
Application granted granted Critical
Publication of JP7282048B2 publication Critical patent/JP7282048B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66992Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by the variation of applied heat
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/373Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
    • H01L23/3735Laminates or multilayers, e.g. direct bond copper ceramic substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/49Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions wire-like arrangements or pins or rods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/48Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
    • H01L21/4814Conductive parts
    • H01L21/4885Wire-like parts or pins
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/07Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
    • H01L25/072Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00 the devices being arranged next to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/70Bipolar devices
    • H01L29/72Transistor-type devices, i.e. able to continuously respond to applied control signals
    • H01L29/739Transistor-type devices, i.e. able to continuously respond to applied control signals controlled by field-effect, e.g. bipolar static induction transistors [BSIT]
    • H01L29/7393Insulated gate bipolar mode transistors, i.e. IGBT; IGT; COMFET
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/06Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
    • H01L2224/0601Structure
    • H01L2224/0603Bonding areas having different sizes, e.g. different heights or widths
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001Core members of the layer connector
    • H01L2224/29099Material
    • H01L2224/291Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45139Silver (Ag) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45147Copper (Cu) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/4813Connecting within a semiconductor or solid-state body, i.e. fly wire, bridge wire
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/4846Connecting portions with multiple bonds on the same bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838Bonding techniques
    • H01L2224/83801Soldering or alloying
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L24/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/85Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/18Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/2003Nitride compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/1026Compound semiconductors
    • H01L2924/1027IV
    • H01L2924/10272Silicon Carbide [SiC]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/1026Compound semiconductors
    • H01L2924/1032III-V
    • H01L2924/1033Gallium nitride [GaN]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19107Disposition of discrete passive components off-chip wires
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/35Mechanical effects
    • H01L2924/351Thermal stress
    • H01L2924/3512Cracking

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Manufacturing & Machinery (AREA)
  • Materials Engineering (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
  • Wire Bonding (AREA)

Description

本開示は、電力用半導体装置におけるヒケスの抑制に関する。
電力用半導体装置において、接合材のヒケスが問題となる。接合材に含まれる複数の元素の凝固点が異なる場合、最初に凝固した元素が後に凝固した金属に引っ張られてクラックが発生する。この現象をヒケスという。例えば、Snを主成分とする鉛フリーはんだでは、Sn単体部分が232℃で最初に固まり、次に添加元素の共晶部分が固まる。例えば、Sn-Ag-Cuは217℃で固まる。金属は固まるときに収縮するため、最初に固まったSnが引っ張られてクラックが発生する。ヒケスが発生すると、放熱性に影響する他、ヒケスが発生することでワイヤボンディング時にチップクラック等のワイヤボンディング不良が生じる。従って、ヒケスを抑制する必要がある。
特許文献1には、絶縁基板の裏面Cuパターンにディンプル加工を施すことで、ヒケスの抑制を図る方法が開示されている。しかし、特許文献1の方法では、ディンプルによって空孔が生じるため、絶縁を担保できない。また、半導体素子(チップ)の配置の設計制約から、ディンプル上に半導体素子が配置される場合は、空孔によって半導体素子の放熱効果が低下する。従って、ヒケス抑制を目的とするディンプル加工を半導体素子の外周に設けることが出来ないという問題があった。また、半導体素子を絶縁基板の外周から遠ざける必要があり、設計の自由度が阻害されるという問題があった。
特許第5665786号公報
本開示は、上記の問題点を解決するためになされたものであり、電力用半導体装置において半導体素子のレイアウトまたは絶縁性能に影響を及ぼすことなく接合材のヒケスを抑制することを目的とする。
本開示の電力用半導体装置は、放熱板と、放熱板の上面の接合領域に、凝固点の異なる複数の元素を含有する接合材によって接合される絶縁基板と、絶縁基板の上面に搭載される半導体素子と、放熱板の上面の接合領域に、平面視において半導体素子を囲むように接合領域の外周の全辺に沿ってボンディングされた金属ワイヤと、を備える。
本開示の電力用半導体装置によれば、金属ワイヤで囲まれた領域内への接合材のヒケスの伸長が抑制される。従って、電力用半導体装置において半導体素子のレイアウトまたは絶縁性能に影響を及ぼすことなく接合材のヒケスが抑制される。
前提技術の電力用半導体装置の構成図である。 絶縁基板の下面金属パターンにディンプルを形成した前提技術の電力用半導体装置の断面図である。 実施の形態1の電力用半導体装置の断面図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 実施の形態1の電力用半導体装置の製造工程を示す図である。 放熱板の上面にワイヤボンディングが形成された状態を示す斜視図である。 ワイヤボンディングにおけるボンディング間隔とループの高さを示す図である。 放熱板の上面にはんだを形成した状態を示す断面図である。 はんだがループの下に流れ込んだ状態を示す断面図である。 図14の要部拡大図である。 前提技術の電力用半導体装置においてはんだに生じる収縮力を示す図である。 ループの下におけるはんだの収縮力と張力の関係を示す図である。 実施の形態1の電力用半導体装置においてはんだに生じる収縮力を示す図である。 前提技術の電力用半導体装置においてはんだにクラックが生じた状態を示す図である。
<A.前提技術>
図1は、第1の前提技術の電力用半導体装置100Aの構成を示している。図1(a)は、電力用半導体装置100Aの上面図であり、図1(b)は電力用半導体装置100Aの断面図である。
電力用半導体装置100Aは、放熱板1、絶縁基板3および半導体素子5を備えて構成される。絶縁基板3は、下面金属パターン31と上面金属パターン33によって絶縁基材32を挟んだ構成である。例えば、下面金属パターン31および上面金属パターン33はCu、絶縁基材32は窒化ケイ素からなる。絶縁基板3の下面金属パターン31は、はんだ2により放熱板1の上面に接合される。上面金属パターン33の上面には、はんだ4により複数の半導体素子5が接合される。はんだ2,4は、接合材の一例である。
半導体素子5の上面には、ワイヤボンディング6が形成される。ワイヤボンディング6は、ボンディング部6bとボンディング部6b間のボンディングワイヤ6wとで構成される。半導体素子5は、電力を制御するスイッチング素子であり、放熱を要する。半導体素子5の半導体材料には、Siの他、SiCまたはGaN等のワイドバンドギャップ半導体が用いられる。
はんだ2はSnを主成分とする。図1では、絶縁基板3の端部下においてはんだ2にヒケス7が生じている様子が示されている。半導体素子5の領域10では、その直下にヒケス7があるためにワイヤボンド時の超音波振動が伝わらず、ワイヤボンディング6を上手く形成できないという問題があった。
図2は、第2の前提技術の電力用半導体装置100Bの断面図である。図2において、はんだ4、半導体素子5、およびワイヤボンディング6は図示を省略している。電力用半導体装置100Bは、絶縁基板3の下面金属パターン31にディンプル311が形成されているという点で、第1の前提技術の電力用半導体装置100Aと異なる。
ディンプル311により、はんだ2におけるヒケス7の発生が抑制される。しかし、ディンプル311には、はんだ2が充填されず気泡がトラップされる未充填部312が生じる。そのため、上面金属パターン33の端部上に半導体素子5が配置される場合には、放熱性の低下を避けるためディンプル311を形成することが出来ない。また、放熱性の条件をクリアしてディンプル311が形成されたとしても、未充填部312により絶縁性能が低下するため、高地絶縁性能が低下する。
そこで、以下に説明する実施の形態では、半導体素子5のレイアウトまたは絶縁性能に影響を及ぼすことなく、Snを主成分とするはんだ2のヒケスを抑制する。
<B.実施の形態1>
<B-1.概要>
図3は、実施の形態1の電力用半導体装置101の断面図である。電力用半導体装置101は、放熱板1の上面にワイヤボンディング8が形成されるという点で、第1の前提技術の電力用半導体装置100Aと異なる。
<B-2.製造工程>
以下、図4から図10に沿って電力用半導体装置101の製造工程を説明する。図4から図10において、(a)は上面図であり、(b)は断面図である。
まず、図4に示すように、放熱板1を用意する。放熱板1の上面のうち、後工程ではんだ2が搭載される領域を接合領域12と称する。放熱板1は、Cuベース板から形成され、放熱板1の接合領域12以外の領域11にはレジストが塗布されている。一方、接合領域12にはレジストが塗布されずCu無垢材である。但し、接合領域12にはNiめっきが施されていても良い。
次に、図5に示すように、放熱板1の上面の接合領域12内に、接合領域12の外周の各辺に沿ってワイヤボンディング8を形成する。
その後、図6に示すように、放熱板1の上面の接合領域12にはんだ2を搭載する。
次に、図7に示すように、絶縁基板3がはんだ2によって放熱板1に接合される。
その後、図8に示すように、絶縁基板3の上面金属パターン33の上面にはんだ4が搭載される。
次に、図9に示すように、複数の半導体素子5がはんだ4によって絶縁基板3の上面金属パターン33に接合される。図6から図9は、はんだ2がまだワイヤボンディング8のボンディングワイヤに濡れていない状態を示している。
その後、図10に示すように、はんだ2がワイヤボンディング8のボンディングワイヤに濡れて、ボンディングワイヤのループの下に入り込む。
<B-3.ボンディングワイヤ>
図11は、放熱板1の上面にワイヤボンディング8が形成された状態を示す斜視図である。ワイヤボンディング8は、放熱板1の上面の接合領域12内に、接合領域12の外周の各辺に沿って形成される。
図12に示すように、ワイヤボンディング8は、ボンディング部8bと、ボンディング部8b間のボンディングワイヤ8wとで構成される。ボンディングワイヤ8wは、CuまたはAgを主成分とする。ボンディングワイヤ8wは、Snを主成分とするはんだ2と反応し、金属間化合物を形成する。
ボンディングワイヤ8wの直径は、200μm以上500μm以下である。図12(a)に示すボンディング部8bの間隔aは、1.0mm以上である。図12(b)に示すボンディングワイヤ8wによるループの高さbは、0.1mm以上である。これらの条件を満たすことにより、はんだ2がボンディングワイヤ8wのループの下に入り込むことが可能となる。
図13は、放熱板1の上面にはんだ2を搭載した直後の状態を示す断面図である。溶融したはんだ2は、AgまたはCuによって構成されたボンディングワイヤ8wに濡れることで、図14に示すように、ボンディングワイヤ8wによるループの下に流れ込む。図15は、一つのボンディングワイヤ8wのループについての図14の拡大図である。
その後、はんだ2は冷却され凝固収縮しようとする。もし放熱板1の上面にワイヤボンディング8が形成されなければ、図16において矢印で示すはんだ2の収縮力により、ヒケス7が伸長する。しかし、電力用半導体装置101においては、図17において左方向の矢印で示すはんだ2の界面張力が、右方向の矢印で示すはんだ2の収縮力に対する反力となる。従って、図18に示すように、ヒケス7がワイヤボンディング8より内側に伸長することが抑制される。
ワイヤボンディング8は、図5または図11に示したように、放熱板1の上面の接合領域12の外周に沿って形成される。従って、ワイヤボンディング8は、平面視において半導体素子5を囲むように形成される。上記のように、ヒケス7はワイヤボンディング8より内側には伸長しないため、結果として、半導体素子5の直下にヒケス7は伸長せず、半導体素子5の上面におけるワイヤボンディング6を適切に行うことが可能となる。
また、図14に示すように、はんだ2がボンディングワイヤ8wのループの下に入り込むことによって、はんだ2の厚みはループの高さbと等しくなる。従って、ループの高さbを制御することにより、はんだ2の厚みを所望の厚みに制御することが可能となる。
絶縁基板3と放熱板1は、材質が異なるため線膨張係数が異なる。例えば、放熱板1の材質をCuとすると、放熱板1の線膨張係数は16.2である。また、絶縁基材32の材質を窒化ケイ素とし、下面金属パターン31および上面金属パターン33の材質をCuとすると、絶縁基板3全体の線膨張係数は6.2である。従って、温度サイクル試験の際に、はんだ2には絶縁基板3と放熱板1の膨張率の差に起因して応力が発生し、図19に示すように水平方向にクラック9が発生する。クラック9は、はんだ2の端部から内側に向かって進展する。図19において、クラック9が最も進展した位置を符号9aで示している。
一方、実施の形態1の電力用半導体装置101では、放熱板1の絶縁基板3に対する接合領域12の全辺に沿ってワイヤボンディング8が形成され、ボンディングワイヤ8wとはんだ2との間で金属間化合物が生成される。金属間化合物は、例えばCuSn、CuSn、またはAgSnである。従って、温度サイクル試験において上述の絶縁基板3と放熱板1の膨張率の差に起因する応力に耐え、クラック9が抑制される。つまり、電力用半導体装置101は、温度サイクル試験におけるクラック耐性を有する。
<B-4.効果>
実施の形態1の電力用半導体装置101は、放熱板1と、放熱板1の上面の接合領域12に、凝固点の異なる複数の元素を含有する接合材であるはんだ2によって接合される絶縁基板3と、絶縁基板3の上面に搭載される半導体素子5と、放熱板1の上面の接合領域12に、平面視において半導体素子5を囲むようにボンディングされた金属ワイヤであるボンディングワイヤ8wと、を備える。従って、放熱板1およびボンディングワイヤ8wと接触したはんだ2に生じる界面張力が、ヒケス7を伸長させるはんだ2の収縮力と反対方向の力となり、ヒケス7の伸長を抑制する。これにより、半導体素子5の直下にヒケス7が伸長することが抑制され、半導体素子5の上面においてワイヤボンディング6を適切に形成することができる。また、絶縁基板3にディンプルが形成されないため、半導体素子のレイアウトの自由度または絶縁性能が阻害されない。
実施の形態1の電力用半導体装置101において、ボンディングワイヤ8wは、放熱板1の上面の接合領域12の外周の全辺に沿ってボンディングされることが望ましい。これにより、半導体素子5の直下にヒケス7が伸長することが抑制され、半導体素子5の上面においてワイヤボンディング6を適切に形成することができる。
実施の形態1の電力用半導体装置101において、ボンディングワイヤ8wのボンディング間隔は1.0mm以上であり、ボンディングワイヤ8wのループの高さは0.1mm以上であることが望ましい。これにより、はんだ2がボンディングワイヤ8wのループの下にスムーズに流れ込むことが可能となる。
実施の形態1の電力用半導体装置101において、ボンディングワイヤ8wは、CuまたはAgを主成分とし、接合材であるはんだ2はSnを主成分とする。これにより、はんだ2がボンディングワイヤ8wと反応して金属間化合物を生成する。従って、温度サイクル試験において、はんだ2は放熱板1と絶縁基板3の線膨張係数の差に起因して発生する応力に耐え、水平方向のクラック9が抑制される。
実施の形態1の電力用半導体装置の製造方法は、放熱板1の上面に金属ワイヤであるボンディングワイヤ8wをボンディングし、放熱板1の上面に、凝固点の異なる複数の元素を含有するはんだ2によって絶縁基板3を接合し、絶縁基板3の上面に搭載される半導体素子5を搭載し、ボンディングワイヤ8wは、放熱板1の上面の絶縁基板3が接合される接合領域において、平面視において半導体素子5を囲むようにボンディングされる。これにより、半導体素子5の直下にヒケス7が伸長することが抑制され、半導体素子5の上面においてワイヤボンディング6を適切に形成することができる。また、絶縁基板3にディンプルが形成されないため、半導体素子のレイアウトの自由度または絶縁性能が阻害されない。
なお、実施の形態を適宜、変形、省略したりすることが可能である。
1 放熱板、2,4 はんだ、3 絶縁基板、5 半導体素子、6,8 ワイヤボンディング、6b,8b ボンディング部、6w,8w ボンディングワイヤ、7 ヒケス、9 クラック、12 接合領域、31 下面金属パターン、32 絶縁基材、33 上面金属パターン、100A,100B,101 電力用半導体装置、311 ディンプル、312 未充填部。

Claims (4)

  1. 放熱板と、
    前記放熱板の上面の接合領域に、凝固点の異なる複数の元素を含有する接合材によって接合される絶縁基板と、
    前記絶縁基板の上面に搭載される半導体素子と、
    前記放熱板の上面の前記接合領域に、平面視において前記半導体素子を囲むように前記接合領域の外周の全辺に沿ってボンディングされた金属ワイヤと、を備える、
    電力用半導体装置。
  2. 前記金属ワイヤのボンディング間隔は1.0mm以上であり、
    前記金属ワイヤのループの高さは0.1mm以上である、
    請求項1に記載の電力用半導体装置。
  3. 前記金属ワイヤは、CuまたはAgを主成分とし、
    前記接合材は、Snを主成分とする、
    請求項1または請求項に記載の電力用半導体装置。
  4. 放熱板の上面に金属ワイヤをボンディングし、
    前記放熱板の上面に、凝固点の異なる複数の元素を含有する接合材によって絶縁基板を接合し、
    前記絶縁基板の上面に搭載される半導体素子を搭載する、
    電力用半導体装置の製造方法であって、
    前記金属ワイヤは、前記放熱板の上面の前記絶縁基板が接合される接合領域において、平面視において前記半導体素子を囲むように前記接合領域の外周の全辺に沿ってボンディングされる、
    電力用半導体装置の製造方法。
JP2020021758A 2020-02-12 2020-02-12 電力用半導体装置およびその製造方法 Active JP7282048B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP2020021758A JP7282048B2 (ja) 2020-02-12 2020-02-12 電力用半導体装置およびその製造方法
US17/077,854 US11387352B2 (en) 2020-02-12 2020-10-22 Power semiconductor device and manufacturing method thereof
DE102021100177.3A DE102021100177A1 (de) 2020-02-12 2021-01-08 Leistungshalbleitervorrichtung und Herstellungsverfahren für diese
CN202110178885.4A CN113257768A (zh) 2020-02-12 2021-02-07 电力用半导体装置及其制造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2020021758A JP7282048B2 (ja) 2020-02-12 2020-02-12 電力用半導体装置およびその製造方法

Publications (2)

Publication Number Publication Date
JP2021128988A JP2021128988A (ja) 2021-09-02
JP7282048B2 true JP7282048B2 (ja) 2023-05-26

Family

ID=76968740

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2020021758A Active JP7282048B2 (ja) 2020-02-12 2020-02-12 電力用半導体装置およびその製造方法

Country Status (4)

Country Link
US (1) US11387352B2 (ja)
JP (1) JP7282048B2 (ja)
CN (1) CN113257768A (ja)
DE (1) DE102021100177A1 (ja)

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013201289A (ja) 2012-03-26 2013-10-03 Mitsubishi Electric Corp 半導体装置
JP2014146645A (ja) 2013-01-28 2014-08-14 Mitsubishi Electric Corp 半導体装置
WO2018220819A1 (ja) 2017-06-02 2018-12-06 三菱電機株式会社 半導体素子接合用基板、半導体装置および電力変換装置
JP2019110317A (ja) 2016-06-14 2019-07-04 三菱電機株式会社 電力用半導体装置

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004228352A (ja) * 2003-01-23 2004-08-12 Mitsubishi Electric Corp 電力半導体装置
US8399972B2 (en) * 2004-03-04 2013-03-19 Skyworks Solutions, Inc. Overmolded semiconductor package with a wirebond cage for EMI shielding
US9147665B2 (en) * 2007-11-06 2015-09-29 Fairchild Semiconductor Corporation High bond line thickness for semiconductor devices
KR20120026909A (ko) * 2010-09-10 2012-03-20 삼성전자주식회사 반도체 패키지 및 그의 제조 방법
JP2014146644A (ja) * 2013-01-28 2014-08-14 Mitsubishi Electric Corp 半導体装置およびその製造方法
US10021790B2 (en) * 2016-02-26 2018-07-10 Avago Technologies General Ip (Singapore) Pte. Ltd. Module with internal wire fence shielding
US10134686B2 (en) * 2016-09-30 2018-11-20 Avago Technologies International Sales Pte. Limited Systems and methods for providing electromagnetic interference (EMI) compartment shielding for components disposed inside of system electronic packages
JP2018137305A (ja) * 2017-02-21 2018-08-30 富士通コンポーネント株式会社 電子装置及び電子装置の製造方法
JP6950757B2 (ja) * 2018-02-08 2021-10-13 株式会社村田製作所 高周波モジュール
US10879191B2 (en) * 2019-01-07 2020-12-29 Qualcomm Incorporated Conformal shielding for solder ball array

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013201289A (ja) 2012-03-26 2013-10-03 Mitsubishi Electric Corp 半導体装置
JP2014146645A (ja) 2013-01-28 2014-08-14 Mitsubishi Electric Corp 半導体装置
JP2019110317A (ja) 2016-06-14 2019-07-04 三菱電機株式会社 電力用半導体装置
WO2018220819A1 (ja) 2017-06-02 2018-12-06 三菱電機株式会社 半導体素子接合用基板、半導体装置および電力変換装置
US20200135682A1 (en) 2017-06-02 2020-04-30 Mitsubishi Electric Corporation Semiconductor element bonding substrate, semiconductor device, and power conversion device

Also Published As

Publication number Publication date
US20210249526A1 (en) 2021-08-12
JP2021128988A (ja) 2021-09-02
DE102021100177A1 (de) 2021-08-12
CN113257768A (zh) 2021-08-13
US11387352B2 (en) 2022-07-12

Similar Documents

Publication Publication Date Title
JP5211493B2 (ja) 配線基板及び半導体装置
JP6983187B2 (ja) 電力用半導体装置
US10879203B2 (en) Stud bump structure for semiconductor package assemblies
JP6847266B2 (ja) 半導体パッケージおよびその製造方法
TWI464833B (zh) 經熱增強之薄型半導體封裝件
JP5578326B2 (ja) リード部品及びその製造方法、並びに半導体パッケージ
US20040232560A1 (en) Flip chip assembly process and substrate used therewith
JP4730181B2 (ja) 半導体装置
JP4385324B2 (ja) 半導体モジュールおよびその製造方法
JP6094413B2 (ja) 半導体モジュール及びその製造方法
JP3347279B2 (ja) 半導体装置およびその製造方法
JP2007059485A (ja) 半導体装置、基板及び半導体装置の製造方法
JP6008750B2 (ja) 半導体装置
JP7282048B2 (ja) 電力用半導体装置およびその製造方法
US11398447B2 (en) Semiconductor device and method for producing semiconductor device
JP2006351950A (ja) 半導体装置及び半導体装置の製造方法
JP6843503B2 (ja) 半導体装置及び移動体
JP2005236019A (ja) 半導体装置の製造方法
JP7200899B2 (ja) 半導体装置および半導体装置の製造方法
JP2014143342A (ja) 半導体モジュール及びその製造方法
EP3751603A3 (en) Semiconductor package with a heat sink bonded to a semiconductor chip with a bonding layer and to a molding material with a thermal interface material
WO2020195847A1 (ja) 電子装置および電子装置の製造方法
JP4863836B2 (ja) 半導体装置
JP2008172120A (ja) パワーモジュール
JP2009252858A (ja) 半導体素子収納用パッケージ

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20220228

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20230127

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20230207

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230324

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20230418

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230516

R150 Certificate of patent or registration of utility model

Ref document number: 7282048

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150