JP7149321B2 - ウエハ位置決め方法及び半導体製造装置 - Google Patents
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Description
1. チャンバ内のライトがオンである間だけ行えるに過ぎない。しかしながら、チャンバ内のライトをオンにするには、チャンバをオフにして温度を下げる必要がある。それにより、ルーチンの製造プロセスが遅れる。
2. 実際のエピタキシャルプロセスでは、ウエハは一般に、例えば700℃などの高温下でベース上にロードされる。高温下でのチャンバのガス流及び温度場は室温下でのものとは異なるので、実際のプロセスにおけるウエハのローディング位置は、室温下で予測される位置決め位置とは異なる。それにより、ウエハの最良の位置決め位置を製造プロセス中に満たすことができない。
ステップS1:第1のウエハの第1表面の状態分布を、当該第1のウエハ上で薄膜プロセスが実行された後に取得し、第1表面は、薄膜プロセスにおいて上に薄膜が形成された表面とは反対側の表面であり、
ステップS2:第1表面の状態分布に従って、第1のウエハが理想的な位置決め中心に位置するかを判定し、第1のウエハが理想的な位置決め中心に位置しない場合に、薄膜プロセスに掛けられる第2のウエハの位置決め位置を、薄膜プロセス中に当該第2のウエハを理想的な位置決め中心に位置決めするように、第1表面の状態分布に従って調節する、
ことを有する。
半径方向に第1のウエハの中心から距離を持つ位置において第1表面の高さを検出して、様々な距離及び様々な半径方向で第1表面の高さデータを取得することと、
高さデータに基づいて様々な半径方向における第1表面のZDD分布を計算することと、
を有するステップによって取得される。
各半径方向における第1表面のZDD分布の最小値を取得し、
各半径方向におけるZDD分布の最小値を持つ位置と第1のウエハの中心との間の直径距離に基づいて、第1表面のZDD分布のレーダーチャートを取得し、該レーダーチャートは、各半径方向におけるZDD分布の最小値を持つ位置と理想的な位置決め中心との間の距離を示し、
ZDD分布のレーダーチャートに従って、第1のウエハが理想的な位置決め中心に位置するかを判定し、
第1のウエハが理想的な位置決め中心に位置しない場合に、ZDD分布のレーダーチャートに従って第2のウエハの位置決め位置を調節する、
ことを有する。
ZDD分布のレーダーチャートに従って第1のウエハの中心を取得し、
取得した第1のウエハの中心を理想的な位置決め中心と比較して、理想的な位置決め中心からの第1のウエハの中心のバイアスベクトルを取得し、
ベクトルに従って薄膜プロセス中の第2のウエハの位置決め位置を調節する、
ことを有する。
薄膜プロセス中にウエハを担持するウエハキャリアと、
ウエハをウエハキャリア上の理想的な位置決め中心に位置決めする位置決め装置であり、プロセッサと実行可能なプログラム命令とを有する位置決め装置と、
を有し、
位置決め装置は、プロセッサが上記実行可能なプログラム命令を実行するときに、上述の方法のうちのいずれかの方法を実行する。
例1
従来技術の問題を解決するために、本出願は、薄膜プロセスに適用されるように特徴付けられるウエハ位置決め方法を提供し、当該方法は、
ステップS1:第1のウエハの第1表面の状態分布を、当該第1のウエハ上で薄膜プロセスが実行された後に取得し、第1表面は、薄膜プロセスにおいて上に薄膜が形成された表面とは反対側の表面であり、
ステップS2:第1表面の状態分布に従って、第1のウエハが理想的な位置決め中心に位置するかを判定する、
ことを有し、
第1のウエハが理想的な位置決め中心に位置しない場合に、薄膜プロセスに掛けられる第2のウエハの位置決め位置が、薄膜プロセス中に当該第2のウエハを理想的な位置決め中心に位置決めするように、第1表面の状態分布に従って調節される。
ステップS21:半径方向に第1のウエハの中心から距離を持つ位置において第1表面の高さを検出して、様々な距離及び様々な半径方向で第1表面の高さデータを取得することと、
ステップS22:高さデータに基づいて様々な半径方向における第1表面のZDD分布を計算することと、
を含む。
この例では、図3Bに示すように、理想的な位置決め中心はOであり、薄膜プロセスにおける第1のウエハの位置決め中心はPである。重要なことには、実際の中心Pが理想的な位置決め中心Oから外れており、バイアスベクトルが更に取得される。図3Bに示すように、バイアスベクトルO→Pは、長さρと、X軸に対して戻り角αの方向とを有している。
本出願は、薄膜プロセスに適用される半導体製造装置を提供する。当該製造装置は、薄膜プロセス中にウエハを担持するウエハキャリアと、ウエハキャリア上でウエハを理想的な位置決め中心に位置付ける位置決め装置とを有する。位置決め装置は、プロセッサと、そこに記憶される実行可能なプログラム命令とを有する。プロセッサが実行可能プログラム命令を実行するとき、位置決め装置は、例1で説明した方法を実行する。
Claims (7)
- 薄膜プロセスに適用される、ウエハを位置決めする方法であって、
ステップS1:第1のウエハの第1表面の状態分布を、当該第1のウエハ上で前記薄膜プロセスが実行された後に取得し、前記第1表面は、前記薄膜プロセスにおいて上に薄膜が形成された表面とは反対側の表面であり、
ステップS2:前記第1表面の前記状態分布に従って、前記第1のウエハが理想的な位置決め中心に位置するかを判定し、前記第1のウエハが理想的な位置決め中心に位置しない場合に、前記薄膜プロセスに掛けられる第2のウエハの位置決め位置を、前記薄膜プロセス中に当該第2のウエハを前記理想的な位置決め中心に位置決めするように、前記第1表面の前記状態分布に従って調節する、
ことを有し、
前記第1表面の前記状態分布は、前記第1表面の裏面Z高さ二次導関数(BZDD)分布を有する、
方法。 - 前記第1表面の前記BZDD分布は、
半径方向に前記第1のウエハの中心から距離を持つ位置において前記第1表面の高さを検出して、様々な距離及び様々な半径方向で前記第1表面の高さデータを取得することと、
前記高さデータに基づいて様々な半径方向における前記第1表面のZDD分布を計算することと、
を有するステップによって取得される、請求項1に記載の方法。 - 前記第1表面の前記状態分布に従って前記第2のウエハの前記位置決め位置を調節するステップは、
各半径方向における前記第1表面の前記ZDD分布の最小値を取得し、
各半径方向における前記ZDD分布の前記最小値を持つ位置と前記第1のウエハの中心との間の半径距離に基づいて、前記第1表面の前記ZDD分布のレーダーチャートを取得し、該レーダーチャートは、各半径方向における前記ZDD分布の前記最小値を持つ前記位置と前記理想的な位置決め中心との間の距離を示し、
前記ZDD分布の前記レーダーチャートに従って、前記第1のウエハが前記理想的な位置決め中心に位置するかを判定し、
前記第1のウエハが前記理想的な位置決め中心に位置しない場合に、前記ZDD分布の前記レーダーチャートに従って前記第2のウエハの前記位置決め位置を調節する、
ことを有する、請求項2に記載の方法。 - 前記第1表面の前記状態分布に従って前記第2のウエハの前記位置決め位置を調節するステップは、
前記ZDD分布の前記レーダーチャートに従って前記第1のウエハの中心を取得し、
取得した前記第1のウエハの中心を前記理想的な位置決め中心と比較して、前記理想的な位置決め中心からの前記第1のウエハの中心のバイアスベクトルを取得し、
前記ベクトルに従って前記薄膜プロセス中の前記第2のウエハの前記位置決め位置を調節する、
ことを有する、請求項3に記載の方法。 - 前記半径方向は、前記第1のウエハの中心から外縁に向かう方向であり、前記半径方向は、前記ウエハの外縁に等間隔で置かれる複数の点によって形成される複数の半径方向を含む、請求項3に記載の方法。
- 半径方向に前記第1のウエハの中心から距離を持つ前記位置は、各半径方向において互いに等間隔で該半径方向上に置かれる複数の位置を含む、請求項2に記載の方法。
- 前記薄膜プロセスは、エピタキシプロセス及び/又は堆積プロセスを有する、請求項1に記載の方法。
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003037075A (ja) | 2001-07-26 | 2003-02-07 | Tokyo Electron Ltd | 移載装置の制御方法および熱処理方法並びに熱処理装置 |
JP2012227471A (ja) | 2011-04-22 | 2012-11-15 | Shin Etsu Handotai Co Ltd | 偏心量の評価方法及びエピタキシャルウェーハの製造方法 |
JP2014127595A (ja) | 2012-12-26 | 2014-07-07 | Shin Etsu Handotai Co Ltd | 偏芯評価方法及びエピタキシャルウェーハの製造方法 |
JP2016538717A (ja) | 2013-10-29 | 2016-12-08 | ケーエルエー−テンカー コーポレイション | プロセス誘起による歪みの予測、ならびにオーバーレイ誤差のフィードフォワード及びフィードバック修正 |
Family Cites Families (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5764353A (en) * | 1996-11-29 | 1998-06-09 | Seh America, Inc. | Back side damage monitoring system |
JPH1190816A (ja) * | 1997-09-22 | 1999-04-06 | Toshiba Corp | 研磨装置及び研磨方法 |
JP2000068359A (ja) * | 1998-08-24 | 2000-03-03 | Hitachi Techno Eng Co Ltd | ウエハ搬送装置 |
JP2005228788A (ja) * | 2004-02-10 | 2005-08-25 | Seiko Epson Corp | ウエーハとプローブカードとの位置合わせ方法、プローブ検査方法及びプローブ検査装置 |
US7486878B2 (en) * | 2006-09-29 | 2009-02-03 | Lam Research Corporation | Offset correction methods and arrangement for positioning and inspecting substrates |
WO2009084154A1 (ja) * | 2007-12-28 | 2009-07-09 | Shin-Etsu Handotai Co., Ltd. | エピタキシャル成長用サセプタ |
TW200930853A (en) * | 2008-01-08 | 2009-07-16 | Yung-Mao Su | Vacuum high temperature spiral magnetic condensation crystal growth method for positioning wafer |
JP2011018697A (ja) * | 2009-07-07 | 2011-01-27 | Shinkawa Ltd | ボンディング装置及びボンディング装置におけるボンディング位置を補正する方法 |
FR2948494B1 (fr) * | 2009-07-27 | 2011-09-16 | Soitec Silicon On Insulator | Procede de determination d'une position centree d'un substrat semi-conducteur dans un four de recuit, dispositif pour traiter thermiquement des substrats semi-conducteurs et procede pour calibrer un tel dispositif |
JP5440414B2 (ja) | 2010-06-22 | 2014-03-12 | 株式会社島津製作所 | プラズマcvd成膜装置 |
JP6132163B2 (ja) * | 2014-04-10 | 2017-05-24 | 信越半導体株式会社 | 偏芯評価方法及びエピタキシャルウェーハの製造方法 |
CN105603383B (zh) * | 2014-11-24 | 2017-12-29 | 中晟光电设备(上海)股份有限公司 | 托盘晶圆定位系统、方法及mocvd设备 |
JP6128198B1 (ja) * | 2015-12-22 | 2017-05-17 | 株式会社Sumco | ウェーハの両面研磨方法及びこれを用いたエピタキシャルウェーハの製造方法 |
KR101810643B1 (ko) | 2016-02-02 | 2017-12-19 | 에스케이실트론 주식회사 | 에피텍셜 웨이퍼의 평탄도 제어 방법 |
FR3052869B1 (fr) * | 2016-06-17 | 2018-06-22 | Unity Semiconductor | Dispositif de positionnement d'une plaquette de circuit integre, et appareil d'inspection d'une plaquette de circuit integre comprenant un tel dispositif de positionnement |
JP7052573B2 (ja) * | 2018-06-06 | 2022-04-12 | 東京エレクトロン株式会社 | 塗布膜形成装置及び塗布膜形成装置の調整方法 |
CN208954953U (zh) * | 2018-12-05 | 2019-06-07 | 德淮半导体有限公司 | 晶圆位置检测装置 |
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JP2012227471A (ja) | 2011-04-22 | 2012-11-15 | Shin Etsu Handotai Co Ltd | 偏心量の評価方法及びエピタキシャルウェーハの製造方法 |
JP2014127595A (ja) | 2012-12-26 | 2014-07-07 | Shin Etsu Handotai Co Ltd | 偏芯評価方法及びエピタキシャルウェーハの製造方法 |
JP2016538717A (ja) | 2013-10-29 | 2016-12-08 | ケーエルエー−テンカー コーポレイション | プロセス誘起による歪みの予測、ならびにオーバーレイ誤差のフィードフォワード及びフィードバック修正 |
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