JP6848579B2 - 電子回路および電子時計 - Google Patents
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Description
このように、ICの内部回路を初期化する初期状態設定手段(初期化回路)と、テスト制御回路を有するICでは、テストモード中に内部回路が初期化されないように、テスト制御回路から出力されるテスト制御信号と、クロック信号とを用いて初期化回路を制御する初期化制御回路を備えたものが開発されている。
図10に示すように、IC10は、発振回路11と、分周回路12と、パルス形成回路13と、ドライバー14と、テスト制御回路15と、初期化制御回路20と、初期化回路30と、を備えている。さらに、IC10は、電源端子VDD,VSSと、接続端子GATE,DRAIN,O1,O2と、操作入力端子P1と、テスト端子TESTと、を備えている。
接続端子GATE,DRAINには、電子時計が備える水晶振動子が接続される。水晶振動子は、発振回路11によって駆動されて所定周波数(32768Hz)のクロック信号を発生する。
接続端子O1,O2には、電子時計が備えるモーターのコイルに接続される。モーターは、2極のステップモーターであり、IC10から出力されるモーター駆動パルスによって駆動される。
操作入力端子P1には、電子時計が備えるりゅうずの操作に応じた操作信号が入力される。
テスト端子TESTには、計測装置が備えるプローブなどが接触されることで、テスト信号が入力される。
分周回路12は、発振回路11の出力を分周してパルス形成回路13に出力する。
パルス形成回路13は、分周回路12から出力されたクロック信号に基づいて、モーターの駆動を制御する所定の波形のパルスを生成し、ドライバー14に出力する。
ドライバー14は、パルス形成回路13から出力されたパルスに応じて、モーターのコイルに電流を流し、モーターを駆動させる。
初期化制御回路20は、テスト制御信号およびクロック信号に基づいて、初期化回路30を制御し、LレベルまたはHレベルの初期化制御信号を出力させる。
初期化制御回路20は、図11に示すように、論理回路21,22を備えている。論理回路21,22は、それぞれ、2つの入力端子と1つの出力端子とを備えている。
論理回路21の一方の入力端子には、テスト制御信号が入力され、他方の入力端子にはクロック信号が入力される。論理回路21の出力端子は、初期化回路30の後述する電界効果トランジスターN2のゲート電極、および、論理回路22の入力端子に接続されている。論理回路22の一方の入力端子には、テスト制御信号が入力され、他方の入力端子には、論理回路21の出力端子が接続されている。論理回路22の出力端子は、初期化回路30の後述する電界効果トランジスターN1のゲート電極に接続されている。
また、非テストモードを設定するHレベルのテスト制御信号が入力され、かつ、クロック信号が入力された場合、論理回路21は、クロック信号がLレベルからHレベルに変化する毎にLレベルの信号を出力し、クロック信号がHレベルからLレベルに変化する毎にHレベルの信号を出力する。そして、論理回路22は、論理回路21の出力レベルを反転したレベルの信号を出力する。これにより、電界効果トランジスターN1がオンかつ電界効果トランジスターN2がオフの状態と、電界効果トランジスターN1がオフかつ電界効果トランジスターN2がオンの状態とが交互に設定される。
また、テストモードを設定するLレベルのテスト制御信号が入力された場合、論理回路21,22は、クロック信号に関係なく、常にHレベルの信号を出力する。これにより、電界効果トランジスターN1,N2をオンとする。
初期化回路30は、図11に示すように、Nチャネル型の電界効果トランジスターN1,N2と、コンデンサーC1,C2と、抵抗R1と、NOT回路31と、を備えている。
電界効果トランジスターN1,N2は、電源端子VSSとNOT回路31の入力端子との間に直列に接続されている。電界効果トランジスターN1のゲート電極は、論理回路22の出力端子に接続されている。電界効果トランジスターN2のゲート電極は、論理回路21の出力端子に接続されている。
コンデンサーC1は、電源端子VDDと、電界効果トランジスターN1および電界効果トランジスターN2の接続部との間に接続されている。コンデンサーC2は、電源端子VDDと、電界効果トランジスターN2およびNOT回路31の接続部A1との間に接続されている。抵抗R1は、電源端子VDDと、接続部A1との間に接続されている。
また、電界効果トランジスターN1がオンとなり、電界効果トランジスターN2がオフとなる場合、コンデンサーC1が充電される。そして、電界効果トランジスターN1がオフとなり、電界効果トランジスターN2がオンとなる場合、コンデンサーC1に蓄積された電荷が、コンデンサーC2に充電される。このコンデンサーC1の充電およびコンデンサーC2の充電が交互に繰り返されることで、接続部A1の電位が電源端子VSSの電位(VSS電位)に向かって低くなる。そして、接続部A1の電位が、NOT回路31の閾値以下になると、NOT回路31は、Hレベルの初期化制御信号を出力する。換言すると、初期化回路30は、コンデンサーC2の充電電圧が予め設定された閾値未満の場合、Lレベルの初期化制御信号を出力し、当該充電電圧が閾値以上の場合、Hレベルの初期化制御信号を出力する。
また、電界効果トランジスターN1,N2がオンの場合、コンデンサーC1,C2が充電され、接続部A1の電位がVSS電位となり、NOT回路31は、Hレベルの初期化制御信号を出力する。
次に、IC10の動作を、図12のタイミングチャートに沿って説明する。
図12に示すように、電子時計に電池がセットされて電池投入されたタイミングT1では、初期化回路30のコンデンサーC1,C2には電荷が蓄積されていないため、接続部A1の電位はVDD電位であり、NOT回路31からLレベルの初期化制御信号が出力される。
このため、コンデンサーC1,C2は充電されず、接続部A1の電位はVDD電位に維持される。したがって、NOT回路31からLレベルの初期化制御信号が継続して出力される。これにより、分周回路12、パルス形成回路13、ドライバー14の初期化処理が実行され、各回路12〜14が時刻表示モードに設定される。
そして、タイミングT3で、接続部A1の電位がNOT回路31の閾値以下となり、NOT回路31からHレベルの初期化制御信号が出力される。これにより、分周回路12、パルス形成回路13、ドライバー14の初期化処理が解除される。なお、各回路12〜14には、時刻表示モードが継続して設定されている。
また、コンデンサーC1,C2は充電状態が維持され、接続部A1の電位はVSS電位に維持される。したがって、NOT回路31からHレベルの初期化制御信号が継続して出力される。このため、分周回路12、パルス形成回路13、ドライバー14では、初期化処理が実行されない。
その後、タイミングT5で、各回路12,13,14のテストを行うため、テスト制御回路15の制御により、発振回路11においてクロック信号の出力処理が停止される。この場合も、接続部A1の電位はVSS電位に維持されるため、NOT回路31からはHレベルの初期化制御信号が継続して出力される。
すなわち、図13に示すように、電池投入時は、IC10のVDD電源端子に波形W1で示されるチャタリングが発生する場合がある。この場合、テスト制御信号の信号レベルは、HレベルおよびLレベルの間で繰り返し切り替わることがある。この結果、発振回路11からクロック信号が出力される前に、コンデンサーC2が充電され、接続部A1の電位がVSS電位となり、NOT回路31からHレベルの初期化制御信号が出力されてしまうことがある。このため、分周回路12、パルス形成回路13、ドライバー14を初期化できず、各回路12〜14において、時刻表示モードではなく、他の動作モードが意図せず設定されてしまい、各回路12〜14が正しく動作しないという問題がある。なお、このような問題は、テストモード以外の他の機能モードおよび非機能モードを設定する機能制御信号と、クロック信号とを用いて初期化回路30を制御する構成においても起こる場合がある。
そして、初期化制御回路は、発振回路からクロック信号が出力されると、初期化回路に初期化処理を解除する第2レベルの初期化制御信号を出力させる。これにより、入力制御回路によって、機能制御信号が初期化制御回路に入力される。そして、初期化制御回路は、初期化回路に第2レベルの初期化制御信号を継続して出力させる。
この構成によれば、電池投入時から、発振回路が動作してクロック信号が出力されるまで、機能制御信号の信号レベルに関係なく、初期化回路が第1レベルの初期化制御信号を出力するため、電池投入時、チャタリングが発生して機能制御信号の信号レベルが繰り返し変動した場合でも、内部回路の初期化処理を確実に実行でき、内部回路を所定の動作モードに設定できる。
そして、初期化制御回路が、コンデンサーの充電を制御することで、発振回路が動作してクロック信号が出力されるまで、初期化回路に第1レベルの初期化制御信号を継続して出力させ、クロック信号が出力された場合、初期化回路に第2レベルの初期化制御信号を出力させることができる。
また、本発明によれば、コンデンサーを用いた簡単な回路で初期化回路を構成できる。
以下、本発明の実施形態の電子時計1を図面に基づいて説明する。なお、上述した従来の電子時計と同じ構成については、同じ符号を付け、説明は省略する。
電子時計1は、図1に示すように、ユーザーの手首に装着される腕時計であり、外装ケース2と、円板状の文字板3と、図示略のムーブメントと、ムーブメント内に設けられたモーターで駆動される指針である秒針5、分針6、時針7と、操作部材であるりゅうず8およびボタン9とを備える。秒針5、分針6、時針7は、図示略のモーターによって駆動され、文字板3の目盛りを指示することで、秒、分、時を表示する。すなわち、各指針5〜7および文字板3は、時刻を表示する表示部を構成する。
初期状態固定回路16は、テスト制御信号が初期化制御回路20Aに入力していない場合、初期化制御回路20AにLレベルの初期状態固定信号を出力する。また、テスト制御信号が初期化制御回路20Aに入力している場合は、初期化制御回路20Aに初期状態固定信号を出力しない。本実施形態では、初期状態固定回路16に、定電流源が用いられている。
初期化制御回路20Aは、図3に示すように、論理回路23,24を備えている。論理回路23,24は、それぞれ、第1入力端子231,241および第2入力端子232,242と、1つの出力端子とを備えている。
論理回路23の第1入力端子231には、入力制御回路40の出力端子41(図4参照)および初期状態固定回路16である定電流源が接続され、第2入力端子232には、クロック信号が入力される。論理回路23の出力端子は、初期化回路30の電界効果トランジスターN2のゲート電極、および、論理回路24の第2入力端子242に接続されている。
論理回路24の第1入力端子241には、入力制御回路40の出力端子41および初期状態固定回路16が接続され、第2入力端子242には、論理回路23の出力端子が接続されている。論理回路24の出力端子は、初期化回路30の電界効果トランジスターN1のゲート電極に接続されている。
また、テスト制御信号が入力されずに、初期化状態固定信号が入力され、かつ、クロック信号が入力された場合、論理回路23は、クロック信号がLレベルからHレベルに変化する毎にLレベルの信号を出力し、クロック信号がHレベルからLレベルに変化する毎にHレベルの信号を出力する。そして、論理回路24は、論理回路23の出力レベルを反転したレベルの信号を出力する。これにより、電界効果トランジスターN1がオンかつ電界効果トランジスターN2がオフの状態と、電界効果トランジスターN1がオフかつ電界効果トランジスターN2がオンの状態とが交互に設定される。
また、初期化制御回路20Aでは、テストモード(機能モード)を設定するLレベルの信号が、入力制御回路40によって反転されて入力されている場合、論理回路23,24は、クロック信号に関係なく、常にHレベルの信号を出力する。これにより、電界効果トランジスターN1,N2をオンとする。
入力制御回路40は、クロックドインバーターによって構成され、図4に示すように、Nチャネル型の電界効果トランジスターN11,N12,N13と、Pチャネル型の電界効果トランジスターP11,P12,P13と、を備えている。
電界効果トランジスターP12,P13は、電源端子VDDと出力端子41との間に直列に接続されている。電界効果トランジスターN12,N13は、電源端子VSSと出力端子41との間に直列に接続されている。
電界効果トランジスターN13,P13のゲート電極には、テスト制御信号が入力される。電界効果トランジスターN12のゲート電極には、初期化制御信号が入力される。
電界効果トランジスターP11,N11は、電源端子VDDと電源端子VSSとの間に直列に接続されている。電界効果トランジスターP11,N11の接続部は、電界効果トランジスターP12のゲート電極に接続されている。電界効果トランジスターP11,N11のゲート電極には、初期化制御信号が入力される。
また、入力制御回路40では、Hレベルの初期化制御信号が入力された場合、電界効果トランジスターN12はオンとなる。また、電界効果トランジスターP11がオフとなり、電界効果トランジスターN11がオンとなる。これにより、電界効果トランジスターP12のゲート電極の電位がVSS電位となり、電界効果トランジスターP12がオンとなる。これにより、出力端子41が電源端子VDD,VSSと接続され、出力端子41からテスト制御信号の位相を反転した信号が出力される。すなわち、Hレベルのテスト制御信号が入力された場合、出力端子41からはLレベルの信号が出力される。ここで、入力制御回路40の電流を流す能力は、定電流源よりも大きく設定されている。このため、Lレベルのテスト制御信号が入力された場合、出力端子41からはHレベルの信号が出力される。
次に、IC10Aの動作を、図5のタイミングチャートに沿って説明する。
図5に示すように、電子時計1に電池がセットされて電池投入されたタイミングT1では、初期化回路30のコンデンサーC1,C2には電荷が蓄積されていないため、接続部A1の電位はVDD電位であり、NOT回路31からLレベルの初期化制御信号が出力される。
また、タイミングT1の直後、発振回路11は、クロック信号を出力していない。また、テスト制御回路15は、Hレベルの信号を出力することで、非テストモード(通常モード)を設定するテスト制御信号を出力する。
このため、コンデンサーC1,C2は充電されず、接続部A1の電位はVDD電位に維持される。したがって、NOT回路31からLレベルの初期化制御信号が継続して出力される。これにより、分周回路12、パルス形成回路13、ドライバー14の初期化処理が実行され、各回路12〜14が時刻表示モードに設定される。
そして、タイミングT3で、接続部A1の電位がNOT回路31の閾値以下となり、NOT回路31からHレベルの初期化制御信号が出力される。これにより、分周回路12、パルス形成回路13、ドライバー14の初期化処理が解除される。なお、各回路12〜14には、時刻表示モードが継続して設定されている。
これにより、入力制御回路40からHレベルの信号が出力される。このため、初期化制御回路20Aによって、接続部A1の電位はVSS電位に維持され、NOT回路31からHレベルの初期化制御信号が継続して出力される。
本実施形態によれば、電池投入時から、発振回路11が動作してクロック信号が出力されるまで、テスト制御信号の信号レベルに関係なく、初期化回路30がLレベルの初期化制御信号を出力するため、電池投入時、チャタリングが発生してテスト制御信号の信号レベルが繰り返し変動した場合でも、内部回路の初期化処理を確実に実行でき、内部回路を時刻表示モードに設定できる。
これにより、内部回路によって表示時刻が制御される電子時計1の信頼性を向上できる。
また、内部回路が初期化されずに誤動作することがないため、誤動作により消費電流が増大し、電池寿命が短くなることを抑制できる。
また、コンデンサーC1,C2を用いた簡単な回路で初期化回路30を構成できる。
なお、本発明は前述の実施形態に限定されるものではなく、本発明の目的を達成できる範囲での変形、改良等は本発明に含まれるものである。
ディレイ回路50には、例えばSRラッチを複数段接続した回路を用いることができる。この場合、ディレイ回路50は、例えば、図7に示すように、NAND回路51,52およびNOR回路53,54を備えて構成される。NAND回路51には、初期化制御信号と、NAND回路52の出力信号が入力される。NAND回路52には、クロック信号と、NAND回路51の出力信号が入力される。NOR回路53には、NAND回路51の出力信号と、NOR回路54の出力信号とが入力され、出力信号が出力端子55に出力される。NOR回路54には、クロック信号と、NOR回路53の出力信号とが入力される。
このディレイ回路50は、Lレベルの初期化制御信号が入力される場合、常にLレベルの信号を出力する。また、Hレベルの初期化制御信号が入力され、クロック信号が入力されていない場合、Lレベルの初期化制御信号を引き続き出力する。そして、この状態からクロック信号が入力されると、Hレベルの信号を出力する。これにより、クロック信号の1周期分、Hレベルの初期化制御信号を遅延させることができる。
このディレイ回路50が設けられることで、図8に示すように、タイミングT3で初期化回路30からHレベルの初期化制御信号が出力された時点では、ディレイ回路50からはLレベルの信号が出力されている。その後、クロック信号がHレベルからLレベルに変化したタイミングT3Aにおいて、ディレイ回路50からHレベルの信号が出力される。なお、ディレイ回路50によるディレイ時間は、SRラッチの段数に応じて変更できる。
上記構成によれば、初期化処理の時間を長くできるため、チャタリングが長い時間発生する場合でも、内部回路を確実に初期化できる。また、初期化回路30や初期化制御回路20Aなどの構成を変更する必要がないため、小規模な設計変更で初期化処理の時間を長くできる。
図9は、前記他の実施形態において、操作入力制御回路17を設けた場合の例を示す。例えば、図9に示すように、操作入力制御回路17はAND回路で構成され、1つの入力端子が操作入力端子P1に接続され、もう一方の入力端子に初期化制御信号が入力される。
この構成によれば、内部回路が初期化されている場合、テスト制御回路15に操作信号が入力されない。すなわち、操作信号にマスクし、テスト制御回路15が操作信号を取り込まないようにできる。このため、例えば、りゅうず8に対してテストモードを設定する操作(例えばりゅうず8を1段引く操作)が意図せず行われた場合でも、分周回路12、パルス形成回路13が初期化処理の実行中にテストモードに設定されることを回避できる。これにより、各回路12〜14の初期化処理を適切に実施できる。
また、初期化処理が実行されていない場合は、テスト制御回路15に操作信号が入力されるため、りゅうず8に対してテストモードを設定する操作が行われることで、テスト制御回路15からテストモードを設定するテスト制御信号を出力させることができ、各回路12,13をテストモードに設定できる。
この構成によれば、内部回路が初期化されている場合、ボタン9に対して各モードを設定する操作が意図せず行われた場合でも、内部回路が初期化処理の実行中に各モードに設定されることを回避できる。これにより、内部回路の初期化処理を適切に実施できる。
また、本発明は、電子時計だけではなく、時刻表示を行うリスト型機器や携帯電話などの電子機器に広く利用できる。
Claims (5)
- クロック信号を出力する発振回路と、
機能モードおよび非機能モードを設定する機能制御信号を出力する機能制御回路と、
内部回路と、
前記内部回路を初期化処理する第1レベル、および、前記初期化処理を解除する第2レベルに変化する初期化制御信号を出力する初期化回路と、
前記初期化回路を制御する初期化制御回路と、
前記機能制御信号の前記初期化制御回路への入力および非入力を切り替える入力制御回路と、
初期状態固定回路と、を備え、
前記初期化回路は、電池投入時に前記第1レベルの初期化制御信号を出力し、
前記入力制御回路は、前記第1レベルの初期化制御信号が出力された場合、前記機能制御信号を前記初期化制御回路に入力させず、前記第2レベルの初期化制御信号が出力された場合、前記機能制御信号を前記初期化制御回路に入力させ、
前記初期状態固定回路は、前記機能制御信号が前記初期化制御回路に入力されていない場合、前記初期化制御回路に初期状態固定信号を出力し、
前記初期化制御回路は、
前記初期状態固定信号が入力された場合、前記クロック信号が出力されるまで、前記初期化回路に前記第1レベルの初期化制御信号を継続して出力させ、
前記初期状態固定信号が入力され、かつ、前記クロック信号が出力された場合、前記初期化回路に前記第2レベルの初期化制御信号を出力させる
ことを特徴とする電子回路。 - 請求項1に記載の電子回路において、
前記初期化回路は、コンデンサーを備え、前記コンデンサーの充電電圧が予め設定された閾値未満の場合、前記第1レベルの初期化制御信号を出力し、前記充電電圧が前記閾値以上の場合、前記第2レベルの初期化制御信号を出力し、
前記初期化制御回路は、前記初期状態固定信号が入力された場合、前記クロック信号に応じて前記コンデンサーを充電させる
ことを特徴とする電子回路。 - 請求項1または請求項2に記載の電子回路において、
前記初期化回路から前記内部回路へ出力された前記初期化制御信号を遅延させるディレイ回路を備える
ことを特徴とする電子回路。 - 請求項1から請求項3のいずれか1項に記載の電子回路において、
操作部材の操作に応じた操作信号が入力される操作入力端子と、
前記操作信号の前記機能制御回路への入力および非入力を切り替える操作入力制御回路と、を備え、
前記機能制御回路は、前記操作信号に応じて、前記機能モードを設定する前記機能制御信号を出力し、
前記内部回路には、前記機能制御信号が入力され、
前記操作入力制御回路は、前記第1レベルの初期化制御信号が出力されている場合、前記操作信号を前記機能制御回路に入力させない
ことを特徴とする電子回路。 - 請求項1から請求項4のいずれか1項に記載の電子回路と、前記内部回路によって表示時刻が制御される表示部と、を備える
ことを特徴とする電子時計。
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