JP6621766B2 - 画素回路及びその駆動方法、並びに表示装置 - Google Patents
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Description
前記補償ユニットは前記駆動ユニットにおける駆動トランジスタの駆動電圧を調整して、前記駆動トランジスタの閾値電圧が前記発光ユニットに流れる電流に与える影響を解消し、前記データラインは前記駆動トランジスタにデータ信号を提供し、
前記キャパシティブタッチユニットはキャパシティブタッチ信号に基づいて相応の電気信号を生成し、前記データラインは前記キャパシティブタッチユニットに初期信号を提供し、前記読み取りラインは前記キャパシティブタッチ信号を読み取り、
前記光感応タッチユニットは光感応タッチ信号に基づいて相応の電気信号を生成し、前記データラインは前記光感応タッチユニットに初期信号を提供し、前記読み取りラインは前記光感応タッチ信号を読み取るというものである。
前記第1トランジスタのゲートと前記第2トランジスタのゲートが接続されて、前記発光制御信号ラインに接続され、前記第1トランジスタの第1極が前記第2トランジスタの第1極、高電圧端にそれぞれ接続され、前記第1トランジスタの第2極が前記第1駆動トランジスタの第1極に接続され、
前記第3トランジスタのゲートが第2走査ラインに接続され、前記第3トランジスタの第1極が前記第1キャパシタの一端、前記第1駆動トランジスタのゲートにそれぞれ接続され、前記第3トランジスタの第2極が前記第1駆動トランジスタの第1極に接続され、
前記第5トランジスタのゲートが第1走査ラインに接続され、前記第5トランジスタの第1極が低電位端に接続され、前記第5トランジスタの第2極が前記第1駆動トランジスタのゲートに接続され、
前記第7トランジスタのゲートが前記第2走査ラインに接続され、前記第7トランジスタの第1極が前記データラインに接続され、前記第7トランジスタの第2極が前記第1駆動トランジスタの第2極、前記第9トランジスタの第1極にそれぞれ接続され、
前記第9トランジスタのゲートと前記第10トランジスタのゲートが接続されて、前記発光制御信号ラインに接続され、前記第9トランジスタの第1極が前記第1駆動トランジスタの第2極に接続され、前記第9トランジスタの第2極が前記第1画素構造における発光ユニットに接続され、
前記第1キャパシタの一端が前記第1トランジスタの第1極に接続され、他端が前記第3トランジスタの第1極に接続され、
前記第2トランジスタの第2極が前記第2駆動トランジスタの第1極に接続され、
前記第4トランジスタのゲートが前記第3走査ラインに接続され、前記第4トランジスタの第1極が前記第2キャパシタの一端、前記第2駆動トランジスタのゲートにそれぞれ接続され、前記第4トランジスタの第2極が前記第2駆動トランジスタの第1極に接続され、
前記第6トランジスタのゲートが前記第1走査ラインに接続され、前記第6トランジスタの第1極が低電位端に接続され、前記第6トランジスタの第2極が前記第2駆動トランジスタのゲートに接続され、
前記第8トランジスタのゲートが前記第3走査ラインに接続され、前記第8トランジスタの第1極が前記データラインに接続され、前記第8トランジスタの第2極が前記第2駆動トランジスタの第2極、前記第10トランジスタの第1極にそれぞれ接続され、
前記第10トランジスタの第1極が前記第2駆動トランジスタの第2極に接続され、前記第10トランジスタの第2極が前記第2画素構造における発光ユニットに接続され、
前記第2キャパシタの一端が前記第2トランジスタの第1極に接続され、他端が前記第4トランジスタの第1極に接続される。
前記第1キャパシティブトランジスタのゲートが第1走査ラインに接続され、前記第1キャパシティブトランジスタの第1極が前記データラインに接続され、前記第1キャパシティブトランジスタの第2極は前記第2キャパシティブトランジスタのゲート、前記第3キャパシタの一端にそれぞれ接続され、
前記第2キャパシティブトランジスタの第1極が前記第3キャパシタの他端、基準電位端にそれぞれ接続され、前記第2キャパシティブトランジスタの第2極が前記第3キャパシティブトランジスタの第2極に接続され、
前記第3キャパシティブトランジスタのゲートが前記光感応タッチユニットに接続され、前記第3キャパシティブトランジスタの第1極が前記読み取りラインに接続される。
前記第1光感応トランジスタのゲートが前記第1走査ラインに接続され、前記第1光感応トランジスタの第1極が低電位端に接続され、前記第1光感応トランジスタの第2極が前記第2光感応トランジスタの第2極、前記第4光感応トランジスタのゲート及び第1極にそれぞれ接続され、
前記第2光感応トランジスタのゲートが前記キャパシティブタッチユニットにおける前記第3キャパシティブトランジスタのゲートに接続され、前記第2光感応トランジスタの第1極が前記データラインに接続され、前記第2光感応トランジスタの第2極が前記第4光感応トランジスタの第1極に接続され、
前記第3光感応トランジスタのゲートが前記第3走査ラインに接続され、前記第3光感応トランジスタの第1極が前記第4光感応トランジスタの第2極に接続され、前記第3光感応トランジスタの第2極が前記読み取りラインに接続され、
前記第4キャパシタの一端が前記第4光感応トランジスタのゲートに接続され、他端が前記第4光感応トランジスタの第2極に接続される。
前記第2画素構造における発光ユニットは第2有機発光ダイオードを含み、前記第2有機発光ダイオードのアノードが前記第10トランジスタの第2極に接続され、前記第2有機発光ダイオードのカソードが低電位端に接続される。
好ましくは、隣接する前記第1画素構造と前記第2画素構造は同一の画素ユニットの隣り合うサブ画素ユニットである。
前記データラインがリセット信号を提供し、前記補償ユニットが前記駆動ユニットをリセットすると同時に、前記キャパシティブタッチユニットと前記光感応タッチユニットがリセットされるリセット段階と、
前記データラインが第1駆動信号を提供し、前記第1画素構造における補償ユニットが放電し、前記キャパシティブタッチユニットがキャパシティブタッチ信号の増幅と収集を行い、前記キャパシティブタッチ信号が前記読み取りラインを介してタッチ実行ユニットに伝送され、前記光感応タッチユニットが初期信号を植え込む第1駆動段階と、
前記データラインが第2駆動信号を提供し、前記第2画素構造における補償ユニットが放電し、前記キャパシティブタッチユニットがタッチを滞留させ、前記光感応タッチユニットが光感応タッチ信号の増幅と収集を行い、前記光感応タッチ信号が前記読み取りラインを介してタッチ実行ユニットに伝送される第2駆動段階と、
発光制御信号ラインが発光信号を提供し、前記キャパシティブタッチユニットと前記光感応タッチユニットがタッチを滞留させ、前記第1画素構造と前記第2画素構造における駆動ユニットが前記発光ユニットの発光をそれぞれ駆動する発光段階と、を含む。
本実施例では、画素回路及び該画素回路に対応する駆動方法を提供する。
データラインがリセット信号を提供し、補償ユニットが駆動ユニットをリセットすると同時に、キャパシティブタッチユニットと光感応タッチユニットがリセットされるリセット段階と、
データラインが第1駆動信号を提供し、第1画素構造における補償ユニットが放電し、キャパシティブタッチユニットがキャパシティブタッチ信号の増幅と収集を行い、前記キャパシティブタッチ信号が読み取りラインを介してタッチ実行ユニットに伝送され、光感応タッチユニットが初期信号を植え込む第1駆動段階と、
データラインが第2駆動信号を提供し、第2画素構造における補償ユニットが放電し、キャパシティブタッチユニットがタッチを滞留させ、光感応タッチユニットが光感応タッチ信号の増幅と収集を行い、光感応タッチ信号が読み取りラインを介してタッチ実行ユニットに伝送される第2駆動段階と、
発光制御信号ラインが発光信号を提供し、キャパシティブタッチユニットと光感応タッチユニットがタッチを滞留させ、第1画素構造と第2画素構造における駆動ユニットが発光ユニットの発光をそれぞれ駆動する発光段階と、を含む。
IOLED1=K(VGS-Vth)2=K[Vdd-(V1-Vth1)-Vth1]2=K(Vdd-V1)2
同様に、OLED2に流れる電流を以下の通り得られる。
IOLED2=K(Vdd-V2)2
本実施例では、実施例1における画素回路を含む表示装置を提供する。
2…… 補償ユニット
3…… 発光ユニット
4…… キャパシティブタッチユニット
5…… 光感応タッチユニット
Claims (10)
- 画素構造毎に、駆動ユニット、補償ユニット及び発光ユニットを有する、複数の画素構造を含む画素回路であって、
隣接する第1画素構造と第2画素構造において、前記第1画素構造はキャパシティブタッチユニットを、前記第2画素構造は光感応タッチユニットをさらに含み、且つ、前記第1画素構造における補償ユニット、前記第2画素構造における補償ユニット、前記キャパシティブタッチユニット及び前記光感応タッチユニットがデータラインを共有し、前記キャパシティブタッチユニットと前記光感応タッチユニットが読み取りラインを共有し、
前記補償ユニットは前記駆動ユニットにおける駆動トランジスタの駆動電圧を調整して、前記駆動トランジスタの閾値電圧が前記発光ユニットに流れる電流に与える影響を解消し、前記データラインは前記駆動トランジスタにデータ信号を提供し、
前記キャパシティブタッチユニットはキャパシティブタッチ信号に基づいて相応の電気信号を生成し、前記データラインは前記キャパシティブタッチユニットに初期信号を提供し、前記読み取りラインは前記キャパシティブタッチ信号を読み取り、
前記光感応タッチユニットは光感応タッチ信号に基づいて相応の電気信号を生成し、前記データラインは前記光感応タッチユニットに初期信号を提供し、前記読み取りラインは前記光感応タッチ信号を読み取る
ことを特徴とする画素回路。 - 前記第1画素構造における補償ユニットと前記第2画素構造における補償ユニットの構造が同一、且つ対称に配置され、前記データラインは、前記第1画素構造における補償ユニットと前記第2画素構造における補償ユニットとの間に配置され、且つ、前記第1画素構造における補償ユニットと前記第2画素構造における補償ユニットにそれぞれ接続される
ことを特徴とする、請求項1に記載の画素回路。 - 前記第1画素構造における駆動ユニットは第1駆動トランジスタを、前記第2画素構造における駆動ユニットは第2駆動トランジスタを含み、前記第1駆動トランジスタと前記第2駆動トランジスタの構造が同一、且つ対称に配置され、前記データラインは、前記第1駆動トランジスタと前記第2駆動トランジスタとの間に位置し、且つ、前記第1駆動トランジスタと前記第2駆動トランジスタにそれぞれ接続される
ことを特徴とする、請求項2に記載の画素回路。 - 前記第1画素構造における補償ユニットは第1トランジスタ、第3トランジスタ、第5トランジスタ、第7トランジスタ、第9トランジスタ及び第1キャパシタを含み、前記第2画素構造における補償ユニットは第2トランジスタ、第4トランジスタ、第6トランジスタ、第8トランジスタ、第10トランジスタ及び第2キャパシタを含み、前記画素回路は第1走査ライン、第2走査ライン、第3走査ライン及び発光制御信号ラインをさらに含み、
前記第1トランジスタのゲートと前記第2トランジスタのゲートが接続されて、前記発光制御信号ラインに接続され、前記第1トランジスタの第1極が前記第2トランジスタの第1極、高電圧端にそれぞれ接続され、前記第1トランジスタの第2極が前記第1駆動トランジスタの第1極に接続され、
前記第3トランジスタのゲートが第2走査ラインに接続され、前記第3トランジスタの第1極が前記第1キャパシタの第1端、前記第1駆動トランジスタのゲートにそれぞれ接続され、前記第3トランジスタの第2極が前記第1駆動トランジスタの第1極に接続され、
前記第5トランジスタのゲートが第1走査ラインに接続され、前記第5トランジスタの第1極が低電位端に接続され、前記第5トランジスタの第2極が前記第1駆動トランジスタのゲートに接続され、
前記第7トランジスタのゲートが前記第2走査ラインに接続され、前記第7トランジスタの第1極が前記データラインに接続され、前記第7トランジスタの第2極が前記第1駆動トランジスタの第2極、前記第9トランジスタの第1極にそれぞれ接続され、
前記第9トランジスタのゲートと前記第10トランジスタのゲートが接続されて、前記発光制御信号ラインに接続され、前記第9トランジスタの第1極が前記第1駆動トランジスタの第2極に接続され、前記第9トランジスタの第2極が前記第1画素構造における発光ユニットに接続され、
前記第1キャパシタの第1端が前記第3トランジスタの第1極に接続され、第2端が前記第1トランジスタの第1極に接続され、
前記第2トランジスタの第2極が前記第2駆動トランジスタの第1極に接続され、
前記第4トランジスタのゲートが前記第3走査ラインに接続され、前記第4トランジスタの第1極が前記第2キャパシタの第1端、前記第2駆動トランジスタのゲートにそれぞれ接続され、前記第4トランジスタの第2極が前記第2駆動トランジスタの第1極に接続され、
前記第6トランジスタのゲートが前記第1走査ラインに接続され、前記第6トランジスタの第1極が低電位端に接続され、前記第6トランジスタの第2極が前記第2駆動トランジスタのゲートに接続され、
前記第8トランジスタのゲートが前記第3走査ラインに接続され、前記第8トランジスタの第1極が前記データラインに接続され、前記第8トランジスタの第2極が前記第2駆動トランジスタの第2極、前記第10トランジスタの第1極にそれぞれ接続され、
前記第10トランジスタの第1極が前記第2駆動トランジスタの第2極に接続され、前記第10トランジスタの第2極が前記第2画素構造における発光ユニットに接続され、
前記第2キャパシタの第1端が前記第4トランジスタの第1極に接続され、第2端が前記第2トランジスタの第1極に接続される
ことを特徴とする、請求項3に記載の画素回路。 - 前記キャパシティブタッチユニットは第1キャパシティブトランジスタ、第2キャパシティブトランジスタ、第3キャパシティブトランジスタ及び第3キャパシタを含み、
前記第1キャパシティブトランジスタのゲートが第1走査ラインに接続され、前記第1キャパシティブトランジスタの第1極が前記データラインに接続され、前記第1キャパシティブトランジスタの第2極は前記第2キャパシティブトランジスタのゲート、前記第3キャパシタの一端にそれぞれ接続され、
前記第2キャパシティブトランジスタの第1極が前記第3キャパシタの他端、基準電位端にそれぞれ接続され、前記第2キャパシティブトランジスタの第2極が前記第3キャパシティブトランジスタの第2極に接続され、
前記第3キャパシティブトランジスタのゲートが前記光感応タッチユニットに接続され、前記第3キャパシティブトランジスタの第1極が前記読み取りラインに接続される
ことを特徴とする、請求項4に記載の画素回路。 - 前記光感応タッチユニットは第1光感応トランジスタ、第2光感応トランジスタ、第3光感応トランジスタ、第4光感応トランジスタ及び第4キャパシタを含み、
前記第1光感応トランジスタのゲートが前記第1走査ラインに接続され、前記第1光感応トランジスタの第1極が低電位端に接続され、前記第1光感応トランジスタの第2極が前記第2光感応トランジスタの第2極、前記第4光感応トランジスタのゲート及び第1極にそれぞれ接続され、
前記第2光感応トランジスタのゲートが前記キャパシティブタッチユニットにおける前記第3キャパシティブトランジスタのゲートに接続され、前記第2光感応トランジスタの第1極が前記データラインに接続され、前記第2光感応トランジスタの第2極が前記第4光感応トランジスタの第1極に接続され、
前記第3光感応トランジスタのゲートが前記第3走査ラインに接続され、前記第3光感応トランジスタの第1極が前記第4光感応トランジスタの第2極に接続され、前記第3光感応トランジスタの第2極が前記読み取りラインに接続され、
前記第4キャパシタの一端が前記第4光感応トランジスタのゲートに接続され、他端が前記第4光感応トランジスタの第2極に接続される
ことを特徴とする、請求項5に記載の画素回路。 - 前記第1画素構造における発光ユニットは第1有機発光ダイオードを含み、前記第1有機発光ダイオードのアノードが前記第9トランジスタの第2極に接続され、前記第1有機発光ダイオードのカソードが低電位端に接続され、
前記第2画素構造における発光ユニットは第2有機発光ダイオードを含み、前記第2有機発光ダイオードのアノードが前記第10トランジスタの第2極に接続され、前記第2有機発光ダイオードのカソードが低電位端に接続される
ことを特徴とする、請求項6に記載の画素回路。 - 前記第1トランジスタから前記第10トランジスタ、前記第1光感応トランジスタから前記第4光感応トランジスタ、前記第1キャパシティブトランジスタから前記第3キャパシティブトランジスタ、及び前記第1駆動トランジスタ、前記第2駆動トランジスタはいずれもP型薄膜トランジスタであり、そのうち、第1極はソース、第2極はドレインである
ことを特徴とする、請求項7に記載の画素回路。 - 請求項1〜8のいずれか一項に記載の画素回路を含む
ことを特徴とする表示装置。 - 隣接する前記第1画素構造と前記第2画素構造は同一の画素ユニットの隣り合うサブ画素ユニットである
ことを特徴とする、請求項9に記載の表示装置。
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