CN111063301B - 像素电路及其驱动方法、阵列基板及显示装置 - Google Patents

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Abstract

本发明的实施例提供一种像素电路及其驱动方法、阵列基板及显示装置，涉及显示技术领域，可以提高显示效果。一种像素电路，包括：第一子像素电路和第二子像素电路；第一子像素电路和第二子像素电路均包括：重置子电路、写入补偿子电路、驱动子电路、发光控制子电路和发光器件；重置子电路配置为在第一重置控制端的控制下，将初始电压端提供的电压输入至驱动子电路；写入补偿子电路配置为在写入控制端的控制下，将数据端输出的信号写入驱动子电路，以对驱动子电路进行阈值电压补偿；发光控制子电路配置为在使能端的控制下，导通第一电源电压端和第二电源电压端之间的电流通路，并将驱动子电路提供的驱动电流传输至发光器件。

Description

像素电路及其驱动方法、阵列基板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、阵列基板及显示装置。
背景技术
有机电致发光二极管(Organic Light Emitting Diode，OLED)显示装置是目前研究领域的热点之一，OLED具有低能耗、生产成本低、自发光、宽视角及相应速度快等优点。
虽然OLED具有诸多优点，但是其驱动晶体管在制作过程中，由于工艺偏差会导致不同位置的驱动晶体管的阈值电压存在差异。并且随着工作时间延长及使用环境改变，驱动晶体管的阈值电压会发生漂移。同时，各像素所处的位置不同会导致电源的压降(IRDrop)不同，对驱动OLED的电流产生影响。如果不能对阈值电压和电源IR Drop进行补偿，则会导致OLED显示器的发光不均匀，使显示画面的观感变差。
现有的像素电路补偿技术中，多数为PMOS电压补偿技术，每个子像素需要独立的电源信号线和数据信号线，导致在空间走线上，信号线距离不足，从而造成线不良。
随着显示装置的分辨率不断增加，电源信号线和数据信号线的距离会不断减小，进一步加剧线不良发生的风险，影响良率。
发明内容
本发明的实施例提供一种像素电路及其驱动方法、阵列基板及显示装置，能够提高显示效果。
为达到上述目的，本发明的实施例采用如下技术方案：
一方面，提供一种像素电路，包括：设置于第一子像素的第一子像素电路和第二子像素的第二子像素电路；所述第一子像素与所述第二子像素相邻；所述第一子像素电路和所述第二子像素电路均包括：重置子电路、写入补偿子电路、驱动子电路、发光控制子电路和发光器件；其中，所述重置子电路与第一重置控制端、初始电压端和所述驱动子电路电连接，所述重置子电路配置为在第一重置控制端的控制下，将所述初始电压端提供的电压输入至所述驱动子电路；写入补偿子电路与写入控制端、数据端和所述驱动子电路电连接；写入补偿子电路配置为在写入控制端的控制下，将所述数据端输出的信号写入所述驱动子电路，以对所述驱动子电路进行阈值电压补偿；发光控制子电路与使能端、所述第一电源电压端、所述驱动子电路以及发光器件电连接；所述发光器件还与第二电源电压端电连接；所述发光控制子电路配置为在所述使能端的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件；其中，所述第一子像素电路的第一重置控制端和写入控制端依次连接第一扫描信号端和第二扫描信号端；所述第二子像素电路的第一重置控制端和写入控制端依次连接所述第二扫描信号端和第三扫描信号端。
可选地，所述像素电路还包括设置于第三子像素的第三子像素电路；所述第三子像素与所述第一子像素分别位于相邻两行；所述第三子像素电路包括：所述重置子电路、所述写入补偿子电路、所述驱动子电路、所述发光控制子电路和所述发光器件；其中，所述第三子像素电路的所述第一重置控制端和所述写入控制端依次连接所述第三扫描信号端和第四扫描信号端。
可选地，所述重置子电路与第二重置控制端、所述发光器件电连接；所述重置子电路还配置为在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；其中，所述第一子像素电路的第二重置控制端连接第三扫描信号端；所述第二子像素电路的第二重置控制端连接第四扫描信号端；在所述像素电路包括第三子像素电路的情况下，所述第三子像素电路的第二重置控制端连接第五扫描信号端。
可选地，所述驱动子电路包括驱动晶体管；所述驱动晶体管的栅极与所述重置子电路电连接；第一极、第二极均与所述写入补偿子电路和所述发光控制子电路电连接。
可选地，所述驱动子电路还包括电容；所述电容的第一端与所述驱动晶体管的栅极电连接，第二端与所述第一电源电压端电连接。
可选地，所述重置子电路包括第一晶体管和第二晶体管；所述第一晶体管的栅极与所述第一重置控制端电连接，第一极与所述初始电压端电连接，第二极与所述驱动晶体管的栅极电连接；所述第二晶体管的栅极与所述第二重置控制端电连接，第一极与所述初始电压端电连接，第二极与所述发光器件电连接。
可选地，所述写入补偿子电路包括第三晶体管和第四晶体管；所述第三晶体管的栅极与所述写入控制端电连接；第一极与所述驱动晶体管的栅极电连接，第二极与所述驱动晶体管的第二极电连接；所述第四晶体管的栅极与所述写入控制端电连接；第一极与所述驱动晶体管的第一极电连接，第二极与所述数据端电连接。
可选地，所述发光控制子电路包括第五晶体管和第六晶体管；所述第五晶体管的栅极与所述使能端电连接，第一极与所述驱动晶体管的第二极电连接，第二极与所述发光器件电连接；所述第六晶体管的栅极与所述使能端电连接，第一极与所述第一电源电压端电连接，第二极与所述驱动晶体管的第一极电连接。
再一方面，提供一种阵列基板，其特征在于，包括：衬底，以及设置在所述衬底上的如上所述的像素电路；所述像素电路对应多个子像素；所述阵列基板还包括：多条扫描信号线、多条初始信号线、多条使能信号线、多条数据信号线、以及多条第一电源电压信号线；每两排子像素共用一条数据信号线；多条所述扫描信号线同层设置；多条所述初始信号线和多条所述使能信号线同层设置；多条所述数据信号线和多条所述第一电源电压信号线同层且平行设置。
另一方面，提供一种显示装置，包括如上所述的阵列基板。
又一方面，提供一种如上所述的像素电路的驱动方法，包括:在第一扫描阶段，第一子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；在第二扫描阶段，所述第一子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；第二子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；在第三扫描阶段，所述第二子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；在发光阶段，所述第一子像素电路和所述第二子像素电路中的发光控制子电路在所述使能端的电压的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件。
可选地，在所述像素电路还包括设置于第三子像素的第三子像素电路的情况下，所述像素电路的驱动方法还包括：在所述第三扫描阶段，第三子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；在第四扫描阶段，所述第三子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；在发光阶段，所述第三子像素电路中的发光控制子电路在所述使能端的电压的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件。
可选地，所述像素电路的驱动方法还包括：在所述第三扫描阶段，所述第一子像素电路中的所述重置子电路在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；在所述第四扫描阶段，所述第二子像素电路中的所述重置子电路在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；在所述像素电路还包括设置于第三子像素的第三子像素电路的情况下，在第五扫描阶段，所述第三子像素电路中的所述重置子电路在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件。
本发明的实施例提供一种像素电路及其驱动方法、阵列基板及显示装置，像素电路包括设置于第一子像素的第一子像素电路和设置于第二子像素的第二子像素电路，第一子像素和第二子像素相邻，第一子像素电路和第二子像素电路的结构相同，基于此，通过设置第一子像素电路的第一重置控制端和写入控制端依次连接第一扫描信号端和第二扫描信号端，第二子像素电路的第一重置控制端和写入控制端依次连接第二扫描信号端和第三扫描信号端，使得第一子像素电路和第二子像素电路可以错位开启，在不同时间段写入数据端输出的信号，从而在实现阈值电压补偿的基础上，实现相邻两个子像素共用数据信号线。由于相邻两排子像素可以共用数据信号线，减少了数据信号线数量，达到了降低数据信号线与第一电源电压信号线的走线排布密度的目的，从而降低了X亮线发生的风险；在走线排布密度降低的基础上，可以适当增加数据信号线的关键尺寸，改善数据信号的传输，提高显示效果。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为现有技术提供的一种像素电路的示意图；
图2为X亮线不良发生率示意图；
图3a为本发明提供的一种像素电路的结构示意图；
图3b为本发明提供的另一种像素电路的结构示意图；
图3c为图3b所述像素电路的各个子电路的具体结构示意图；
图4a为本发明提供的另一种像素电路的结构示意图；
图4b为本发明提供的又一种像素电路的结构示意图；
图4c为图4b所述像素电路的各个子电路的具体结构示意图；
图5a为本发明提供的又一种像素电路的结构示意图；
图5b为本发明提供的又一种像素电路的结构示意图；
图5c为图5b所述像素电路的各个子电路的具体结构示意图；
图6为本发明提供一种阵列基板的结构示意图；
图7为图5c所示像素电路的各个子电路的时序电路图；
图8a-图8g为图5c所示的像素电路在各个阶段时的等效电路图；
图9为发光器件的电流示意图；
图10为图5c的结构示意图；
图11为本发明提供的一种显示装置的结构示意图；
图12为本发明提供的一种像素电路的驱动方法流程示意图。
附图标记：
1-显示装置；2-阵列基板；3-衬底；10-像素电路；100-第一子像素电路；200-第二子像素电路；300-第三子像素电路；400-第四子像素电路；101-重置子电路；102-写入补偿子电路；103-驱动子电路；104-发光控制子电路；L-发光器件；P-子像素；Rst1-第一重置控制端；Rst2-第二重置控制端；Input-写入控制端；Vint-初始电压端；Data-数据端；EM-使能端；VDD-第一电源电压端；VSS-第二电源电压端；S1-第一扫描信号端；S2-第二扫描信号端；S3-第三扫描信号端；S4-第四扫描信号端；S5-第五扫描信号端；S6-第五扫描信号端。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
在现有技术中，如图1所示，阵列基板2包括多个呈阵列排布的子像素P。每个子像素P对应设置一个子像素电路。该子像素电路例如可以为7T1C型的子像素电路。
阵列基板2还包括：多对扫描信号线、多条数据信号线，多条使能信号线、多条初始电压信号线、多条第一电源电压信号线以及多条第二电源电压信号线。
同一行子像素对应的各子像素电路与同一对扫描信号线、同一条使能信号线电连接。该多对扫描信号线用于分别为扫描信号端S11-S1N、S21-S2N(N大于等于1的正整数)提供扫描信号；多条使能信号线EM用于为使能端EM提供使能信号。
同一列子像素对应的各子像素电路与同一条数据信号线、同一初始电压信号线、同一条第一电源电压信号线及同一条第二电源电压信号线电连接。该数据信号线用于为数据端Data提供数据信号；该多条第一电源电压信号线用于为电源电压端VDD提供电源电压信号；该多条第二电源电压信号线用于为第二电源电压端VSS提供电源电压信号；该多条初始电压信号线用于为初始信号端Vint提供初始电压信号。
由于数据信号线与第一电源电压信号线之间的距离不足，导致在空间走线上，两条信号线之间距离较短，容易短路，从而出现X亮线不良，影响良率。
其中，X亮线(X-Line)不良的发生率与数据信号线和第一电源电压信号线之间的距离存在明显的线性相关性。示例的，如图2所示，以Cupid和Panda产品为例，源漏掩膜工艺(SD Mask)中，在对显影曝光之后关键尺寸(Critical Dimension,CD)的检测和最终关键尺寸的检测中，可以明显看到，随着关键尺寸变大，即，数据信号线与第一电源电压信号线之间的距离变小，X亮线的发生率将变大。因此，设计一款既能稳定补偿阈值电压，又能简化走线的电路结构尤为重要。
基于此，本发明的实施例提供一种像素电路，如图3a和图4a所示，设置于第一子像素的第一子像素电路100和第二子像素的第二子像素电路200；第一子像素与第二子像素相邻。
第一子像素电路100和第二子像素电路200均包括：重置子电路101、写入补偿子电路102、驱动子电路103、发光控制子电路104和发光器件L。
可以理解的是，第一子像素与第二子像素的位置可以为同行相邻两个子像素，或者，为同列相邻两个子像素。第一子像素电路100和第二子像素电路200的电路结构完全相同。
其中，重置子电路101与第一重置控制端Rst1、初始电压端Vint和驱动子电路103电连接；重置子电路101配置为在第一重置控制端Rst1的控制下，将初始电压端Vint提供的电压输入至驱动子电路103。
写入补偿子电路102与写入控制端Input、数据端Data和驱动子电路103电连接；写入补偿子电路102配置为在写入控制端Input的控制下，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。
可以理解的是，针对每个子像素电路中的驱动子电路103，数据端Data输出的信号可以相同，也可以不同。
发光控制子电路104与使能端EM、第一电源电压端VDD、驱动子电路103以及发光器件L电连接；发光器件L还与第二电源电压端VSS电连接；发光控制子电路104配置为在使能端EM的控制下，导通第一电源电压端VDD和第二电源电压端VSS之间的电流通路，并将驱动子电路103提供的驱动电流传输至发光器件L。
需要说明的是，发光控制子电路104与发光器件L的阳极(正极)连接，发光器件L的阴极(负极)与第二电源电压端VSS电连接，这样，当发光控制子电路104在使能端EM的控制下，导通第一电源电压端VDD和第二电源电压端VSS之间的电流通路时，驱动子电路103提供的驱动电流将传输至发光器件L，以驱动发光器件L发光。
第一电源电压端VDD可以为高电平端，输出恒定的高电压；第二电源电压端VSS为低电平端，输出恒定的低电压。此处的“高”、“低”仅表示输入的电压之间的相对大小关系。第二电源电压端VSS也可接地。
发光器件L可以为OLED，还可以为微型发光二极管(Micro LED)或者迷你发光二极管(Mini LED)等。
其中，第一子像素电路100的第一重置控制端Rst1和写入控制端Input依次连接第一扫描信号端S1和第二扫描信号端S2。
第二子像素电路200的第一重置控制端Rst1和写入控制端Input依次连接第二扫描信号端S2和第三扫描信号端S3。
可以理解的是，由于第一子像素电路100和第二子像素电路200的第一重置控制端Rst1和写入控制端Input顺次连接不同的扫描信号端，并且在扫描信号端依次输出扫描信号的情况下，在任一个扫描信号的触发下，第一子像素电路100和第二子像素电路200均处于不同的状态。
例如，当第一扫描信号端S1、第二扫描信号端S2和第三扫描信号端S3依次输出扫描信号时，第一子像素电路100和第二子像素电路200对应的状态如下：
当第一扫描信号端S1输出扫描信号时，第一子像素电路100的第一重置控制端Rst1接收到第一扫描信号端S1的扫描信号，将初始电压端Vint提供的电压输入至驱动子电路103。第二子像素电路200未工作。
当第二扫描信号端S2输出扫描信号时，第一子像素电路100和第二子像素电路200同时接收到第二扫描信号端S2的扫描信号，虽然，第一子像素电路100和第二子像素电路200同时工作，但是由于第二扫描信号端S2分别电连接第一子像素电路100中的写入控制端Input和第二子像素电路200中的第一重置控制端Rst1，因此，第一子像素电路100中的驱动子电路103写入数据端Data输出的信号，以对驱动子电路103进行阈值电压补偿；而第二子像素电路200的驱动子电路103输入初始电压端Vint提供的电压。
当第三扫描信号端S3输出扫描信号时，第二子像素电路200的写入控制端Input接收到第三扫描信号端S3的扫描信号，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。
由此，通过不同的扫描信号可以控制相邻两个子像素所对应的子像素电路，使得两个子像素电路在不同时间段写入数据端输出的信号，进行阈值电压补偿，由于写入状态的发生时间不同，因此，相邻两个子像素可以共用数据信号线。
在上述基础上，通过不同的扫描信号控制相邻两排子像素(两排子像素指的是两行子像素或者两列子像素)，使得相邻两排子像素可以在不同时间段进行阈值电压补偿，进而使得相邻两排子像素可以共用数据信号线。
本发明的实施例提供一种像素电路，包括设置于第一子像素的第一子像素电路100和设置于第二子像素的第二子像素电路200，第一子像素和第二子像素相邻，第一子像素电路100和第二子像素电路200的结构相同，基于此，通过设置第一子像素电路100的第一重置控制端Rst1和写入控制端Input依次连接第一扫描信号端S1和第二扫描信号端S2，第二子像素电路200的第一重置控制端Rst1和写入控制端Input依次连接第二扫描信号端S2和第三扫描信号端S3，使得第一子像素电路100和第二子像素电路200可以错位开启，在不同时间段写入数据端输出的信号，从而在实现阈值电压补偿的基础上，实现相邻两个子像素共用数据信号线。由于相邻两排子像素可以共用数据信号线，减少了数据信号线数量，达到了降低数据信号线与第一电源电压信号线的走线排布密度的目的，从而降低了X亮线发生的风险；在走线排布密度降低的基础上，可以适当增加数据信号线的关键尺寸，改善数据信号的传输，提高显示效果。
可选地，如图4a所示，像素电路还包括设置于第三子像素的第三子像素电路300；第三子像素与第一子像素分别位于相邻两行。
第三子像素电路包括：重置子电路101、写入补偿子电路102、驱动子电路103、发光控制子电路104和发光器件L。
可以理解的是，当相邻的第一子像素和第二子像素的排布方向不同时，与第一子像素分别位于相邻两行的第三子像素的位置不同。
示例一，第一子像素位于第一行第一列，第二子像素位于第一行第二列，第三子像素位于第二行第一列；示例二，第一子像素位于第一行第一列，第二子像素位于第一行第二列，第三子像素位于第二行第二列；示例三，第一子像素位于第一行第一列，第二子像素位于第二行第一列，第三子像素位于第一行第二列；示例四，第一子像素位于第一行第一列，第二子像素位于第二行第一列，第三子像素位于第二行第二列。
此处，第一子像素电路100、第二子像素电路200和第三子像素电路300的电路结构相同。
其中，第三子像素电路300的第一重置控制端Rst1和写入控制端Input依次连接第三扫描信号端S3和第四扫描信号端S4。
可以理解的是，由于第一子像素电路100、第二子像素电路200、第三子像素电路300的第一重置控制端Rst1和写入控制端Input顺次连接不同的扫描信号端，并且在扫描信号端依次输出扫描信号的情况下，在任一个扫描信号的触发下，第一子像素电路100、第二子像素电路200和第三子像素电路300均处于不同的状态。
例如，当第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3和第四扫描信号端S4依次输出扫描信号时，第一子像素电路100、第二子像素电路200和第三子像素电路300对应的状态如下：
当第一扫描信号端S1输出扫描信号时，第一子像素电路100的第一重置控制端Rst1接收到第一扫描信号端S1的扫描信号，将初始电压端Vint提供的电压输入至驱动子电路103。第二子像素电路200和第三子像素子电路300未工作。
当第二扫描信号端S2输出扫描信号时，第一子像素电路100和第二子像素电路200同时接收到第二扫描信号端S2的扫描信号，虽然，第一子像素电路100和第二子像素电路200同时工作，但是由于第二扫描信号端S2分别电连接第一子像素电路100中的写入控制端Input和第二子像素电路200中的第一重置控制端Rst1，因此，第一子像素电路100中的驱动子电路103写入数据端Data输出的信号，以对驱动子电路103进行阈值电压补偿；而第二子像素电路200的驱动子电路103输入初始电压端Vint提供的电压。此时，第三子像素电路300未工作。
当第三扫描信号端S3输出扫描信号时，第二子像素电路200和第三子像素电路300同时接收到第三扫描信号端S3的扫描信号，虽然，第二子像素电路200和第三子像素电路300同时工作，但是由于第三扫描信号端S3分别电连接第二子像素电路200中的写入控制端Input和第三子像素电路300中的第一重置控制端Rst1，因此，第二子像素电路200中的驱动子电路103写入数据端Data输出的信号，以对驱动子电路103进行阈值电压补偿；而第三子像素电路300的驱动子电路103输入初始电压端Vint提供的电压。
当第四扫描信号端S4输出扫描信号时，第三子像素电路300的写入控制端Input接收到第四扫描信号端S4的扫描信号，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。
由此，通过不同的扫描信号可以控制2×2子像素中的其中三个子像素所对应的子像素电路，使得三个子像素电路在不同时间段进行阈值电压补偿，由于写入状态的发生时间不同，因此，该三个子像素可以共用数据信号线。
在上述基础上，如图5a所示，若2×2子像素中的另一个子像素为第四子像素，设置于第四子像素的第四子像素电路400与其他子像素电路结构相同。第四子像素电路400的第一重置控制端Rst1和写入控制端Input依次连接第四扫描信号端S4和第五扫描信号端S5。
此时，将第二子像素电路200、第三子像素电路300和第四子像素电路400当作第一子像素电路100、第二子像素电路和第三子像素电路，将第二扫描信号端S2、第三扫描信号端S3、第四扫描信号端和第五扫描信号端S5当作第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3和第四扫描信号端S4，第二子像素电路200、第三子像素电路300和第四子像素电路400对应的状态如下：
当第二扫描信号端S2输出扫描信号时，第二子像素电路200的第一重置控制端Rst1接收到第二扫描信号端S2的扫描信号，将初始电压端Vint提供的电压输入至驱动子电路103。第三子像素电路300和第四子像素电路400未工作。
当第三扫描信号端S3输出扫描信号时，第二子像素电路200和第三子像素电路300同时接收到第三扫描信号端S3的扫描信号，虽然，第二子像素电路200和第三子像素电路300同时工作，但是由于第三扫描信号端S3分别电连接第二子像素电路200中的写入控制端Input和第三子像素电路300中的第一重置控制端Rst1，因此，第二子像素电路200中的驱动子电路103写入数据端Data输出的数据信号，以对驱动子电路103进行阈值电压补偿；而第三子像素电路300的驱动子电路103输入初始电压端Vint提供的电压。
当第四扫描信号端S4输出扫描信号时，第三子像素电路300和第四子像素电路400同时接收到第四扫描信号端S4的扫描信号，虽然，第三子像素电路300和第四子像素电路400同时工作，但是由于第四扫描信号端S4分别电连接第三子像素电路300中的写入控制端Input和第四子像素电路400中的第一重置控制端Rst1，因此，第三子像素电路300的写入控制端Input接收到第四扫描信号端S4的扫描信号，将数据端Data输出的数据信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿；而第三子像素电路300的驱动子电路103输入初始电压端Vint提供的电压。
当第五扫描信号端S5输出扫描信号时，第四子像素电路400的写入控制端Input接收到第五扫描信号端S5的扫描信号，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。
由此，通过不同的扫描信号可以控制2×2个子像素所对应的四个子像素电路，使得该四个子像素电路在不同时间段写入数据端输出的信号，进行阈值电压补偿，由于写入状态的发生时间不同，因此，该2×2个子像素可以共用数据信号线。
依次类推，如图6所示，每相邻两排子像素所对应的子像素电路的第一重置控制端Rst1和写入控制端Input顺次错位连接两个相邻扫描信号端，可以通过不同的扫描信号控制相邻两排子像素，使得该相邻两排子像素可以在不同时间段进行阈值电压补偿，进而使得该相邻两排子像素可以共用数据信号线。
可选地，如图3b、图4b和图5b所示，重置子电路101与第二重置控制端Rst2、发光器件L电连接。
重置子电路101还配置为在第二重置控制端Rst2的控制下，将初始电压端Vint提供的电压输入至发光器件L。
其中，第一子像素电路100的第二重置控制端Rst2连接第三扫描信号端S3；第二子像素电路200的第二重置控制端Rst2连接第四扫描信号端S4。
可以理解的是，由于第一子像素电路100、第二子像素电路200的第二重置控制端Rst2连接不同的扫描信号端，因此，在不同的扫描信号触发下，第一子像素电路100和第二子像素电路200处于不同的状态。
例如，当第三扫描信号端S3和第四扫描信号端S4在不同时间输出扫描信号时，第一子像素电路100、第二子像素电路200对应的状态如下：
当第三扫描信号端S3输出扫描信号时，第二子像素电路200的写入控制端Input接收到第三扫描信号端S3的扫描信号，将数据端Data输出的数据信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿；此时，第一子像素电路100的第二重置控制端Rst2接收到第三扫描信号端S3的扫描信号，将初始电压端Vint提供的电压输入至发光器件L，强制进行黑画面，改善残像。
当第四扫描信号端S4输出扫描信号时，第三子像素电路300的写入控制端Input接收到第四扫描信号端S4的扫描信号，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。此时，第二子像素电路200的第二重置控制端Rst2接收到第四扫描信号端S4的扫描信号，将初始电压端Vint提供的电压输入至发光器件L，强制进行黑画面，改善残像。
如图4b所示，在像素电路10包括第三子像素电路300的情况下，第三子像素电路300的第二重置控制端Rst2连接第五扫描信号端S5。
当第五扫描信号端S5输出扫描信号时，第四子像素电路400的写入控制端Input接收到第五扫描信号端S5的扫描信号，将数据端Data输出的信号写入驱动子电路103，以对驱动子电路103进行阈值电压补偿。此时，第三子像素电路300的第二重置控制端Rst2接收到第五扫描信号端S5的扫描信号，将初始电压端Vint提供的电压输入至发光器件L，强制进行黑画面，改善残像。
在上述基础上，如图5b所示，在像素电路还包括第四子像素电路400的情况下，第四子像素电路400的第二重置控制端Rst2连接第六扫描信号端S6。当第六扫描信号端S6输出扫描信号时，第四子像素电路400的第二重置控制端Rst2接收到第六扫描信号端S6的扫描信号，将初始电压端Vint提供的电压输入至发光器件L。
依次类推，如图6所示，每相邻两排子像素的子像素电路的第一重置控制端Rst2顺次连接相邻两个扫描信号端，通过不同的扫描信号控制相邻两排子像素，使得该相邻两排子像素可以在不同时间段，将初始电压端Vint提供的电压输入至发光器件L，强制进行黑画面，改善残像。
可选地，如图3c、图4c和图5c所示，驱动子电路103包括驱动晶体管Td，驱动晶体管的栅极与重置子电路101电连接；第一极、第二极均与写入补偿子电路102和发光控制子电路104电连接。
可选地，如图3c、图4c和图5c所示，驱动子电路103除包括驱动晶体管Td外，还包括电容C。
其中，电容C的第一端与驱动晶体管Td的栅极电连接，第二端与第一电源电压端VDD电连接。
可选地，如图3c、图4c和图5c所示，重置子电路101包括第一晶体管T1和第二晶体管T2。
第一晶体管T1的栅极与第一重置控制端Rst1电连接，第一极与初始电压端Vint电连接，第二极与驱动晶体管Td的栅极电连接。
第二晶体管T2的栅极与第二重置控制端Rst2电连接，第一极与初始电压端Vint电连接，第二极与发光器件L电连接。
当第一重置控制端Rst1和第二重置控制端Rst2与不同的扫描信号端电连接时，第一晶体管T1能够在第一重置控制端Rst1的控制下导通或截止，第二晶体管T2能够在第二重置控制端Rst2的控制下导通或截止，均起到开关的作用。
需要说明的是，重置子电路101还可以包括与第一晶体管T1并联的多个开关晶体管、和/或与第二晶体管T2并联的多个开关晶体管。上述仅仅是对重置子电路101的举例说明，其它与重置子电路101功能相同的结构在此不再一一赘述，但都应当属于本发明的保护范围。
可选地，如图3c、图4c和图5c所示，写入补偿子电路102包括第三晶体管T3和第四晶体管T4。
第三晶体管T3的栅极与写入控制端Input电连接；第一极与驱动晶体管Td的栅极电连接，第二极与驱动晶体管Td的第二极电连接。
第四晶体管T4的栅极与所述写入控制端Input电连接；第一极与驱动晶体管的第一极电连接，第二极与数据端Data电连接。
当写入控制端Input与不同的扫描信号端电连接时，第三晶体管T3、第四晶体管T4均能够在写入控制端Input的控制下导通或截止，起到开关的作用。
需要说明的是，写入补偿子电路102还可以包括与第三晶体管T3并联的多个开关晶体管、和/或与第四晶体管T4并联的多个开关晶体管。上述仅仅是对写入补偿子电路102的举例说明，其它与写入补偿子电路102功能相同的结构在此不再一一赘述，但都应当属于本发明的保护范围。
可选地，如图3c、图4c和图5c所示，发光控制子电路104包括第五晶体管T5和第六晶体管T6。
第五晶体管T5的栅极与使能端EM电连接，第一极与驱动晶体管Td的第二极电连接，第二极与发光器件L电连接。
第六晶体管T6的栅极与使能端EM电连接，第一极与第一电源电压端VDD电连接，第二极与驱动晶体管Td的第一极电连接。
需要说明的是，发光控制子电路104还可以包括与第五晶体管T5并联的多个开关晶体管、和/或与第六晶体管T6并联的多个开关晶体管。上述仅仅是对发光控制子电路104的举例说明，其它与发光控制子电路104功能相同的结构在此不再一一赘述，但都应当属于本发明的保护范围。
基于上述对各子电路的描述，以下结合如图5c对上述像素电路的具体驱动过程进行详细的说明。其中，第一子像素电路100、第二子像素电路200、第三子像素电路300和第四子像素电路400中的第一晶体管T1、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及驱动晶体管Td均为P型晶体管。
如图7所示，若阵列基板包括有2348行像素，扫描频率为60Hz，则每一行的扫描时间为1/(2348×60)s，即，33333μs。针对一子像素电路，其写入补偿时间为扫描时间的一半，即，16666μs。
在第一扫描阶段P1，第一扫描信号端S1输出低电平信号，第二扫描信号端S2、第三扫描信号端S3、第四扫描信号端S4、第五扫描信号端S5和第六扫描信号端S6均输出高电平信号，使能端EM输出高电平信号，基于此，图5c所示的像素电路的等效电路图如图8a所示。
第一子像素电路100中的第一晶体管T1导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及驱动晶体管Td均截止。
第一子像素电路100中的第一晶体管T1导通，使得初始电压端Vint的电压(记为V0)输入至驱动晶体管Td的栅极，对驱动晶体管的栅极进行复位。
在第二扫描阶段P2，第二扫描信号端S2输出低电平信号，第一扫描信号端S1、第三扫描信号端S3、第四扫描信号端S4、第五扫描信号端S5和第六扫描信号端S6均输出高电平信号，使能端EM输出高电平信号，基于此，图5c所示的像素电路的等效电路图如图8b所示。
第一子像素电路100中的第三晶体管T3、第四晶体管T4导通，第一晶体管T1导通，第二晶体管T2、第五晶体管T5、第六晶体管T6均截止。
第一子像素电路100中的第三晶体管T3、第四晶体管T4导通，使得数据端Data输出的数据信号(记为Vdata1)写入驱动晶体管Td的第一极；从而使得驱动晶体管Td的Vgs＝V0-Vdata1，V0为0V时，Vgs小于0V，驱动晶体管Td处于导通状态，此时驱动晶体管Td的栅极的电压逐渐上升，直至栅极电压达到Vdata1+Vth(Vth为驱动晶体管的阈值电压)，实现对驱动晶体管的阈值电压补偿，因此，驱动晶体管Td的Vgs＝Vdata1+Vth-Vdata1＝Vth，从而使得驱动晶体管Td处于截止状态。
第二子像素电路200中的第一晶体管T1导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及驱动晶体管Td均截止。
第二子像素电路200中的第一晶体管T1导通，使得初始电压端Vint的电压(记为V0)输入至驱动晶体管Td的栅极，对驱动晶体管的栅极进行复位。
在第三扫描阶段P3，第三扫描信号端S3输出低电平信号，第一扫描信号端S1、第二扫描信号端S2、第四扫描信号端S4、第五扫描信号端S5和第六扫描信号端S6均输出高电平信号，使能端EM输出高电平信号，基于此，图5c所示的像素电路的等效电路图如图8c所示。
第一子像素电路100中的第二晶体管T2导通，第一晶体管T1、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6均截止。
第一子像素电路100中的电容保持驱动晶体管Td的栅极电压为Vdata1+Vth，而第一子像素电路100中的第二晶体管T2导通，使得初始电压端Vint提供的电压输入至发光器件L的阳极，强制进行黑画面，改善残像。
第二子像素电路200中的第三晶体管T3、第四晶体管T4导通，第一晶体管T1导通，第二晶体管T2、第五晶体管T5、第六晶体管T6均截止。
第二子像素电路200中的第三晶体管T3、第四晶体管T4导通，使得数据端Data输出的数据信号(记为Vdata2)写入驱动晶体管Td的第一极；从而使得驱动晶体管Td的Vgs＝V0-Vdata2，V0为0V时，Vgs小于0V，驱动晶体管Td处于导通状态，此时驱动晶体管Td的栅极的电压逐渐上升，直至栅极电压达到Vdata2+Vth，实现对驱动晶体管的阈值电压补偿，因此，驱动晶体管Td的Vgs＝Vdata2+Vth-Vdata2＝Vth，从而使得驱动晶体管Td处于截止状态。
第三子像素电路300中的第一晶体管T1导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及驱动晶体管Td均截止。
第三子像素电路300中的第一晶体管T1导通，使得初始电压端Vint的电压(记为V0)输入至驱动晶体管Td的栅极，对驱动晶体管的栅极进行复位。
在第四扫描阶段P4，第四扫描信号端S4输出低电平信号，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3、第五扫描信号端S5和第六扫描信号端S6均输出高电平信号，使能端EM输出高电平信号，基于此，图5c所示的像素电路的等效电路图如图8d所示。
第二子像素电路200中的第二晶体管T2导通，第一晶体管T1、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6均截止。
第二子像素电路200中的电容保持驱动晶体管Td的栅极电压为Vdata2+Vth，而第一子像素电路100中的第二晶体管T2导通，使得初始电压端Vint提供的电压输入至发光器件L的阳极，强制进行黑画面，改善残像。
第三子像素电路300中的第三晶体管T3、第四晶体管T4导通，第一晶体管T1导通，第二晶体管T2、第五晶体管T5、第六晶体管T6均截止。
第三子像素电路300中的第三晶体管T3、第四晶体管T4导通，使得数据端Data输出的数据信号(记为Vdata3)写入驱动晶体管Td的第一极；从而使得驱动晶体管Td的Vgs＝V0-Vdata3，V0为0V时，Vgs小于0V，驱动晶体管Td处于导通状态，此时驱动晶体管Td的栅极的电压逐渐上升，直至栅极电压达到Vdata3+Vth，实现对驱动晶体管的阈值电压补偿，因此，驱动晶体管Td的Vgs＝Vdata3+Vth-Vdata3＝Vth，从而使得驱动晶体管Td处于截止状态。
第四子像素电路400中的第一晶体管T1导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及驱动晶体管Td均截止。
第四子像素电路400中的第一晶体管T1导通，使得初始电压端Vint的电压(记为V0)输入至驱动晶体管Td的栅极，对驱动晶体管的栅极进行复位。
在第五扫描阶段P5，第五扫描信号端S5输出低电平信号，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3、第四扫描信号端S4和第六扫描信号端S6均输出高电平信号，使能端EM输出高电平信号。基于此，图5c所示的像素电路的等效电路图如图8e所示。
第三子像素电路300中的第二晶体管T2导通，第一晶体管T1、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6均截止。
第三子像素电路300中的电容保持驱动晶体管Td的栅极电压为Vdata3+Vth，而第一子像素电路100中的第二晶体管T2导通，使得初始电压端Vint提供的电压输入至发光器件L的阳极，强制进行黑画面，改善残像。
第四子像素电路400中的第三晶体管T3、第四晶体管T4导通，第一晶体管T1导通，第二晶体管T2、第五晶体管T5、第六晶体管T6均截止。
第四子像素电路400中的第三晶体管T3、第四晶体管T4导通，使得数据端Data输出的数据信号(记为Vdata4)写入驱动晶体管Td的第一极；从而使得驱动晶体管Td的Vgs＝V0-Vdata4，V0为0V时，Vgs小于0V，驱动晶体管Td处于导通状态，此时驱动晶体管Td的栅极的电压逐渐上升，直至栅极电压达到Vdata4+Vth，实现对驱动晶体管的阈值电压补偿，因此，驱动晶体管Td的Vgs＝Vdata4+Vth-Vdata4＝Vth，从而使得驱动晶体管Td处于截止状态。
在第六扫描阶段P6，第六扫描信号端S6输出低电平信号，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3、第四扫描信号端S4和第五扫描信号端S5均输出高电平信号，使能端EM输出高电平信号。基于此，图5c所示的像素电路的等效电路图如图8f所示。
第四子像素电路400中的第二晶体管T2导通，第一晶体管T1、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6均截止。
第四子像素电路400中的电容保持驱动晶体管Td的栅极电压为Vdata4+Vth，而第一子像素电路100中的第二晶体管T2导通，使得初始电压端Vint提供的电压输入至发光器件L的阳极，强制进行黑画面，改善残像。
在上述基础上，依次类推，还有第七扫描阶段P7，直至第八扫描阶段P8(发光阶段)，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3、第四扫描信号端S4、第五扫描信号端S5和第六扫描信号端S6均输出高电平信号，使能端EM(E1)输出低电平信号。基于此，图5c所示的像素电路的等效电路图如图8g所示。
第一子像素电路100、第二子像素电路200、第三子像素电路300和第四子像素电路400中的第五晶体管T5、第六晶体管T6导通，第一晶体管T1导通，第二晶体管T2、第三晶体管T3、第四晶体管T4均截止。
第一子像素电路100中的驱动晶体管Td的第一极与第一电源电压信号端VDD导通，第二极与发光器件L导通，在此基础上，当驱动晶体管Td的栅极电压与第一电源电压信号端VDD提供的电源电压信号Vdd之差小于其阈值电压Vth时导通，即，当(Vdata1+Vth)－Vdd＜Vth，驱动晶体管Td输出的驱动电流可以传输至发光器件L中，驱动发光器件L发光。
第二子像素电路200中的驱动晶体管Td的第一极与第一电源电压信号端VDD导通，第二极与发光器件L导通，在此基础上，当驱动晶体管Td的栅极电压与第一电源电压信号端VDD提供的电源电压信号Vdd之差小于其阈值电压Vth时导通，即，当(Vdata2+Vth)－Vdd＜Vth，驱动晶体管Td输出的驱动电流可以传输至发光器件L中，驱动发光器件L发光。
第三子像素电路300中的驱动晶体管Td的第一极与第一电源电压信号端VDD导通，第二极与发光器件L导通，在此基础上，当驱动晶体管Td的栅极电压与第一电源电压信号端VDD提供的电源电压信号Vdd之差小于其阈值电压Vth时导通，即，当(Vdata3+Vth)－Vdd＜Vth，驱动晶体管Td输出的驱动电流可以传输至发光器件L中，驱动发光器件L发光。
第四子像素电路400中的驱动晶体管Td的第一极与第一电源电压信号端VDD导通，第二极与发光器件L导通，在此基础上，当驱动晶体管Td的栅极电压与第一电源电压信号端VDD提供的电源电压信号Vdd之差小于其阈值电压Vth时导通，即，当(Vdata4+Vth)－Vdd＜Vth，驱动晶体管Td输出的驱动电流可以传输至发光器件L中，驱动发光器件L发光。
其中，W/L为驱动晶体管Td的宽长比，C为沟道绝缘层电容，u为沟道载流子迁移率。
依次类推，每个子像素电路的中流过驱动晶体管Td的电流只与数据端Data提供的用于实现显示的数据电压和第一电源电压端VDD输入的第一电源电压有关，与驱动晶体管Td的阈值电压Vth无关，从而消除了驱动晶体管Td的阈值电压Vth对发光器件L发光亮度的影响。
在此基础上，可以理解的是，当不同子像素电路接收到数据端的信号不同时，所包括的驱动子电路可以实现不同电流的输出，以使得发光器件亮度不同。如图9所示，d1所对应的子像素电路接收到数据端的数据电压为4V，d2所对应的子像素电路接收到数据端的数据电压为3.5V，d3所对应的子像素电路接收到数据端的数据电压为3V等,本领域技术人员应该明白，对于电致发光显示面板，数据线Data上的Vdata电压越小，输出到发光器件L上的电流越大，发光器件L发出光的亮度越大。
在上述实施例中，所有晶体管还可以均为N型晶体管。由于晶体管均为N型，晶体管导通时对应的扫描信号需要为高电平状态。
本发明的实施例还提供一种阵列基板2，如图6所示，包括：衬底3，以及设置在衬底3上的如上所述的像素电路10；所述像素电路对应多个子像素P；
阵列基板2还包括：多条扫描信号线、多条初始信号线、多条使能信号线、多条数据信号线、以及多条第一电源电压信号线；每两排子像素共用一条数据信号线；
多条扫描信号线同层设置；
多条初始信号线和多条使能信号线同层设置；
多条数据信号线和多条第一电源电压信号线同层且平行设置。
需要说明的是，在像素电路包括电容的情况下，多条扫描信号线和像素电路中的电容的第一基板同层设置；多条初始信号线、多条使能信号线和电容的第二基板同层设置。
示例的，如图6所示，第一行第一列子像素为第一子像素P1、第一行第二列子像素为第二子像素P2，第二行第一列子像素为第三子像素P3、第二行第二列子像素为第四子像素P3，依次类推，直至最后一行；
第一子像素P1对应设置像素电路10中的第一子像素电路100，第二子像素P2对应设置第二子像素电路100，第三子像素P3对应设置第三子像素电路100，依次类推，直至最后一行。该两列子像素所对应的子像素电路结构均相同，从第一子像素电路100直至最后一个子像素电路顺次以错一位的方式连接三个相邻的扫描信号端，并且每两行共用一条使能信号线，从而实现相邻两列子像素可以在不同时间段进行阈值电压补偿，实现共用数据信号线。
基于此，示例的，如图10所示，在第一子像素电路100中：第一晶体管T1包括第一有源层、第一绝缘层、第一栅极、第一源极和第一漏极，第一绝缘层设置在第一有源层与第一源极、第一漏极之间；第一栅极连接第一扫描信号线S1；第一源极与初始信号线Vint电连接，第一漏极与第三晶体管T3电连接；
第二晶体管T2第二有源层、第二绝缘层、第二栅极、第二源极和第二漏极，第二绝缘层设置在第二有源层与第二源极、第二漏极之间；第二栅极与第三扫描信号线S3电连接；第二源极与初始信号线Vint电连接，第二漏极与发光器件L的阳极电连接；
第三晶体管T3第三有源层、第三绝缘层、第三栅极、第三源极和第三漏极，第三绝缘层设置在第三有源层与第三源极、第三漏极之间；第三栅极与第二扫描信号线电连接，第三源极与驱动晶体管的栅极电连接，第三漏极与驱动晶体管的漏极电连接；
第四晶体管T4包括第四有源层、第四绝缘层、第四栅极、第四源极和第四漏极，第四绝缘层设置在第四有源层与第四源极、第四漏极之间；第四源极穿过第四绝缘层上的过孔Q1与第四有源层电连接。第四漏极穿过第四绝缘层上的过孔Q2与第四有源层电连接；第四栅极与第二扫描信号线S2电连接；第四源极与数据线Data电连接；
第五晶体管T5包括第五有源层、第五绝缘层、第五栅极、第五源极和第五漏极，第五绝缘层设置在第五有源层与第五源极、第五漏极之间；第五源极穿过第五绝缘层上的过孔Q3与第五有源层电连接，第五漏极穿过第五绝缘层上的过孔Q4与第五有源层电连接；第五栅极与使能信号线EM电连接；第五源极与驱动晶体管的漏极电连接，第五漏极与发光器件L的阳极电连接。
第六晶体管T6包括第六有源层、第六绝缘层、第六栅极、第六源极和第六漏极，第六绝缘层设置在第六有源层与第六源极、第六漏极之间；第六源极穿过第六绝缘层上的过孔Q5与第六有源层电连接，第六漏极穿过第六绝缘层上的过孔Q6与第六有源层电连接；第六栅极与使能信号线EM电连接，第六源极与第一电源电压先号线VDD电连接，第六漏极与第四漏极电连接；参考图10，在过孔Q2与过孔Q6共用的情况下，第四漏极与第六漏极共用。
本发明实施例中，第一有源层、第二有源层、第三有源层、第四有源层、第五有源层、第六有源层同层同材料。
依次类推，其他子像素电路的晶体管的栅极连接的扫描信号线顺次错一位，其他连接方式与上述类似，在此不再赘述。
本发明的实施例还提供一种显示装置1，如图11所示，包括如上所述的阵列基板2。
其中，该显示装置1可以为显示面板，或者，可以是包括显示面板的显示装置1。
本发明的实施例还提供一种如上所述的像素电路的驱动方法，如图12所示，包括:
S10、在第一扫描阶段P1，第一子像素电路100中的重置子电路101在第一重置控制端Rst1的电压控制下，将初始电压端提供的电压输入至驱动子电路。
S20、在第二扫描阶段P2，第一子像素电路100中的写入补偿子电路102在写入控制端Input的电压控制下，将数据端输出的数据电压写入至驱动子电路103，对驱动子电路103进行阈值电压补偿；第二子像素电路200中的重置子电路101在第一重置控制端Rst1的电压控制下，将初始电压端Vint提供的电压输入至驱动子电路103。
S30、在第三扫描阶段P3，第二子像素电路200中的写入补偿子电路102在写入控制端Input的电压控制下，将数据端输出的数据电压写入至驱动子电路103，对驱动子电路103进行阈值电压补偿。
S40、在发光阶段，第一子像素电路和第二子像素电路中的发光控制子电路104在使能端的电压的控制下，导通第一电源电压端VDD和第二电源电压端VSS之间的电流通路，并将驱动子电路103提供的驱动电流传输至所述发光器件L。
可选地，在像素电路还包括设置于第三子像素的第三子像素电路的情况下，在上述S30之后，在S40之前，像素电路的驱动方法还包括：
在第三扫描阶段P3，第三子像素电路300中的重置子电路在第一重置控制端Rst1的电压控制下，将初始电压端Vint提供的电压输入至驱动子电路103。
在第四扫描阶段P4，第三子像素电路300中的写入补偿子电路102在写入控制端Input的电压控制下，将数据端输出的数据电压写入至驱动子电路103，对驱动子电路103进行阈值电压补偿。
在发光阶段，第三子像素电路300中的发光控制子电路在使能端EM的电压的控制下，导通第一电源电压端VDD和第二电源电压端VSS之间的电流通路，并将驱动子电路103提供的驱动电流传输至发光器件L。
可选地，像素电路的驱动方法还包括：
在第三扫描阶段P3，第一子像素电路中的重置子电路101在第二重置控制端Rst2的控制下，将初始电压端Vint提供的电压输入至发光器件L。
在第四扫描阶段P4，第二子像素电路200中的重置子电路101在第二重置控制端Rst2的控制下，将初始电压端Vint提供的电压输入至发光器件L。
在像素电路还包括设置于第三子像素的第三子像素电路300的情况下，在第五扫描阶段P5，第三子像素电路300中的重置子电路101在第二重置控制端Rst2的控制下，将初始电压端Vint提供的电压输入至发光器件L。
需要说明的是，当像素电路还包括设置于第四子像素的第四子像素电路400的情况下，第二子像素电路200、第三子像素电路300、第四子像素电路400的驱动方法与第一子像素电路100、第二子像素电路200、第三子像素电路300的驱动方法相同。后续子像素电路的驱动方法，依次类推，在此不再赘述。
在本发明的实施例中，示例的，由于两列子像素共用数据线，每两行子像素共用使能信号线EM，使能信号由GOA(Gate Driver OnArray，阵列基板行驱动)控制输出。为了确保每两行子像素同时正常发光，通常在第三行子像素写入数据端的信号后，第四行子像素即将写入数据端的信号时，第一行和第二行的子像素才进行发光，后续依次类推。
本发明的实施例所提供的像素电路的驱动方法与上述像素电路具有相同的有益效果，在此不再赘述。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (9)

1.一种像素电路，其特征在于，包括：设置于第一子像素的第一子像素电路、第二子像素的第二子像素电路、第三子像素的第三子像素电路和第四子像素的第四子像素电路；所述第一子像素、所述第二子像素、所述第三子像素和所述第四子像素呈两行两列排布；所述第一子像素与所述第二子像素相邻，所述第三子像素与所述第一子像素分别位于相邻两行，所述第四子像素与所述第一子像素分别位于相邻两行；
所述第一子像素电路、所述第二子像素电路、所述第三子像素电路和所述第四子像素电路均包括：重置子电路、写入补偿子电路、驱动子电路、发光控制子电路和发光器件；
其中，所述重置子电路与第一重置控制端、初始电压端和所述驱动子电路电连接，所述重置子电路配置为在第一重置控制端的控制下，将所述初始电压端提供的电压输入至所述驱动子电路；
写入补偿子电路与写入控制端、数据端和所述驱动子电路电连接；写入补偿子电路配置为在写入控制端的控制下，将所述数据端输出的信号写入所述驱动子电路，以对所述驱动子电路进行阈值电压补偿；
发光控制子电路与使能端、第一电源电压端、所述驱动子电路以及发光器件电连接；所述发光器件还与第二电源电压端电连接；所述发光控制子电路配置为在所述使能端的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件；
其中，所述第一子像素电路的第一重置控制端和写入控制端依次连接第一扫描信号端和第二扫描信号端；
所述第二子像素电路的第一重置控制端和写入控制端依次连接所述第二扫描信号端和第三扫描信号端;
所述第三子像素电路的所述第一重置控制端和所述写入控制端依次连接所述第三扫描信号端和第四扫描信号端;
所述第四子像素电路的所述第一重置控制端和所述写入控制端依次连接所述第四扫描信号端和第五扫描信号端；
所述重置子电路与第二重置控制端、所述发光器件电连接；
所述重置子电路还配置为在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；
其中，所述第一子像素电路的第二重置控制端连接第三扫描信号端；所述第二子像素电路的第二重置控制端连接第四扫描信号端；
所述第三子像素电路的第二重置控制端连接第五扫描信号端；
所述第四子像素电路的第二重置控制端连接第六扫描信号端。
2.根据权利要求1所述的像素电路，其特征在于，所述驱动子电路包括驱动晶体管；
所述驱动晶体管的栅极与所述重置子电路电连接；第一极、第二极均与所述写入补偿子电路和所述发光控制子电路电连接。
3.根据权利要求2所述的像素电路，其特征在于，所述驱动子电路还包括电容；
所述电容的第一端与所述驱动晶体管的栅极电连接，第二端与所述第一电源电压端电连接。
4.根据权利要求2所述的像素电路，其特征在于，所述重置子电路包括第一晶体管和第二晶体管；
所述第一晶体管的栅极与所述第一重置控制端电连接，第一极与所述初始电压端电连接，第二极与所述驱动晶体管的栅极电连接；
所述第二晶体管的栅极与所述第二重置控制端电连接，第一极与所述初始电压端电连接，第二极与所述发光器件电连接。
5.根据权利要求2所述的像素电路，其特征在于，所述写入补偿子电路包括第三晶体管和第四晶体管；
所述第三晶体管的栅极与所述写入控制端电连接；第一极与所述驱动晶体管的栅极电连接，第二极与所述驱动晶体管的第二极电连接；
所述第四晶体管的栅极与所述写入控制端电连接；第一极与所述驱动晶体管的第一极电连接，第二极与所述数据端电连接。
6.根据权利要求2所述的像素电路，其特征在于，所述发光控制子电路包括第五晶体管和第六晶体管；
所述第五晶体管的栅极与所述使能端电连接，第一极与所述驱动晶体管的第二极电连接，第二极与所述发光器件电连接；
所述第六晶体管的栅极与所述使能端电连接，第一极与所述第一电源电压端电连接，第二极与所述驱动晶体管的第一极电连接。
7.一种阵列基板，其特征在于，包括：衬底，以及设置在所述衬底上的如权利要求1-6任一项所述的像素电路；所述像素电路对应多个子像素；
所述阵列基板还包括：多条扫描信号线、多条初始信号线、多条使能信号线、多条数据信号线、以及多条第一电源电压信号线；每两排子像素共用一条数据信号线；
多条所述扫描信号线同层设置；
多条所述初始信号线和多条所述使能信号线同层设置；
多条所述数据信号线和多条所述第一电源电压信号线同层且平行设置。
8.一种显示装置，其特征在于，包括如权利要求7所述的阵列基板。
9.一种如权利要求1-6任一项所述的像素电路的驱动方法，其特征在于，包括:
在第一扫描阶段，第一子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；
在第二扫描阶段，所述第一子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；第二子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；
在第三扫描阶段，所述第二子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；
在发光阶段，所述第一子像素电路和所述第二子像素电路中的发光控制子电路在所述使能端的电压的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件；
所述像素电路的驱动方法还包括：
在所述第三扫描阶段，所述第一子像素电路中的所述重置子电路在第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；第三子像素电路中的重置子电路在第一重置控制端的电压控制下，将初始电压端提供的电压输入至驱动子电路；
在第四扫描阶段，所述第二子像素电路中的所述重置子电路在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；所述第三子像素电路中的写入补偿子电路在写入控制端的电压控制下，将数据端输出的数据电压写入至所述驱动子电路，对所述驱动子电路进行阈值电压补偿；
在第五扫描阶段，所述第三子像素电路中的所述重置子电路在所述第二重置控制端的控制下，将所述初始电压端提供的电压输入至所述发光器件；
在发光阶段，所述第三子像素电路中的发光控制子电路在所述使能端的电压的控制下，导通所述第一电源电压端和所述第二电源电压端之间的电流通路，并将所述驱动子电路提供的驱动电流传输至所述发光器件。
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