JP6406740B2 - パルス信号統合回路、表示パネルおよび表示装置 - Google Patents
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Description
第n出力制御手段は、第1の制御端が第n入力パルス信号を受信し、第2の制御端が第n+1入力パルス信号を受信し、出力端が該パルス信号出力端に接続するものであって、各表示周期において、該第n入力パルス信号が初めて有効となってから該第n+1入力パルス信号が初めて有効となる前までの時間帯に、該第n入力パルス信号を該パルス信号出力端へ出力するように制御するのに用いられる。nはNより小さい正整数である。
第N出力制御手段は、第1の制御端が第N入力パルス信号を受信し、第2の制御端が第1入力パルス信号を受信し、出力端が該パルス信号出力端に接続するものであって、各表示周期において、該第N入力パルス信号が初めて有効となってから次の表示周期における第1入力パルス信号が初めて有効となる前までの時間帯に、該第N入力パルス信号を該パルス信号出力端へ出力するように制御するのに用いられる。
Claims (10)
- 各表示周期において逐次有効なN個(Nは1より大きな整数)の入力パルス信号を出力パルス信号に統合するのに用いられ、N個の出力制御手段とパルス信号出力端とを備えるパルス信号統合回路であって、
第n出力制御手段は、第1の制御端が第n入力パルス信号を受信し、第2の制御端が第n+1入力パルス信号を受信し、出力端が該パルス信号出力端に接続するものであって、各表示周期において、該第n入力パルス信号が初めて有効となってから該第n+1入力パルス信号が初めて有効となる前までの時間帯に、該第n入力パルス信号を該パルス信号出力端へ出力するように制御するのに用いられ、nがNより小さい正整数であり、
第N出力制御手段は、第1の制御端が第N入力パルス信号を受信し、第2の制御端が第1入力パルス信号を受信し、出力端が該パルス信号出力端に接続するものであって、各表示周期において、該第N入力パルス信号が初めて有効となってから次の表示周期における第1入力パルス信号が初めて有効となる前までの時間帯に、該第N入力パルス信号を該パルス信号出力端へ出力するように制御するのに用いられる
ことを特徴とするパルス信号統合回路。 - 請求項1に記載のパルス信号統合回路において、
前記出力制御手段の各々はそれぞれ、
ゲート及び第1極が該出力制御手段の第1の制御端に接続する第1出力制御トランジスタと、
ゲートが該出力制御手段の第2の制御端に接続し、第1極が該第1出力制御トランジスタの第2極に接続し、第2極が第1レベルを受信する第2出力制御トランジスタと、
ゲートが該第1出力制御トランジスタの第2極に接続し、第1極が該第1の制御端に接続し、第2極が該パルス信号出力端に接続する第3出力制御トランジスタとを備え、
前記第2出力制御トランジスタがオンとなって、前記第3出力制御トランジスタのゲートが前記第1レベルを受信する場合、前記第3出力制御トランジスタはオフとなる
ことを特徴とするパルス信号統合回路。 - 請求項2に記載のパルス信号統合回路において、
前記N個の入力パルス信号はすべて正方向パルス信号であり、前記第1出力制御トランジスタ、前記第2出力制御トランジスタおよび前記第3出力制御トランジスタはいずれもn型TFTであり、第1レベルはローレベルである、
あるいは、
前記N個の入力パルス信号はすべて負方向パルス信号であり、前記第1出力制御トランジスタ、前記第2出力制御トランジスタおよび前記第3出力制御トランジスタはいずれもp型TFTであり、第1レベルはハイレベルである
ことを特徴とするパルス信号統合回路。 - 請求項1〜3のいずれか一項に記載のパルス信号統合回路において、
前記N個の入力パルス信号をそれぞれ受信し、該パルス信号出力端に接続する出力無効制御手段であって、該N個の入力パルス信号がいずれも無効である場合、無効なレベル信号を該パルス信号出力端へ出力するように制御するのに用いられる出力無効制御手段を、さらに備える
ことを特徴とするパルス信号統合回路。 - 請求項4に記載のパルス信号統合回路において、
前記出力無効制御手段は、ゲート電位制御トランジスタと、無効制御トランジスタと、前記N個の入力パルス信号をそれぞれ受信するN個の有効制御トランジスタとを備え、
前記ゲート電位制御トランジスタは、ゲート及び第1極が第2レベルを受信し、
前記無効制御トランジスタは、ゲートが該ゲート電位制御トランジスタの第2極に接続し、第1極が該パルス信号出力端に接続し、第2極が第1レベルを受信し、
第m有効制御トランジスタは、ゲートが第m入力パルス信号を受信し、第1極が該無効制御トランジスタのゲートに接続し、第2極が第3レベルを受信し、mがN以下の正整数であり、
前記第2レベルは、該ゲート電位制御トランジスタがオンとなるように制御し、
該第m入力パルス信号が有効である場合、該第m有効制御トランジスタがオンとなるため、該無効制御トランジスタのゲートは該第3レベルを受信することになり、これにより、該無効制御トランジスタはオフとなり、
該N個の入力パルス信号がいずれも無効である場合、該無効制御トランジスタのゲートが該第2レベルを受信し、これにより、該無効制御トランジスタはオンとなり、前記パルス信号出力端は第1レベルを受信する
ことを特徴とするパルス信号統合回路。 - 請求項5に記載のパルス信号統合回路において、
前記N個の入力パルス信号はすべて正方向パルス信号であり、前記ゲート電位制御トランジスタ、前記無効制御トランジスタおよび前記N個の有効制御トランジスタはいずれもn型TFTであり、前記第1レベルはローレベルであり、前記第2レベルはハイレベルであり、前記第3レベルはローレベルである、
あるいは、
前記N個の入力パルス信号はすべて負方向パルス信号であり、前記ゲート電位制御トランジスタ、前記無効制御トランジスタおよび前記N個の有効制御トランジスタはいずれもp型TFTであり、前記第1レベルはハイレベルであり、前記第2レベルはローイレベルであり、前記第3レベルはハイレベルである
ことを特徴とするパルス信号統合回路。 - 請求項6に記載のパルス信号統合回路において、
前記n型TFTがデプレッション型TFTである場合、前記第3レベルは、前記第1レベルより小さいであり、
前記n型TFTがエンハンスメント型TFTである場合、前記第3レベルは、前記第1レベルと同じである
ことを特徴とするパルス信号統合回路。 - 請求項1〜7のいずれか一項に記載のパルス信号統合回路を備える表示パネルであって、
前記パルス信号統合回路は、パルス信号出力端を介して、前記表示パネルにゲート駆動信号を供給することを特徴とする表示パネル。 - 請求項8に記載の表示パネルにおいて、
前記表示パネルは、OLED表示パネルであることを特徴とする表示パネル。 - 請求項8または9に記載の表示パネルを備えることを特徴とする表示装置。
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