CN109616041B - 移位寄存器单元、驱动方法、栅极驱动电路及显示装置 - Google Patents

移位寄存器单元、驱动方法、栅极驱动电路及显示装置 Download PDF

Info

Publication number
CN109616041B
CN109616041B CN201910112669.2A CN201910112669A CN109616041B CN 109616041 B CN109616041 B CN 109616041B CN 201910112669 A CN201910112669 A CN 201910112669A CN 109616041 B CN109616041 B CN 109616041B
Authority
CN
China
Prior art keywords
output
signal
power supply
circuit
pull
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201910112669.2A
Other languages
English (en)
Other versions
CN109616041A (zh
Inventor
袁粲
李永谦
袁志东
何敏
徐海侠
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
BOE Technology Group Co Ltd
Hefei BOE Zhuoyin Technology Co Ltd
Original Assignee
BOE Technology Group Co Ltd
Hefei BOE Zhuoyin Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by BOE Technology Group Co Ltd, Hefei BOE Zhuoyin Technology Co Ltd filed Critical BOE Technology Group Co Ltd
Priority to CN201910112669.2A priority Critical patent/CN109616041B/zh
Publication of CN109616041A publication Critical patent/CN109616041A/zh
Priority to PCT/CN2020/074922 priority patent/WO2020164525A1/zh
Priority to US17/256,049 priority patent/US11328675B2/en
Application granted granted Critical
Publication of CN109616041B publication Critical patent/CN109616041B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/28—Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00—Aspects of the constitution of display devices
    • G09G2300/04—Structural and physical details of display devices
    • G09G2300/0421—Structural details of the set of electrodes
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
    • G09G2310/0264—Details of driving circuits
    • G09G2310/0286—Details of a shift registers arranged for use in a driving circuit
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/08—Details of timing specific for flat panels, other than clock recovery
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2330/00—Aspects of power supply; Aspects of display protection and defect management
    • G09G2330/02—Details of power systems and of start or stop of display operation
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
    • G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
    • G09G3/32—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED]
    • G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
    • G09G3/3225—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix
    • G09G3/3233—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix with pixel circuitry controlling the current through the light-emitting element
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
    • G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
    • G09G3/32—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED]
    • G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
    • G09G3/3266—Details of drivers for scan electrodes

Abstract

本发明公开了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。该移位寄存器单元包括移位电路和信号整合电路。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出控制电源信号，并可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。

Description

移位寄存器单元、驱动方法、栅极驱动电路及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。
背景技术
显示装置一般包括：像素电路以及用于向该像素电路提供驱动信号的移位寄存器单元。其中，该像素电路一般包括：驱动晶体管，以及与同一条栅线连接的开关晶体管和检测晶体管。该移位寄存器单元的输出端可以与该栅线连接，并向该栅线输出驱动信号。进而，该开关晶体管可以在栅线输出的栅极信号(即该驱动信号)的控制下，驱动其连接的发光单元发光；该检测晶体管可以在该栅极信号的控制，检测发光单元的电压，并根据检测到的电压对驱动晶体管的阈值电压进行外部补偿，以保证显示装置的显示效果。
相关技术中，每个移位寄存器单元可以包括：输入电路、输出电路和下拉电路。每个移位寄存器单元的输出电路可以与两个输出端连接，并在不同的工作阶段向该两个输出端输出不同电位的信号。或者，两个移位寄存器单元的输出电路可以分别与一个输出端连接，并在不同的工作阶段向其连接的输出端输出不同电位的信号。该两个输出端可以与同一条栅线连接，该栅线可以根据两个输出端输出的驱动信号，控制像素电路的工作。
但是，由于相关技术中需要通过两个输出端分别向同一条栅线输出不同电位的驱动信号来控制像素电路的工作，因此可能会使得栅线上的信号发生紊乱，进而导致像素电路的工作可靠性较低。
发明内容
本发明提供了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置，可以解决相关技术中像素电路工作可靠性较低的问题，所述技术方案如下：
一方面，提供了一种移位寄存器单元，所述移位寄存器单元包括：移位电路和信号整合电路；
所述移位电路分别与控制电源端、第一输出端和第二输出端连接，所述移位电路用于在显示阶段，向所述第一输出端输出来自所述控制电源端的控制电源信号，以及用于在消隐阶段，向所述第二输出端输出所述控制电源信号；
所述信号整合电路分别与所述控制电源端、所述第一输出端、所述第二输出端、第一下拉电源端和第三输出端连接，所述信号整合电路用于响应于所述控制电源信号和所述第一输出端提供的第一输出信号，向所述第三输出端输出所述控制电源信号；
所述信号整合电路还用于响应于所述控制电源信号和所述第二输出端提供的第二输出信号，向所述第三输出端输出所述控制电源信号；
所述信号整合电路还用于响应于所述控制电源信号、所述第一输出信号和所述第二输出信号，向所述第三输出端输出来自所述第一下拉电源端的第一下拉电源信号，所述第三输出端与一条栅线连接，用于向所述栅线输出驱动信号。
可选的，所述信号整合电路包括：第一输入子电路、第一输出子电路、第二输入子电路、第二输出子电路、下拉控制子电路和下拉子电路；
所述第一输入子电路分别与所述控制电源端和第一节点连接，用于响应于所述控制电源信号，向所述第一节点输出所述控制电源信号；
所述第一输出子电路分别与所述第一节点、所述控制电源端、所述第一输出端和所述第三输出端连接，用于响应于所述第一节点的电位和所述第一输出信号，向所述第三输出端输出所述控制电源信号；
所述第二输入子电路分别与所述控制电源端和第二节点连接，用于响应于所述控制电源信号，向所述第二节点输出所述控制电源信号；
所述第二输出子电路分别与所述第二节点、所述控制电源端、所述第二输出端和所述第三输出端连接，用于响应于所述第二节点的电位和所述第二输出信号，向所述第三输出端输出所述控制电源信号；
所述下拉控制子电路分别与所述控制电源端、第三节点、所述第一输出端、所述第二输出端和第二下拉电源端连接，用于响应于所述第一输出信号或所述第二输出信号，向所述第三节点输出来自所述第二下拉电源端的第二下拉电源信号，以及用于响应于所述控制电源信号，向所述第三节点输出所述控制电源信号；
所述下拉子电路分别与所述第三节点、所述第一下拉电源端和所述第三输出端连接，用于响应于所述第三节点的电位，向所述第三输出端输出所述第一下拉电源信号。
可选的，所述第一输入子电路包括：第一输入晶体管；所述第一输出子电路包括：第一输出晶体管、第二输出晶体管和第一电容器；所述第二输入子电路包括：第二输入晶体管；所述第二输出子电路包括：第三输出晶体管、第四输出晶体管和第二电容器；
所述第一输入晶体管的栅极和第一极均与所述控制电源端连接，所述第一输入晶体管的第二极与所述第一节点连接；
所述第一输出晶体管的栅极与所述第一输出端连接，所述第一输出晶体管的第一极与所述控制电源端连接，所述第一输出晶体管的第二极与所述第二输出晶体管的第一极连接；
所述第二输出晶体管的栅极与所述第一节点连接，所述第二输出晶体管的第二极与所述第三输出端连接；
所述第一电容器的一端与所述第一节点连接，所述第一电容器的另一端与所述第三输出端连接；
所述第二输入晶体管的栅极和第一极均与所述控制电源端连接，所述第二输入晶体管的第二极与所述第二节点连接；
所述第三输出晶体管的栅极与所述第二输出端连接，所述第三输出晶体管的第一极与所述控制电源端连接，所述第三输出晶体管的第二极与所述第四输出晶体管的第一极连接；
所述第四输出晶体管的栅极与所述第二节点连接，所述第四输出晶体管的第二极与所述第三输出端连接；
所述第二电容器的一端与所述第二节点连接，所述第二电容器的另一端与所述第三输出端连接。
可选的，所述第二输入晶体管复用所述第一输入晶体管，所述第二输出晶体管复用所述第四输出晶体管，所述第二电容器复用所述第一电容器。
可选的，所述控制电源端包括第一电源端和第二电源端，所述第一电源端提供的第一电源信号的电位与所述第二电源端提供的第二电源信号的电位互补；
所述第一输入子电路分别与所述第一电源端和所述第一节点连接，用于响应于所述第一电源端提供的第一电源信号，向所述第一节点输出所述第一电源信号；所述第一输出子电路分别与所述第一电源端、所述第一节点、所述第一输出端和所述第三输出端连接，用于响应于所述第一节点的电位和所述第一输出信号，向所述第三输出端输出所述第一电源信号；
所述第二输入子电路分别与所述第二电源端和所述第二节点连接，用于响应于所述第二电源端提供的第二电源信号，向所述第二节点输出所述第二电源信号，所述第二输出子电路分别与所述第二电源端、所述第二节点、所述第二输出端和所述第三输出端连接，用于响应于所述第二节点的电位和所述第二输出信号，向所述第三输出端输出所述第二电源信号。
可选的，所述第一输入晶体管的栅极和第一极均与所述第一电源端连接，所述第一输入晶体管的第二极与所述第一节点连接；
所述第二输入晶体管的栅极和第一极均与所述第二电源端连接，所述第二输入晶体管的第二极与所述第二节点连接；
所述第一输出子电路还包括：第五输出晶体管，所述第二输出子电路还包括：第六输出晶体管；
所述第五输出晶体管的栅极和第一极均与所述第一电源端连接，所述第五输出晶体管的第二极与所述第一输出晶体管的第一极连接；
所述第六输出晶体管的栅极和第一极均与所述第二电源端连接，所述第六输出晶体管的第二极与所述第三输出晶体管的第一极连接。
可选的，所述移位电路包括：第一移位子电路和第二移位子电路；所述第一移位子电路分别与所述控制电源端和所述第一输出端连接，用于在显示阶段，向所述第一输出端输出所述控制电源信号；所述第二移位子电路分别与所述控制电源端和所述第二输出端连接，用于在消隐阶段，向所述第二输出端输出所述控制电源信号；
每个所述移位子电路均包括：下拉控制模块和下拉模块；
每个所述下拉控制模块分别与所述控制电源端、下拉节点、所述第二下拉电源端和上拉节点连接，用于响应于所述控制电源信号，向所述下拉节点输出所述控制电源信号，以及用于响应于所述上拉节点的电位，向所述下拉节点输出所述第二下拉电源信号；
所述第一移位子电路中的下拉模块分别与所述第一移位子电路中的下拉节点、所述第一下拉电源端和所述第一输出端连接，用于响应于所述第一移位子电路中的下拉节点的电位，向所述第一输出端输出所述第一下拉电源信号，所述第二移位子电路中的下拉模块分别与所述第二移位子电路中的下拉节点、所述第一下拉电源端和所述第二输出端连接，用于响应于所述第二移位子电路中的下拉节点的电位，向所述第二输出端输出所述第一下拉电源信号。
所述下拉控制子电路复用所述第二移位子电路中的下拉控制模块，所述下拉子电路复用所述第二移位子电路中的下拉模块。
另一方面，提供了一种移位寄存器单元的驱动方法，应用于如上述方面所述的移位寄存器单元，所述方法包括：
在第一阶段，控制电源端提供的控制电源信号的电位为第一电位，移位电路向第一输出端输出所述控制电源信号，信号整合电路响应于所述第一输出端提供的第一输出信号和所述控制电源信号，向第三输出端输出所述控制电源信号；
在第二阶段，所述控制电源信号的电位为第一电位，所述第一输出信号的电位和第二输出端提供的第二输出信号的电位均为第二电位，所述信号整合电路响应于所述控制电源信号、所述第一输出信号和所述第二输出信号，向所述第三输出端输出来自第一下拉电源端的第一下拉电源信号，所述第一下拉电源信号的电位为第二电位；
在第三阶段，所述控制电源信号的电位为第一电位，所述移位电路向所述第二输出端输出所述控制电源信号，所述信号整合电路响应于所述第二输出信号和所述控制电源信号，向所述第三输出端输出所述控制电源信号。
又一方面，提供了一种栅极驱动电路，所述栅极驱动电路包括：至少两个级联的如上述方面所述的移位寄存器单元；
每一级移位寄存器单元的第三输出端与下一级移位寄存器单元的输入信号端连接，每一级移位寄存器单元的第三输出端与上一级移位寄存器单元的复位信号端连接。
再一方面，提供了一种显示装置，所述显示装置包括：如上述方面所述的栅极驱动电路。
本发明提供的技术方案带来的有益效果至少可以包括：
综上所述，本发明实施例提供了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置，该移位寄存器单元包括移位电路和信号整合电路。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出该控制电源信号，以及可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出该控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线上，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的一种移位寄存器单元的结构示意图；
图2是本发明实施例提供的另一种移位寄存器单元的结构示意图；
图3是本发明实施例提供的又一种移位寄存器单元的结构示意图；
图4是本发明实施例提供的再一种移位寄存器单元的结构示意图；
图5是本发明实施例提供的再一种移位寄存器单元的结构示意图；
图6是本发明实施例提供的再一种移位寄存器单元的结构示意图；
图7是本发明实施例提供的再一种移位寄存器单元的结构示意图；
图8是本发明实施例提供的再一种移位寄存器单元的结构示意图；
图9是本发明实施例提供的一种移位寄存器单元的驱动方法流程图；
图10是本发明实施例提供的一种移位寄存器单元各信号端的时序图；
图11是本发明实施例提供的一种移位寄存器单元各信号端的时序仿真图；
图12是本发明实施例提供的一种栅极驱动电路中各信号端的时序图。
具体实施方式
为了使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
为了便于读者理解，首先对本发明实施例所涉及的电路中的相关器件进行介绍。本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，根据在电路中的作用本发明的实施例所采用的晶体管主要为开关晶体管。由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，将其中源极称为第一极，漏极称为第二极。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、输出端为漏极。此外，本发明实施例所采用的开关晶体管可以包括P型开关晶体管和N型开关晶体管中的任一种，其中，P型开关晶体管在栅极为低电平时导通，在栅极为高电平时截止，N型开关晶体管在栅极为高电平时导通，在栅极为低电平时截止。此外，本发明各个实施例中的多个信号都对应有第一电位和第二电位，第一电位和第二电位仅代表该信号的电位有2个不同的状态量，不代表具有特定的数值。
图1是本发明实施例提供的一种移位寄存器单元的结构示意图。如图1所示，该移位寄存器单元可以包括：移位电路10和信号整合电路20。
该移位电路10可以分别与控制电源端VDD、第一输出端OUT1和第二输出端OUT2连接。该移位电路10可以在显示阶段(即显示装置进行图像显示的阶段)，向第一输出端OUT1输出来自控制电源端VDD的控制电源信号。并且该移位电路10还可以在消隐阶段(即像素电路驱动一行像素扫描完成到驱动下一行像素扫描开始之前的阶段，或者像素电路驱动一帧图像显示完成到驱动下一帧图像开始显示之前的阶段)，向第二输出端OUT2输出该控制电源信号。其中，该控制电源信号的电位可以为第一电位，在本发明实施例中，该第一电位可以为有效电位(该有效电位是指控制移位寄存器单元包括的晶体管开启，使得移位寄存器单元工作的电位)。
该信号整合电路20可以分别与控制电源端VDD、第一输出端OUT1、第二输出端OUT2、第一下拉电源端VGL和第三输出端OUT3连接。该信号整合电路20可以响应于控制电源端VDD提供的控制电源信号和第一输出端OUT1提供的第一输出信号，向第三输出端OUT3输出该控制电源信号。
该信号整合电路20还可以响应于该控制电源信号和第二输出端OUT2提供的第二输出信号，向第三输出端OUT3输出该控制电源信号。
该信号整合电路20还可以响应于该控制电源信号、第一输出信号和第二输出信号，向第三输出端OUT3输出来自第一下拉电源端VGL的第一下拉电源信号。该第三输出端OUT3可以与一条栅线连接(图1中未示出)，用于向该栅线输出驱动信号，即用于向该栅线输出移位电路10向第一输出端OUT1输出的控制电源信号，和移位电路10向第二输出端OUT2输出的控制电源信号。
示例的，信号整合电路20可以在第一输出端OUT1提供的第一输出信号的电位为第一电位时(即移位电路10向第一输出端OUT1输出控制电源信号时)，向第三输出端OUT3输出该控制电源信号。也即是，信号整合电路20可以将移位电路10向第一输出端OUT1输出的第一输出信号，输出至第三输出端OUT3。该信号整合电路20可以在第二输出端OUT2提供的第二输出信号的电位为第一电位时(即移位电路10向第二输出端OUT2输出控制电源信号时)，向第三输出端OUT3输出该控制电源信号。也即是，该信号整合电路20还可以将移位电路10向第二输出端OUT2输出的第二输出信号，输出至第三输出端OUT3。
通过使用信号整合电路20将移位电路10在显示阶段向第一输出端OUT1输出的控制电源信号，和在消隐阶段向第二输出端OUT2输出的控制电源信号，输出至同一个第三输出端OUT3，可以实现第一输出信号和第二输出信号的整合。由于该第三输出端OUT3与驱动像素电路的一条栅线连接，因此可以使得该栅线在该第三输出端OUT3提供的第三输出信号的控制下，可靠的驱动与其连接的像素电路工作。提高像素电路的工作可靠性。
另外，该信号整合电路20还可以在第一输出信号的电位和第二输出信号的电位均为第二电位时，在控制电源信号、第一输出信号和第二输出信号的控制下，向第三输出端OUT3输出来自第一下拉电源信号端VGL的第一下拉电源信号，该第一下拉电源信号的电位可以为第二电位。在本发明实施例中，该第二电位可以为无效电位(该无效电位是指控制移位寄存器单元包括的晶体管关断，使得移位寄存器单元停止工作的电位)，且该第二电位相对于该第一电位可以为低电位。
综上所述，本发明实施例提供了一种移位寄存器单元。该移位寄存器单元包括移位电路和信号整合电路。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出该控制电源信号，以及可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出该控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线上，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。
图2是本发明实施例提供的另一种移位寄存器单元的结构示意图。如图2所示，该信号整合电路可以包括：第一输入子电路201、第一输出子电路202、第二输入子电路203、第二输出子电路204、下拉控制子电路205和下拉子电路206。
参考图2，该第一输入子电路201可以分别与控制电源端VDD和第一节点P1连接。该第一输入子电路201可以响应于控制电源信号，向第一节点P1输出该控制电源信号。
示例的，该控制电源信号的电位为第一电位，该第一输入子电路201可以在控制电源信号的控制下，向第一节点P1输出处于第一电位的控制电源信号，从而实现对第一节点P1的充电。
该第一输出子电路202可以分别与第一节点P1、控制电源端VDD、第一输出端OUT1和第三输出端OUT3连接。该第一输出子电路202可以响应于第一节点P1的电位和第一输出信号，向第三输出端OUT3输出控制电源信号。
示例的，该第一输出子电路202可以在第一节点P1的电位和第一输出信号的电位均为第一电位(即移位电路10向第一输出端OUT1输出处于第一电位的控制电源信号)时，向第三输出端OUT3输出该控制电源信号。
该第二输入子电路203可以分别与控制电源端VDD和第二节点P2连接。该第二输入子电路203可以响应于控制电源信号，向第二节点P2输出该控制电源信号。
示例的，该控制电源信号的电位为第一电位，该第二输入子电路203可以在控制电源信号的控制下，向第二节点P2输出该处于第一电位的控制电源信号，从而实现对第二节点P2的充电。
该第二输出子电路204可以分别与第二节点P2、控制电源端VDD、第二输出端OUT2和第三输出端OUT3连接。该第二输出子电路204可以响应于第二节点P2的电位和第二输出信号，向第三输出端OUT3输出控制电源信号。
示例的，该第二输出子电路204可以在第二节点P2的电位和第二输出信号的电位均为第一电位(即移位电路10向第二输出端OUT2输出处于第一电位的控制电源信号)时，向第三输出端OUT3输出该控制电源信号。
该下拉控制子电路205可以分别与控制电源端VDD、第三节点P3、第一输出端OUT1、第二输出端OUT2和第二下拉电源端LVGL连接。该下拉控制子电路205可以响应于第一输出信号或第二输出信号，向第三节点P3输出来自第二下拉电源端LVGL的第二下拉电源信号。该下拉控制子电路205还可以响应于控制电源信号，向第三节点P3输出控制电源信号。
示例的，该下拉控制子电路205可以在第一输出信号的电位或者第二输出信号的电位为第一电位(即在移位电路10向第一输出端OUT1输出处于第一电位的控制电源信号，或者向第二输出端OUT2输出处于第一电位的控制电源信号时)时，向第三节点P3输出来自第二下拉电源端LVGL的第二下拉电源信号，该第二下拉电源信号的电位为第三电位。另外，该下拉控制子电路205还可以在第一输出信号的电位和第二输出信号的电位均为第二电位时，在控制电源信号的控制下，向第三节点P3输出处于第一电位的控制电源信号。
参考图2，该下拉子电路206可以分别与第三节点P3、第一下拉电源端VGL和第三输出端OUT3连接。该下拉子电路206可以响应于第三节点P3的电位，向第三输出端OUT3输出第一下拉电源信号。
示例的，该下拉子电路206可以在第三节点P3的电位为第一电位时，向第三输出端OUT3输出处于第二电位的第一下拉电源信号，从而实现对第三输出端OUT3的复位。
需要说明的是，在本发明实施例中，该第二下拉电源端LVGL提供的第二下拉电源信号的电位(即第三电位)相对于该第一下拉电源端VGL提供的第一下拉电源信号的电位(即第二电位)为低电位。通过向第三节点P3输出更低电位的第二下拉电源信号，可以确保下拉子电路206在该第三节点P3的控制下不会误开启，避免下拉子电路206误开启而无法对第三输出端OUT3进行有效复位的问题。进一步有效保证了移位寄存器单元的工作可靠性。
图3是本发明实施例提供的又一种移位寄存器单元的结构示意图。如图3所示，该第一输入子电路201可以包括：第一输入晶体管M1；第一输出子电路202可以包括：第一输出晶体管T1、第二输出晶体管T2和第一电容器C1；第二输入子电路203可以包括：第二输入晶体管M2；第二输出子电路204可以包括：第三输出晶体管T3、第四输出晶体管T4和第二电容器C2。
如图3所示，该第一输入晶体管M1的栅极和第一极可以均与控制电源端VDD连接，该第一输入晶体管M1的第二极可以与第一节点P1连接。
该第一输出晶体管T1的栅极可以与第一输出端OUT1连接，该第一输出晶体管T1的第一极可以与控制电源端VDD连接，该第一输出晶体管T1的第二极可以与第二输出晶体管T2的第一极连接。
该第二输出晶体管T2的栅极可以与第一节点P1连接，该第二输出晶体管T2的第二极可以与第三输出端OUT3连接。
该第一电容器C1的一端可以与第一节点P1连接，该第一电容器C1的另一端可以与第三输出端OUT3连接。
该第二输入晶体管M2的栅极和第一极可以均与控制电源端VDD连接，该第二输入晶体管M2的第二极可以与第二节点P2连接。
该第三输出晶体管T3的栅极可以与第二输出端OUT2连接，该第三输出晶体管T3的第一极可以与控制电源端VDD连接，该第三输出晶体管T3的第二极可以与第四输出晶体管T4的第一极连接。
该第四输出晶体管T4的栅极可以与第二节点P2连接，该第四输出晶体管T4的第二极可以与第三输出端OUT3连接。
该第二电容器C2的一端可以与第二节点P2连接，该第二电容器C2的另一端可以与第三输出端OUT3连接。
通过设置第一电容器C1，可以使得在第三输出端OUT3的电位为第一电位时，第一节点P1的电位可以在该第一电容器C1的自举作用下被进一步拉高，保证第二输出晶体管T2可以充分开启。相应的，避免了第二输出晶体管T2的阈值电压Vth对第二输出晶体管T2输出的信号造成影响，使得第二输出晶体管T2可以向第三输出端OUT3无损输出控制电源信号，即使得第二输出晶体管T2向第三输出端OUT3输出的控制电源信号不会由于阈值电压的影响而受到损耗，保证了第二输出晶体管T2向第三输出端OUT3输出的信号的可靠性。
同理，通过设置第二电容器C2，可以使得在第三输出端OUT3的电位为第一电位时，第二节点P2的电位可以在该第二电容器C2的自举作用下被进一步拉高，保证第四输出晶体管T4可以充分开启。相应的，避免了第四输出晶体管T4的阈值电压Vth对第四输出晶体管T4输出的信号造成影响，使得第四输出晶体管T4可以向第三输出端OUT3无损输出控制电源信号，即使得第四输出晶体管T4向第三输出端OUT3输出的控制电源信号不会由于阈值电压的影响而受到损耗，保证了第四输出晶体管T4向第三输出端OUT3输出的信号的可靠性。
其中，该自举作用是指电容器利用其两端电压差无法突变的特性，使用一端的电压抬高另一端的电压。即当电容器一端的电压升高时，由于电容器的两端电压差保持不变，则另一端的电压相应的也可以被拉高。
可选的，由于第一输入晶体管M1的栅极和第二输入晶体管M2的栅极连接的信号端，第一输入晶体管M1的第一极和第二输入晶体管M2的第一极连接的信号端，以及第一输入晶体管M1的第二极和第二输入晶体管M2的第二极连接的信号端均相同。第二输出晶体管T2的栅极和第四输出晶体管T4的栅极连接的信号端，以及第二输出晶体管T2的第二极和第四输出晶体管T4的第二极连接的信号端均相同。第一电容器C1的两端和第二电容器C2的两端连接的信号端也均相同。因此，在本发明实施例中，图3所示的第二输入晶体管M2可以复用第一输入晶体管M1，第二输出晶体管T2可以复用第四输出晶体管T4，第二电容器C2可以复用第一电容器C1。
示例的，图4是本发明实施例提供的再一种移位寄存器单元的结构示意图。如图4所示，该第一输入子电路201和第二输入子电路203可以共用一个输入晶体管，例如图4所示的第一输入晶体管M1。该第一输出子电路202和第二输出子电路204可以共用一个输出晶体管和一个电容器，例如图4所示的第二输出晶体管T2和第一电容器C1。相应的，该第一节点P1和第二节点P2即为同一个节点(如图4所示的第一节点P1)。
通过复用晶体管，可以在实现信号整合，保证像素电路可靠工作的前提下，减少使用的晶体管的数量，例如图4相对于图3的移位寄存器单元，节省了两个晶体管和一个电容器。进而可以简化信号整合电路20的结构，节省生产成本，为量产提供了技术支持，并且还有利于窄边框显示面板的实现。
可选的，图5是本发明实施例提供的再一种移位寄存器单元的结构示意图。如图5所示，该控制电源端VDD可以包括第一电源端VDDo和第二电源端VDDe。该第一电源端VDDo提供的第一电源信号的电位与第二电源端VDDe提供的第二电源信号的电位互补。也即是，在第一电源信号的电位为第一电位时，第二电源信号的电位为第二电位；在第一电源信号的电位为第二电位时，第二电源信号的电位为第一电位。
相应的，如图5所示，该第一输入子电路201可以分别与第一电源端VDDo和第一节点P1连接。该第一输入子电路201可以响应于第一电源端VDDo提供的第一电源信号，向第一节点P1输出第一电源信号。
示例的，该第一输入子电路201可以在第一电源信号的电位为第一电位时，向第一节点P1输出该第一电源信号，从而实现对第一节点P1的充电。
该第一输出子电路202可以分别与第一电源端VDDo、第一节点P1、第一输出端OUT1和第三输出端OUT3连接。该第一输出子电路202可以响应于第一节点P1的电位和第一输出信号，向第三输出端OUT3输出第一电源信号。
示例的，该第一输出子电路202可以在第一电源信号的电位和第一输出信号的电位均为第一电位(即移位电路10向第一输出端OUT1输出处于第一电位的第一电源信号时)时，向第三输出端OUT3输出该第一电源信号。
该第二输入子电路203可以分别与第二电源端VDDe和第二节点P2连接。该第二输入子电路203可以响应于第二电源端VDDe提供的第二电源信号，向第二节点P2输出第二电源信号。
示例的，该第二输入子电路203可以在第二电源信号的电位为第一电位时，向第二节点P2输出该第二电源信号，从而实现对第二节点P2的充电。
该第二输出子电路204可以分别与第二电源端VDDe、第二节点P2、第二输出端OUT2和第三输出端OUT3连接。该第二输出子电路204可以响应于第二节点P2的电位和第二输出信号，向第三输出端OUT3输出第二电源信号。
示例的，该第二输出子电路204可以在第二电源信号的电位和第二输出信号的电位均为第一电位(即移位电路10向第二输出端OUT2输出处于第一电位的第二电源信号)时，向第三输出端OUT3输出该第二电源信号。
通过设置两个输出电位互补的电源端(第一电源端VDDo和第二电源端VDDe)来分别控制第一节点P1的电位和第二节点P2的电位，可以降低第一输入晶体管M1和第二输入晶体管M2的栅极偏压，减小第一输入晶体管M1和第二输入晶体管M2的阈值电压Vth发生的偏移，提高了移位寄存器单元工作的稳定性。并且，还可以避免第一输入晶体管M1和第二输入晶体管M2在处于第一电位的控制电源信号的控制下，长时间处于开启状态时，使用寿命较短的问题，提高了移位寄存器单元的工作可靠性。
可选的，该第一电源信号的电位和第二电源信号的电位的跳变时间均可以小于或等于时间阈值。
示例的，假设该时间阈值为3秒(s)，第一电源信号的电位和第二电源信号的电位跳变时间均等于该时间阈值，则该第一电源信号的电位和第二电源信号的电位即均可以3s跳变一次。
相应的，图6是本发明实施例提供的再一种移位寄存器单元的结构示意图。如图6所示，该第一输出子电路202还可以包括：第五输出晶体管T5；该第二输出子电路204还可以包括：第六输出晶体管T6。
参考图6，第一输入晶体管M1的栅极和第一极可以均与第一电源端VDDo连接，该第一输入晶体管M1的第二极可以与第一节点P1连接。
第二输入晶体管M2的栅极和第一极可以均与第二电源端VDDe连接，该第二输入晶体管M2的第二极可以与第二节点P2连接。
该第五输出晶体管T5的栅极和第一极可以均与第一电源端VDDo连接，该第五输出晶体管T5的第二极可以与第一输出晶体管T1的第一极连接。
该第六输出晶体管T6的栅极和第一极可以均与第二电源端VDDe连接，该第六输出晶体管T6的第二极可以与第三输出晶体管T3的第一极连接。
参考图6可以看出，由于该第一输出晶体管T3的第一极和第三输出晶体管T3的第一极通过一个节点引出。因此通过设置第五输出晶体管T5将第一电源端VDDo提供的第一电源信号输出至第一输出晶体管T1的第一极，以及通过设置第六输出晶体管T6将第二电源端VDDe提供的第二电源信号输出至第三输出晶体管T1的第一极，可以避免第一电源端VDDo和第二电源端VDDe之间相互短路的问题，保证了信号整合电路20的工作可靠性，进而保证了移位寄存器单元的工作可靠性。
可选的，参考图3、图4和图6还可以看出，该下拉控制子电路205可以包括：第一下拉控制晶体管L1、第二下拉控制晶体管L2和第三下拉控制晶体管L3。该下拉子电路206可以包括：下拉晶体管K1。
该第一下拉控制晶体管L1的栅极和第一极可以均与控制电源端VDD连接，该第一下拉控制晶体管L1的第二极可以与第三节点P3连接。
该第二下拉控制晶体管L2的栅极可以与第一输出端OUT1连接，该第三下拉控制晶体管L3的栅极可以与第二输出端OUT2连接。该第二下拉控制晶体管L2的第一极和该第三下拉控制晶体管L3的第一极可以均与第二下拉电源端LVGL连接。该第二下拉控制晶体管L2的第二极和该第三下拉控制晶体管L3的第二极可以均与第三节点P3连接。
该下拉晶体管K1的栅极可以与第三节点P3连接，该下拉晶体管K1的第一极可以与第一下拉电源端VGL连接，该下拉晶体管K1的第二极可以与第三输出端OUT3连接。
图7是本发明实施例提供的再一种移位寄存器单元的结构示意图。如图7所示，该移位电路10可以包括：第一移位子电路101和第二移位子电路102。
该第一移位子电路101可以分别与控制电源端VDD和第一输出端OUT1连接。该第一移位子电路101可以在显示阶段，向第一输出端OUT1输出来自控制电源端VDD的控制电源信号。该第二移位子电路102可以分别与控制电源端VDD和第二输出端OUT2连接。该第二移位子电路102可以在消隐阶段，向第二输出端OUT2输出来自控制电源端VDD的控制电源信号。
示例的，参考图5和图6，该控制电源端VDD可以包括第一电源端VDDo和第二电源端VDDe。相应的，参考图7，该第一移位子电路101和第二移位子电路102均可以分别与第一电源端VDDo和第二电源端VDDe连接。
可选的，每个移位子电路均可以包括：下拉控制模块和下拉模块。
每个下拉控制模块可以分别与控制电源端、下拉节点、第二下拉电源端和上拉节点连接。每个下拉控制模块均可以响应于控制电源信号，向下拉节点输出控制电源信号，以及可以响应于上拉节点的电位，向下拉节点输出第二下拉电源信号。第一移位子电路101中的下拉模块可以分别与该第一移位子电路101中的下拉节点、第一下拉电源端和第一输出端连接。该第一移位子电路101可以响应于第一移位子电路101中的下拉节点的电位，向第一输出端输出第一下拉电源信号。第二移位子电路102中的下拉模块可以分别与该第二移位子电路102中的下拉节点、第一下拉电源端和第一输出端连接。该第一移位子电路102可以响应于第二移位子电路102中的下拉节点的电位，向第二输出端输出第一下拉电源信号。
可选的，在本发明实施例中，该信号整合电路20中的下拉控制子电路205和下拉子电路206，可以复用第二移位子电路102中的下拉控制模块和第二移位子电路102中的下拉模块。示例的，图8是本发明实施例提供的再一种移位寄存器单元的结构示意图。如图8所示，该信号整合电路20中的下拉晶体管K1可以与第二移位子电路102中的下拉节点QB连接。
由于第一移位子电路101是在显示阶段，向第一输出端OUT1输出控制电源信号，第二移位子电路102是在消隐阶段，向第二输出端OUT2输出控制电源信号。且一般情况下，在消隐阶段向第二输出端OUT2输出控制电源信号的脉冲宽度，大于在显示阶段向第一输出端OUT1输出控制电源信号。因此通过复用第二移位子电路102中的下拉控制模块和下拉模块，可以使得在第二移位子电路102向第二输出端OUT2输出控制电源信号时，下拉子电路206不会开启。避免下拉子电路206在第二移位子电路102向第二输出端OUT2输出控制电源信号时，对第三输出端OUT3进行下拉的问题。在简化移位寄存器单元结构的前提下，保证了移位寄存器单元的工作可靠性。
通过复用移位电路中的下拉控制模块和下拉模块，可以在实现信号整合，保证像素电路工作可靠性的前提下，进一步减少移位寄存器单元中的晶体管的数量，即可以简化移位寄存器单元的结构。相应的，进一步节省了生产成本，更加有利于窄边框显示装置的实现。
可选的，参考图7和图8可以看出，该第一移位子电路101和第二移位子电路102还可以分别与第一下拉电源端VGL和第二下拉电源端LVGL连接。该第一移位子电路101可以在该第一下拉电源端VGL和第二下拉电源端LVGL的控制下，对第一输出端OUT1提供的第一输出信号进行复位。该第二移位子电路102可以在该第一下拉电源端VGL和第二下拉电源端LVGL的控制下，对第二输出端OUT2提供的第一输出信号进行复位。
相应的，在本发明实施例中，该信号整合电路20可以复用移位电路10中的信号线。例如，参考图7和图8，该信号整合电路20可以复用移位电路10中的第一下拉电源端VGL、第二下拉电源端LVGL、第一电源端VDDo和第二电源端VDDe。通过复用信号线，可以减少信号线的设置，使得该信号整合电路20更加便于集成在显示面板中。
可选的，该移位电路10可以仅包括一个移位子电路。相应的，该一个移位子电路可以与第一输出端OUT1和第二输出端OUT2连接。本发明实施例对该移位电路10的具体结构不做限定。
需要说明的是，在上述各实施例中，均是以各个晶体管为N型晶体管，且第一电位相对于第二电位为低电位为例进行的说明。当然，各个晶体管还可以采用P型晶体管，当该各个晶体管采用P型晶体管时，该第一电位相对于第二电位可以为高电位。
综上所述，本发明实施例提供了一种移位寄存器单元。该移位寄存器单元包括移位电路和信号整合电路。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出该控制电源信号，以及可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出该控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线上，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。
图9是本发明实施例提供的一种移位寄存器单元的驱动方法流程图，可以应用于如图1至图8任一所示的移位寄存器单元中。如图9所示，该方法包括：
步骤901、在第一阶段，控制电源端提供的控制电源信号的电位为第一电位，移位电路向第一输出端输出该控制电源信号，信号整合电路响应于该第一输出端提供的第一输出信号和该控制电源信号，向第三输出端输出该控制电源信号。
步骤902、在第二阶段，控制电源信号的电位为第一电位，第一输出信号的电位和第二输出端提供的第二输出信号的电位均为第二电位，信号整合电路响应于控制电源信号、第一输出信号和第二输出信号，向第三输出端输出来自第一下拉电源端的第一下拉电源信号，该第一下拉电源信号的电位为第二电位。
步骤903、在第三阶段，控制电源信号的电位为第一电位，移位电路向第二输出端输出该控制电源信号，信号整合电路响应于第二输出信号和控制电源信号，向第三输出端输出控制电源信号。
综上所述，本发明实施例提供了一种移位寄存器单元的驱动方法。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出该控制电源信号，以及可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出该控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线上，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。
另外，以图3所示的移位寄存器单元为例，并以移位寄存器单元中各个晶体管均为N型晶体管，第一电位相对于第二电位为低电位，控制电源端VDD提供的控制电源信号的电位为第一电位为例，对本发明实施例提供的移位寄存器单元的驱动原理进行介绍：
图10是本发明实施例提供的一种栅极驱动电路中各个信号端输出信号的时序图。如图10所示，在第一阶段t1，移位电路10向第一输出端OUT1输出该处于第一电位的控制电源信号。第一输入晶体管M1和第一输出晶体管T1开启，控制电源端VDD通过该第一输入晶体管M1向第一节点P1输出处于第一电位的控制电源信号，第二输出晶体管T2开启。控制电源端VDD通过第一输出晶体管T1和第二输出晶体管T2向第三输出端OUT3输出控制电源信号。此时，第一节点P1的电位可以在第一电容器C1的自举作用下被进一步拉高，第二输出晶体管T2充分开启。进而使得控制电源端VDD向第三输出端OUT3无阈值损失的输出该控制电源信号。相应的，该第三输出端OUT3可以将该处于第一电位的控制电源信号输出至与其连接的一条栅线，从而驱动像素电路中的发光单元发光。该第一阶段t1也可以称为显示阶段。
另外，参考图10，在第一阶段t1，由于第一输出端OUT1提供的第一输出信号的电位为第一电位，因此第二下拉控制晶体管L2开启，第二下拉电源端LVGL可以通过第二下拉控制晶体管L2向第三节点P3输出处于第三电位的第二下拉电源信号，使得下拉晶体管K1关断，保证第三输出端OUT3的正常输出。
在第二阶段t2，第一输出端OUT1提供的第一输出信号的电位，和第二输出端OUT2提供的第二输出信号的电位均为第二电位。此时，第一输出晶体管T1、第三输出晶体管T3、第二下拉控制晶体管L2和第三下拉控制晶体管L3均关断。由于控制电源端VDD提供的控制电源信号的电位为第一电位，因此第一下拉控制晶体管L1开启，控制电源端VDD通过该第一下拉控制晶体管L1向第三节点P3输出处于第一电位的控制电源信号，下拉晶体管K1开启。第一下拉电源端VGL通过该下拉晶体管K1向第三输出端OUT3输出处于第二电位的第一下拉电源信号，从而实现对第三输出端OUT3的复位。该第二阶段t2也可以称为复位阶段。
在第三阶段t3，移位电路10向第二输出端OUT2输出处于第一电位的控制电源信号。第二输入晶体管M2和第三输出晶体管T3开启，控制电源端VDD通过该第二输入晶体管M2向第二节点P2输出处于第一电位的控制电源信号，第四输出晶体管T4开启。控制电源端VDD通过第三输出晶体管T3和第四输出晶体管T4向第三输出端OUT3输出该控制电源信号。此时，第二节点P2的电位可以在第二电容器C2的自举作用下被进一步拉高，第四输出晶体管T4充分开启。进而使得控制电源端VDD向第三输出端OUT3无阈值损失的输出该控制电源信号。相应的，该第三输出端OUT3可以将该处于第一电位的控制电源信号输出至与其连接的一条栅线，从而使得像素电路中的检测晶体管实现对驱动晶体管的驱动电流的检测，进而实现外部补偿功能。由于外部补偿一般是在消隐阶段执行，因此该第三阶段t3也可以称为消隐阶段。
另外，参考图10，在第三阶段t3，由于第二输出端OUT2提供的第二输出信号的电位为第一电位，因此第三下拉控制晶体管L3开启，第二下拉电源端LVGL可以通过第三下拉控制晶体管L3向第三节点P3输出处于第三电位的第二下拉电源信号，使得下拉晶体管K1关断，保证第三输出端OUT3的正常输出。
可选，参考图10可以看出，第三输出端OUT3在第三阶段t3的脉冲宽度，大于在第一阶段t1的脉冲宽度。进而可以保证像素电路在消隐阶段，在第三输出端OUT3向栅线提供的驱动信号的控制下，可靠的检测驱动晶体管的驱动电流，进而对像素电路进行有效的外部补偿，保证显示装置的显示效果。
可选的，图11是以图4所示的移位寄存器单元为例，示出的一种移位寄存器单元中各个信号端的时序仿真图。如图11所示，其横轴可以是指：时间(微秒/μs)，纵轴可以是指：电压值(伏特/V)。
参考图11可以看出，在第10μs至15μs的时间段内，移位电路10向第一输出端OUT1输出的控制电源信号的电压为24V。在第20μs至第25μs的时间段内，移位电路10向第二输出端OUT2输出的控制电源信号的电压也为24V。并且，在第10μs至15μs和第20μs至第25μs的时间段内，第一节点P1的电压在第一电容器C1的自举作用下可以达到51V，进而保证了第二输出晶体管T2可以充分开启。相应的，可以保证控制电源端VDD将控制电源信号无损输出至第三输出端OUT3。例如，参考图11，在第10μs至15μs和第20μs至第25μs的时间段内，第三输出端OUT3的电压可以达到23V。
并且，参考图11还可以看出，在第15μs至20μs的时间段内，第一下拉电源端VGL通过下拉晶体管K1向第三输出端OUT3输出的第一下拉电源信号的电压为-6V。而在第10μs至15μs和第20μs至第25μs的时间段内，第二下拉电源端LVGL通过第二下拉控制晶体管L2或第三下拉控制晶体管L3向第三节点P3输出的第二下拉电源信号的电位为-7.6V。通过向第三节点P3输出更低电位的第二下拉电源信号，可以保证下拉晶体管K1不会被误开启，进而保证第三输出端OUT3的正常输出。
需要说明的是，在上述各实施例中，均是以各个晶体管为N型晶体管，且第一电位相对于第二电位为低电位为例进行的说明。当然，各个晶体管还可以采用P型晶体管，当该各个晶体管采用P型晶体管时，该第一电位相对于第二电位可以为高电位。
综上所述，本发明实施例提供了一种移位寄存器单元的驱动方法。由于移位电路可以在显示阶段和消隐阶段向第一输出端和第二输出端分别输出控制电源信号，因此可以实现显示和外部补偿功能。且由于信号整合电路可以在控制电源信号和第一输出端提供的第一输出信号的控制下，向第三输出端输出该控制电源信号，以及可以在控制电源信号和第二输出端提供的第二输出信号的控制下，向第三输出端输出该控制电源信号。因此可以实现将第一输出信号和第二输出信号整合输出至第三输出端，并由第三输出端将整合后的信号输出至驱动像素电路的一条栅线上，从而在实现外部补偿的前提下，还保证了像素电路的工作可靠性。
本发明实施例提供了一种栅极驱动电路，该栅极驱动电路可以包括至少两个级联的移位寄存器单元，其中每个移位寄存器单元可以包括：如图1至图8任一所示的移位寄存器单元。
每一级移位寄存器单元的第三输出端OUT3可以与上一级移位寄存器单元的复位信号端连接；每一级移位寄存器单元的第三输出端OUT3可以与下一级移位寄存器单元的输入信号端连接。
图12是本发明实施例提供的一种栅极驱动电路中各信号端的时序图。如图12所示，第n级移位寄存器单元的第三输出端OUT3(n)输出的驱动信号的电位为第n级移位寄存器单元的第一输出端OUT1(n)输出的第一输出信号的电位，且为第n级移位寄存器单元的第二输出端OUT2(n)输出的第二输出信号的电位。即参考图12，当第n级移位寄存器单元的第一输出端OUT1(n)输出的第一输出信号的电位为第一电位时，第n级移位寄存器单元的第三输出端OUT3(n)输出的驱动信号的电位为第一电位；当第n级移位寄存器单元的第一输出端OUT2(n)输出的第一输出信号的电位为第一电位时，第n级移位寄存器单元的第三输出端OUT3(n)输出的驱动信号的电位也为第一电位。即实现了将第一输出信号和第二输出信号的整合，第n+1级同理。每级移位寄存器单元的驱动原理均可以参考上述描述的驱动原理，本发明实施例对此不再赘述。
另外，本发明实施例还提供一种显示装置，该显示装置可以包括上述所述的栅极驱动电路。该显示装置可以为：电子纸、OLED显示装置、AMOLED显示装置、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
所属领域的技术人员可以清楚地了解到，为描述的方便和简洁，上述描述的移位寄存器单元和各电路的具体工作过程，可以参考前述方法实施例中的对应过程，在此不再赘述。
以上所述仅为本发明的可选实施例，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (9)

1.一种移位寄存器单元，其特征在于，所述移位寄存器单元包括：移位电路和信号整合电路；
所述移位电路分别与控制电源端、第一输出端和第二输出端连接，所述移位电路用于在显示阶段，向所述第一输出端输出来自所述控制电源端的控制电源信号，以及用于在消隐阶段，向所述第二输出端输出所述控制电源信号；
所述信号整合电路分别与所述控制电源端、所述第一输出端、所述第二输出端、第一下拉电源端和第三输出端连接，所述信号整合电路用于响应于所述控制电源信号和所述第一输出端提供的第一输出信号，在所述显示阶段向所述第三输出端输出所述控制电源信号；
所述信号整合电路还用于响应于所述控制电源信号和所述第二输出端提供的第二输出信号，在所述消隐阶段向所述第三输出端输出所述控制电源信号；
所述信号整合电路还用于响应于所述控制电源信号、所述第一输出信号和所述第二输出信号，向所述第三输出端输出来自所述第一下拉电源端的第一下拉电源信号，所述第三输出端与一条栅线连接，用于向所述栅线输出驱动信号；
其中，所述信号整合电路包括：第一输入子电路、第一输出子电路、第二输入子电路、第二输出子电路、下拉控制子电路和下拉子电路；
所述第一输入子电路分别与所述控制电源端和第一节点连接，用于响应于所述控制电源信号，向所述第一节点输出所述控制电源信号；
所述第一输出子电路分别与所述第一节点、所述控制电源端、所述第一输出端和所述第三输出端连接，用于响应于所述第一节点的电位和所述第一输出信号，向所述第三输出端输出所述控制电源信号；
所述第二输入子电路分别与所述控制电源端和第二节点连接，用于响应于所述控制电源信号，向所述第二节点输出所述控制电源信号；
所述第二输出子电路分别与所述第二节点、所述控制电源端、所述第二输出端和所述第三输出端连接，用于响应于所述第二节点的电位和所述第二输出信号，向所述第三输出端输出所述控制电源信号；
所述下拉控制子电路分别与所述控制电源端、第三节点、所述第一输出端、所述第二输出端和第二下拉电源端连接，用于响应于所述第一输出信号或所述第二输出信号，向所述第三节点输出来自所述第二下拉电源端的第二下拉电源信号，以及用于响应于所述控制电源信号，向所述第三节点输出所述控制电源信号；
所述下拉子电路分别与所述第三节点、所述第一下拉电源端和所述第三输出端连接，用于响应于所述第三节点的电位，向所述第三输出端输出所述第一下拉电源信号。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一输入子电路包括：第一输入晶体管；所述第一输出子电路包括：第一输出晶体管、第二输出晶体管和第一电容器；所述第二输入子电路包括：第二输入晶体管；所述第二输出子电路包括：第三输出晶体管、第四输出晶体管和第二电容器；
所述第一输入晶体管的栅极和第一极均与所述控制电源端连接，所述第一输入晶体管的第二极与所述第一节点连接；
所述第一输出晶体管的栅极与所述第一输出端连接，所述第一输出晶体管的第一极与所述控制电源端连接，所述第一输出晶体管的第二极与所述第二输出晶体管的第一极连接；
所述第二输出晶体管的栅极与所述第一节点连接，所述第二输出晶体管的第二极与所述第三输出端连接；
所述第一电容器的一端与所述第一节点连接，所述第一电容器的另一端与所述第三输出端连接；
所述第二输入晶体管的栅极和第一极均与所述控制电源端连接，所述第二输入晶体管的第二极与所述第二节点连接；
所述第三输出晶体管的栅极与所述第二输出端连接，所述第三输出晶体管的第一极与所述控制电源端连接，所述第三输出晶体管的第二极与所述第四输出晶体管的第一极连接；
所述第四输出晶体管的栅极与所述第二节点连接，所述第四输出晶体管的第二极与所述第三输出端连接；
所述第二电容器的一端与所述第二节点连接，所述第二电容器的另一端与所述第三输出端连接。
3.根据权利要求2所述的移位寄存器单元，其特征在于，
所述第二输入晶体管复用所述第一输入晶体管，所述第二输出晶体管复用所述第四输出晶体管，所述第二电容器复用所述第一电容器。
4.根据权利要求2所述的移位寄存器单元，其特征在于，所述控制电源端包括第一电源端和第二电源端，所述第一电源端提供的第一电源信号的电位与所述第二电源端提供的第二电源信号的电位互补；
所述第一输入子电路分别与所述第一电源端和所述第一节点连接，用于响应于所述第一电源端提供的第一电源信号，向所述第一节点输出所述第一电源信号；所述第一输出子电路分别与所述第一电源端、所述第一节点、所述第一输出端和所述第三输出端连接，用于响应于所述第一节点的电位和所述第一输出信号，向所述第三输出端输出所述第一电源信号；
所述第二输入子电路分别与所述第二电源端和所述第二节点连接，用于响应于所述第二电源端提供的第二电源信号，向所述第二节点输出所述第二电源信号，所述第二输出子电路分别与所述第二电源端、所述第二节点、所述第二输出端和所述第三输出端连接，用于响应于所述第二节点的电位和所述第二输出信号，向所述第三输出端输出所述第二电源信号。
5.根据权利要求4所述的移位寄存器单元，其特征在于，
所述第一输入晶体管的栅极和第一极均与所述第一电源端连接，所述第一输入晶体管的第二极与所述第一节点连接；
所述第二输入晶体管的栅极和第一极均与所述第二电源端连接，所述第二输入晶体管的第二极与所述第二节点连接；
所述第一输出子电路还包括：第五输出晶体管，所述第二输出子电路还包括：第六输出晶体管；
所述第五输出晶体管的栅极和第一极均与所述第一电源端连接，所述第五输出晶体管的第二极与所述第一输出晶体管的第一极连接；
所述第六输出晶体管的栅极和第一极均与所述第二电源端连接，所述第六输出晶体管的第二极与所述第三输出晶体管的第一极连接。
6.根据权利要求1至5任一所述的移位寄存器单元，其特征在于，所述移位电路包括：第一移位子电路和第二移位子电路；所述第一移位子电路分别与所述控制电源端和所述第一输出端连接，用于向所述第一输出端输出所述控制电源信号；所述第二移位子电路分别与所述控制电源端和所述第二输出端连接，用于向所述第二输出端输出所述控制电源信号；每个所述移位子电路均包括：下拉控制模块和下拉模块；
每个所述下拉控制模块分别与所述控制电源端、下拉节点、所述第二下拉电源端和上拉节点连接，用于响应于所述控制电源信号，向所述下拉节点输出所述控制电源信号，以及用于响应于所述上拉节点的电位，向所述下拉节点输出所述第二下拉电源信号；
所述第一移位子电路中的下拉模块分别与所述第一移位子电路中的下拉节点、所述第一下拉电源端和所述第一输出端连接，用于响应于所述第一移位子电路中的下拉节点的电位，向所述第一输出端输出所述第一下拉电源信号，所述第二移位子电路中的下拉模块分别与所述第二移位子电路中的下拉节点、所述第一下拉电源端和所述第二输出端连接，用于响应于所述第二移位子电路中的下拉节点的电位，向所述第二输出端输出所述第一下拉电源信号；
所述下拉控制子电路复用所述第二移位子电路中的下拉控制模块，所述下拉子电路复用所述第二移位子电路中的下拉模块。
7.一种移位寄存器单元的驱动方法，其特征在于，应用于如权利要求1至6任一所述的移位寄存器单元，所述方法包括：
在第一阶段，控制电源端提供的控制电源信号的电位为第一电位，移位电路向第一输出端输出所述控制电源信号，信号整合电路响应于所述第一输出端提供的第一输出信号和所述控制电源信号，向第三输出端输出所述控制电源信号；
在第二阶段，所述控制电源信号的电位为第一电位，所述第一输出信号的电位和第二输出端提供的第二输出信号的电位均为第二电位，所述信号整合电路响应于所述控制电源信号、所述第一输出信号和所述第二输出信号，向所述第三输出端输出来自第一下拉电源端的第一下拉电源信号，所述第一下拉电源信号的电位为第二电位；
在第三阶段，所述控制电源信号的电位为第一电位，所述移位电路向所述第二输出端输出所述控制电源信号，所述信号整合电路响应于所述第二输出信号和所述控制电源信号，向所述第三输出端输出所述控制电源信号。
8.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括：至少两个级联的如权利要求1至6任一所述的移位寄存器单元；
每一级移位寄存器单元的第三输出端与下一级移位寄存器单元的输入信号端连接，每一级移位寄存器单元的第三输出端与上一级移位寄存器单元的复位信号端连接。
9.一种显示装置，其特征在于，所述显示装置包括：如权利要求8所述的栅极驱动电路。
CN201910112669.2A 2019-02-13 2019-02-13 移位寄存器单元、驱动方法、栅极驱动电路及显示装置 Active CN109616041B (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN201910112669.2A CN109616041B (zh) 2019-02-13 2019-02-13 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
PCT/CN2020/074922 WO2020164525A1 (zh) 2019-02-13 2020-02-12 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
US17/256,049 US11328675B2 (en) 2019-02-13 2020-02-12 Shift register unit, driving method, gate driving circuit, and display device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201910112669.2A CN109616041B (zh) 2019-02-13 2019-02-13 移位寄存器单元、驱动方法、栅极驱动电路及显示装置

Publications (2)

Publication Number Publication Date
CN109616041A CN109616041A (zh) 2019-04-12
CN109616041B true CN109616041B (zh) 2021-04-16

Family

ID=66018882

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201910112669.2A Active CN109616041B (zh) 2019-02-13 2019-02-13 移位寄存器单元、驱动方法、栅极驱动电路及显示装置

Country Status (3)

Country Link
US (1) US11328675B2 (zh)
CN (1) CN109616041B (zh)
WO (1) WO2020164525A1 (zh)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109616041B (zh) * 2019-02-13 2021-04-16 合肥京东方卓印科技有限公司 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
CN112133254B (zh) 2019-06-25 2021-12-17 京东方科技集团股份有限公司 移位寄存器单元、栅极驱动电路、显示装置和控制方法
CN110634436B (zh) * 2019-09-26 2022-09-23 合肥京东方卓印科技有限公司 栅极驱动电路及显示面板
CN113035258A (zh) * 2021-03-09 2021-06-25 京东方科技集团股份有限公司 移位寄存器、栅极驱动电路及显示面板

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007317288A (ja) * 2006-05-25 2007-12-06 Mitsubishi Electric Corp シフトレジスタ回路およびそれを備える画像表示装置
JP2009047746A (ja) * 2007-08-14 2009-03-05 Sony Corp 表示装置および電子機器
JP2009086143A (ja) * 2007-09-28 2009-04-23 Panasonic Corp 容量性負荷駆動回路およびプラズマディスプレイパネル
CN104252843B (zh) 2014-09-23 2016-08-24 京东方科技集团股份有限公司 脉冲信号合并电路、显示面板和显示装置
CN105989811B (zh) * 2015-02-13 2019-01-01 南京瀚宇彩欣科技有限责任公司 移位暂存器电路
CN105185345B (zh) * 2015-10-23 2018-09-07 京东方科技集团股份有限公司 一种栅极驱动电路及其驱动方法、显示面板
CN106531064B (zh) * 2016-12-06 2019-03-08 深圳市富满电子集团股份有限公司 一种led显示屏及其显示控制电路
CN108648716B (zh) * 2018-07-25 2020-06-09 京东方科技集团股份有限公司 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
CN108648718B (zh) * 2018-08-01 2020-07-14 京东方科技集团股份有限公司 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
CN108682398B (zh) * 2018-08-08 2020-05-29 京东方科技集团股份有限公司 移位寄存器单元、栅极驱动电路、显示装置及驱动方法
CN109616041B (zh) 2019-02-13 2021-04-16 合肥京东方卓印科技有限公司 移位寄存器单元、驱动方法、栅极驱动电路及显示装置

Also Published As

Publication number Publication date
CN109616041A (zh) 2019-04-12
US11328675B2 (en) 2022-05-10
US20210233476A1 (en) 2021-07-29
WO2020164525A1 (zh) 2020-08-20

Similar Documents

Publication Publication Date Title
CN107578741B (zh) 移位寄存器单元及其驱动方法、栅极驱动电路、显示装置
CN108281123B (zh) 移位寄存器单元、栅极驱动电路、显示装置以及驱动方法
US11315471B2 (en) Shift register unit, driving device, display device and driving method
CN109616041B (zh) 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
US20180122289A1 (en) Shift register, driving method, gate driving circuit and display device
US10825413B2 (en) Shift register circuit, gate driving circuit and method for driving the same, and display apparatus
CN108877636B (zh) 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
CN108806584B (zh) 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
CN106782285B (zh) 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
US11749154B2 (en) Gate driver on array circuit and display panel
US11410587B2 (en) Shift register unit and method for driving same, gate drive circuit, and display device
CN109243351B (zh) 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
US11030931B2 (en) Shift register unit, driving method, gate drive circuit and display device
CN112154497B (zh) 移位寄存器单元、驱动电路、显示装置以及驱动方法
US10796780B2 (en) Shift register unit and driving method thereof, gate driving circuit and display apparatus
CN108877721B (zh) 移位寄存器单元、栅极驱动电路、显示装置以及驱动方法
US20210335196A1 (en) Shift Register Unit, Driving Method, Gate Driver on Array and Display Device
CN110189680B (zh) 移位寄存器单元、驱动方法、栅极驱动电路及显示装置
US11094389B2 (en) Shift register unit and driving method, gate driving circuit, and display device
CN107248390B (zh) 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
US20210256927A1 (en) Circuit and method for preventing screen flickering, drive circuit for display panel, and display apparatus
US11373576B2 (en) Shift register and method of driving the same, gate driving circuit
US10971102B2 (en) Shift register unit and driving method, gate driving circuit, and display device
CN113763859B (zh) 移位寄存器及其驱动方法、栅极驱动电路、面板及装置
CN110910852B (zh) 移位寄存器单元、栅极驱动电路及显示装置

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant