JP2018508834A - 表示パネル及びその駆動回路 - Google Patents
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Abstract
Description
前記駆動回路が走査信号、データ信号及び選択信号を生成し、前記走査信号が走査線により前記画像単位に送信され、前記データ信号がデータ線により前記画像単位に送信され、前記選択信号は、前記データ信号の前記画像単位への出力を選択的に制御する。
前記表示パネルは、表示パネルに対する高解像度の要求を満足するために、多数の配線が必要であり、つまり、解像度が高い表示パネルは、多くの配線が必要である。しかし、前記表示パネルの配線空間に限りがあるため、その中の配線の数が無制限に増加することはありえないから、前記表示パネルの解像度の向上が制限される。
対応する表示パネルにおける画素アレイを、画像を表示するように制御する駆動回路であって、前記画素アレイに提供されるデータ信号を生成するデータ信号提供モジュールと、第1選択信号を提供する第1選択信号生成モジュールと、第2選択信号を提供する第2選択信号生成モジュールと、選択モジュールとを備え、前記選択モジュールは、少なくとも2つの選択スイッチの組合せを含み、前記選択スイッチの組合せは、前記第1選択信号生成モジュール、前記第2選択信号生成モジュール、前記データ信号提供モジュール及び前記画素アレイに電気的に接続され、前記選択スイッチの組合せは、前記第1選択信号、前記第2選択信号及び前記データ信号を受信し、前記第1選択信号及び前記第2選択信号に基づいて、前記データ信号を前記画素アレイに出力し、前記選択スイッチの組合せは、前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第1スイッチと、前記第2選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第2スイッチと、前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第3スイッチと、前記第2選択信号生成モジュール、前記第3スイッチ及び前記画素アレイにおける第3画素列に電気的に接続されている第4スイッチと、前記第2選択信号生成モジュール、前記第1スイッチ及び前記画素アレイにおける第1画素列に電気的に接続されている第5スイッチと、前記第1選択信号生成モジュール、前記第2スイッチ及び前記画素アレイにおける第2画素列に電気的に接続されている第6スイッチと、を含み、前記駆動回路は、走査信号提供モジュールをさらに含み、前記走査信号提供モジュールは、前記画素アレイに電気的に接続され、前記走査信号提供モジュールは、走査信号を生成し、前記走査信号を前記画素アレイに送信する。
図1は、本発明の表示パネルのブロック図である。
以下、前記第1画素行101に対応する第1走査信号Gate1、前記第2画素行102に対応する第2走査信号Gate2がハイレベルの時に前記画素アレイ10における画素のスイッチをオンし、ローレベルの時に前記画素のスイッチをオフすることを例として説明する。その逆もまた然りである。
前記走査信号提供モジュールが生成する前記第1走査信号Gate1はハイレベルであり、前記第2走査信号Gate2はローレベルである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオンし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもオフする。
前記第1走査信号Gate1はハイレベルのままであり、前記第2走査信号Gate2はローレベルのままである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオンし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもオフする。
前記第1走査信号Gate1はハイレベルのままであり、前記第2走査信号Gate2はローレベルのままである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオンし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもオフする。
前記第1走査信号Gate1はローレベルであり、前記第2走査信号Gate2はハイレベルである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオフし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもがオンする。
前記第1走査信号Gate1はローレベルのままであり、前記第2走査信号Gate2はハイレベルのままである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオフし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもオンする。
前記第1走査信号Gate1はローレベルのままであり、前記第2走査信号Gate2はハイレベルのままである。この場合に、前記第1画素R1、前記第2画素G1及び前記第3画素B1のスイッチはいずれもオフし、前記第4画素R2、前記第5画素G2及び前記第6画素B2のスイッチはいずれもオンする。
画面全体がリフレッシュされるまで、以上のように続ける。
前記第1スイッチ2041、前記第2スイッチ2042、前記第3スイッチ2043及び前記第4スイッチ2044は、いずれもPMOS(Positive channel Metal Oxide Semiconductor、Pチャネル金属酸化物半導体)トランジスタであり、前記第5スイッチ2045及び前記第6スイッチ2046は、いずれもNMOS(Negative channel Metal Oxide Semiconductor、Nチャネル金属酸化物半導体)トランジスタである。
Claims (20)
- 対応する表示パネルにおける画素アレイを、画像を表示するように制御する駆動回路であって、
前記画素アレイに提供されるデータ信号を生成するデータ信号提供モジュールと、
第1選択信号を提供する第1選択信号生成モジュールと、
第2選択信号を提供する第2選択信号生成モジュールと、
選択モジュールと、
を備え、
前記選択モジュールは、少なくとも2つの選択スイッチの組合せを含み、前記選択スイッチの組合せは、前記第1選択信号生成モジュール、前記第2選択信号生成モジュール、前記データ信号提供モジュール、及び前記画素アレイに電気的に接続され、前記選択スイッチの組合せは、前記第1選択信号、前記第2選択信号、及び前記データ信号を受信し、前記第1選択信号と前記第2選択信号に基づいて、前記データ信号を前記画素アレイに出力し、
前記選択スイッチの組合せは、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第1スイッチと、
前記第2選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第2スイッチと、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第3スイッチと、
前記第2選択信号生成モジュール、前記第3スイッチ、及び前記画素アレイにおける第3画素列に電気的に接続されている第4スイッチと、
前記第2選択信号生成モジュール、前記第1スイッチ、及び前記画素アレイにおける第1画素列に電気的に接続されている第5スイッチと、
前記第1選択信号生成モジュール、前記第2スイッチ、及び前記画素アレイにおける第2画素列に電気的に接続されている第6スイッチと、
を含み、
前記駆動回路は、走査信号提供モジュールをさらに備え、前記走査信号提供モジュールは、前記画素アレイに電気的に接続され、前記走査信号提供モジュールは、走査信号を生成し、且つ前記走査信号を前記画素アレイに送信する駆動回路。 - 前記第1スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第1制御端と、
前記データ信号提供モジュールに電気的に接続されている第1入力端と、
前記第5スイッチに電気的に接続されている第1出力端と、
を含み、
前記第1制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第1入力端と前記第1出力端との間の第1電流チャンネルのオン・オフを制御し、
前記第2スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第2制御端と、
前記データ信号提供モジュールに電気的に接続されている第2入力端と、
前記第6スイッチに電気的に接続されている第2出力端と、
を含み、
前記第2制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第2入力端と前記第2出力端との間の第2電流チャンネルのオン・オフを制御し、
前記第3スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第3制御端と、
前記データ信号提供モジュールに電気的に接続されている第3入力端と、
前記第4スイッチに電気的に接続されている第3出力端と、
を含み、
前記第3制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第3入力端と前記第3出力端との間の第3電流チャンネルのオン・オフを制御し、
前記第4スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第4制御端と、
前記第3出力端に電気的に接続されている第4入力端と、
前記第3画素列に電気的に接続されている第4出力端と、
を含み、
前記第4制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第4入力端と前記第4出力端との間の第4電流チャンネルのオン・オフを制御し、
前記第5スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第5制御端と、
前記第1出力端に電気的に接続されている第5入力端と、
前記第1画素列に電気的に接続されている第5出力端と、
を含み、
前記第5制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第5入力端と前記第5出力端との間の第5電流チャンネルのオン・オフを制御し、
前記第6スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第6制御端と、
前記第2出力端に電気的に接続されている第6入力端と、
前記第2画素列に電気的に接続されている第6出力端と、
を含み、
前記第6制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第6入力端と前記第6出力端との間の第6電流チャンネルのオン・オフを制御する請求項1に記載の駆動回路。 - 前記第1電流チャンネルは、前記第3電流チャンネルがオンの時にオンし、前記第3電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第2電流チャンネルは、前記第4電流チャンネルがオンの時にオンし、前記第4電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第3電流チャンネルは、前記第1電流チャンネルがオンの時にオンし、前記第1電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第4電流チャンネルは、前記第2電流チャンネルがオンの時にオンし、前記第2電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第5電流チャンネルは、前記第2電流チャンネルがオンの時にオフし、前記第2電流チャンネルがオフの時にオンし、前記第4電流チャンネルがオンの時にオフし、前記第4電流チャンネルがオフの時にオンし、
前記第6電流チャンネルは、前記第1電流チャンネルがオンの時にオフし、前記第1電流チャンネルがオフの時にオンし、前記第3電流チャンネルがオンの時にオフし、前記第3電流チャンネルがオフの時にオンする請求項2に記載の駆動回路。 - 前記第1選択信号のハイレベルの持続時間は、前記第2選択信号のハイレベルの持続時間と同一であり、前記第1選択信号のローレベルの持続時間は、前記第2選択信号のローレベルの持続時間と同一であり、
前記第1選択信号のハイレベルの持続時間と、前記第2選択信号のハイレベルの持続時間は、ともに2K個のクロック単位周期であり、前記第1選択信号のローレベルの持続時間と、前記第2選択信号のローレベルの持続時間は、ともにK個のクロック単位周期であり、ここで、前記Kは正整数であり、
前記第2選択信号のハイレベルの立ち上がりエッジの開始時間と、前記第1選択信号のハイレベルの立ち上がりエッジの開始時間は、K個のクロック単位周期離れている請求項1に記載の駆動回路。 - 対応する表示パネルにおける画素アレイを、画像を表示するように制御する駆動回路であって、
前記画素アレイに提供されるデータ信号を生成するデータ信号提供モジュールと、
第1選択信号を提供する第1選択信号生成モジュールと、
第2選択信号を提供する第2選択信号生成モジュールと、
選択モジュールと、
を備え、
前記選択モジュールは、少なくとも2つの選択スイッチの組合せを含み、前記選択スイッチの組合せは、前記第1選択信号生成モジュール、前記第2選択信号生成モジュール、前記データ信号提供モジュール、及び前記画素アレイに電気的に接続され、前記選択スイッチの組合せは、前記第1選択信号、前記第2選択信号、及び前記データ信号を受信し、前記第1選択信号と前記第2選択信号に基づいて、前記データ信号を前記画素アレイに出力する駆動回路。 - 前記選択スイッチの組合せは、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第1スイッチと、
前記第2選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第2スイッチと、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第3スイッチと、
前記第2選択信号生成モジュール、前記第3スイッチ及び前記画素アレイにおける第3画素列に電気的に接続されている第4スイッチと、
前記第2選択信号生成モジュール、前記第1スイッチ及び前記画素アレイにおける第1画素列に電気的に接続されている第5スイッチと、
前記第1選択信号生成モジュール、前記第2スイッチ及び前記画素アレイにおける第2画素列に電気的に接続されている第6スイッチと、
を含む請求項5に記載の駆動回路。 - 前記第1スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第1制御端と、
前記データ信号提供モジュールに電気的に接続されている第1入力端と、
前記第5スイッチに電気的に接続されている第1出力端と、
を含み、
前記第1制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第1入力端と前記第1出力端との間の第1電流チャンネルのオン・オフを制御し、
前記第2スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第2制御端と、
前記データ信号提供モジュールに電気的に接続されている第2入力端と、
前記第6スイッチに電気的に接続されている第2出力端と、
とを含み、
前記第2制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第2入力端と前記第2出力端との間の第2電流チャンネルのオン・オフを制御し、
前記第3スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第3制御端と、
前記データ信号提供モジュールに電気的に接続されている第3入力端と、
前記第4スイッチに電気的に接続されている第3出力端と、
を含み、
前記第3制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第3入力端と前記第3出力端との間の第3電流チャンネルのオン・オフを制御し、
前記第4スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第4制御端と、
前記第3出力端に電気的に接続されている第4入力端と、
前記第3画素列に電気的に接続されている第4出力端と、
を含み、
前記第4制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第4入力端と前記第4出力端との間の第4電流チャンネルのオン・オフを制御し、
前記第5スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第5制御端と、
前記第1出力端に電気的に接続されている第5入力端と、
前記第1画素列に電気的に接続されている第5出力端と、
を含み、
前記第5制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第5入力端と前記第5出力端との間の第5電流チャンネルのオン・オフを制御し、
前記第6スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第6制御端と、
前記第2出力端に電気的に接続されている第6入力端と、
前記第2画素列に電気的に接続されている第6出力端と、
を含み、
前記第6制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第6入力端と前記第6出力端との間の第6電流チャンネルのオン・オフを制御する請求項6に記載の駆動回路。 - 前記第1制御端は、第1信号線を介して前記第1選択信号生成モジュールに電気的に接続され、
前記第2制御端は、第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第3制御端は、前記第1信号線を介して前記第1選択信号生成モジュールに電気的に接続され、
前記第4制御端は、前記第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第5制御端は、前記第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第6制御端は、前記第1信号線を介して前記第1選択信号生成モジュールに電気的に接続されている請求項7に記載の駆動回路。 - 前記第1電流チャンネルは、前記第3電流チャンネルがオンの時にオンし、前記第3電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第2電流チャンネルは、前記第4電流チャンネルがオンの時にオンし、前記第4電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第3電流チャンネルは、前記第1電流チャンネルがオンの時にオンし、前記第1電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第4電流チャンネルは、前記第2電流チャンネルがオンの時にオンし、前記第2電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第5電流チャンネルは、前記第2電流チャンネルがオンの時にオフし、前記第2電流チャンネルがオフの時にオンし、前記第4電流チャンネルがオンの時にオフし、前記第4電流チャンネルがオフの時にオンし、
前記第6電流チャンネルは、前記第1電流チャンネルがオンの時にオフし、前記第1電流チャンネルがオフの時にオンし、前記第3電流チャンネルがオンの時にオフし、前記第3電流チャンネルがオフの時にオンする請求項7に記載の駆動回路。 - 前記第1スイッチ、前記第2スイッチ、前記第3スイッチ及び前記第4スイッチは、いずれもNチャネル金属酸化物半導体トランジスタであり、前記第5スイッチ及び前記第6スイッチは、いずれもPチャネル金属酸化物半導体トランジスタであり、又は
前記第1スイッチ、前記第2スイッチ、前記第3スイッチ及び前記第4スイッチは、いずれもPチャネル金属酸化物半導体トランジスタであり、前記第5スイッチ及び前記第6スイッチは、いずれもNチャネル金属酸化物半導体トランジスタである請求項9に記載の駆動回路。 - 前記第1選択信号のハイレベルの持続時間は、前記第2選択信号のハイレベルの持続時間と同一であり、前記第1選択信号のローレベルの持続時間は、前記第2選択信号のローレベルの持続時間と同一であり、
前記第1選択信号のハイレベルの持続時間及び前記第2選択信号のハイレベルの持続時間は、いずれも2K個のクロック単位周期であり、前記第1選択信号のローレベルの持続時間及び前記第2選択信号のローレベルの持続時間は、いずれもK個のクロック単位周期であり、ここで、前記Kは正整数であり、
前記第2選択信号のハイレベルの立ち上がりエッジの開始時間と前記第1選択信号のハイレベルの立ち上がりエッジの開始時間は、K個のクロック単位周期離れている請求項5に記載の駆動回路。 - 走査信号のハイレベルの持続時間は、3K個のクロック単位周期であり、前記走査信号のローレベルの持続時間も3K個のクロック単位周期である請求項11に記載の駆動回路。
- 画素アレイと、
前記画素アレイを、画像を表示するように制御する駆動回路と、
を含む表示パネルであって、
前記駆動回路は、
前記画素アレイに提供されるデータ信号を生成するデータ信号提供モジュールと、
第1選択信号を提供する第1選択信号生成モジュールと、
第2選択信号を提供する第2選択信号生成モジュールと、
選択モジュールと、
を含み、
前記選択モジュールは、少なくとも2つの選択スイッチの組合せを含み、前記選択スイッチの組合せは、前記第1選択信号生成モジュール、前記第2選択信号生成モジュール、前記データ信号提供モジュール及び前記画素アレイに電気的に接続され、前記選択スイッチの組合せは、前記第1選択信号、前記第2選択信号及び前記データ信号を受信し、前記第1選択信号及び前記第2選択信号に基づいて、前記データ信号を前記画素アレイに出力する表示パネル。 - 前記選択スイッチの組合せは、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第1スイッチと、
前記第2選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第2スイッチと、
前記第1選択信号生成モジュール及び前記データ信号提供モジュールに電気的に接続されている第3スイッチと、
前記第2選択信号生成モジュール、前記第3スイッチ及び前記画素アレイにおける第3画素列に電気的に接続されている第4スイッチと、
前記第2選択信号生成モジュール、前記第1スイッチ及び前記画素アレイにおける第1画素列に電気的に接続されている第5スイッチと、
前記第1選択信号生成モジュール、前記第2スイッチ及び前記画素アレイにおける第2画素列に電気的に接続されている第6スイッチと、
を含む請求項13に記載の表示パネル。 - 前記第1スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第1制御端と、
前記データ信号提供モジュールに電気的に接続されている第1入力端と、
前記第5スイッチに電気的に接続されている第1出力端と、
を含み、
前記第1制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第1入力端と前記第1出力端との間の第1電流チャンネルのオン・オフを制御し、
前記第2スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第2制御端と、
前記データ信号提供モジュールに電気的に接続されている第2入力端と、
前記第6スイッチに電気的に接続されている第2出力端と、
を含み、
前記第2制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第2入力端と前記第2出力端との間の第2電流チャンネルのオン・オフを制御し、
前記第3スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第3制御端と、
前記データ信号提供モジュールに電気的に接続されている第3入力端と、
前記第4スイッチに電気的に接続されている第3出力端と、
を含み、
前記第3制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第3入力端と前記第3出力端との間の第3電流チャンネルのオン・オフを制御し、
前記第4スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第4制御端と、
前記第3出力端に電気的に接続されている第4入力端と、
前記第3画素列に電気的に接続されている第4出力端と、
を含み、
前記第4制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第4入力端と前記第4出力端との間の第4電流チャンネルのオン・オフを制御し、
前記第5スイッチは、
前記第2選択信号生成モジュールに電気的に接続されている第5制御端と、
前記第1出力端に電気的に接続されている第5入力端と、
前記第1画素列に電気的に接続されている第5出力端と、
を含み、
前記第5制御端は、前記第2選択信号を受信し、前記第2選択信号に基づいて、前記第5入力端と前記第5出力端との間の第5電流チャンネルのオン・オフを制御し、
前記第6スイッチは、
前記第1選択信号生成モジュールに電気的に接続されている第6制御端と、
前記第2出力端に電気的に接続されている第6入力端と、
前記第2画素列に電気的に接続されている第6出力端と、
前記第6制御端は、前記第1選択信号を受信し、前記第1選択信号に基づいて、前記第6入力端と前記第6出力端との間の第6電流チャンネルのオン・オフを制御する請求項14に記載の表示パネル。 - 前記第1制御端は、第1信号線を介して前記第1選択信号生成モジュールに電気的に接続され、
前記第2制御端は、第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第3制御端は、前記第1信号線を介して前記第1選択信号生成モジュールに電気的に接続され、
前記第4制御端は、前記第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第5制御端は、前記第2信号線を介して前記第2選択信号生成モジュールに電気的に接続され、
前記第6制御端は、前記第1信号線を介して前記第1選択信号生成モジュールに電気的に接続されている請求項15に記載の表示パネル。 - 前記第1電流チャンネルは、前記第3電流チャンネルがオンの時にオンし、前記第3電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第2電流チャンネルは、前記第4電流チャンネルがオンの時にオンし、前記第4電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第3電流チャンネルは、前記第1電流チャンネルがオンの時にオンし、前記第1電流チャンネルがオフの時にオフし、前記第6電流チャンネルがオンの時にオフし、前記第6電流チャンネルがオフの時にオンし、
前記第4電流チャンネルは、前記第2電流チャンネルがオンの時にオンし、前記第2電流チャンネルがオフの時にオフし、前記第5電流チャンネルがオンの時にオフし、前記第5電流チャンネルがオフの時にオンし、
前記第5電流チャンネルは、前記第2電流チャンネルがオンの時にオフし、前記第2電流チャンネルがオフの時にオンし、前記第4電流チャンネルがオンの時にオフし、前記第4電流チャンネルがオフの時にオンし、
前記第6電流チャンネルは、前記第1電流チャンネルがオンの時にオフし、前記第1電流チャンネルがオフの時にオンし、前記第3電流チャンネルがオンの時にオフし、前記第3電流チャンネルがオフの時にオンする請求項15に記載の表示パネル。 - 前記第1スイッチ、前記第2スイッチ、前記第3スイッチ及び前記第4スイッチは、いずれもNチャネル金属酸化物半導体トランジスタであり、前記第5スイッチ及び前記第6スイッチは、いずれもPチャネル金属酸化物半導体トランジスタであり、又は、
前記第1スイッチ、前記第2スイッチ、前記第3スイッチ及び前記第4スイッチは、いずれもPチャネル金属酸化物半導体トランジスタであり、前記第5スイッチ及び前記第6スイッチは、いずれもNチャネル金属酸化物半導体トランジスタである請求項17に記載の表示パネル。 - 前記第1選択信号のハイレベルの持続時間は、前記第2選択信号のハイレベルの持続時間と同一であり、前記第1選択信号のローレベルの持続時間は、前記第2選択信号のローレベルの持続時間と同一であり、
前記第1選択信号のハイレベルの持続時間及び前記第2選択信号のハイレベルの持続時間は、いずれも2K個のクロック単位周期であり、前記第1選択信号のローレベルの持続時間及び前記第2選択信号のローレベルの持続時間は、いずれもK個のクロック単位周期であり、ここで、前記Kは正整数であり、
前記第2選択信号のハイレベルの立ち上がりエッジの開始時間と、前記第1選択信号のハイレベルの立ち上がりエッジの開始時間は、K個のクロック単位周期離れている請求項13に記載の表示パネル。 - 走査信号のハイレベルの持続時間は、3K個のクロック単位周期であり、前記走査信号のローレベルの持続時間も3K個のクロック単位周期である請求項19に記載の表示パネル。
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