CN104485063B - 显示面板及其驱动电路 - Google Patents

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Abstract

本发明公开了一种显示面板及其驱动电路。驱动电路用于控制相应的显示面板中的像素阵列显示图像，驱动电路包括：一数据信号提供模块，用于生成数据信号，数据信号用于提供给像素阵列；一第一选择信号生成模块，用于提供第一选择信号；一第二选择信号生成模块，用于提供第二选择信号；以及一选择模块，选择模块包括：至少两选择开关组合，选择开关组合与第一选择信号生成模块、第二选择信号生成模块、数据信号提供模块和像素阵列电性连接，选择开关组合用于接收第一选择信号、第二选择信号和数据信号，并用于根据第一选择信号和第二选择信号将数据信号输出至像素阵列。本发明可以有效降低选择信号的电平转换频率。

Description

显示面板及其驱动电路
【技术领域】
本发明涉及显示技术领域，特别涉及一种显示面板及其驱动电路。
【背景技术】
传统的显示面板一般都包括有驱动电路，传统的驱动电路用于控制所述显示面板中的像素单元显示相应的图像。
传统的驱动电路对所述显示面板进行驱动的技术方案一般为：
所述驱动电路生成扫描信号、数据信号和选择信号，所述扫描信号通过扫描线发送给所述像素单元，所述数据信号通过数据线发送给所述像素单元，所述选择信号用于有选择性地控制所述数据信号向所述像素单元的输出。
在实践中，发明人发现现有技术至少存在以下问题：
在通过所述扫描信号对所述显示面板的像素单元进行扫描的过程中，所述选择信号在扫描对象从一行像素切换至另一行像素时均需要进行电平转换，因此，所述选择信号的电平转换频率较高。
故，有必要提出一种新的技术方案，以解决上述技术问题。
【发明内容】
本发明的目的在于提供一种显示面板及其驱动电路，其能降低驱动电路的选择信号的电平转换频率。
为解决上述问题，本发明的技术方案如下：
一种驱动电路，所述驱动电路用于控制相应的显示面板中的像素阵列显示图像，所述驱动电路包括：一数据信号提供模块，用于生成数据信号，所述数据信号用于提供给所述像素阵列；一第一选择信号生成模块，用于提供第一选择信号；一第二选择信号生成模块，用于提供第二选择信号；以及一选择模块，所述选择模块包括：至少两选择开关组合，所述选择开关组合与所述第一选择信号生成模块、所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列电性连接，所述选择开关组合用于接收所述第一选择信号、所述第二选择信号和所述数据信号，并用于根据所述第一选择信号和所述第二选择信号将所述数据信号输出至所述像素阵列。
在上述驱动电路中，所述选择开关组合包括：一第一开关，所述第一开关与所述第一选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第一像素列电性连接；一第二开关，所述第二开关与所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第二像素列电性连接；一第三开关，所述第三开关与所述第一选择信号生成模块和所述数据信号提供模块电性连接；以及一第四开关，所述第四开关与所述第二选择信号生成模块、所述第三开关和所述像素阵列中的第三像素列电性连接。
在上述驱动电路中，所述第一开关包括：一第一控制端，所述第一控制端与所述第一选择信号生成模块电性连接；一第一输入端，所述第一输入端与所述数据信号提供模块电性连接；以及一第一输出端，所述第一输出端与所述第一像素列电性连接；其中，所述第一控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第一输入端和所述第一输出端之间的第一电流通道的开启和关闭；所述第二开关包括：一第二控制端，所述第二控制端与所述第二选择信号生成模块电性连接；一第二输入端，所述第二输入端与所述数据信号提供模块电性连接；以及一第二输出端，所述第二输出端与所述第二像素列电性连接；其中，所述第二控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第二输入端和所述第二输出端之间的第二电流通道的开启和关闭；所述第三开关包括：一第三控制端，所述第三控制端与所述第一选择信号生成模块电性连接；一第三输入端，所述第三输入端与所述数据信号提供模块电性连接；以及一第三输出端，所述第三输出端与所述第四开关电性连接；其中，所述第三控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第三输入端和所述第三输出端之间的第三电流通道的开启和关闭；所述第四开关包括：一第四控制端，所述第四控制端与所述第二选择信号生成模块电性连接；一第四输入端，所述第四输入端与所述第三输出端电性连接；以及一第四输出端，所述第四输出端与所述第三像素列电性连接；其中，所述第四控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第四输入端和所述第四输出端之间的第四电流通道的开启和关闭。
在上述驱动电路中，所述第一电流通道用于在所述第三电流通道开启时关闭，以及用于在所述第三电流通道关闭时开启；所述第二电流通道用于在所述第四电流通道开启时关闭，以及用于在所述第四电流通道关闭时开启；所述第三电流通道用于在所述第一电流通道开启时关闭，以及用于在所述第一电流通道关闭时开启；所述第四电流通道用于在所述第二电流通道开启时关闭，以及用于在所述第二电流通道关闭时开启。
在上述驱动电路中，所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平的持续时间相同，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平的持续时间相同；所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平持续时间均为2K个时钟单元周期，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平持续时间均为4K个时钟单元周期，其中，所述K为正整数；所述像素阵列的扫描信号的高电平的上升沿的开始时间位于所述第一选择信号的高电平的持续时间内或者所述第二选择信号的高电平的持续时间内。
一种显示面板，所述显示面板包括：一像素阵列；以及一驱动电路，所述驱动电路用于控制所述像素阵列显示图像，所述驱动电路包括：一数据信号提供模块，用于生成数据信号，所述数据信号用于提供给所述像素阵列；一第一选择信号生成模块，用于提供第一选择信号；一第二选择信号生成模块，用于提供第二选择信号；以及一选择模块，所述选择模块包括：至少两选择开关组合，所述选择开关组合与所述第一选择信号生成模块、所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列电性连接，所述选择开关组合用于接收所述第一选择信号、所述第二选择信号和所述数据信号，并用于根据所述第一选择信号和所述第二选择信号将所述数据信号输出至所述像素阵列。
在上述显示面板中，所述选择开关组合包括：一第一开关，所述第一开关与所述第一选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第一像素列电性连接；一第二开关，所述第二开关与所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第二像素列电性连接；一第三开关，所述第三开关与所述第一选择信号生成模块和所述数据信号提供模块电性连接；以及一第四开关，所述第四开关与所述第二选择信号生成模块、所述第三开关和所述像素阵列中的第三像素列电性连接。
在上述显示面板中，所述第一开关包括：一第一控制端，所述第一控制端与所述第一选择信号生成模块电性连接；一第一输入端，所述第一输入端与所述数据信号提供模块电性连接；以及一第一输出端，所述第一输出端与所述第一像素列电性连接；其中，所述第一控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第一输入端和所述第一输出端之间的第一电流通道的开启和关闭；所述第二开关包括：一第二控制端，所述第二控制端与所述第二选择信号生成模块电性连接；一第二输入端，所述第二输入端与所述数据信号提供模块电性连接；以及一第二输出端，所述第二输出端与所述第二像素列电性连接；其中，所述第二控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第二输入端和所述第二输出端之间的第二电流通道的开启和关闭；所述第三开关包括：一第三控制端，所述第三控制端与所述第一选择信号生成模块电性连接；一第三输入端，所述第三输入端与所述数据信号提供模块电性连接；以及一第三输出端，所述第三输出端与所述第四开关电性连接；其中，所述第三控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第三输入端和所述第三输出端之间的第三电流通道的开启和关闭；所述第四开关包括：一第四控制端，所述第四控制端与所述第二选择信号生成模块电性连接；一第四输入端，所述第四输入端与所述第三输出端电性连接；以及一第四输出端，所述第四输出端与所述第三像素列电性连接；其中，所述第四控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第四输入端和所述第四输出端之间的第四电流通道的开启和关闭。
在上述显示面板中，所述第一电流通道用于在所述第三电流通道开启时关闭，以及用于在所述第三电流通道关闭时开启；所述第二电流通道用于在所述第四电流通道开启时关闭，以及用于在所述第四电流通道关闭时开启；所述第三电流通道用于在所述第一电流通道开启时关闭，以及用于在所述第一电流通道关闭时开启；所述第四电流通道用于在所述第二电流通道开启时关闭，以及用于在所述第二电流通道关闭时开启。
在上述显示面板中，所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平的持续时间相同，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平的持续时间相同；所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平持续时间均为2K个时钟单元周期，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平持续时间均为4K个时钟单元周期，其中，所述K为正整数；所述像素阵列的扫描信号的高电平的上升沿的开始时间位于所述第一选择信号的高电平的持续时间内或者所述第二选择信号的高电平的持续时间内。
相对现有技术，本发明可以有效降低所述驱动电路的选择信号的电平转换频率。
为让本发明的上述内容能更明显易懂，下文特举优选实施例，并配合所附图式，作详细说明如下。
【附图说明】
图1为本发明的显示面板的框图；
图2为图1所示的显示面板的第一实施例的电路图；
图3为图2所示的显示面板的驱动信号的波形图。
【具体实施方式】
本说明书所使用的词语“实施例”意指用作实例、示例或例证。此外，本说明书和所附权利要求中所使用的冠词“一”一般地可以被解释为意指“一个或多个”，除非另外指定或从上下文可以清楚确定单数形式。
参考图1，图1为本发明的显示面板的框图。
本发明的显示面板可以是TFT-LCD(Thin Film TransistorLiquid Crystal Display，薄膜晶体管液晶显示面板)、OLED(Organic Light Emitting Diode，有机发光二极管显示面板)等。
本发明的显示面板包括像素阵列10和驱动电路20。
所述驱动电路20与所述显示面板中的所述像素阵列10电性连接，所述驱动电路20用于控制所述像素阵列10显示图像，所述驱动电路20包括数据信号提供模块201、第一选择信号生成模块202、第二选择信号生成模块203和选择模块204。
所述数据信号提供模块201用于生成数据信号，所述数据信号用于提供给所述像素阵列10。所述第一选择信号生成模块202，用于提供第一选择信号MUX1。所述第二选择信号生成模块203，用于提供第二选择信号MUX2。所述选择模块204包括至少两选择开关组合，所述选择开关组合与所述第一选择信号生成模块202、所述第二选择信号生成模块203、所述数据信号提供模块201和所述像素阵列10电性连接，所述选择开关组合用于接收所述第一选择信号MUX1、所述第二选择信号MUX2和所述数据信号，并用于根据所述第一选择信号MUX1和所述第二选择信号MUX2将所述数据信号输出至所述像素阵列10。
所述驱动电路20还包括扫描信号提供模块，所述扫描信号提供模块与所述像素阵列10电性连接，所述扫描信号提供模块用于生成扫描信号(栅极信号)，并用于将所述扫描信号发送至所述像素阵列10。
参考图2，图2为图1所示的显示面板的第一实施例的电路图。
在本实施例中，所述像素阵列10包括至少一第一像素行101和至少一第二像素行102，所述第一像素行101和所述第二像素行102沿第一方向30以阵列(一维阵列)的形式排列。所述第一像素行101包括至少一第一像素R1、至少一第二像素G1和至少一第三像素B1，所述第一像素R1、所述第二像素G1和所述第三像素B1沿第二方向40以阵列(一维阵列)的形式排列。所述第二像素行102包括至少一第四像素R2、至少一第五像素G2和至少一第六像素B2，所述第四像素R2、所述第五像素G2和所述第六像素B2沿所述第二方向40以阵列(一维阵列)的形式排列。所述像素阵列10还包括至少一第一像素列103、至少一第二像素列104以及至少一第三像素列105，其中，所述第一像素列103包括所述第一像素R1和所述第四像素R2，所述第二像素列104包括所述第二像素G1和所述第五像素G2，所述第三像素列105包括所述第三像素B1和所述第六像素B2。其中，所述第一方向30与所述第二方向40垂直。
在本实施例中，所述选择开关组合包括第一开关2041、第二开关2042、第三开关2043和第四开关2044。所述第一开关2041与所述第一选择信号生成模块202、所述数据信号提供模块201和所述像素阵列10中的第一像素列103电性连接。所述第二开关2042与所述第二选择信号生成模块203、所述数据信号提供模块201和所述像素阵列10中的第二像素列104电性连接。所述第三开关2043与所述第一选择信号生成模块202、所述数据信号提供模块201和所述第四开关2044电性连接。所述第四开关2044与所述第二选择信号生成模块203、所述第三开关2043和所述像素阵列10中的第三像素列105电性连接。
在本实施例中，所述第一开关2041、所述第二开关2042、所述第三开关2043和所述第四开关2044均可以是三极管。所述第一开关2041包括第一控制端20411、第一输入端20412和第一输出端20413。所述第一控制端20411与所述第一选择信号生成模块202电性连接，具体地，所述第一控制端20411通过第一信号线2021与所述第一选择信号生成模块202电性连接。所述第一输入端20412与所述数据信号提供模块201电性连接。所述第一输出端20413与所述第一像素列103电性连接。其中，所述第一控制端20411用于接收所述第一选择信号MUX1，并用于根据所述第一选择信号MUX1控制所述第一输入端20412和所述第一输出端20413之间的第一电流通道的开启和关闭。
所述第二开关2042包括第二控制端20421、第二输入端20422和第二输出端20423。所述第二控制端20421与所述第二选择信号生成模块203电性连接，具体地，所述第二控制端20421通过第二信号线2031与所述第二选择信号生成模块203电性连接。所述第二输入端20422与所述数据信号提供模块201电性连接。所述第二输出端20423与所述第二像素列104电性连接。其中，所述第二控制端20421用于接收所述第二选择信号MUX2，并用于根据所述第二选择信号MUX2控制所述第二输入端20422和所述第二输出端20423之间的第二电流通道的开启和关闭。
所述第三开关2043包括第三控制端20431、第三输入端20432和第三输出端20433。所述第三控制端20431与所述第一选择信号生成模块202电性连接，具体地，所述第三控制端20431通过所述第一信号线2021与所述第一选择信号生成模块202电性连接。所述第三输入端20432与所述数据信号提供模块201电性连接。所述第三输出端20433与所述第四开关2044电性连接。其中，所述第三控制端20431用于接收所述第一选择信号MUX1，并用于根据所述第一选择信号MUX1控制所述第三输入端20432和所述第三输出端20433之间的第三电流通道的开启和关闭。
所述第四开关2044包括第四控制端20441、第四输入端20442和第四输出端20443。所述第四控制端20441与所述第二选择信号生成模块203电性连接，具体地，所述第四控制端20441通过所述第二信号线2031与所述第二选择信号生成模块203电性连接。所述第四输入端20442与所述第三输出端20433电性连接。所述第四输出端20443与所述第三像素列105电性连接。其中，所述第四控制端20441用于接收所述第二选择信号MUX2，并用于根据所述第二选择信号MUX2控制所述第四输入端20442和所述第四输出端20443之间的第四电流通道的开启和关闭。
在本实施例中，所述第一开关2041和所述第二开关2042均是NMOS(Negative channel Metal Oxide Semiconductor，N沟道金属氧化物半导体)晶体管，所述第三开关2043和所述第四开关2044均是PMOS(Positive channel Metal Oxide Semiconductor，P沟道金属氧化物半导体)晶体管。
所述第一电流通道用于在所述第三电流通道开启时关闭，以及用于在所述第三电流通道关闭时开启。
所述第二电流通道用于在所述第四电流通道开启时关闭，以及用于在所述第四电流通道关闭时开启。
所述第三电流通道用于在所述第一电流通道开启时关闭，以及用于在所述第一电流通道关闭时开启。
所述第四电流通道用于在所述第二电流通道开启时关闭，以及用于在所述第二电流通道关闭时开启。
在本实施例中，所述第一选择信号MUX1的高电平的持续时间和所述第二选择信号MUX2的高电平的持续时间相同，所述第一选择信号MUX1的低电平的持续时间和所述第二选择信号MUX2的低电平的持续时间相同。
所述第一选择信号MUX1的高电平的持续时间和所述第二选择信号MUX2的高电平持续时间均为2K个时钟单元周期，所述第一选择信号MUX1的低电平的持续时间和所述第二选择信号MUX2的低电平持续时间均为4K个时钟单元周期，所述扫描信号(包括所述第一像素行101所对应的第一扫描信号Gate1、所述第二像素行102所对应的第二扫描信号Gate2)的高电平的持续时间为3K个时钟单元周期，所述扫描信号的低电平的持续时间也为3K个时钟单元周期。其中，所述K为正整数。例如，所述K＝1。
所述像素阵列10的扫描信号的高电平的上升沿的开始时间位于所述第一选择信号MUX1的高电平的持续时间内或者所述第二选择信号MUX2的高电平的持续时间内。
参考图3，图3为图2所示的显示面板的驱动信号的波形图。
下面以所述第一像素行101所对应的第一扫描信号Gate1、所述第二像素行102所对应的第二扫描信号Gate2在高电平时开启所述像素阵列10中的像素的开关，在低电平时关闭所述像素的开关为例来说明。反之亦然。
在第一个时钟单元周期301：
所述扫描信号提供模块所生成的所述第一扫描信号Gate1为高电平，所述第二扫描信号Gate2为低电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均开启，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均关闭。
所述第一选择信号MUX1为高电平，所述第二选择信号MUX2为低电平。此时，所述第一开关2041的所述第一电流通道开启，所述第二开关2042的所述第二电流通道关闭，所述第三开关2043的所述第三电流通道关闭，所述第四开关2044的所述第四电流通道开启。所述数据信号通过所述第一电流通道输入到所述第一像素列103的所述第一像素R1中，以对所述第一像素R1充电。
在第二个时钟单元周期302：
所述第一扫描信号Gate1仍为高电平，所述第二扫描信号Gate2仍为低电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均开启，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均关闭。
所述第一选择信号MUX1为低电平，所述第二选择信号MUX2为低电平。此时，所述第一电流通道关闭，所述第二电流通道关闭，所述第三电流通道开启，所述第四电流通道开启。所述数据信号通过所述第三电流通道和所述第四电流通道输入到所述第三像素列105的所述第三像素B1中，以对所述第三像素B1充电。
在第三个时钟单元周期303：
所述第一扫描信号Gate1仍为高电平，所述第二扫描信号Gate2仍为低电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均开启，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均关闭。
所述第一选择信号MUX1为低电平，所述第二选择信号MUX2为高电平。此时，所述第一电流通道关闭，所述第二电流通道开启，所述第三电流通道开启，所述第四电流通道关闭。所述数据信号通过所述第二电流通道输入到所述第二像素列104的所述第二像素G1中，以对所述第二像素G1充电。
在第四个时钟单元周期304：
所述第一扫描信号Gate1为低电平，所述第二扫描信号Gate2为高电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均关闭，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均开启。
所述第一选择信号MUX1保持为低电平，所述第二选择信号MUX2保持为高电平。此时，所述第一电流通道关闭，所述第二电流通道开启，所述第三电流通道开启，所述第四电流通道关闭。所述数据信号通过所述第二电流通道输入到所述第二像素列104的所述第五像素G2中，以对所述第五像素G2充电。
在第五个时钟单元周期305：
所述第一扫描信号Gate1仍为低电平，所述第二扫描信号Gate2仍为高电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均关闭，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均开启。
所述第一选择信号MUX1保持为低电平，所述第二选择信号MUX2为低电平。此时，所述第一电流通道关闭，所述第二电流通道关闭，所述第三电流通道开启，所述第四电流通道开启。所述数据信号通过所述第三电流通道和所述第四电流通道输入到所述第三像素列105的所述第六像素B2中，以对所述第六像素B2充电。
在第六个时钟单元周期306：
所述第一扫描信号Gate1仍为低电平，所述第二扫描信号Gate2仍为高电平。此时，所述第一像素R1、所述第二像素G1和所述第三像素B1的开关均关闭，所述第四像素R2、所述第五像素G2和所述第六像素B2的开关均开启。
所述第一选择信号MUX1为高电平，所述第二选择信号MUX2仍为低电平。此时，所述第一电流通道开启，所述第二电流通道关闭，所述第三电流通道关闭，所述第四电流通道开启。所述数据信号通过所述第一电流通道输入到所述第一像素列103的所述第四像素R2中，以对所述第四像素R2充电。
依此类推，直至完成整个画面的刷新。
通过上述技术方案，可以有效降低所述选择信号的电平转换频率，即，所述选择信号的电平转换频率从N次/帧降低为(N/2)次/帧，其中，所述N为所述像素阵列的像素行的数量。
此外，上述技术方案还有利于减少所述显示面板的布线的数量，从而使得所述显示面板的分辨率的提高不受所述布线数量的限制。
本发明的显示面板的第二实施例与上述第一实施例相似，不同之处在于：
所述第一开关2041和所述第二开关2042均是PMOS(Positive channel Metal Oxide Semiconductor，P沟道金属氧化物半导体)晶体管，所述第三开关2043和所述第四开关2044均是NMOS(Negative channel Metal Oxide Semiconductor，N沟道金属氧化物半导体)晶体管。
尽管已经相对于一个或多个实现方式示出并描述了本发明，但是本领域技术人员基于对本说明书和附图的阅读和理解将会想到等价变型和修改。本发明包括所有这样的修改和变型，并且仅由所附权利要求的范围限制。特别地关于由上述组件执行的各种功能，用于描述这样的组件的术语旨在对应于执行所述组件的指定功能(例如其在功能上是等价的)的任意组件(除非另外指示)，即使在结构上与执行本文所示的本说明书的示范性实现方式中的功能的公开结构不等同。此外，尽管本说明书的特定特征已经相对于若干实现方式中的仅一个被公开，但是这种特征可以与如可以对给定或特定应用而言是期望和有利的其他实现方式的一个或多个其他特征组合。而且，就术语“包括”、“具有”、“含有”或其变形被用在具体实施方式或权利要求中而言，这样的术语旨在以与术语“包含”相似的方式包括。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (8)

1.一种驱动电路，其特征在于，所述驱动电路用于控制相应的显示面板中的像素阵列显示图像，所述驱动电路包括：
一数据信号提供模块，用于生成数据信号，所述数据信号用于提供给所述像素阵列；
一第一选择信号生成模块，用于提供第一选择信号；
一第二选择信号生成模块，用于提供第二选择信号；以及
一选择模块，所述选择模块包括：
至少两选择开关组合，所述选择开关组合与所述第一选择信号生成模块、所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列电性连接，所述选择开关组合用于接收所述第一选择信号、所述第二选择信号和所述数据信号，并用于根据所述第一选择信号和所述第二选择信号将所述数据信号输出至所述像素阵列，所述选择开关组合包括：
一第一开关，所述第一开关与所述第一选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第一像素列电性连接；
一第二开关，所述第二开关与所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第二像素列电性连接；
一第三开关，所述第三开关与所述第一选择信号生成模块和所述数据信号提供模块电性连接；以及
一第四开关，所述第四开关与所述第二选择信号生成模块、所述第三开关和所述像素阵列中的第三像素列电性连接。
2.根据权利要求1所述的驱动电路，其特征在于，所述第一开关包括：
一第一控制端，所述第一控制端与所述第一选择信号生成模块电性连接；
一第一输入端，所述第一输入端与所述数据信号提供模块电性连接；以及
一第一输出端，所述第一输出端与所述第一像素列电性连接；
其中，所述第一控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第一输入端和所述第一输出端之间的第一电流通道的开启和关闭；
所述第二开关包括：
一第二控制端，所述第二控制端与所述第二选择信号生成模块电性连接；
一第二输入端，所述第二输入端与所述数据信号提供模块电性连接；以及
一第二输出端，所述第二输出端与所述第二像素列电性连接；
其中，所述第二控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第二输入端和所述第二输出端之间的第二电流通道的开启和关闭；
所述第三开关包括：
一第三控制端，所述第三控制端与所述第一选择信号生成模块电性连接；
一第三输入端，所述第三输入端与所述数据信号提供模块电性连接；以及
一第三输出端，所述第三输出端与所述第四开关电性连接；
其中，所述第三控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第三输入端和所述第三输出端之间的第三电流通道的开启和关闭；
所述第四开关包括：
一第四控制端，所述第四控制端与所述第二选择信号生成模块电性连接；
一第四输入端，所述第四输入端与所述第三输出端电性连接；以及
一第四输出端，所述第四输出端与所述第三像素列电性连接；
其中，所述第四控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第四输入端和所述第四输出端之间的第四电流通道的开启和关闭。
3.根据权利要求2所述的驱动电路，其特征在于，所述第一电流通道用于在所述第三电流通道开启时关闭，以及用于在所述第三电流通道关闭时开启；
所述第二电流通道用于在所述第四电流通道开启时关闭，以及用于在所述第四电流通道关闭时开启；
所述第三电流通道用于在所述第一电流通道开启时关闭，以及用于在所述第一电流通道关闭时开启；
所述第四电流通道用于在所述第二电流通道开启时关闭，以及用于在所述第二电流通道关闭时开启。
4.根据权利要求1至3中任意一项所述的驱动电路，其特征在于，所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平的持续时间相同，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平的持续时间相同；
所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平持续时间均为2K个时钟单元周期，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平持续时间均为4K个时钟单元周期，其中，所述K为正整数；
所述像素阵列的扫描信号的高电平的上升沿的开始时间位于所述第一选择信号的高电平的持续时间内或者所述第二选择信号的高电平的持续时间内。
5.一种显示面板，其特征在于，所述显示面板包括：
一像素阵列；以及
一驱动电路，所述驱动电路用于控制所述像素阵列显示图像，所述驱动电路包括：
一数据信号提供模块，用于生成数据信号，所述数据信号用于提供给所述像素阵列；
一第一选择信号生成模块，用于提供第一选择信号；
一第二选择信号生成模块，用于提供第二选择信号；以及
一选择模块，所述选择模块包括：
至少两选择开关组合，所述选择开关组合与所述第一选择信号生成模块、所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列电性连接，所述选择开关组合用于接收所述第一选择信号、所述第二选择信号和所述数据信号，并用于根据所述第一选择信号和所述第二选择信号将所述数据信号输出至所述像素阵列，所述选择开关组合包括：
一第一开关，所述第一开关与所述第一选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第一像素列电性连接；
一第二开关，所述第二开关与所述第二选择信号生成模块、所述数据信号提供模块和所述像素阵列中的第二像素列电性连接；
一第三开关，所述第三开关与所述第一选择信号生成模块和所述数据信号提供模块电性连接；以及
一第四开关，所述第四开关与所述第二选择信号生成模块、所述第三开关和所述像素阵列中的第三像素列电性连接。
6.根据权利要求5所述的显示面板，其特征在于，所述第一开关包括：
一第一控制端，所述第一控制端与所述第一选择信号生成模块电性连接；
一第一输入端，所述第一输入端与所述数据信号提供模块电性连接；以及
一第一输出端，所述第一输出端与所述第一像素列电性连接；
其中，所述第一控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第一输入端和所述第一输出端之间的第一电流通道的开启和关闭；
所述第二开关包括：
一第二控制端，所述第二控制端与所述第二选择信号生成模块电性连接；
一第二输入端，所述第二输入端与所述数据信号提供模块电性连接；以及
一第二输出端，所述第二输出端与所述第二像素列电性连接；
其中，所述第二控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第二输入端和所述第二输出端之间的第二电流通道的开启和关闭；
所述第三开关包括：
一第三控制端，所述第三控制端与所述第一选择信号生成模块电性连接；
一第三输入端，所述第三输入端与所述数据信号提供模块电性连接；以及
一第三输出端，所述第三输出端与所述第四开关电性连接；
其中，所述第三控制端用于接收所述第一选择信号，并用于根据所述第一选择信号控制所述第三输入端和所述第三输出端之间的第三电流通道的开启和关闭；
所述第四开关包括：
一第四控制端，所述第四控制端与所述第二选择信号生成模块电性连接；
一第四输入端，所述第四输入端与所述第三输出端电性连接；以及
一第四输出端，所述第四输出端与所述第三像素列电性连接；
其中，所述第四控制端用于接收所述第二选择信号，并用于根据所述第二选择信号控制所述第四输入端和所述第四输出端之间的第四电流通道的开启和关闭。
7.根据权利要求6所述的显示面板，其特征在于，所述第一电流通道用于在所述第三电流通道开启时关闭，以及用于在所述第三电流通道关闭时开启；
所述第二电流通道用于在所述第四电流通道开启时关闭，以及用于在所述第四电流通道关闭时开启；
所述第三电流通道用于在所述第一电流通道开启时关闭，以及用于在所述第一电流通道关闭时开启；
所述第四电流通道用于在所述第二电流通道开启时关闭，以及用于在所述第二电流通道关闭时开启。
8.根据权利要求5至7中任意一项所述的显示面板，其特征在于，所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平的持续时间相同，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平的持续时间相同；
所述第一选择信号的高电平的持续时间和所述第二选择信号的高电平持续时间均为2K个时钟单元周期，所述第一选择信号的低电平的持续时间和所述第二选择信号的低电平持续时间均为4K个时钟单元周期，其中，所述K为正整数；
所述像素阵列的扫描信号的高电平的上升沿的开始时间位于所述第一选择信号的高电平的持续时间内或者所述第二选择信号的高电平的持续时间内。
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