JP5840739B2 - スピントロニクス素子およびその製造方法、ならびに磁気読み取りヘッドおよびその製造方法 - Google Patents
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本発明に係る第2の磁気読み取りヘッドの製造方法は、シード層を供給し、その上に反強磁性(AFM:Antiferromagnetic )層を形成する工程と、AFM層の上に反平行2(AP2:Anti-Parallel 2 )層を形成する工程と、AP2層の上にAFM結合層を形成する工程と、AFM結合層の上に反平行1(AP1:Anti-Parallel 1 )層を形成する工程と、その後にスペーサ層を形成する工程と、スペーサ層の上にフリー層を形成する工程と、フリー層の上にキャップ層を形成する工程とを含むものである。フリー層を形成する工程は、スペーサ層の上に第1のフリー層を形成する工程と、第1のフリー層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、第1の導電層の上に半導体および半金属からなる群より選択される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、MRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、第2の導電層の上に第2のフリー層を形成する工程とを含む。
本発明に係る第3の磁気読み取りヘッドの製造方法は、シード層を供給し、その上に反強磁性(AFM:Antiferromagnetic )層を形成する工程と、AFM層の上に反平行2(AP2:Anti-Parallel 2 )層を形成する工程と、AP2層の上にAFM結合層を形成する工程と、AFM結合層の上に反平行1(AP1:Anti-Parallel 1 )層を形成する工程と、その後にスペーサ層を形成する工程と、スペーサ層の上にフリー層を形成する工程と、フリー層の上にキャップ層を形成する工程とを含むものである。AP1層を形成する工程は、AFM結合層の上に第1の強磁性層を形成する工程と、第1の強磁性層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、第1の導電層の上に半導体および半金属からなる群より選択される第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、第1のMRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、第2の導電層の上に第2の強磁性層を形成する工程とを含む。フリー層を形成する工程は、スペーサ層の上に第1のフリー層を形成する工程と、第1のフリー層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第3の導電層を形成する工程と、第3の導電層の上に半導体および半金属からなる群より選択される第2の磁気抵抗効果増加層(MREL)を形成する工程と、第2のMRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第4の導電層を形成する工程と、第4の導電層の上に第2のフリー層を形成する工程とを含む。
本発明に係る第2のスピントロニクス素子の製造方法は、シード層を供給し、その上に強磁性層を形成する工程と、その後にペーサ層を形成する工程と、スペーサ層の上にフリー層を形成する工程と、フリー層の上にキャップ層を形成する工程とを含むものである。フリー層を形成する工程は、第1のフリー層を形成する工程と、第1のフリー層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、第1の導電層の上に半導体および半金属からなる群より選択される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、MRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、第2の導電層の上に第2のフリー層を形成する工程とを含む。
本発明に係る第3のスピントロニクス素子の製造方法は、シード層を供給し、その上に強磁性層を形成する工程と、その後にスペーサ層を形成する工程と、スペーサ層の上にフリー層を形成する工程と、フリー層の上にキャップ層を形成する工程とを含むものである。強磁性層を形成する工程は、第1の強磁性層を形成する工程と、第1の強磁性層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、第1の導電層の上に半導体および半金属からなる群より選択されると共に上部表面および下部表面を有する第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、第1のMRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、第2の導電層の上に第2の強磁性層を形成する工程と、上部表面と下部表面に対して垂直に第1の強磁性層と第2の強磁性層とを磁化する工程とを含む。フリー層を形成する工程は、第1のフリー層を形成する工程と、第1のフリー層の上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第3の導電層を形成する工程と、第3の導電層の上に半導体および半金属からなる群より選択される第2の磁気抵抗効果増加層(MREL)を形成する工程と、第2のMRELの上にCu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第4の導電層を形成する工程と、第4の導電層の上に第2のフリー層を形成する工程とを含む。
本発明に係る第2のスピントロニクス素子は、シード層の上に設けられた強磁性層と、強磁性層を覆うスペーサ層と、スペーサ層の上に設けられたフリー層と、フリー層の上に設けられたキャップ層とを備えたものである。フリー層は、第1のフリー層と、第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、第2の導電層の上に設けられた第2のフリー層とを含む。
本発明に係る第3のスピントロニクス素子は、シード層の上に設けられた強磁性層と、強磁性層を覆うスペーサ層と、スペーサ層の上に設けられたフリー層と、フリー層の上に設けられたキャップ層とを備えたものである。強磁性層は、第1の強磁性層と、第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成されると共に上部表面および下部表面を有する第1の磁気抵抗効果増加層(MREL)と、第1のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、第2の導電層の上に設けられた第2の強磁性層とを含み、第1の強磁性層および第2の強磁性層は、上部表面と下部表面に対して垂直に磁化されている。フリー層は、第1のフリー層と、第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第3の導電層と、第3の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成される第2の磁気抵抗効果増加層(MREL)と、第2のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第4の導電層と、第4の導電層の上に設けられた第2のフリー層とを含む。
本発明に係る第2の磁気読み取りヘッドは、シード層の上に設けられ、このシード層と接触する反強磁性(AFM:Antiferromagnetic )層と、AFM層の上に設けられた反平行2(AP2:Anti-Parallel 2 )層と、AP2層の上に設けられたAFM結合層と、AFM結合層の上に設けられた反平行1(AP1:Anti-Parallel 1 )層と、AP1層を覆うスペーサ層と、スペーサ層の上に設けられたフリー層と、フリー層を覆うキャップ層とを備えたものである。フリー層は、スペーサ層の上に設けられた第1のフリー層と、第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、第2の導電層の上に設けられた第2のフリー層とを含む。
本発明に係る第3の磁気読み取りヘッドは、シード層の上に設けられ、このシード層と接触する反強磁性(AFM:Antiferromagnetic )層と、AFM層の上に設けられた反平行2(AP2:Anti-Parallel 2 )層と、AP2層の上に設けられたAFM結合層と、AFM結合層の上に設けられた反平行1(AP1:Anti-Parallel 1 )層と、AP1層を覆うスペーサ層と、スペーサ層の上に設けられたフリー層と、フリー層を覆うキャップ層とを備えたものである。AP1層は、AFM結合層の上に設けられた第1の強磁性層と、第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、第1のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、第2の導電層の上に設けられた第2の強磁性層とを含む。フリー層は、スペーサ層の上に設けられた第1のフリー層と、第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第3の導電層と、第3の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された第2の磁気抵抗効果増加層(MREL)と、第2のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第4の導電層と、第4の導電層の上に設けられた第2のフリー層とを含む。
本発明者は、ZnOなどのバンドギャップが小さい半導体をCuなどの導電性金属層の間に挟み込んで構成した3層構造(例えば、Cu0.3/ZnO1.5/Cu0.3;数値は各層の膜厚(nm))をスピントロニクス素子に挿入すると、そのスピントロニクス素子のMR比が著しく増加することを見出した。その初期の例は、約45×45[nm]のサイズにパターニングされたスピントルク発振器(STO:Spin Torque Oscillator)を用いた実験の過程において発見された。その構造は、Ta1.0/Ru2.0/Cu2.0/[Co0.2/Ni0.6]×15/Cu2.0/FeCo15.0/Ru1.0/Ta4.0/Ru3.0であった。
図3はその典型的なRH曲線を表す。この測定は、外部印加磁界の方向が膜面に垂直な方向から7度離れた状態で行われた。よって、測定で用いられた外部印加磁界が膜面に対して正確に垂直となるようにされていれば、さらに高いMR値が得られたと考えられる。
(a)M1およびM2は、例えば、Cu、Ag、Au、C(グラフェン、ナノチューブなどを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuなどの高導電性金属であるが、これに限定されるものではない。M1およびM2は、一般に同じ材料を用いて同じ厚さ(好ましくは0以上5.0nm以下)に形成され、例えばともに膜厚が約0.3nmのCuとするのが望ましい。但し、本発明の効果に著しく影響しない限り、M1およびM2は異なる材料であってもよく、異なる厚さであってもよい。
(b)さらに、MRELを構成するM1/半導体/M2という基本3層構造は、そのまま1回だけ用いてもよいし、あるいは複数回繰り返し追加的に積層するようにしてもよい。この場合、追加する各3層構造は、必ずしも、同じMREL内の他の3層構造とは必ずしも同じ材料および/または同一の厚さでなくてもよい。
(c)MRELの半導体部分におけるバンドギャップは、0.3eV以上8eV以下でなければならず、1eV以上6eV以下であることが望ましい。
(d)MRELの半導体部分における電子移動度は、10cm2 ・sec-1・V-1以上2 ,000,000cm2 ・sec-1・V-1以下でなければならず、50cm2 ・sec-1・V-1以上50,000cm2 ・sec-1・V-1以下であることが望ましい。
従来のGMR素子の一般的な構造は、シード/AFM/AP2/Ru/AP1/導電性スペーサ/FL/キャップである。ここで、AFMは反強磁性(Antiferromagnetic )層、AP2は外側ピンド(Anti-Parallel 2 )層、Ruは結合層、AP1は内側ピンド(Anti-Parallel 1 )層、FLはフリー層である。
(1)シード/AFM/AP2/Ru/[FM1/MREL/FM2]/導電性スペーサ/FL/キャップ
(2)シード/AFM/AP2/Ru/AP1/導電性スペーサ/[FL1/MREL/FL2]/キャップ
(3)シード/AFM/AP2/Ru/[FM1/MREL/FM2]/導電性スペーサ/[FL1/MREL/FL2]/キャップ
従来のTMR素子の構造は、シード/AFM/AP2/Ru/AP1/バリア層/FL/キャップである。
(4)シード/AFM/AP2/Ru/[FM1/MREL/FM2]/バリア層/FL/キャップ
(5)シード/AFM/AP2/Ru/AP1/バリア層/[FL1/MREL/FL2]/キャップ
(6)シード/AFM/AP2/Ru/[FM1/MREL/FM2]/バリア層/[FL1/MREL/FL2]/キャップ
(7)シード/[FM1/MREL/FM2]/スペーサ/FL/キャップ
(8)シード/FM/スペーサ/[FL1/MREL/FL2]/キャップ
(9)シード/[FM1/MREL/FM2]/スペーサ/[FL1/MREL/FL2]/キャップ
このスピントルク発振器は、特に、磁界発生層(FGL:Field Generating Layer)を備えるものであり、その従来の素子構造は、シード/SIL/スペーサ/FGL/キャップ(層に垂直な磁界を含む)である。
(10)シード/[FM1/MREL/FM2]/スペーサ/FGL/キャップ
(11)シード/SIL/スペーサ/[FL1/MREL/FL2]/キャップ
(12)シード/[FM1/MREL/FM2]/スペーサ/[FL1/MREL/FL2]/キャップ
Claims (32)
- シード層を供給し、その上に反強磁性(AFM:Antiferromagnetic )層を形成する工程と、
前記AFM層の上に、反平行2(AP2:Anti-Parallel 2 )層を形成する工程と、
前記AP2層の上に、AFM結合層を形成する工程と、
前記AFM結合層の上に、反平行1(AP1:Anti-Parallel 1 )層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記AP1層を形成する工程は、
前記AFM結合層の上に、第1の強磁性層を形成する工程と、
前記第1の強磁性層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記MRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2の強磁性層を形成する工程と
を含む、磁気読み取りヘッドの製造方法。 - シード層を供給し、その上に反強磁性(AFM:Antiferromagnetic )層を形成する工程と、
前記AFM層の上に、反平行2(AP2:Anti-Parallel 2 )層を形成する工程と、
前記AP2層の上に、AFM結合層を形成する工程と、
前記AFM結合層の上に、反平行1(AP1:Anti-Parallel 1 )層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記フリー層を形成する工程は、
前記スペーサ層の上に、第1のフリー層を形成する工程と、
前記第1のフリー層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記MRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2のフリー層を形成する工程と
を含む、磁気読み取りヘッドの製造方法。 - シード層を供給し、その上に反強磁性(AFM:Antiferromagnetic )層を形成する工程と、
前記AFM層の上に、反平行2(AP2:Anti-Parallel 2 )層を形成する工程と、
前記AP2層の上に、AFM結合層を形成する工程と、
前記AFM結合層の上に、反平行1(AP1:Anti-Parallel 1 )層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記AP1層を形成する工程は、
前記AFM結合層の上に、第1の強磁性層を形成する工程と、
前記第1の強磁性層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択される第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記第1のMRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2の強磁性層を形成する工程と
を含み、
前記フリー層を形成する工程は、
前記スペーサ層の上に、第1のフリー層を形成する工程と、
前記第1のフリー層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第3の導電層を形成する工程と、
前記第3の導電層の上に、半導体および半金属からなる群より選択される第2の磁気抵抗効果増加層(MREL)を形成する工程と、
前記第2のMRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第4の導電層を形成する工程と、
前記第4の導電層の上に、第2のフリー層を形成する工程と
を含む、磁気読み取りヘッドの製造方法。 - 前記スペーサ層を導電性とすることにより、前記磁気読み取りヘッドを、巨大磁気抵抗効果(GMR:Giant Magneto-Resistance)素子として構成する
請求項1ないし請求項3のいずれか1項に記載の磁気読み取りヘッドの製造方法。 - 前記スペーサ層を電気的絶縁性とすることにより、前記磁気読み取りヘッドを、トンネル磁気抵抗効果(TMR:Tunneling Magneto-Resistance)素子として構成する
請求項1ないし請求項3のいずれか1項に記載の磁気読み取りヘッドの製造方法。 - 前記半導体のバンドギャップを、1eV以上6eV以下であり、電子移動度が、50cm2 ・sec-1・V-1以上50,000cm2 ・sec-1・V-1以下とする
請求項1ないし請求項3のいずれか1項に記載の磁気読み取りヘッドの製造方法。 - 前記半導体を、ZnO、ZnS、Znx Mg(1-x) O、ZnCuO、ZnCdO、ZnAlO、ZnSe、ZnTe、Si、Ge、TiO2 、AlN、GaN、InN、AlP、AlAs、AlSb、GaP、GaAs、GaSb、InP、InAs、ZnS、CdS、CdTe、HgTe、PbS、PbSe、PbTe、SnO、SnTe、Cu2 O、FeSi2 、CrMnSi、Mg2 Si、RuSi3 、およびIr3 Si5 からなる群より選択する
請求項1ないし請求項3のいずれか1項に記載の磁気読み取りヘッドの製造方法。 - 前記半導体として、不純物が添加されていないものを用いるか、または、Si、B、Mg、Mn、Al、Cu、Cd、Cr、Zn、Ti、Sn、Zr、Hf、Ru、Mo、Nb、Co、Fe、およびNiからなる群から選択された不純物の添加により調整された導電性を有するものを用いる
請求項7記載の磁気読み取りヘッドの製造方法。 - 前記半金属を、Sb、Bi、CoSi、Cox Fe(1-x) Si、Cox Ni(1-x) Si、Cox Mn(1-x) Si、FeSi、およびCox Cr(1-x) Siからなる群より選択する
請求項1ないし請求項3のいずれか1項に記載の磁気読み取りヘッドの製造方法。 - シード層を供給し、その上に強磁性層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記強磁性層を形成する工程は、
第1の強磁性層を形成する工程と、
前記第1の強磁性層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択されると共に上部表面および下部表面を有する磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記MRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2の強磁性層を形成する工程と、
前記上部表面と前記下部表面に対して垂直に、前記第1の強磁性層と前記第2の強磁性層とを磁化する工程と
を含む、スピントロニクス素子の製造方法。 - シード層を供給し、その上に強磁性層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記フリー層を形成する工程は、
第1のフリー層を形成する工程と、
前記第1のフリー層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記MRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2のフリー層を形成する工程と
を含む、スピントロニクス素子の製造方法。 - シード層を供給し、その上に強磁性層を形成する工程と、
その後に、スペーサ層を形成する工程と、
前記スペーサ層の上に、フリー層を形成する工程と、
前記フリー層の上に、キャップ層を形成する工程と
を含み、
前記強磁性層を形成する工程は、
第1の強磁性層を形成する工程と、
前記第1の強磁性層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第1の導電層を形成する工程と、
前記第1の導電層の上に、半導体および半金属からなる群より選択されると共に上部表面および下部表面を有する第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)を形成する工程と、
前記第1のMRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第2の導電層を形成する工程と、
前記第2の導電層の上に、第2の強磁性層を形成する工程と、
前記上部表面と前記下部表面に対して垂直に、前記第1の強磁性層と前記第2の強磁性層とを磁化する工程と
を含み、
前記フリー層を形成する工程は、
第1のフリー層を形成する工程と、
前記第1のフリー層の上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第3の導電層を形成する工程と、
前記第3の導電層の上に、半導体および半金属からなる群より選択される第2の磁気抵抗効果増加層(MREL)を形成する工程と、
前記第2のMRELの上に、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される第4の導電層を形成する工程と、
前記第4の導電層の上に、第2のフリー層を形成する工程と
を含む、スピントロニクス素子の製造方法。 - 前記半導体のバンドギャップを1eV以上6eV以下とし、電子移動度を50cm2 ・sec-1・V-1以上50,000cm2 ・sec-1・V-1以下とする
請求項10ないし請求項12のいずれか1項に記載のスピントロニクス素子の製造方法。 - 前記半導体を、ZnO、ZnS、Znx Mg(1-x) O、ZnCuO、ZnCdO、ZnAlO、ZnSe、ZnTe、Si、Ge、TiO2 、AlN、GaN、InN、AlP、AlAs、AlSb、GaP、GaAs、GaSb、InP、InAs、ZnS、CdS、CdTe、HgTe、PbS、PbSe、PbTe、SnO、SnTe、Cu2 O、FeSi2 、CrMnSi、Mg2 Si、RuSi3 、およびIr3 Si5 からなる群より選択する
請求項10ないし請求項12のいずれか1項に記載のスピントロニクス素子の製造方法。 - 前記半導体として、不純物が添加されていないものを用いるか、または、Si、B、Mg、Mn、Al、Cu、Cd、Cr、Ti、Zr、Hf、Ru、Mo、Nb、Co、Fe、およびNiからなる群から選択された不純物の添加により調整された導電性を有するものを用いる
請求項14記載のスピントロニクス素子の製造方法。 - 前記半金属を、Sb、Bi、CoSi、Cox Fe(1-x) Si、Cox Ni(1-x) Si、Cox Mn(1-x) Si、FeSi、およびCox Cr(1-x) Siからなる群より選択する
請求項10ないし請求項12のいずれか1項に記載のスピントロニクス素子の製造方法。 - シード層の上に設けられ、このシード層と接触する反強磁性(AFM:Antiferromagnetic )層と、
前記AFM層の上に設けられた反平行2(AP2:Anti-Parallel 2 )層と、
前記AP2層の上に設けられたAFM結合層と、
前記AFM結合層の上に設けられた反平行1(AP1:Anti-Parallel 1 )層と、
前記AP1層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層を覆うキャップ層と
を備え、
前記AP1層は、
前記AFM結合層の上に設けられた第1の強磁性層と、
前記第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、
前記MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2の強磁性層と
を含む、磁気読み取りヘッド。 - シード層の上に設けられ、このシード層と接触する反強磁性(AFM:Antiferromagnetic )層と、
前記AFM層の上に設けられた反平行2(AP2:Anti-Parallel 2 )層と、
前記AP2層の上に設けられたAFM結合層と、
前記AFM結合層の上に設けられた反平行1(AP1:Anti-Parallel 1 )層と、
前記AP1層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層を覆うキャップ層と
を備え、
前記フリー層は、
前記スペーサ層の上に設けられた第1のフリー層と、
前記第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、
前記MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2のフリー層と
を含む、磁気読み取りヘッド。 - シード層の上に設けられ、このシード層と接触する反強磁性(AFM:Antiferromagnetic )層と、
前記AFM層の上に設けられた反平行2(AP2:Anti-Parallel 2 )層と、
前記AP2層の上に設けられたAFM結合層と、
前記AFM結合層の上に設けられた反平行1(AP1:Anti-Parallel 1 )層と、
前記AP1層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層を覆うキャップ層と
を備え、
前記AP1層は、
前記AFM結合層の上に設けられた第1の強磁性層と、
前記第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された第1の磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、
前記第1のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2の強磁性層と
を含み、
前記フリー層は、
前記スペーサ層の上に設けられた第1のフリー層と、
前記第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第3の導電層と、
前記第3の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成された第2の磁気抵抗効果増加層(MREL)と、
前記第2のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第4の導電層と、
前記第4の導電層の上に設けられた第2のフリー層と
を含む、磁気読み取りヘッド。 - 前記スペーサ層が導電性を有することにより、巨大磁気抵抗効果(GMR:Giant Magneto-Resistance)素子として構成されている
請求項17ないし請求項19のいずれか1項に記載の磁気読み取りヘッド。 - 前記スペーサ層が電気的絶縁性を有することにより、トンネル磁気抵抗効果(TMR:Tunneling Magneto-Resistance)素子として構成されている
請求項17ないし請求項19のいずれか1項に記載の磁気読み取りヘッド。 - 前記半導体は、バンドギャップが、1eV以上6eV以下であり、電子移動度が、50cm2 ・sec-1・V-1以上50,000cm2 ・sec-1・V-1以下である
請求項17ないし請求項19のいずれか1項に記載の磁気読み取りヘッド。 - 前記半導体は、ZnO、ZnS、Znx Mg(1-x) O、ZnCuO、ZnCdO、ZnAlO、ZnSe、ZnTe、Si、Ge、TiO2 、AlN、GaN、InN、AlP、AlAs、AlSb、GaP、GaAs、GaSb、InP、InAs、ZnS、CdS、CdTe、HgTe、PbS、PbSe、PbTe、SnO、SnTe、Cu2 O、FeSi2 、CrMnSi、Mg2 Si、RuSi3 、およびIr3 Si5 からなる群より選択される
請求項17ないし請求項19のいずれか1項に記載の磁気読み取りヘッド。 - 前記半導体として、不純物が添加されていないものが用いられ、または、Si、B、Mg、Mn、Al、Cu、Cd、Cr、Zn、Ti、Sn、Zr、Hf、Ru、Mo、Nb、Co、Fe、およびNiからなる群から選択された不純物の添加により調整された導電性を有するものが用いられている
請求項23記載の磁気読み取りヘッド。 - 前記半金属は、Sb、Bi、CoSi、Cox Fe(1-x) Si、Cox Ni(1-x) Si、Cox Mn(1-x) Si、FeSi、およびCox Cr(1-x) Siからなる群より選択される
請求項17ないし請求項19のいずれか1項に記載の磁気読み取りヘッド。 - シード層の上に設けられた強磁性層と、
前記強磁性層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層の上に設けられたキャップ層と
を備え、
前記強磁性層は、
第1の強磁性層と、
前記第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成されると共に上部表面および下部表面を有する磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、
前記MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2の強磁性層と
を含み、
前記第1の強磁性層および前記第2の強磁性層が、前記上部表面と前記下部表面に対して垂直に磁化されている
を備えたスピントロニクス素子。 - シード層の上に設けられた強磁性層と、
前記強磁性層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層の上に設けられたキャップ層と
を備え、
前記フリー層は、
第1のフリー層と、
前記第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成される磁気抵抗効果増加層(MREL:Magneto-Resistance Enhancing Layer)と、
前記MRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2のフリー層と
を含む、スピントロニクス素子。 - シード層の上に設けられた強磁性層と、
前記強磁性層を覆うスペーサ層と、
前記スペーサ層の上に設けられたフリー層と、
前記フリー層の上に設けられたキャップ層と
を備え、
前記強磁性層は、
第1の強磁性層と、
前記第1の強磁性層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第1の導電層と、
前記第1の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成されると共に上部表面および下部表面を有する第1の磁気抵抗効果増加層(MREL)と、
前記第1のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第2の導電層と、
前記第2の導電層の上に設けられた第2の強磁性層と
を含み、
前記第1の強磁性層および前記第2の強磁性層が、前記上部表面と前記下部表面に対して垂直に磁化されており、
前記フリー層は、
第1のフリー層と、
前記第1のフリー層の上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第3の導電層と、
前記第3の導電層の上に設けられ、半導体および半金属からなる群より選択された材料により構成される第2の磁気抵抗効果増加層(MREL)と、
前記第2のMRELの上に設けられ、Cu、Ag、Au、C(グラフェンおよびナノチューブを含む)、Zn、Ti、Sn、Cr、Al、Mg、およびRuからなる群より選択される材料により構成された第4の導電層と、
前記第4の導電層の上に設けられた第2のフリー層と
を含む、スピントロニクス素子。 - 前記半導体は、バンドギャップが、1eV以上6eV以下であり、電子移動度が、50cm2 ・sec-1・Vー1以上50,000cm2 ・secー1・V-1以下である
請求項26ないし請求項28のいずれか1項に記載のスピントロニクス素子。 - 前記半導体は、ZnO、ZnS、Znx Mg(1-x) O、ZnCuO、ZnCdO、ZnAlO、ZnSe、ZnTe、Si、Ge、TiO2 、AlN、GaN、InN、AlP、AlAs、AlSb、GaP、GaAs、GaSb、InP、InAs、ZnS、CdS、CdTe、HgTe、PbS、PbSe、PbTe、SnO、SnTe、Cu2 O、FeSi2 、CrMnSi、Mg2 Si、RuSi3 、およびIr3 Si5 からなる群より選択される
請求項26ないし請求項28のいずれか1項に記載のスピントロニクス素子。 - 前記半導体として、不純物が添加されていないものが用いられ、または、Si、B、Mg、Mn、Al、Cu、Cd、Cr、Zn、Ti、Sn、Zr、Hf、Ru、Mo、Nb、Co、Fe、およびNiからなる群から選択された不純物の添加により調整された導電性を有するものが用いられている
請求項30記載のスピントロニクス素子。 - 前記半金属は、Sb、Bi、CoSi、Cox Fe(1-x) Si、Cox Ni(1-x) Si、Cox Mn(1-x) Si、FeSi、およびCox Cr(1-x) Siからなる群より選択される
請求項26ないし請求項28のいずれか1項に記載のスピントロニクス素子。
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