JP5580009B2 - 半導体素子用エピタキシャル基板、半導体素子、および、半導体素子用エピタキシャル基板の作製方法 - Google Patents
半導体素子用エピタキシャル基板、半導体素子、および、半導体素子用エピタキシャル基板の作製方法 Download PDFInfo
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Description
<HEMT素子の構成>
図1は、本発明の第1の実施の形態に係るHEMT素子10の構成を概略的に示す断面模式図である。HEMT素子10は、基板1と、バッファ層2と、チャネル層3と、障壁層5とが積層形成された構成を有する。バッファ層2と、チャネル層3と、障壁層5とはいずれも、MOCVD法(有機金属化学的気相成長法)を用いてエピタキシャル形成される(詳細は後述)のが好適な一例である。以降においては、基板1と、バッファ層2と、チャネル層3と、障壁層5とが積層形成された積層構造体を、エピタキシャル基板10Aとも称することとする。なお、図1における各層の厚みの比率は、実際のものを反映したものではない。
本実施の形態に係るHEMT素子10においては、障壁層5が、その表面5aからの深さ方向(厚み方向)に一様な組成を有するのではなく、傾斜組成を有するように形成されてなる。
チャネル層3と障壁層5を構成するIII族窒化物の組成が所定の要件を満たすようにすることで、従来よりも高い濃度で二次元電子ガスが存在する二次元電子ガス領域3eを備える一方で、歪みによる内部応力が抑制されたHEMT素子10が実現される。具体的には、2×1013/cm2以上という二次元電子ガス濃度が実現される。なお、HEMT素子10における二次元電子ガスの移動度は、概ね300〜400cm2/Vs程度である。
図4:Al0.1Ga0.9N(x1=0、y1=0.1、z1=0.9);
図5:Al0.2Ga0.8N(x1=0、y1=0.2、z1=0.8);
図6:Al0.3Ga0.7N(x1=0、y1=0.3、z1=0.7)。
上述のように、チャネル層3は、x1=0、0≦y1≦0.3なる組成範囲をみたすように形成されるが、チャネル層3がAlをわずかでも含むようにした場合(y1>0の場合)、その比抵抗は急激に増大するとともに、オフ時のドレインリーク電流は急激に減少する。例えば、y1=0の場合(チャネル層3がGaN)に比べて、y1=0.01の場合(チャネル層3がAl0.01Ga0.99N)は比抵抗が2オーダー程度大きくなり、ドレインリーク電流は2オーダー程度小さくなる。さらに、y1=0.1の場合(チャネル層3がAl0.1Ga0.9N)にはy1=0のときに比べて比抵抗は4オーダー程度大きくなり、ドレインリーク電流は3オーダー程度小さくなる。
次に、上述のようなチャネル層3および障壁層5が上述のような組成範囲を有するエピタキシャル基板10Aを作製し、さらに係るエピタキシャル基板10Aを用いてHEMT素子10を作製する方法を説明する。
<スペーサ層を備えるHEMT素子>
図7は、本発明の第2の実施の形態に係るHEMT素子20の構成を概略的に示す断面模式図である。HEMT素子20は、第1の実施の形態に係るHEMT素子10のチャネル層3と障壁層5の間に、スペーサ層4が介挿された構成を有する。スペーサ層4以外の構成要素については、第1の実施の形態に係るHEMT素子10と同じであるので、その詳細な説明は省略する。なお、以降においては、基板1と、バッファ層2と、チャネル層3と、スペーサ層4と、障壁層5とが積層形成された積層構造体を、エピタキシャル基板20Aとも称することとする。
上述のような構造を有するHEMT素子20は、スペーサ層4の形成に係るプロセスを除き、第1の実施の形態に係るHEMT素子10と同様の方法で作製される。
本実施例では、障壁層の表面近傍部のIn組成分布を違えた6種(サンプルNo.1〜No.6)のエピタキシャル基板を作製し、それぞれについてのショットキーコンタクト特性を評価した。
実施例2として、障壁層のベース部の組成を種々に違える一方、傾斜率を0.95に固定した、計17種のショットキーダイオードを作製した。また、比較例として、表面近傍部を傾斜組成とせず、ベース部と同じ組成を有するようにした17種のショットキーダイオードを実施例2に対応させて作製した。それぞれの試料について、理想因子と20V印加時のショットキー電極の逆方向リーク電流とを評価した。
2 バッファ層
3 チャネル層
3e 二次元電子ガス領域
4 スペーサ層
5 障壁層
5a (障壁層の)表面
6 ソース電極
7 ドレイン電極
8 ゲート電極
I (チャネル層と障壁層との)界面
10、20 HEMT素子
10A、20A エピタキシャル基板
Claims (12)
- 下地基板と、
少なくともGaを含む、Inx1Aly1Gaz1N(x1+y1+z1=1)なる組成の第1のIII族窒化物からなるチャネル層と、
少なくともInとAlとをともに含む、Inx2Aly2Gaz2N(x2+y2+z2=1)なる組成の第2のIII族窒化物からなる障壁層と、
を備えるエピタキシャル基板であって、
前記障壁層においては、表面から前記障壁層の深さ方向において所定距離範囲内の部分を表面近傍部とし、前記表面から前記深さ方向において前記所定距離以上離れた部分をベース部とするとき、前記ベース部においてはIn組成比が一様であり、前記表面におけるIn組成比は前記ベース部におけるIn組成比よりも小さく、かつ、前記表面と前記ベース部との間においてはIn組成比が連続的に変化する、
ことを特徴とする半導体素子用エピタキシャル基板。 - 請求項1に記載の半導体素子用エピタキシャル基板であって、
前記表面近傍部が前記障壁層の前記表面から前記深さ方向に6nm以上の範囲であり、
前記ベース部における前記第2のIII族窒化物の組成をInx2αAly2αGaz2αN(x2α+y2α+z2α=1)と表し、前記表面における前記第2のIII族窒化物の組成をInx2βAly2βGaz2βN(x2β+y2β+z2β=1)と表す場合に、
0.9≦x2β/x2α≦0.95である、
ことを特徴とする半導体素子用エピタキシャル基板。 - 請求項1ないし請求項4のいずれかに記載の半導体素子用エピタキシャル基板であって、
前記第1のIII族窒化物がGaNである、
ことを特徴とする半導体素子用エピタキシャル基板。 - 請求項1ないし請求項5のいずれかに記載の半導体素子用エピタキシャル基板であって、
前記チャネル層と前記障壁層との間に、少なくともAlを含み、前記障壁層よりも大きなバンドギャップエネルギーを有する、Inx3Aly3Gaz3N(x3+y3+z3=1)なる組成の第3のIII族窒化物からなるスペーサ層、
をさらに備えることを特徴とする半導体素子用エピタキシャル基板。 - 請求項6に記載の半導体素子用エピタキシャル基板であって、
前記第3のIII族窒化物の組成がx3=0、0≦z3≦0.05で定まる範囲内にあることを特徴とする半導体素子用エピタキシャル基板。 - 請求項7に記載の半導体素子用エピタキシャル基板であって、
前記第3のIII族窒化物がAlNであることを特徴とする半導体素子用エピタキシャル基板。 - 請求項1ないし請求項8のいずれかに記載の半導体素子用エピタキシャル基板の前記障壁層の上に、ソース電極、ドレイン電極、およびゲート電極が設けられてなる半導体素子。
- 下地基板の上に、少なくともGaを含む、Inx1Aly1Gaz1N(x1+y1+z1=1)なる組成の第1のIII族窒化物からなるチャネル層を形成するチャネル層形成工程と、
前記チャネル層の上に、少なくともInとAlとをともに含む、Inx2Aly2Gaz2N(x2+y2+z2=1)なる組成の第2のIII族窒化物からなる障壁層を形成する障壁層形成工程と、
を備える半導体素子用エピタキシャル基板の作製方法であって、
前記障壁層形成工程においては、表面から前記障壁層の深さ方向において所定距離範囲内の部分を表面近傍部とし、前記表面から前記深さ方向において前記所定距離以上離れた部分をベース部とするとき、前記ベース部においてはIn組成比が一様であり、前記表面におけるIn組成比は前記ベース部におけるIn組成比よりも小さく、かつ、前記表面と前記ベース部との間においてはIn組成比が連続的に変化するように、前記障壁層を形成する、
ことを特徴とする半導体素子用エピタキシャル基板の作製方法。 - 請求項10に記載の半導体素子用エピタキシャル基板の作製方法であって、
前記障壁層形成工程においては、
前記障壁層の前記表面から前記深さ方向に6nm以上の範囲を前記表面近傍部とし、
前記ベース部における前記第2のIII族窒化物の組成をInx2αAly2αGaz2αN(x2α+y2α+z2α=1)と表し、前記表面における前記第2のIII族窒化物の組成をInx2βAly2βGaz2βN(x2β+y2β+z2β=1)と表す場合に、
0.9≦x2β/x2α≦0.95をみたすように前記障壁層を形成する、
ことを特徴とする半導体素子用エピタキシャル基板の作製方法。
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