JP5435720B2 - 半導体装置 - Google Patents
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Description
以下、本発明の第1の実施形態の半導体装置とその製造方法について、図面を参照しながら説明する。
次に、本発明の第2の実施形態の半導体装置とその製造方法について、図面を参照しながら説明する。
2 素子分離領域
10 半導体装置
10a 半導体装置
11H ゲート構造
11L ゲート構造
12H ゲート絶縁膜
12L ゲート絶縁膜
13H ゲート電極
13L ゲート電極
14A 絶縁膜
14B 絶縁膜
14H オフセットスペーサー
14HA 第一層
14HB 第二層
14L オフセットスペーサー
15H サイドウォールスペーサー
15L サイドウォールスペーサー
16H ソース/ドレイン領域
16L ソース/ドレイン領域
17H エクステンション領域
17L エクステンション領域
18H ハロー領域
18L ハロー領域
20 レジスト
21 レジスト
Claims (9)
- 基板上に、同一の導電型である第1電界効果型トランジスタ及び第2電界効果型トランジスタが形成され、
前記第1電界効果型トランジスタは、
前記基板における第1活性領域上に形成された第1ゲート電極と、
前記第1ゲート電極の側方に形成された堆積絶縁膜からなる第1サイドウォールスペーサーと、
前記第1活性領域における前記第1ゲート電極下方を挟む両側に形成された第1導電型の第1エクステンション領域とを備え、
前記第2電界効果型トランジスタは、
前記基板における第2活性領域上に形成された第2ゲート電極と、
前記第2ゲート電極の側方に形成された堆積絶縁膜からなる第2サイドウォールスペーサーと、
前記第2活性領域における前記第2ゲート電極下方を挟む両側に形成された第1導電型の第2エクステンション領域とを備え、
前記第1サイドウォールスペーサーと、前記第1ゲート電極との間に、堆積絶縁膜からなる第1オフセットスペーサーが設けられ、
前記第2サイドウォールスペーサーと、前記第2ゲート電極との間に、前記第1オフセットスペーサーよりも厚い、堆積絶縁膜からなる第2オフセットスペーサーが設けられ、
前記第1ゲート電極のゲート長方向の寸法と、前記第2ゲート電極のゲート長方向の寸法とは同一寸法に形成されており、
前記第1電界効果型トランジスタと前記第2電界効果型トランジスタとは、同一不純物濃度のチャネル拡散層を有し、
前記第2電界効果型トランジスタは、前記第1電界効果型トランジスタよりも閾値電圧が高く設定され、
前記第1エクステンション領域と前記第1ゲート電極とが重なるゲート長方向の長さは、前記第2エクステンション領域と前記第2ゲート電極とが重なるゲート長方向の長さよりも長く、
前記第1ゲート電極と前記第1サイドウォールスペーサーとの間の距離は、前記第2ゲート電極と前記第2サイドウォールスペーサーとの間の距離よりも短いことを特徴とする半導体装置。 - 請求項1の半導体装置において、
前記第1オフセットスペーサー及び前記第2オフセットスペーサーのうちの少なくとも前記第2オフセットスペーサーは、2層以上の積層構造であり、
前記第2オフセットスペーサーの積層数は、前記第1オフセットスペーサーの積層数よりも多いことを特徴とする半導体装置。 - 請求項1又は2のいずれか1つの半導体装置において、
前記第1エクステンション領域と前記第1ゲート電極とが重なるゲート長方向の長さは、前記第2エクステンション領域と前記第2ゲート電極とが重なるゲート長方向の長さよりも所定の距離だけ長いことを特徴とする半導体装置。 - 請求項1〜3のいずれか1つの半導体装置において、
前記第1ゲート電極と前記第1サイドウォールスペーサーとの間の距離は、前記第2ゲート電極と前記第2サイドウォールスペーサーとの間の距離よりも所定の距離だけ短いことを特徴とする半導体装置。 - 請求項3又は4の半導体装置において、
前記所定の距離は、前記第1電界効果型トランジスタの閾値電圧と前記第2電界効果型トランジスタの閾値電圧との違いによって設定されていることを特徴とする半導体装置。 - 請求項3〜5のいずれか1つの半導体装置において、
前記所定の距離は、2nm以上で且つ4nm以下であることを特徴とする半導体装置。 - 請求項1〜6のいずれか1つの半導体装置において、
前記第1ゲート電極の下方における前記第1エクステンション領域間の距離は、前記第2ゲート電極の下方における前記第2エクステンション領域間の距離よりも短いことを特徴とする半導体装置。 - 請求項1〜7のいずれか1つの半導体装置において、
前記第1エクステンション領域と前記基板との間に設けられた第2導電型の第1ハロー領域と、
前記第2エクステンション領域と前記基板との間に設けられた第2導電型の第2ハロー領域とを更に備えることを特徴とする半導体装置。 - 請求項1〜8のいずれか1つの半導体装置において、
前記第1活性領域における前記第1ゲート電極から見て前記第1エクステンション領域の外側に形成された第1導電型の第1ソース/ドレイン領域と、
前記第2活性領域における前記第2ゲート電極から見て前記第2エクステンション領域の外側に形成された第1導電型の第2ソース/ドレイン領域とを備えることを特徴とする半導体装置。
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