JP5050210B2 - 自動利得制御回路、そのような回路を具備したシステム、及び自動利得制御方法 - Google Patents
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Description
利得制御部は、AD変換器の変換の2つのサンプル値間で可変利得増幅器の利得を変化させるように構成されている
利得制御部は、AD変換器によって与えられた第1デジタル値と、可変利得増幅器の利得を表す第2デジタル値とをシリアルバスを介して送信するように構成されている。
しきい値イベントの発生のたび、かつ可変利得増幅器の利得が最小値でない場合に、利得制御部は、2の倍数分の1に可変利得増幅器の利得を減少させる。
しきい値イベントの発生のたび、かつ可変利得増幅器の利得が最小値でない場合に、利得制御部は、2つの連続した第1デジタル値間の差の絶対値に応じた所定の値だけ可変利得増幅器の利得を減少させる。
待機時間が規定待機時間よりも長く、かつ可変利得増幅器の利得が最大値でない場合に、利得制御部は、2の倍数倍に可変利得増幅器の利得を増大させる。
利得制御部は、プログラマブルロジックデバイスである。
自動利得制御回路は、特定用途向け集積回路である。
利得制御部は、2つのAD変換器と2つの可変利得増幅器とで、2つのチャネルを管理する機能を有し、それらのそれぞれは、1つ又は2つの回路である。
可変利得増幅器は、デジタルポテンショメータを具備した反転増幅器から成る。
2 信号調整回路
10 自動利得制御回路
11 可変利得増幅器
12 利得制御部
13 反転増幅器
14 入力抵抗器
15 第1帰還抵抗器
16 第2帰還抵抗器
17 信号比較器
18 論理回路
20 AD変換器
S センサ信号
R 受信信号
A 増幅信号
D デジタルデータ信号
CLK クロック信号
G デジタル利得値信号
T しきい値信号
C 比較信号
DOUT 完全デジタルデータ信号
Claims (10)
- 受信信号を受け取って、増幅信号をAD変換器に出力するように構成された可変利得増幅器と、
前記増幅信号を受け取るため、かつ前記可変利得増幅器の利得を制御するために前記可変利得増幅器に接続された利得制御部と
を具備した自動利得制御回路であって、
前記利得制御部が、
AD変換器によって与えられた第1デジタル値と、可変利得増幅器の利得を表す第2デジタル値とをシリアルバスを介して送信するように構成され、
前記利得制御部が、
増幅信号が所定のしきい値に達するたびにしきい値イベントの発生を決定し、
しきい値イベントの発生のたび、かつ可変利得増幅器の利得が最小値でない場合に、2つの連続した第1デジタル値間の差の絶対値に応じた所定の値だけ可変利得増幅器の利得を減少させ、
前回のしきい値イベントからの待機時間を計測し、
待機時間が規定待機時間よりも長く、かつ可変利得増幅器の利得が最大値でない場合に、可変利得増幅器の利得を増大させるように構成されていることを特徴とする自動利得制御回路。 - しきい値イベントの発生のたび、かつ可変利得増幅器の利得が最小値でない場合に、前記利得制御部が、2の倍数分の1に可変利得増幅器の利得を減少させることを特徴とする請求項1に記載の自動利得制御回路。
- 待機時間が規定待機時間よりも長く、かつ可変利得増幅器の利得が最大値でない場合、前記利得制御部が、2の倍数倍に可変利得増幅器の利得を増大させることを特徴とする請求項1ないし2のいずれか1項に記載の自動利得制御回路。
- 前記利得制御部が、プログラマブルロジックデバイス(PLD)であることを特徴とする請求項1ないし3のいずれか1項に記載の自動利得制御回路。
- 特定用途向け集積回路(ASIC)で構成されることを特徴とする請求項1ないし3のいずれか1項に記載の自動利得制御回路。
- 前記利得制御部が、2つのAD変換器と2つの可変利得増幅器とで、2つのチャネルを管理する機能を有し、
前記2つのAD変換器及び前記2つの可変利得増幅器のそれぞれは、1つ又は2つの回路で構成されていることを特徴とする請求項1ないし5のいずれか1項に記載の自動利得制御回路。 - 前記可変利得増幅器が、デジタルポテンショメータを具備した反転増幅器から成ることを特徴とする請求項1ないし6のいずれか1項に記載の自動利得制御回路。
- 請求項1ないし7のいずれか1項に記載の自動利得制御回路を具備したシステムであって、
前記可変利得増幅器から前記増幅信号を受け取るために前記自動利得制御回路に接続されたAD変換器をさらに具備することを特徴とするシステム。 - 前記可変利得増幅器に接続された振動センサをさらに具備し、
前記受信信号が、前記振動センサから前記可変利得増幅器によって受け取られることを特徴とする請求項8に記載のシステム。 - 受信信号を増幅して、増幅信号をAD変換器に出力する可変利得増幅器の自動利得制御方法であって、前記方法は、前記増幅信号を受け取るため、かつ前記可変利得増幅器の利得を制御するために前記可変利得増幅器に接続された利得制御部を使用し、前記利得制御部は、AD変換器によって与えられた第1デジタル値と、可変利得制御部の利得を表す第2デジタル値とをシリアルバスを介して送信し、
前記方法は、
増幅信号が所定のしきい値に達するたびにしきい値イベントの発生を決定する段階と、
しきい値イベントの発生のたび、かつ可変利得増幅器の利得が最小値でない場合に、2つの連続した第1デジタル値間の差の絶対値に応じた所定の値だけ可変利得増幅器の利得を減少させる段階と、
前回のしきい値イベントからの待機時間を計測する段階と、
待機時間が規定待機時間よりも長く、かつ可変利得増幅器の利得が最大値でない場合に、可変利得増幅器の利得を増大させる段階と
を有することを特徴とする方法。
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