JP4700636B2 - 半導体メモリ装置を装着したメモリモジュールを有するシステム - Google Patents
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Description
また、メモリコントローラの代りにマイクロプロセッサを具備することを特徴とする。
また、データバッファは、データストローブ信号のエッジごとにデータを入出力することを特徴とする。
また、第1クロック信号、第2クロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、第1クロック信号、第2クロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、第1クロック信号、第2クロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、システムクロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、システムクロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、第1クロック信号、第2クロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、第1クロック信号、第2クロック信号、アドレス信号及びコマンド信号は、システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする。
また、メモリモジュールは、第1クロック信号及び第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする。
また、本発明のメモリモジュールは、低周波動作のレジスタのために使われる第1クロック信号と高周波動作のメモリチップのために使われる第2クロック信号とを受信する。それで、メモリモジュールが装着されるシステムのクロック周波数が高まっても、メモリモジュール内の動作周波数領域が相異なるレジスタとメモリチップとは該当周波数のクロック信号に選択的に連結されるために安定して動作する。
310 クロックバッファ
320 アドレスバッファ
330 コマンドバッファ
340 データバッファ
350 制御部
Claims (18)
- 第1クロック信号、前記第1クロック信号の周波数より高い周波数の第2クロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、前記メモリモジュールは、
前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信し、その出力を前記メモリモジュールの一方向に提供するレジスタと、
前記第2クロック信号に連結され、これに応答して前記レジスタから出力される前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記第1クロック信号、前記第2クロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項1に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項1に記載のシステム。 - 第1クロック信号、前記第1クロック信号の周波数より高い周波数の第2クロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、前記メモリモジュールは、
前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信し、その出力を前記メモリモジュールの中央で両方向に提供するレジスタと、
前記第2クロック信号に連結され、これに応答して前記レジスタから出力される前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記第1クロック信号、前記第2クロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項4に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項4に記載のシステム。 - システムクロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、
前記システムは、
前記システムクロック信号を受信して第1クロック信号及び前記第1クロック信号の周波数より高い周波数の第2クロック信号を発生させる位相同期回路を具備し、
前記メモリモジュールは前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信し、その出力を前記メモリモジュールの一方向に提供するレジスタと、
前記第2クロック信号に連結され、これに応答して前記レジスタから出力される前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記システムクロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項7に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項7に記載のシステム。 - システムクロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、
前記システムは、
前記システムクロック信号を受信して第1クロック信号及び前記第1クロック信号の周波数より高い周波数の第2クロック信号を発生させる位相同期回路を具備し、
前記メモリモジュールは、
前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信し、その出力を前記メモリモジュールの中央で両方向に提供するレジスタと、
前記第2クロック信号に連結され、これに応答して前記レジスタから出力された前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記システムクロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項10に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項10に記載のシステム。 - 第1クロック信号、前記第1クロック信号の周波数より高い周波数の第2クロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、前記メモリモジュールは、
前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信し、その出力を前記メモリモジュールの一方向に提供するレジスタと、
前記第2クロック信号に連結され、これと位相同期する多数の内部クロック信号を発生させる位相同期回路と、
前記内部クロック信号に各々連結され、これに応答して前記レジスタから出力される前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記第1クロック信号、前記第2クロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項13に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項13に記載のシステム。 - 第1クロック信号、前記第1クロック信号の周波数より高い周波数の第2クロック信号、アドレス信号及びコマンド信号のバスラインが配置され、これらバスラインと連結されるメモリモジュールを有するシステムにおいて、前記メモリモジュールは、
前記第1クロック信号に連結され、これに応答して前記アドレス信号及び前記コマンド信号を受信してその出力を前記メモリモジュールの中央で両方向に提供するレジスタと、
前記第2クロック信号に連結され、これと位相同期する多数の内部クロック信号を発生させる位相同期回路と、
前記内部クロック信号に各々連結され、これに応答して前記レジスタから出力される前記アドレス信号及び前記コマンド信号を受信する多数のメモリチップとを具備することを特徴とするシステム。 - 前記第1クロック信号、前記第2クロック信号、前記アドレス信号及び前記コマンド信号は、
前記システム内に装着されるメモリコントローラまたはマイクロプロセッサから提供されることを特徴とする請求項16に記載のシステム。 - 前記メモリモジュールは、
前記第1クロック信号及び前記第2クロック信号を受信する2つ以上のモジュールピンを具備することを特徴とする請求項16に記載のシステム。
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