JP4129090B2 - 磁性薄膜メモリ素子および磁性薄膜メモリ - Google Patents
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Description
【発明の属する技術分野】
本発明は熱と磁界により磁化方向を変えることで情報を記録する固体メモリ、すなわち磁性薄膜メモリに関する。
【0002】
【従来の技術】
磁性材料による固体メモリは、古くはフェライトによるコアメモリ、その後、ワイヤメモリ、バブルドメインメモリ、ブロッホラインメモリなどの提案がなされてきたが、金属磁性薄膜による固体メモリとしては磁気抵抗効果メモリMRAM(magnetoresistive random access memory )がある。
【0003】
1972年に磁気抵抗効果膜を固体メモリに利用することがL.J.SchweeによりProc.INTERMAG Conf. IEEE Trans.Magn.,Kyoto,p.405(1972)に報告されたが、出力が低く実用に至らなかった。その後、より大きな出力が得られる巨大磁気抵抗効果が見いだされて、それを利用したMRAMの研究が盛んになり、種々のタイプのMRAMに関する報告がなされている。例えば、榊間らにより日本応用磁気学会誌,20,22(1996)にその一例が報告されており、これによると、そのメモリ素子は、図16(a)に示されるように、書き込み線W、絶縁膜113、ハード磁性膜111、導電膜114、ソフト磁性膜112の積層体から構成されている。このメモリ素子において、図16(a)に示されるように紙面に対し上向きの電流を書き込み線Wに与え、右向きにハード磁性膜111を磁化した状態を『1』、図16(b)に示されるようにその逆を『0』とする。
【0004】
読み出し方法は、図16(c)に示されるように,ハード磁性膜111には影響を及ばさないが、ソフト磁性膜112は反転できる程度の大きさの正負の電流パルスを書き込み線Wに与え、素子に検出電流を通電して確認して、その抵抗変化ΔRが正か負かで『1』『0』を判別する。図16(c)の左側の状態では、正負の電流パルスをかけた後にハード磁性膜111とソフト磁性膜112の磁化の方向が互いに逆になっているので抵抗変化ΔRが正の値となる。図16(c)の右側の状態では、正負の電流パルスをかけた後にハード磁性膜111とソフト磁性膜112の磁化の方向が同一方向となっているので抵抗変化ΔRが負の値となる。
【0005】
このようにGMRによるメモリは、電流の発生する磁界により磁化反転を行うが、読み出しの際にも書き込み線に正負の電流パルスを通電してソフト磁性膜112を反転する必要があり、また抵抗の変化を検出するという複雑な動作が必要であり、読み出し時間が長く、信号処理も複雑である。
【0006】
一方、熱による磁化方向の制御に関しては、例えば、光磁気ディスクに代表されるように熱磁気書き込みが行なわれる。しかしこの場合は記録媒体が回転し、熱源にはレーザを使用し、レーザ自身も光ヘッドに固定されて動くことから、固体メモリではなく、機械的に動作するためアクセスが遅く、振動などに弱いという問題がある。また、熱を利用した固体メモリとしては、特開平4−23293に単層の積層磁化膜を使用した発明が提案されている。それによると、当該固体メモリは、当該公報の第1図に示されるように、加熱素子、磁性薄膜、磁気抵抗素子、書き込み用のスイッチングトランジスタ、読み出し用のトランスファーゲートおよび6本のリード線を備えて構成される。この場合、磁性薄膜は素子分離しておらず、連続状態にある。そして、書き込み時にスイッチングトランジスタにより所定のメモリ素子だけに電流を通電して磁性膜を加熱して磁化方向を反転させる。読み出しは、磁気抵抗素子により磁化の方向を検出するようにする。これには各メモリ素子に半導体材料で形成されるトランスファーゲートが必要であり、加熱手段を考えると磁性膜が連続していることから隣接メモリ素子への影響が無視できず、高密度化が難しいという問題がある。
【0007】
【発明が解決しようとする課題】
本発明は上記従来技術の諸問題を解決するためになされたものであり、その目的は、速い速度で書き込み・消去を行い、さらに高速アクセスを可能とし、読み出し時のSN比が高い不揮発性の磁性薄膜メモリ素子および磁性薄膜メモリを提供することにある。
【0008】
【課題を解決するための手段】
このような課題を解決するために、本発明の磁性薄膜メモリ素子は、所定の間隔を開けて平面配置または積層配置された第1磁性膜および第2磁性膜と、これらの第1磁性膜もしくは第2磁性膜に隣接して配置されるか、または、これらの第1磁性膜と第2磁性膜の間に介在された検出部分と、前記第2磁性膜の磁化方向を反転させるための磁化手段と、前記第2磁性膜の保磁力を減少させるように作用する加熱手段とを備える磁性薄膜メモリ素子であって、前記第1磁性膜の保磁力は、第2磁性膜の保磁力と比較してそれより大きく、かつ予め所定の一方向に磁化されており、前記磁化手段によって、第1磁性膜の磁化は反転しないが、第2磁性膜の磁化は反転できるような磁界を印加し、第2磁性膜の磁化方向を第1磁性膜の磁化の方向とは逆方向に磁化させて消去の状態を作り出し、前記加熱手段によって、第2磁性膜を加熱して一時的に保磁力を減少させるとともに、第1磁性膜による磁界を利用して第2磁性膜の磁化方向を第1磁性膜と同一方向に向かせて書き込みの状態を作り出す、または、前記加熱手段によって、第2磁性膜を加熱して一時的に保磁力を減少させるとともに、第1磁性膜による磁界を利用して第2磁性膜の磁化方向を第1磁性膜と同一方向に向かせて消去の状態を作り出し、前記磁化手段によって、第1磁性膜の磁化は反転しないが、第2磁性膜の磁化は反転できるような磁界を印加し、第2磁性膜の磁化方向を第1磁性膜の磁化の方向とは逆方向に磁化させて書き込みの状態を作り出し、前記第2磁性膜の磁化方向を前記検出部分で検出することで読み出しが行えるようにしてなるように構成される。
【0009】
また、本発明において、前記第1磁性膜および第2磁性膜は、それらの容易磁化軸が膜面内成分を有し、2つの磁性膜が静磁的に結合するように配置されてなるように構成される。
【0010】
また、本発明のより好ましい態様として、前記第1磁性膜、前記検出部分、および前記第2磁性膜が順次、同一平面上にライン状に配置されてなるように構成される。
【0011】
また、本発明のより好ましい態様として、さらにもう一つの第1磁性膜を設け、新たな第1磁性膜と前記第1磁性膜とで前記検出部分、および前記第2磁性膜を挟むように配置してなるように構成される。
【0012】
また、本発明のより好ましい態様として、前記検出部分に磁束を集束するために、第1磁性膜と第2磁性膜の検出部分側の幅を第1磁性膜と第2磁性膜の本体の幅よりも狭くするか、または、検出部分と第1磁性膜の間及び検出部分と第2磁性膜の間に磁束集束のための軟磁性薄膜を配置してなるように構成される。
【0013】
また、本発明のより好ましい態様として、少なくとも前記第1磁性膜および前記第2磁性膜が基板面に積層方向に層状に配置されてなるように構成される。
【0014】
また、本発明のより好ましい態様として、前記検出部分が、磁気抵抗効果素子またはホール素子を用いて構成される。
【0015】
また、本発明のより好ましい態様として、前記加熱手段として、第2磁性膜に隣接して設けた非磁性金属膜からなる加熱部を用い、それに電流を流すことにより非磁性金属膜および第2磁性膜を加熱するように構成される。
【0016】
また、本発明のより好ましい態様として、前記磁化手段としては、第2磁性膜に隣接して設けた非磁性金属膜を用い、それに電流を流すことにより発生する磁界により第2磁性膜の磁化を反転させてなるように構成される。
【0017】
また、本発明のより好ましい態様として、前記加熱部として第2磁性膜そのものを兼用させ、それに電流を流すことにより第2磁性膜を加熱してなるように構成される。
【0018】
また、本発明の磁性薄膜メモリは、上記の磁性薄膜メモリ素子をマトリクス状に配列した記憶素子部分と、直交する2本の書き込み線および直交する2本の読み出し線を備え、縦又は横方向に並べられた前記磁性薄膜メモリ素子のそれぞれが、直交する2本の書き込み線および直交する2本の読み出し線に接続されるように構成される。
【0019】
また、本発明の磁性薄膜メモリは、上記の磁性薄膜メモリ素子をマトリクス状に配列した記憶素子部分と、直交する2本の書き込み線および1本の読み出し線を備え、縦又は横方向に並べられた前記磁性薄膜メモリ素子のそれぞれが、直交する2本の書き込み線および1本の読み出し線に接続され、書き込み線の1本が読み出し線を兼ねるように構成される。
【0020】
また、磁性薄膜メモリの好ましい態様として、隣り合うメモリ素子の第1磁性膜が連続膜で形成されるよう構成される。
【0021】
本発明の磁性薄膜メモリ素子は、第2磁性膜のみを加熱するとその保磁力、磁気異方性が低下して、隣接する第1磁性膜による磁界により第1磁性膜と同じ方向に磁化が向く。ここにおいて、2つの磁性膜の磁化方向が互いに平行か反平行かにより両者間に発生する磁界分布が異なり、これらの両磁性膜間に配置した磁気検出素子で検知するもので、2つの磁性膜を有することは磁界の大きさだけで両者の違いを検知できるのがメリットである。また、熱の発生、磁界の発生はすべて電気信号だけで行うことも可能であるため高速な書き込み・消去が可能である。特に加熱による書き込みは磁界によるそれと比較して、周辺の磁性体への磁界による影響が無く、高密度な集積が可能となる。
【0022】
このような本発明により、情報の高速な書き込み・消去が可能で機械的な動作を必要としない不揮発性の磁気薄膜固体メモリを実現することができる。
【0023】
【発明の実施の形態】
以下、本発明の磁性薄膜メモリ素子の実施の形態について詳細に説明する。
【0024】
本発明の磁性薄膜メモリ素子は、(1)平面配置タイプの磁性薄膜メモリ素子と、(2)積層配置タイプの磁性薄膜メモリ素子に大別でき、まず最初に(1)平面配置タイプの素子について説明する。
【0025】
(1)平面配置タイプの磁性薄膜メモリ素子
図1は、平面配置タイプの磁性薄膜メモリ素子1の概略平面図を示しており、図2は、図1のA−A断面矢視図を示している。このタイプの素子は、メモリ形成の微細加工において、各構成部分を個別に制御でき、設計・製造上の利点がある。
【0026】
これらの図に示されるように、絶縁基板5の上には、第1磁性膜11、検出部分40、第2磁性膜20、および第1磁性膜15が順次、ライン状に配置されている。さらに、本実施の形態の場合、第2磁性膜の上には、絶縁層50を介して加熱手段である加熱部30が積層され(図2)、この加熱部30および前記検出部分40には、それぞれ、加熱リード線39,39および検出リード線49,49が接続されている。
【0027】
この実施例の形態においては、検出部分40を挟むように配置される第1磁性膜11の他に、検出部分40側に位置せず、第2磁性膜20を挟むようにして配置される第1磁性膜15が配置されている。第1磁性膜15は必ず必要というわけではないが、第2磁性膜20の磁化反転を容易ならしめる(第1磁性膜により高い安定した磁界を第2磁性膜に与えることができる)ためには、できるだけ第1磁性膜15を形成しておくことが望ましい。
【0028】
本発明において、第1磁性膜11,15の保磁力は、第2磁性膜20の保磁力と比較してそれより大きくなるように材料設定されており、かつ第1磁性膜11,15の磁化方向は、図1の矢印(α)で示されるように予め所定の一方向に面内磁化されている。
【0029】
第1磁性膜11,15および第2磁性膜20の形成方法は特に限定されることなく、例えば、磁性粉末とバインダを含有する磁性塗料を塗布して形成してもよいし、真空成膜法により磁性金属薄膜として形成してもよいし、また、湿式メッキ法により形成したものであってもよい。
【0030】
本発明において、検出部分40を挟むように配置される第1磁性膜11および第2磁性膜20は、それらの容易磁化軸が膜面内成分を有し、2つの磁性膜が静磁的に結合するように配置される。これにより、対向する第1磁性膜11および第2磁性膜20の端部における磁界の変化を検出部分40で検出することが容易に可能となる。ちなみに先行技術との比較になるが、光磁気ディスクのように磁化容易軸成分が膜面に積層方向に有る場合は、反磁界の面から制御が難しく、使用できる材料も制限される。これに対して本発明で用いる磁性膜では、形状異方性と同じ方向に磁化容易軸成分があり材料選択の幅が広くなるというメリットがある。
【0031】
加熱手段としての加熱部(好ましくは非磁性金属膜から形成される)30の材料としては、加熱リード線39,39に通電することにより、加熱部30を発熱させて、第2磁性膜20の温度を上げ、第2磁性膜20の保磁力を減少させるように作用させることができるものであれば特に限定されるものではない。
【0032】
なお、図7に示されるように、加熱手段としての加熱部30を設けず、直接、第2磁性膜20にリード線29,29を配し、これに通電して第2磁性膜20そのものを加熱するようにしてもよい。このように第2磁性膜20を瞬間的に加熱する方法は、電流によるジュール熱を利用しており、発熱体として第2磁性膜20に密接して形成される加熱部(非磁性金属膜)30に電流を流すか、第2磁性膜20自身に電流を流すことにより熱を発生させる。
【0033】
検出部分40は、後述する動作原理から磁界を検出できる素子であればどのようなものでも使用できる。例えば、サーチコイルなどでも良いが、検知感度の面および製造面から磁気抵抗効果素子あるいはホール素子を用いることが特に好ましい。
【0034】
ここで磁気抵抗効果素子としては、異方性磁気抵抗効果、スピンバルブタイプの巨大磁気抵抗効果、誘導フェリ磁性タイプの巨大磁気抵抗効果、反強磁性結合タイプの巨大磁気抵抗効果、磁気トンネリングによる巨大磁気抵抗効果(TMR)、ペロブスカイト型酸化物によるコロッサル磁気抵抗効果(CMR)、ホットエレクトロンによるスピンバルブトランジスタの巨大磁気抵抗効果などによる磁気抵抗効果素子が好適例として挙げられる。
【0035】
なお、磁化手段としては、第2磁性膜20の磁化方向を反転制御して書き込みや、消去の状態を作りだせるものであれば、特に限定されないが、図5(a),(b)に示されるように、加熱リード線39,39に流す電流によって発生する磁界を利用して第2磁性膜20の磁化を反転制御させる方法が好適である。図5(a)は、図1の第2磁性膜20の箇所をピックアップした平面図、図5(b)は、図5(a)のB−B断面断面矢視図であり、図5(b)において、電流方向は紙面の手前から奥行きに流れている。この場合、加熱リード線39,39に流れる電流は小さくしかも短時間であるので加熱部30の発熱による磁化への影響は起きない。磁化手段は上述したように原理上、磁界を発生できるものなら何でも良く、たとえば永久磁石や磁気ヘッドでも使用可能である。しかしながら、これらは可動部分が必要で固体メモリの構成には好ましくなく、電気的に処理できる図5に示される構成が特に優れている。
【0036】
図1および図2に示される本発明の磁性薄膜メモリ素子1は、磁化手段および加熱手段により第2磁性膜20の磁化方向を反転制御して書き込みおよび消去の状態を作りだし、前記第1磁性膜11と第2磁性膜20の間に生じる磁界変化を前記検出部分40で検出することで読み出しが行えるように構成されている。これについては、図3および図4を用いて磁性薄膜メモリ素子の動作原理としてさらに詳細に説明する。
【0037】
磁性薄膜メモリ素子の動作原理
本発明の磁性薄膜メモリ素子の動作原理を、すでに上述した平面配置タイプの磁性薄膜メモリ素子1を例にとって、図3および図4を用いて説明する。
【0038】
書き込みの方法は、「熱書き込み」と「磁界書き込み」の2つの方法がある。図3(a)〜(d)は、「熱書き込み」の場合における、(a)消去の状態、(b)加熱による書き込み操作、(c)書き込みの状態、および(d)磁界印加による消去操作を、順次経時的に示した図である。これらの各状態および操作は、連続的に繰り返し行なうことができる。
【0039】
本発明で言う「熱書き込み」の場合、図3(d)で示されるようにメモリ素子1に、第1磁性膜11,15の磁化(磁化方向は矢印(α))は反転しないが、第2磁性膜20の磁化は反転できるような磁界を磁化手段により印加し、第2磁性膜の磁化方向を第1磁性膜の磁化の方向とは逆方向(矢印(β))に磁化させる。
【0040】
この操作を、磁界印加による消去操作と言い、その結果として生じる図3(a)の状態を「消去」状態という。
【0041】
ここで、個々のメモリを独立に消去する場合は、上記図5(a)(b)に示されるように加熱リード線39,39(作用的には、書き込み線として作用するように電流の大きさおよび通電時間を選定する)に流す電流によって発生する磁界により、第2磁性膜20の磁化をβ方向に反転させ消去する。その際、電流はごく短時間だけ流れるので熱発生等の悪影響は生じない。
【0042】
また、全ての書き込まれた記憶を一度に消去する場合は、電磁石や永久磁石の磁界を使用することもできる。この場合、第2磁性膜20のみの磁化方向を反転させる((β)方向にする)必要があり、この場合、第1磁性膜の保磁力は、第2磁性膜の保磁力より大きく設定しておく必要がある。
【0043】
次に、図3(b)に示されるように第2磁性膜20を、加熱部30を発熱させることにより、ある一定の温度以上に瞬間的に加熱して一時的に保磁力を減少させるとともに、第1磁性膜11,15による磁界を利用して第2磁性膜20の磁化方向を第1磁性膜11,15と同一方向((α)方向)に向かせる。この操作を加熱による書き込み操作と言い、その結果生じる図3(c)の状態を「書き込み」の状態と言う。
【0044】
本発明の場合、「消去」状態では第1磁性膜11(15)と第2磁性膜20の磁化の方向が異なる状態にあり(図3(a))、また、「書き込み」状態では第1磁性膜11(15)と第2磁性膜20の磁化方向が同じ状態にある(図3(c))。そして、これらの状態変化を、第1磁性膜11と第2磁性膜20の間に置かれた検出部分40によって磁界変化として検出することで、書き込み・消去を判別することができる。従って、従来技術ですでに説明したMRAMのように、書き込みの時に2本の書き込み線の電流による合成磁界で磁化反転を制御したり、読み出しの時にワード線に電流を流してMR素子の磁化方向を制御したり、正負のパルス電流を印可して磁化の方向を判別したりする必要がなく、非常に信号処理を単純化できることが本発明の特徴となっている。
【0045】
次ぎに、「磁界書き込み」の方法について説明する。図4(a)〜(d)は、「磁界書き込み」の場合における、(a)消去の状態、(b)磁界印加による書き込み操作、(c)書き込みの状態、および(d)加熱による消去操作を、順次経時的に示した図である。これらの各状態および操作は、連続的に繰り返し行なうことができる。
【0046】
このような「磁界書き込み」は、すでに述べた「熱書き込み」における消去と書き込みの状態を逆に設定したものと考えればよい。つまり、図4(d)に示されるように、瞬間的な加熱により第1磁性膜11,15と第2磁性膜20の磁化方向を同じ((α)方向の磁化)にする操作が加熱による消去操作であり、その結果生じた「消去」の状態が図4(a)に示される。
【0047】
この「消去」状態から、磁界を第2磁性膜20に印加して、第2磁性膜2の磁化方向を第1磁性膜11,15の磁化方向(矢印α)と逆方向(矢印β)に反転させる操作(図4(b))が、磁界印加による書き込み操作となる。ここで書き込み操作は、例えば、図5(a),(b)に示されるように加熱リード線39,39(作用的には、書き込み線として作用するように電流の大きさおよび通電時間を選定する)に流す電流によって発生する磁界で第2磁性膜20の磁化をβ方向に反転させて書き込むようにすればよい。その際、電流は短時間であるので温度上昇による磁化の反転は起きない。それより長い時間、電流を加熱リード線39,39に流して加熱部30を加熱すると消去される(図4(d),(a))。なお、検出部分40による読み出しは、上記の熱書き込みの場合と同様に行われる。
【0048】
上述してきたようにメモリ素子を基板面に平面的に配置する場合(平面配置タイプの場合)、図6(a)に示されるように、検出部分40に磁束を集束するために、第1磁性膜11および第2磁性膜20の検出部分側11aおよび20aの幅をそれぞれ狭くするか、あるいは、図6(b)に示されるように検出部分40と第1磁性膜11の間、及び検出部分40と第2磁性膜20の間に磁束集束のための軟磁性薄膜18および28(ヨークを形成)をそれぞれ第1磁性膜11および第2磁性膜20の端部と接して配置するように構成することが好ましい。このように検出部分40近傍で磁束を集束させることにより大きな磁界の変化が得られる。
【0049】
次いで、(2)積層配置タイプの素子について説明する。
【0050】
(2)積層配置タイプの磁性薄膜メモリ素子
この場合、交換結合が生じることを防ぐために、あるいは電気的な絶縁を確保するために、必要に応じて絶縁膜を各層間に成膜する必要がある。
【0051】
図8には、積層配置タイプの磁性薄膜メモリ素子2の好適な一例が断面図として示されている。
【0052】
図8(a)に示されるように、基板5に第1磁性膜11、検出部分40、絶縁膜60、第2磁性層20、絶縁膜50、加熱部30の順に配置されるか、あるいは、図8(b)に示されるように、基板5に検出部分40、絶縁膜70、第1磁性膜11、絶縁膜60、第2磁性膜20、絶縁膜50、加熱部30の順に配置される。この場合においても、第1磁性膜11および第2磁性膜20は、それらの容易磁化軸が面内成分を有し、2つの磁性膜11,12が静磁的に結合するように積層配置されている。図8に示されるように検出部分40は、第1磁性膜11の長さ方向の一端に偏った端部に配置することが好ましい。良好な検出感度を得るためである。
【0053】
図8(c)には、図8(b)の変形例が示されている。図8(c)に示される実施の形態の場合、発熱体として加熱部を設けず、直接、第2磁性膜20にリード線29,29を配し、これに通電して第2磁性膜20そのものを加熱するようにしている。
【0054】
このような積層配置タイプの磁性薄膜メモリ素子においても、磁性薄膜メモリ素子の動作原理は前記の平面配置タイプの磁性薄膜メモリ素子の場合と全く同様である、つまり、第2磁性膜20の磁化の反転は、上記の平面配置タイプの磁性薄膜メモリ素子と全く同様の方法でなされる。ただし、前述したように読み出しの場合は、より大きな磁界変化を得るために、検出部分40の位置は磁性膜の中央よりは、むしろ端部に近いところに設置することが望ましい。
【0055】
上述してきたように、メモリ素子の各部分は基板上に平面的に配置しても、また基板に積層方向に層状に配置しても良い。前者は、各素子を独立に形成できることから製造上のプロセス制御が容易となるというメリットがあり、後者は、高密度化の点で有利であるというメリットがある。
【0056】
次に、上述してきたようなメモリ素子を、マトリクス状に配列させた磁性薄膜メモリについて、図9〜図15を参照しつつ説明する。
【0057】
図9は、本発明の磁性薄膜メモリの基本構成を示す概略図であり、図10は、基板面に平面的に配置したメモリ素子の具体的接続方法を示した図である。
【0058】
図9に示されるように、複数のメモリ素子M11〜M22が基板上にマトリクス状に配置され、記憶素子部分を構成する。そして、図9に示されるように一個のメモリ素子に対して直交する2本の書き込み線と直交する2本の読み出し線がそれぞれ配置される。
【0059】
具体的には、メモリ素子M11に対しては直交する2本の書き込み線W01,W10と、直交する2本の読み出し線R01,R10が配置され;メモリ素子M12に対しては直交する2本の書き込み線W02,W10と、直交する2本の読み出し線R02,R10が配置され;メモリ素子M21に対しては直交する2本の書き込み線W01,W20と、直交する2本の読み出し線R01,R20が配置され;メモリ素子M22に対しては直交する2本の書き込み線W02,W20と、直交する2本の読み出し線R02,R20が配置される。これらの配置からもわかるように、格子状に配置される各書き込み線と各読み出し線は、メモリ素子に対して効率良く共用されている。
【0060】
より具体的には、図10に示されるように、2本の書き込み線は、第2磁性膜20の加熱のための電流供給、および第2磁性膜20の磁化反転に必要な磁界を発生するための電流供給に使用され、また、2本の読み出し線は検出部分40に接続され、第2磁性膜20の磁化方向により異なる発生磁界を電気的に検出するように使用される。具体的に、例えば図10のM11に相当するメモリ素子(左上に位置する)の書き込み・消去には、加熱部30に接続されている書き込み線W10,W01の両端に電圧を印加し電流を流して加熱部30を加熱し、第2磁性膜20の磁化を反転させる。読み出しは、検出部分40に接続されている読み出し線のR10,R01に検出電流を流し、両端電圧の差で、『1』、『0』を判別する。
【0061】
また、同様の効果を図11から図15で示される構成でも得ることが可能である。すなわち、図11に示されるように、一個のメモリ素子(例えば、図11の左上の素子)対して、直交する2本の書き込み線W01,W10と、1本の読み出し線R01から構成し、2本の書き込み線のうち片側1本W10を読み出し線(R10)として兼用することが可能である。
【0062】
図12に示される構成は、前記図10に示される構成と基本的な構成は変わらないが、メモリ素子を格子状の配線に対し斜めに配置した点でのみ異なる。
【0063】
図13は、基板面に積層方向に各部分を配置した積層配置タイプの磁性薄膜メモリ素子を用いた例である。なお、第1磁性膜11は、最下層に位置しているために、図面上、第2磁性膜20に覆われ見えていない。
【0064】
図14に示される構成は、発熱体として加熱部を設けず、直接、第2磁性膜20に2本の書き込み線(例えば、W01,W10)を配し、これに通電して第2磁性膜20そのものを加熱するようにしている例を示している。
【0065】
図15に示される構成は、前記図10に示される第1磁性膜11を連続膜として形成した例である。この場合、第1磁性膜11の形成が容易であり、また平行に近い磁界を発生することが可能である。
【0066】
以上このようにして形成される磁性薄膜メモリ(図9〜図15)は、書き込み・消去および読み出しの動作が単純であり、その前後の信号処理も容易である。換言すれば、本発明の磁性薄膜メモリは、その構成が非常に単純であり、個々のメモリ素子に半導体素子であるトランスファゲートやスイッチング素子は必要としない(もちろんそれらを使用してもメモリの構成は可能である)。
【0067】
なお、当然のことながらホール素子を検出部分に使用する場合は、書き込み線と読み出し線以外にホール素子に電流供給線が必要になるが、記録の読み書きには直接関係ないので、ここでの説明は省略する。
【0068】
【実施例】
以下に本発明の実施例を示し、本発明をさらに詳細に説明する。
【0069】
[実施例1]
実施例1では、基板面上に平面的に配置したメモリ素子による熱書き込みの実験を行った。
【0070】
図1に示されるように、まず最初に、コーニング製7059ガラス基板の上に、膜厚25nm、大きさ50μm×10μmのNiFeの磁気抵抗素子による検出部分をスッパッタ法で設けた。この場合、NiFe膜の容易磁化軸方向が、その長さ方向(後に形成される第1および第2磁性膜の長さ方向に対して垂直な方向)になるように磁気異方性を付与した。
【0071】
次いで、この検出部分と、後に形成する第2磁性膜のスペース分を考慮し、これらを挟むようにして両側に、Baフェライトと樹脂との混合物からなる第1磁性膜を2箇所、塗布法により成膜した。第1磁性膜の膜厚は10μmで、大きさは50μm×150μmとした。
【0072】
次いで、膜厚10μm、大きさ50μm×150μmのCrO2 粒子と樹脂の混合物からなる第2磁性膜を塗布法により形成した。ここでは第2磁性膜として第1磁性膜より保磁力の低い材料を使用した。第1磁性膜、第2磁性膜ともに長さ方向が磁化容易軸になるようにした。
【0073】
次いで、第2磁性膜の上に、厚さ0.1μmのSiO2 からなる絶縁層をスパッタ法で形成させた後、さらにこの上に厚さ1μm、大きさ50μm×150μmのNiCrからなる加熱部(加熱手段)をスパッタ法により成膜した。その後、上記の検出部分の両端と、加熱部(加熱手段)の両端に、それぞれ、リード線を接続した。
【0074】
このようにして形成されたメモリ素子の3つの磁性膜(2つの第1磁性膜、1つの第2磁性膜)の長さ方向に2kOeの磁界を印加し、磁性膜の配列方向に全ての磁性膜を磁化させた。
【0075】
このようにして作製した磁性薄膜メモリ素子のサンプルを用い、下記の手順に従い、メモり素子としての機能の確認を行った。すなわち、まず、最初に図3(d)に示されるように永久磁石により第1磁性膜の磁化方向と逆方向に200Oeの磁界を与え、第2磁性膜の磁化方向を第1磁性膜と逆方向とした。この状態が「消去」の状態であり、その状態が図3(a)に示される。
【0076】
この状態で検出部分に1mAの電流を通電すると、検出部分の両端電圧は50mVであった。
【0077】
次に、図3(b)に示されるように第2磁性膜の上の加熱部(加熱手段)に10mAの電流を1.5秒間通電して加熱した。図3(c)に示されるように通電のあとに冷却すると第2磁性膜の磁化方向が、第1磁性膜の磁界方向と同一方向となった。この状態で検出部分の両端電圧は49mVに低下した。この状態が「書き込み」の状態である。このように検出部分の電圧の違いで、『0』,『1』を判別できることが確認できた。
【0078】
次に、「書き込み」の状態から「消去」状態にするために、図3(d)に示されるように永久磁石により第1磁性膜の磁化方向と逆方向に200Oeの磁界を印加したところ、第2磁性膜の磁化方向のみを第1磁性膜と逆方向とすることが実現でき、メモリ素子としての十分な機能を備えていることが確認できた。
【0079】
[実施例2]
実施例2では、実施例1の酸化物系の磁性膜に代えて金属膜を使用した。すなわち、第1磁性膜はスパッタ法による膜厚2μmのCoPt、第2磁性膜はめっき法により膜厚1μmのCoPを使用した。それ以外は上記実施例1と同様にして実施例2の磁性薄膜メモリ素子のサンプルを作製した。そして、上記実施例1と同様の機能確認実験を行なったところ、実施例1の場合と同様の結果が得られることが確認できた。
【0080】
[実施例3]
実施例3では、基板面上に平面的に配置したメモリ素子による熱書き込み方式において、「書き込み」状態から「消去」状態に変える場合に、磁界の印加を電流通電で行えることを確認した。メモリ素子の構造は基本的には上記実施例2と同様であるが、第2磁性膜を磁化するために十分な磁界を得るためには第2磁性膜の長さ方向の寸法を小さくする必要がある。従って、第1磁性膜と加熱部の大きさを5μm×15μm、厚み2μm;第2磁性膜の大きさを5μm×15μm、厚み1μm;そして検出部分の大きさを5μm×2μmとした。書き込みは10mAの電流を15ミリ秒間の通電による加熱により行った。「書き込み」状態にするところまでは上記実施例1と同様であるが、第2磁性膜を第1磁性膜の磁化方向と逆方向にする方法が異なる。すなわち、磁界は図5(a),(b)に示されるように加熱部(加熱手段)に電流を流すことで発生させることができ、局部的な磁化反転を可能にさせる。本実施例では加熱部(加熱手段)に250mAの電流を1マイクロ秒通電させた。短時間であることから温度上昇は小さく、電流によって発生する磁界のみにより、第2磁性膜の磁化方向が第1磁性膜と逆方向となり、「消去」の状態が得られることが確認できた。
【0081】
また、永久磁石により第2磁性膜の磁化方向を第1磁性膜と逆方向とし「消去」の状態とした後に、加熱部に250mAの電流を1マイクロ秒間通電させた。ただし、電流の方向は、上記電流によって発生する磁界のみにより消去を行ったときの方向と逆方向とした。通電は短時間であることから温度上昇は小さく電流によって発生する磁界のみにより第2磁性膜の磁化方向が、第1磁性膜の磁化方向と同方向となり、「書き込み」の状態が得られることが確認できた。
【0082】
[実施例4]
実施例4では、基板面上に平面的に配置したメモリ素子による磁界書き込み方式の実験を行った。メモリ素子の構造は実施例1と同じである。
【0083】
最初に、形成されたメモリ素子の磁性膜の長さ方向に2kOeの磁界を印加し、磁性膜の配列方向に全ての磁性膜を磁化させた。
【0084】
このようにして作製した磁性薄膜メモリ素子のサンプルを用い、下記の手順に従い、メモり素子としての機能の確認を行った。すなわち、まず、最初に図4(d)に示されるように第2磁性膜の上の形成された加熱部(加熱手段)に10mA、1.5秒間電流を通電して加熱した。その後、冷却した状態が「消去」の状態であり、その状態が図4(a)に示される。この状態で検出部分に1mAの電流を通電したところ検出部分の両端電圧は49mVであった。
【0085】
次に、図4(b)に示されるように永久磁石により第2磁性膜の磁化方向を第1磁性膜の磁化方向の逆方向に反転させた。検出部分の両端電圧は50mVに上昇した。これは第2磁性膜の磁化が反転したことを示しており、この状態が「書き込み」の状態であり、その状態が図4(c)に示されれる。このように検出部分の両端電圧の違いで、『0』,『1』を判別できることが確認できた。
【0086】
次に、「書き込み」の状態から「消去」の状態にするために、再び、加熱部に10mAの電流を1.5秒間通電させたところ、第2磁性膜の磁界方向が第1磁性膜の磁界方向と同方向となり、「消去」状態が得られた。これにより、本発明サンプルは、メモリ素子としての十分な機能を備えていることが確認できた。
【0087】
[実施例5]
実施例5は第2磁性膜に磁化反転のために直接電流を通電して加熱を行う実験、すなわち、第2磁性膜に加熱部(加熱手段)としての機能を兼用させた実験を行った。
【0088】
メモリ素子構造としては、実施例1において加熱部の成膜を行わず、図7に示されるように、直接、第2磁性膜にリード線を接続した。この場合、第2磁性膜のCrO2 粒子と樹脂にカーボン粉末を混合し、電気抵抗を調整した。それ以外は、上記実施例1と同様にして実施例5の磁性薄膜メモリ素子のサンプルを作製した。そして、上記実施例1と同様の機能確認実験を行なったところ、実施例1の場合と同様の結果が得られることが確認できた。ちなみに、第2磁性膜を加熱させる場合には、10mAの電流を10ミリ秒間、直接第2磁性膜に通電することにより、第2磁性膜の磁化を反転させることができた。
【0089】
[実施例6]
実施例6では、上記実施例1において検出部分として用いたNiFeの磁気抵抗効果素子を、GMR(巨大磁気抵抗効果)を示す素子に代えた実験を行った。
【0090】
実施例1のNiFe膜の代わりに、GMR特性を持つFeCoNi/Cu多層膜を成膜させた。すなわち、RFスパッタ装置によりFeNiCoを1.5nm,Cuを2.0nm交互に20層積層した。これ以外は、上記実施例1と同様にして実施例6の磁性薄膜メモリ素子のサンプルを作製した。この実施例6における検出部分を用いた場合、検出電流1mAに対し、検出部分の両端電圧は「消去」の状態で20mV、「書き込み」の状態で19mVとなり、検出部分をNiFeとした場合よりも大きな変化率が得られることが確認できた。
【0091】
[実施例7]
実施例7では、検出部分に磁束を集束させ、より感度を向上させるための実験を行った。すなわち、実施例1の素子構造において、図6(a)に示されるように第1および第2磁性膜の検出部分側の幅を狭くした。それ以外は、上記実施例1と同様にして実施例7の磁性薄膜メモリ素子のサンプルを作製した。狭くしなかった実施例1の場合と比較し、出力電圧が約10%の上昇することが確認できた。なお、この場合、検出部分の寸法は変えず、磁性膜の基本幅を50μmから100μmに広げ、長さも300μmとし、磁性膜の検出部分側の幅を50μmに絞った。
【0092】
また、図6(b)に示されるように、上辺/下辺の比が1/2とした軟磁性を持つ膜厚1μmの(NiFe)膜を第1および第2磁性膜と検出部分との間に成膜して、磁束集束のためのヨークとした。この場合、ヨークの無い場合と比較して約12%検出電圧が上昇した。この実施の際、検出部分の寸法は変えず、各磁性膜の寸法は幅を50μmから100μmに広げ、長さも150μmから300μmとした。またヨークは上辺50μm、下辺100μm、高さ50μmの台形とした。
【0093】
[実施例8]
実施例8では、磁性薄膜メモリ素子の各部分が基板面に対し垂直方向に層状に配置されたいわゆる積層配置タイプの素子での実験を行った。
【0094】
ここでは、実施例1の、基板面に対し平面的に各部分を配置した構造で実現した性能と同様の性能を得ることを目標にメモリ素子を作製した。その構造図が図8(b)に示される。ただし、本実施例では、InSb膜によるホール効果素子を検出部分として用いた。
【0095】
図8(b)に示されるように、まず最初に、マイカ基板の上に、蒸着法による膜厚1μmのInSb膜により検出部分を形成した。この場合、検出部分の位置は両磁性膜の長さ方向の一端に偏って配置させた。その上にフォトレジスト材料による絶縁膜を介してCoPtからなる第1磁性膜をスパッタ法で成膜した。第1磁性膜の膜厚は2μmで大きさは50μm×150μmとした。
【0096】
次に、この第1磁性膜の上にフォトレジスト材料により膜厚5μmの絶縁膜を形成した。次いで、この絶縁膜の上に、CoPからなる膜厚1μmの第2磁性膜をめっき法で形成した。大きさは50μm×150μmmの長方形とした。
【0097】
次いで、第2磁性膜の上に、フォトレジスト材料により絶縁膜を形成させた。第1磁性膜、第2磁性膜ともに長さ方向が磁化容易軸になるようにした。第2磁性膜の上に、上記絶縁層を介して、厚さ1μm、大きさ50μm×150μmのNiCrからなる加熱部(加熱手段)をスパッタ法により成膜した。その後、検出部分の両端と加熱部の両端に、それぞれ、リード線を接続した。
【0098】
このようにして形成されたメモリ素子の磁性膜の長さ方向に2kOeの磁界を印加し、磁性膜の長さ方向に全ての磁性膜を磁化させた(「消去」の状態)。
【0099】
このようにして作製した磁性薄膜メモリ素子のサンプルを用い、下記の手順に従い、メモり素子としての機能の確認を行った。すなわち、まず、最初に「消去」の状態でホール素子に1Vの入力を与え、0.1mVの出力を得た。
【0100】
次に、第2磁性膜の上の加熱部に10mA、1秒間の電流を通電して加熱し、冷却後の磁界を測定した結果、3mVに上昇した。この状態が「書き込み」の状態である。
【0101】
次に、第1磁性膜の磁化方向に400Oeの磁界を印加したところ、第2磁性膜の磁化方向を第1磁性膜のそれと同じ方向に向けることができ、「消去」の状態に戻せることが確認できた。
【0102】
このように検出部分の両端電圧の違いで、『0』,『1』を判別でき、メモリ素子としての十分な機能を備えていることが確認できた。
【0103】
[実施例9]
これまで個々のメモリ素子の構造、作製方法、機能の方法の実施例を示してきたが、実施例9では、それらをマトリクス状に配置した磁性薄膜メモリでの実験を行った。
【0104】
基本動作確認のために、図9に示されるごとくマトリクス構成としては最も簡単な縦2列、横2列合計4個のメモリ素子のそれぞれに対して、2本の直交する書き込み線と、それに平行する2本の読み出し線を設けた。すなわち、厚さ20μmのCuを蒸着法によりそれぞれ成膜した。書き込み線の幅は100μm、読み込み線は30μmとした。各メモリ素子の加熱部の各一端を2本の書き込み線にそれぞれ接続させた。またメモリ素子の検出部分の各一端を2本の書き込み線にそれぞれ接続させた。
【0105】
メモリ素子と各線との接続状態は図10に示されるとおりとした。次に、図9のM21のメモリ素子を代表させてメモリの機能を確認した。書き込み方式は熱書き込みで実施例1のメモリ素子を使用した。書き込みは、書き込み線W20,W01の各一端に電圧を印加し電流10mAを1.5秒間通電した。これによりM21のメモリ素子のみ磁化反転が起こり、読み出し線のR20,R01の各一端の間の電圧のみ検出電流1mAに対し49mVで、他の全ての組み合わせは50mVであった。
【0106】
また、その後、この磁気薄膜メモリに永久磁石で200Oeの磁界を第1磁性膜の磁化方向とは逆方向に印加し、R20,R01間に1mAの検出電流を通電すると両端電圧は50mVとなり、消去されていることが確認できた。
【0107】
この動作は他の位置のメモリ素子でも同様であった。
【0108】
[実施例10]
図11に示される磁気薄膜メモリの構成、すなわち、読み出し線を各メモリ素子に対し1本だけを設け、それに直交する書き込み線をもう一方向の読み出し線として兼用に使ったメモリを作製し、上記実施例9と同様にして動作確認を行った。その結果、上記実施例9の場合と全く同様の動作ができることが確認できた。
【0109】
[実施例11]
図12に示される磁気薄膜メモリの構成、すなわち、実施例1の素子を配線に対して、斜めに配置したメモリを作製し、上記実施例9と同様にして動作確認を行った。設計の都合上、第1磁性膜の長さは300μmとしたが、上記実施例9の場合と全く同様の結果が得られた。
【0110】
[実施例12]
図13に示される磁気薄膜メモリの構成、すなわち上記実施例8の積層配置タイプのメモリ素子を使用してこのものをマトリクス状に配置して磁気薄膜メモリを作製した。この場合も、実施例8から期待される結果をそのまま確認することができ、メモリとしても上記実施例9の場合と同様の結果が得られることが確認できた。
【0111】
[実施例13]
図14に示される磁気薄膜メモリの構成、すなわち、第2磁性膜に加熱手段としての機能をも兼用させた磁気薄膜メモリを作製した。この場合も、実施例5から期待される結果をそのまま確認することができ、メモリとしても上記実施例9の場合と同様の結果が得られることが確認できた。
【0112】
[実施例14]
図15に示される磁気薄膜メモリの構成、すなわち図10の隣り合う第1磁性膜を連続膜として磁気薄膜メモリを作製し、上記実施例9と同様にして動作確認を行った。その結果、上記実施例9の場合と全く同様の動作が行なえることが確認できた。
【0113】
【発明の効果】
上記の結果より本発明の効果は明らかである。すなわち、本発明の磁性薄膜メモリ素子は、所定の間隔を開けて平面配置または積層配置された第1磁性膜および第2磁性膜と、これらの第1磁性膜もしくは第2磁性膜に隣接して配置されるか、または、これらの第1磁性膜と第2磁性膜の間に介在された検出部分と、前記第2磁性膜の磁化方向を反転させるための磁化手段と、前記第2磁性膜の保磁力を減少させるように作用する加熱手段とを備え、前記第1磁性膜の保磁力は、第2磁性膜の保磁力と比較してそれより大きく、かつ予め所定の一方向に磁化されており、前記磁化手段および加熱手段により第2磁性膜の磁化方向を反転制御して書き込みおよび消去の状態を作りだし、前記第2磁性膜の磁化方向を前記検出部分で検出することで読み出しが行えるように構成しており、これを用いた本発明にかかる薄膜磁気メモリは、上記に説明したように不揮発性の磁気薄膜固体メモリであり、情報の高速な書き込み・消去が可能で機械的な動作を必要としないという極めて優れた効果を発揮する。
【図面の簡単な説明】
【図1】平面配置タイプの磁性薄膜メモリ素子の概略平面図である。
【図2】図1のA−A断面矢視図である。
【図3】(a)〜(d)は、それぞれ、磁性薄膜メモリ素子の動作原理(熱書き込み)を経時的に説明するための平面図である。
【図4】(a)〜(d)は、それぞれ、磁性薄膜メモリ素子の動作原理(磁界書き込み)を経時的に説明するための平面図である。
【図5】(a)は、電流により第2磁性膜を磁化反転させる実施形態を示す平面図であり、(b)は、その断面図である。
【図6】(a),(b)は、それぞれ検出部分における磁束集束の好適な一態様を示すメモリ素子の平面図である。
【図7】第2磁性膜の加熱を、第2磁性膜に直接通電して行う場合の実施形態を示すメモリ素子の平面図である。
【図8】(a),(b),(c)は、それぞれ本発明の基板面に垂直方向に各部分を層状に配置した積層配置タイプのメモリ素子の断面状態を示す図面である。
【図9】本発明の磁性薄膜メモリの概略基本構成図である。
【図10】本発明の基板面に平面的に配置したメモリ素子を用いた磁性薄膜メモリの概略構成図である。
【図11】読み出し線を1本とし、2本の書き込み線の1本を読み出し線として兼用する場合の磁性薄膜メモリの概略構成図である。
【図12】本発明の基板面に平面的に配置したメモリ素子を斜めに配置した場合の磁性薄膜メモリの概略構成図である。
【図13】本発明の基板面に対し垂直方向に各部分を積層した積層配置タイプのメモリ素子を用いた磁性薄膜メモリの概略構成図である。
【図14】本発明の第2磁性膜に直接通電するタイプのメモリ素子を用いた磁性薄膜メモリの概略構成図である。
【図15】本発明メモリ素子の第1磁性膜が連続に形成された磁性薄膜メモリの概略構成図である。
【図16】従来技術であるMRAMの動作原理を説明するために図面である。
【符号の説明】
1…平面配置タイプの磁性薄膜メモリ素子
2…積層配置タイプの磁性薄膜メモリ素子
5…絶縁基板
11,15…第1磁性膜
20…第2磁性膜
30…加熱手段(加熱部)
39…加熱リード線
40…検出部分
49…検出リード線
50,60,70…絶縁膜
W10 、W20 、W01 、W02 …書き込み線
R10 、R20 、R01 、R02 …読み出し線
M11 、M12 、M21 、M22 …メモリ素子
Claims (13)
- 所定の間隔を開けて平面配置または積層配置された第1磁性膜および第2磁性膜と、
これらの第1磁性膜もしくは第2磁性膜に隣接して配置されるか、または、これらの第1磁性膜と第2磁性膜の間に介在された検出部分と、
前記第2磁性膜の磁化方向を反転させるための磁化手段と、
前記第2磁性膜の保磁力を減少させるように作用する加熱手段とを備える磁性薄膜メモリ素子であって、
前記第1磁性膜の保磁力は、第2磁性膜の保磁力と比較してそれより大きく、かつ予め所定の一方向に磁化されており、
前記磁化手段によって、第1磁性膜の磁化は反転しないが、第2磁性膜の磁化は反転できるような磁界を印加し、第2磁性膜の磁化方向を第1磁性膜の磁化の方向とは逆方向に磁化させて消去の状態を作り出し、前記加熱手段によって、第2磁性膜を加熱して一時的に保磁力を減少させるとともに、第1磁性膜による磁界を利用して第2磁性膜の磁化方向を第1磁性膜と同一方向に向かせて書き込みの状態を作り出す、または、
前記加熱手段によって、第2磁性膜を加熱して一時的に保磁力を減少させるとともに、第1磁性膜による磁界を利用して第2磁性膜の磁化方向を第1磁性膜と同一方向に向かせて消去の状態を作り出し、前記磁化手段によって、第1磁性膜の磁化は反転しないが、第2磁性膜の磁化は反転できるような磁界を印加し、第2磁性膜の磁化方向を第1磁性膜の磁化の方向とは逆方向に磁化させて書き込みの状態を作り出し、
前記第2磁性膜の磁化方向を前記検出部分で検出することで読み出しが行えるようにしてなることを特徴とする磁性薄膜メモリ素子。 - 前記第1磁性膜および第2磁性膜は、それらの容易磁化軸が膜面内成分を有し、2つの磁性膜が静磁的に結合するように配置されてなる請求項1に記載の磁性薄膜メモリ素子。
- 前記第1磁性膜、前記検出部分、および前記第2磁性膜が順次、同一平面上にライン状に配置されてなる請求項1または請求項2に記載の磁性薄膜メモリ素子。
- さらにもう一つの第1磁性膜を設け、新たな第1磁性膜と前記第1磁性膜とで前記検出部分、および前記第2磁性膜を挟むように配置してなる請求項3に記載の磁性薄膜メモリ素子。
- 前記検出部分に磁束を集束するために、第1磁性膜と第2磁性膜の検出部分側の幅を第1磁性膜と第2磁性膜の本体の幅よりも狭くするか、または、検出部分と第1磁性膜の間及び検出部分と第2磁性膜の間に磁束集束のための軟磁性薄膜を配置してなる請求項1ないし請求項4のいずれかに記載の磁性薄膜メモリ素子。
- 少なくとも前記第1磁性膜および前記第2磁性膜が基板面に積層方向に層状に配置されてなる請求項1または請求項2に記載の磁性薄膜メモリ素子。
- 前記検出部分が、磁気抵抗効果素子またはホール素子を用いて構成される請求項1ないし請求項6のいずれかに記載の磁性薄膜メモリ素子。
- 前記加熱手段として、第2磁性膜に隣接して設けた非磁性金属膜からなる加熱部を用い、それに電流を流すことにより非磁性金属膜および第2磁性膜を加熱してなる請求項1ないし請求項7のいずれかに記載の磁性薄膜メモリ素子。
- 前記磁化手段として、第2磁性膜に隣接して設けた非磁性金属膜を用い、それに電流を流すことにより発生する磁界により第2磁性膜を磁化させてなる請求項1ないし請求項8のいずれかに記載の磁性薄膜メモリ素子。
- 前記加熱部として第2磁性膜そのものを兼用させ、それに電流を流すことにより第2磁性膜を加熱してなる請求項1ないし請求項7のいずれかに記載の磁性薄膜メモリ素子。
- 請求項1ないし請求項10のいずれかに記載の磁性薄膜メモリ素子をマトリクス状に配列した記憶素子部分と、直交する2本の書き込み線および直交する2本の読み出し線を備え、
縦又は横方向に並べられた前記磁性薄膜メモリ素子のそれぞれが、直交する2本の書き込み線および直交する2本の読み出し線に接続されることを特徴とする磁性薄膜メモリ。 - 請求項1ないし請求項10のいずれかに記載の磁性薄膜メモリ素子をマトリクス状に配列した記憶素子部分と、直交する2本の書き込み線および1本の読み出し線を備え、
縦又は横方向に並べられた前記磁性薄膜メモリ素子のそれぞれが、直交する2本の書き込み線および1本の読み出し線に接続され、書き込み線の1本が読み出し線を兼ねることを特徴とする磁性薄膜メモリ。 - 隣り合うメモリ素子の第1磁性膜が連続膜で形成される請求項11または請求項12に記載の磁性薄膜メモリ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30161498A JP4129090B2 (ja) | 1998-10-08 | 1998-10-08 | 磁性薄膜メモリ素子および磁性薄膜メモリ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30161498A JP4129090B2 (ja) | 1998-10-08 | 1998-10-08 | 磁性薄膜メモリ素子および磁性薄膜メモリ |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000113666A JP2000113666A (ja) | 2000-04-21 |
JP4129090B2 true JP4129090B2 (ja) | 2008-07-30 |
Family
ID=17899073
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30161498A Expired - Fee Related JP4129090B2 (ja) | 1998-10-08 | 1998-10-08 | 磁性薄膜メモリ素子および磁性薄膜メモリ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4129090B2 (ja) |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6724674B2 (en) * | 2000-11-08 | 2004-04-20 | International Business Machines Corporation | Memory storage device with heating element |
JP4666774B2 (ja) * | 2001-01-11 | 2011-04-06 | キヤノン株式会社 | 磁気薄膜メモリ素子、磁気薄膜メモリおよび情報記録再生方法 |
US6603678B2 (en) | 2001-01-11 | 2003-08-05 | Hewlett-Packard Development Company, L.P. | Thermally-assisted switching of magnetic memory elements |
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JP4798895B2 (ja) * | 2001-08-21 | 2011-10-19 | キヤノン株式会社 | 強磁性体メモリとその熱補助駆動方法 |
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US6667897B1 (en) * | 2002-06-28 | 2003-12-23 | International Business Machines Corporation | Magnetic tunnel junction containing a ferrimagnetic layer and anti-parallel layer |
JP2006511892A (ja) * | 2002-12-18 | 2006-04-06 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | 改竄からmram素子を保護するための方法及び装置 |
JP4742490B2 (ja) * | 2003-09-09 | 2011-08-10 | ソニー株式会社 | 磁気メモリ |
US7397074B2 (en) | 2005-01-12 | 2008-07-08 | Samsung Electronics Co., Ltd. | RF field heated diodes for providing thermally assisted switching to magnetic memory elements |
-
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Publication number | Publication date |
---|---|
JP2000113666A (ja) | 2000-04-21 |
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