JP3240216B2 - 設定値に対する電圧変動を検出する検出回路、デバイス及び電力供給回路 - Google Patents

設定値に対する電圧変動を検出する検出回路、デバイス及び電力供給回路

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JP3240216B2
JP3240216B2 JP17551393A JP17551393A JP3240216B2 JP 3240216 B2 JP3240216 B2 JP 3240216B2 JP 17551393 A JP17551393 A JP 17551393A JP 17551393 A JP17551393 A JP 17551393A JP 3240216 B2 JP3240216 B2 JP 3240216B2
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    • H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
    • H02M3/00—Conversion of dc power input into dc power output
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    • H02M3/04—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters
    • H02M3/10—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
    • H02M3/145—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
    • H02M3/155—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only
    • H02M3/156—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only with automatic control of output voltage or current, e.g. switching regulators

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、エラー増巾器を備え
たデバイスのための、設定値に対する電圧変動を検出す
る回路に関するものである。この発明は、特に設定値に
対する過電圧を検出して制限するために、ブースト型ス
イッチを有する電力供給回路に使用するのに適してい
る。
【０００２】
【従来の技術】ここで電力供給回路とは、交流電圧を一
定の直流出力電圧に変換するための回路をいう。ブース
ト型スイッチを有する電力供給回路には、パワー・トラ
ンジスタのオン／オフ動作を制御するための制御回路が
設けられている。パワー・トランジスタは、ターンオン
時に一定の出力電圧（入力電圧より高い）を得るのに要
する電流までインダクタを充電させ、そしてターンオフ
時にダイオードを通して負荷へインダクタを放電させ
る。パワー・トランジスタのスイッチングによって生じ
られたリップルを低減するための出力コンデンサも設け
られている。
【０００３】上述した型式の周知の回路は図１に一例と
して示されている。この図１において、電力供給回路１
は、正弦波入力電圧ＶMが印加されている入力端子３及
び出力端子５，６を有する整流ブリッジ２を備えてい
る。出力端子５は抵抗５ａを介して制御回路８、通常は
集積回路の入力ピン７に接続され、そして出力端子６は
基準電位ライン（アース）９に接続されている。出力端
子５はトランス１１の１次巻線１０の一端にも接続さ
れ、その他端はダイオード１２のアノードに接続されて
いる。ダイオード１２のカソード（電力供給回路１の出
力端子１２ａを定める）と基準電位ライン９の間には、
コンデンサ１３、負荷１４、並びに一対の抵抗１６と１
７から成る分圧器１５が並列に接続され、この分圧器１
５のタップすなわちノード１８は制御回路８の入力ピン
１９に接続されている。
【０００４】トランス１１は２次巻線２０を備え、その
一端がアースされ且つ他端が抵抗２０ａを介して制御回
路８のピン２１に接続されると共にダイオード２２のア
ノードに接続されている。ダイオード２２のカソードと
アースの間にはコンデンサ２３が設けられ、そしてダイ
オード２２のカソードは制御回路８のピン２４にも接続
されている。
【０００５】制御回路８はエラー増巾器２７を備え、そ
の正入力端子には基準電圧ＶRが印加され、そして負入
力端子は制御回路８の入力ピン１９に接続されている。
エラー増巾器２７の負入力端子すなわち反転入力端子と
出力端子の間には、通常、制御回路８の外部で且つ制御
回路８の入力ピン１９と２９の間で補償用コンデンサ２
８が接続されている。エラー増巾器２７の出力端子は乗
算段３０の第１入力端子に接続され、その第２入力端子
は入力ピン７に接続され、そしてその出力端子はピン２
４にも接続された制御段３１に接続されている。この制
御段３１の出力端子はパワーＭＯＳトランジスタ３４の
ゲート端子に接続されている。制御段３１は、トランジ
スタ３４をターンオン／オフするための制御論理回路を
備え、且つトランジスタ３４をドライブする。このトラ
ンジスタ３４は、そのドレイン端子がダイオード１２の
アノードに接続され且つソース端子が制御回路８のピン
３５に接続されている。最後に、抵抗３６はトランジス
タ３４のソース端子と基準電位ライン９の間に設けら
れ、制御回路８のピン３７も基準電位ライン９に接続さ
れている。
【０００６】
【発明が解決しようとする課題】図１の回路の主な欠点
は、例えば負荷１４での鋭い変動によって起こされた、
出力端子での鋭い過電圧を瞬時に除去しないことであ
る。これは制御回路８のレスポンスに制限があるためで
あり、従って制御回路８は入力電圧ＶMの２倍の周波数
の出力電圧変動で影響されないように設計しなければな
らない。上記欠点を解消するために、出力電圧Ｖｏの瞬
時値に比例する信号を作る別な分圧器が分圧器１５と並
列に出力端子に設けられる。別な分圧器のノードは、制
御回路８に組み込まれたヒステリシス・コンパレータの
入力端子に接続される。そしてこのコンパレータは到来
信号を基準電圧と比較し且つ前者が後者を超える場合に
ターンオフ信号を制御段３１へ供給し、その結果、出力
電圧Ｖｏが正しい値に回復するまでトランジスタ３４を
ターンオフする。
【０００７】しかしながら、そのような解決策では、別
な分圧器によって作られた信号を受けるための特殊なピ
ンを制御回路８に設ける必要がある。ところが、このよ
うなことは全ての制御回路８に適用できるとは限らな
い。特に８ピン・パッケージ式の制御回路８には、この
ためのピンを用意できない。
【０００８】この発明の目的は、電圧変動を検出する
が、出力端子に外部信号を作るために余計なピンを必要
としない検出回路を提供することである。
【０００９】
【課題を解決するための手段】この発明に係る検出回路
は、エラー増巾器(27)の入出力端子間に接続された帰還
枝路(28)に接続でき、この帰還枝路に流れ且つ出力端子
(12a)に発生された出力電圧(Vo)の変動に比例する電流
(DI)を検出するための電流センサ(40)を備えたものであ
る。
【００１０】
【実施例】この発明を、その一実施例について、以下に
詳しく説明する。図２には、電力供給回路１の制御回路
８、補償用コンデンサ２８、分圧器１５及びトランジス
タ３４だけを示す。その他の構成部品は全て図１に示し
たものと同じであるので、同一符号で表してその説明を
省略する。
【００１１】図２において、３９は設定値に対して出力
電圧の変動を検出するための回路を示し、この検出回路
３９は、この発明によれば、補償用コンデンサ２８を流
れる電流を検出するための手段を備えている。この電流
は出力電圧Ｖｏの変動に瞬時に比例する。上記手段は、
パッケージ上に余計なピンを設ける必要性を無くす制御
回路８に都合良く集積される。
【００１２】詳しく云うと、検出回路３９は、ここでは
ピン２９とエラー増巾器２７の出力端子４１との間に置
かれ、出力端子４２に、補償用コンデンサ２８の電流Ｄ
Ｉに比例する電流信号ＫＤＩを発生するための電流セン
サ４０を備えている。図２の例では、電流信号ＫＤＩは
出力端子４２とアースの間の抵抗４３によって電圧信号
に変換された後にヒステリシス・コンパレータ４４の負
入力端子へ供給される。このコンパレータ４４の正入力
端子には基準電圧ＶR1が供給される。コンパレータ４４
の出力は制御段３１に供給され、この制御段３１は電圧
信号が基準電圧ＶR1で決まる閾値を超える時にトランジ
スタ３４をターンオフする。
【００１３】図２の回路は下記のように作動する。電力
供給回路１（図１も参照されたい）では、ノード１８と
基準電位ライン９の間に接続されて抵抗値がＲ1である
抵抗１７に流れる電流は一定であって、抵抗１７がエラ
ー増巾器２７の負入力端子に接続されているのでＶR／
Ｒ1に等しいと考えられる。定常状態の作動状態では、
電力供給回路１の出力電圧Ｖｏが設定値に等しい時に、
上記電流はダイオード１２（図１）のカソードに接続さ
れて抵抗値Ｒ2を有する抵抗１６に流れる電流とも等し
い。
【００１４】そのような状態では、補償用コンデンサ２
８の電流はゼロであり、そして電流を供給しないのでエ
ラー増巾器２７の最終段はバイアス状態にある。
【００１５】何等かの理由により、もし出力電圧Ｖｏに
変動が起こり、例えばＤＶｏの増加なら、これは抵抗１
６だけで検出され、その電流はＤＶｏ／Ｒ2に等しい量
ＤＩだけ増加し、この電流ＤＩは補償用コンデンサ２８
に流れて電流センサ４０で検出される。この電流センサ
４０は電流ＤＩに比例する電流信号ＫＤＩを出力端子４
２に発生する。従って、抵抗４３はその両端間に電流Ｄ
Ｉに比例した電圧降下ＤＶｏを発生し、これは過電圧制
限回路を構成するコンパレータ４４によってＶR1と比較
される。このＶR1を適切に設定することにより出力電圧
Ｖｏの変動閾値を調整することが可能である。なお、Ｖ
R1を超えると、コンパレータ４４の出力は切り換ってト
ランジスタ３４をターンオフする。
【００１６】この発明の望ましい実施例によれば、補償
用コンデンサ２８を流れる電流ＤＩは、エラー増巾器２
７の出力段を流れる瞬時電流とそのバイアス電流（両者
は上述したように電力供給回路１の定常状態作動状態で
は等しい）の差として電流センサ４０で測定される。
【００１７】上述した解決策の具体例が図３に示されて
いる。図３は、抵抗１６及び１７から成る分圧器１５、
補償用コンデンサ２８、抵抗４３並びにコンパレータ４
４を示す。図３において、エラー増巾器２７は、前置増
巾器４７並びに出力トランジスタ４８及びバイアス電流
Ｉｂを供給する電流源４９を含む最終段によって表され
ている。もう少し詳しく云えば、前置増巾器４７は、そ
の正入力端子に基準電圧ＶRが印加され、負入力端子が
ピン１９（ひいてはノード１８）に接続され、且つ出力
端子５０が出力トランジスタ４８、この場合はＰＮＰ型
のベース端子に接続されている。出力トランジスタ４８
のエミッタ端子はエラー増巾器２７の出力端子４１にな
るが、コレクタ端子は電流センサ４０の一部をなすカレ
ント・ミラー回路５２のＮＰＮ型トランジスタ５１のコ
レクタ端子に接続されている。
【００１８】トランジスタ５１は、そのエミッタ端子が
基準電位ライン９（ピン３７を介して）に接続され、そ
してそのベース端子がコレクタ端子に短絡され且つトラ
ンジスタ５１と共にカレント・ミラー回路５２を形成す
るＮＰＮ型トランジスタ５３のベース端子に接続されて
いる。トランジスタ５３は、そのエミッタ端子がアース
され、そしてそのコレクタ端子がトランジスタ５６と共
にカレント・ミラー回路５７を形成するトランジスタ５
５のコレクタ端子に接続されている。トランジスタ５５
及び５６は両方共ＰＮＰ型であって、ベース端子が相互
接続されると共にエミッタ端子が電位ＶCCの給電ライン
５８に接続されている。トランジスタ５６のベース端子
はそのコレクタ端子に短絡され、そして電流源４９はト
ランジスタ５６のコレクタ端子とエラー増巾器２７の出
力端子４１との間に設けられて出力トランジスタ４８へ
バイアス電流Ｉｂを供給する。
【００１９】トランジスタ５５と５３のコレクタ端子間
のノード６０は、トランジスタ６２と共に１：Ｋ比のカ
レント・ミラー回路６３を形成するトランジスタ６１の
コレクタ端子に接続されている。トランジスタ６１及び
６２は両方共ＰＮＰ型であって、そのベース端子が相互
接続され且つエミッタ端子が給電ライン５８に接続され
ている。トランジスタ６１はそのコレクタ端子がベース
端子に短絡され、トランジスタ６２はそのコレクタ端子
がノード６４を介して抵抗４３の一端に接続され、そし
てノード６４がコンパレータ４４の負入力端子に接続さ
れている。
【００２０】図２について上述したように、図３の回路
の定常状態作動状態では、補償コンデンサ２８を流れる
電流がゼロであるので、電流源４９によって生じられた
バイアス電流だけが出力トランジスタ４８を流れ、この
電流はトランジスタ５１そしてトランジスタ５３にも流
れる。同様に、バイアス電流Ｉｂはトランジスタ５６そ
してトランジスタ５５にも流れる。同一の電流は従って
両方のトランジスタ５５及び５３に流れるが、トランジ
スタ６１及び６２には電流が流れないので、ノード６４
はアースされそしてコンパレータ４４の出力は高い。
【００２１】逆に、図２について上述したように、電力
供給回路１の出力電圧が増加ＤＶｏすると、抵抗１６の
電流ひいては補償用コンデンサ２８に流入する電流ＤＩ
も増加し、この電流ＤＩが出力トランジスタ４８に注入
されるので、この段階では電流Ｉｂ＋ＤＩが供給される
ことになる。
【００２２】トランジスタ６１には、従ってこの段階で
は電流ＤＩが供給され、この電流ＤＩはトランジスタ５
５によって供給された電流とトランジスタ５３によって
引き出された電流（Ｉｂ＋ＤＩ）との差に等しく、そし
てトランジスタ６１と６２のエミッタ面積の比Ｋに応じ
て電流はトランジスタ６２に反映される。得られた電流
信号ＫＤＩは抵抗４３に供給され、この抵抗４３はその
ために変動ＤＶｏに比例した電圧降下Ｖ1を発生する。
そしてＶ1がＶR1を超える時にコンパレータ４４はトラ
ンジスタ３４をターンオフさせるのである。
【００２３】
【発明の効果】この発明に係る回路の利点は以上の説明
から明らかであろう。最初に、補償用コンデンサ２８を
流れる電流の関数として出力電圧の変動を検出するの
で、過電圧検出回路部品は特定のピンを必要とすること
無く制御回路８に集積できる。従って、これは、少ない
ピンしかない制御回路８に過電圧検出兼制限回路を充分
に実施するのみならず、制限回路に数本のピンがある場
合には他の用途のための別なピンを自由にすることがで
きる。
【００２４】第２に、ＤＶｏに比例する電圧Ｖ1が抵抗
値Ｒ2の抵抗１６を通してコンパレータ４４に供給され
るので、基準電圧ＶR1を変化させることなく抵抗値Ｒ2
を調節することによりコンパレータ４４が作動される瞬
間（ひいては制限手段が作動されるべき出力電圧変動
値）を調節することが可能である。これは、所要通り適
切な値の外部部品すなわち抵抗１６が設けられた同一の
制限回路８をアセンブリ段に提供する点で、特に有利で
ある。
【００２５】第３に、基準電圧の閾値が出力電圧Ｖｏと
直接比較されるのではなく、出力電圧Ｖｏの変動に比例
する信号Ｖ1と比較されるので、基準電圧ＶR1と測定電
流ＤＩの少なくとも一方のどんなエラーや不正確度（百
分率）も、出力電圧変動ＤＶｏの関数としてのコンパレ
ータ４４の動作エラーになり、そして出力電圧Ｖｏの全
エラーと比較するとＤＶｏ／Ｖｏに等しい係数だけ低減
される。
【００２６】第４に、上述した解決策は設計が簡単で、
制限回路８に容易に集積化でき、しかも小型である。
【００２７】最後に、上述した回路は、高度の信頼性を
提供し、そして温度変化に対して抵抗４３の抵抗値及び
感度が製造時にバラツク可能性があるにもかかわらず、
極めて正確にされ得る。事実、抵抗４３の抵抗値がどん
なにバラツイても、回路を較正するだけで、従って例え
ば抵抗１６の抵抗値を上述したように調節したり抵抗４
３を較正したりすることによって克服できる一方、温度
変化に対する抵抗４３の感度を、抵抗４３の抵抗値と同
じ仕方で基準電圧ＶR1を温度の関数として変えるだけで
完全に克服できる。
【００２８】当業者には明らかなように、この発明の範
囲から逸脱することなく、ここに例示して上述したよう
な回路を種々変更することができる。特に、電力供給回
路に加えて、上述したように、この発明に係る回路は、
過電圧が検出されて積極的に制限されるべき出力端子を
備え、且つ定常状態の作動状態では電流が供給されない
が、デバイスの出力電圧が変動する場合にはこの電圧変
動に瞬時に比例する電流が供給される帰還枝路を有する
エラー増巾器も備える他の型式のデバイスにも適用でき
る。
【００２９】最後に、付加的なピンを設ける必要のない
制御回路８内に集積するために特別に設計されたが、こ
の発明に係る回路は、ピンの数に制限の無いデバイスや
検出回路を必ずしも集積化する必要の無いデバイスにも
適用することができる。
【００３０】同一設計の解決策は設定電圧の負の変動を
検出して積極的に制限するのにも適用できる。その場
合、電流は、デバイスの定常状態作動状態以外では、上
述した例とくらべて反転するが、帰還コンデンサだけに
流れる。この場合には、検出兼制限回路を適切に変更す
る必要があることは明白である。
【図面の簡単な説明】
【図１】この発明に係る検出回路を適用できる周知の電
力供給回路の回路図である。
【図２】この発明に係る検出回路の一実施例を示すブロ
ック図である。
【図３】図２のブロック図を実施した回路図である。
【符号の説明】
１ 電力供給回路としてのデバイス ８ 制御回路 １２ａ デバイスの出力端子 ２７ エラー増巾器 ２８ 補償用コンデンサ ３９ 検出回路 ４０ 電流センサ ４１ エラー増巾器の出力端子 ４３ 抵抗 ４４ コンパレータ ４８ 出力トランジスタ ４９ 電流源 ５２，５７ カレント・ミラー回路 ６０，６４ ノード
───────────────────────────────────────────────────── フロントページの続き (72)発明者 クラウディオ・ディアッツィ イタリア国、20135 ミラノ、ヴィア・ ルカーノ ２ (72)発明者 アルビーノ・ピデュッティ イタリア国、33100 ウディーネ、ヴィ ア・ジョッピ 42 (56)参考文献 実開 昭59−68264（ＪＰ，Ｕ) (58)調査した分野(Int.Cl.7，ＤＢ名) G01R 19/00 - 19/32

Claims (13)

    (57)【特許請求の範囲】
  1. 【請求項１】 デバイス(1)のための設定値に関連した
    電圧変動を検出する検出回路(39)であって、 前記デバイス(1)は、 エラー増巾器(27)と、互いにカス
    ケード接続された制御部(30,31,34)と、出力電圧(Vo)を
    供給する出力端子(12a)とを備え、前記制御部は、入力電圧を受ける第１の入力端子(7)を
    有し、 前記エラー増巾器(27)は、前記デバイスの出力端子(12
    a)に接続されて前記デバイスの出力電圧(Vo)を示す信号
    を受ける入力端子(19)と、前記制御部の第２の入力端子
    に接続されて該入力端子にエラー信号を供給する出力端
    子(41)とを有し、 前記デバイス(1)は、前記エラー増巾器(27)の前記入力
    端子(19)と前記出力端子(41)との間に接続された帰還枝
    路(28)を更に備えている前記検出回路(39)において、 前記帰還枝路(28)に接続可能な電流センサ(40)を備え、前記帰還枝路(28)は、前記 帰還枝路に流れる電流(DI)を
    検出して前記デバイスの出力端子(12a)での前記出力電
    圧(Vo)の変動に比例した信号を生成することを特徴とす
    る検出回路。
  2. 【請求項２】 前記デバイス(1)が、前記エラー増巾器
    (27)をバイアスし且つ前記エラー増巾器の出力端子(41)
    に供給されるバイアス電流(Ib)を生じるための回路(49)
    を備えた請求項１の検出回路において、前記電流センサ
    (40)は、前記エラー増巾器の出力端子を流れる瞬時電流
    を検出するための手段(52)と、前記バイアス回路(49)に
    接続でき且つ前記検出手段(52)に接続された複数の入力
    端子を有し、前記瞬時電流と前記バイアス電流の差に等
    しい信号(DI)を発生するための減算手段(60)とを含むこ
    とを特徴とする請求項１の検出回路。
  3. 【請求項３】 前記エラー増巾器(27)が、前記バイアス
    回路(49)及び前記帰還枝路(28)に接続された第１端子を
    有するトランジスタ(48)を含む出力段を備えた請求項２
    の検出回路において、前記検出手段は、前記トランジス
    タの第２端子へ接続できる入力端子及び第２のカレント
    ・ミラー回路(57)の出力端子に接続された出力端子を有
    する第１のカレント・ミラー回路(52)を含み、前記第２
    のカレント・ミラー回路は前記バイアス回路に接続でき
    る入力端子を有し、前記第１及び第２のカレント・ミラ
    ー回路の出力端子は前記電流センサ(40)の出力端子(41)
    に接続されて前記減算手段になるノード(60)を形成する
    ことを特徴とする請求項２の検出回路。
  4. 【請求項４】 前記帰還枝路(28)が純容量性であること
    を特徴とする請求項１から請求項３までのいずれか記載
    の検出回路。
  5. 【請求項５】 電圧制限回路(43,44)を備え、前記電圧
    制限回路の入力端子(64)が前記電流センサ(40)へ接続さ
    れ且つ前記電圧制限回路の出力端子が前記制御部(30,3
    1,34)に接続できることを特徴とする請求項１から請求
    項４までのいずれか記載の検出回路。
  6. 【請求項６】 前記電圧制限回路(43,44)は電流／電圧
    変換器(43)を含み、その入力側が前記電流センサ(40)に
    接続され且つ出力側がコンパレータ(44)に接続され、そ
    してこのコンパレータが基準電圧(VR1)を受け且つ前記
    制御部(30,31,34)に接続できる出力端子を有することを
    特徴とする請求項５の検出回路。
  7. 【請求項７】 前記コンパレータがヒステリシス・コン
    パレータ(44)であることを特徴とする請求項６の検出回
    路。
  8. 【請求項８】 出力電圧(Vo)が発生される出力端子(12
    a)を備え、且つこの出力端子(12a)に接続された入力端
    子(19)及びエラー信号を供給する出力端子(41)を有する
    エラー増巾器(27)、このエラー増巾器の前記入出力端子
    間に接続された帰還枝路(28)、並びに設定値に対して前
    記出力電圧の変動を検出する検出回路(39)も備えたデバ
    イス(1)において、前記帰還枝路に接続され、この帰還
    枝路に流れ且つ前記出力電圧の変動に比例する電流(DI)
    を検出するための電流センサ(40)を更に備えたことを特
    徴とするデバイス。
  9. 【請求項９】 前記エラー増巾器(27)をバイアスし且つ
    前記エラー増巾器の出力端子(41)に供給されるバイアス
    電流(Ib)を生じるための回路(49)を備え、前記電流セン
    サ(40)は、前記エラー増巾器の出力端子を流れる瞬時電
    流を検出するための手段(52)と、前記バイアス回路(49)
    に接続でき且つ前記検出手段(52)に接続された複数の入
    力端子を有し、前記瞬時電流と前記バイアス電流の差に
    等しい信号(DI)を発生するための減算手段(60)とを含む
    ことを特徴とする請求項８のデバイス。
  10. 【請求項１０】 電圧制限回路(43,44)を備え、その入
    力端子(64)が前記電流センサ(40)へ接続され且つ出力端
    子が前記出力端子(12a)に接続されることを特徴とする
    請求項８又は請求項９のデバイス。
  11. 【請求項１１】 出力電圧(Vo)が発生される出力端子(1
    2a)を備え、且つこの出力端子(12a)に接続された入力端
    子(19)及びエラー信号を供給する出力端子(41)を有する
    エラー増巾器(27)、このエラー増巾器の前記入出力端子
    間に接続された帰還枝路(28)、前記エラー増巾器と縦続
    接続された制御段(31)、この制御段によってドライブさ
    れ且つ前記出力端子(12a)に接続されたスイッチ素子(3
    4)、並びに設定値に対して前記出力電圧の変動を検出す
    る検出回路(39)も備えた電力供給回路(1)において、前
    記帰還枝路に接続され、この帰還枝路に流れ且つ前記設
    定値に対する前記出力電圧の変動に比例する電流(DI)を
    検出するための電流センサ(40)を更に備えたことを特徴
    とする電力供給回路。
  12. 【請求項１２】 前記エラー増巾器(27)をバイアスし且
    つ前記エラー増巾器の出力端子(41)に供給されるバイア
    ス電流(Ib)を生じるための回路(49)を備え、前記電流セ
    ンサ(40)は、前記エラー増巾器の出力端子を流れる瞬時
    電流を検出するための手段(52)と、前記バイアス回路(4
    9)に接続でき且つ前記検出手段(52)に接続された複数の
    入力端子を有し、前記瞬時電流と前記バイアス電流の差
    に等しい信号(DI)を発生するための減算手段(60)とを含
    むことを特徴とする請求項１１の電力供給回路。
  13. 【請求項１３】 電圧制限回路(43,44)を備え、その入
    力端子(64)が前記電流センサ(40)へ接続され且つ出力端
    子が前記出力端子(12a)に接続されることを特徴とする
    請求項１１又は請求項１２の電力供給回路。
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