JP3040342B2 - 電力用mosゲート型回路のための制御回路 - Google Patents
電力用mosゲート型回路のための制御回路Info
- Publication number
- JP3040342B2 JP3040342B2 JP8088288A JP8828896A JP3040342B2 JP 3040342 B2 JP3040342 B2 JP 3040342B2 JP 8088288 A JP8088288 A JP 8088288A JP 8828896 A JP8828896 A JP 8828896A JP 3040342 B2 JP3040342 B2 JP 3040342B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- input
- control
- gate type
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01H—ELECTRIC SWITCHES; RELAYS; SELECTORS; EMERGENCY PROTECTIVE DEVICES
- H01H73/00—Protective overload circuit-breaking switches in which excess current opens the contacts by automatic release of mechanical energy stored by previous operation of a hand reset mechanism
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/082—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
- H03K17/0828—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in composite switches
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/082—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
- H03K17/0822—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in field-effect transistor switches
Landscapes
- Electronic Switches (AREA)
- Semiconductor Integrated Circuits (AREA)
- Protection Of Static Devices (AREA)
- Emergency Protection Circuit Devices (AREA)
- Power-Operated Mechanisms For Wings (AREA)
Description
ート型電力用素子(Smart Power MOSgated devices)に関
するものであり、更に詳しくは、障害発生後に障害用ラ
ッチ回路をリセットするための独自のリセット信号が入
力ピンに供給され、かつ、この電力用素子のオフ信号入
力レベルでは障害用ラッチはリセットされ得ないスマー
ト電力用回路に関する。
力用スイッチング素子であって、この素子では、素子の
温度や、電流、電圧の状態を監視して、障害状態が検出
されるか又は予想されるとその素子をオフさせる回路の
ような「知能」が、代表的なパワーMOSFETである
MOSゲート型素子に与えられている。このタイプのよ
く知られた素子の一つは、インターナショナル・レクテ
ィファイア社(International Rectifier Corporation)
によって製造されている、型番IRSF 3010の完
全な保護機能を有するDMOS電力用スイッチであり、
これはSMARTFETトランジスタ(SMARTFET Transi
stor)と命名されている。SMARTFETは、本発明
の譲受人であるインターナショナル・レクティファイア
社の商標である。
ピン構成のTO 220パッケージに収められている。
他のパッケージの形態を使用してもよい。本パッケージ
は、入力ピン、ドレイン・ピン、およびソース・ピンを有
している。制御回路のための動作電力は、入力ピンから
入力される制御信号より供給される。この素子は、完全
な保護機能を有するモノリシックなNチャネル型の、論
理レベルのパワーMOSFETであって、80オームの
オン抵抗を有し、過電流や、過温度、ESDに対する回
路の保護機能が組み込まれており、また能動的な過電圧
保護機能を有している。
ETチップに集積化されたラッチ回路であってエラーの
発生を認識し記憶してパワーMOSFETのゲートから
ターンオン信号を除去するラッチ回路を使用している。
このラッチ回路は、指定された最小期間だけその入力を
Lowに保持することによりクリアおよびリセットされ
る。したがって、障害状態が持続し、ラッチ回路が動作
の次のサイクルでリセットされると、この素子がオンし
て障害状態となり、再び誤動作する。この状況は、この
ラッチ回路が他の方法でクリアされるまで続く。
け取る別個のリセット・ピンをパッケージに設けること
により回避することができる。しかし、この場合、5ピ
ンのパッケージが必要となり、しかもSOT223型パ
ッケージを使用することができなくなる。しかし、イン
テリジェントな回路を有するまたは有さない他の3ピン
のパッケージと容易に交換できる(a drop-in replaceme
nt)3ピンのパッケージとして作製することが強く要望
されている。
使用しつつ、障害動作後に障害用ラッチ回路がリセット
されない電力用MOSゲート型回路のための制御回路を
提供することを目的とする。
は、IRSF 3010の回路とともに使用できるもの
であって、リセット信号と入力オン信号と入力オフ信号
とのアナログ式多重化を行い、3ピンの入力回路および
パッケージを維持するものである。この新規な回路は、
次に示す二つの異なる閾値電圧を使用する。 1.通常1ボルト以下であるリセット閾値。前記入力ピ
ンをこの閾値よりも低い値に下げることにより、障害用
ラッチをリセットする。 2.通常3.2ボルトであるセット閾値。前記入力ピンを
この閾値よりも高い値に上げることにより、MOSゲー
ト型素子をオンし、3.2ボルトよりも下げることによ
り、MOSゲート型素子をオフする。
は、リセット電圧よりも高い電圧、例えばこの素子をオ
フさせる2ボルトと、セット電圧、例えばこの素子をオ
ンさせる5ボルトとの間で、切り換えられる。障害状態
によって障害用ラッチが作動してこの素子がオフして
も、障害用ラッチはリセット電圧よりも高い入力オフ電
圧によってはリセットされ得ない。
もよい。しかし、ここでは、3つの識別可能な信号が抵
抗分圧回路を有するマイクロコントローラから供給され
る特定の新規な3状態駆動について説明する。抵抗分圧
回路は、二つの異なる抵抗値を有する抵抗から構成さ
れ、これらの抵抗はマイクロコントローラの入力端子と
リセット端子との間に直列に接続されている。これらの
抵抗の間の節点は、前記MOSゲート型素子回路の入力
端子ピンに接続され、マイクロコントローラの2個の出
力ポートの信号レベルに応じて3つの状態すなわち3つ
のレベルのうちの一つのレベルの信号電圧を有する。こ
れらの信号レベルとしては、0ボルト(リセットするた
めの電圧)、2ボルト(この素子をオフするための電
圧)、および5ボルト(この素子をオンするための電
圧)を考えることができる。明らかなことではあるが、
他の値を用いてもよい。
能付きMOSゲート型素子に対して別個のリセット信号
入力を実現する。
を参照する本発明の以下の記述から明らかであろう。
従来技術である保護機能付きMOS制御スイッチ素子(M
OS controlled switch device)が示されており、このス
イッチ素子では、電力用素子と同一のチップに保護回路
が組み込まれている。図1に示す回路は、前述の従来技
術であるスマートFET DMOSパワースイッチ(Smar
t FETDMOS Power Switch)IRSF 3010型の回路で
ある。
ン・ピン11に接続されたドレイン電極、ソース・ピン1
2に接続されたソース電極、および抵抗14に接続され
た電流検出出力電極13を有する電流検出パワーMOS
FETである。このMOSFETのゲート電極15は、
制御用MOSFET16を介して入力ピン17に接続さ
れている。MOSFET10は、所望の如何なるMOS
ゲート型素子であってもよく、例えばIGBTまたはM
OSゲート型サイリスタであってもよく、所望の如何な
る電流検出の構成を有していてもよい。
御対象の素子または回路に損傷を与えるか又はそれらを
破壊するであろう障害状態からMOSFET10を保護
するためのものである。この制御回路は、いずれの方式
のものでもよいが、図1では、主MOSFET10の入
力回路に直列に接続された前述の制御用MOSFET1
6と、主MOSFET10のソースとゲートの間に接続
された第2MOSFET20とから成る。また、入力ピ
ン17に供給される入力信号から動作電力を引き出すバ
イアス電圧供給回路21a、R−Sラッチ回路21、比
較器22と23、OR回路24、ツェナー・ダイオード
25、および、クランプ回路のツェナー・ダイオード2
6とダイオード28が設けられている。なお、図1に示
したR−Sラッチ回路21では、S入力が入力ピン17
に、R入力がOR回路24の出力に、Q出力がMOSF
ET16のゲートに、バーQ出力がMOSFET20の
ゲートにそれぞれ接続されているが、S入力をOR回路
24の出力に、バーR入力を入力ピン17に、Q出力を
MOSFET20のゲートに、バーQ出力をMOSFE
T16のゲートにそれぞれ接続する構成としてもよい。
するESD保護を行うものであって、入力電圧を例えば
10ボルトに制限する。
ものである。ブロック30は、通常3本のリード線を有
する図2に示すTO 220型パッケージ31内に納め
られている、集積回路が形成されたシリコン・チップに
対応する。パッケージ31は、入力リード端子ピン1
7、ドレイン端子ピン(およびタブ)11、およびソー
ス・ピン12を有しており、これらは図1にも示されて
いる。図1および図2に示した保護機能付きMOS素子
は、保護機能のない標準のパワーMOSFET用または
類似のMOSゲート型素子用に設計されたソケットに直
接差し込めることに注意されたい。
入力信号源、例えばマイクロコントローラが入力パルス
を入力ピン17に供給することにより、使用者が望むよ
うに、ドレイン・ピン11とソース・ピン17の間に流れ
るドレイン電流のオンとオフの切換を制御する。任意の
適当な負荷、例えば直流モータの駆動回路や、ソレノイ
ドの駆動回路、ランプの駆動回路などがドレイン・ピン
11およびソース・ピン12に直列に接続されることに
注意されたい。本素子は、MOSFET10をオフさせ
る0ボルトとMOSFET10をオンさせる5ボルトと
の間で切り換わる入力波形によって40kHz程度以下の
周波数でスイッチングを行うことができる。
力信号波形を示し、図3(b)はその入力信号によって
生じるピン11における電流を同一の時間尺度で示す。
正常動作中は、ピン17の信号が5ボルトのときMOS
FET10がオン状態となる。抵抗14を流れる電流を
示す信号は基準電圧VREFよりも小さく、過温度信号Tj
も基準電圧VREFよりも小さい。したがって、比較器2
2および23の出力はLowであって、R−Sラッチの
R入力もLowである。その結果、Q出力はHighと
なってMOSFET16がオンし、バーQ出力はLow
となってMOSFET20はオフのままとなる。
ン17における信号が零ボルトのとき、MOSFET1
0のゲート電圧は0であり、この素子はオフしている。
入力信号が再び5ボルトへと切り換わると、MOSFE
T10がオンし、図3(b)の最初の部分に示されてい
るようにドレイン電流が流れ、本システムが正常に動作
する。
(b)において障害のスパイク"x"によって示されてい
るように、比較器22と23の一方または双方の出力が
Highとなり、これによりOR回路24の出力がHi
ghとなる。その結果、R−SラッチのQ出力およびバ
ーQ出力が切り換わってMOSFET16がオフし、入
力ピン17とMOSFET10のゲートとが切り離され
る。また、R−Sラッチの切り換わりによりMOSFE
T20がオンして、ソース・ピン12の電位がMOSF
ET10のゲートの電位に固定される。このようにして
MOSFET10は、障害となるスパイクに応答してオ
フする。
チは、入力ピン17におけるLowの入力信号によって
リセットされる。MOSFET10は、その後、ターン
オン信号(HighのVin)が入力17に現れるとター
ンオンする。しかし、障害状態がなお存続する場合に
は、図3(b)に示した障害のパルス"y"が現れ、ラッ
チ21が再び動作する。このシーケンスは、その障害が
解消されるかまたは本回路がタイムアウト状態となるま
で継続される。
クロコントローラの回路からラッチ21へ別個のリセッ
ト信号を供給するために別個のリセット・ピンを設ける
ことにより、回避することができる。しかし、図2に示
した3ピン構成を維持することが強く望まれている。
オン信号が障害動作後に前記ラッチをリセットしない新
規な回路を提供する。
回路の新規な信号源が図5に示されている。図1に示し
た構成要素と同様の構成要素には、図4において同じ符
号が付されている。しかし、図4に示した回路は、R−
Sラッチ21に、ラッチ21のリセットの閾値電圧より
も高いトリガ電圧を有するシュミットトリガ回路41が
組み込まれている点で修正されている。例えば、ラッチ
21のリセットの閾値電圧は1ボルトであり、シュミッ
トトリガ回路41の閾値電圧は3.5ボルトである。シュ
ミットトリガ回路41の出力およびラッチ21のバーQ
出力は、AND回路42に入力される。AND回路42
の出力は、制御用MOSFET16のゲートおよびイン
バータ43に入力される。インバータ43の出力は制御
用MOSFET20のゲートに入力される。本実施形態
では、ラッチ21のバーR入力におけるリセット閾値は
1ボルトである。すなわち、ラッチ21をリセットする
ためには、バーRのピンにおける電圧は1ボルト以下で
なければならない。したがって、図4に示した回路は、
入力端子17における3つの異なる入力信号レベルに対
して以下のように動作する。
い場合は、AND回路42への入力はHighとなり、
MOSFET16はオン状態、MOSFET20はオフ
状態となる。
と、シュミットトリガ回路41が動作し、シュミットト
リガ回路41からLowが出力される。したがって、A
ND回路42はLowとなり、MOSFET16はオフ
してMOSFET20はオンし、これにより主MOSF
ETであるパワーMOSFET10がオフする。この動
作は、図6(a)および(b)に示されている。この入
力が2ボルトと5ボルトの間で切り換わる限り、本素子
は、この入力が0ボルトと5ボルトの間で切り換わると
きの図1の従来の素子と同様に動作する。この間ラッチ
21はリセットされないことに注意されたい。
し、MOSFET16をオフ状態にとどめMOSFET
20をオン状態にとどめるために、バーQがLowへと
変化する。この状態は、ラッチ21のリセット閾値より
も低い値、好ましくは0ボルトの第3の信号が入力17
に供給されるまで継続する。したがって、正常動作を継
続できるようにするためには、図6(b)に示されてい
る如く、入力ピン17を1ボルトよりも低い値に引き下
げることにより障害用ラッチ21をリセットする。
マイクロコントローラ50による制御の下で、上記入力
端子に対する3つの異なる電圧レベルを生成するための
新規な入力回路を示す。ここに示すようにマイクロコン
トローラ50はINポートとRESETポートを有して
いる。INポートにおける電圧は、制御されたデューテ
ィ比を持つ方形波であり、0ボルトと5ボルトの間で使
用者の要求に応じて切り換わる。RESETポートにお
ける電圧は5ボルトであるが、リセットのために0ボル
トへと切り換えることができる。例えば2000オームと30
00オームの抵抗値をそれぞれ有する抵抗51と52から
成る抵抗分圧回路がINポートとRESETポートとの
間を接続しており、節点53で接続されている。抵抗5
1と52の抵抗値は同一であってもよいし、上述の値と
異なる値であってもよい。節点53は、図4における入
力17に接続されている。
抗分圧回路のみを使用して3状態の駆動を提供し、以下
のように動作する。5ボルトを出力するために、INポ
ートが5ボルトとされ、バーRESET・ポートが5ボ
ルトとされる。このようにすると節点53の電圧も5ボ
ルトとなる。2ボルトを出力するために、INポートが
0ボルトとされ、バーRESET・ポートが5ボルトの
ままとされる。抵抗分圧回路の分圧比は、節点53にお
いて2ボルトが生成されるように設定されている。節点
53において0ボルトを生成するためには(ラッチ21
をリセットするためには)、バーRESETポートの電
圧を0ボルトとしINポートの電圧も0ボルトとするだ
けでよい。
の無い動作中にMOSFET10をオフするためのLo
w信号の電圧よりも低い限り、所望の任意の電圧範囲で
本発明を使用することができる、ということに注意され
たい。
ミットトリガ回路41に基づくヒステリシス特性を有し
ている。したがって図7に示すように、ドレイン電流I
Dの曲線がMOSFET10のゲートへの入力電圧Vgs
の関数として示される。MOSFET10の入力電圧V
gsが増大すると、3.5ボルトを越えMOSFET10が
オンする第1の値でシュミットトリガ回路41が動作
し、電流IDが流れる。しかし、ターンオフ中におい
て、ゲート電圧は、ターンオンする値よりも低下し、約
3.5ボルトよりも低い第2の値となる。このヒステリシ
スの効果により、本回路に良好な雑音耐力が生じる。
たが、他の多くの変形や他の用途が当業者にとっては明
らかである。したがって、本発明は、この中での特定の
開示内容によって限定されるものではなく、請求の範囲
によってのみ限定される。
示す回路図。
ジである3ピン構成のTO 220型パッケージを示す
斜視図。
時間の関数として示す図(a)、および、障害が継続し
て存在する場合において図3(a)の時間尺度と同一の
時間尺度で図1に示した回路のドレイン電流を示す図
(b)。
す回路図。
するためのアナログ出力回路を示す回路図。
に示した入力ピンへの入力信号を時間の関数として示す
図(a)、障害が継続して存在する場合において図6
(a)の時間尺度と同一の時間尺度で図4に示した回路
のドレイン電流を示す図(b)。
路のヒステリシス特性を示す図。
Claims (11)
- 【請求項1】 電力用MOSゲート型回路のための制御
回路において、 前記MOSゲート型回路は第1および第2主端子ピンと
入力端子ピンとを有し、該入力端子ピンが前記両主端子
ピンの間における前記電力用MOSゲート型回路のオン
とオフの切り換えを制御し、前記電力用MOSゲート型
回路は、前記第1および第2主端子ピンに接続された第
1および第2主電極と、入力電極とを有するMOSゲー
ト型電力用素子を備え、 前記制御回路は、 前記MOSゲート型電力用素子の少なくとも一つの動作
状態を監視し、該動作状態を示す値が所定の値を越える
と前記MOSゲート型電力用素子をオフさせる保護回路
手段と、 前記入力端子ピンと前記入力電極との間に接続され、タ
ーンオン信号が前記入力ピンに供給されたときに前記M
OSゲート型電力用素子のターンオン及びターンオフを
制御する、少なくとも1つの第1制御用MOSFET手
段と、 前記入力端子ピンと前記第1制御用MOSFET手段と
の間に接続されており、第1電圧の信号及び第2電圧の
信号のそれぞれに応答して、前記第1制御用MOSFE
T手段および前記MOSゲート型電力用素子をターンオ
ン及びターンオフさせる第1回路手段と、 前記保護回路手段に接続された入力と前記第1制御用M
OSFET手段に接続された出力とを有するリセット可
能なラッチ回路手段であって、前記保護回路手段の出力
に応答して第1ラッチ状態へと切り換わることにより、
前記MOSゲート型電力用素子をオフさせるために前記
第1制御用MOSFET手段を動作させないようにする
ラッチ回路手段と、 該ラッチ回路手段の入力に接続し、前記第1及び第2電
圧のうちの低い方の電圧よりも低い第3電圧の信号に応
答して前記ラッチ回路手段をリセットするための手段と
を備え、 前記電力用MOSゲート型回路は、前記入力端子ピンに
供給される互いに識別可能な第1、第2および第3電圧
の3種類の信号のうち第1電圧の信号によってオンし、
第2電圧の信号によってオフし、障害後に第3電圧の信
号によってリセットされるようにしたことを特徴とする
制御回路。 - 【請求項2】 請求項1に記載の回路において、前記電
力用MOSゲート型回路が3ピンのTO 220型パッ
ケージに収められている回路。 - 【請求項3】 請求項1に記載の回路において、前記保
護回路手段が電流測定回路および温度測定回路を有して
いる回路。 - 【請求項4】 請求項1に記載の回路において、前記制
御回路は、前記MOSゲート型電力用素子の前記入力電
極と前記両主電極のうちの一つの電極との間に接続され
導通することにより前記MOSゲート型電力用素子をオ
フさせる第2制御用MOSFETを有し、該第2制御用
MOSFETは、前記第1制御用MOSFET手段がオ
ンするとオフし前記第1制御用MOSFET手段がオフ
するとオンするように前記入力端子ピンと前記ラッチ回
路手段とに接続されている回路。 - 【請求項5】 請求項1に記載の制御回路において、前
記ラッチ回路手段はR−Sラッチである制御回路。 - 【請求項6】 請求項1に記載の制御回路において、前
記第1、第2および第3電圧は、それぞれ、略5ボル
ト、略2ボルトおよび略0ボルトという異なる電圧であ
る制御回路。 - 【請求項7】 請求項1または請求項4のいずれかに記
載の制御回路において、前記第1回路手段がシュミット
トリガ回路を有している制御回路。 - 【請求項8】 請求項7に記載の制御回路において、前
記第1回路手段は、前記シュミットトリガ回路からの出
力を受け、かつ、前記第1制御用MOSFET手段の入
力に接続される入力と、前記第2制御用MOSFETの
入力に接続される出力とを有するインバータ回路を更に
備えている制御回路。 - 【請求項9】 請求項8に記載の制御回路であって、前
記シュミットトリガ回路の出力に接続された第1入力
と、前記ラッチ回路手段の出力に接続された第2入力
と、前記インバータ回路の前記入力に接続された出力と
を有するAND回路を更に備える制御回路。 - 【請求項10】 請求項1に記載の回路であって、前記
入力端子ピンに接続された入力回路を更に備え、該入力
回路は前記第1、第2および第3電圧の信号を選択的に
生成するための手段を持ち、該入力回路手段は、第1電
圧出力と第2電圧出力との間でそれぞれ選択的に切り換
えることができる第1および第2出力ポートと、前記第
1出力ポートと第2出力ポートとの間を接続し前記入力
端子ピンが接続される節点を有する抵抗分圧回路とを有
している回路。 - 【請求項11】 請求項10に記載の回路において、前
記分圧回路の抵抗値が前記節点の両側の抵抗の一方と他
方とで異なっている回路。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US08/420,193 US5563759A (en) | 1995-04-11 | 1995-04-11 | Protected three-pin mosgated power switch with separate input reset signal level |
US420193 | 1995-04-11 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH08307221A JPH08307221A (ja) | 1996-11-22 |
JP3040342B2 true JP3040342B2 (ja) | 2000-05-15 |
Family
ID=23665457
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8088288A Expired - Lifetime JP3040342B2 (ja) | 1995-04-11 | 1996-04-10 | 電力用mosゲート型回路のための制御回路 |
Country Status (8)
Country | Link |
---|---|
US (1) | US5563759A (ja) |
JP (1) | JP3040342B2 (ja) |
KR (1) | KR100197913B1 (ja) |
DE (1) | DE19614354C2 (ja) |
FR (1) | FR2733099A1 (ja) |
GB (1) | GB2299902B (ja) |
IT (1) | IT1285197B1 (ja) |
SG (1) | SG52684A1 (ja) |
Families Citing this family (47)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5986359A (en) * | 1996-04-23 | 1999-11-16 | Lear Automotive Dearborn, Inc. | Power delivery circuit with short circuit protection |
EP0822661A3 (de) * | 1996-08-02 | 1999-11-24 | Siemens Aktiengesellschaft | Ansteuerschaltung für ein Feldeffekt gesteuertes Leistungs-Halbleiterbauelement |
JP3241279B2 (ja) * | 1996-11-14 | 2001-12-25 | 株式会社日立製作所 | 保護機能付きスイッチ回路 |
US6011416A (en) * | 1997-02-19 | 2000-01-04 | Harness System Technologies Research Ltd. | Switch circuit having excess-current detection function |
US6104149A (en) * | 1997-02-28 | 2000-08-15 | International Rectifier Corp. | Circuit and method for improving short-circuit capability of IGBTs |
DE19722300A1 (de) * | 1997-05-28 | 1998-12-03 | Bosch Gmbh Robert | Übertemperatur-Schutzschaltung |
KR100468658B1 (ko) * | 1997-08-21 | 2005-03-16 | 페어차일드코리아반도체 주식회사 | 전원제어회로 |
US6097237A (en) * | 1998-01-29 | 2000-08-01 | Sun Microsystems, Inc. | Overshoot/undershoot protection scheme for low voltage output buffer |
US5920452A (en) * | 1998-06-01 | 1999-07-06 | Harris Corporation | Circuit and method for protecting from overcurrent conditions and detecting an open electrical load |
US6259292B1 (en) * | 1999-04-21 | 2001-07-10 | James S. Congdon | Three-terminal inverting hysteretic transistor switch |
JP3664061B2 (ja) * | 1999-12-28 | 2005-06-22 | 日産自動車株式会社 | 電流制御型半導体素子用駆動回路 |
US6330143B1 (en) | 2000-02-23 | 2001-12-11 | Ford Global Technologies, Inc. | Automatic over-current protection of transistors |
US6969959B2 (en) * | 2001-07-06 | 2005-11-29 | Lutron Electronics Co., Inc. | Electronic control systems and methods |
JP3990218B2 (ja) | 2002-07-12 | 2007-10-10 | 矢崎総業株式会社 | 半導体素子の保護装置 |
US6989649B2 (en) * | 2003-07-09 | 2006-01-24 | A. O. Smith Corporation | Switch assembly, electric machine having the switch assembly, and method of controlling the same |
EP1515441B1 (de) * | 2003-09-05 | 2010-01-20 | Biotronik GmbH & Co. KG | Spannungsfester MOS-Schalter |
US8540493B2 (en) | 2003-12-08 | 2013-09-24 | Sta-Rite Industries, Llc | Pump control system and method |
US6963498B2 (en) * | 2004-02-02 | 2005-11-08 | International Rectifier Corporation | Bootstrap capacitor refresh circuit |
US7845913B2 (en) | 2004-08-26 | 2010-12-07 | Pentair Water Pool And Spa, Inc. | Flow control |
US7686589B2 (en) | 2004-08-26 | 2010-03-30 | Pentair Water Pool And Spa, Inc. | Pumping system with power optimization |
US8019479B2 (en) | 2004-08-26 | 2011-09-13 | Pentair Water Pool And Spa, Inc. | Control algorithm of variable speed pumping system |
US7854597B2 (en) | 2004-08-26 | 2010-12-21 | Pentair Water Pool And Spa, Inc. | Pumping system with two way communication |
US8480373B2 (en) | 2004-08-26 | 2013-07-09 | Pentair Water Pool And Spa, Inc. | Filter loading |
US8469675B2 (en) | 2004-08-26 | 2013-06-25 | Pentair Water Pool And Spa, Inc. | Priming protection |
US7874808B2 (en) | 2004-08-26 | 2011-01-25 | Pentair Water Pool And Spa, Inc. | Variable speed pumping system and method |
US8602745B2 (en) | 2004-08-26 | 2013-12-10 | Pentair Water Pool And Spa, Inc. | Anti-entrapment and anti-dead head function |
FR2888709B1 (fr) * | 2005-07-13 | 2007-10-05 | Valeo Electronique Sys Liaison | Circuit imprime perfectionne, adapte a la detection d'un echauffement accidentel |
JP4732191B2 (ja) * | 2006-02-28 | 2011-07-27 | 矢崎総業株式会社 | 過熱保護機能付き半導体装置の制御回路 |
FR2900292B1 (fr) * | 2006-04-21 | 2008-11-14 | Airbus France Sas | Dispositif de securite pour interrupteur a semi-conducteurs |
JP5373257B2 (ja) * | 2006-08-04 | 2013-12-18 | 日立オートモティブシステムズ株式会社 | エンジン用高圧ポンプ駆動回路 |
DE102006045542A1 (de) * | 2006-09-25 | 2008-04-03 | Atmel Germany Gmbh | Satellitenhochfrequenzempfängerschaltkreis, Schaltungsanordnung zur Verarbeitung von Satellitensignalen und Verfahren zum Betreiben einer derartigen Schaltungsanordnung |
US8068322B2 (en) * | 2008-07-31 | 2011-11-29 | Honeywell International Inc. | Electronic circuit breaker apparatus and systems |
ES2688385T3 (es) | 2008-10-06 | 2018-11-02 | Pentair Water Pool And Spa, Inc. | Método para operar un sistema de seguridad de liberación de vacío |
US9556874B2 (en) | 2009-06-09 | 2017-01-31 | Pentair Flow Technologies, Llc | Method of controlling a pump and motor |
US8657489B2 (en) | 2010-06-28 | 2014-02-25 | Infineon Technologies Ag | Power switch temperature control device and method |
EP2649318A4 (en) | 2010-12-08 | 2017-05-10 | Pentair Water Pool and Spa, Inc. | Discharge vacuum relief valve for safety vacuum release system |
DE102010055479A1 (de) * | 2010-12-22 | 2012-06-28 | Continental Automotive Gmbh | Schaltung zur Ansteuerung eines Schalters |
EP2774009B1 (en) | 2011-11-01 | 2017-08-16 | Pentair Water Pool and Spa, Inc. | Flow locking system and method |
WO2013156811A1 (en) * | 2012-04-19 | 2013-10-24 | Freescale Semiconductor, Inc. | A protection circuit and a gate driving circuitry |
US9885360B2 (en) | 2012-10-25 | 2018-02-06 | Pentair Flow Technologies, Llc | Battery backup sump pump systems and methods |
JP6168899B2 (ja) * | 2013-08-01 | 2017-07-26 | 三菱電機株式会社 | パワーモジュール |
US9136691B2 (en) * | 2013-08-08 | 2015-09-15 | Tyco Electronics Corporation | Solid state relay protective device |
JP6260710B2 (ja) * | 2014-09-09 | 2018-01-17 | 富士電機株式会社 | 半導体モジュール |
CN106873569B (zh) * | 2015-12-14 | 2019-05-21 | 中国航空工业第六一八研究所 | 一种基于rs触发器的bit故障锁存方法 |
EP3442019A4 (en) * | 2016-04-06 | 2019-12-04 | Shindengen Electric Manufacturing Co., Ltd. | POWER MODULE |
US10734992B2 (en) * | 2017-08-09 | 2020-08-04 | Infineon Technologies Ag | Circuit and method for providing an output signal |
CN110289601A (zh) * | 2019-07-12 | 2019-09-27 | 西安电子科技大学 | 用于保护igbt的内置于驱动ic的主动钳位电路 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
IT1215279B (it) * | 1985-06-10 | 1990-01-31 | Ates Componenti Elettron | Dispositivo elettrico di potenza intelligente a circuito integrato monolitico. |
US4703390A (en) * | 1986-05-27 | 1987-10-27 | Motorola, Inc. | Integrated circuit power timer |
JP3169723B2 (ja) * | 1992-01-31 | 2001-05-28 | 株式会社日立製作所 | 保護回路を具備する半導体装置および電子システム |
KR100271690B1 (ko) * | 1992-01-31 | 2000-11-15 | 스즈키 진이치로 | 보호회로를 구비하는 반도체 장치 및 전자시스템 |
US5325258A (en) * | 1992-08-26 | 1994-06-28 | International Rectifier Corporation | Power transistor driver circuit with current sensing and current overprotection and method for protecting power transistor from overcurrent |
US5497285A (en) * | 1993-09-14 | 1996-03-05 | International Rectifier Corporation | Power MOSFET with overcurrent and over-temperature protection |
US5550701A (en) * | 1994-08-30 | 1996-08-27 | International Rectifier Corporation | Power MOSFET with overcurrent and over-temperature protection and control circuit decoupled from body diode |
-
1995
- 1995-04-11 US US08/420,193 patent/US5563759A/en not_active Expired - Lifetime
-
1996
- 1996-04-01 GB GB9606870A patent/GB2299902B/en not_active Expired - Fee Related
- 1996-04-10 KR KR1019960010777A patent/KR100197913B1/ko not_active IP Right Cessation
- 1996-04-10 SG SG1996007818A patent/SG52684A1/en unknown
- 1996-04-10 JP JP8088288A patent/JP3040342B2/ja not_active Expired - Lifetime
- 1996-04-11 FR FR9604518A patent/FR2733099A1/fr active Pending
- 1996-04-11 DE DE19614354A patent/DE19614354C2/de not_active Expired - Lifetime
- 1996-04-11 IT IT96MI000687A patent/IT1285197B1/it active IP Right Grant
Also Published As
Publication number | Publication date |
---|---|
GB2299902B (en) | 1999-06-09 |
KR100197913B1 (ko) | 1999-06-15 |
GB9606870D0 (en) | 1996-06-05 |
GB2299902A (en) | 1996-10-16 |
ITMI960687A0 (ja) | 1996-04-11 |
JPH08307221A (ja) | 1996-11-22 |
FR2733099A1 (fr) | 1996-10-18 |
DE19614354C2 (de) | 1998-11-05 |
ITMI960687A1 (it) | 1997-10-11 |
KR960039047A (ko) | 1996-11-21 |
DE19614354A1 (de) | 1996-10-17 |
US5563759A (en) | 1996-10-08 |
SG52684A1 (en) | 1998-09-28 |
IT1285197B1 (it) | 1998-06-03 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3040342B2 (ja) | 電力用mosゲート型回路のための制御回路 | |
JP3448340B2 (ja) | Igbt障害電流制限回路及び方法 | |
US5978192A (en) | Schmitt trigger-configured ESD protection circuit | |
US7576964B2 (en) | Overvoltage protection circuit of output MOS transistor | |
US5091664A (en) | Insulated gate bipolar transistor circuit with overcurrent protection | |
JP3758738B2 (ja) | Mosゲート型電力用半導体素子を用いた高電圧側スイッチ回路 | |
JP4271169B2 (ja) | 半導体装置 | |
JP2001008492A (ja) | 故障保護回路を備えたモータコントローラ | |
US20020021539A1 (en) | Protective circuit against overheating of a semiconductor switching device | |
JPH0340517A (ja) | パワーデバイスの駆動・保護回路 | |
JPH0213115A (ja) | 電力用電界効果トランジスタ駆動回路 | |
US8270135B2 (en) | Transistor half-bridge control | |
KR100271690B1 (ko) | 보호회로를 구비하는 반도체 장치 및 전자시스템 | |
US5457419A (en) | MOSFET with temperature protection | |
JPH05252643A (ja) | 過電圧保護回路 | |
CN112448363B (zh) | 提供车辆中的电路的过电流保护的电气安全系统 | |
JP2004129378A (ja) | 電力用半導体素子のゲート駆動回路 | |
JPH02278915A (ja) | 電力用mosfetの保護回路 | |
JPH05218836A (ja) | 絶縁ゲート素子の駆動回路 | |
US6832356B1 (en) | Gate driver for power device | |
US5943205A (en) | Driver and overload protection circuit | |
US5764466A (en) | Circuit for short circuit detection through resistive shunt in power circuits using unipolar control voltage | |
JPH07183781A (ja) | 半導体装置とその駆動装置 | |
JP2000312142A (ja) | インテリジェントパワースイッチ装置 | |
JP3476903B2 (ja) | 保護機能付き負荷駆動回路 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090303 Year of fee payment: 9 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100303 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100303 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110303 Year of fee payment: 11 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110303 Year of fee payment: 11 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110303 Year of fee payment: 11 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110303 Year of fee payment: 11 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120303 Year of fee payment: 12 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120303 Year of fee payment: 12 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130303 Year of fee payment: 13 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130303 Year of fee payment: 13 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140303 Year of fee payment: 14 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
EXPY | Cancellation because of completion of term |