JP3032003B2 - 高直線性を有するｄ／ａ変換器 - Google Patents
高直線性を有するｄ／ａ変換器Info
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- JP3032003B2 JP3032003B2 JP2506930A JP50693090A JP3032003B2 JP 3032003 B2 JP3032003 B2 JP 3032003B2 JP 2506930 A JP2506930 A JP 2506930A JP 50693090 A JP50693090 A JP 50693090A JP 3032003 B2 JP3032003 B2 JP 3032003B2
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
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Description
【発明の詳細な説明】 本発明は、ディジタル入力量をアナログ出力量に、D/
A変換器により変換する方法に関する。
A変換器により変換する方法に関する。
１つのD/A変換器によって大きな量子化領域をカバー
するためには、このD/A変換器のビット数は高く構成さ
れなければならない。この種のD/A変換器に対するコス
トは非常に高い。従って、コストを節約するためにあま
り大きな量子化領域を処理することのできない変換器を
使用することが公知である。この場合次のようにして大
きな領域が得られる。すなわち、D/A変換器固有の量子
化領域内でD/A変換器が出力電圧を細かいステップで出
力し、出力側では量子化領域の端部に達した際、付加的
電流源ないし電圧源が接続される。各電流源ないし電圧
源は出力電圧をD/A変換器の１ステップだけ粗く変化さ
せ、変換器は次に隣接するステップの間再び、アナログ
出力量の変化を細かいステップで行うのである。しか
し、変換器の構成素子公差、アナログ出力値を粗く調整
するために接続された付加的電源の構成素子公差並びに
熱的ドリフトおよび老化のため、隣接する領域に対する
粗ステップが、D/A変換器によって量子化領域端部で送
出される値に相応することの方が稀である。このような
粗ステップにより、上方または下方の値への不連続的個
所が惹起され得る。しかし形成される出力関数は、通常
連続的に経過しなければならない。
するためには、このD/A変換器のビット数は高く構成さ
れなければならない。この種のD/A変換器に対するコス
トは非常に高い。従って、コストを節約するためにあま
り大きな量子化領域を処理することのできない変換器を
使用することが公知である。この場合次のようにして大
きな領域が得られる。すなわち、D/A変換器固有の量子
化領域内でD/A変換器が出力電圧を細かいステップで出
力し、出力側では量子化領域の端部に達した際、付加的
電流源ないし電圧源が接続される。各電流源ないし電圧
源は出力電圧をD/A変換器の１ステップだけ粗く変化さ
せ、変換器は次に隣接するステップの間再び、アナログ
出力量の変化を細かいステップで行うのである。しか
し、変換器の構成素子公差、アナログ出力値を粗く調整
するために接続された付加的電源の構成素子公差並びに
熱的ドリフトおよび老化のため、隣接する領域に対する
粗ステップが、D/A変換器によって量子化領域端部で送
出される値に相応することの方が稀である。このような
粗ステップにより、上方または下方の値への不連続的個
所が惹起され得る。しかし形成される出力関数は、通常
連続的に経過しなければならない。
例えば自動選局回路において同調電圧をディジタル段
で次のように変化することが公知である。すなわち、全
同調電圧領域が粗ステップで変化され、この粗ステップ
内で同調電圧が微ステップで変化されるようにするので
ある。微ステップで走査された粗ステップの終了時に次
の粗ステップが投入接続される。この粗ステップの開始
点は直前に調整された値の上側にあることもある。その
ためこの開始から再びステップへ始まる同調電圧値が検
出されない。従い公知の回路装置では次の粗ステップの
移行の際、新たに調整される粗ステップの開始が直前に
達した値の常に下側にあるようにする。この手段は同調
電圧従い放送局が飛び越されることを確実に阻止する
（DE3037021）。しかしこの手段は出力関数に跳躍の発
生することを阻止しない。このことは放送局探索の際に
は問題とならない。しかしその他の場合、例えば音声再
生装置で音量を調整する際、この種の不連続性は問題と
なる。
で次のように変化することが公知である。すなわち、全
同調電圧領域が粗ステップで変化され、この粗ステップ
内で同調電圧が微ステップで変化されるようにするので
ある。微ステップで走査された粗ステップの終了時に次
の粗ステップが投入接続される。この粗ステップの開始
点は直前に調整された値の上側にあることもある。その
ためこの開始から再びステップへ始まる同調電圧値が検
出されない。従い公知の回路装置では次の粗ステップの
移行の際、新たに調整される粗ステップの開始が直前に
達した値の常に下側にあるようにする。この手段は同調
電圧従い放送局が飛び越されることを確実に阻止する
（DE3037021）。しかしこの手段は出力関数に跳躍の発
生することを阻止しない。このことは放送局探索の際に
は問題とならない。しかしその他の場合、例えば音声再
生装置で音量を調整する際、この種の不連続性は問題と
なる。
本発明の課題は、接続可能な付加的電源を備えた、量
子化領域の狭いD/A変換器を用いたD/A変換方法におい
て、出力関数から不連続個所が消失するように改善する
ことである。この課題は請求項１に記載された方法によ
り解決される。
子化領域の狭いD/A変換器を用いたD/A変換方法におい
て、出力関数から不連続個所が消失するように改善する
ことである。この課題は請求項１に記載された方法によ
り解決される。
以下本発明を図面を用いて説明する。
図１は、従来の技術から公知の回路構成を示し、 図２は、図１に所属する曲線経過を示し、 図３は、本発明による回路を示し、 図４と図５は、図３の回路の特性曲線を示し、 図６は、本発明の簡単化した回路図を示し、 図７は、図６の説明に用いる線図であり、 図８は、本発明の別の実施例を示し、 図９は、図８の説明に用いる線図である。
図１には図２と関連して従来技術による回路がどのよ
うに動作するかが例で示されている。制御回路、例えば
マイクロプロセッサ１はその出力側Ｄに、0000 0000か
ら1111 1111へディジタルステップで増分される２進信
号を出力する。このディジタル信号はD/A変換器２へ出
力され、微ステップで変化するアナログ出力信号がその
出力側a1から取り出される。ディジタル値が1111 1111
に達すると、マイクロプロセッサ１は出力Ｄを、形成す
べき出力信号をさらに高める際に0000 0000に切り換
え、付加的に別のD/A変換器２と出力側a2を介して１組
ステップだけさらに切り換える。この１粗ステップはD/
A変換器２の量子化領域に相応する。２つの出力側a1とa
2は加算段４を介して出力側Ａに出力される。この出力
側Ａからアナログ信号が取り出される。D/A変換器３は
４ビット変換器として示されている。従い、この変換器
はその出力側a2に16粗ステップを形成することができ
る。D/A変換器３は相応のディジタル接続可能電流源ま
たは電圧源により置換することもできる。この装置によ
りｎステップで検出される領域は式ｎ（2^8−１）によ
り定められる。
うに動作するかが例で示されている。制御回路、例えば
マイクロプロセッサ１はその出力側Ｄに、0000 0000か
ら1111 1111へディジタルステップで増分される２進信
号を出力する。このディジタル信号はD/A変換器２へ出
力され、微ステップで変化するアナログ出力信号がその
出力側a1から取り出される。ディジタル値が1111 1111
に達すると、マイクロプロセッサ１は出力Ｄを、形成す
べき出力信号をさらに高める際に0000 0000に切り換
え、付加的に別のD/A変換器２と出力側a2を介して１組
ステップだけさらに切り換える。この１粗ステップはD/
A変換器２の量子化領域に相応する。２つの出力側a1とa
2は加算段４を介して出力側Ａに出力される。この出力
側Ａからアナログ信号が取り出される。D/A変換器３は
４ビット変換器として示されている。従い、この変換器
はその出力側a2に16粗ステップを形成することができ
る。D/A変換器３は相応のディジタル接続可能電流源ま
たは電圧源により置換することもできる。この装置によ
りｎステップで検出される領域は式ｎ（2^8−１）によ
り定められる。
図２に示されているように、粗いステップから次の粗
いステップへの移行個所には不連続性が生じる。という
のは、粗いステップがD/A変換器の量子化領域に正確に
は相応しないからである。これは例えば構成素子公差ま
たは他の影響による。このような不連続性は、X1からX
1′に示したような下方への信号変化またはX2からX2′
に示したような上方への信号変化を生じる。しかしこの
ような信号経過は上に述べた理由から不所望のものであ
る。
いステップへの移行個所には不連続性が生じる。という
のは、粗いステップがD/A変換器の量子化領域に正確に
は相応しないからである。これは例えば構成素子公差ま
たは他の影響による。このような不連続性は、X1からX
1′に示したような下方への信号変化またはX2からX2′
に示したような上方への信号変化を生じる。しかしこの
ような信号経過は上に述べた理由から不所望のものであ
る。
この不都合な状態を取り除くため、図３の回路が作製
された。この回路の作用を図４に関連して説明する。こ
こでは３つの閾値S1〜S3が形成される。公知の回路に対
し付加的に３つの比較器K1、K2、K3が出力側Ａに接続さ
れる。これらの比較器は形成された出力電圧を種々異な
る基準電圧と比較する。この種々異なる基準電圧は例え
ば固定の基準電圧Ｕに接続された分圧器により形成する
ことができる。分圧器は抵抗W1、W2、W3からなる。しか
し抵抗は別のD/A変換器を介して構成することもでき
る。その際それぞれの閾値は、D/A変換器２の入力値111
1 1111がｎ番目の粗ステップで達することとなる値より
も下側にあり、かつD/A変換器２の入力値0000 0000が
（ｎ＋１）番目の粗ステップで調整される値よりも上側
にある値でなければならない。このようにして幅Ｂのオ
ーバラップ領域が発生する。出力電圧がこの閾値の１つ
を上回ると直ちに、相応の比較器K1、K2ないしK3がマイ
クロプロセッサ１に信号を送出する。マイクロプロセッ
サはこれに基づき次の粗ステップを開始し、同時にD/A
変換器２にオフセットを印加する。
された。この回路の作用を図４に関連して説明する。こ
こでは３つの閾値S1〜S3が形成される。公知の回路に対
し付加的に３つの比較器K1、K2、K3が出力側Ａに接続さ
れる。これらの比較器は形成された出力電圧を種々異な
る基準電圧と比較する。この種々異なる基準電圧は例え
ば固定の基準電圧Ｕに接続された分圧器により形成する
ことができる。分圧器は抵抗W1、W2、W3からなる。しか
し抵抗は別のD/A変換器を介して構成することもでき
る。その際それぞれの閾値は、D/A変換器２の入力値111
1 1111がｎ番目の粗ステップで達することとなる値より
も下側にあり、かつD/A変換器２の入力値0000 0000が
（ｎ＋１）番目の粗ステップで調整される値よりも上側
にある値でなければならない。このようにして幅Ｂのオ
ーバラップ領域が発生する。出力電圧がこの閾値の１つ
を上回ると直ちに、相応の比較器K1、K2ないしK3がマイ
クロプロセッサ１に信号を送出する。マイクロプロセッ
サはこれに基づき次の粗ステップを開始し、同時にD/A
変換器２にオフセットを印加する。
図４の回路の機能を説明する際、マイクロプロセッサ
１の出力Ｄは値0000 0000から始まりディジタルで公知
のように増分計数されることを前提とする。第１の粗ス
テップ内でその最終値1111 1111に達する前に、出力側
Ａの信号は閾値S1に達する。この閾値S1は例えば値1111
1011に相応することができる。この値または最終値に
達するまでに生じる差分値はマイクロプロセッサ１のメ
モリにファイルされている。同時に出力側Ｄは0000 000
0にセットされ、次の粗ステップが開始される。この粗
ステップは閾値S1の下側になければならない。そのとこ
ろからD/A変換器２は新たに、閾値S1に再び達するまで
増分計数する。このディジタル値、例えば0000 0011も
ファイルされている。曲線経過のこの個所を明確にする
ため、図４のａに拡大して示してある。さらに増分計数
すると、第１の粗ステップ内で閾値S2に達する。この閾
値S2はディジタル入力信号1111 1101に相応することが
でき、やはりファイルされている。ここでも最終的まで
の差分をファイルしておくことができる。ディジタル入
力信号をゼロセットすることにより第２の粗ステップが
開始され、D/A変換器２は再び閾値S2に達するまで増分
計数する。この閾値S2では入力値は0000 0110であり、
これもファイルされている。この瞬間は図４のｂに拡大
して示されている。
１の出力Ｄは値0000 0000から始まりディジタルで公知
のように増分計数されることを前提とする。第１の粗ス
テップ内でその最終値1111 1111に達する前に、出力側
Ａの信号は閾値S1に達する。この閾値S1は例えば値1111
1011に相応することができる。この値または最終値に
達するまでに生じる差分値はマイクロプロセッサ１のメ
モリにファイルされている。同時に出力側Ｄは0000 000
0にセットされ、次の粗ステップが開始される。この粗
ステップは閾値S1の下側になければならない。そのとこ
ろからD/A変換器２は新たに、閾値S1に再び達するまで
増分計数する。このディジタル値、例えば0000 0011も
ファイルされている。曲線経過のこの個所を明確にする
ため、図４のａに拡大して示してある。さらに増分計数
すると、第１の粗ステップ内で閾値S2に達する。この閾
値S2はディジタル入力信号1111 1101に相応することが
でき、やはりファイルされている。ここでも最終的まで
の差分をファイルしておくことができる。ディジタル入
力信号をゼロセットすることにより第２の粗ステップが
開始され、D/A変換器２は再び閾値S2に達するまで増分
計数する。この閾値S2では入力値は0000 0110であり、
これもファイルされている。この瞬間は図４のｂに拡大
して示されている。
図５にはD/A変換器２の出力関数が示されている。こ
の関数は最初の較正とファイルに従い生じる。次の粗ス
テップへ切替わる個所に不連続性がもはや存在していな
いことが明瞭に示されている。
の関数は最初の較正とファイルに従い生じる。次の粗ス
テップへ切替わる個所に不連続性がもはや存在していな
いことが明瞭に示されている。
図６には４つだけの粗ステップに対する簡単な例が示
されている、ここでは粗いD/A変換器３に対して２ビッ
トが必要である。（2^n−１）＝３の比較器が必要とな
る図３の実施例とは異なり、比較器の数は２に減少し、
図３ではｎ＝４であれば15個の比較器が必要であるが、
ｎ＝４の場合４に減少している。第１の（2^0）番目の
ステップは零から閾値S1に達する。第２の（2^1）番目
のステップは閾値S1から閾値S2に達する。第３の（2^0
＋2^1）番目のステップは閾値S2から閾値S3に達する。
第４の（2^2）番目のステップは閾値S3から開始する。D
/A変換器２に対して次の粗ステップへ移行するのために
オフセット値を形成することは、ここではこれをD/A変
換器３の重み付け制御に相応してオフセット値を記憶す
ることにより行われる。それにより、粗ステップの開始
時に相応のオフセット値が調整される。
されている、ここでは粗いD/A変換器３に対して２ビッ
トが必要である。（2^n−１）＝３の比較器が必要とな
る図３の実施例とは異なり、比較器の数は２に減少し、
図３ではｎ＝４であれば15個の比較器が必要であるが、
ｎ＝４の場合４に減少している。第１の（2^0）番目の
ステップは零から閾値S1に達する。第２の（2^1）番目
のステップは閾値S1から閾値S2に達する。第３の（2^0
＋2^1）番目のステップは閾値S2から閾値S3に達する。
第４の（2^2）番目のステップは閾値S3から開始する。D
/A変換器２に対して次の粗ステップへ移行するのために
オフセット値を形成することは、ここではこれをD/A変
換器３の重み付け制御に相応してオフセット値を記憶す
ることにより行われる。それにより、粗ステップの開始
時に相応のオフセット値が調整される。
この実施例を図７を用いて明確にする。第１の（2^
0）番目の粗ステップST1では、D/A変換器２にオフセッ
ト値０が印加される。第２の（2^1）番目の粗ステップS
T2に切り換えるため第１の閾値S1に達した際、求められ
たオフセット値OS1は＋４であるとする。第３の粗ステ
ップST3において第２の閾値S2に達した際、求められた
オフセット値は＋２とする。第４の粗ステップST4に切
り換えるため第３の閾値S3に達した際、第３の粗ステッ
プのオフセット値OS3（＋２）に、第２の粗ステップST2
の記憶されているオフセット値OS2（＋４）が加算され
る。すなわち、＋６の新しいオフセット値が生じる。
0）番目の粗ステップST1では、D/A変換器２にオフセッ
ト値０が印加される。第２の（2^1）番目の粗ステップS
T2に切り換えるため第１の閾値S1に達した際、求められ
たオフセット値OS1は＋４であるとする。第３の粗ステ
ップST3において第２の閾値S2に達した際、求められた
オフセット値は＋２とする。第４の粗ステップST4に切
り換えるため第３の閾値S3に達した際、第３の粗ステッ
プのオフセット値OS3（＋２）に、第２の粗ステップST2
の記憶されているオフセット値OS2（＋４）が加算され
る。すなわち、＋６の新しいオフセット値が生じる。
図８にはさらに別の実施例が示されている。この実施
例では、隣接する粗ステップへの切換および開始を唯１
つの比較器Ｋにより処理することができる。そのため、
この比較器の第１入力側にはＡに形成されたアナログ出
力電圧が印加される。第２の入力側はオフセット電圧を
受け取る。このオフセット電圧はa2にてD/A変換器３か
ら取り出される。このオフセット電圧に固定のオフセッ
ト電圧U0が重畳される。
例では、隣接する粗ステップへの切換および開始を唯１
つの比較器Ｋにより処理することができる。そのため、
この比較器の第１入力側にはＡに形成されたアナログ出
力電圧が印加される。第２の入力側はオフセット電圧を
受け取る。このオフセット電圧はa2にてD/A変換器３か
ら取り出される。このオフセット電圧に固定のオフセッ
ト電圧U0が重畳される。
図９にはこのことが詳細に示されている。ここにはア
ナログ出力量Ａの経過がディジタル入力値Ｄに依存して
示されている。ここでも、粗ステップA0,A1,A2,A3はD/A
変換器３により形成され、粗ステップ内の微ステップは
D/A変換器２により形成される。第１の粗ステップは値A
0で開始し、第２の粗ステップは値A1で開始する。等
々。粗ステップのステップ幅はＧであるとする。D/A変
換器３により形成される粗ステップの開始時に、D/A変
換器２はその最小値、例えば零を送出する。閾値Uref1
〜Uref3は、D/A変換器２による最大可能なアナログ値
（この値は粗ステップｎ内にある）と、D/A変換器２が
零にセットされた後であって、隣接する粗ステップ（ｎ
＋１）の開始に相応する値との間にそれぞれある。閾値
Urefはオフセット電圧U0を粗ステップｎの値に重畳する
ことにより形成される。ここでU0の大きさは、ステップ
幅Ｇに、上に定義したオーバラップ領域Ｂを式U0＝Ｇ＋
ｂに従い加算することで得られる。有利には、ｂに0.5B
を選択する。このようにすると、ステップｎに対して基
準電圧Urefが一般的から得られる。
ナログ出力量Ａの経過がディジタル入力値Ｄに依存して
示されている。ここでも、粗ステップA0,A1,A2,A3はD/A
変換器３により形成され、粗ステップ内の微ステップは
D/A変換器２により形成される。第１の粗ステップは値A
0で開始し、第２の粗ステップは値A1で開始する。等
々。粗ステップのステップ幅はＧであるとする。D/A変
換器３により形成される粗ステップの開始時に、D/A変
換器２はその最小値、例えば零を送出する。閾値Uref1
〜Uref3は、D/A変換器２による最大可能なアナログ値
（この値は粗ステップｎ内にある）と、D/A変換器２が
零にセットされた後であって、隣接する粗ステップ（ｎ
＋１）の開始に相応する値との間にそれぞれある。閾値
Urefはオフセット電圧U0を粗ステップｎの値に重畳する
ことにより形成される。ここでU0の大きさは、ステップ
幅Ｇに、上に定義したオーバラップ領域Ｂを式U0＝Ｇ＋
ｂに従い加算することで得られる。有利には、ｂに0.5B
を選択する。このようにすると、ステップｎに対して基
準電圧Urefが一般的から得られる。
Urefn＝An−１＋Ｇ＋ｂ 上の説明は出力量Ａの増分計数に関連する。出力量Ａ
を減算計数する場合は、基準電圧Urefを切り換えなけれ
ばならない。これは図８に、所定量Ｇの電源を橋絡する
ことにより象徴的に示されている。橋絡はマイクロプロ
セッサ１により線路I/Dを介して制御される。減算計数
の場合の基準電圧はステップｎに対して式、 Urefn＝An−１＋ｂ に従い定められる。すなわち、これは増分計数の場合の
先行するステップ（ｎ−１）の基準電圧と同じ大きさで
ある。
を減算計数する場合は、基準電圧Urefを切り換えなけれ
ばならない。これは図８に、所定量Ｇの電源を橋絡する
ことにより象徴的に示されている。橋絡はマイクロプロ
セッサ１により線路I/Dを介して制御される。減算計数
の場合の基準電圧はステップｎに対して式、 Urefn＝An−１＋ｂ に従い定められる。すなわち、これは増分計数の場合の
先行するステップ（ｎ−１）の基準電圧と同じ大きさで
ある。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭57−53144（ＪＰ，Ａ) 特開 昭55−137723（ＪＰ，Ａ) 特開 昭58−10920（ＪＰ，Ａ) 特開 昭60−185429（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H03M 1/10
Claims (6)
- 【請求項１】ディジタル入力量をアナログ出力量に第１
のD/A変換器（２）を用いて変換する方法であって、 前記第１のD/A変換器（２）はアナログ出力量を微ステ
ップで増分計数し、さらにアナログ出力量を粗いディジ
タルステップで変換する第２のD/A変換器（３）を有
し、 当該粗いディジタルステップにより、第１のD/A変換器
（２）のすべての微ステップによる最大可能な変化より
も小さなアナログ出力値が変化が生じ、 これによりオーバラップ領域（Ｂ）を形成し、 微ステップのD/A変換器（２）の変換結果と、粗ステッ
プのD/A変換器（３）の変換結果とが加算装置（４）で
加算され、 補正値をアナログ出力信号（Ａ）における非線形性の除
去のために用いる形式の変換方法において、 校正中に閾値（Ｓ）を前記オーバラップ領域（Ｂ）内に
設定し、 比較回路（Ｋ）によって当該閾値（Ｓ）と前記アナログ
出力値（Ａ）とを比較し、 前記比較器（Ｋ）が、前記アナログ出力値（Ａ）が前記
閾値（Ｓ）達することを検出する際、第１のD/A変換器
（２）の相応する第１のディジタル入力値を記憶し、そ
の後、第１のD/A変換器（２）の値を零にセットし、 次の粗ステップを開始し、 その後、閾値（Ｓ）に新たに達するまで第１のD/A変換
器（２）のディジタル入力値を増分計数し、得られた第
２のディジタル入力値を同様に記憶し、 通常動作中に、アナログ出力信号（Ａ）が第１のD/A変
換器（２）の連続的増分によって形成されるときであっ
て、かつ前記記憶した第１のディジタル値に達すると
き、相応する粗ステップを開始し、 第１のD/A変換器（２）に同時に、記憶した第２のディ
ジタル値より１微ディジタルステップだけ高めたディジ
タル値をオフセットとして印加し、 第１のD/A変換器（２）の連続的減分計数によってアナ
ログ出力信号が形成されるときであって、記憶した第２
のディジタル値に達するときに、粗ステップを切り替
え、 第１のD/A変換器（２）に、この記憶した第２のディジ
タル値から１微ステップだけ減算した値をオフセットと
して印加する、ことを特徴とする変換方法。 - 【請求項２】相応する比較器（K1〜K3）による複数の閾
値（S1、S2、……Sn）を、第１のD/A変換器（２）の量
子化領域に等しい間隔で設け、当該閾値を表すディジタ
ル値を校正中に記憶する請求項１記載の方法。 - 【請求項３】比較器（K1〜K3）は、記憶した第１および
第２のディジタル値が閾値（Ｓ）に達した際、前記ディ
ジタル値の記憶に対する信号を出力する請求項１から２
までのいずれか１記載の方法。 - 【請求項４】粗ステップを、ディジタルで接続可能な電
流源を用いて形成する請求項１から３までのいずれか１
記載の方法。 - 【請求項５】第１のD/A変換器（２）に対するオフセッ
トとして切り替えのために使用される値を、第２のD/A
変換器（３）をトリガするパルス値に依存して記憶する
請求項１から４までのいずれか１記載の方法。 - 【請求項６】専用比較器（Ｋ）を、通常動作中に次の粗
ステップに切り替えるために用い、 該比較器の第１の入力側には形成されたアナログ出力量
が印加され、 第２のD/A変換器（３）の粗ステップの値（ｎ＊Ｇ）に
相応するオフセット電圧（Uref）がその第２の入力側に
印加され、 前記オフセット電圧には、該値に電圧（U0）が加算さ
れ、 前記電圧（U0）は、出力信号の変化の方向に依存して切
換可能であり、 値Ｇ＋ｂは、出力信号の増分計数の際には電圧（U0）に
相応し、出力信号の減算計数の際には値ｂに相応し、 ｂはオーバラップ領域（Ｂ）の端数に相応する請求項１
から５のいずれか１記載の方法。
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