JP2979923B2 - 半導体装置 - Google Patents
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- Y10S257/925—Bridge rectifier module
Description
どに適用する電力変換用の半導体装置に関する。
およびインバータ回路を図3,図4に示す。図3におい
て、1は半導体装置の外形が方形状になるパッケージ、
2,3は正,負の直流入力端子(P,N)、4は交流出
力端子(U,V,W)、5はパッケージ1内に組み込ま
れた半導体チップ(例えばIGBT)の制御用端子であ
り、各端子2〜5はパッケージ1の上面に図示のような
レイアウトで分散配列されている。また、パッケージ1
の内部には、図4で示すようにスイッチング用半導体チ
ップとしてのIGBT(ゲート絶縁型バイポーラトラン
ジスタ)5とフリーホイーリングダイオード6を対にし
て3相ブリッジ回路を構成するように6個組の半導体チ
ップが組み込まれている。なお、7は直流電源の整流回
路、8は交流出力側に接続して可変速度制御される電動
機である。
ミングでスイッチング動作させることにより、交流出力
端子4からの出力電圧,周波数を可変制御して電動機9
の速度制御を行うことができる。この場合に、IGBT
6のスイッチング動作により主回路電流は直流側からI
GBT6を通って交流側へ、また逆に交流側からIGB
T6,フリーホイーリングダイオード7を通って直流側
へ流れるが、IGBT6が高速でスイッチング動作する
際の電流変化率di/dtが高いために、直流側内部配線の
浮遊インダクタンス10(インダクタンス値L)によっ
てサージ電圧L×di/dtが発生する。このサージ電圧は
直流入力電圧に重畳されてIGBT6とフリーホイーリ
ングダイオード7の各チップ間に印加されるため、サー
ジ電圧がチップ耐圧を超えると素子が破壊してしまう。
このために従来では、図4で示すように正負の直流入力
端子2と3の間にサージ抑制用のスナバコンデンサ11
を接続して内部配線の浮遊インダクタンス10に起因す
るサージ電圧を低く抑える対策が採られている。
たサージ電圧保護回路では、2対の直流入力端子2,3
のうち、直流電源から遠い方の端子間(図示の右側)に
接続したスナバコンデンサ11は直流電源に近い方の端
子間に接続したスナバコンデンサと比べてサージ抑制効
果が低くなる。この解決策として、2対の直流入力端子
2,3のうち、正極の端子同士,および負極の端子同士
の間に鎖線で表した導体バー12などを外部接続した上
で、スナバコンデンサ11を正負の各端子間に接続すれ
ば、直流側主回路の電流経路は導体バー12を経由する
分を含めて2経路になって電流が分担されるので、それ
だけ大きなサージ抑制効果の得られることが期待でき
る。
の半導体装置に採用しようとすると、図3の端子配列で
は、パッケージ1の左右両端側に配した直流入力端子3
の間に挟まれる形で交流出力端子4,および端子間に設
けた絶縁隔壁13が並んでいるため、これら部品が障害
物となって直流入力端子3の間に外部接続する導体バー
12を最短距離で直線状に配線することができない。こ
のために、前記導体バー12の配線経路が長くなり、そ
のインダクタンス成分が関与して前記のスナバコンデン
サ11によるサージ抑制効果が十分に発揮できなくな
る。特に大電流容量の大形パッケージでは内部配線長が
長くなるために、この傾向大である。
であり、フリーホイーリングダイオードチップと対にし
た複数個組のスイッチング用半導体チップをブリッジ回
路構成にしてパッケージ内に組み込んだ半導体装置を対
象に、先記したスナバコンデンサ,直流入力端子の同極
端子間に外部接続した導体バーとの組合わせで内部配線
の浮遊インダクタンスに起因するサージ電圧を効果的に
抑制できるようにした半導体装置、特に有効な端子配列
構造を提供することを目的とする。
に、本発明は、フリーホイーリングダイオードチップと
対にした複数個組のスイッチング用半導体チップをブリ
ッジ回路構成にしてパッケージ内に組み込んだ半導体装
置を対象に、複数個の半導体チップを組み込んだ方形状
になるパッケージの上面に直流入力端子, 交流出力端
子, および各半導体チップの制御用端子を配列するとと
もに、パッケージの周囲4辺のうち、対向する2辺の縁
部にそれぞれ正負1対の直流入力端子を同極性同士が向
かい合せに並ぶように振り分けて配列し、残る対向2辺
の縁部に交流出力端子,制御用端子を配列して構成する
ものとする。
として、前記における直流入力端子の正極端子,および
負極端子同士の間にまたがってパッケージの上面側に直
線状の導体バーを接続する構成があり、また、この導体
バーの配線を容易に行うために、前記の直流入力端子
は、パッケージ上面の中央面域より一段高い位置に設置
するのがよい。
れ正負1対ずつ振り分けて配置した直流入力端子につい
て、正極同士,負極同士の間にまたがって導体バーを外
部接続することにより、直流電源から直流入力端子を経
て各スイッチング用半導体チップ(IGBT)に流れ込
む電流、および交流出力端子から各スイッチング用半導
体チップ,まははフリーホイーリングダイオードを経て
直流入力端子より直流電源側に流れる電流は、正負2対
の直流入力端子に二分してほぼ均等に流れるようになる
ので、各対の正負端子間に接続するスナバコンデンサな
どと組合わせることで、直流入力端子と半導体チップと
の間を結ぶ内部配線の浮遊インダクタンスに起因するサ
ージ電圧を、導体バーを外部接続しない場合に比べて半
分に低減できる。
は、同極同士がパッケージの両端に向かい合うように並
列に配置されており、かつ同極の端子間を結ぶ導体バー
の配線経路にはなんらの障害物がない。したがって、端
子間を最短距離で直線状の導体バー(導体長が短いほど
インダクタンスが小となる)により相互接続することが
でき、これによりより一層高いサージ抑制効果が得られ
る。
(c),および図2により説明する。なお、図示実施例
において、図3,図4に対応する同一部品には同じ符号
が付してある。まず、図1(a)〜(c)において、外
形が方形状になるパッケージ1に対して、その周囲4辺
のうちの対向する左右2辺の縁部には、正負1対ずつ同
極性同士が向かい合せに並ぶように直流入力端子2,3
が振り分けて平行に配列されており、残る対向2辺の一
方には交流出力端子4が、他方には制御用端子5が配列
されている。さらに、直流入力端子2,3は、パッケー
ジ1の上面周域に形成した凸状段差1aの上に設けてパ
ッケージ上面の中央面域より一段高い位置に設置されて
いる。また、パッケージ1の内部には、図4と同様にフ
リーホイーリングダイオード7と組合わせた6個組のI
GBT6で構成したブリッジ回路が組み込まれている。
タとして使用する場合には、直流入力端子2,3の正極
端子同士,および負極端子同士の間にまたがって、パッ
ケージ1の上面側に直線状の導体バー12を外部接続
し、さらに各対の正負端子間には図2で示すようにスナ
バコンデンサ11を接続する。これにより、内部配線の
浮遊インダクタンスに起因して半導体装置のスイッチン
グ動作時に発生するサージ電圧を効果的に抑制すること
ができる。この場合に、図1の構成で判るように、パッ
ケージ1の上面側には直流入力端子2,3の同極端子間
を結ぶ配線経路に突き出すような障害物がないので、直
線状の導体バー12を用いて同極端子間を最短距離で相
互接続でき、これによって高いサージ抑制効果が得られ
る。
ば、スナバコンデンサ,直流入力端子の正負同極端子間
に外部接続した導体バーと組合わせて内部配線の浮遊イ
ンダクタンスに起因するサージ電圧を抑制する場合に、
パッケージ上に配列した他の交流出力端子,制御用端子
などに制約されることなしに、直流入力端子の正負同極
間を最短長の導体バーで相互接続することができ、これ
により高いサージ抑制効果が得られる。これにより、内
部配線長が長くなる大電流容量,大形パッケージの半導
体装置でも容易に内部サージ電圧の抑制が可能となり、
これにより半導体チップに要求される耐圧をあまり高く
する必要が無くなるので、例えばオン電圧の低減,スイ
ッチング時間の短縮,スイッチング損失の低減など、他
の特性面での改善効果が期待できる。
構造図であり、(a)は平面図(b)は側面図、(c)
は正面図
ッケージ構造図であり、(a)は平面図、(b)は正面
図
Claims (3)
- 【請求項1】直流を入力として交流出力を得る電力変換
用の半導体装置であり、複数個の半導体チップを組み込
んだ方形状になるパッケージの上面に直流入力端子, 交
流出力端子, および各半導体チップの制御用端子を配列
したものにおいて、パッケージの周囲4辺のうち、対向
する2辺の縁部にそれぞれ正負1対の直流入力端子を同
極性同士が向かい合せに並ぶように振り分けて配列し、
残る対向2辺の縁部に交流出力端子,制御用端子を配列
したことを特徴とする半導体装置。 - 【請求項2】請求項1記載の半導体装置において、直流
入力端子の正極端子,および負極端子同士の間にまたが
ってパッケージの上面側に直線状の導体バーを外部接続
したことを特徴とする半導体装置。 - 【請求項3】請求項1または2記載の半導体装置におい
て、直流入力端子をパッケージ上面の中央面域より一段
高い位置に設置したことを特徴とする半導体装置。
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