JP2867495B2 - ヒットレス切替方式 - Google Patents
ヒットレス切替方式Info
- Publication number
- JP2867495B2 JP2867495B2 JP1304282A JP30428289A JP2867495B2 JP 2867495 B2 JP2867495 B2 JP 2867495B2 JP 1304282 A JP1304282 A JP 1304282A JP 30428289 A JP30428289 A JP 30428289A JP 2867495 B2 JP2867495 B2 JP 2867495B2
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- Japan
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- signal
- phase
- working
- frame
- switching
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- Detection And Prevention Of Errors In Transmission (AREA)
- Time-Division Multiplex Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はディジタル無線通信における回線切替方式に
関し、特にビット誤りなしで現用回線と予備回線との切
替えを行うヒットレス切替方式に関する。
関し、特にビット誤りなしで現用回線と予備回線との切
替えを行うヒットレス切替方式に関する。
第２図は従来のヒットレス切替方式の一例を示す図で
あり、バッファ回路１、切替回路２、回線切替制御回路
４および位相合致判定回路６を備えている。
あり、バッファ回路１、切替回路２、回線切替制御回路
４および位相合致判定回路６を備えている。
バッファ回路１は、送信端局で２分岐されて現用回線
および予備回線を介して伝送されてきた現用信号11およ
び予備信号12をそれぞれ受け、位相合致判定回路６が出
力する遅延差制御信号17に応じて両信号の遅延差がなく
なるように制御する。この場合、回線切替制御回路４か
ら切替制御信号15を受けているときは予備信号12を基準
として遅延差を制御する。
および予備回線を介して伝送されてきた現用信号11およ
び予備信号12をそれぞれ受け、位相合致判定回路６が出
力する遅延差制御信号17に応じて両信号の遅延差がなく
なるように制御する。この場合、回線切替制御回路４か
ら切替制御信号15を受けているときは予備信号12を基準
として遅延差を制御する。
一方、位相合致判定回路６は、バッファ回路１が出力
する現用信号13および予備信号14をそれぞれ受け、両信
号をビット毎に比較して位相差を検知し、位相差に応じ
た遅延差制御信号17を生成してバッファ回路１へ送出す
ると共に、ビット毎の比較により両信号の位相が一致し
ているか不一致かを判定し、位相判定信号18を生成して
回線切替制御回路４へ出力する。
する現用信号13および予備信号14をそれぞれ受け、両信
号をビット毎に比較して位相差を検知し、位相差に応じ
た遅延差制御信号17を生成してバッファ回路１へ送出す
ると共に、ビット毎の比較により両信号の位相が一致し
ているか不一致かを判定し、位相判定信号18を生成して
回線切替制御回路４へ出力する。
回線切替制御回路４は、現用回線のビット誤り率等が
劣化したために現用回線から予備回線への切替指示信号
20を受けた場合は、位相合致判定回路６が出力している
位相判定信号18が位相一致を示しているときに、切替制
御信号15をバッファ回路１および切替回路２へ出力す
る。切替回路２は、切替制御信号15に応じ現用信号11と
予備信号12との位相が一致しているときに、現用回線か
ら予備回線へ切替えて出力信号16を出力する。
劣化したために現用回線から予備回線への切替指示信号
20を受けた場合は、位相合致判定回路６が出力している
位相判定信号18が位相一致を示しているときに、切替制
御信号15をバッファ回路１および切替回路２へ出力す
る。切替回路２は、切替制御信号15に応じ現用信号11と
予備信号12との位相が一致しているときに、現用回線か
ら予備回線へ切替えて出力信号16を出力する。
また、回線切替制御回路４は、現用回線のビット誤り
率が低減して予備回線から現用回線への切戻しを示す切
替指示信号20を受けた場合、位相判定信号18が位相一致
を示しているときに予備回線から現用回線へ切戻す切替
制御信号15を出力する。
率が低減して予備回線から現用回線への切戻しを示す切
替指示信号20を受けた場合、位相判定信号18が位相一致
を示しているときに予備回線から現用回線へ切戻す切替
制御信号15を出力する。
一般にフェージング等によって回線品質が劣化する場
合、最初にビットエラーが発生し、ビットエラーレート
の悪化に伴ってフレーム同期外れ状態となる。その後の
フェージング変動によって回線が回復する場合は、ビッ
トエラーレートが低減することによりフレーム同期が確
立し、その後に正常な状態に推移する。
合、最初にビットエラーが発生し、ビットエラーレート
の悪化に伴ってフレーム同期外れ状態となる。その後の
フェージング変動によって回線が回復する場合は、ビッ
トエラーレートが低減することによりフレーム同期が確
立し、その後に正常な状態に推移する。
上述した従来のヒットレス切替方式では、現用信号と
予備信号との位相の一致状況を検出するのに、両信号を
ビット毎に比較して判定するので検出するのに時間を要
する。この理由は、現用信号11と予備信号12とをビット
毎に比較して判定すると、両信号のデータともビット誤
りを含むため正しい判定をするには長時間比較する必要
があるからである。このため、変化の速いフェージング
等によってフレーム同期が外れる状況においては、現用
信号、予備信号にビット誤りが生じて位相が不一致とな
っているにも拘わらず不一致を示す信号の出力が遅れる
ので、ヒットレス切替えが確実に行うことができない。
予備信号との位相の一致状況を検出するのに、両信号を
ビット毎に比較して判定するので検出するのに時間を要
する。この理由は、現用信号11と予備信号12とをビット
毎に比較して判定すると、両信号のデータともビット誤
りを含むため正しい判定をするには長時間比較する必要
があるからである。このため、変化の速いフェージング
等によってフレーム同期が外れる状況においては、現用
信号、予備信号にビット誤りが生じて位相が不一致とな
っているにも拘わらず不一致を示す信号の出力が遅れる
ので、ヒットレス切替えが確実に行うことができない。
本発明の目的は、変化の速いフェージング等に対して
も、位相判定動作を追従させて、確実に切替えを行うこ
とができるヒットレス切替方式を提供することにある。
も、位相判定動作を追従させて、確実に切替えを行うこ
とができるヒットレス切替方式を提供することにある。
本発明のヒットレス切替方式は、２分岐されて現用回
線および予備回線を介してそれぞれ伝送される現用信号
および予備信号のフレームを検知しフレームの同期外れ
が生じたときにフレーム同期外れ信号を生成し出力する
フレーム同期検出手段と、前記現用信号および前記予備
信号を受け両信号の伝送遅延差がなくなるように制御し
て出力する伝送遅延吸収手段と、前記フレーム同期外れ
信号を受けたときに位相不一致を示す位相判定信号を強
制的に出力し、前記伝送遅延吸収手段から出力される現
用信号および予備信号をビット毎に比較して位相差を検
知し遅延差制御信号を生成して前記伝送遅延差吸収手段
へ出力すると共に、前記ビット毎の比較により前記両信
号の位相一致を判定したときに位相一致を示す位相判定
手段を出力する位相合致判定手段と、前記位相判定信号
が位相一致を示しているときに前記伝送遅延吸収手段か
ら出力される現用信号および予備信号のいずれかを切替
えて出力する切替手段とを備える。
線および予備回線を介してそれぞれ伝送される現用信号
および予備信号のフレームを検知しフレームの同期外れ
が生じたときにフレーム同期外れ信号を生成し出力する
フレーム同期検出手段と、前記現用信号および前記予備
信号を受け両信号の伝送遅延差がなくなるように制御し
て出力する伝送遅延吸収手段と、前記フレーム同期外れ
信号を受けたときに位相不一致を示す位相判定信号を強
制的に出力し、前記伝送遅延吸収手段から出力される現
用信号および予備信号をビット毎に比較して位相差を検
知し遅延差制御信号を生成して前記伝送遅延差吸収手段
へ出力すると共に、前記ビット毎の比較により前記両信
号の位相一致を判定したときに位相一致を示す位相判定
手段を出力する位相合致判定手段と、前記位相判定信号
が位相一致を示しているときに前記伝送遅延吸収手段か
ら出力される現用信号および予備信号のいずれかを切替
えて出力する切替手段とを備える。
次に図面を参照して本発明を説明する。
第１図は本発明の一実施例を示す図であり、バッファ
回路１、切替回路２、位相合致判定回路３、回線切替制
御回路４およびフレーム同期検知回路５を備えている。
バッファ回路１、切替回路２および回線切替制御回路４
は、第２図に示す従来のものと同様に動作する。
回路１、切替回路２、位相合致判定回路３、回線切替制
御回路４およびフレーム同期検知回路５を備えている。
バッファ回路１、切替回路２および回線切替制御回路４
は、第２図に示す従来のものと同様に動作する。
フレーム同期検知回路５は、現用信号11および予備信
号12のそれぞれのフレームを検知し、少なくとも一方が
フレーム同期外れ状態となったときに、フレーム同期外
れ信号19を位相合致判定回路３へ出力する。
号12のそれぞれのフレームを検知し、少なくとも一方が
フレーム同期外れ状態となったときに、フレーム同期外
れ信号19を位相合致判定回路３へ出力する。
位相合致判定回路３は、通常（フレーム同期外れ信号
19を受けていない状態のとき）、バッファ回路１が出力
する現用信号13および予備信号14をそれぞれ受け、両信
号をビット毎に比較して位相差を検知し、位相差に応じ
て遅延差制御信号17を生成してバッファ回路１へ送出す
る。そして、フレーム同期外れ信号19を受けたときは、
強制的に不一致と判定して位相判定信号18を出力する。
19を受けていない状態のとき）、バッファ回路１が出力
する現用信号13および予備信号14をそれぞれ受け、両信
号をビット毎に比較して位相差を検知し、位相差に応じ
て遅延差制御信号17を生成してバッファ回路１へ送出す
る。そして、フレーム同期外れ信号19を受けたときは、
強制的に不一致と判定して位相判定信号18を出力する。
回線切替制御回路４は、切替指示信号20および位相判
定信号18を受け、位相判定信号18が位相一致を示したと
きに切替制御信号15を切替回路２へ出力する。切替回路
２は、切替制御信号15に応じて回線切替えを行う。
定信号18を受け、位相判定信号18が位相一致を示したと
きに切替制御信号15を切替回路２へ出力する。切替回路
２は、切替制御信号15に応じて回線切替えを行う。
以上説明したように本発明は、フェージング等によっ
てフレーム同期が外れる状況においては、従来のように
現用信号と予備信号とをビット毎に比較して位相不一致
を判定することなく、フレーム同期外れを検知して強制
的に位相不一致と判定する。フレーム同期検知回路５は
受信信号に含まれるパターンとビット誤りの影響を受け
ない既知のフレームパターンを比較して判定されるため
従来のビット毎に判定するような長時間の比較が不要と
なるため、位相不一致の検出時間を短縮することができ
る。従って、変化の速いフェージン等に対しても確実に
ヒットレス切替を行って回線を救済することができる。
てフレーム同期が外れる状況においては、従来のように
現用信号と予備信号とをビット毎に比較して位相不一致
を判定することなく、フレーム同期外れを検知して強制
的に位相不一致と判定する。フレーム同期検知回路５は
受信信号に含まれるパターンとビット誤りの影響を受け
ない既知のフレームパターンを比較して判定されるため
従来のビット毎に判定するような長時間の比較が不要と
なるため、位相不一致の検出時間を短縮することができ
る。従って、変化の速いフェージン等に対しても確実に
ヒットレス切替を行って回線を救済することができる。
第１図は本発明の一実施例を示すブロック図、第２図は
従来のヒットレス切替方式の一例を示すブロック図であ
る。 １……バッファ回路、２……切替回路、３……位相合致
判定回路、４……回線切替制御回路、５……フレーム同
期検知回路、11,13……現用信号、12,14……予備信号、
15……切替制御信号、16……出力信号、17……遅延差制
御信号、18……位相判定信号、19……フレーム同期外れ
信号、20……切替指示信号。
従来のヒットレス切替方式の一例を示すブロック図であ
る。 １……バッファ回路、２……切替回路、３……位相合致
判定回路、４……回線切替制御回路、５……フレーム同
期検知回路、11,13……現用信号、12,14……予備信号、
15……切替制御信号、16……出力信号、17……遅延差制
御信号、18……位相判定信号、19……フレーム同期外れ
信号、20……切替指示信号。
Claims (1)
- 【請求項１】２分岐されて現用回線および予備回線を介
してそれぞれ伝送される現用信号および予備信号のフレ
ームを検知しフレームの同期外れが生じたときにフレー
ム同期外れ信号を生成し出力するフレーム同期検出手段
と、前記現用信号および前記予備信号を受け両信号の伝
送遅延差がなくなるように制御して出力する伝送遅延吸
収手段と、前記フレーム同期外れ信号を受けたときに位
相不一致を示す位相判定信号を強制的に出力し、前記伝
送遅延吸収手段から出力される現用信号および予備信号
をビット毎に比較して位相差を検知し遅延差制御信号を
生成して前記伝送遅延差吸収手段へ出力すると共に、前
記ビット毎の比較により前記両信号の位相一致を判定し
たときに位相一致を示す位相判定手段を出力する位相合
致判定手段と、前記位相判定信号が位相一致を示してい
るときに前記伝送遅延吸収手段から出力される現用信号
および予備信号のいずれかを切替えて出力する切替手段
とを備えることを特徴とするヒットレス切替方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1304282A JP2867495B2 (ja) | 1989-11-22 | 1989-11-22 | ヒットレス切替方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1304282A JP2867495B2 (ja) | 1989-11-22 | 1989-11-22 | ヒットレス切替方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03165132A JPH03165132A (ja) | 1991-07-17 |
| JP2867495B2 true JP2867495B2 (ja) | 1999-03-08 |
Family
ID=17931161
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1304282A Expired - Fee Related JP2867495B2 (ja) | 1989-11-22 | 1989-11-22 | ヒットレス切替方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2867495B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10257034A (ja) * | 1997-03-12 | 1998-09-25 | Nec Corp | 無瞬断切替装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61247142A (ja) * | 1985-04-25 | 1986-11-04 | Nec Corp | デジタル伝送路切換方式 |
-
1989
- 1989-11-22 JP JP1304282A patent/JP2867495B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03165132A (ja) | 1991-07-17 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |