JP2712465B2 - クロック選択回路 - Google Patents

クロック選択回路

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JP2712465B2
JP2712465B2 JP1003179A JP317989A JP2712465B2 JP 2712465 B2 JP2712465 B2 JP 2712465B2 JP 1003179 A JP1003179 A JP 1003179A JP 317989 A JP317989 A JP 317989A JP 2712465 B2 JP2712465 B2 JP 2712465B2
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はクロツク信号を切替え選択するクロツク選択
回路に関し、特にクロツク分配部のクロツク選択回路に
関するものである。
〔従来の技術〕
従来、この種のクロツク選択回路は、第３図に示すよ
うに否定論理積（NAND）回路22〜24から成る切替回路21
を備え、第４図（ａ）及び（ｃ）に示す０系クロツク信
号11と１系クロツク信号12の２系統のクロツク入力に対
して、第４図（ｂ）及び（ｄ）に示す０系切替信号13と
１系切替信号14の切替信号にてクロツク信号を選択する
構成となつていた。
〔発明が解決しようとする課題〕
上述した従来のクロツク選択回路は、クロツク信号と
選択信号の論理積の否定をとり、その出力の論理積の否
定をとることにより第４図（ｅ）に示すクロツク信号16
を選択していたが、これによるとクロツク信号と選択信
号が非同期であるために、第４図に示すようなタイミン
グで切替えられた場合、切替点付近に不安定なクロツク
信号（同図（ｅ）参照）が出力されてしまい、受信信号
にエラーが発生するという問題がある。
〔課題を解決するための手段〕
このような問題点を解決するため、本発明のクロツク
選択回路は、０系クロック信号と１系クロック信号の排
他的論理和をとる排他的論理和回路と、Ｄ入力端子に０
系切替信号が入力され、クロック入力端子に排他的論理
和回路の出力が入力された第１のフリップフロップと、
Ｄ入力端子に１系切替信号が入力され、クロック入力端
子に排他的論理和回路の出力が入力された第２のフリッ
プフロップと、第１のフリップフロップの出力と０系ク
ロック信号の否定論理積をとる第１の否定論理積回路
と、第２のフリップフロップの出力と１系クロック信号
の否定論理積をとる第２の否定論理積回路と、第１の否
定論理積回路の出力と第２の否定論理積回路の出力の否
定論理積をとる第３の否定論理積回路とを備え、０系と
１系の２系統のクロック信号を切替えるための、クロッ
ク信号に非同期な切替信号をクロック信号に同期させる
ようにしたものである。
〔作用〕
したがつて、本発明においては、切替信号が入力クロ
ツクに同期され、切替時の不安定なクロツクが出力され
なくなる。
〔実施例〕
次に本発明について図面を参照して説明する。
第１図は本発明によるクロツク選択回路の一実施例を
示す回路構成図である。第１図において、第２図（ａ）
及び（ｄ）に示す０系クロツク信号11と１系クロツク信
号12は、切替回路１の否定論理積（NAND）回路2,3の一
方の入力端子に入力され、その入力クロツクに対応する
第２図（ｂ）及び（ｅ）に示す切替信号13,14は各々フ
リツプフロツプ（FF）6,7に入力されていて、その出力
Ｑが前記各否定論理積回路2,3の他方の入力端子に入力
されている。そして、この２系統のクロツク信号11,12
の排他的論理和回路５の出力をフリツプフロツプ6,7の
クロツク入力に入力することにより、切替回路１の否定
論理積回路４から選択されたクロツク信号を出力クロツ
ク15として取り出すものとなつている。
このように構成されたクロツク選択回路によると、第
２図に示す２系統のクロツク信号11,12および切替信号1
3,14に位相ずれがある場合、その切替信号13,14を各フ
リツプフロツプ6,7で保持し（第２図（ｅ）及び（ｆ）
参照）、クロツク信号11,12の排他的論理和回路５の出
力をフリツプフロツプ6,7のクロツク入力に入力するこ
とにより、第２図に示すように、クロツク信号の変化点
に切替信号を同期させ、位相ずれを吸収する。これによ
り、切替信号がクロツク信号に同期され、第２図（ｇ）
に示すように、切替時の不安定クロツクが出力されなく
なる。
〔発明の効果〕
以上説明したように本発明のクロツク選択回路は、フ
リツプフロツプから成る回路により切替信号を保持して
クロツク信号に同期させることにより、クロツク信号の
切替えを安定にすることができる効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例の回路構成図、第２図は第１
図の実施例の動作説明に供するタイミングチヤート、第
３図は従来例の回路構成図、第４図は第３図の従来例の
動作説明に供するタイミングチヤートである。 １……切替回路、2,3,4……否定論理積（NAND）回路、
５……排他的論理和回路、6,7……フリツプフロツプ。

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項１】クロック信号を切替え選択するクロック選
    択回路において、 ０系クロック信号と１系クロック信号の排他的論理和を
    とる排他的論理和回路と、 Ｄ入力端子に０系切替信号が入力され、クロック入力端
    子に排他的論理和回路の出力が入力された第１のフリッ
    プフロップと、 Ｄ入力端子に１系切替信号が入力され、クロック入力端
    子に排他的論理和回路の出力が入力された第２のフリッ
    プフロップと、 第１のフリップフロップの出力と０系クロック信号の否
    定論理積をとる第１の否定論理積回路と、 第２のフリップフロップの出力と１系クロック信号の否
    定論理積をとる第２の否定論理積回路と、 第１の否定論理積回路の出力と第２の否定論理積回路の
    出力の否定論理積をとる第３の否定論理積回路とを備
    え、 ０系と１系の２系統のクロック信号を切替えるための、
    クロック信号に非同期な切替信号をクロック信号に同期
    させることを特徴とするクロック選択回路。
JP1003179A 1989-01-10 1989-01-10 クロック選択回路 Expired - Lifetime JP2712465B2 (ja)

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JPS6066517A (ja) * 1983-09-22 1985-04-16 Ricoh Co Ltd クロック切換回路

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