JP2664873B2 - 電子パッケージおよびその作製方法 - Google Patents

電子パッケージおよびその作製方法

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、電子パッケージング構
造体(アセンブリ)に関し、特にその一部にフィルム状
のフレキシブル回路基板を用いた構造体に関するもので
ある。さらに詳しくは、本発明は情報処理システム(コ
ンピュータ)の分野に用いることのできるパッケージン
グ構造体に関するものである。
【0002】
【従来の技術】米国特許第5、343、366号明細書
には、2つのフレキシブル回路基板を有する集積回路
(IC)パッケージについて記述されている。上記2つ
のフレキシブル回路基板はそれぞれ、基板の開口を通じ
て半導体チップに接合したリード線を有している。この
ような接合とすることにより、種々ある接合技術の中
で、熱圧着を用いることが可能となる。上記リード線は
その後、エポキシなどのポリマーで封止することができ
る。上記2つのフレキシブル基板は第3の共通のフレキ
シブル基板によって電気的に接続される。この基板によ
りチップが他の基板に接続される。平行に配したチップ
はエラストマーを用いてヒート・シンクに押し付け、熱
の分散を可能とする。
【0003】上述したタイプの従来の電子パッケージン
グ構造体には、例えば、米国特許第4,849,856
号、第4,914,551号、第4,962,416
号、ならびに第4,965,700号の各明細書に記述
されたものがある。また、関連した構造体について、米
国特許第5,057,969号、第5,115,964
号、第5,133,495号、ならびに第5,203,
075号の各明細書に記述されている。これらの特許に
開示されている上述のようなパッケージング構造体は一
般に、少なくとも一枚の薄膜のフレキシブル回路基板を
その一部に用いている。このような回路基板は典型的
に、少なくとも一つの回路層(例えば、クロム−銅−ク
ロム)を有する薄い誘電体(例えば、ポリイミド)の層
をその上に有している。この薄膜フレキシブル回路基板
は、他の回路基板(例えば、印刷配線板)上に配置して
電気的に接続することができ、従って、薄膜基板の各
部、すなわち回路基板の回路に接続された半導体デバイ
ス(チップ)を、上記他の回路基板上の対応する回路に
電気的に接続することができる。上記米国特許第4,8
49,856号、第4,914,551号、第4,96
2,416号、ならびに第5,057,969号の各明
細書には、このようなパッケージング構造体の代表例が
示されており、そこではこの接続手段が用いられてい
る。
【0004】今日作製されている薄膜フレキシブル回路
基板は、情報処理システムの分野で望まれるいくつかの
長所(例えば、高密度、柔軟性、製造が比較的容易であ
ることなど)を備えている。
【0005】以下の説明から分るように、本発明ではこ
のようなフレキシブル回路基板を、精密な半田技術と組
み合せて容易に用いることができ、比較的高密度の電子
パッケージ構造体を作製することができる。このような
半田技術は、本出願の出願人によって開発され非常に成
功裏に用いられたものであり、結果としての製品を比較
的低コストで得ることを可能とするものである。このよ
うな精密半田処理の例は、上記米国特許第5,133,
459号および第5,203,075号の各明細書に詳
しく記述されている。
【0006】米国特許第5,133,495号および第
5,203,075号の各明細書に記述されているよう
に、小さい半田要素(例えば、ボール)が回路基板上に
正確に配置され、十分にかつ効果的に基板が相互接続さ
れる。
【0007】以下の説明から分るように、本発明は、上
記半田要素を正確に半導体デバイス(チップ;最終的な
パッケージ構造体の一部を形成する)の下に直接配置で
きるとき、上記半田技術および同様の半田技術を、フレ
キシブル回路基板の使用と組み合せることを可能とし、
また、フレキシブル回路基板の一部を形成する導電要素
を上記半導体デバイスに電気的に接続する効果的な手段
を与える。本発明はこれらの有利な教示を従来のいくぶ
ん大まかな手法(熱圧着)と組み合せることにより、上
記手法の既知の長所からも利益(例えば、低コスト化)
を得ている。
【0008】本明細書の教示によって直ちに認識できる
上述した特徴および他の特徴を備えた電子パッケージン
グ構造体およびその作製方法は、当該技術分野において
重要な進歩をもたらすものとなろう。
【0009】
【発明が解決しようとする課題】従って本発明の目的
は、以下に説明する種々の特徴を有するパッケージおよ
びその作製方法を提供することによって、電子パッケー
ジングの技術を高めることである。
【0010】
【課題を解決するための手段】本発明は、第1の複数の
導電体を備えた面を有する第1の回路基板と、第1の回
路基板に電気的に接続され、第1の複数の導電要素を備
えた面を有する第2の回路基板とを備え、上記第2の回
路基板は材質的にフレキシブルであって少なくとも一つ
の開口を有し、そして複数のコンタクト・サイトを有し
て第2の基板にその一方の面に沿って電気的に接続され
た半導体デバイスを備えた電子パッケージを与える。第
2のフレキシブル回路基板の第1の複数の導電要素の中
の選択されたものは、開口を通じて、半導体デバイスの
コンタクト・サイトの中の選択されたもののそれぞれに
電気的に接続される。一方、前記半導体デバイスの反対
側の、第2の回路基板の第2の面に沿って設けられてい
る導電要素中の選択されたものは、第1の回路基板上の
導電要素の中の選択されたもののそれぞれに半田付けさ
れる。
【0011】また本発明は、複数の導電体を有する第1
の回路基板を用意し、第1の複数の導電要素を備えた面
を有し、少なくとも一つの開口を有する第2の回路基板
を用意し、前記導電要素は前記開口をブリッジし、前記
第2の回路基板の前記第1の複数の導電要素のそれぞれ
に、複数の半田要素を取り付け、複数のコンタクト・サ
イトを有する半導体デバイスを用意し、第1の複数の導
電要素の中の選択されたものを、第2の回路基板の開口
を通じて、半導体デバイスのコンタクト・サイトのそれ
ぞれに接合し、その後、第1の複数の導電要素のそれぞ
れの上にある複数の半田要素を第1の回路基板の導電体
のそれぞれに接合するステップを含む電子パッケージの
作製方法を与える。
【0012】
【実施例】次に本発明の実施例について図面を参照して
説明する。図1、図2に本発明の一実施例の電子パッケ
ージ10を示す。パッケージ10は第1の回路基板1
1、第2の回路基板13、ならびに半導体デバイス(チ
ップ)15を備えている。
【0013】基板11は望ましくは印刷配線板(PC
B)とし、この基板は既知のように、その内部および/
またはその上に一つ以上の導電面を備えた誘電体材料1
7を有している。このような導電面は従来より良く知ら
れているように、PCBにおける信号の伝達、電源の供
給、および/またはグランドのために典型的に用いられ
る。PCBはまた、良く知られているように、誘電体1
7の内部に間隔をおいて配置した複数の導電体を含むこ
ともできる。図1の実施例では、基板11は、その上に
複数の導電体21を有する少なくとも一つの上面19を
含み、それによって基板11、従ってパッケージ10に
おける信号伝達を可能としている。これらの導電体21
のそれぞれは、既知のように銅とすることが望ましい。
導電体21は既知のようにフラット・パッドなどとする
ことができ、また既知のように配線とすることもでき
る。また、この導電体は従来より知られているように内
部の所定の導電面(図示せず)に電気的に接続すること
も可能である(例えば、メッキ・スルーホール(図示せ
ず)を用いて)。
【0014】一つの例では、基板11の厚さは約1.5
24mm(0.060インチ)とし、全部で4つの内部
導電面を設けた(図の外部面の他に)。
【0015】第2の回路基板13は十分にフレキシブル
であり、少なくとも一つの誘電体層23を有している。
誘電体層23は少なくとも一つの面(図1の下側の面)
を有し、その面25には数個の導電要素27を備えてい
る。基板13は基板11に次のようにして電気的に接続
する。すなわち、導電要素27の中の所望のものをそれ
ぞれ、導電体21の中の所望のものに電気的に接続す
る。以下に述べるように、この接続は半田付けによって
行なう。
【0016】基板13は薄い(例えば、厚さ0.050
8mm(0.002インチ))ポリイミド誘電体層(2
3)とすることが望ましく、また面25の図中下側の導
電要素27は銅とすることが望ましい。フレキシブル回
路基板に、ポリイミドおよび銅の導電要素を用いること
は従来より行なわれているので、さらなる説明は省略す
る。図1の実施例において、各導電要素27は、導電体
21と同様、配線などである他に、金属パッドであって
もよい。また、重要なことであるが、基板13の各開口
をブリッジするための導電要素、即ち各開口を挟む2つ
の領域の間にかけられた導電要素は、開口を横断して突
出する銅のリード線であることが望ましく、そして細長
い形状であることが望ましい(図2)。 図1及び図2
に示すように、第2の回路基板13のうち半導体デバイ
ス15のコンタクト・サイト41のそれぞれに対向する
部分は開口31とされている。そしてコンタクト・サイ
ト41に対するボンディングは開口31の上で行われて
いる。コンタクト・サイト41に接続されるリード線即
ち導電要素は2種類あり、一つは第2の回路基板13の
上面25’に設けられている導電要素27’Aであり、
そして他は下面25に設けられている導電要素27Aで
ある。導電要素27’Aは、上面25’のうち開口31
を挟む2つの領域の間に開口31を渡るようにかけられ
た細長いリード線部材であり、そして図2に示すよう
に、半導体デバイス15のコンタクト・サイト41は、
開口31の上で導電要素27’Aにボンディングされて
いる。この場合、開口31内は空間のままにされてい
る。図1及び図2に示すように、導電要素27Aは、下
面25のうち開口31を挟む2つの領域のうちの一方の
領域に固定された一端部と、この一端部に連続し開口3
1内をコンタクト・サイト41に向かって延びコンタク
ト・サイトに接触してから再び下面25に向けて延びる
中間部と、この中間部に連続し2つの領域のうち他方の
領域に固定された他端部とを有する。そしてこの場合、
開口31内の空間には中間部だけが設けられている。以
下、これらをブリッジ導電要素と呼ぶ。
【0017】上述のように、基板13は少なくとも一つ
の開口31を有し、図2に示すように、基板13のセグ
メント部33を取り囲む、連続的な形となっている。し
かし本発明はこれに限定されるものではなく、基板のポ
リイミド層に所定の形の個別の開口が配置され、各リー
ド線により各開口をブリッジするようになっていてもよ
い。取り囲む形の連続的な開口31を設けた場合には、
各ブリッジ導電要素27Aは、それが基板13の下面に
配置されているか、あるいは上面に配置されているか
(あるいは両面に配置されているか)にかかわらず、セ
グメント部33を基板の他の部分に対して位置合わせし
て配置する役割を果たす。
【0018】フレキシブル基板13はさらに望ましくは
導電要素27′を、面25の反対側の面25′に有して
いる。要素27′は要素27と同様の構成とすることが
でき、また同様の導電材料とすることができる。また、
要素27′及び27’Aを所望の要素27に、例えば既
知のメッキ・スルーホール技術を用いて、接続すること
も本発明に含まれる。図1にその代表例を符号35によ
って示す。開口31のブリッジのためのものを除いて、
すべての要素27,27′はこのような導電スルーホー
ルによって相互に接続することができる。図1には、開
口をブリッジする、導電要素27A及び27’Aを示
す。図2では、数本のこのようなブリッジのための導電
要素27′Aを、数本の下側のブリッジ導電要素27A
と共に示す。図に示したブリッジ導電要素の数はあくま
でも一例であり、本発明はこれに限定されるものではな
い。具体的には、下側ブリッジ導電要素27Aの数は例
えば全部で60本とし、一方、上側ブリッジ導電要素2
7′Aの数は560本とすることができる。
【0019】チップ15は、その底面に所定のパターン
で間隔をおいて配置された複数のコンタクト・サイト4
1を含んでいる。このようなコンタクト・サイトは従来
より知られており、半導体チップ上に典型的に設けられ
ている。本発明の一実施例では、本発明のパッケージ構
造体に用いる一つのチップに全部で620個のこのよう
なサイトを設けた。なお、図2に示したサイト41はあ
くまでも説明のためのものであり、本発明はこれに限定
されるものではない。
【0020】本発明では、基板13の下側のブリッジ導
電要素27Aからいくつかを選択し、それらを、チップ
15上のコンタクト・サイト41の選択したものに熱圧
着する。さらに、上側のブリッジ導電要素27′Aも同
様に取り付ける。重要なことであるが、要素27A,2
7′Aの両方の取り付けは、基板13の開口31を横断
するように行なわれる。さらに重要なことであるが、こ
の比較的大まかな取り付け(熱圧着)は、本発明の構造
体を作製する手順の一部として、下側導電要素27に半
田要素(ボール)を取り付けることによって行なう。こ
の半田付けについては以下にさらに詳しく説明する。熱
圧着はマイクロ電子技術において既知の手法であり、従
ってさらなる説明は省略する。
【0021】図2では、各ブリッジ導電要素27A,2
7′Aは長方形であり、隣接する開口31を横断して延
在している。図から分るように、これらは対応する各導
電要素(27あるいは27′)に電気的に接続されてお
り、これらの要素を含む所望の回路を形成している。
【0022】最も重要なことであるが、図1と図2とを
比較して分るように、本発明は、フレキシブル回路基板
の両面上の導電要素をチップに効果的に接続する手段を
与えることができ、同時に、上記導電要素と、より固い
他の基板(例えば、PCB)上の各導電体とを電気的に
効果的に接続することを可能とする。この後者の接続の
際、半田要素を効果的に用い、独特の手法として、それ
らをチップとは反対側のフレキシブル基板の面上で、チ
ップの直下に配置する。図2より分るように、数個の半
田要素51を、基板13のセグメント33上で、チップ
15の直下に設けることができる(基板の他の選択され
た部分に設けた、より多くの半田要素51に加えて)。
【0023】本発明の望ましい実施例では、半田要素5
1は最初は、下側の導電体27の選択されたものに、上
記米国特許第5,203,075号明細書に詳しく記述
されているような手順によって、設ける。具体的には、
半田ペースト(図示せず)を望ましくこれらの選択され
た要素27に塗布し、次に球形の半田部材(ボール)を
ペースト上に配置する。その後、加熱してペーストをボ
ール状にさせ、そして半田ボールのまわりに凝固させ
る。半田としては2種類のものを用いる。望ましいペー
ストとしては、すず:鉛が63:37の半田を用い、一
方、個々の半田ボールにはすず:鉛が10:90の半田
を用いる。後者は半田ペーストより高い融点を有してお
り、そのことは、米国特許第5,203,075号明細
書に示されているように、いくつかの点で有利である。
【0024】本発明の他の実施例では、ペーストを用い
る必要はなく、その代りに、個々の球形の半田要素(ボ
ール)を各導電要素に対して位置合わせし、そして加熱
し、ボールを部分的に変形させて(溶融させる)、要素
27に接続する。このような処理は、上記米国特許第
5,133,495号明細書に記述されているものと同
様のものである。
【0025】図3に、上述した種々のステップを表すフ
ローチャートを示す。これから分るように、本発明の重
要な特徴は、まず、最初にフレキシブル基板の選定した
導電要素上に半田要素を配置することであり、そして次
に半田要素が正確に配置されたその基板に対して、比較
的大まかな処理(熱圧着)を行って、このような導電要
素の他のものを半導体デバイス上の選定されたコンタク
ト・サイトに電気的に十分に接続し、その結果、フレキ
シブル回路基板の外側の領域と共に、半導体デバイスの
下(反対側)の部分に、半田要素51の中の選択したも
のを配置できるようにすることである。ここで用いる熱
圧着ではシングル・ポイント接合を行ない、熱圧着ボン
ディング・ツールは各開口31内に延びて(突入し
て)、要素27A(あるいは27′A)と係合し、チッ
プ15に対する効果的な接続を行う。この手順の後、半
導体デバイス−フレキシブル回路サブアセンブリを、基
板11に対して位置合わせし、基板13上の半田要素5
1が基板11上の各導電体(21)に対して正確に一致
するようにする。このような位置合わせは、表面マウン
ト・アセンブリ作業の際に広く用いられているスプリッ
ト光学配置ツールによって望ましく行なう。サブアセン
ブリの半田要素51は、米国特許第5,203,075
号明細書に記述されているようにして、各半田ペースト
・サイト(ペーストは図示せず)上に配置する。次に、
この位置合わせした構造体に熱を効果的に加え、半田ペ
ーストをリフロー(溶融)させて、各導電体21に接続
させる。望ましくは、半田ペーストの組成はすず:鉛が
63:37とし、リフローは約200°Cの温度で行な
う。
【0026】以上、電子パッケージおよびその作製方法
について記述した。この方法は、2つの技術(熱圧着お
よび半田付け)を組み合せて、比較的簡単な構成の最終
構造体を得るものであり、そして比較的簡単に電子パッ
ケージを作製することを可能とするものである。半導体
チップ上のコンタクト・サイトの各パターンと、最終的
な構造体を形成する2つの基板(フレキシブルおよび硬
質)の各要素および導電体とを正確に、そして十分かつ
効果的に電気接続することができる。同じく重要なこと
であるが、以上の結果、比較的高密度(平方インチ当た
りの線の数)の構造体が得られる。このことも情報処理
システムの分野では重要である。従って、本発明によっ
て作製したものは、現在の多くの情報処理システム(コ
ンピュータ)環境において使用でき、切迫した高密度化
に対する要求に答えることができる。さらに、本発明は
比較的大規模に実施することができ(マスプロダクショ
ン)、従って、種々の特徴(例えば、コスト)による利
益を享受することができる。
【0027】現時点で望ましいと考えられる本発明の実
施例ついて記述したが、当業者にとって明らかなよう
に、本発明の範囲から逸脱することなく種々に変形した
り、変更を加えることは可能である。
【0028】まとめとして、本発明の構成に関して以下
の事項を開示する。 (1)複数の導電体を備えた面を有する第1の回路基板
と、前記第1の回路基板に電気的に接続され、第1の複
数の導電要素を備えた面を有し、実質的にフレキシブル
であり、少なくとも一つの開口を有する第2の回路基板
と、複数のコンタクト・サイトを有し、前記第2のフレ
キシブル回路基板に、その第1の面に沿って電気的に接
続された半導体デバイスとを備え、前記第2のフレキシ
ブル回路基板の前記第1の複数の導電要素の中の選択さ
れたものは、前記開口をブリッジし、かつ前記半導体デ
バイスの前記コンタクト・サイトの中の選択されたもの
のそれぞれに前記開口を通じて電気的に接続され、前記
半導体デバイスとは反対側の、前記第2の回路基板の第
2の面に沿って設けられている前記導電要素の中の選択
されたものは、前記第1の回路基板上の前記導電体のそ
れぞれに半田付けされていることを特徴とする電子パッ
ケージ。 (2)前記第1の回路基板は印刷配線板であることを特
徴とする上記(1)に記載の電子パッケージ。 (3)前記導電体は金属パッドから成ることを特徴とす
る上記(2)に記載の電子パッケージ。 (4)前記第2の回路基板は、前記第1の複数の導電体
を備えた前記面と反対側の第2の面上に位置する第2の
複数の導電要素を有し、前記第2の複数の導電要素の中
の選択されたものは、前記半導体デバイスの前記コンタ
クト・サイトの中の選択されたもののそれぞれに電気的
に接続されていることを特徴とする上記(1)に記載の
電子パッケージ。 (5)前記第2の複数の導電要素の中の前記選択された
ものはそれぞれ、前記第2の回路基板の前記開口をブリ
ッジするリード線部材から成ることを特徴とする上記
(4)に記載の電子パッケージ。 (6)前記第1の複数の導電要素の中の前記選択された
ものはそれぞれ、前記第2の回路基板の前記開口をブリ
ッジするリード線部材から成ることを特徴とする上記
(1)に記載の電子パッケージ。 (7)複数の導電体を有する第1の回路基板を用意し、
第1の複数の導電要素を備えた面を有し、少なくとも一
つの開口を有し、前記導電要素が前記開口をブリッジし
ている第2の回路基板を用意し、前記第2の回路基板の
前記第1の複数の導電要素のそれぞれに、複数の半田要
素を取り付け、複数のコンタクト・サイトを有する半導
体デバイスを用意し、前記第1の複数の導電要素の中の
選択されたものを、前記第2の回路基板の前記開口を通
じて、前記半導体デバイスの前記コンタクト・サイトの
それぞれに接合し、その後、前記第1の複数の導電要素
のそれぞれの上にある前記複数の半田要素を、前記第1
の回路基板の前記導電体のそれぞれに接合することを特
徴とする電子パッケージの作製方法。 (8)前記第1の複数の導電要素の中の前記選択された
ものの前記コンタクト・サイトのそれぞれへの接合は、
熱圧着によって行なうことを特徴とする上記(7)に記
載の方法。 (9)前記導電要素のそれぞれに半田ペーストを塗布
し、半田ボールを前記半田ペーストを有する前記導電要
素のそれぞれの上に配置し、その後前記ペーストおよび
前記半田ボールを加熱することによって、前記半田要素
を、前記第1の複数の導電要素の中の前記選択されたも
のに取り付けることを特徴とする上記(7)に記載の方
法。 (10)前記導電要素のそれぞれに半田ボールを付着さ
せ、その後前記半田ボールを加熱することによって、前
記半田要素を前記第1の複数の導電要素の中の前記選択
されたものに取り付けることを特徴とする上記(7)に
記載の方法。
【0029】
【発明の効果】本発明により、フレキシブル回路基板を
用いた優れた電子パッケージおよびその作製方法が得ら
れる。
【図面の簡単な説明】
【図1】本発明の一実施例の電子パッケージ構造体を示
す部分断面拡大立面図である。
【図2】図1の2−2線に沿った部分平面図である。
【図3】本発明の望ましい実施例としての、電子パッケ
ージ構造体を作製する方法における種々のステップを示
すフローチャートである。
【符号の説明】
11 第1の回路基板 13 第2の回路基板 15 半導体デバイス 21 導電体 27,27′ 導電要素 31 開口 41 コンタクト・サイト 51 半田要素
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H05K 3/46 H05K 3/46 Q (72)発明者 クリストファー・ジェラルド・アンギュ ラス アメリカ合衆国 ニューヨーク州 オー ウイーゴー リスル ロード 1201 (72)発明者 ジョセフ・マライアン・マイリュースキ ー アメリカ合衆国 ニューヨーク州 ビン ガムトン ヴァレイ ビュー コート 6 (56)参考文献 特開 平6−291165(JP,A) 実開 昭63−89280(JP,U) 特公 平3−58537(JP,B2) 特公 平4−154136(JP,B2)

Claims (9)

    (57)【特許請求の範囲】
  1. 【請求項1】表面(19)上に複数個の導電体(21)
    を有する第1回路基板(11)と、該第1回路基板の上
    記表面(19)に対面する第1表面(25)及び該第1
    表面の反対側の第2表面(25’)を有するフレキシブ
    ルな第2回路基板(13)であって、上記第1表面(2
    5)に複数個の第1導電要素(27)を有し、該複数個
    の第1導電要素(27)が上記第1回路基板(11)の
    上記複数個の導電体(21)にそれぞれ半田付けにより
    接続されている上記第2回路基板(13)と、 該第2回路基板(13)の上記第2表面(25’)に対
    面する側に複数個のコンタクト・サイト(41)を有す
    る半導体デバイス(15)とを備え、 上記第2回路基板(13)のうち上記半導体デバイス
    (15)の上記コンタクト・サイト(41)のそれぞれ
    に対向する部分は開口(31)になっており、上記第2
    回路基板(13)の上記第2表面(25’)に上記開口
    (31)の上を渡る第2導電要素(27’A)が設けら
    れており、上記半導体デバイス(15)の上記コンタク
    ト・サイト(41)が上記開口(31)の上で上記第2
    導電要素(27’A)にボンディングされており、上記
    開口(31)内は空間にされており、上記第2導電要素
    (27’A)は、上記第2回路基板(13)のうち上記
    開口(31)以外の箇所に設けられた配線を介して所定
    の第1導電要素(27)に接続されていることを特徴と
    する電子パッケージ。
  2. 【請求項2】上記第2導電要素(27’A)は、上記第
    2表面(25’)のうち上記開口(31)を挟む2つの
    領域の間に上記開口(31)を渡るようにかけられた細
    長いリード線部材であることを特徴とする請求項1に記
    載の電子パッケージ。
  3. 【請求項3】上記半導体デバイス(15)の上記コンタ
    クト・サイト(41)と上記第2導電要素(27’A)
    との間のボンディングは熱圧着ボンディングであること
    を特徴とする請求項1又は請求項2に記載の電子パッケ
    ージ。
  4. 【請求項4】上記半導体デバイス(15)の上記コンタ
    クト・サイト(41)のうち選択されたコンタクト・サ
    イト(41)は、上記第2導電要素(27’A)に接続
    されており、そして残りのコンタクト・サイト(41)
    は、該残りのコンタクト・サイト(41)のそれぞれに
    対向する上記開口(31)の各々に設けられた第3導電
    要素(27A)にボンディングされており、 該第3導電要素(27A)は、上記第1表面(25)の
    うち上記開口(31)を挟む2つの領域のうちの一方の
    領域に固定された一端部と、該一端部に連続し上記開口
    (31)内を上記コンタクト・サイト(41)に向かっ
    て延び該コンタクト・サイト(41)に接触してから再
    び上記第1表面(25)に向けて延びる中間部と、該中
    間部に連続し上記2つの領域のうち他方の領域に固定さ
    れた他端部とを有し、上記開口(31)内の空間には上
    記第3導電要素(27A)の上記中間部だけが設けられ
    ていることを特徴とする請求項1、請求項2又は請求項
    3に記載の電子パッケージ。
  5. 【請求項5】上記第3導電要素(27A)は、上記第2
    回路基板(13)の上記第1表面(25)に設けられた
    接続体を介して所定の第1導電要素(27)に接続され
    ていることを特徴とする請求項4に記載の電子パッケー
    ジ。
  6. 【請求項6】表面上に複数個の導電体(21)を有する
    第1回路基板(11)を用意し、該第1回路基板(1
    1)の上記表面に対面する第1表面(25)及び該第1
    表面の反対側の第2表面(25’)を有し、上記第1回
    路基板(11)の複数個の導電体(21)にそれぞれ対
    面する第1導電要素(27)を上記第1表面(25)に
    有し、上記第2表面(25’)の側に接続される半導体
    デバイス(15)の複数個のコンタクト・サイト(4
    1)のそれぞれに対向する部分は開口(31)になって
    おり、該開口(31)の上を渡る第2導電要素(27’
    A)を上記第2表面(25’)に有し、上記開口(3
    1)内は空間にされている第2回路基板(13)を用意
    し、 該第2回路基板(13)の上記第1導電要素(27)の
    それぞれに半田要素を取り付け、 上記半導体デバイス(15)の上記コンタクト・サイト
    (41)のそれぞれを上記第2回路基板(13)の上記
    第2導電要素(27’A)のそれぞれに接触させ、上記
    第1表面(25)の側から上記開口(31)内にボンデ
    ィング・ツールを挿入して上記コンタクト・サイト(4
    1)及び上記第2導電要素(27’A)をボンディング
    し、 上記第2回路基板(13)の上記第1導電要素(27)
    に取り付けられた上記半田要素のそれぞれを上記第1回
    路基板(11)の上記導電体(21)のそれぞれに接触
    させ、上記半田要素を溶融して上記第1導電要素(2
    7)及び上記導電体(21)を接続することを含む電子
    パッケージの製造方法。
  7. 【請求項7】上記第2導電要素(27’A)は、上記第
    2表面(25’)のうち上記開口(31)を挟む2つの
    領域の間に上記開口(31)を渡るようにかけられた細
    長いリード線部材であることを特徴とする請求項6に記
    載の電子パッケージの製造方法。
  8. 【請求項8】上記半導体デバイス(15)の上記コンタ
    クト・サイト(41)のうち選択されたコンタクト・サ
    イト(41)は、上記第2導電要素(27’A)に接続
    されており、そして残りのコンタクト・サイト(41)
    は、該残りのコンタクト・サイト(41)のそれぞれに
    対向する上記第2回路基板(13)の上記開口(31)
    の各々に設けられた第3導電要素(27A)にボンディ
    ングされており、 該第3導電要素(27A)は、上記第1表面(25)の
    うち上記開口(31)を挟む2つの領域のうちの一方の
    領域に固定された一端部と、該一端部に連続し上記開口
    (31)内を上記コンタクト・サイト(41)に向かっ
    て延び該コンタクト・サイト(41)に接触してから再
    び上記第1表面(25)に向けて延びる中間部と、該中
    間部に連続し上記2つの領域のうち他方の領域に固定さ
    れた他端部とを有し、上記開口(31)内の空間には上
    記第3導電要素(27A)の上記中間部だけが設けられ
    ていることを特徴とする請求項6又は請求項7に記載の
    電子パッケージの製造方法。
  9. 【請求項9】上記第3導電要素(27A)は、上記第2
    回路基板(13)の上記第1表面(25)に設けられた
    接続体を介して所定の第1導電要素(27)に接続され
    ていることを特徴とする請求項8に記載の電子パッケー
    ジの製造方法。
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Families Citing this family (56)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5834705A (en) * 1994-03-04 1998-11-10 Silicon Graphics, Inc. Arrangement for modifying eletrical printed circuit boards
JP2833996B2 (ja) * 1994-05-25 1998-12-09 日本電気株式会社 フレキシブルフィルム及びこれを有する半導体装置
JP2647001B2 (ja) * 1994-05-31 1997-08-27 日本電気株式会社 テープキャリアならびに半導体デバイスの実装構造およびその製造方法
CA2157259C (en) * 1994-08-31 2000-08-29 Koetsu Tamura Electronic device assembly and a manufacturing method of the same
US5778505A (en) * 1994-10-04 1998-07-14 Gemcor Engineering Corporation Apparatus for fastening a semi-cylindrical workpiece
JPH08213422A (ja) * 1995-02-07 1996-08-20 Mitsubishi Electric Corp 半導体装置およびそのボンディングパッド構造
US5585162A (en) * 1995-06-16 1996-12-17 Minnesota Mining And Manufacturing Company Ground plane routing
US5675183A (en) * 1995-07-12 1997-10-07 Dell Usa Lp Hybrid multichip module and methods of fabricating same
US5976910A (en) * 1995-08-30 1999-11-02 Nec Corporation Electronic device assembly and a manufacturing method of the same
JP3527350B2 (ja) * 1996-02-01 2004-05-17 株式会社ルネサステクノロジ 半導体装置
MY123146A (en) * 1996-03-28 2006-05-31 Intel Corp Perimeter matrix ball grid array circuit package with a populated center
US5808874A (en) * 1996-05-02 1998-09-15 Tessera, Inc. Microelectronic connections with liquid conductive elements
US5774340A (en) * 1996-08-28 1998-06-30 International Business Machines Corporation Planar redistribution structure and printed wiring device
US5759737A (en) * 1996-09-06 1998-06-02 International Business Machines Corporation Method of making a component carrier
US5804771A (en) * 1996-09-26 1998-09-08 Intel Corporation Organic substrate (PCB) slip plane "stress deflector" for flip chip deivces
JP3633252B2 (ja) * 1997-01-10 2005-03-30 イビデン株式会社 プリント配線板及びその製造方法
KR100499306B1 (ko) 1997-01-23 2005-11-22 세이코 엡슨 가부시키가이샤 반도체장치및그제조방법
JPH10275966A (ja) * 1997-01-30 1998-10-13 Ibiden Co Ltd プリント配線板及びその製造方法
US5898219A (en) * 1997-04-02 1999-04-27 Intel Corporation Custom corner attach heat sink design for a plastic ball grid array integrated circuit package
DE69839882D1 (de) 1997-06-06 2008-09-25 Ibiden Co Ltd Mehrschichtige gedruckte leiterplatte und verfahren zu deren herstellung
US6730541B2 (en) * 1997-11-20 2004-05-04 Texas Instruments Incorporated Wafer-scale assembly of chip-size packages
JP3971500B2 (ja) * 1998-02-20 2007-09-05 ソニー株式会社 半導体素子実装用配線基板の製造方法
US6423623B1 (en) 1998-06-09 2002-07-23 Fairchild Semiconductor Corporation Low Resistance package for semiconductor devices
US6414391B1 (en) * 1998-06-30 2002-07-02 Micron Technology, Inc. Module assembly for stacked BGA packages with a common bus bar in the assembly
US6133634A (en) 1998-08-05 2000-10-17 Fairchild Semiconductor Corporation High performance flip chip package
US6050832A (en) * 1998-08-07 2000-04-18 Fujitsu Limited Chip and board stress relief interposer
US6081026A (en) * 1998-11-13 2000-06-27 Fujitsu Limited High density signal interposer with power and ground wrap
US6239485B1 (en) 1998-11-13 2001-05-29 Fujitsu Limited Reduced cross-talk noise high density signal interposer with power and ground wrap
US6221694B1 (en) * 1999-06-29 2001-04-24 International Business Machines Corporation Method of making a circuitized substrate with an aperture
DE19930308B4 (de) * 1999-07-01 2006-01-12 Infineon Technologies Ag Multichipmodul mit Silicium-Trägersubstrat
US6281437B1 (en) 1999-11-10 2001-08-28 International Business Machines Corporation Method of forming an electrical connection between a conductive member having a dual thickness substrate and a conductor and electronic package including said connection
US6264612B1 (en) 2000-01-14 2001-07-24 Children's Hospital Medical Center Catheter with mechano-responsive element for sensing physiological conditions
US6624522B2 (en) 2000-04-04 2003-09-23 International Rectifier Corporation Chip scale surface mounted device and process of manufacture
US7057292B1 (en) 2000-05-19 2006-06-06 Flipchip International, Llc Solder bar for high power flip chips
JP2002111233A (ja) * 2000-10-03 2002-04-12 Victor Co Of Japan Ltd プリント配線板及びその製造方法
US7119447B2 (en) * 2001-03-28 2006-10-10 International Rectifier Corporation Direct fet device for high frequency application
US6930397B2 (en) * 2001-03-28 2005-08-16 International Rectifier Corporation Surface mounted package with die bottom spaced from support board
US7476964B2 (en) * 2001-06-18 2009-01-13 International Rectifier Corporation High voltage semiconductor device housing with increased clearance between housing can and die for improved flux flushing
US6582990B2 (en) 2001-08-24 2003-06-24 International Rectifier Corporation Wafer level underfill and interconnect process
US6784540B2 (en) 2001-10-10 2004-08-31 International Rectifier Corp. Semiconductor device package with improved cooling
JP3678212B2 (ja) * 2002-05-20 2005-08-03 ウシオ電機株式会社 超高圧水銀ランプ
US7579697B2 (en) 2002-07-15 2009-08-25 International Rectifier Corporation Arrangement for high frequency application
US7397137B2 (en) 2002-07-15 2008-07-08 International Rectifier Corporation Direct FET device for high frequency application
US6755700B2 (en) * 2002-11-12 2004-06-29 Modevation Enterprises Inc. Reset speed control for watercraft
US6841865B2 (en) * 2002-11-22 2005-01-11 International Rectifier Corporation Semiconductor device having clips for connecting to external elements
US20050269677A1 (en) * 2004-05-28 2005-12-08 Martin Standing Preparation of front contact for surface mounting
US7524701B2 (en) * 2005-04-20 2009-04-28 International Rectifier Corporation Chip-scale package
US7230333B2 (en) 2005-04-21 2007-06-12 International Rectifier Corporation Semiconductor package
TWI365516B (en) 2005-04-22 2012-06-01 Int Rectifier Corp Chip-scale package
US20060289981A1 (en) * 2005-06-28 2006-12-28 Nickerson Robert M Packaging logic and memory integrated circuits
JP4795883B2 (ja) * 2006-07-21 2011-10-19 株式会社日立ハイテクノロジーズ パターン検査・計測装置
US20080241563A1 (en) * 2007-03-30 2008-10-02 Khamvong Thammasouk Polymer substrate for electronic components
JP5644264B2 (ja) * 2009-10-14 2014-12-24 富士通株式会社 半導体装置
US9742091B2 (en) * 2014-04-11 2017-08-22 R&D Sockets, Inc. Method and structure for conductive elastomeric pin arrays using solder interconnects and a non-conductive medium
US10477684B2 (en) * 2015-09-25 2019-11-12 Intel Corporation Apparatus, system, and method including a bridge device for interfacing a package device with a substrate
EP3996802A4 (en) * 2019-07-12 2023-10-25 Neuralink Corp. SANDWICH ASSEMBLY DIAGRAM FOR THIN FILM ELECTRODE ARRAY AND INTEGRATED CIRCUITS

Family Cites Families (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3795047A (en) * 1972-06-15 1974-03-05 Ibm Electrical interconnect structuring for laminate assemblies and fabricating methods therefor
JPS5269564A (en) * 1975-12-08 1977-06-09 Seiko Epson Corp Semiconductor device and its manufacturing process
JPS5366166A (en) * 1976-11-26 1978-06-13 Hitachi Ltd Electron part
US4413308A (en) * 1981-08-31 1983-11-01 Bell Telephone Laboratories, Incorporated Printed wiring board construction
US4435740A (en) * 1981-10-30 1984-03-06 International Business Machines Corporation Electric circuit packaging member
EP0152189A3 (en) * 1984-01-25 1987-12-09 Luc Technologies Limited Bonding electrical conductors and bonded products
JPS6389280U (ja) * 1986-12-01 1988-06-10
US5159535A (en) * 1987-03-11 1992-10-27 International Business Machines Corporation Method and apparatus for mounting a flexible film semiconductor chip carrier on a circuitized substrate
US5195237A (en) * 1987-05-21 1993-03-23 Cray Computer Corporation Flying leads for integrated circuits
US5045975A (en) * 1987-05-21 1991-09-03 Cray Computer Corporation Three dimensionally interconnected module assembly
US5054192A (en) * 1987-05-21 1991-10-08 Cray Computer Corporation Lead bonding of chips to circuit boards and circuit boards to circuit boards
JPH0358537A (ja) * 1989-07-27 1991-03-13 Nikon Corp カレントループ伝送装置
US5135155A (en) * 1989-08-25 1992-08-04 International Business Machines Corporation Thermocompression bonding in integrated circuit packaging
KR940004246B1 (ko) * 1989-09-11 1994-05-19 신닛뽕 세이데쓰 가부시끼가이샤 Tab 테이프와 반도체칩을 접속하는 방법 및 그것에 사용하는 범프시이트와 범프 부착 tab 테이프
JP2753746B2 (ja) * 1989-11-06 1998-05-20 日本メクトロン株式会社 Ic搭載用可撓性回路基板及びその製造法
US5127570A (en) * 1990-06-28 1992-07-07 Cray Research, Inc. Flexible automated bonding method and apparatus
US5115964A (en) * 1990-09-07 1992-05-26 International Business Machines Corporation Method for bonding thin film electronic device
US5057969A (en) * 1990-09-07 1991-10-15 International Business Machines Corporation Thin film electronic device
US5148265A (en) * 1990-09-24 1992-09-15 Ist Associates, Inc. Semiconductor chip assemblies with fan-in leads
JPH04154136A (ja) * 1990-10-18 1992-05-27 Fujitsu Ltd ベアチップの実装方法
US5203075A (en) * 1991-08-12 1993-04-20 Inernational Business Machines Method of bonding flexible circuit to cicuitized substrate to provide electrical connection therebetween using different solders
US5133495A (en) * 1991-08-12 1992-07-28 International Business Machines Corporation Method of bonding flexible circuit to circuitized substrate to provide electrical connection therebetween
JP2537325B2 (ja) * 1991-11-29 1996-09-25 明 北原 表面実装電子部品と製法
US5222014A (en) * 1992-03-02 1993-06-22 Motorola, Inc. Three-dimensional multi-chip pad array carrier
EP0569949A3 (en) * 1992-05-12 1994-06-15 Akira Kitahara Surface mount components and semifinished products thereof
AU4782293A (en) * 1992-07-24 1994-02-14 Tessera, Inc. Semiconductor connection components and methods with releasable lead support
JPH06291165A (ja) * 1993-04-01 1994-10-18 Nec Corp フリップチップ接続構造

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