JP2016099127A - パワー半導体モジュールの製造方法及びその中間組立ユニット - Google Patents

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Kenichiro Sato
憲一郎 佐藤
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Abstract

【課題】 本発明の目的は、基板材料が異なる少なくとも2以上のパワー半導体素子を混載するパワー半導体モジュールにおいて、電気特性の不良品を確実に除くことができるパワー半導体モジュールの製造方法、及びその中間組立ユニットを提供することにある。
【解決手段】 金属箔付き絶縁基板3の金属箔3bには、基板材料が異なり、漏れ電流の大きさに1桁以上の差がある、半導体素子1aと2bが半田付けされている。半導体素子1aと2bの表面電極には、半導体素子間を連結しない、配線部材20aと20bがそれぞれ接続されている。前記配線部材を介して、各半導体素子に個別に通電を行い、漏れ電流の検査を個別に行うことができるので、漏れ電流の大きい不良を発見することができる。
【選択図】図3

Description

本発明は、基板材料及び高さが異なる少なくとも2以上の半導体素子を混載するパワー半導体モジュールの製造方法及びその中間組立ユニットに関する。
複数個の半導体素子を組み合わせて回路を構成するパワー半導体モジュールの製造工程においては、その完成前の中間組立ユニットの状態で、電気特性を中間検査することが一般的である。
例えば、特許文献1には、IGBT(Insulated Gate Bipolar Transistor)、パワーMOSFET(Metal Oxide Semiconductor Field Effect Transistor)等のパワー半導体素子について実施される、スイッチング特性試験、サージ試験、連続動作試験、熱抵抗試験のことが記載されている。また、特許文献2には、パワー半導体モジュールに組まれたインバータ回路のスイッチング特性を検査する方法が開示されている。
特開2010−107432号公報 特開2012−229971号公報
従来技術の問題点について図面を用いて説明する。
図1には、パワー半導体モジュールの中間組立ユニット100に組み込まれた、半導体素子1aの漏れ電流を検査する方法が模式的に示されている。ここで、半導体素子1aと半導体素子1bは、どちらも縦方向に電流が流れる縦型シリコン半導体素子とする。半導体素子1aと半導体素子1bのそれぞれの裏面は、絶縁基板3の第1金属箔3bに半田接合されている。一方、半導体素子1a及び半導体素子1bの表面電極は、配線部材10に半田接合され、電気的に接続されている。
すなわち、従来の検査方法では、中間組立ユニット100において、半導体素子1aと半導体素子1bは並列接続されている。
一方、漏れ電流の検査のため、半導体素子間を連結する配線部材10には測定プローブP1が接触している。また、第1金属箔3bには測定プローブP2が接触している。漏れ電流の検査は、電圧源VSを用いて測定プローブP1とP2との間に電圧を印加し、電流計AMで電流値を読み取ることによってなされる。読み取った電流値が、予め定めた規格値よりも小さければ「合格」とする。
上記検査で読み取った電流値は、半導体素子1aの漏れ電流と半導体素子1bの漏れ電流を合計した値であり、厳密に言えば半導体素子1aの漏れ電流を検査したことにはならないが、半導体素子1bの漏れ電流が、半導体素子1aの漏れ電流よりも小さいか、あるいは同程度であれば、合否判定を左右するほどのものではない。
しかしながら、パワー半導体モジュールに基板材料の異なる半導体素子を混載する場合、上記の検査方法は適切ではない。
例えば、図1において、半導体素子1aをシリコン基板に形成されたIGBT素子とし、半導体素子1bを炭化シリコン(SiC)基板に形成されたSiC−SBD(Schottky Barrier Diode)とすると、SiC−SBDの漏れ電流がIGBTの漏れ電流よりも1桁以上大きいため、IGBTが漏れ電流の大きい不良品であっても検査では検出できない。SiC−SBDにおいて、漏れ電流が大きい理由は、欠陥密度の小さい良質のSiC基板を得ることが難しいからであるが、高耐熱、高耐圧、低損失等の優れた特性を備えているため、今後の市場拡大が大いに期待されている。
よって、本発明の目的は、基板材料及び高さが異なる少なくとも2以上のパワー半導体素子を混載するパワー半導体モジュールにおいて、漏れ電流の大きい不良品を確実に除くことができるパワー半導体モジュールの製造方法、及びその中間組立ユニットを提供することにある。
上記目的を達成するため、本発明のパワー半導体モジュールの製造方法は、金属箔付き絶縁基板の片面の金属箔に、基板材料及び高さが異なる少なくとも2以上の半導体素子を半田付けすると共に、各半導体素子の表面電極に、前記半導体素子間を連結しない複数の配線部材を、前記配線部材が前記半導体素子の表面電極に半田を介して接続された後の状態で、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように接続する半導体素子接合工程と、前記配線部材を介して、各半導体素子に個別に通電を行い、漏れ電流の検査を行う検査工程と、前記配線部材の上面間をバスバーで接続する配線部材接続工程と、を含むことを特徴とする。
本発明のパワー半導体モジュールの製造方法によれば、半導体素子間を連結しない配線部材を介して、各半導体素子に個別に通電を行い、漏れ電流の検査を行うようにしたので、例えば炭化シリコン半導体素子とシリコン半導体素子が混載されているような場合であっても、個々の半導体素子の漏れ電流を正確に測定でき、半導体素子の不良を確実に発見して、不良半導体素子が搭載されたものについて以後の工程を行う無駄を省くことがきる。
また、配線部材が半導体素子の表面電極に半田を介して接続された後の状態で、絶縁基板の表面から前記配線部材の上面までの高さが同一となるように接続することにより、配線部材の上面間をバスバーで接続する配線部材接続作業の際の接続ポイントの高さを一定にして、作業性を良好にすることができる。
本発明のパワー半導体モジュールの製造方法の一つの態様において、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、前記配線部材の下面から上面までの高さがそれぞれ定められた前記配線部材を接続することが好ましい。
上記態様によれば、半導体素子の高さに応じて配線部材の高さを変えることにより、半田の厚さが一定であっても、各半導体素子に接続された配線部材の上面の高さを揃えることができ、半田付け条件を制御しやすくなる。
本発明のパワー半導体モジュールの製造方法の別の態様において、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、前記配線部材と前記半導体素子の表面電極とを接続する前記半田の厚さがそれぞれ定められた厚さになるように、前記配線部材を接続することが好ましい。
上記態様によれば、配線部材の高さが一定であっても、半導体素子の高さに応じて半田の厚さを変えることにより、各半導体素子に接続された配線部材の上面の高さを揃えることができ、配線部材の高さを共通化して部品管理がしやすくなる。
本発明のパワー半導体モジュールの製造方法において、前記配線部材の接続工程における配線部材とバスバーとの接続を、レーザー溶接によって行うことが好ましい。
上記態様によれば、配線部材とバスバーとの接続を、レーザー溶接によって行うことにより、非接触で局所加熱することができるため、既に半田付けされた箇所を溶融させることなく接続でき、短時間で接続できるので作業性がよい。
本発明のパワー半導体モジュールの製造方法において、前記配線部材又は/及びバスバーは、バネ性を有する材質及び構造とされていることが好ましい。
上記態様によれば、配線部材又は/及びバスバーがバネ性を有する材質及び構造とされているので、配線部材にバスバーを接続する際に、配線部材又は/及びバスバーを弾性的に変形させて互いを密着させることができ、確実に接続することができる。
本発明のパワー半導体モジュールの製造方法において、前記半導体素子は、少なくとも1つが炭化シリコン半導体素子であり、他がシリコン半導体素子であることが好ましい。
前述したように、炭化シリコン半導体素子と、シリコン半導体素子とは、漏れ電流が1桁以上異なるが、本発明によれば、各半導体素子毎に個別に漏れ電流を測定できるので、それぞれの半導体素子の漏れ電流不良を確実に発見し、性能と信頼性に優れたパワー半導体モジュールを製造することができる。
本発明のパワー半導体モジュール用の中間組立ユニットは、金属箔付き絶縁基板と、該絶縁基板の片面の金属箔に半田付けされた、基板材料及び高さが異なる少なくとも2以上の半導体素子と、前記各半導体素子の表面電極に半田を介して個別に接続された状態で、前記絶縁基板の表面から上面までの高さが同一となる、前記半導体素子間を連結しない複数の配線部材と、前記配線部材の前記上面間を接続するバスバーと、を備えることを特徴とする。
本発明のパワー半導体モジュール用の中間ユニットによれば、配線部材を介して、各半導体素子に個別に通電を行って、漏れ電流の検査を行うことができるので、例えば炭化シリコン半導体素子とシリコン半導体素子が混載されているような場合であっても、個々の半導体素子の漏れ電流を正確に測定でき、半導体素子の不良を確実に発見して、不良半導体素子が搭載されたものについて以後の工程を行う無駄を省くことがきる。
また、配線部材が半導体素子の表面電極に半田を介して接続された後の状態で、絶縁基板の表面から前記配線部材の上面までの高さが同一となるように接続することにより、配線部材の上面間をバスバーで接続する配線部材接続作業の際の接続ポイントの高さを一定にして、作業性を良好にすることができる。
本発明のパワー半導体モジュール用の中間組立ユニットの一つの態様において、前記配線部材の下面から上面までの高さが、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、それぞれ定められていることが好ましい。
上記態様によれば、半導体素子の高さに応じて配線部材の高さを変えることにより、半田の厚さが一定であっても、各半導体素子に接続された配線部材の上面の高さを揃えることができ、半田付け条件を制御しやすくなる。
本発明のパワー半導体モジュール用の中間組立ユニットの別の態様において、前記配線部材と前記半導体素子の表面電極とを接続する前記半田の厚さが、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、それぞれ定められていることが好ましい。
上記態様によれば、配線部材の高さが一定であっても、半導体素子の高さに応じて半田の厚さを変えることにより、各半導体素子に接続された配線部材の上面の高さを揃えることができ、配線部材の高さを共通化して部品管理がしやすくなる。
本発明のパワー半導体モジュール用の中間組立ユニットにおいて、前記配線部材及び/又はバスバーは、バネ性を有する材質及び構造とされていることが好ましい。
上記態様によれば、配線部材又は/及びバスバーがバネ性を有する材質及び構造とされているので、配線部材にバスバーを接続する際に、配線部材又は/及びバスバーを弾性的に変形させて互いを密着させることができ、確実に接続することができる。
本発明のパワー半導体モジュール用の中間組立ユニットにおいて、前記半導体素子は、少なくとも1つが炭化シリコン半導体素子であり、他がシリコン半導体素子であることが好ましい。
上記態様によれば、製造工程において漏れ電流不良を確実に発見することが可能となり、性能と信頼性に優れたパワー半導体モジュールを製造するための、中間組立ユニットを提供することができる。
本発明によれば、各半導体素子に配線部材を介して個別に通電を行い、漏れ電流の検査を行うことができるので、個々の半導体素子の漏れ電流をより正確に測定でき、半導体素子の不良を確実に発見して、不良半導体素子が搭載されたものについて以後の工程を行う無駄を省くことがきる。
また、配線部材が半導体素子の表面電極に半田を介して接続された後の状態で、絶縁基板の表面から前記配線部材の上面までの高さが同一となるように接続されているので、配線部材の上面間をバスバーで接続する配線部材接続作業の際の接続ポイントの高さを一定にして、製造作業性を良好にすることができる。
従来のパワー半導体モジュールの検査方法の一例を示す模式図である。 本発明のパワー半導体モジュールの一実施形態に係る断面模式図である。 本発明のパワー半導体モジュールの検査方法の一例を示す模式図である。 本発明のパワー半導体モジュールの他の実施形態に係る断面模式図である。 本発明のパワー半導体モジュールの更に他の実施形態に係る断面模式図である。 本発明のパワー半導体モジュールの更に他の実施形態に係る断面模式図である。 本発明のパワー半導体モジュールの更に他の実施形態に係る断面模式図である。 本発明のパワー半導体モジュールの更に他の実施形態に係る断面模式図である。
以下図面に基づいて、本発明の実施形態について説明する。
図2(a)には、本発明の中間組立ユニット200の断面が模式的に示されている。
半導体素子1aと2bは、基板材料及び高さが異なるものが使用されており、ここでは便宜上、半導体素子1aは半導体素子2bよりも高さが低いものとして説明する。
本発明半導体素子1a及び半導体素子2bの裏面は、それぞれ半田4a及び4bを介して、絶縁基板3の第1金属箔3bに接続されている。また、半導体素子1aの表面電極は半田5aを介して配線部材20aに接続され、半導体素子2bの表面電極は半田5bを介して配線部材20bに接続されているが、図示しない部分も含めて、配線部材20aと配線部材20bは電気的に分離されている。
半導体素子1aは半導体素子2bよりも高さが低いが、配線部材20aの下面21aから上面22aまでの高さH200aを、配線部材20bの下面21bから上面22bまでの高さH200bよりも高くして、配線部材20aの上面22aと配線部材20bの上面22bが、絶縁基板の表面3dから同じ高さとになるように構成されている。
図2(b)には、中間組立ユニット200を内蔵する、パワー半導体モジュール2000の断面が模式的に示されている。配線部材20a、20bには、バスバー6が、レーザー溶接等により接続されている。中間組立ユニット200は樹脂ケース8に収納され、封止樹脂9が充填されて、封止されている。
上記態様によれば、中間組立ユニット200において、配線部材20aと配線部材20bは、電気的に分離されているため、半導体素子1と半導体素子2の漏れ電流を個別に検査し、不良を確実に発見することができる。
また、上記態様によれば、配線部材20aの上面22aと、配線部材20bの上面22bが、同じ高さになるように高さ調整されているので、バスバー6をレーザー溶接する際に、接続箇所毎にレーザー光の焦点深度を調整する手間が省け、効率よく接続することができる。
以下、パワー半導体モジュール2000の各部について、更に詳しく説明する。
半導体素子1a、2bは、特に限定されないが、例えば半導体素子1aとしてシリコン基板に形成されたIGBTやパワーMOSFETを用い、半導体素子2bとして炭化シリコン基板に形成されたSiC−SBDやSiC−MOSFET等が用いられ、インバータ回路、コンバータ回路を構成することができる。
絶縁基板3は、絶縁板3aと第1金属箔3b、第2金属箔3cとからなり、第1金属箔3bには、半導体素子1a、2bを半田接合することができる。一方、第2金属箔3cには、図示しないヒートスプレッダ又は冷却器を半田接合することができる。絶縁板3aの材質は、熱伝導に優れた絶縁材料ならば特に限定されず、例えば窒化アルミニウム、窒化珪素、アルミナ等を用いることができる。また、金属箔3b、3cの材質は、電気伝導と熱伝導に優れた材料ならば特に限定されず、具体的には銅が好ましく、コスト低減のため銅箔が絶縁板3aにDCB(Direct Copper Bonding)法によって形成されていることが好ましい。
配線部材20a,20bは、電気伝導に優れた材料ならば特に限定されず、例えば、錫めっきされた銅板をクランク形状に折り曲げてバネ性をもたせた部材を用いることができる。バネ性を持たせると、配線部材にバスバーを接続する際に、配線部材を弾性的に変形させてバスバー6に密着させ、確実に接続することができる。ただし、配線部材20a,20bの断面形状を図2に示されるようなクランク形状にすると、配線部材20aと配線部材20bを分離する隙間S200が十分確保されていない場合は、配線部材20aに測定プローブP1を接触させた時に、配線部材20aが弾性変形して配線部材20bに接触し、電気的にショートするおそれがある。また、配線部材20aの上面22aの幅W200が狭いと測定プローブP1の位置合せが難しくなる。よって、半導体素子1aと半導体素子2bとの間隔は、配線部材の弾性変形と、測定プローブP1の位置合せ精度を考慮して、設計することが好ましい。
バスバー6の材質は、特に限定されず、電気伝導に優れ、バネ性を備える材料であることが好ましい。具体的には銅、銅合金、アルミニウム、アルミニウム合金等が好ましい。
バスバー6と配線部材20a、20bとの接続は、レーザー溶接が好ましく、その場合は、レーザー光の吸収効率を高めるために、バスバー6の表面が、ニッケルめっきされていることが好ましい。また、バスバー6には、スリット孔又はディンプルを設けて剛性を局所的に低下させて、バネ性をもたせることができる。バネ性をもたせた構造にすると、バスバーを配線部材に接続する際に、バスバーを配線部材に弾性的に変形させて互いを密着させることができ、確実に溶接することができる。
次に、パワー半導体モジュール2000の製造方法について説明する。
(組立工程1)
基板材料が異なる、半導体素子1a、2bの裏面を、絶縁基板3の第1金属箔3bに半田付けする。
(組立工程2)
配線部材20a、20bを、それぞれ半導体素子1a、2bの表面電極に半田付けして、中間組立ユニット200とする。
組立工程1及び2は、1つの工程にまとめ、加熱処理を1回にして半田付けしてもよい。
(検査工程1)
上記手順で組み立てた中間組立ユニット200の電気特性(漏れ電流等)を検査する。検査に合格した中間組立ユニット200については、組立工程3に進むことができる。
(組立工程3)
中間組立ユニット200を樹脂ケース8に組み込み、配線部材20a、20bにバスバー6を接続する。
本発明において、配線部材20a、20bと、バスバー6との接続は、特に限定されず、例えば接続したい箇所にNd3+YAGレーザーを照射し、配線部材とバスバーを局所加熱して、レーザー溶接部7を形成することができる。レーザー溶接によれば、非接触で局所加熱することができるため、既に半田付けされた箇所を溶融させることなく接続でき、短時間で接続できるので作業性がよい。
また、バスバー6は、個別の部品に分かれていてその一つひとつを接続してもよいが、バスバー6が樹脂ケース8に鋳込まれ、樹脂ケースごと中間組立ユニット200に組み付けてもよい。このようにすると、配線部材に対して正確に位置決めすることができ、レーザー溶接し易くなる。
(検査工程2)
バスバー6によって半導体素子1a、2bを連結した後、必要に応じて他の項目を検査することができる。例えば、インバータ回路の特性試験などは、半導体素子間を連結した状態で実施することができる。
(組立工程4)
樹脂ケース8に封止樹脂9を充填し、パワー半導体モジュール2000とする。
以上は、パワー半導体モジュールの概略であるが、ここに記載を省略した工程としては、例えばIGBTのゲート電極のワイヤーボンディング、中間組立ユニット200のヒートシンクへの半田付け、半田付け部のX線検査等がある。
以下、検査工程1の漏れ電流検査について詳しく説明する。
図3(a)には、本発明の中間組立ユニット200に搭載された半導体素子1aの漏れ電流を検査する方法が示されている。半導体素子1aに接続された配線部材20aには測定プローブP1が接触している。また、金属箔3bには測定プローブP2が接触している。漏れ電流の検査は、電圧源VSを用いて測定プローブP1とP2との間に電圧を印加し、電流計AMで電流値を読み取ることによってなされる。読み取った電流値が、予め定めた規格値よりも小さければ「合格」とする。配線部材20aと配線部材20bは電気的に分離されているため、半導体素子2bの方には電流が流れず、半導体素子1aの漏れ電流を精度よく検査することができる。
また、図3(b)に示された方法によって、半導体素子2bの漏れ電流も、必要に応じて、検査することができる。半導体素子2bに接続された配線部材20bには測定プローブP1が接触している。また、金属箔3bには測定プローブP2が接触している。漏れ電流の検査は、電圧源VSを用いて測定プローブP1とP2との間に電圧を印加し、電流計AMで電流値を読み取ることによってなされる。
本発明によれば、基板材料が異なり、漏れ電流の大きさに1桁以上の差がある、2以上の半導体素子が混載されていたとしても、各半導体素子が電気的に分離された状態で、漏れ電流を測定するので、不良品を確実に発見することができる。
図4には、本発明の中間組立ユニット及びパワー半導体モジュールの他の実施形態が、(a)及び(b)にそれぞれ示されている。パワー半導体モジュール3000では、配線部材30a、30bは、カタカナの「コ」の字に似た断面形状を有し、半導体素子の外縁よりも張り出さないように設置されている。
このように構成すると、配線部材30aと配線部材30bを分離する隙間S300は、図2のS200よりも大きくすることができる。同時に、測定プローブP1を接触させる配線部材30aの上面の幅W300も、配線部材を折り返すことによって、図2のW200よりも大きくすることができる。その結果、配線部材どうしが短絡し難くなり、プローブの位置合せが容易になる。
また、図示されているように、半導体素子1aが半導体素子2bよりも高さが低くされている場合は、配線部材30aの高さH300aを配線部材30bの高さH300bよりも高くして、配線部材30aの上面32aと配線部材30bの上面32bが、絶縁基板3の表面3dから同じ高さになるように構成すると、先述したようにバスバー6を効率よく接続できるので好ましい。
また、配線部材30aは、「コ」の字の解放部分33aが、バスバー6が鋳込まれている側の樹脂ケースの内面8aと対向するように取り付けられ、配線部材30bを配線部材30aと背中合わせにして「コ」の字の連結部分34aと34bが隣接するように取り付けられていることが好ましい。
上記のように取り付けた時の利点は、下記の図5と比較すると分かり易い。
図5(b)には、配線部材30aが「コ」の字の連結部分34aが、バスバー6が鋳込まれている側の樹脂ケースの内面8aと対向するように取り付けられ、配線部材30bが、「コ」の字の解放部分33aと33bとが向き合うように取り付けられているパワー半導体モジュール3001の断面が模式的に示されている。
樹脂ケースの内面8aから配線部材30aの「コ」の字の連結部34aまでの距離は、図4(b)ではL300で示され、図5(b)ではL301で示されている。図から明らかなように、L300の方がL301よりも長くなっているため、図4(b)のように取り付ける方が、図5(b)のように取り付けるよりも、バスバー6が撓み易くなり、半導体素子1aに加わる応力を軽減することができる。
また、連結部分34aと連結部分34bとの距離は、図4(b)ではD300で示され、図5(b)ではD301で示されている。図から明らかなように、D300の方がD301よりも短くなっているため、図4(b)のように取り付ける方が、図5(b)のように取り付けるよりも、半導体素子間の電気抵抗をより小さくすることができる。
以上2つの理由から、配線部材30a及び30bの取付け向きは、図4のように取り付ける方が、図5のように取り付けるよりも好ましい。
図6には、本発明の中間組立ユニット及びパワー半導体モジュールの更に他の実施形態が、(a)及び(b)にそれぞれ示されている。
パワー半導体モジュール4000には、アルファベットの「Z」の字に似た断面形状の配線部材40a、40bが用いられている。
図示されているように、半導体素子1aが半導体素子2bよりも高さが低くされている場合は、配線部材40aの高さH400aを配線部材40bの高さH400bよりも高くして、配線部材40aの上面42aと配線部材40bの上面42bが、絶縁基板表面3dから同じ高さとになるように構成すると、先述したようにバスバー6を効率よく接続できるので好ましい。
また、図6に示されるように、配線部材40aは、配線部材40aの「Z」字のバスバーに近い側の屈曲部分が、樹脂ケースのバスバーを鋳込んだ側の内面8aから、遠ざかるように取り付けると、L400を長くできるので、半導体素子に加わる応力をより大きく緩和することができる。また、配線部材40bは、「Z」の字を左右反転させた向きに取り付けると、D400を短くできるので、半導体素子間の電気抵抗を小さくすることができる。
図7には、本発明の中間組立ユニット及びパワー半導体モジュールの更に他の実施形態が、(a)及び(b)にそれぞれ示されている。
パワー半導体モジュール5000には、ブロック形状の配線部材50a、50bが用いられている。ブロック形状にしたことで、伝熱面積が増えて伝熱がよくなり、熱容量が増えて過渡熱抵抗を減らすことができる。
図示されているように、半導体素子1aが半導体素子2bよりも高さが低くされている場合は、配線部材50aの高さH500aを配線部材50bの高さH500bよりも高くして、配線部材50aの上面52aと配線部材50bの上面52bが、絶縁基板の表面3dから同じ高さとになるように構成すると、先述したようにバスバー6を効率よく接続できるので好ましい。
図8には、本発明の中間組立ユニット及びパワー半導体モジュールの更に他の実施形態が、(a)及び(b)にそれぞれ示されている。
パワー半導体モジュール6000では、配線部材60aの高さH600aと配線部材60bの高さH600bは同一とし、半導体素子1aと半導体素子2bの高さの違いに対しては、半導体素子1aの上面と配線部材60aの下面61aを接続する半田5cを厚くして、配線部材60aの上面62aと配線部材60bの上面62bが、絶縁基板3の表面3dから同じ高さとになるように構成している。このように構成すると、先述したようにバスバー6を効率よく接続できるので好ましい。
なお、上記の高さ調整は、半田4a、4b、5bの厚さ変更で行ってもよい。
1a、1b、2b:半導体素子
3:絶縁基板
3a:絶縁板
3b:第1金属箔
3c:第2金属箔
4a、4b、5a、5b、5c:半田
6:バスバー
7:レーザー溶接部
8:樹脂ケース
8a:樹脂ケースのバスバーを鋳込んだ側の内面
9:封止樹脂
10:配線部材(半導体素子間を連結する)
20a、20b、30a、30b、40a、40b、50a、50b,60a、60b:配線部材(半導体素子間を連結しない)
21a、21b、31a、31b、41a、41b、51a、51b、61a、61b:配線部材の上面
22a、22b、32a、32b、42a、42b、52a、52b、62a、62b:配線部材の下面
33a、33b:配線部材の「コ」の字の解放部分
34a、34b:配線部材の「コ」の字の連結部分
100、200、300、400、500、600:中間組立ユニット
2000、3000、4000,5000,6000:パワー半導体モジュール
P1、P2:測定プローブ
VS:電圧源
AM:電流計
D300、D301、D400:2つの配線部材の「コ」の字の連結部間の距離
H200、H300、H301、H400、H500、H600:絶縁基板の表面から配線部材までの高さ
H200a、H200b、H300a、H300b、H301a、H301b、H400a、H400b、H500a、H500b、H600a、H600b:配線部材の高さ
L300、L301、L400:樹脂ケースの内面から配線部材の「コ」の字の連結部までの距離
S200、S300、S301:配線部材間の隙間
W200、W300、W301:測定プローブを接触させる配線部材の上面の幅

Claims (11)

  1. 金属箔付き絶縁基板の片面の金属箔に、基板材料及び高さが異なる少なくとも2以上の半導体素子を半田付けすると共に、各半導体素子の表面電極に、前記半導体素子間を連結しない複数の配線部材を、前記配線部材が前記半導体素子の表面電極に半田を介して接続された後の状態で、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように接続する半導体素子接合工程と、
    前記配線部材を介して、各半導体素子に個別に通電を行い、漏れ電流の検査を行う検査工程と、
    前記配線部材の上面間をバスバーで接続する配線部材接続工程と、
    を含むことを特徴とするパワー半導体モジュールの製造方法。
  2. 前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、前記配線部材の下面から上面までの高さがそれぞれ定められた前記配線部材を接続する請求項1に記載のパワー半導体モジュールの製造方法。
  3. 前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、前記配線部材と前記半導体素子の表面電極とを接続する前記半田の厚さがそれぞれ定められた厚さになるように、前記配線部材を接続する請求項1に記載のパワー半導体モジュールの製造方法。
  4. 前記配線部材の接続工程における配線部材とバスバーとの接続を、レーザー溶接によって行う、請求項1〜3のいずれか1つに記載のパワー半導体モジュールの製造方法。
  5. 前記配線部材又は/及びバスバーは、バネ性を有する材質及び構造とされている、請求項1〜4のいずれか1つに記載のパワー半導体モジュールの製造方法。
  6. 前記半導体素子は、少なくとも1つが炭化シリコン半導体素子であり、他がシリコン半導体素子である、請求項1〜5のいずれか1つに記載のパワー半導体モジュールの製造方法。
  7. 金属箔付き絶縁基板と、
    該絶縁基板の片面の金属箔に半田付けされた、基板材料及び高さが異なる少なくとも2以上の半導体素子と、
    前記各半導体素子の表面電極に半田を介して個別に接続された状態で、前記絶縁基板の表面から上面までの高さが同一となる、前記半導体素子間を連結しない複数の配線部材と、
    前記配線部材の前記上面間を接続するバスバーと、
    を備えることを特徴とするパワー半導体モジュール用の中間組立ユニット。
  8. 前記配線部材の下面から上面までの高さが、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、それぞれ定められている請求項7に記載のパワー半導体モジュール用の中間組立ユニット。
  9. 前記配線部材と前記半導体素子の表面電極とを接続する前記半田の厚さが、前記絶縁基板の表面から前記配線部材の上面までの高さが同一となるように、前記半導体素子の高さに応じて、それぞれ定められている請求項7に記載のパワー半導体モジュール用の中間組立ユニット。
  10. 前記配線部材及び/又はバスバーは、バネ性を有する材質及び構造とされている、請求項7〜9のいずれか1つに記載のパワー半導体モジュール用の中間組立ユニット。
  11. 前記半導体素子は、少なくとも1つが炭化シリコン半導体素子であり、他がシリコン半導体素子である、請求項7〜10のいずれか1つに記載のパワー半導体モジュール用の中間組立ユニット。
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US14/877,334 US9741628B2 (en) 2014-11-18 2015-10-07 Method for manufacturing semiconductor module and intermediate assembly unit of the same
CN201510649189.1A CN105609440B (zh) 2014-11-18 2015-10-09 功率半导体模块的制造方法及其中间装配单元

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018129414A (ja) * 2017-02-09 2018-08-16 株式会社東芝 半導体モジュール
JP2019050301A (ja) * 2017-09-11 2019-03-28 株式会社東芝 パワー半導体モジュール
JP2021002552A (ja) * 2019-06-20 2021-01-07 富士電機株式会社 半導体装置及びその製造方法、並びに半導体モジュール

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6341427B2 (ja) * 2015-01-21 2018-06-13 株式会社オートネットワーク技術研究所 回路構成体及び電気接続箱
JP6515886B2 (ja) * 2016-07-08 2019-05-22 株式会社豊田自動織機 半導体モジュール
CN107908875B (zh) * 2017-11-16 2020-04-07 华北电力大学 一种功率半导体器件热特性参数的确定方法及系统
JP7035920B2 (ja) * 2018-09-06 2022-03-15 三菱電機株式会社 半導体装置および電力変換装置
EP3863045A1 (en) * 2020-02-04 2021-08-11 Infineon Technologies AG Power semiconductor module arrangement and method for producing the same

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10112978A (ja) * 1996-10-08 1998-04-28 Fuji Electric Co Ltd スイッチング電源用整流部の組立構造
JP2003043105A (ja) * 2001-08-02 2003-02-13 Fujitsu Media Device Kk 被測定物の特性試験時におけ被測定物の吸着加圧方法及びその吸着加圧パット
JP2004324354A (ja) * 2003-04-28 2004-11-18 Shimizu Corp トンネル掘削機の切削刃部の取付構造、取付方法及び交換方法
JP2005345247A (ja) * 2004-06-02 2005-12-15 Toyota Motor Corp 半導体素子の評価装置
JP2007324354A (ja) * 2006-05-31 2007-12-13 Sony Corp 半導体装置
JP2009522758A (ja) * 2005-12-28 2009-06-11 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 電子モジュールならびに該電子モジュールを製造するための方法
JP2010103222A (ja) * 2008-10-22 2010-05-06 Fuji Electric Systems Co Ltd 半導体装置
US20100252922A1 (en) * 2009-04-03 2010-10-07 Infineon Technologies Ag Power Semiconductor Module, Power Semiconductor Module Assembly and Method for Fabricating a Power Semiconductor Module Assembly
JP2013065836A (ja) * 2011-08-31 2013-04-11 Mitsubishi Electric Corp 電極部材およびこれを用いた電力用半導体装置

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2560894B2 (ja) 1989-09-20 1996-12-04 富士電機株式会社 半導体装置
JP2605506B2 (ja) 1991-07-10 1997-04-30 三菱電機株式会社 半導体装置
JPH06302734A (ja) 1993-04-14 1994-10-28 Sansha Electric Mfg Co Ltd 電力用半導体モジュール
JP2854785B2 (ja) 1993-08-30 1999-02-03 三菱電機株式会社 半導体装置およびその製造方法
JP4419552B2 (ja) 2003-12-16 2010-02-24 株式会社豊田自動織機 半導体モジュールの端子構造及びコントローラ出力端子
DE112006002488B4 (de) * 2005-09-21 2014-05-28 International Rectifier Corp. Halbleiter-Baueinheit
JP2007184525A (ja) 2005-12-07 2007-07-19 Mitsubishi Electric Corp 電子機器装置
JP4984730B2 (ja) 2006-08-09 2012-07-25 富士電機株式会社 半導体装置
JP5076440B2 (ja) 2006-10-16 2012-11-21 富士電機株式会社 半導体装置及び半導体装置の製造方法
JP5267053B2 (ja) 2008-10-31 2013-08-21 富士電機株式会社 半導体試験装置
JP4988784B2 (ja) * 2009-03-30 2012-08-01 株式会社日立製作所 パワー半導体装置
WO2011115081A1 (ja) * 2010-03-16 2011-09-22 富士電機システムズ株式会社 半導体装置
JP2012229971A (ja) 2011-04-26 2012-11-22 Honda Motor Co Ltd 半導体検査装置、及び半導体検査方法
CN104067387B (zh) * 2012-03-22 2016-12-14 三菱电机株式会社 半导体装置及其制造方法
CN102693969B (zh) * 2012-06-18 2014-12-24 南京银茂微电子制造有限公司 一种igbt功率模块
CN202695428U (zh) * 2012-06-18 2013-01-23 南京银茂微电子制造有限公司 一种igbt功率模块
CN102801072A (zh) * 2012-07-23 2012-11-28 西安永电电气有限责任公司 Igbt模块短接桥
JP6076865B2 (ja) * 2013-09-02 2017-02-08 ルネサスエレクトロニクス株式会社 電子装置

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10112978A (ja) * 1996-10-08 1998-04-28 Fuji Electric Co Ltd スイッチング電源用整流部の組立構造
JP2003043105A (ja) * 2001-08-02 2003-02-13 Fujitsu Media Device Kk 被測定物の特性試験時におけ被測定物の吸着加圧方法及びその吸着加圧パット
JP2004324354A (ja) * 2003-04-28 2004-11-18 Shimizu Corp トンネル掘削機の切削刃部の取付構造、取付方法及び交換方法
JP2005345247A (ja) * 2004-06-02 2005-12-15 Toyota Motor Corp 半導体素子の評価装置
JP2009522758A (ja) * 2005-12-28 2009-06-11 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 電子モジュールならびに該電子モジュールを製造するための方法
JP2007324354A (ja) * 2006-05-31 2007-12-13 Sony Corp 半導体装置
JP2010103222A (ja) * 2008-10-22 2010-05-06 Fuji Electric Systems Co Ltd 半導体装置
US20100252922A1 (en) * 2009-04-03 2010-10-07 Infineon Technologies Ag Power Semiconductor Module, Power Semiconductor Module Assembly and Method for Fabricating a Power Semiconductor Module Assembly
JP2013065836A (ja) * 2011-08-31 2013-04-11 Mitsubishi Electric Corp 電極部材およびこれを用いた電力用半導体装置

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018129414A (ja) * 2017-02-09 2018-08-16 株式会社東芝 半導体モジュール
US10199365B2 (en) 2017-02-09 2019-02-05 Kabushiki Kaisha Toshiba Semiconductor module
JP2019050301A (ja) * 2017-09-11 2019-03-28 株式会社東芝 パワー半導体モジュール
JP2021002552A (ja) * 2019-06-20 2021-01-07 富士電機株式会社 半導体装置及びその製造方法、並びに半導体モジュール
JP7358797B2 (ja) 2019-06-20 2023-10-11 富士電機株式会社 半導体装置及びその製造方法、並びに半導体モジュール

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