JP2016004948A - 半導体装置 - Google Patents

半導体装置 Download PDF

Info

Publication number
JP2016004948A
JP2016004948A JP2014125531A JP2014125531A JP2016004948A JP 2016004948 A JP2016004948 A JP 2016004948A JP 2014125531 A JP2014125531 A JP 2014125531A JP 2014125531 A JP2014125531 A JP 2014125531A JP 2016004948 A JP2016004948 A JP 2016004948A
Authority
JP
Japan
Prior art keywords
nitride semiconductor
semiconductor layer
layer
concentration
semiconductor device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2014125531A
Other languages
English (en)
Inventor
康裕 磯部
Yasuhiro Isobe
康裕 磯部
直治 杉山
Naoji Sugiyama
直治 杉山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP2014125531A priority Critical patent/JP2016004948A/ja
Priority to KR1020150002011A priority patent/KR20160001595A/ko
Priority to CN201510013137.5A priority patent/CN105304783A/zh
Priority to US14/634,863 priority patent/US20150372124A1/en
Publication of JP2016004948A publication Critical patent/JP2016004948A/ja
Priority to US15/249,168 priority patent/US20160365417A1/en
Pending legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/201Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds including two or more compounds, e.g. alloys
    • H01L29/205Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds including two or more compounds, e.g. alloys in different semiconductor regions, e.g. heterojunctions
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • H01L29/518Insulating materials associated therewith the insulating material containing nitrogen, e.g. nitride, oxynitride, nitrogen-doped material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0684Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape, relative sizes or dispositions of the semiconductor regions or junctions between the regions
    • H01L29/0692Surface layout
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/2003Nitride compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/207Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds further characterised by the doping material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/36Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the concentration or distribution of impurities in the bulk material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/778Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
    • H01L29/7786Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with direct single heterostructure, i.e. with wide bandgap layer formed on top of active layer, e.g. direct single heterostructure MIS-like HEMT

Abstract

【課題】高耐圧化された半導体装置およびその製造方法を提供する。【解決手段】実施形態の半導体装置は、第1の窒化物半導体層と、イントリンシック窒化物半導体層と、Alを有する第2の窒化物半導体層とを持つ。前記イントリンシック窒化物半導体層は、前記第1の窒化物半導体層の第1の側に設けられる。前記第2の窒化物半導体層は、前記イントリンシック窒化物半導体層の前記第1の窒化物半導体層に対向する側に設けられる。前記第1の窒化物半導体層は、前記第1の窒化物半導体層、前記イントリンシック窒化物半導体層および前記第2の窒化物半導体層が積層される方向に、第1の濃度と、前記第1の濃度よりも低い第2の濃度とが繰り返す炭素分布を有する。【選択図】図2C

Description

本発明の実施形態は、半導体装置に関する。
窒化物半導体は、発光デバイスの他、その臨界電界強度の高さからパワーデバイスにも使用され、近年、より一層の高耐圧化が求められている。
特開2007−251144号公報
本発明が解決しようとする課題は、高耐圧化された半導体装置を提供することである。
実施形態の半導体装置は、第1の窒化物半導体層と、イントリンシック窒化物半導体層と、Alを有する第2の窒化物半導体層とを持つ。前記イントリンシック窒化物半導体層は、前記第1の窒化物半導体層の第1の側に設けられる。前記第2の窒化物半導体層は、前記イントリンシック窒化物半導体層の前記第1の窒化物半導体層に対向する側に設けられる。前記第1の窒化物半導体層は、前記第1の窒化物半導体層、前記イントリンシック窒化物半導体層および前記第2の窒化物半導体層が積層される方向に、第1の濃度と、前記第1の濃度よりも低い第2の濃度とが繰り返す炭素分布を有する。
実施形態1による半導体装置を示す略示断面図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]の濃度分布の具体例を示す図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]の濃度分布の他の具体例を示す図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]の濃度分布のさらに他の具体例を示す図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]およびアルミニウム[Al]の濃度分布の具体例を示す図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]およびアルミニウム[Al]の濃度分布の他の具体例を示す図の一例。 図1に示す半導体装置が含むC−AlGa1−xN層中の炭素[C]およびアルミニウム[Al]の濃度分布のさらに他の具体例を示す図の一例。 実施形態2による半導体装置を示す略示断面図の一例。 図4に示す半導体装置の製造方法を説明する略示断面図の一例。 図4に示す半導体装置の製造方法を説明する略示断面図の一例。
以下、実施形態のいくつかについて図面を参照しながら説明する。図面において、同一の部分には同一の参照番号を付し、その重複説明は適宜省略する。また、添付の図面は、それぞれ発明の説明とその理解を促すためのものであり、各図における形状や寸法、比などは実際の装置と異なる個所がある点に留意されたい。
本願明細書において、「積層」は、互いに接して重ねられる場合の他、間に他の層が介挿されて重ねられる場合をも含む。また、「上に設けられる」とは、直接接して設けられる場合の他、間に他の層が介挿されて設けられる場合をも含む。
(1)半導体装置
図1は、実施形態1による半導体装置を示す略示断面図の一例である。本実施形態の半導体装置は、基板Sと、バッファ層10と、C−ALGA1−xN層13と、i(intrinsic)−GaN層14と、AlGa1−xN層15と、を含む。
基板Sは、本実施形態において、(111)面からなるSi基板である。Si基板の厚さは、例えば500μm以上2mm以内であり、より望ましくは700μm以上、1.5mm以内である。また、基板Sは薄層Siが積層された基体であってもよい。薄層Siが積層された基体を用いる場合は、薄層Siの層厚は例えば5nm以上500nmである。しかしながら、基板SはSi基板に限ることなく、例えば、SiC基板、サファイア基板またはGaN基板等も使用可能である。
バッファ層10は、本実施形態において、基板Sの上に基板Sに接して設けられたAlN層である。AlN層10の層厚は、例えば50nm以上500nm以下であり、望ましくは100nm以上300nm以下である。なお、バッファ層10に代えて超格子構造の多層膜を使用してもよい。ここで、「超格子構造」とは、例えば層厚5nmのAlN層と層厚20nmのGaN層とを1ペアとして、これを複数ペア、例えば20ペア交互に積層した構造をいう。
また、半導体装置全体の層厚や半導体装置の設計によっては、AlN層10の基板Sに対向する側でAlN層10に接してAlGa1−yN層(0<y<1)を介挿してもよい。その場合、AlGa1−yN層(0<y<1)の層厚は、例えば100nm以上1000nmである。
C−AlGa1−xN層13は、バッファ層10の基板Sに対向する側に設けられた、炭素[C]を含むAlGa1−xN層(0≦x<0.01)である。C−AlGa1−xN層13の層厚は、例えば100nm以上10μm以下であり、C−AlGa1−xN層13に含まれる炭素[C]の平均濃度は例えば1×1016cm−3以上3×1019cm−3以下であり、炭素[C]の最小濃度は1×1010cm−3、最大濃度は5×1019cm−3である。AlGa1−xN層中に炭素[C]を添加することにより、リーク電流を低減することができるので、半導体装置全体としての絶縁耐量が増加し、高耐圧化が可能になる。C−AlGa1−xN層13は、本実施形態において例えば第1の窒化物半導体層に対応する。C−AlGa1−xN層13の詳細構成については後に詳述する。
i−GaN層14は、C−AlGa1−xN層13のバッファ層10に対向する側に設けられる。i−GaN層14の層厚は例えば0.5μm以上3μm以下であり、i−GaN層14の不純物濃度は、炭素[C]、酸素[O]およびシリコン[Si]のいずれもが3×1017cm−3未満である。本実施形態において、i−GaN層14は、例えばイントリンシック窒化物半導体層に対応し、バッファ層10に対向する側は例えば第1の側に対応する。
AlGa1−xN層15は、i−GaN層14のC−AlGa1−xN層13に対向する側に形成され、ノンドープまたはn型のAlGa1−xN(0<x≦1)を含む。i−GaN層14内のi−GaN層14とAlGa1−xN層15との界面付近には二次元電子系30eが発生する。これにより、i−GaN層14はチャネルとして機能する。本実施形態において、AlGa1−xN層15は、例えば第2の窒化物半導体層に対応する。
C−AlGa1−xN層13の具体的な構成について図2A乃至図3Cを参照して詳述する。
本実施形態の半導体装置に設けられたC−AlGa1−xN層13において、添加された炭素[C]の濃度分布は一様ではなく、その厚さ方向、すなわち基板S上でバッファ層10、C−ALGA1−xN層13、i−GaN層14、およびAlGa1−xN層15が積層される方向において、変化している。
C−AlGa1−xN層13における[C]濃度変化のいくつかの具体例を図2A乃至図2Cに示す。図2Aの例では、C−AlGa1−xN層13のバッファ層10側からi−GaN層14側へ向かって炭素[C]濃度が所定割合で変化している。図2Bの例では、C−AlGa1−xN層13のバッファ層10側からi−GaN層14側へ向かって炭素[C]濃度が階段状に変化している。
炭素[C]濃度の変化態様として、図2Aおよび図2Bでは、C−AlGa1−xN層13のバッファ層10側からi−GaN層14側へ炭素[C]濃度が逓減する例を示した。これは、エピタキシャル成長層が十分に厚い場合、炭素[C]の濃度分布を一様にすると、上層側になるに従い、すなわち基板から離隔するに従ってGaN結晶の品質が低下してしまうからである。GaN結晶の品質低下はデバイス動作時に抵抗が増加する現象(電流コラプス)を誘発してしまう。
また、本実施形態では、基板SとしてSi基板を使用するため、炭素[C]濃度を一定にすると、エピタキシャル成長中に圧縮応力が掛かりにくくなる。そこで、C−AlGa1−xN層13のバッファ層10側からi−GaN層14側へ炭素[C]濃度が逓減することにより圧縮応力が掛かり易くなり、その結果、クラックフリーで、且つ、上に凸形状のウェーハを得ることができる。
しかしながら、C−AlGa1−xN層13における[C]濃度の変化は、これらの例に限ることなく、例えば図2Cの櫛の歯形状に示すように、バッファ層10側からi−GaN層14側へ向けて高濃度の領域と(例えば炭素[C]の添加が意図的に止められた)低濃度の領域とが繰り返す態様でもよい。この場合は、例えばC−AlGa1−xN層13の膜厚は100nm以上10μm以下であり、炭素[C]の最小濃度は1×1010cm−3、最大濃度は5×1019cm−3であり、高濃度領域と低濃度領域を繰り返す数(振幅数)の最小回数は5回であり、C−AlGa1−xN層13の膜厚をYμmとしたとき、振幅数は10Y以上1000Y以下である。この図2Cの実施形態においても、高濃度領域の炭素[C]は低濃度領域側へ拡散するため、平均炭素濃度としては、例えば1×1016cm−3以上3×1019cm−3以下となり、高耐圧化されたデバイスを実現できる。さらに、上記したように、炭素[C]を一様に添加した窒化物半導体エピタキシャル成長層が十分厚い場合、結晶品質が低下してしまうが、低濃度領域層を設けることで結晶品質の低下を抑制することができ、電流コラプス現象も抑制することができる。
また、C−AlGa1−xN層13については炭素[C]濃度のみならず、アルミニウム[Al]の組成比(すなわち、C−AlGa1−xN中のxの値)を変化させてもよい。アルミニウム[Al]組成比の変化態様は、例えば図3A乃至図3Cに示すように、炭素[C]濃度の変化態様と同様でもよいが、これらの例に限るものではない。このように積層方向、例えばバッファ層10側からi−GaN層14側へ向かってアルミニウム[Al]濃度が変化することにより、炭素[C]濃度のコントロールを容易にし、高品質な結晶を得ることができる。
図4は、実施形態2による半導体装置の概略構造を示す略示断面図の一例である。
図1との対比により明らかなように、本実施形態の半導体装置は、図1に示す半導体装置に電極31乃至33をさらに設けることにより、横型HEMT(High Electron Mobility Transistor)を実現したものである。
具体的には、図4に示す半導体装置は、基板S、バッファ層10、C−AlGa1−xN層13、i−GaN層14、およびAlGa1−xN層15がこの順で積層された半導体装置に加え、ソース(またはドレイン)電極31、ドレイン(またはソース)電極32およびゲート電極33を含む。
ソース(またはドレイン)電極31、および、ドレイン(またはソース)電極32は、AlGa1−xN層15のi−GaN層14に対向する側に互いに離隔して設けられ、それぞれAlGa1−xN層15にオーミック接合されるように形成される。本実施形態において、ソース(またはドレイン)電極31、および、ドレイン(またはソース)電極32は、例えば第1および第2の電極にそれぞれ対応する。
ゲート電極33は、ソース(またはドレイン)電極31、および、ドレイン(またはソース)電極32に挟まれるようにAlGa1−xN層15のi−GaN層14に対向する側に形成される。本実施形態において、ゲート電極33は例えば制御電極に対応する。
図4では特に図示しないが、これらの電極31〜33間のAlGa1−xN層15上の領域に絶縁膜を成膜してもよい。また、ゲート電極33とAlGa1−xN層15との間にゲート絶縁膜(図示せず)を介挿してMIS(Metal−Insulator−Semiconductor)構造としてもよい。
上述した少なくとも一つの実施形態による半導体装置によれば、積層方向に炭素[C]の濃度または炭素[C]およびアルミニウム[Al]の濃度が変化するC−AlGa1−xN層13を含むので、高耐圧化されえた半導体装置が提供される。
(2)半導体装置の製造方法
図4に記載の半導体装置を製造する方法の一例について図5Aおよび図5Bを参照しながら説明する。
まず、図5Aに示すように、既知の方法を用いた低温成長により基板S上にバッファ層10を形成する。
次に、有機金属気相堆積(MOCVD:etal rganic hemical apor eposition)法により、炭素[C]をドープしながらバッファ層10の基板Sに対向する側にGaN結晶をエピタキシャル成長させる。ドーピングガスとしては例えばアセチレン(C)もしくは四臭化炭素(CBr4)を使用する。
エピタキシャル成長中のGaN結晶内の炭素[C]濃度を高めるためには、(a)成長圧力を下げる、(b)V属元素材料/III属元素(本例ではN/Ga)の比を下げる、(c)成長温度を下げる、などの方法もある。
ここで、一定濃度の炭素[C]を含むドーパントガスを供給しながらGaN結晶をエピタキシャル成長させる場合、炭素[C]が瞬間的に過剰に供給された場合、炭素[C]が適切なエピタキシャル成長を阻害してしまうため、GaN結晶の品質が低下する可能性があるという問題がある。特に、GaNのエピタキシャル成長層を厚く形成する場合は、上層側になるに従い、すなわち基板から離隔するに従ってGaN結晶の品質が低下する可能性があるという問題もある。また、本例のように、Si基板上にGaN結晶を成長させる場合、高濃度の炭素[C]を添加したGaNは、格子定数が理想的な値ではないことにより、成長中で圧縮応力が掛かりにくいため、クラックフリー且つ上に凸形状のウェーハを得ることが困難であるという問題もある。
これらの問題に対処するため、例えば図2A乃至図2Cに示したように、狙いの炭素[C]濃度分布に応じてドーピングガス量、成長温度および圧力を制御する。ただし、これらのパラメータの組み合わせを最適化してもGaN層の結晶品質には問題が残る。
そこで、本例では、Alを含む窒化物半導体は他の不純物を取り込みやすくなるという特性を利用し、GaN結晶のエピタキシャル成長中にアルミニウム[Al]をドーピングする。アルミニウム[Al]のドーピング量は、組成比で1%未満が望ましい。これにより、GaNの格子定数、結晶品質、および成長速度に強い影響を与えることなく、炭素[C]の取り込みを増加させることができる。その結果、図5Bに示すように炭素[C]が添加されたAlGa1−xN層13が形成される。本例のようにアルミニウム[Al]をドーピングした場合は、AlGa1−xN中のxの値は、0<x<0.01となる。
本例では、炭素[C]の取り込みをより一層増加させるため、トリメチルアルミニウムAl(CH)(以下、単に「TMAl」という)を用いて以下の反応式(1)により炭素[C]の供給量を増やす。
Ga(CH)+ Al(CH)+ NH=GaN,AlN + H,C …反応式(1)
このようにIII族原料を増やすことで炭素[C]の供給量を増大させることができる。
また、例えば図3A乃至図3Cに示したように、炭素[C]のみならずアルミニウム[Al]のドープ量を変化させることもできる。これにより、AlGaN中の原料組成の組み合わせやドープする炭素[C]濃度分布の選択肢を増やすことが可能となる。
その後は、既知の方法により、C−AlGa1−xN層13のバッファ層10に対向する側にi−GaN層14とAlGa1−xN層15とを順次に形成し、さらに、AlGa1−xN層15にオーミック接合されるようにソースまたはドレインとなる電極31,32を形成し、AlGa1−xN層15のi−GaN層14と対向する側で電極31,32間にゲート電極33を形成すれば、図4に示す半導体装置が提供される。
上述した半導体装置の製造方法によれば、GaN結晶のエピタキシャル成長中に炭素[C]の濃度または炭素[C]およびアルミニウム[Al]の濃度を変化させるので、一定濃度で炭素[C]をドーピングし続ける場合と同様のリーク電流低減効果が得られると共に、良好な結晶品質を得ることができる。さらに、Si基板上にC−AlGa1−xN層13を形成する場合は上に凸の形状を得ることができる。これにより、高耐圧化された半導体装置を提供することができる。
本発明のいくつかの実施形態を説明したが、これらの実施形態は、例として提示したものであり、発明の範囲を限定することは意図していない。これら実施形態は、その他の様々な形態で実施されることが可能であり、発明の要旨を逸脱しない範囲で、種々の省略、置き換え、変更を行うことができる。これら実施形態やその変形は、発明の範囲や要旨に含まれると同様に、特許請求の範囲に記載された発明とその均等の範囲に含まれるものである。
10…バッファ層、13…C−AlGa1−xN層、14…i−GaN層、15…AlGa1−xN層、31,32…ドレイン電極またはソース電極、33…ゲート電極、S…基板。

Claims (10)

  1. 第1の窒化物半導体層と、
    前記第1の窒化物半導体層の第1の側に設けられたイントリンシック窒化物半導体層と、
    前記イントリンシック窒化物半導体層の前記第1の窒化物半導体層に対向する側に設けられたAlを有する第2の窒化物半導体層と、
    を備え、
    前記第1の窒化物半導体層は、前記第1の窒化物半導体層、前記イントリンシック窒化物半導体層および前記第2の窒化物半導体層が積層される方向に、第1の濃度と前記第1の濃度よりも低い第2の濃度とが繰り返す炭素分布を有することを特徴とする半導体装置。
  2. Alを有する第1の窒化物半導体層と、
    前記第1の窒化物半導体層の第1の側に設けられたイントリンシック窒化物半導体層と、
    前記イントリンシック窒化物半導体層の前記第1の窒化物半導体層に対向する側に設けられたAlを有する第2の窒化物半導体層と、
    を備え、
    前記第1の窒化物半導体層は、濃度が変化する炭素分布を有することを特徴とする半導体装置。
  3. 前記第1の窒化物半導体層中のAl濃度は、前記第1の窒化物半導体層、前記イントリンシック窒化物半導体層および前記第2の窒化物半導体層が積層される方向に逓減することを特徴とする請求項2に記載の半導体装置。
  4. 前記Al濃度は、階段状に逓減することを特徴とする請求項2または3に記載の半導体装置。
  5. 前記第1の窒化物半導体層は、前記第1の窒化物半導体層、前記イントリンシック窒化物半導体層および前記第2の窒化物半導体層が積層される方向に、第1の濃度と前記第1の濃度よりも低い第2の濃度とが繰り返すAl分布を有することを特徴とする請求項2に記載の半導体装置。
  6. 前記第1の濃度の最大値は5×1019cm−3であることを特徴とする請求項1または5に記載の半導体装置。
  7. 前記第2の濃度の最小値は1×1010cm−3であることを特徴とする請求項1、5および6のいずれか一項に記載の半導体装置。
  8. 前記第1の濃度と前記第2の濃度とが繰り返す数は5以上であることを特徴とする請求項1、5乃至7のいずれか一項に記載の半導体装置。
  9. 前記第1の窒化物半導体層の厚さをYμmとすると、前記第1の濃度と前記第2の濃度とが繰り返す数は10Y以上1000Y以下であることを特徴とする請求項1、5乃至8のいずれか一項に記載の半導体装置。
  10. 前記第2の窒化物半導体層の前記イントリンシック窒化物半導体層に対向する側に、互いに離隔して設けられた第1および第2の電極と、
    前記第2の窒化物半導体層の前記イントリンシック窒化物半導体層に対向する側で前記第1および第2の電極の間に設けられた制御電極と、
    をさらに備えることを特徴とする請求項1乃至9のいずれか一項に記載の半導体装置。
JP2014125531A 2014-06-18 2014-06-18 半導体装置 Pending JP2016004948A (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2014125531A JP2016004948A (ja) 2014-06-18 2014-06-18 半導体装置
KR1020150002011A KR20160001595A (ko) 2014-06-18 2015-01-07 반도체 장치
CN201510013137.5A CN105304783A (zh) 2014-06-18 2015-01-12 半导体装置
US14/634,863 US20150372124A1 (en) 2014-06-18 2015-03-01 Semiconductor device
US15/249,168 US20160365417A1 (en) 2014-06-18 2016-08-26 Semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2014125531A JP2016004948A (ja) 2014-06-18 2014-06-18 半導体装置

Publications (1)

Publication Number Publication Date
JP2016004948A true JP2016004948A (ja) 2016-01-12

Family

ID=54870418

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2014125531A Pending JP2016004948A (ja) 2014-06-18 2014-06-18 半導体装置

Country Status (4)

Country Link
US (2) US20150372124A1 (ja)
JP (1) JP2016004948A (ja)
KR (1) KR20160001595A (ja)
CN (1) CN105304783A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2020098939A (ja) * 2020-03-09 2020-06-25 株式会社東芝 半導体基板及び半導体装置
JP2020530939A (ja) * 2017-07-20 2020-10-29 スウェガン、アクチボラグSwegan Ab 高電子移動度トランジスタのためのヘテロ構造及びその製造方法

Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015176936A (ja) * 2014-03-13 2015-10-05 株式会社東芝 半導体装置
WO2017100141A1 (en) * 2015-12-10 2017-06-15 IQE, plc Iii-nitride structures grown silicon substrates with increased compressive stress
US11430882B2 (en) 2016-06-24 2022-08-30 Wolfspeed, Inc. Gallium nitride high-electron mobility transistors with p-type layers and process for making the same
US10892356B2 (en) 2016-06-24 2021-01-12 Cree, Inc. Group III-nitride high-electron mobility transistors with buried p-type layers and process for making the same
US10840334B2 (en) * 2016-06-24 2020-11-17 Cree, Inc. Gallium nitride high-electron mobility transistors with deep implanted p-type layers in silicon carbide substrates for power switching and radio frequency applications and process for making the same
DE112019006829T5 (de) * 2019-02-05 2021-10-21 Mitsubishi Electric Corporation Halbleitervorrichtung und Verfahren zur Herstellung der Halbleitervorrichtung
JP7393138B2 (ja) * 2019-06-24 2023-12-06 住友化学株式会社 Iii族窒化物積層体
US20220376096A1 (en) * 2020-06-23 2022-11-24 Innoscience (Zhuhai) Technology Co., Ltd. Semiconductor device structures and methods of manufacturing the same
CN114616679B (zh) * 2021-04-12 2023-04-18 英诺赛科(苏州)科技有限公司 半导体器件及其制造方法
US11929428B2 (en) 2021-05-17 2024-03-12 Wolfspeed, Inc. Circuits and group III-nitride high-electron mobility transistors with buried p-type layers improving overload recovery and process for implementing the same

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010239034A (ja) * 2009-03-31 2010-10-21 Furukawa Electric Co Ltd:The 半導体装置の製造方法および半導体装置
JP2011082494A (ja) * 2009-09-14 2011-04-21 Covalent Materials Corp 化合物半導体基板
WO2012066701A1 (ja) * 2010-11-19 2012-05-24 パナソニック株式会社 窒化物半導体装置
JP2013021124A (ja) * 2011-07-11 2013-01-31 Dowa Electronics Materials Co Ltd Iii族窒化物エピタキシャル基板およびその製造方法
JP2014072429A (ja) * 2012-09-28 2014-04-21 Fujitsu Ltd 半導体装置
JP2015053328A (ja) * 2013-09-05 2015-03-19 富士通株式会社 半導体装置

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5192987A (en) * 1991-05-17 1993-03-09 Apa Optics, Inc. High electron mobility transistor with GaN/Alx Ga1-x N heterojunctions
US6649287B2 (en) * 2000-12-14 2003-11-18 Nitronex Corporation Gallium nitride materials and methods
US7112830B2 (en) * 2002-11-25 2006-09-26 Apa Enterprises, Inc. Super lattice modification of overlying transistor
US8482035B2 (en) * 2005-07-29 2013-07-09 International Rectifier Corporation Enhancement mode III-nitride transistors with single gate Dielectric structure
US8269259B2 (en) * 2009-12-07 2012-09-18 International Rectifier Corporation Gated AlGaN/GaN heterojunction Schottky device
US9105703B2 (en) * 2010-03-22 2015-08-11 International Rectifier Corporation Programmable III-nitride transistor with aluminum-doped gate
JP5552923B2 (ja) * 2010-06-30 2014-07-16 住友電気工業株式会社 半導体装置およびその製造方法
US8796738B2 (en) * 2011-09-21 2014-08-05 International Rectifier Corporation Group III-V device structure having a selectively reduced impurity concentration
JP6119165B2 (ja) * 2012-09-28 2017-04-26 富士通株式会社 半導体装置

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010239034A (ja) * 2009-03-31 2010-10-21 Furukawa Electric Co Ltd:The 半導体装置の製造方法および半導体装置
JP2011082494A (ja) * 2009-09-14 2011-04-21 Covalent Materials Corp 化合物半導体基板
WO2012066701A1 (ja) * 2010-11-19 2012-05-24 パナソニック株式会社 窒化物半導体装置
JP2013021124A (ja) * 2011-07-11 2013-01-31 Dowa Electronics Materials Co Ltd Iii族窒化物エピタキシャル基板およびその製造方法
JP2014072429A (ja) * 2012-09-28 2014-04-21 Fujitsu Ltd 半導体装置
JP2015053328A (ja) * 2013-09-05 2015-03-19 富士通株式会社 半導体装置

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2020530939A (ja) * 2017-07-20 2020-10-29 スウェガン、アクチボラグSwegan Ab 高電子移動度トランジスタのためのヘテロ構造及びその製造方法
JP7039684B2 (ja) 2017-07-20 2022-03-22 スウェガン、アクチボラグ 高電子移動度トランジスタのためのヘテロ構造及びその製造方法
JP2020098939A (ja) * 2020-03-09 2020-06-25 株式会社東芝 半導体基板及び半導体装置

Also Published As

Publication number Publication date
US20150372124A1 (en) 2015-12-24
CN105304783A (zh) 2016-02-03
US20160365417A1 (en) 2016-12-15
KR20160001595A (ko) 2016-01-06

Similar Documents

Publication Publication Date Title
JP2016004948A (ja) 半導体装置
JP5064824B2 (ja) 半導体素子
US9660066B2 (en) High electron mobility transistor
US8426893B2 (en) Epitaxial substrate for electronic device and method of producing the same
US8072002B2 (en) Field effect transistor
TWI596764B (zh) 具有週期性摻雜碳之氮化鎵之高電子移動率電晶體
JP5919703B2 (ja) 半導体装置
JP5787417B2 (ja) 窒化物半導体基板
WO2012026234A1 (ja) エピタキシャルウエハ及び半導体装置
US8759878B2 (en) Nitride semiconductor device and method for manufacturing same
WO2015008430A1 (ja) 半導体装置
JP2016167499A (ja) 半導体装置
JP2013125913A (ja) 半導体装置
JP6331695B2 (ja) 半導体素子の製造方法
JP2011187643A (ja) ヘテロ接合型電界効果トランジスタ
JP2009021279A (ja) 半導体エピタキシャルウエハ
JP2007123824A (ja) Iii族窒化物系化合物半導体を用いた電子装置
JP5746927B2 (ja) 半導体基板、半導体デバイスおよび半導体基板の製造方法
JP2015115371A (ja) 窒化物半導体装置およびその製造方法、並びに電界効果トランジスタおよびダイオード
JP2015070091A (ja) Iii族窒化物半導体基板
JP2015008244A (ja) ヘテロ接合電界効果型トランジスタおよびその製造方法
JP2012064977A (ja) Iii族窒化物半導体積層ウェハ及びiii族窒化物半導体デバイス
JP2016134565A (ja) 半導体装置
JP7347335B2 (ja) 半導体装置
JP2016134563A (ja) 半導体装置

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20160824

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20170417

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20170425

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20171024