JP2011009259A - 半導体装置、リソグラフィ方法、及び半導体装置の製造方法 - Google Patents
半導体装置、リソグラフィ方法、及び半導体装置の製造方法 Download PDFInfo
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Abstract
【解決手段】本発明による半導体装置は、リソグラフィ製造工程用のアライメントマークを有する。アライメントマークは、検出光の走査方向に沿って所定の間隔で配置された複数の棒状マーク10を備える。複数の棒状マーク10の各々は、走査方向に直交する第1方向に沿って所定の間隔で配置された複数の配線マーク11によって形成される。互いに隣接する配線マーク10間隔WSは、半導体装置の設計制約の範囲内において前記検出光の波長より短い。
【選択図】図8
Description
図8から図11を参照して、本発明によるアライメントマークの第1の実施の形態を説明する。本実施の形態におけるアライメントマーク1は、シリコンウエハ上に転写済みの回路パタン(以下、重ね合わせ先層と称す)の位置を確認するために利用される。
図12から図19を参照して、本発明によるアライメントマークの第2の実施の形態を説明する。
10、10a、10b、20a、20b:棒状マーク
11:配線マーク(ライン)
12:スペース
P1〜P3:間隔(ピッチ)
W1〜W3:幅
WL:配線マークの線幅
WS:スペースの幅
Claims (9)
- 検出光によって位置座標が検出されるアライメントマークが搭載された半導体装置において、
前記アライメントマークは、前記検出光の走査方向に沿って所定の間隔で配置された複数の棒状マークを備え、
前記複数の棒状マークの各々は、前記走査方向に直交する第1方向に沿って所定の間隔で配置された複数の配線マークによって形成され、
互いに隣接する前記配線マークの間隔は、半導体装置の設計制約の範囲内において前記検出光の波長より短い
半導体装置。 - 請求項1に記載の半導体装置において、
前記配線マークの前記第1方向の幅は、前記半導体装置の設計制約の範囲内にある
半導体装置。 - 請求項2に記載の半導体装置において、
前記幅及び前記配線マークの間隔は、1μm未満である
半導体装置。 - 請求項2又は3に記載の半導体装置において、
前記幅と前記配線マークの間隔は等しい
半導体装置。 - 請求項4に記載の半導体装置において、
前記幅は、0.5μm未満である
半導体装置。 - 請求項1から5のいずれか1項に記載の半導体装置において、
前記複数の棒状マークは、
前記走査方向がX方向であり、前記アライメントマークのX座標を検出するための第1棒状マークと、
前記走査方向がX方向に垂直なY方向であり、前記アライメントマークのY座標を検出するための第2棒状マークと、
を備える
半導体装置。 - 半導体基板上に形成されたアライメントマークに検出光を照射して、前記検出光の反射強度から前記アライメントマークの位置座標を検出する工程と、
前記位置座標に基づいて前記半導体基板の位置を調整する工程と、
前記回路パタンの上層に所定のパタンのフォトレジストを露光する工程と
を具備し、
前記アライメントマークは、
前記検出光の走査方向に沿って所定の間隔で配置された複数の棒状マークを備え、
前記複数の棒状マークの各々は、前記走査方向に直行する第1方向に沿って所定の間隔で配置された、複数の配線マークによって形成され、
互いに隣接する前記配線マーク間の第1方向の第1間隔が、半導体装置の設計制約の範囲内において、前記検出光の波長より短いことを特徴とする
リソグラフィ方法。 - 請求項7に記載のリソグラフィ方法において、
前記フォトレジストを露光する工程は、
前記回路パタンが形成された重ね合わせ先層に設けられた第1アライメントマークに、検出光を照射して、前記検出光の反射強度から前記第1アライメントマークの第1位置座標を検出する工程と、
前記所定のパタンの重ね合わせ層に設けられた第2アライメントマークに、検出光を照射して、前記検出光の反射強度から前記第2アライメントマークの第2位置座標を検出する工程と、
前記第1位置座標と前記第2位置座標とを用いて前記所定のパタンのフォトレジストの露光位置を決定する工程と
を備え、
前記第1アライメントマークと前記第2アライメントマークのそれぞれは、前記複数の棒状マークを備え、
前記複数の棒状マークは、
前記走査方向がX方向であり、前記アライメントマークのX座標を検出するための第1棒状マークと、
前記走査方向がX方向に垂直なY方向であり、前記アライメントマークのY座標を検出するための第2棒状マークと
を備える
リソグラフィ方法。 - 請求項7又は8に記載のリソグラフィ方法を用いた半導体装置の製造方法。
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