JP2008243904A - 半導体発光素子およびその製造方法ならびに発光装置 - Google Patents

半導体発光素子およびその製造方法ならびに発光装置 Download PDF

Info

Publication number
JP2008243904A
JP2008243904A JP2007078719A JP2007078719A JP2008243904A JP 2008243904 A JP2008243904 A JP 2008243904A JP 2007078719 A JP2007078719 A JP 2007078719A JP 2007078719 A JP2007078719 A JP 2007078719A JP 2008243904 A JP2008243904 A JP 2008243904A
Authority
JP
Japan
Prior art keywords
layer
light emitting
semiconductor
type gan
light
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2007078719A
Other languages
English (en)
Other versions
JP5032171B2 (ja
Inventor
Hajime Nako
古 肇 名
Koichi Tachibana
浩 一 橘
Kotaro Zaima
満 康太郎 財
Shinji Saito
藤 真 司 斎
Shinya Nunogami
上 真 也 布
Toshiyuki Oka
俊 行 岡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP2007078719A priority Critical patent/JP5032171B2/ja
Priority to US12/037,358 priority patent/US7863637B2/en
Publication of JP2008243904A publication Critical patent/JP2008243904A/ja
Priority to US12/955,620 priority patent/US8004004B2/en
Application granted granted Critical
Publication of JP5032171B2 publication Critical patent/JP5032171B2/ja
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/02Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies
    • H01L33/26Materials of the light emitting region
    • H01L33/30Materials of the light emitting region containing only elements of group III and group V of the periodic system
    • H01L33/32Materials of the light emitting region containing only elements of group III and group V of the periodic system containing nitrogen
    • FMECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
    • F21LIGHTING
    • F21KNON-ELECTRIC LIGHT SOURCES USING LUMINESCENCE; LIGHT SOURCES USING ELECTROCHEMILUMINESCENCE; LIGHT SOURCES USING CHARGES OF COMBUSTIBLE MATERIAL; LIGHT SOURCES USING SEMICONDUCTOR DEVICES AS LIGHT-GENERATING ELEMENTS; LIGHT SOURCES NOT OTHERWISE PROVIDED FOR
    • F21K9/00Light sources using semiconductor devices as light-generating elements, e.g. using light-emitting diodes [LED] or lasers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/0556Disposition
    • H01L2224/05568Disposition the whole external layer protruding from the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05573Single external layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05639Silver [Ag] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05644Gold [Au] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05663Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05666Titanium [Ti] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05663Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05669Platinum [Pt] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/15Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components with at least one potential-jump barrier or surface barrier specially adapted for light emission
    • H01L27/153Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components with at least one potential-jump barrier or surface barrier specially adapted for light emission in a repetitive configuration, e.g. LED bars
    • H01L27/156Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components with at least one potential-jump barrier or surface barrier specially adapted for light emission in a repetitive configuration, e.g. LED bars two-dimensional arrays
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/02Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies
    • H01L33/16Semiconductor devices with at least one potential-jump barrier or surface barrier specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor bodies with a particular crystal structure or orientation, e.g. polycrystalline, amorphous or porous

Abstract

【課題】演色性の高い半導体発光素子およびその製造方法ならびに発光装置を提供することを可能にする。
【解決手段】上面が傾斜面2a1である凸部2aと、凸部の両側に形成され凸部よりも幅が狭く底面が凸部の上面より深い位置にある凹部2bとを表面に有する半導体基板2と、半導体基板の上方に少なくとも凸部を覆うように形成された窒化物系半導体からなる発光層4と、を備えている。
【選択図】図1

Description

本発明は、半導体発光素子およびその製造方法ならびに発光装置に関する。
近年、半導体発光素子は広く表示装置、照明装置、記録装置等に用いられている。特に誘導放出を用いない半導体発光ダイオード(LED)は輝度が高いために表示装置として用いられている。また、最近新たな応用としてLEDを照明として用いる試みがなされている。例えば、蛍光灯の代替照明として、GaNを始めとする窒化物系半導体を用いた緑色から紫外域にかけての短波長の半導体発光素子と、蛍光体を組み合せた固体照明の技術開発と実用化が盛んに進められている。ここで、窒化物系半導体を用いた発光ダイオード(LED)等の発光素子と蛍光体の組み合わせ方を最適化し、太陽光に近い自然な白色光を得ることは、従来の固体照明の代替化という意味で非常に重要な要素となる。
一般的な白色光を得る組み合わせとして青色LEDと黄色蛍光体を組み合わせたものがあるが、近紫外LEDチップとRGB蛍光体とを組み合わせたものは太陽光に最も近く、前者より高演色性を得ることが可能である。
しかし、このような従来の方法は、LEDチップに蛍光体を塗布する必要があり、また、塗布方法などにより演色性が変化するなど、複雑な作製工程と微調整が必要となり、均一に再現性よく、また簡便に白色光源を得るのが難しいという問題があった。
更に、蛍光体に合わせたLEDチップの波長制御のためのIn(インジウム)の組成増加は、濃度不均一による非発光部や欠陥の増加、結晶品質の低下などを招くため高品質で高In組成の結晶を得るのは難しいという問題もあった。
また、半導体発光素子を照明として用いる場合に投入電力に対する発光効率が蛍光灯に比べて低いという問題がある。
一方、Inの組成比が低くても高出力の紫外線発光を可能にするGaN系半導体発光素子が開発されている(例えば、特許文献1参照)。この特許文献1に記載の発光素子は、表面に凹凸が形成された基板上にGaN系結晶層からなる積層構造を形成し、この積層構造にInGaN系発光層が含まれた構成となっている。そして、発光層中のIn組成は基板の凹凸に応じて面内で変調されている。しかし、この発光素子の発光波長は広くないため、白色光に近い演色性を得ることができない。
特開2003−258302号公報
以上説明したように、従来の白色光を得るための発光素子と蛍光体の組み合わせは複雑な工程を有し、波長制御のための高いIn組成を有する発光素子を得るためには、高度に制御された製造技術を必要とした。
また、演色性の高い半導体発光素子は今までのところ知られていない。
本発明は、上記事情を考慮してなされたものであって、演色性の高い半導体発光素子およびその製造方法ならびに発光装置を提供することを目的とする。
本発明の第1の態様による半導体発光素子は、上面が傾斜面である凸部と、前記凸部の両側に形成され前記凸部よりも幅が狭く底面が前記凸部の前記上面よりも深い位置にある凹部とを表面に有する半導体基板と、前記半導体基板の上方に少なくとも前記凸部を覆うように形成された窒化物系半導体からなる発光層と、を備えたことを特徴とする。
また、本発明の第2の態様による発光素子は、半導体基板と、前記半導体基板上に設けられたn型GaN層と、前記n型GaN層上に設けられ、障壁層と井戸層とが交互に積層された多重量子井戸構造の発光層と、前記発光層上に設けられたp型GaNからなるコンタクト層と、を備え、前記障壁層および前記井戸層の平均屈折率が前記発光層の上下の層の平均屈折率よりも低いことを特徴とする。
また、本発明の第3の態様による発光装置は、支持体と、前記支持体に支持された上記記載の半導体発光素子と、前記半導体発光素子の少なくとも一部を覆うように形成された樹脂と、前記樹脂に分散され、前記半導体発光素子が発光する光の少なくとも一部を吸収し、波長変換して発光する蛍光体と、を備えたことを特徴とする。
また、本発明の第4の態様による半導体発光素子の製造方法は、上面が傾斜面である凸部と、前記凸部の両側に形成され前記凸部よりも幅が狭く底面が前記凸部の前記上面よりも深い位置にある凹部とを表面に有する半導体基板上に窒化物系半導体からなる発光層を形成する工程、を備えたことを特徴とする。
以下、図面を参照して本発明の実施形態を詳細に説明する。
(第1実施形態)
本発明の第1実施形態による窒化物系半導体発光素子の概略の断面を図1に示す。本実施形態の半導体発光素子は、表面に幅の異なる凸部2aおよび凹部2bを有する基板2上に形成されたn型のGaNからなるガイド層3と、このGaN層3上に形成されたInGaNからなる多重量子井戸構造の発光層4と、この発光層4上に形成されたp型のGaNからなるガイド層5とを備えている。なお、本実施形態においては、コンタクト層および電極は省略している。また、各層は<0001>方向(紙面上では上方向)に成長される。
基板2の凸部2aおよび凹部2bは、<1−100>方向(図1では紙面に垂直な方向)にストライプ状で存在し、凸部2aの幅wは凹部2bの幅wより広く凸部2aの幅wが400μm、凹部2bの幅wが30μmである。なお、凸部2aの幅wは200μm以上1mm以下が良い。凸部2aの幅wが200μmより狭いと発光領域が狭くなって、1チップから得る発光効率が下がってしまう。また、凸部2aの幅wが1mmより大きいと積層する発光層4内のIn組成の面内不均一が顕著になる影響が出てしまい、高演色性の効果が失われる。更に、この凸部2aの幅wは、300μm以上500μm以下であることが好ましい。
凹部2bの幅wに関しては20μm以上100μm以下が良い。凹部2bの幅wが20nmより狭いと凹部2bに隣接する両サイドの凸部2aの成長面が交わる恐れがあり、積層する原子・分子のマイグレーションが凸部2a間で自由に行なわれ、このため演色性のよいIn組成の分布が保たれずに形成されてしまう。また、凹部2bの幅wが100μmより大きくなると一枚のウェハーから作製される窒化物系半導体発光素子の数が少なくなってしまうため好ましくない。更に、この凹部2bの幅wは、20μm以上50μm以下であることが好ましい。
なお、凹部2bの深さ、すなわち凸部2aの傾斜面の一番低い端部からの距離は、5μm以上50μm以下であることが好ましい。結晶成長後のチップ切り出しの際のスクライブラインの起点として、深さが5μm以上の凹部を設けることにより、切り出し・およびチップの分割が容易となる。しかし、深さが50μmより大きいと、凹部におけるウェハーの厚さが薄くなり、強度が弱くなる。このため、所望のチップ形状に分割するためのスクライブラインを形成する時点で、意図しない場所で凹部に沿って割れてしまい、所望のサイズのチップが得られなくなり、生産性が損なわれる。
また、本実施形態において、凸部2aは表面が<11−20>方向(紙面の右から左の方向)に対して傾斜した傾斜面2a1となっており、この傾斜面2a1の膜面に対する傾斜角θは約0.3度である。なお、傾斜方向は左から右方向でも構わない。また、一つの基板2上に異なる傾斜方向の凸部2aが存在していても良い。異なる幅、深さ、および異なる周期を有する凹凸が存在しても構わない。傾斜角度θは0.1度以上45度以下が良いが、デバイス構造を形成するため、好ましくは0.1度以上5度以下が良く、更に演色性のよいIn組成の分布を得て、平坦性を維持できるためには、傾斜角度θは0.2度以上0.4度以下が好ましい。
発光素子は、凸部2aおよび凹部2bが形成された基板2上に窒化物系半導体薄膜をエピタキシャル成長させることで作製する。薄膜は周知の技術である有機金属気相成長(MOCVD)法や分子線エピタキシー(MBE)法などを用いて成長することで作製が可能である。
本実施形態の比較例として、図2に示すように、凹凸のない基板100上にn型のGaNからなるガイド層3、多重量子井戸構造のInGaNからなる発光層4、p型のGaNからなるガイド層5を積層した発光素子を作成した。なお、各層の成長方向は、本実施形態と同様に<0001>方向である。
本実施形態の発光素子と比較例の発光素子を顕微フォトルミネッセンス(PL)による波長ピーク測定を実施したところ、比較例の発光素子の場合、400μm角内における波長分布はほぼ一定であったのに対し、本実施形態の発光素子は±20nm〜±30nmの範囲で分布していることがわかった。またそれは、凸部2aの傾斜面の高い部分から低い部分へ向かうにつれ(図1では右から左に向かうにつれ)波長が短波化の方向であることがわかった。これを以下に説明する。
InGaN結晶成長において、In原子(もしくは分子)は、成長面であるC面{0001}でマイグレーションなどによる移動により行き来するが、その際、それら原子が取り込まれる場所、例えば原子層のステップ端や、原子層のステップの直線から1個から数個の原子分ずれたキンクなどにGaが存在しないと取り込まれずに蒸発・拡散してしまう。このためGaが原子層ステップ端やキンク、またマイグレーションする表層により多く存在している状態をつくる必要がある。すなわち成長速度が速い状態にあるほどInの取り込み量は多くなる傾向となる。ここで、<11−20>方向に対して傾斜を持つ場合、傾斜角度に応じて表層のGa面とN面の存在比が違う。このため表層の吸着面では成長速度差が生じ、それに応じてIn原子の取込み量が変化することで、積層薄膜の同一面内においてIn組成の分布差が形成されることになる。
本実施形態の場合は、凸部2aの傾斜面2a1の高い部分から低い部分へ向かってGa面の存在比が小さくなる傾向であり、それにより傾斜面2a1の高い部分にIn取込み量の多い領域が形成され、傾斜面内での波長分布差が生じたものと考えられる。また、ステップフロー成長の場合、傾斜角を持った方向へ成長が進むため、本実施形態においては、傾斜面方向への成長が支配的である。
本実施形態では、積極的に<11−20>方向に対して傾斜した方向へ成長を促し、また、成長速度差を生じさせることでの相乗効果によって面内にIn組成の分布差を形成し、単一波長ではなくブロードな発光波長領域を有する発光素子を得ることが可能となる。これにより、高度に制御された製造技術を必要とせず、演色性の高い半導体発光素子を得ることができる。
また、強引に成長速度を上げてIn組成の増大させるのと違い、表面荒れや点欠陥の形成、発光に寄与しない不純物の増加などをおこさずにIn組成が高い活性層を得ることが可能となったため、結晶品質の高い長波発光素子を得ることができ、素子寿命など信頼性が重要なLDへの適応も可能となった。
なお、本実施形態においては、窒化物系半導体層の主成長面方向としてはC面{0001}であったがその限りではなく、他の面、例えばA面{11−20}、R面{1−102}、M面{1−100}、または{1−101}面、{11−22}面でもよい。
ここで、{0001}面は(0001)面や(000−1)面等の等価な面を含むミラー指数の包括表現である。一方、<1−100>方向は六方晶系の対称性に起因した結晶学的に等価な[1−100]、[10−10]、[−1100]、[−1010]、[01−10]、[0−110]方向を含む方向群の全体を集合的に表現するミラー指数である。また、<11−20>方向は[11−20]、[1−210]、[−2110]、[−1−120]、[−12−10]、[2−1−10]方向を含む方向群の全体を集合的に表現するミラー指数である。そして、[1−100]方向は、これに回転対称となる[10−10]方向とは区別される固有の方向であり、[11−20]は、これに回転対称となる[−12−10]方向や、[2−1−10]方向とは区別される固有の方向を意味するミラー指数である。なお、面方位や方向において、記号−(バー)はその直後の数字に付随して用いられる。
また、本実施形態では、基板としてGaNを用いたが、その代わりにサファイアやSiC、ZnOを用いることも可能である。
(第2実施形態)
次に、本発明の第2実施形態による窒化物系半導体発光ダイオード(LED)を図3に示す。
本実施形態のLEDは、第1実施形態と同様の凸部11aおよび凹部11bを有するn型GaNからなる基板11上に、n型GaNからなるコンタクト層12、n型GaNからなるガイド層13、多重量子井戸構造のInGaNからなる発光層14、p型AlGaNからなるオーバーフロー防止層15、p型GaNからなるガイド層16、およびp型GaNからなるコンタクト層17が、順次積層された積層構造を有している。なお、第1実施形態と同様に凸部11aの表面が<11−20>方向(紙面の右から左の方向)へ傾斜した傾斜面11a1となっている。また、凸部11aおよび凹部11bの幅は第1実施形態で説明した範囲の値となっている。本実施形態においては、凸部幅は400μm、凹部幅は30μmである。
また、上記積層構造の一部分がp型GaNからなるコンタクト層17からn型GaNからなるコンタクト層12に達するまで除去され、露出したコンタクト層12上にTi/Pt/Auからなるn側電極18が形成されている。また、p型GaNからなるコンタクト層17の表面にはAgからなるp側反射電極19が形成されている。p側反射電極19は、発光層14からの光を反射し、光の取り出し効率を上げる効果がある。
次に、本実施形態のLEDの製造方法について説明する。本実施形態のLEDは周知の有機金属気相成長(MOCVD)法により作成した。トリメチルガリウム(TMG)、トリメチルアルミニウム(TMA)、トリメチルインジウム(TMI)、ビスシクロペンタジエニルマグネシウム(CpMg)を用い、ガス原料として、アンモニア(NH)、シラン(SiH)を用いた。さらに、キャリアガスとして水素及び窒素を用いた。なお、本実施形態のLEDの製造方法において、製造装置やそれら原料に限定されるものではない。
まず、表面に凸部11aおよび凹部11bが形成されたn型GaNからなる基板11を有機洗浄、酸洗浄によって処理し、その後MOCVD装置の反応室内に導入し、高周波によって加熱されるサセプタ上に設置した。次いで常圧で窒素を41L(リットル)/min、アンモニアを4L/minの流量で流しながら、温度1100℃まで約12分間かけて昇温する過程において気相エッチングを施し、基板11の表面にできた自然酸化膜を除去した。
次いで、キャリアガスとして水素を6L/min、窒素を18L/minの流量で流し、アンモニアを6L/min、TMGを50cc/minおよびSiHを10cc/minの流量で60分間供給することでn型GaNからなるコンタクト層12を形成した。
続いて、そのまま温度を1060℃まで降温し、SiHを3cc/minの流量まで下げて約3分間でn型GaNからなるガイド層13を成長した。
次いで、TMG及びSiHの供給を停止して基板11の温度を800℃まで降温した。キャリアガスを流量が27L/minの窒素のみに切り替え、アンモニアを12L/min、TMGを3cc/minの流量で流し、この中にTMIの流量を、5cc/minと120cc/minとの組み合わせで前者が約16分、後者が約0.5分ずつ5回繰り返すように切り替えて供給し、最後にTMIを5cc/minの流量で約110分供給することにより、多重量子井戸構造のInGaNからなる発光層14を形成した。
次いで、TMG、TMIの供給を停止して、窒素とアンモニアはそのままで1030℃まで昇温した。
次いで、温度を1030℃で保持し、水素を21L/min、窒素を20L/min、アンモニアを4L/minの流量にそれぞれ切り替え、その中にTMGを25cc/分、TMAを約30cc/min、CpMgを6cc/minの流量で約1分供給することによりp型AlGaNからなるオーバーフロー防止層15を形成した。
次いで、このままの状態からTMAのみ供給を停止し、CpMgの流量を8cc/minに切り替えて約6分供給することによりp型GaNからなるガイド層16を形成した。
次いで、このままの状態からCpMgを50cc/minの流量で約3分供給してp型GaNからなるコンタクト層17を形成した。そして、有機金属原料の供給を停止し、キャリアガスのみ引き続き供給して基板11の温度を自然降温した。但し、アンモニアの供給は基板11の温度が500℃に達した際に停止した。
次いで、上記積層構造の一部をn型GaNからなるコンタクト層12に達するまでドライエッチング法を用いて除去し、露出したコンタクト層12上にTi/Pt/Auからなるn側電極18を形成した。また、p型GaNからなるコンタクト層17上には、Agからなるp側電極19を形成した。その後、上記積層構造を反転させ実装することでフリップチップ構造とした。
次に、このようにして形成された本実施形態のLEDのI−V特性を測定したところ、良好なオーミック接触が得られた。このLEDの動作電圧は20mA時で3.5V〜4V、光出力は30mWとなった。また、波長測定を行なったところ波長中心が460nmで±30nmのブロードな波長領域でピークを得た。これは領域の違いによって複数の波長ピークが存在し、それらが合わさることで得られたものと思われる。
以上説明したように本実施形態によれば、高度に制御された製造技術を必要とせず、中心波長に対し波長領域幅が60nm〜80nmのブロードな発光素子を得ることが可能となり、同じ面内に単一波長ではなく複数の波長領域が存在する演色性の高いLEDを得ることができる。
なお、本実施形態では、基板としてGaNを用いたが、その代わりにサファイアやSiC、ZnOを用いることも可能である。また、本実施形態では、同一面側に正負の電極を有していたが、上下に電極を有する構造であってもよい。
(第3実施形態)
次に、本発明の第3実施形態による発光装置を図4に示す。本実施形態の発光装置は、より演色性の高い白色光を得るために第2実施形態の発光素子10をセラミック・パッケージ(外囲器)23内に配置されたサブマウント26上にフリップチップ実装し、赤色蛍光体材料を分散させた樹脂22で封止した構成となっている。本実施形態の発光装置においては、凹部を有するセラミック・パッケージ23の上記凹部の底部を貫通するように設けられたリード電極27上にサブマウント26が形成されている。このサブマウント26上に一対のバンプ25が設けられ、この一対のバンプ25に、第2実施形態の発光素子10の一対の電極18、19が接続されるように、発光素子10がフリップチップ実装されている。バンプ25の材料としては、金属バンプやはんだを使用するが、金バンプを用いると好ましい。バンプ25とリード電極27は金線等の導電性ワイヤなどでサブマウント26内部を貫通して接合し電気的導通を取る。リード電極27は電気伝導性が良いことが求められる。リード電極27の材料としては、鉄、銅、銅の合金等や、これらに銀、アルミニウム、金等の金属メッキが施されたものが使用できる。
また、セラミック・パッケージ23と発光素子10を気密封止するためシリコーン樹脂などの封止樹脂22などで接着されている。封止樹脂はシリコーン樹脂に限定されるものではない。例えば、透明タイプのビスフェノールAグリシジルエーテルやビスフェノールFグリシジルエーテルなどのエポキシ樹脂などでもよい。シリコーン樹脂22中には、上記発光素子10が発光する光の少なくとも一部を吸収し波長変換して発光する赤色の蛍光体(例えばユーロピウム(Eu)を導入したCaAlSiN)が分散されている。なお、蛍光体は赤色に限定されるものではない。セリウムで付活されたイットリウム・アルミニウム・ガーネット系蛍光体や、ユーロピウムを導入した珪酸ストロンチウム・バリウム系蛍光体、α―サイアロン蛍光体Ca(Si,Al)12(O,N)16などを使用することができる。なお、記号(Si,Al)は、SiおよびAlの少なくとも一方を意味し、記号(O,N)はOおよびNの少なくとも一方を意味する。また、赤色の蛍光体としてはLaS:Eu,Sm(:の後の元素は付活元素を示す。以下同じ。)等が用いられる。緑色の蛍光体としてはInGaNやBaMgAl2717:Eu,Mn等が用いられる。なお、赤色の蛍光体と緑色の蛍光体とを樹脂中に分散させても良い。なお、緑色の蛍光体の代わりに或いはこれと併せて黄色の蛍光体を用いることも可能であり、例えば(Sr,Ca,Ba)SiO:Eu等が用いられる。黄色の蛍光体を用いる場合は、必要に応じて赤色の蛍光体を省略することもできる。
この構成により、半導体発光素子10から放出された光の一部は、蛍光体が分散された封止樹脂22を通過する際に蛍光体により波長変換される。この波長変換された光と、波長変換されずに封止樹脂22を通過した光との混色によりより演色性の高い白色光が得られる。
以上説明したように、本実施形態によれば、高度に制御された製造技術を必要とせず、演色性の高い発光装置を得ることができる。
なお、本実施形態の発光装置においては、発光素子の一対の電極18、19は同じ側に形成されていたが、例えば図16に示すように、反対側に形成された電極18A、19Aを備えた発光素子10Aを用いてもよい。この場合、電極18Aはワイヤ28を介してパッド25に電気的に接続される。なお、n側電極18Aは、n型GaNからなる基板にコンタクトされる。また、n側電極18Aとp側電極19Aとを上下逆の配置としてもよい。
(第4実施形態)
次に、本発明の第4実施形態による半導体発光素子を図5に示す。本実施形態の半導体発光素子30は、窒化物系半導体レーザ素子であって、第1実施形態と同様の凸部31aおよび凹部31bを有するn型GaNからなる基板31上に、n型GaN層32、n型AlGaNからなるクラッド層33、n型GaNからなる光ガイド層34、多重量子井戸構造のInGaNからなる活性層35、p型AlGaNからなるオーバーフロー防止層36、p型GaNからなる光ガイド層37、p型AlGaNからなるクラッド層38、p型GaN層39、およびp型GaNからなるコンタクト層40が、順次積層された積層構造を有している。なお、第1実施形態と同様に凸部31aの表面が<11−20>方向(紙面の右から左の方向)へ傾斜した傾斜面31a1となっている。また、凸部31aおよび凹部31bの幅は第1実施形態で説明した範囲に範囲の値となっている。本実施形態においては、凸部幅は400μm、凹部幅は30μmである。
上記積層構造において、基板31の下部にはn型電極41が設けられている。また、基板31の凸部31a上の傾斜面31a1の高い右側すなわちIn組成の高い領域に対して、<1−100>方向へ幅2μmのリッジ形状のp側電極42が紙面に垂直方向に延在するように設けられている。なお、リッジ形状は、p型AlGaNからなるクラッド層38、p型GaN層39、p型GaNからなるコンタクト層40、およびp側電極42によって構成され、このリッジ形状により電流狭窄を行なっている。
次に、本実施形態の半導体レーザ素子30の製造方法について説明する。この半導体レーザ素子30は周知の有機金属気相成長(MOCVD)法により作成した。トリメチルガリウム(TMG)、トリメチルアルミニウム(TMA)、トリメチルインジウム(TMI)、ビスシクロペンタジエニルマグネシウム(CpMg)を用い、ガス原料として、アンモニア(NH)、シラン(SiH)を用いた。さらに、キャリアガスとして水素及び窒素を用いた。なお、本実施形態の半導体レーザ素子の製造方法において、製造装置やそれら原料に限定されるものではない。
まず、表面に凸部31aおよび凹部31bが形成されたn型GaNからなる基板31を有機洗浄、酸洗浄によって処理し、その後MOCVD装置の反応室内に導入し、高周波によって加熱されるサセプタ上に設置した。次いで常圧で窒素を41L/min、アンモニアを4L/minの流速で流しながら、温度1100℃まで約12分間かけて昇温する過程において気相エッチングを施し、表面にできた自然酸化膜を除去した。
次いで、キャリアガスとして水素を6L/min、窒素を18L/minの流量で供給し、アンモニアを6L/min、TMGを50cc/minおよびSiHを5cc/minの流量で60分間供給することでn型GaN層32を形成した。
続いて、そのまま温度を1060℃まで降温し、キャリアガスの水素を21L/min、窒素を20L/min、アンモニアを4L/minの流量に切り替え、TMGを25cc/min、TMAを5cc/min、SiHを5cc/minの流量で120分間供給することでn型AlGaNからなるクラッド層33を形成した。このままの条件でTMAの供給を停止し、SiHのみ3cc/minの流量まで下げて約10分間でn型GaNからなる光ガイド層34を形成した。
次いで、TMG及びSiHの供給を停止して基板温度を800℃まで降温した。キャリアガスを窒素が27L/minの流量に切り替え、アンモニアを12L/min、TMGを3cc/minの流量で流し、この中にTMIの流量を5cc/minと195cc/minとの組み合わせで前者が約16分、後者は約2分ずつ3回繰り返すように切り替えて供給し、最後にTMIを5cc/minの流量で約120分供給することにより、多重量子井戸構造のInGaNからなる活性層35を形成した。
次いで、TMG、TMIの供給を停止して、窒素とアンモニアはそのままで供給し1030℃まで昇温した。
次いで、温度を1030℃で保持し、水素を21L/min、窒素を20L/min、アンモニアを4L/minの流量に切り替え、その中にTMGを25cc/min、TMAを約30cc/min、CpMgを6cc/minの流量で約1分供給することにより、p型AlGaNからなるオーバーフロー防止層36を形成した。
次いで、このままの状態からTMAのみ供給を停止し、他の物(水素、窒素、アンモニア、TMG、CpMg)を、流量を変えずに約2分供給することにより、p型GaNからなる光ガイド層37を形成した。
次いで、このままの状態からTMAを15cc/minの流量で再度供給し、CpMgを8cc/minの流量に切り替えて約40分供給することによりp型AlGaNからなるクラッド層38を形成した。
次いで、このままの状態からTMAのみ供給を停止し、他の物(水素、窒素、アンモニア、TMG、CpMg)を、流量を変えずに約2分供給することにより、p型GaN層39を形成、さらに、CpMgのみ50cc/minの流量に切り替えて約1分供給することによりp型GaNからなるコンタクト層40を形成した。
そして、有機金属原料の供給を停止し、キャリアガスのみ引き続き供給して基板温度を自然降温した。但し、アンモニアの供給は基板温度が500℃に達した際に停止した。
このようにして作製した半導体レーザ構造を、MOCVD装置から取出し、基板31の凸部31a上の傾斜の高い右側すなわちIn組成の高い領域に対して、周知のドライエッチング法にて[1−100]方向へ幅2μmとなるようストライプ状にp型AlGaNからなるクラッド層38まで除去することでリッジを形成、露出したリッジ上のp型GaNからなるコンタクト層40上にNi/Auからなるp側電極42を形成した。
また、n型GaNからなる基板31の裏面には周知の真空蒸着法やスパッタ法などを用いてTi/Pt/Auからなるn側電極41を形成した。なお、これら電極に用いた材料は上記材料に限定されるものではない。
次に、このレーザ構造を基板側からスクライバなどを用いて[11−20]方向と平行な方向に沿って劈開することで、共振器ミラーを形成した。この共振器ミラーに、SiOおよびTiOからなる誘導体膜を電子ビーム蒸着法など用いて蒸着し、誘導体多層反射膜を形成する。なお、この誘導体多層反射膜を形成する誘電体材料はSiOやTiOに限定されるものではない。
このようにして作製した半導体レーザ素子は波長440nmで連続発振した。また、この半導体レーザ素子のしきい値電流が290mA、動作電圧が7V、光出力が30mWであった。
以上説明したように本実施形態によれば、基板に形成した凹凸部により不均一なIn組成に伴う点欠陥の形成や、発光に寄与しない不純物の増加などを抑制しつつ、高いIn組成の領域を同一面内に形成することができるため、良質な結晶品質である活性層を装備した長波長の窒化物系半導体レーザ素子の作製が可能となった。
(第5実施形態)
次に、本発明の第5実施形態による半導体発光素子を説明する。
本実施形態の半導体発光素子は、発光効率を上げるために発光層内の吸収を低減し、発光素子内部での反射光が発光層を通過することによって生じる発光効率の低下を防ぐことにより発光効率を上げる構成となっている。具体的には半導体発光素子は素子の内部と外部との屈折率差によってある割合で内部反射を生じ、発光層に戻ってきた光が発光層で吸収される。通常の直方体形状の発光素子ではこの現象により発光層で発光した光の50%以上が素子外部に取り出せない状況となっている。解決策として吸収を減らすために内部反射を低減し、外部への取り出しを増加させる方法が取られている。しかし、十分ではなく更なる効率向上には発光層の吸収を抑えることが必要である。本実施形態においては、発光層で発光した光が再び発光層に吸収されることを防ぐ構成にして発光効率を向上させている。
本実施形態による半導体発光素子を図6に示す。本実施形態の半導体発光素子50は、n型GaNからなる基板51上に、n型Al0.02Ga0.98Nからなるホール閉じこめ層(クラッド層)52、多重量子井戸構造のIn0.2Ga0.8N/In0.03Ga0.87Al0.1Nからなる活性層53、p型Al0.02Ga0.98Nからなる電子閉じこめ層(クラッド層)54、p型GaNからなるコンタクト層55を順次積層した積層構造を有している。また、コンタクト層55上にはp側透明電極56が設けられ、基板51の裏面(クラッド層52が設けられた側と反対側の面)にn側電極57が設けられている。なお、活性層53はIn0.03Ga0.87Al0.1Nからなる膜厚2nmの障壁層、In0.2Ga0.8Nからなる膜厚1.5nmの井戸層(ウェル)、In0.03Ga0.87Al0.1Nからなる膜厚2nmの障壁層(バリア)の順で交互に積層し、井戸層(ウェル)が合計20層積層された構成となっている。
なお、本実施形態においては、基板51上に、クラッド層52、活性層53、クラッド層54、コンタクト層55を順次積層した積層構造を、MOCVD法を用いた結晶積層装置において形成した。
上記積層構造を結晶積層装置より取り出し、250μm×250μmの開口を有するメタルマスクを用いて、p側電極材料となるPtを蒸着し、p側透明電極56のPt層を形成した。続いて、このPt層上にSiO膜を製膜し、このSiO膜上に、Pt層の膜面より小さい200μm×200μmのサイズの矩形開口を有するフォトレジストからなるレジストパターンを形成した。そして、このレジストパターンをマスクとしてフッ化アンモニウムにより上記開口部に対応するSiO膜の部分を除去し、上記開口部の底部にPt層を露出させた。さらに上記レジストパターンを用いて上記開口部にリフトオフ法によりTi/Pt/Auの積層膜を形成することによりp側電極56を形成した。続いて、基板51の裏面側を研磨した後、この裏面に蒸着によりTi/Pt/Auの積層膜を形成し、n側電極57を形成した。
次にn型GaNからなる基板51の表面に素子に沿って第1スクライブラインを形成した。第1スクライブラインの形成は、p側電極56を避けてスクライブができるようにp型GaNからなるコンタクト層55の表面を観察しながら行った。さらに形成された第1スクライブラインに垂直となる第2スクライブラインを形成した。この第2スクライブラインの形成の際にも、p側電極56を避けて素子分離ができるようにp型GaNからなるコンタクト層55の表面を観察しながら行った。上記第1および第2スクライブラインに沿って切断することによりチップに分離した。
次に、上述の製造方法によって、更に井戸層(ウェル)の総数が10の発光素子と5の発光素子をそれぞれ製造し、本実施形態の発光素子(ウェルの総数20)と、ウェルの総数が10、5の発光素子の発光効率をそれぞれ測定した。なお、井戸層の総数が10、5の発光素子は、井戸層の総数が異なる以外は、本実施形態の発光素子と同じ構成となっている。この測定結果を図7に示す。図7からわかるように、井戸層の総数が5または10の発光素子では注入電流を増やすと発光効率が低下している。したがって、井戸層の総数は20以上であることが好ましいことになる。
次に、井戸層の総数を変えずに井戸層の膜厚(ウェル厚)を2nm、3nmにそれぞれ変化させた発光素子を制作し、それぞれの発光素子の発光効率を測定した。なお、これらの発光素子は、井戸層の膜厚が異なる以外は、本実施形態の発光素子と同じ構成となっている。上記測定結果を図8に示す。図8からわかるように、井戸層の膜厚を本実施形態よりも厚くすると、発光効率が低下する。したがって、井戸層の膜厚は1.5nm以下であることが好ましい。
また、井戸層の総数を変えずに障壁層の膜厚(バリア厚)を3nmの発光素子を制作し、発光効率を測定した。なお、この発光素子は、障壁層の膜厚が異なる以外は、本実施形態の発光素子と同じ構成となっている。上記測定結果を図9に示す。図9からわかるように、障壁層の膜厚を本実施形態よりも厚くすると、発光効率が低下する。したがって、障壁層の膜厚は2nm以下であることが好ましい。
本実施形態の発光素子においては、障壁層のAlの組成比は0.1であったが、障壁層のバンドギャップを変化させるために障壁層のAlの組成が0.03の発光素子と、Alの組成比が0の発光素子を作成し、それぞれの発光素子の電流に対する発光効率を測定した結果を図10に示す。図10からわかるように、障壁層のAlの組成比を低下させると発光強度が弱くなった。これは、障壁層のAlの組成比を低下させると、井戸層と障壁層とのバンドギャップ差がなくなって多重量子井戸層でミニバンドが形成されることと、Alの組成比の低下により屈折率の値が高くなり、活性層から外に出る光の割合が減ってしまうことが原因と考えられる。したがって、光を活性層外に取り出しやすくするためには素子を構成するいずれの層よりも障壁層の屈折率が低いことが重要である。
以上のことから窒化物半導体の多重量子井戸の障壁層は素子を構成するいずれの層よりもバンドギャップが大きいことで上に述べたいずれの効果ともに効果的に光を取り出すことが可能となる。
なお、今回対象にしている窒化物半導体はバンドギャップの大小と屈折率の大小が逆の傾向を示すために屈折率とバンドギャップ双方について規定しなくてもバンドギャップについて規定することで同じ効果が得られる。
従来のLEDにおいては効率の低下が、温度上昇によるもの、電流パスが変化して電極の下に集中することにより取り出し効率が低下するものが知られていたが、GaN系の素子においては放熱を良好にして温度が上昇しないようにしたり、電流のパスが電極の直下に位置しないようにした場合でも低下した。この効率の低下を防止するために多重量子井戸の数を増やし、かつ井戸層および障壁層の膜厚を狭くして多重量子井戸全体の厚さが増えることによる電圧上昇を防止している。また、多重量子井戸の平均屈折率が周りの層よりも低いので外に向かう光が活性層とその外の層との間で反射することを防止することができる。平均の屈折率を小さくする場合に井戸層の屈折率を小さくすることは波長が変化することとなり好ましくはない。しかし、本実施形態のように障壁層のAl組成を大きくすることが重要である。
以上説明したように、本実施形態によれば、発光素子の動作時には発光層の吸収が少なくい状態で動作させることができ、高効率の発光素子を得ることができる。
なお、本実施形態の発光素子の基板51に第1実施形態および第2実施形態のように凹凸を設けることにより、第1および第2実施形態と同様に、高度に制御された製造技術を必要とせず、演色性の高い半導体発光素子を得ることができる。
(第6実施形態)
次に、本発明の第6実施形態による発光装置を図11乃至図15を参照して説明する。
図11に本実施形態の発光装置の平面図を示す。本実施形態の発光装置60は、マトリクス状に配置された複数(図11では25個)の発光ダイオード70を備えている。各発光ダイオード70は、図12に示すように、n型GaNからなる基板71上に、n型GaNからなるコンタクト層72、InGaNからなる下地層73、多重量子井戸構造の発光層74、p型AlGaNからなるキャップ層75、およびp型GaNからなるコンタクト層76が積層された構造を有している。コンタクト層76には隣接する発光ダイオード70のコンタクト層72と接続するための配線80が接続されている。したがって、図11に示すマトリクス状に配置された複数の発光ダイオード70は、配線80によって直列に接続された構成となっている。なお、図12に示すように、配線80と、キャップ層75、発光層74、下地層73、およびコンタクト層72との間には電気的絶縁をするための例えばSiOからなる絶縁層77が設けられている。また、図11に示すマトリクス状に配置された発光ダイオード70のうち、左上の発光ダイオード70のn型GaNからなるコンタクト層72に電気的に接続するボンディングパッド90が設けられ、このボンディングパッド90は、図12に示すように、ZnO膜91と、Ti/Pt/Auの積層膜92とからなっている。また、図11に示すマトリクス状に配置された発光ダイオード70のうち、右下の発光ダイオード70のp型GaNからなるコンタクト層76に電気的に接続するボンディングパッド95が設けられ、このボンディングパッド95は、ボンディングパッド90と同様に、ZnO膜と、Ti/Pt/Auの積層膜とからなっている。なお、本実施形態においては、配線80はZnOにGaが添加された材料からなっている。また、ボンディングパッド90、95は、ZnO膜にGaが含まれていてもよい。
次に、本実施形態の発光装置の製造方法を説明する。
まず、結晶成長炉内で、n型GaNからなる基板71上に、n型GaNからなるコンタクト層72、InGaNからなる下地層73、多重量子井戸構造の発光層74、p型AlGaNからなるキャップ層75、およびp型GaNからなるコンタクト層76を順次積層する。この積層構造を結晶成長炉から取り出し、コンタクト層76上に、フォトレジストからなる第1レジストパターンを形成し、この第1レジストパターンをマスクとして、上記積層構造の一部分をn型GaNが露出するまでエッチングを行なう。その後、第1レジストパターンを剥離する。
続いて、表面をクリーニングし、全面にSiO膜77をCVDにより形成する。そして、このSiO膜77上に、n側電極、p側電極を形成する部分に開口を有する第2レジストパターンを形成する。この第2レジストパターンをマスクとして、フッ化アンモニウムを用いてSiO膜77をエッチングする。その後、第2レジストパターンを剥離する。
次に、再びレジストを塗布し、このレジストをパターニングしてZnOが蒸着される部分以外の領域にレジストを残置する。その後、レーザMBE装置に導入し、ZnOを蒸着する。この際、不純物となるGaも同時に蒸着し、Gaの量が始めに多く徐々に少なくなるようにスパッタ量を調節する。
蒸着が終わったらレーザMBE装置から取り出し、レジストを除去し、リフトオフすることによりGaが添加されたZnOからなる配線が形成される。更に第3のレジストパターンを形成し、この第3のレジストパターンを覆うように金属を堆積し、第3のレジストパターンを除去することにより、両端のボンディングパッド90、95を形成する。ボンディングパッド90、95にはTi/Pt/Auが適しており、Auは厚い方がよい。
このように形成された本実施形態の発光装置を、図11に示す切断線A−Aで切断したときの断面図を図13に示す。本実施形態の発光装置は図13に示す矢印に示すように電流が流れる。なお、本実施形態の発光装置を構成する発光ダイオードは、直流100V、100mAで動作した。また、本実施形態の発光装置を構成する発光ダイオードを2個用いてそれぞれ極性が反対になるように並列に配線し、交流100Vに接続したところ100mAで動作した。なお、コンデンサーやコイルを用いて平滑化を行なうことで発光をさらに均一化できる。
なお、本実施形態において、配線80のZnO膜の厚さは500nmであって、p型GaNからなるコンタクト層76、n型GaNからなるコンタクト層72にそれぞれに接している界面からZnOに向かって不純物であるGaは濃度が低くなるようなプロファイルを有している。これをSIMS(Secondary Ion Mass Spectroscopy)法により確認した結果を図14に示す。SIMS法は、表面側よりスパッタしながら測定を行なった。この図14から、表面側より徐々にGaの濃度が上昇し、GaNからなるコンタクト層との界面に到達するとGaの濃度は大きく上昇していることがわかる。Ga濃度は界面付近においては1×1021cm−3を超えており、上記界面付近は半導体ではなく、いわゆるモット転移を起こし、金属的な電気特性を示す。また、高濃度なGaを含むZnOに接したp型GaNからなるコンタクト層76も2×1021cm−3程度の高濃度のMgを界面のみにドーピングすれば、この界面は電流の流れに対してpn接合が逆になるが高濃度であるためにトンネリングが起こりやすく低抵抗で接合させることができる。このために、発光装置内にLEDの個数が増えたとしても発光ダイオードと発光ダイオードとを接続することによる接触抵抗は上昇しない。なお、コンタクト層76内における、2×1021cm−3程度の高濃度のMgを含む領域の厚さは、10nm以下であることが好ましい。10nmよりも厚い場合は、結晶に欠陥が入り抵抗が高くなる。
本実施形態では基板をGaNとしたがサファイア基板やSi基板であってもよい。サファイア基板、Si基板の場合には基板から素子を剥離し、光取り出し効率を向上することができる。サファイア上の場合にはレーザを照射し、剥離することができ、Si上では素子の表面を樹脂で保護した後、フッ硝酸でSi基板を除去する。いずれの場合も剥離後は支持基板に貼り付けて保持する必要がある。最終的な支持基板への接着ではその界面を発光波長に対して高反射率のもので形成しておくことにより光取り出しの効率を向上することができる。
また、本実施形態ではZnO膜の形成にレーザMBEを用いたが、水溶液成長でも可能である。この場合は、レジストでのパターニングは同様に行ない、硝酸亜鉛水溶液に硝酸ガリウムを溶解させ、水温100℃にて堆積を行なう。濃度を最適化することにより緻密で均一なZnO膜が作成できる。なお、この場合にはZnO膜中のGa濃度を厚さ方向にコントロールできないので界面付近に向かって濃度勾配をつけることができないがGa濃度を全体に高濃度にすることにより低抵抗とすることができる。
この他、ZnO膜の形成はメタルマスクをレジストの代わりに用いてMBE法やスパッタ法により形成することも可能である。MBE法を用いて作成した場合にはもっともコントロール性がよく低抵抗なものが形成できる。
本実施形態において、電流の流れに沿った層構造は、p型GaNなるコンタクト層/n型ZnO膜/n型GaNからなるコンタクト層という構造となっている。この層構造のバンドラインナップの模式図を図15に示す。この図15からわかるように、p型GaNからなるコンタクト層と、n型ZnO膜との接合はトンネル接合となっており、この部分での抵抗はほとんど生じない。このように、本実施形態の利点を生かすには酸化物のドーピング濃度はモット転移が生じる以上であることが望ましい。具体的にはZnOの内部においては、ドーピング濃度は1×1020cm−3である。モット転移が生じる濃度nはボーア半径をaとすると、n1/3×a=0.26という関係があることが知られているが、実際にはこれより1桁程度高い濃度で金属的な振る舞いが見られるようになる。
本実施形態においては、配線となる酸化物と接する部分はGaNとなっているが、これに限らずIII族元素(Ga、In、Al、B)の少なくとも1つを含む窒化物半導体でもかまわない。また本実施形態では、酸化物のドーピング材料はGaを用いたがIn、Al、Bでもかまわない。また、配線となる酸化物としてZnOを用いたがMgの酸化物(MgO)であってもよい。これは、ZnOおよびMgOは高濃度にGaをドーピング可能であり、GaはGaNの構成元素であるため、GaNとの界面においては、Gaが拡散し、高濃度となることも期待できるからである。
また、本実施形態の発光ダイオード70の基板71の表面に第1乃至第2実施形態で説明した凹凸を設けてもよい。この場合は、第1乃至第2実施形態と同様に、演色性の高い半導体発光装置を得ることができる。また、本実施形態の発光ダイオードを第3実施形態の発光素子として用いることができる。
(第7実施形態)
次に、本発明の第7実施形態による半導体発光素子を説明する。
一般に、半導体発光素子の構造ではキャリヤを閉じこめるために発光層はその周りの層であるコンタクト層やクラッド層よりもエネルギーバンドギャップが小さい材料を用いていた。通常の材料では屈折率の大きさとエネルギーバンドギャップの大きさは逆の傾向を示すので、屈折率分布は発光層の付近が高屈折率でその周りが低屈折率な構造となっていた。このような構造では発光層で発生した光のうち、水平方向に近い光は、発光層とクラッド層との界面で全反射し発光層内を導光されていく。
これに対して、本実施形態の半導体発光素子においては、発光層の屈折率が発光層の周りの層の屈折率よりも小さく、屈折率の高低関係が、今までの構造とは逆になっており、発光層内を導光される光は極端に少ない。本実施形態の半導体発光素子は発光ダイオードであって、その断面を図17に示す。本実施形態の発光ダイオードは、膜厚が150μmのn型GaN基板200と、このGaN基板200上に形成された膜厚が300nmのn型GaN層202と、GaN層202の第1の領域上に形成され、正孔のオーバーフローを防止する膜厚が10nmのn型Al0.1Ga0.9Nからなるオーバーフロー防止層204と、オーバーフロー防止層204上に形成され、障壁層と井戸層とが交互に積層された多重量子井戸構造の発光層206と、発光層206上に形成されたp型GaNからなる膜厚が80nmのコンタクト層208と、このコンタクト層208上に設けられたp側電極210と、GaN層202の第1の領域と異なる領域上に形成されたn側電極212と、を備えている。
発光層206を構成する障壁層は膜厚が10nmのIn0.005Al0.05Ga0.945Nからなっており、井戸層は膜厚が2.5nmのIn0.15Al0.005Ga0.845Nからなっている。本実施形態の半導体発光素子のエネルギーバンドを図18(a)に示し、屈折率を図18(b)に示す。図18(a)、18(b)からわかるように、本実施形態においては、障壁層と井戸層の平均屈折率がその上下にある層(例えば、オーバーフロー防止層204、n型GaN層202、p型GaNからなるコンタクト層208)の平均屈折率よりも低くなっている。さらにこの場合、n型GaN基板200の平均屈折率よりも低くなっている。本明細書では、m(≧1)個の層からなる構造の平均屈折率Naveとは、
層厚で重み付けした平均屈折率を意味し、すなわち、i(1≦i≦m)番目の層の屈折率をn、その層厚をdとすると、
Nave=(n・d+・・・+n・d)/(d+・・・+d
で表される値である。
従来の構造では、正孔の有効質量が電子の有効質量に比べて重いため、発光層を乗り越えて無効電流となる原因は電子のオーバーフローにあった。しかし、本実施形態のように、膜厚が10nmのIn0.005Al0.05Ga0.945Nからなる障壁層と、膜厚が2.5nmのIn0.15Al0.005Ga0.845Nからなる井戸層とによって発光層を形成すると、量子井戸構造の障壁層のバンドギャップが大きいため、図19の矢印で示した電子および正孔の流れのうち発光層を乗り越え、無効電流を生じさせる原因は正孔であることが本発明者達によって知見された。そこで、本実施形態では、従来の場合と逆にn側に正孔のオーバーフローを防止するオーバーフロー防止層204を設けることにより、発光効率を向上させる構造としている。なお、図19は、本実施形態の半導体発光素子のエネルギーバンド図であり、破線は量子井戸中の量子準位を示し、電子と正孔が再結合することにより発光していることを示す。また、本実施形態においては、オーバーフロー防止層は、バンドギャップが障壁層よりも大きくなるように構成されている。
本実施形態においては、図20(a)に示すように、発光層の屈折率が発光層の周りの層の屈折率よりも小さく、屈折率の高低関係が、今までの構造とは逆になっている。このため、図20(b)に示すように、発光層内を導光される光は極端に少なく、さらに半導体発光素子の最外周で反射してきた光は、ある角度より浅い光の場合に発光層に戻ることなく、発光層とその外側の層との間で反射し、外に取り出される。すなわち、本実施形態においては、発光層に戻る光の割合が極端に少なくなり、半導体発光素子の外部に取り出される光が飛躍的に向上する。これに対して、従来は、発光層で発光した光が全方位に放射され、膜面方向に近い方位に放射される光は発光層に戻り、発光層で吸収されることとなる。このため、注入した電流に対して発光し、素子外部に取り出される光が減少する。
なお、本実施形態において、電子のオーバーフローを防止する、エネルギーバンドギャップの大きい層がp側にあってもよい。
また、本実施形態の発光ダイオードの基板200の表面に第1乃至第2実施形態で説明した凹凸を設けてもよい。この場合は、第1乃至第2実施形態と同様に、演色性の高い半導体発光装置を得ることができる。
また、本実施形態の半導体発光素子を第3実施形態の発光素子として用いてもよい。
また、本実施形態の半導体発光素子を第6実施形態の発光ダイオードの代わりに用いてもよい。
第1実施形態による半導体発光素子の概略の構成を示す断面図。 比較例による半導体発光素子を示す断面図。 第2実施形態による半導体発光ダイオードを示す断面図。 第3実施形態による発光装置の断面図。 第4実施形態による半導体レーザ素子を示す断面図。 第5実施形態による半導体発光素子を示す断面図。 井戸層の数を変えた場合の発光効率−注入電流特性を示す図。 井戸層の膜厚を変えた場合の発光効率−注入電流特性を示す図。 障壁層の膜厚を変えた場合の発光効率−注入電流特性を示す図。 障壁層のAlの組成比を変えた場合の発光効率−注入電流特性を示す図。 第6実施形態の発光装置の平面図。 第6実施形態の発光装置の発光ダイオードの断面図。 図11に示す切断線A−Aで切断した断面図。 配線となるZnO膜の膜厚方向のGa濃度を示す図。 第6実施形態の電流の流れに沿った層構造のバンドラインナップを示す模式図。 第3実施形態の一変形例による発光装置の断面図。 第7実施形態の半導体発光素子の断面図。 第7実施形態の半導体発光素子のエネルギーバンドおよび屈折率を示す図。 オーバーフロー防止層をn側に設ける理由を説明する図。 第7実施形態の効果を説明する図。
符号の説明
2 基板
3 n型GaNからなるガイド層
4 多重量子井戸構造のInGaNからなる発光層
5 p型GaNからなるガイド層
10 発光ダイオード
11 基板
12 n型GaNからなるコンタクト層
13 n型GaNからなるガイド層
14 多重量子井戸構造のInGaNからなる発光層
15 p型AlGaNからなるオーバーフロー防止層
16 p型GaNからなる層
17 p型GaNからなるコンタクト層
18 n側電極
19 p側電極
22 蛍光体を分散した封止樹脂
23 セラミック・パッケージ
25 バンプ
26 サブマウント
27 リード電極
30 半導体レーザ素子
31 基板
32 n型GaNからなるコンタクト層
33 n型AlGaNからなるクラッド層
34 n型GaNからなる光ガイド層
35 多重量子井戸構造のInGaNからなる活性層
36 p型AlGaNからなるオーバーフロー防止層
37 p型GaNからなるガイド層
38 p型AlGaNからなるクラッド層
39 p型GaNからなる層
40 p型GaNからなるコンタクト層
41 n側電極
42 p側電極

Claims (14)

  1. 上面が傾斜面である凸部と、前記凸部の両側に形成され前記凸部よりも幅が狭く底面が前記凸部の前記上面よりも深い位置にある凹部とを表面に有する半導体基板と、
    前記半導体基板の上方に少なくとも前記凸部を覆うように形成された窒化物系半導体からなる発光層と、
    を備えたことを特徴とする半導体発光素子。
  2. 前記発光層は、InGaNからなる多重量子井戸構造を有していることを特徴とする請求項1記載の半導体発光素子。
  3. 前記発光層の、前記傾斜面の高い領域に形成された第1部分は、低い領域に形成された第2部分に比べてInの組成が多いことを特徴とする請求項2記載の半導体発光素子。
  4. 前記凹部は、幅が20μm以上100μm以下で、深さが5μm以上50μm以下であることを特徴とする請求項1乃至3のいずれかに記載の半導体発光素子。
  5. 前記凸部は、幅が200μm以上1mm以下であり、前記傾斜面の傾斜角度が0.1度以上45度以下であることを特徴とする請求項1乃至4のいずれかに記載の半導体発光素子。
  6. 前記傾斜角度は0.2度以上0.4度以下であることを特徴とする請求項5記載の半導体発光素子。
  7. 前記半導体基板はGaN基板であり、前記傾斜面は<11−20>方向に対して傾斜しており、前記発光層は前記半導体基板の<1−100>方向に形成されていることを特徴とする請求項1乃至6のいずれかに記載の半導体発光素子。
  8. 前記半導体基板と前記発光層との間に設けられたn型GaN層と、前記n型GaN層と前記発光層との間に設けられたn型GaNからなる第1のガイド層と、前記発光層上に設けられたp型AlGaNからなるオーバーフロー防止層と、前記オーバーフロー防止層上に設けられたp型GaNからなる第2のガイド層と、前記第2のガイド層上に設けられたp型GaNからなるコンタクト層と、を備えていることを特徴とする請求項1乃至7のいずれかに記載の半導体発光素子。
  9. 前記半導体基板と前記発光層との間に設けられたn型GaN層と、前記n型GaN層と前記発光層との間に設けられたn型AlGaNからなる第1のクラッド層と、前記第1のクラッド層と前記発光層との間に設けられたn型GaNからなる第1のガイド層と、前記発光層上に設けられたp型AlGaNからなるオーバーフロー防止層と、前記オーバーフロー防止層上に設けられた前記p型GaNからなる第2のガイド層と、前記第2のガイド層上に設けられたp型AlGaNからなる第2のクラッド層と、前記第2のクラッド層上に設けられたp型GaNからなるコンタクト層と、を備えていることを特徴とする請求項1乃至7のいずれかに記載の半導体発光素子。
  10. 半導体基板と、前記半導体基板上に設けられたn型GaN層と、前記n型GaN層上に設けられ、障壁層と井戸層とが交互に積層された多重量子井戸構造の発光層と、前記発光層上に設けられたp型GaNからなるコンタクト層と、を備え、前記障壁層および前記井戸層の平均屈折率が前記発光層の上下の層の平均屈折率よりも低いことを特徴とする半導体発光素子。
  11. バンドギャップが前記障壁層よりも大きい、正孔のオーバーフローを防止するオーバーフロー防止層が前記発光層と、前記n型GaN層との間に設けられていることを特徴とする請求項10記載の半導体発光素子。
  12. 支持体と、
    前記支持体に支持された請求項1乃至11のいずれかに記載の半導体発光素子と、
    前記半導体発光素子の少なくとも一部を覆うように形成された樹脂と、
    前記樹脂に分散され、前記半導体発光素子が発光する光の少なくとも一部を吸収し、波長変換して発光する蛍光体と、
    を備えたことを特徴とする発光装置。
  13. 上面が傾斜面である凸部と、前記凸部の両側に形成され前記凸部よりも幅が狭く底面が前記凸部の前記上面よりも深い位置にある凹部とを表面に有する半導体基板上に窒化物系半導体からなる発光層を形成する工程、
    を備えたことを特徴とする半導体発光素子の製造方法。
  14. 前記発光層は、InGaNからなる多重量子井戸構造を有することを特徴とする請求項13記載の半導体発光素子の製造方法。
JP2007078719A 2007-03-26 2007-03-26 半導体発光素子およびその製造方法ならびに発光装置 Expired - Fee Related JP5032171B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2007078719A JP5032171B2 (ja) 2007-03-26 2007-03-26 半導体発光素子およびその製造方法ならびに発光装置
US12/037,358 US7863637B2 (en) 2007-03-26 2008-02-26 Semiconductor light emitting element, method for manufacturing the same, and light emitting device
US12/955,620 US8004004B2 (en) 2007-03-26 2010-11-29 Semiconductor light emitting element, method for manufacturing the same, and light emitting device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2007078719A JP5032171B2 (ja) 2007-03-26 2007-03-26 半導体発光素子およびその製造方法ならびに発光装置

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2011185180A Division JP5543946B2 (ja) 2011-08-26 2011-08-26 半導体発光素子および発光装置

Publications (2)

Publication Number Publication Date
JP2008243904A true JP2008243904A (ja) 2008-10-09
JP5032171B2 JP5032171B2 (ja) 2012-09-26

Family

ID=39792643

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2007078719A Expired - Fee Related JP5032171B2 (ja) 2007-03-26 2007-03-26 半導体発光素子およびその製造方法ならびに発光装置

Country Status (2)

Country Link
US (2) US7863637B2 (ja)
JP (1) JP5032171B2 (ja)

Cited By (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2010047289A1 (en) * 2008-10-22 2010-04-29 Panasonic Electric Works Co., Ltd. Semi-conductor light emitting device
JP2010182832A (ja) * 2009-02-04 2010-08-19 Panasonic Corp 窒化物半導体発光素子およびその製造方法
JP2011243369A (ja) * 2010-05-17 2011-12-01 Sharp Corp 発光装置、照明装置および車両用前照灯
WO2012090400A1 (ja) * 2010-12-28 2012-07-05 信越半導体株式会社 発光素子
JP2013128104A (ja) * 2011-11-17 2013-06-27 Sanken Electric Co Ltd 半導体発光装置及び半導体発光装置の製造方法
JP2013229638A (ja) * 2013-08-12 2013-11-07 Toshiba Corp 半導体発光素子および発光装置
US8733996B2 (en) 2010-05-17 2014-05-27 Sharp Kabushiki Kaisha Light emitting device, illuminating device, and vehicle headlamp
US8833991B2 (en) 2010-02-10 2014-09-16 Sharp Kabushiki Kaisha Light emitting device, with light guide member having smaller exit section, and illuminating device, and vehicle headlight including the same
JP2014187325A (ja) * 2013-03-25 2014-10-02 Toshiba Corp 半導体発光装置及びその製造方法
US8876344B2 (en) 2009-12-17 2014-11-04 Sharp Kabushiki Kaisha Vehicle headlamp with excitation light source, light emitting part and light projection section
JP2015509669A (ja) * 2012-03-06 2015-03-30 ソラア インコーポレーテッドSoraa Inc. 導波光効果を低減させる低屈折率材料層を有する発光ダイオード
US9816677B2 (en) 2010-10-29 2017-11-14 Sharp Kabushiki Kaisha Light emitting device, vehicle headlamp, illumination device, and laser element
JP2018078232A (ja) * 2016-11-11 2018-05-17 日本碍子株式会社 広波長域発光素子および広波長域発光素子の作製方法
JP7448626B1 (ja) 2022-12-23 2024-03-12 日機装株式会社 窒化物半導体発光素子の製造方法

Families Citing this family (33)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007080896A (ja) * 2005-09-12 2007-03-29 Sanyo Electric Co Ltd 半導体素子
US8247886B1 (en) 2009-03-09 2012-08-21 Soraa, Inc. Polarization direction of optical devices using selected spatial configurations
US8791499B1 (en) 2009-05-27 2014-07-29 Soraa, Inc. GaN containing optical devices and method with ESD stability
US9000466B1 (en) 2010-08-23 2015-04-07 Soraa, Inc. Methods and devices for light extraction from a group III-nitride volumetric LED using surface and sidewall roughening
US9583678B2 (en) 2009-09-18 2017-02-28 Soraa, Inc. High-performance LED fabrication
US8933644B2 (en) 2009-09-18 2015-01-13 Soraa, Inc. LED lamps with improved quality of light
CN102630349B (zh) 2009-09-18 2017-06-13 天空公司 功率发光二极管及利用电流密度操作的方法
US9293644B2 (en) 2009-09-18 2016-03-22 Soraa, Inc. Power light emitting diode and method with uniform current density operation
KR20110056866A (ko) * 2009-11-23 2011-05-31 삼성전자주식회사 질화물 발광소자 및 그 제조방법
US10147850B1 (en) 2010-02-03 2018-12-04 Soraa, Inc. System and method for providing color light sources in proximity to predetermined wavelength conversion structures
US8740413B1 (en) 2010-02-03 2014-06-03 Soraa, Inc. System and method for providing color light sources in proximity to predetermined wavelength conversion structures
US8905588B2 (en) 2010-02-03 2014-12-09 Sorra, Inc. System and method for providing color light sources in proximity to predetermined wavelength conversion structures
KR101630152B1 (ko) * 2010-02-24 2016-06-14 엘지디스플레이 주식회사 하이브리드 발광다이오드 칩과 이를 포함하는 발광다이오드 소자 및 이의 제조방법
US9450143B2 (en) 2010-06-18 2016-09-20 Soraa, Inc. Gallium and nitrogen containing triangular or diamond-shaped configuration for optical devices
US8786053B2 (en) 2011-01-24 2014-07-22 Soraa, Inc. Gallium-nitride-on-handle substrate materials and devices and method of manufacture
US8686431B2 (en) 2011-08-22 2014-04-01 Soraa, Inc. Gallium and nitrogen containing trilateral configuration for optical devices
US8912025B2 (en) 2011-11-23 2014-12-16 Soraa, Inc. Method for manufacture of bright GaN LEDs using a selective removal process
US8867582B2 (en) 2012-04-04 2014-10-21 Osram Opto Semiconductors Gmbh Laser diode assembly
US9008138B2 (en) * 2012-04-12 2015-04-14 Osram Opto Semiconductors Gmbh Laser diode device
DE102012103160A1 (de) * 2012-04-12 2013-10-17 Osram Opto Semiconductors Gmbh Laserdiodenvorrichtung
JP5934575B2 (ja) * 2012-05-16 2016-06-15 サンケン電気株式会社 窒化物半導体装置の製造方法
US10804316B2 (en) * 2012-08-07 2020-10-13 Seoul Viosys Co., Ltd. Wafer level light-emitting diode array
US9318529B2 (en) * 2012-09-07 2016-04-19 Seoul Viosys Co., Ltd. Wafer level light-emitting diode array
US10388690B2 (en) 2012-08-07 2019-08-20 Seoul Viosys Co., Ltd. Wafer level light-emitting diode array
KR101957816B1 (ko) * 2012-08-24 2019-03-13 엘지이노텍 주식회사 발광 소자
US9412922B2 (en) * 2012-09-07 2016-08-09 Seoul Viosys Co., Ltd. Wafer level light-emitting diode array
US9978904B2 (en) 2012-10-16 2018-05-22 Soraa, Inc. Indium gallium nitride light emitting devices
US8802471B1 (en) 2012-12-21 2014-08-12 Soraa, Inc. Contacts for an n-type gallium and nitrogen substrate for optical devices
US8994033B2 (en) 2013-07-09 2015-03-31 Soraa, Inc. Contacts for an n-type gallium and nitrogen substrate for optical devices
JP6301097B2 (ja) * 2013-10-01 2018-03-28 シチズン電子株式会社 半導体発光装置
US9419189B1 (en) 2013-11-04 2016-08-16 Soraa, Inc. Small LED source with high brightness and high efficiency
TWI587548B (zh) * 2015-09-07 2017-06-11 隆達電子股份有限公司 發光二極體封裝件
CN111628056B (zh) * 2020-06-05 2023-03-21 湘能华磊光电股份有限公司 一种提升晶体质量的led多量子阱层生长方法

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1056236A (ja) * 1996-08-08 1998-02-24 Toyoda Gosei Co Ltd 3族窒化物半導体レーザ素子
JP2000183460A (ja) * 1998-12-15 2000-06-30 Toshiba Corp 半導体素子およびその製造方法
JP2000223743A (ja) * 1999-01-29 2000-08-11 Sanyo Electric Co Ltd 窒化物系半導体発光素子及び窒化物半導体層の成長方法
JP2002100804A (ja) * 2000-07-18 2002-04-05 Sony Corp 半導体発光素子及び半導体発光装置
JP2002344088A (ja) * 2001-05-11 2002-11-29 Sharp Corp 窒化物半導体レーザ素子とこれを含む光学装置
JP2003198062A (ja) * 2001-12-26 2003-07-11 Sony Corp 半導体レーザー素子及び半導体レーザー素子の製造方法
JP2005322698A (ja) * 2004-05-06 2005-11-17 Denso Corp 半導体レーザ素子およびその製造方法
JP2006134926A (ja) * 2004-11-02 2006-05-25 Sharp Corp 窒化物半導体素子
JP2006332269A (ja) * 2005-05-25 2006-12-07 Toyoda Gosei Co Ltd 発光装置

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2000055893A1 (fr) * 1999-03-17 2000-09-21 Mitsubishi Cable Industries, Ltd. Base de semiconducteur et son procede de fabrication et procede de fabrication de cristal semiconducteur
JP3556916B2 (ja) * 2000-09-18 2004-08-25 三菱電線工業株式会社 半導体基材の製造方法
TW536841B (en) * 2001-03-21 2003-06-11 Mitsubishi Cable Ind Ltd Semiconductor light emitting element
JP3756831B2 (ja) 2002-03-05 2006-03-15 三菱電線工業株式会社 GaN系半導体発光素子
CN1993835A (zh) * 2004-06-14 2007-07-04 三菱电线工业株式会社 氮化物半导体发光器件
US7339255B2 (en) * 2004-08-24 2008-03-04 Kabushiki Kaisha Toshiba Semiconductor device having bidirectionally inclined toward <1-100> and <11-20> relative to {0001} crystal planes
JP2006066449A (ja) * 2004-08-24 2006-03-09 Toshiba Corp 半導体発光素子
US20080135868A1 (en) * 2004-10-01 2008-06-12 Mitsubishi Cable Industries, Ltd. Nitride Semiconductor Light Emitting Element and Method for Manufacturing the Same

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1056236A (ja) * 1996-08-08 1998-02-24 Toyoda Gosei Co Ltd 3族窒化物半導体レーザ素子
JP2000183460A (ja) * 1998-12-15 2000-06-30 Toshiba Corp 半導体素子およびその製造方法
JP2000223743A (ja) * 1999-01-29 2000-08-11 Sanyo Electric Co Ltd 窒化物系半導体発光素子及び窒化物半導体層の成長方法
JP2002100804A (ja) * 2000-07-18 2002-04-05 Sony Corp 半導体発光素子及び半導体発光装置
JP2002344088A (ja) * 2001-05-11 2002-11-29 Sharp Corp 窒化物半導体レーザ素子とこれを含む光学装置
JP2003198062A (ja) * 2001-12-26 2003-07-11 Sony Corp 半導体レーザー素子及び半導体レーザー素子の製造方法
JP2005322698A (ja) * 2004-05-06 2005-11-17 Denso Corp 半導体レーザ素子およびその製造方法
JP2006134926A (ja) * 2004-11-02 2006-05-25 Sharp Corp 窒化物半導体素子
JP2006332269A (ja) * 2005-05-25 2006-12-07 Toyoda Gosei Co Ltd 発光装置

Cited By (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2010047289A1 (en) * 2008-10-22 2010-04-29 Panasonic Electric Works Co., Ltd. Semi-conductor light emitting device
JP2010103247A (ja) * 2008-10-22 2010-05-06 Panasonic Electric Works Co Ltd 半導体発光素子
US8536585B2 (en) 2008-10-22 2013-09-17 Panasonic Corporation Semiconductor light emitting device including anode and cathode having the same metal structure
JP2010182832A (ja) * 2009-02-04 2010-08-19 Panasonic Corp 窒化物半導体発光素子およびその製造方法
US8876344B2 (en) 2009-12-17 2014-11-04 Sharp Kabushiki Kaisha Vehicle headlamp with excitation light source, light emitting part and light projection section
US8833991B2 (en) 2010-02-10 2014-09-16 Sharp Kabushiki Kaisha Light emitting device, with light guide member having smaller exit section, and illuminating device, and vehicle headlight including the same
US8733996B2 (en) 2010-05-17 2014-05-27 Sharp Kabushiki Kaisha Light emitting device, illuminating device, and vehicle headlamp
JP2011243369A (ja) * 2010-05-17 2011-12-01 Sharp Corp 発光装置、照明装置および車両用前照灯
US10465873B2 (en) 2010-10-29 2019-11-05 Sharp Kabushiki Kaisha Light emitting device, vehicle headlamp, illumination device, and laser element
US9816677B2 (en) 2010-10-29 2017-11-14 Sharp Kabushiki Kaisha Light emitting device, vehicle headlamp, illumination device, and laser element
US10281102B2 (en) 2010-10-29 2019-05-07 Sharp Kabushiki Kaisha Light emitting device, vehicle headlamp, illumination device, and laser element
WO2012090400A1 (ja) * 2010-12-28 2012-07-05 信越半導体株式会社 発光素子
US8933432B2 (en) 2010-12-28 2015-01-13 Shin-Etsu Handotai Co., Ltd. Light-emitting device
JP2013128104A (ja) * 2011-11-17 2013-06-27 Sanken Electric Co Ltd 半導体発光装置及び半導体発光装置の製造方法
US9269876B2 (en) 2012-03-06 2016-02-23 Soraa, Inc. Light emitting diodes with low refractive index material layers to reduce light guiding effects
JP2015509669A (ja) * 2012-03-06 2015-03-30 ソラア インコーポレーテッドSoraa Inc. 導波光効果を低減させる低屈折率材料層を有する発光ダイオード
JP2014187325A (ja) * 2013-03-25 2014-10-02 Toshiba Corp 半導体発光装置及びその製造方法
JP2013229638A (ja) * 2013-08-12 2013-11-07 Toshiba Corp 半導体発光素子および発光装置
JP2018078232A (ja) * 2016-11-11 2018-05-17 日本碍子株式会社 広波長域発光素子および広波長域発光素子の作製方法
JP7448626B1 (ja) 2022-12-23 2024-03-12 日機装株式会社 窒化物半導体発光素子の製造方法

Also Published As

Publication number Publication date
US20080237569A1 (en) 2008-10-02
JP5032171B2 (ja) 2012-09-26
US8004004B2 (en) 2011-08-23
US20110068360A1 (en) 2011-03-24
US7863637B2 (en) 2011-01-04

Similar Documents

Publication Publication Date Title
JP5032171B2 (ja) 半導体発光素子およびその製造方法ならびに発光装置
KR101451036B1 (ko) 반도체 발광 소자
US6876009B2 (en) Nitride semiconductor device and a process of manufacturing the same
US9048385B2 (en) Nitride semiconductor light emitting diode
JP5788046B2 (ja) 半導体発光素子
US20050082544A1 (en) Nitride semiconductor device, and its fabrication process
JP2012195321A (ja) 半導体発光素子
KR101646664B1 (ko) 발광 소자, 발광 소자의 제조방법 및 발광 소자 패키지
JP2009130097A (ja) Iii族窒化物半導体発光素子及びその製造方法
KR20130058406A (ko) 반도체 발광소자
JP5740350B2 (ja) 半導体発光素子
JP4325160B2 (ja) 窒化物半導体発光素子
JP5715593B2 (ja) 半導体発光素子
JP5075298B1 (ja) 窒化物系半導体発光素子およびその製造方法
JP5543946B2 (ja) 半導体発光素子および発光装置
WO2011101929A1 (ja) 半導体発光装置及びその製造方法
JP2013229638A (ja) 半導体発光素子および発光装置
JP2009123836A (ja) 窒化物半導体発光素子
WO2017127958A1 (zh) 光泵浦发光器件及单片集成光泵浦发光器件的制备方法
JP2014170977A (ja) 発光装置
JP4982625B1 (ja) 半導体発光素子
JP6010169B2 (ja) 半導体発光素子
JP2014099663A (ja) 半導体発光素子
TW202412339A (zh) 用於將發光二極體晶片調光的金屬層
KR20130068701A (ko) 발광소자 및 이를 포함하는 발광 소자 패키지

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20090327

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20110629

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20110708

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110826

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120104

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120215

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20120605

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20120628

R151 Written notification of patent or utility model registration

Ref document number: 5032171

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150706

Year of fee payment: 3

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313113

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees