JP2008160880A - 固体撮像装置および固体撮像装置の駆動方法 - Google Patents
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Abstract
【解決手段】列並列ADC23−1〜23−mを搭載したCMOSイメージセンサ10において、当該列並列ADC23−1〜23−mを比較器31およびアップ/ダウンカウンタ32を用いて構成することにより、加算器、ラインメモリ装置などの追加回路なしに、複数行に亘って画素デジタル値の加算演算を実行可能にし、また感度を一定に保ちながら高フレームレート化の実現を可能にする。
【選択図】図1
Description
図1は、本発明の第1実施形態に係る固体撮像装置、例えば列並列ADC搭載のCMOSイメージセンサの構成を示すブロック図である。図1に示すように、本実施形態に係るCMOSイメージセンサ10は、光電変換素子を含む単位画素11が行列状(マトリックス状)に多数2次元配置されてなる画素アレイ部12に加えて、行走査回路13、カラム処理部14、参照電圧供給部15、列走査回路16、水平出力線17およびタイミング制御回路18を有する構成となっている。
図6は、本発明の第2実施形態に係る列並列ADC搭載CMOSイメージセンサの構成を示すブロック図である。図7に、本実施形態に係るCMOSイメージセンサの動作説明に供するタイミングチャートを示す。
図8は、本発明の第3実施形態に係る列並列ADC搭載CMOSイメージセンサの構成を示すブロック図であり、図中、図1と同等部分には同一符号を付して示している。
図10は、本発明の第4実施形態に係る列並列ADC搭載CMOSイメージセンサの構成を示すブロック図であり、図中、図1と同等部分には同一符号を付して示している。
図14は、本発明の第5実施形態に係る列並列ADC搭載CMOSイメージセンサの構成を示すブロック図であり、図中、図8と同等部分には同一符号を付して示している。
Claims (10)
- 光電変換素子を含む単位画素が行列状に2次元配置されるとともに、当該単位画素の行列状配置に対して列毎に列信号線が配線され、前記単位画素を行毎に選択制御する固体撮像装置の駆動方法であって、
前記選択制御によって選択した行の単位画素から前記列信号線を介して出力されるアナログ信号をデジタル信号に変換し、かつ当該デジタル信号を複数の単位画素間で加算して読み出す
ことを特徴とする固体撮像装置の駆動方法。 - 前記加算を複数の行の単位画素間で行う
ことを特徴とする請求項1記載の固体撮像装置の駆動方法。 - 前記加算を行う行数に応じてアナログ−デジタル変換のビット精度を低減し、アナログーデジタル変換時間を低減する
ことを特徴とする請求項2記載の固体撮像装置の駆動方法。 - 前記行数をM行とするとき、Nビットのアナログ−デジタル変換のビット精度を(N−M)ビットに低減し、アナログーデジタル変換時間を1/Mに低減する
ことを特徴とする請求項3記載の固体撮像装置の駆動方法。 - 前記画素アレイ部の各単位画素を任意の行毎に選択制御する
ことを特徴とする請求項1記載の固体撮像装置の駆動方法。 - 前記選択制御によって選択した複数の行の単位画素から出力されるアナログ信号をデジタル信号に変換し、同一列に配置されている単位画素についてのデジタル信号を前記複数の行間で加算する
ことを特徴とする請求項5記載の固体撮像装置の駆動方法。 - 前記同一列に配置されている単位画素についてのデジタル信号を奇数行同士、偶数行同士で独立に加算する
ことを特徴とする請求項6記載の固体撮像装置の駆動方法。 - 前記加算を複数の列の単位画素間で行う
ことを特徴とする請求項1記載の固体撮像装置の駆動方法。 - 前記選択制御によって選択した行の単位画素から前記列信号線を介して出力されるアナログ信号を列単位で複数系統に振り分けてデジタル信号に変換し、かつ当該デジタル信号を複数の列間で加算する
ことを特徴とする請求項8記載の固体撮像装置の駆動方法。 - 前記選択制御によって選択した行の単位画素から前記列信号線を介して出力されるアナログ信号を列ごとにデジタル信号に変換し、かつ当該デジタル信号を任意の組み合わせの複数の列間で加算する
ことを特徴とする請求項8記載の固体撮像装置の駆動方法。
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