JP2007134691A5 - - Google Patents

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Claims (10)

  1. 絶縁基板上に形成され第1方向に延びたゲート線及び前記ゲート線に接続されたゲート電極を含むゲート配線と、
    前記絶縁基板上に前記ゲート配線と絶縁して形成され、前記ゲート線と交差するように第2方向に延びたデータ線、前記データ線に接続されたソース電極及び前記ソース電極と離隔して位置するドレイン電極を含むデータ配線と、
    前記ゲート配線と前記データ配線上に各画素毎に形成され前記ドレイン電極と接続された画素電極と、を含むが、
    前記ゲート配線及び/又は前記データ配線は、
    下部構造物上に形成されたバリア膜と、
    前記バリア膜上に形成された銅又は銅合金を含む銅導電膜と、
    前記銅導電膜上に形成された銅窒化物を含む中間膜と、
    前記中間膜上に形成されたキャッピング膜と、
    を含むことを特徴とする薄膜トランジスタ基板。
  2. 前記バリア膜は、Mo、MoN、又はMo合金を含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  3. 前記中間膜は、銅窒化物、銅酸化物、及び銅酸窒化物のうちのいずれか1つを含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  4. 前記キャッピング膜は、Mo、MoN、又はMo合金を含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  5. 前記Mo合金は、MoW、MoTi、MoNb、MoZrのうち、少なくともいずれか1つを含むことを特徴とする請求項2乃至4のうちのいずれか1項に記載の薄膜トランジスタ基板。
  6. 絶縁基板上に形成され第1方向に延びたゲート線及び前記ゲート線に接続されたゲート電極を含むゲート配線と、
    前記絶縁基板上に前記ゲート配線と絶縁して形成され、前記ゲート線と交差するように第2方向に延びたデータ線、前記データ線に連結されたソース電極及び前記ソース電極と離隔して位置するドレイン電極を含むデータ配線と、
    前記ゲート配線と前記データ配線上に各画素毎に形成され前記ドレイン電極と接続された画素電極と、を含むが、
    前記ゲート配線及び/又は前記データ配線は、
    下部構造物上に形成されたバリア膜と、
    前記バリア膜上に形成された第1中間膜と、
    前記第1中間膜上に形成された銅又は銅合金を含む銅導電膜と、
    前記銅導電膜上に形成された第2中間膜と、
    前記中間膜上に形成されたキャッピング膜と、
    を含むことを特徴とする薄膜トランジスタ基板。
  7. 前記バリア膜は、Mo、MoN、又はMo合金を含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  8. 前記第1中間膜又は前記第2中間膜は、銅窒化物、銅酸化物、及び銅酸窒化物のうち、少なくともいずれか1つを含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  9. 前記キャッピング膜は、Mo、MoN、又はMo合金を含むことを特徴とする請求項記載の薄膜トランジスタ基板。
  10. 前記Mo合金は、MoW、MoTi、MoNb、MoZrのうち、少なくともいずれか1つを含むことを特徴とする請求項7または9記載の薄膜トランジスタ基板。
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