JP2007041537A - 平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路及びその具現方法とそれを利用したデータ駆動回路 - Google Patents
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Abstract
時間分割概念(Time Division)とサンプリングモードアナログ加算(Sampling Mode Analog Adding)の概念をデータ駆動ICに適用して、高解像度駆動のためのチップの面積が増加する現象を防止できる平板ディスプレイ駆動用時間分割サンプリングを利用したデジタルアナログ回路及びその具現方法とそれを利用したデータ駆動回路を提供する。
【解決手段】
n−ビットの解像度を有するアナログ出力を発生させるために、n−ビットのデジタル入力データをMSBグループとLSBグループに分けた後、各グループに該当するアナログ出力を分けられた各デジタル入力データにしたがって順次的に生成させて、順次的に発生した各アナログデータをサンプリング及び総加算して最終n−ビット解像度のアナログ出力を発生させる構造により、各アナログデータの順次的発生は主要ハードウェアの共有を可能にして非常に小さい面積でチャンネルDACを具現可能にする。
【選択図】図3
Description
グ加算(Sampling Mode Analog Adding)の概念をデータ駆動ICの構造に適用して高解
像度駆動のためにチップの面積が増加する現象を防止できるようにした、平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路及びその具現方法とそれを利用したデータ駆動回路に関するものである。
2n:1 MUX10、2n個のお互いに異なる大きさの信号の出力を有する基準信号源20、前記基準信号源20のガンマ特性を補正するためのガンマ補正部30からなり、それを利用したデータ駆動器の構造は図2に示す。
関係は、定められたマッピングテーブル(Mapping Table)による。
多数の出力(Data Channel)を独立的に持っていなければならない。平板ディスプレイの解像度規格にしたがって、要求されるデータチャンネルの個数が決められ、データ駆動器の出力個数が不足する場合、いくつかのデータ駆動器を並列に連結して高解像度の平板デ
ィスプレイを駆動したりする。
ジタルデータビット数を増加させる場合、MUXの大きさと信号線等の数は幾何級数的に増加する。
縮小のような費用を支払わなければならない状況が発生する。
第二に、解像度の変更なしにデータ駆動チップ(Data Driver IC)を製作するにおいて、本発明の時分割サンプリングDACをデータ駆動に適用すると、駆動チップの全体面積で多きな部分を占めるMUX(または、PTL)の大きさを2(n−n/k)分の1に減らすことができ、駆動チップの大きさを大きく減らすことができる。
1に小さくすることができ、同時にルーティング面積が狭くなることによって干渉(Interference)効果を大きく減らすことができる。
図示したように、回路各部の動作タイミングを提供し、同期(Synchronization)を合
わせるためのタイミング信号を発生するタイミング信号発生器110、n−ビットのデジタルデータを入力として受けてそれをk個のグループに分割し、前記タイミング信号発生器110からのタイミング信号にしたがって、分割されたデジタルデータ入力を出力させるデータ選択器120、2n/k個のアナログ基準信号を出力するk個のグループに分けられた基準信号発生器130−1、130−2、...、130−k、前記基準信号発生器130−1、130−2、...、130−kのガンマ特性を補正するためのガンマ補正部140、前記k個の基準信号発生器130−1、130−2、...、130−kの出力(k×2n/k個の出力レベル)を入力にして、前記タイミング信号発生器110からのタイミング信号にしたがって選択された一つの基準信号グループの信号(2n/k個の出力レベル)だけを出力させる基準信号選択器150、前記データ選択器120から入力されたn/k−ビットデジタルデータを制御入力として前記基準信号選択器150から入力された基準信号中の1個を選択して出力させるMUX160、前記タイミング信号発生器110のタイミングによりMUX160の出力をサンプリング及び貯蔵(Sample and
Store)するサンプリングモードアナログ加算器170で構成される。
ーIC)、タイミングコントローラー、グラフィックラム(GRAM)そして、データドライバーIC(または、ソースドライバーIC)で構成され、この4個のICが1個のICに集積されたりまたはその一部のチップが集積されたりするが、本発明ではこれらのチップセット中、図4のデータ駆動回路のようにタイミングコントローラー180とデータドライバーだけを図示して説明し、ゲートドライバーIC及びグラフィックメモリーの動作は通常的な動作をすると仮定する。また、本発明でデータ選択器120、MUX160、サンプリングモードアナログ加算器170は、各データチャンネルを構成する基本回路単位Aになる。
常的に平板ディスプレイパネルはフレーム単位で表示情報を更新する。ここで、更新周期をフレームタイムという。
図5でP2がフレームタイムの大部分を占めるようにみえるが、これは説明の便宜のためにこのように図示したもので、通常的に効率的なディスプレイシステムではP4がフレームタイムの大部分を占め、本発明の場合も同様である。
まず、4−ビットの入力データ(n=4)をMSB1グループ2−ビットとLSB1グループ2−ビット二個に(k=2)分けて、タイム1で開始してP5の間MSB2−ビットがMUX160の制御端子に入力され、基準信号発生器150は図6の4−レベルのアナログ信号をMUX160のアナログ入力に出力させて、MUX160はMSBデータにしたがって、入力された4−レベルのアナログ信号の中の1個をサンプリングモードアナログ加算器170の入力へ出力させて、サンプリングモードアナログ加算器170は入力された信号をサンプリングして貯蔵するとP5が終了してタイム2に至る。
図6は、基準信号選択器150の時間による出力タイミング図を示したもので、MSBに該当するアナログ出力をMUX160の出力からサンプリング及び貯蔵して、タイム2でLSBに該当するアナログ出力をMUX160の出力からサンプリング及び貯蔵して、その2信号の合計を出力イネーブル(Output Enable)信号によりサンプリングモードア
ナログ加算器170の最終出力になるようにする。
この場合、問題になる部分は図3のデータ選択器120、基準信号選択器150、MUX160である。
ビット数基準で大きい側をLSBグループで処理し、ビット数基準で小さいグループに該当するグループの処理はLSB側を使用しMSB側を使用しなければよく、残る1−ビットデータをMSBで処理することもでき、LSBで処理することもできる。
TFT LCD駆動器の場合、出力形態は電圧形態を取っているが、AMOLED駆動器の場合は電流形態を取ったり、電圧形態を取ったりするが、電流出力形態と電圧出力形態において、前記サンプリングモードアナログ加算器170の形態だけが異なるだけである。
図9は、電流出力がシンクタイプ(Sink Type)の場合で、NMOSトランジスターM
LSB、MMSBをPMOSトランジスターに変換するとソースタイプ(Source Type)
が可能である。
、MSEN(MSBに該当するアナログ電圧信号が入力されるとイネーブルされる信号)、OEN(最終出力時にイネーブルされる信号)に各々連結されたMOSトランジスターM1〜M3は、スイッチの機能を果たし、NMOSまたはPMOSで具現可能である。ここで、前記LSEN、MSEN、OENは、前記タイミング信号発生器110からのタイミング信号によりイネーブルされる。
前記図9は、DACから入力される信号が電圧の場合であり、電流入力である場合は図10のように構成できる。
上述したように、本発明の好ましい実施例を参照して説明したけれど、該当技術分野の熟練した当業者は、本発明の特許請求の範囲に記載された本発明の思想及び領域から逸脱しない範囲内で本発明を多様に修正または変形して実施できる。
第一に、時分割サンプリングDAC構造を利用してDAC具現に利用する場合、回路の大きさを減らすと同時に精密度を高められる。
1に小さくすることができ、同時にルーティング面積が狭くなることによって干渉(Interference)効果を大きく減らすことができるようになり経済的側面及び性能的側面の両方で改善された効果を得られる。n=10、k=2と仮定すると、n/k=5、n−n/k=5であるので基準信号線の個数は、1024(210)個から32(25)個に減り、ルーティングの面積は32(25)分の1に減らすことができるようになる。
120:データ選択器
130−1、130−2、...、130−k:基準信号発生器
140:基準信号選択器
150:ガンマ 補正部
160:MUX
170:サンプリングモードアナログ加算器
180:タイミングコントローラー
190:シフトレジスター
200:サンプリングラッチ
210:ホールディングラッチ
Claims (11)
- 回路各部の動作タイミングを提供し、または同期化するためのタイミング信号を発生するタイミング信号発生手段と、
n−ビットのデジタルデータを入力として受けて同デジタルデータを所定個数kのグループに分割し、前記タイミング信号発生器からのタイミング信号にしたがって、該分割されたデジタル入力データを出力させるデータ選択手段と、
各 々2n/k個のアナログ基準信号を出力する所定個数kの基準信号発生手段と、
前記基準信号発生手段の出力を入力として、前記タイミング信号発生手段からのタイミング信号にしたがって、選択された2n/k個のアナログ基準信号だけを出力させる基準信号選択手段と、
前記データ選択手段から入力されたn/k−ビットデジタルデータを制御入力として前記基準信号選択手段から入力された基準信号中の1個を出力させるMUXと、
前記タイミング信号発生手段のタイミングにより前記MUXの出力をサンプリング及び貯蔵するサンプリングモードアナログ加算手段と、
を含むことを特徴とする平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。 - 前記データ選択手段が、n−ビットのデジタルデータ入力をMSBとLSBグループに分割することを特徴とする請求項1記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。
- 前記サンプリングモードアナログ加算手段が、その出力が電流出力形態を有する場合、
LSBに該当するアナログ電圧信号に対応する電流出力によりオンオフされる第1MOSトランジスターと、
MSBに該当するアナログ電圧信号に対応する電流出力によりオンオフされる第2MOSトランジスターと、
前記第1および第2MOSトランジスターの電流出力に該当する電圧が貯蔵される第1および第2キャパシターと、
LSBに該当するアナログ電圧信号が入力されるとイネーブルされる信号及びMSBに該当するアナログ電圧信号が入力されるとイネーブルされる信号によりスイッチングされ、前記第1および第2キャパシターへの電圧の貯蔵を可能にする第1および第2スイッチング素子と、
サンプリングモードアナログ加算手段の最終出力のためにイネーブルされる信号によりスイッチングされ、前記LSBとMSBに該当する電流の合計の最終出力を可能にする第3スイッチング素子と、
を含むことを特徴とする請求項2記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。 - 前記第1乃至第3スイッチング素子が、MOSトランジスターであることを特徴とする請求項3記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。
- 前記LSBに該当するアナログ電圧信号が入力されるとイネーブルされる信号、MSBに該当するアナログ電圧信号が入力されるとイネーブルされる信号、及びサンプリングモードアナログ加算手段の最終出力のためにイネーブルされる信号は、前記タイミング信号発生手段からのタイミング信号によりイネーブルされることを特徴とする、請求項3記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。
- 前記nが奇数でkが偶数か、または、nは偶数でkは奇数の場合、のように正確にグル
ープを分けられない場合、デジタルデータ入力のビット数を基準に最も大きいグループに合うように前記データ選択手段、基準信号選択手段、及びMUXの大きさ、を決めることを特徴とする請求項1記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。 - 前記所定個数kが少なくても2以上であることを特徴とする請求項1記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路。
- n−ビットデジタルデータ入力からn−ビット解像度を有するアナログ信号を発生させるための方法において、n−ビットのデジタル入力データを少なくても2つ以上のデジタルデータグループに形成する工程と、
各デジタルデータグループに該当するアナログ値を時間的に分割する工程と、
時間により分割され生成されるアナログ値をサンプリング及び貯蔵する工程と、
サンプリング及び貯蔵された値をすべて加算して最終アナログ出力信号がn−ビット解像度を有するようにする工程と、
を特徴とする平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路の具現方法。 - 前記デジタルデータグループが、n−ビットのデジタル入力データがMSBとLSBグループに分割されていることを特徴とする請求項8記載の平板ディスプレイ駆動用時分割サンプリングを利用したデジタルアナログ回路の具現方法。
- 請求項1によるデジタルアナログ回路を平板ディスプレイ駆動用データ駆動回路に適用するにおいて、データ駆動回路の出力が所定個数の出力チャンネルを有する場合、前記データ選択手段、MUX、及びサンプリングモードアナログ加算手段を各々のデータチャンネルの基本構成単位にして、前記基準信号選択手段の出力を各データチャンネルのMUXの入力として共有するようにして、前記所定個数の各データチャンネルが最終的のアナログ信号を出力することを特徴とするデータ駆動回路。
- 請求項1によるデジタルアナログ回路を平板ディスプレイ駆動用データ駆動回路に適用するにおいて、データ駆動回路の出力が所定個数の出力チャンネルを有する場合、前記MUX及びサンプリングモードアナログ加算手段を各々のデータチャンネルの基本構成単位にして、タイミングコントローラーの制御によりタイミング信号を発生する前記タイミング信号発生手段からのタイミング信号により、前記MUXにデジタルデータを入力するホールディングラッチの動作を調整し、またはグラフィックメモリーのデータ幅及びタイミングを調整して、前記MUXにデジタル入力データが選択的に入力されるようにして、前記基準信号選択手段の出力を各データチャンネルのMUXの入力として共有して、前記所定個数の各データチャンネルが最終的のアナログ信号を出力することを特徴とするデータ駆動回路。
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