JP2005190015A - Pciシステム - Google Patents
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Abstract
【課題】 制御を容易にすることが可能なPCIシステムを提供する。
【解決手段】 ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボード203に、I/Oおよび内部ローカルバスが配設された複数の拡張ボード201、202を接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、遅延制御用LSI201k、201kと電源制御用LSI201h、202hを介し、供給電源のオン/オフタイミングを任意の時間だけ遅延可能とする。
【選択図】 図2
【解決手段】 ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボード203に、I/Oおよび内部ローカルバスが配設された複数の拡張ボード201、202を接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、遅延制御用LSI201k、201kと電源制御用LSI201h、202hを介し、供給電源のオン/オフタイミングを任意の時間だけ遅延可能とする。
【選択図】 図2
Description
本発明は、省エネのための電源制御を可能としたPCIシステムに関する。
従来技術として、同一出願人より、PCIシステムの拡張ボード間において、別ルートで内部ローカルバスを有することにより、PCIバス変換LSIによる変換処理を省く技術が開示されている(例えば特許文献1参照)。
特開平9−34610号公報
しかし、上記PCIシステムにおいては、制御対象システムへのイニシャル処理およびエンド処理の時間に依存して命令しているので、制御が複雑になるという問題があった。
本発明は、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令できることで制御を容易にすることが可能なPCIシステムを提供することを目的とする。
本発明は、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令できることで制御を容易にすることが可能なPCIシステムを提供することを目的とする。
上記の課題を解決するために、請求項1に記載の発明は、ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介して供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とする。
また、請求項2に記載の発明は、ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介して前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とする。
また、請求項3に記載の発明は、ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介し、前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすると共に、前記PCマザーボード上のホストCPUから、前記PCIバスおよびPCマザーボード上のその他システムにおける供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とする。
また、請求項2に記載の発明は、ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介して前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とする。
また、請求項3に記載の発明は、ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介し、前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすると共に、前記PCマザーボード上のホストCPUから、前記PCIバスおよびPCマザーボード上のその他システムにおける供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とする。
請求項1によれば、供給電源のオン/オフタイミングを遅延させることにより、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令できることで制御を容易にすることができる。
請求項2によれば、PCマザーボード以外の複数の拡張ボード電源のオン/オフタイミングを遅延させることにより、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令でき、消費電力を抑え省エネを実現することができる。
請求項3によれば、PCマザーボード上のホストCPU以外の電源のオン/オフタイミングを遅延させることにより、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令でき、消費電力を抑え省エネを実現することができる。
請求項2によれば、PCマザーボード以外の複数の拡張ボード電源のオン/オフタイミングを遅延させることにより、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令でき、消費電力を抑え省エネを実現することができる。
請求項3によれば、PCマザーボード上のホストCPU以外の電源のオン/オフタイミングを遅延させることにより、制御対象システムへのイニシャル処理およびエンド処理の時間に依存せず命令でき、消費電力を抑え省エネを実現することができる。
以下、図面を参照して、本発明の実施形態を詳細に説明する。
図1、図2に示す本発明の実施形態に係るプリンタ装置を説明する前に図3、図4に基いてその基本構成を説明する。
図3はプリンタ装置にPCIバスを用いたPCIシステムを適用した場合の基本構成図である。プリンタエンジン200を制御してプリンタ機能を実現するプリンタモジュール部としてのプリンタコントローラボード201と、プリンタ装置側からスキャナ101を制御してスキャナ機能を実現するスキャナモジュール部としてのスキャナコントローラボード202と、プリンタコントローラボード201およびスキャナコントローラボード202を制御して、コピー機能、ファクシミリ機能等を実現するためのPCマザーボード203とから構成される。
ここで、PCマザーボード203には、ホスト用CPUや、メモリがホストバス(内部ローカルバス)に接続されており、汎用のPCIバスにはデータ量の大きいデバイス(HDDなど)やデータを高速に転送する必要のあるデバイス(ビデオデバイス等の高速I/Oなど)等が接続されている。また、PCIバスとホストバスをPCIホストブリッジ(バス・ブリッジ回路)を介して接続することにより、PCマザーボード203全体の制御をホスト用CPUで行えるようにしている。
更に、拡張ボードであるプリンタコントローラボード201およびスキャナコントローラボード202は、それぞれPCIブリッジ(バス・ブリッジ回路)を含むPCIバス変換LSIが搭載されており、それぞれのボードのコネクタ204、206とPCマザーボード203側のPCIコネクタ205、207とを接続することにより、PCIバス変換LSIを介してボード201、202の内部ローカルバスとPCマザーボード203のPCIバスとが接続される構成である。
図4は図3に示すプリンタ装置における拡張ボードの取り付け例を示す斜視図である。PCマザーボード203側のPCIコネクタ205、207に、拡張ボードであるプリンタコントローラボード201およびスキャナコントローラボード202のコネクタ204、206を挿入することにより、容易にシステムの拡張を行うことができる。
図1、図2に示す本発明の実施形態に係るプリンタ装置を説明する前に図3、図4に基いてその基本構成を説明する。
図3はプリンタ装置にPCIバスを用いたPCIシステムを適用した場合の基本構成図である。プリンタエンジン200を制御してプリンタ機能を実現するプリンタモジュール部としてのプリンタコントローラボード201と、プリンタ装置側からスキャナ101を制御してスキャナ機能を実現するスキャナモジュール部としてのスキャナコントローラボード202と、プリンタコントローラボード201およびスキャナコントローラボード202を制御して、コピー機能、ファクシミリ機能等を実現するためのPCマザーボード203とから構成される。
ここで、PCマザーボード203には、ホスト用CPUや、メモリがホストバス(内部ローカルバス)に接続されており、汎用のPCIバスにはデータ量の大きいデバイス(HDDなど)やデータを高速に転送する必要のあるデバイス(ビデオデバイス等の高速I/Oなど)等が接続されている。また、PCIバスとホストバスをPCIホストブリッジ(バス・ブリッジ回路)を介して接続することにより、PCマザーボード203全体の制御をホスト用CPUで行えるようにしている。
更に、拡張ボードであるプリンタコントローラボード201およびスキャナコントローラボード202は、それぞれPCIブリッジ(バス・ブリッジ回路)を含むPCIバス変換LSIが搭載されており、それぞれのボードのコネクタ204、206とPCマザーボード203側のPCIコネクタ205、207とを接続することにより、PCIバス変換LSIを介してボード201、202の内部ローカルバスとPCマザーボード203のPCIバスとが接続される構成である。
図4は図3に示すプリンタ装置における拡張ボードの取り付け例を示す斜視図である。PCマザーボード203側のPCIコネクタ205、207に、拡張ボードであるプリンタコントローラボード201およびスキャナコントローラボード202のコネクタ204、206を挿入することにより、容易にシステムの拡張を行うことができる。
以下、具体的に本発明のPCIシステムを用いるプリンタ装置の一実施形態について、図面を参照して詳細に説明する。
図1は本発明の実施形態に係るプリンタ装置の外観図である。本実施形態のプリンタ装置102は、単体でプリンタ機能を有することに加えて、図示の如く、スキャナ101と組み合わせることにより、スキャナ101で読み取った画像データ(VIDEOデータ)をプリンタ装置102で出力することが可能である。換言すれば、プリンタ装置102とスキャナ101の構成によってコピー機能を実現できる構成である。尚、103はプリンタ装置102およびスキャナ101を載置するためのテーブルを示す。
図2は本発明の実施形態に係るプリンタ装置の制御系のハード構成図である。プリンタ装置102はプリンタエンジン200を制御してプリンタ機能を実現するプリンタモジュール部の制御基板としてのプリンタコントローラボード201と、プリンタ装置102側からスキャナ101を制御してスキャナ機能を実現するスキャナモジュール部の制御基板としてのスキャナコントローラボード202と、プリンタ装置102の多機能化のために種々の制御を行うPCマザーボード203とから構成される。
尚、図において符号204〜207はそれぞれプリンタコントローラボード201またはスキャナコントローラボード202をPCマザーボード203に接続するためのコネクタを示す。
また、プリンタコントローラボード201は、プリンタエンジン200との間でデータのやり取りを行うためのASIC201a、プリンタ装置102のプリンタ機能の制御を行うためのCPU201b、メモリ201c、I/O201d、RISCバスからなる内部ローカルバス201e、内部ローカルバス201eを後述するPCIバス203aに接続するためのPCIバス変換LSI201f、後述するPCマザーボード203上のホスト用CPU203dからの制御によって、上記モジュール201a〜201fの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI201k、電源制御用LSI201hを備えている。
図1は本発明の実施形態に係るプリンタ装置の外観図である。本実施形態のプリンタ装置102は、単体でプリンタ機能を有することに加えて、図示の如く、スキャナ101と組み合わせることにより、スキャナ101で読み取った画像データ(VIDEOデータ)をプリンタ装置102で出力することが可能である。換言すれば、プリンタ装置102とスキャナ101の構成によってコピー機能を実現できる構成である。尚、103はプリンタ装置102およびスキャナ101を載置するためのテーブルを示す。
図2は本発明の実施形態に係るプリンタ装置の制御系のハード構成図である。プリンタ装置102はプリンタエンジン200を制御してプリンタ機能を実現するプリンタモジュール部の制御基板としてのプリンタコントローラボード201と、プリンタ装置102側からスキャナ101を制御してスキャナ機能を実現するスキャナモジュール部の制御基板としてのスキャナコントローラボード202と、プリンタ装置102の多機能化のために種々の制御を行うPCマザーボード203とから構成される。
尚、図において符号204〜207はそれぞれプリンタコントローラボード201またはスキャナコントローラボード202をPCマザーボード203に接続するためのコネクタを示す。
また、プリンタコントローラボード201は、プリンタエンジン200との間でデータのやり取りを行うためのASIC201a、プリンタ装置102のプリンタ機能の制御を行うためのCPU201b、メモリ201c、I/O201d、RISCバスからなる内部ローカルバス201e、内部ローカルバス201eを後述するPCIバス203aに接続するためのPCIバス変換LSI201f、後述するPCマザーボード203上のホスト用CPU203dからの制御によって、上記モジュール201a〜201fの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI201k、電源制御用LSI201hを備えている。
また、図示を省略するが、必要に応じてLANや電話回線と接続するためのNIC等のインターフェース、HDD等の拡張メモリが設けられているものとし、同様に遅延制御用LSI201kと電源制御用LSI201hにより電源が制御される。
スキャナコントローラボード202は、スキャナ101との間でデータのやり取りを行うためのASIC202a、プリンタ装置102側からスキャナ機能を実現するためのI/O202b、RISCバスからなる内部ローカルバス202c、内部ローカルバス202cを後述するPCIバス203aに接続するためのPCIバス変換LSI202f、後述するPCマザーボード203上のホスト用CPU203dからの制御によって、上記モジュール202a〜202c、202fの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI202k、電源制御用LSI202hを備えている。
また、図示は省略するが、必要に応じてCPUやHDD等の拡張メモリを設けることができ、同様に遅延制御用LSI202kと電源制御用LSI202hにより電源が制御される。
PCマザーボード203は、汎用のPCIバス203a、ホストバスである内部ローカルバス203b、PCIバス203aと内部ローカルバス203bとを接続するPCIホストブリッジ203c、内部ローカルバス203bに接続されたホスト用CPU203d、メモリ203e、PCIバス203aに接続されたHDD203f、I/O203g、ホスト用CPU203dからの制御によって、上記モジュール203a〜203c、203e〜203gの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI203k、電源制御用LSI203hを備えている。
スキャナコントローラボード202は、スキャナ101との間でデータのやり取りを行うためのASIC202a、プリンタ装置102側からスキャナ機能を実現するためのI/O202b、RISCバスからなる内部ローカルバス202c、内部ローカルバス202cを後述するPCIバス203aに接続するためのPCIバス変換LSI202f、後述するPCマザーボード203上のホスト用CPU203dからの制御によって、上記モジュール202a〜202c、202fの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI202k、電源制御用LSI202hを備えている。
また、図示は省略するが、必要に応じてCPUやHDD等の拡張メモリを設けることができ、同様に遅延制御用LSI202kと電源制御用LSI202hにより電源が制御される。
PCマザーボード203は、汎用のPCIバス203a、ホストバスである内部ローカルバス203b、PCIバス203aと内部ローカルバス203bとを接続するPCIホストブリッジ203c、内部ローカルバス203bに接続されたホスト用CPU203d、メモリ203e、PCIバス203aに接続されたHDD203f、I/O203g、ホスト用CPU203dからの制御によって、上記モジュール203a〜203c、203e〜203gの電源を制御しオン/オフ状態をモニタ可能とする遅延制御用LSI203k、電源制御用LSI203hを備えている。
図5は図2に示す遅延制御用LSI201k(202k、203k)と電源制御用LSI201h(202h、203h)の内部ブロック図である。遅延制御用LSI201k(202k、203k)の内部は不揮発メモリ501(502、503)を保有している。
ホスト用CPU203dからの電源制御信号504(505、506)が遅延制御用LSI201k(202k、203k)に入力され、内部ローカルバスから不揮発メモリ501(502、503)に予め設定した任意時間だけ信号の変化を遅らせた後、次段の電源制御用LSI201h(202h、203h)へ電源制御信号507(508、509)を出力する。
電源制御用LSI201h(202h、203h)に入力された電源制御信号507(508、509)の状態変化により、出力する制御電源510(511、512)をオン/オフさせることで各デバイスの電源を制御する。また、電源制御状態信号513(514、515)、516(517、518)の出力信号状態変化をモニタすることで、制御電源510(511、512)のオン/オフを確認することが可能である。
ホスト用CPU203dからの電源制御信号504(505、506)が遅延制御用LSI201k(202k、203k)に入力され、内部ローカルバスから不揮発メモリ501(502、503)に予め設定した任意時間だけ信号の変化を遅らせた後、次段の電源制御用LSI201h(202h、203h)へ電源制御信号507(508、509)を出力する。
電源制御用LSI201h(202h、203h)に入力された電源制御信号507(508、509)の状態変化により、出力する制御電源510(511、512)をオン/オフさせることで各デバイスの電源を制御する。また、電源制御状態信号513(514、515)、516(517、518)の出力信号状態変化をモニタすることで、制御電源510(511、512)のオン/オフを確認することが可能である。
実施例1の動作を示す。ホスト用CPU203dより、制御信号線をコネクタ204〜207、および遅延制御用LSI201k、202kを介し、電源制御用LSI201h、202hに接続し、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバスの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202kの電源制御状態信号513(514)と電源制御用LSI201h、202hからの電源制御状態信号516(517)をモニタする。
そして状況により遅延制御用LSI201k、202kからの電源制御信号507(508)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202hにより、制御電源510(511)をオフすることで消費電力を抑える。
また、ホスト用CPU203dからの制御により、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバスの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202kの電源状態状態信号513(514)と電源制御用LSI201h、202hからの電源状態状態信号516(517)をモニタする。
そして、状況により遅延制御用LSI201k、202kからの電源制御信号507(508)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202hにより、制御電源510(511)をオンすることで上記デバイスの初期化動作が実行され通常状態に戻る。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202kの電源制御状態信号513(514)と電源制御用LSI201h、202hからの電源制御状態信号516(517)をモニタする。
そして状況により遅延制御用LSI201k、202kからの電源制御信号507(508)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202hにより、制御電源510(511)をオフすることで消費電力を抑える。
また、ホスト用CPU203dからの制御により、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバスの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202kの電源状態状態信号513(514)と電源制御用LSI201h、202hからの電源状態状態信号516(517)をモニタする。
そして、状況により遅延制御用LSI201k、202kからの電源制御信号507(508)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202hにより、制御電源510(511)をオンすることで上記デバイスの初期化動作が実行され通常状態に戻る。
実施例2の動作を示す。ホスト用CPU203dより、制御信号線をPCマザーボード203の遅延制御用LSI203kを介し電源制御用LSI203h、コネクタ204〜207、および遅延制御用LSI201k、202kを介し、電源制御用LSI201h、202hに接続し、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバス、PCマザーボード203のデバイス203b〜203c、203e〜203g、内部ローカルバス、および、PCIバス203aの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202k、203kの電源制御状態信号513(514、515)と電源制御用LSI201h、202h、203hからの電源制御状態信号516(517、518)をモニタする。
そして状況により遅延制御用LSI201k、202k、203kからの電源制御信号507(508、509)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202h、203hにより、制御電源510(511、512)をオフすることで消費電力を抑える。
また、ホスト用CPU203dからの制御により、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバス、PCマザーボード203のデバイス203b〜203c、203e〜203g、内部ローカルバス、および、PCIバス203aの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202k、203kの電源制御状態信号513(514、515)と電源制御用LSI201h、202h、203hからの電源制御状態信号516(517、518)をモニタする。
そして状況により遅延制御用LSI201k、202k、203kからの電源制御信号507(508、509)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御LSI201h、202h、203hにより、制御電源510(511、512)をオンすることで、上記デバイスの初期化動作が実行され通常状態に戻る。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202k、203kの電源制御状態信号513(514、515)と電源制御用LSI201h、202h、203hからの電源制御状態信号516(517、518)をモニタする。
そして状況により遅延制御用LSI201k、202k、203kからの電源制御信号507(508、509)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御用LSI201h、202h、203hにより、制御電源510(511、512)をオフすることで消費電力を抑える。
また、ホスト用CPU203dからの制御により、プリンタコントローラボード201のデバイス201a〜201f、内部ローカルバス、スキャナコントローラボード202のデバイス202a〜202c、202f、内部ローカルバス、PCマザーボード203のデバイス203b〜203c、203e〜203g、内部ローカルバス、および、PCIバス203aの電源をモニタする。
即ち、ホスト用CPU203dにより、遅延制御用LSI201k、202k、203kの電源制御状態信号513(514、515)と電源制御用LSI201h、202h、203hからの電源制御状態信号516(517、518)をモニタする。
そして状況により遅延制御用LSI201k、202k、203kからの電源制御信号507(508、509)を予め設定された任意時間だけ遅延させた後、信号の状態を変化させ出力し、電源制御LSI201h、202h、203hにより、制御電源510(511、512)をオンすることで、上記デバイスの初期化動作が実行され通常状態に戻る。
201 プリンタコントローラボード
202 スキャナコントローラボード
203 PCマザーボード
201h、202h 電源制御用LSI
201k、2021k 遅延制御用LSI
202 スキャナコントローラボード
203 PCマザーボード
201h、202h 電源制御用LSI
201k、2021k 遅延制御用LSI
Claims (3)
- ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介して供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とするPCIシステム。
- ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介して前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とするPCIシステム。
- ホストCPU、I/O、メモリ、ホストバス、PCIホストブリッジおよびPCIバスが配置されたPCマザーボードに、I/Oおよび内部ローカルバスが配設された複数の拡張ボードを接続することが可能なPCIシステムにおいて、前記PCIバスとは別に制御信号線およびステータスの読み取り可能な信号線を設け、予め設定された所定の時間だけ信号の変化を遅延する遅延制御用LSIと、電源制御信号を出力して電源をON/OFFする電源制御用LSIとを備え、前記遅延制御用LSIと電源制御用LSIを介し、前記I/Oおよび内部ローカルバスが配設された複数の拡張ボードの供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすると共に、前記PCマザーボード上のホストCPUから、前記PCIバスおよびPCマザーボード上のその他システムにおける供給電源のオン/オフタイミングを任意の時間だけ遅延可能とすることを特徴とするPCIシステム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003428147A JP2005190015A (ja) | 2003-12-24 | 2003-12-24 | Pciシステム |
Applications Claiming Priority (1)
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JP2003428147A JP2005190015A (ja) | 2003-12-24 | 2003-12-24 | Pciシステム |
Publications (1)
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Family
ID=34787236
Family Applications (1)
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JP2003428147A Withdrawn JP2005190015A (ja) | 2003-12-24 | 2003-12-24 | Pciシステム |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2007034580A (ja) * | 2005-07-26 | 2007-02-08 | Ricoh Co Ltd | Pciシステム |
CN101930274A (zh) * | 2009-06-19 | 2010-12-29 | 佳能株式会社 | 信息处理装置及其控制方法 |
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2003
- 2003-12-24 JP JP2003428147A patent/JP2005190015A/ja not_active Withdrawn
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Publication number | Priority date | Publication date | Assignee | Title |
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JP2007034580A (ja) * | 2005-07-26 | 2007-02-08 | Ricoh Co Ltd | Pciシステム |
CN101930274A (zh) * | 2009-06-19 | 2010-12-29 | 佳能株式会社 | 信息处理装置及其控制方法 |
CN101930274B (zh) * | 2009-06-19 | 2013-05-29 | 佳能株式会社 | 信息处理装置及其控制方法 |
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