JP2003500845A - プラスチックチップキャリヤの製造プロセス及びプラスチックチップキャリヤ - Google Patents
プラスチックチップキャリヤの製造プロセス及びプラスチックチップキャリヤInfo
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Abstract
(57)【要約】
【課題】特に従来の製造プロセスにおいて生じるバリや異物粒子によって開回路や短絡回路が発生することによる、電気接触の信頼性の低下を防止できるプラスチックチップキャリヤ及びその製造プロセスを提供する。
【解決手段】本発明はプラスチックキャリヤにおける城型ビアホールの新しい製造プロセスに関し、均一に半円柱形の側壁接触が形成されると共に、バリや異物粒子が発生して開回路や短絡回路が発生することにより電気接触の信頼性の低下を防止できる。これにより、従来のセラミックキャリヤの代用品として実用性を有するプラスチックチップキャリヤを提供する。
Description
従来技術を良く見ると、前記説明における従来技術の欠点を実証することがで
きる。まず、以下に従来のプロセスにおける典型的な工程の流れを説明する。 <イ>複数の孔110を形成する。 <ロ>PTH(メッキされたスルーホール)と銅140をメッキする。非回路
領域の銅125、140をエッチングすることによって回路系を定義する。 <ハ>半田マスク170を塗布する。 <ニ>ニッケル/金160をメッキする。 <ホ>溝210を刳りぬく。 <ヘ>支持板、例えば、防火型4(FR4)或いはビスマレイド・トリアジン
(BT)120材をラミネートする。 <ト>溝210を仕上げる。
きる。まず、以下に従来のプロセスにおける典型的な工程の流れを説明する。 <イ>複数の孔110を形成する。 <ロ>PTH(メッキされたスルーホール)と銅140をメッキする。非回路
領域の銅125、140をエッチングすることによって回路系を定義する。 <ハ>半田マスク170を塗布する。 <ニ>ニッケル/金160をメッキする。 <ホ>溝210を刳りぬく。 <ヘ>支持板、例えば、防火型4(FR4)或いはビスマレイド・トリアジン
(BT)120材をラミネートする。 <ト>溝210を仕上げる。
【0009】
前記ステップ5においては、溝210を刳りぬいて半円形(3次元的に見て、
半円筒形である)を形成するため、バリ310と異物粒子320とがかなり発生
する(図12参照)。周知のように、金属バリ310は短絡を起こし、又、プラ
スチック異物粒子320は孔110を塞いでしまうので、完成品における側部接
触点がクランプされた時に開回路を起こしてしまう。
半円筒形である)を形成するため、バリ310と異物粒子320とがかなり発生
する(図12参照)。周知のように、金属バリ310は短絡を起こし、又、プラ
スチック異物粒子320は孔110を塞いでしまうので、完成品における側部接
触点がクランプされた時に開回路を起こしてしまう。
【0010】
又、前記バリが生じなくても、側壁では、刳りぬき工程により銅層が露出され
てしまうと共に、銅/ニッケル/金層も刳りぬき工具に引きずられてラミネート
された側壁から剥離或いはゆるんでしまう。いずれの場合も製品の使用期間にお
ける信頼性を低下させることになる。
てしまうと共に、銅/ニッケル/金層も刳りぬき工具に引きずられてラミネート
された側壁から剥離或いはゆるんでしまう。いずれの場合も製品の使用期間にお
ける信頼性を低下させることになる。
【0011】
バリ310と異物粒子320が生じる根本的な原因は、厚膜の銅/ニッケル/
金の金属層125、140、150及び160が大きな弾力を有し、刳りぬき加
工により簡単に破壊できないからである。
金の金属層125、140、150及び160が大きな弾力を有し、刳りぬき加
工により簡単に破壊できないからである。
【0012】
本発明においては、そのような側部接触部330に対する新しい製造プロセス
の開発により、バリや異物粒子が発生せず、又は最小限に抑えられ、ひいては前
記全ての問題を軽減することができる。
の開発により、バリや異物粒子が発生せず、又は最小限に抑えられ、ひいては前
記全ての問題を軽減することができる。
【0013】
以下、本発明における好ましい工程の流れを詳細に説明する。印刷回路板(P
CB)や高密度相互接続(HDI)の製造技術に熟練する者であれば、種々な変
更ができるが、本発明における好ましい製造工程の流れは次のようである。 <イ>コア材120(BT材より構成され、厚さは約0.4mmであるが、重要な
パラメータではなく、0.2mmから1mmの間における所要の厚さにすること
ができる)に孔10(径度は約0.5mmであり、一般には0.25mmから1
mmの間である)を形成する。
CB)や高密度相互接続(HDI)の製造技術に熟練する者であれば、種々な変
更ができるが、本発明における好ましい製造工程の流れは次のようである。 <イ>コア材120(BT材より構成され、厚さは約0.4mmであるが、重要な
パラメータではなく、0.2mmから1mmの間における所要の厚さにすること
ができる)に孔10(径度は約0.5mmであり、一般には0.25mmから1
mmの間である)を形成する。
【0014】
<ロ>PTH130(メッキされたスルーホール)と銅140を約2μmから約
6μmの好ましい範囲に薄くメッキするが、約5μmがより好ましい。
6μmの好ましい範囲に薄くメッキするが、約5μmがより好ましい。
【0015】
<ハ>銅をプリエッチングし、高密度で溝に近い側縁領域135に回路パターン
を形成する。
を形成する。
【0016】
<ニ>溝210を刳りぬいて半円筒形の内側接触表面を形成する。
【0017】
<ホ>PTHと銅140を最終厚さ(約15μmから約25μmの範囲であるが、
20μmがより好ましい)に完全にメッキする。
20μmがより好ましい)に完全にメッキする。
【0018】
<ヘ>乾式フィルム開口により非高密度領域におけるニッケル/金領域150−
160を定義付けると同時に、高密度領域又は側縁領域を完全に開放させた状態
に維持させ、電気メッキ法によりニッケル/金をメッキする。前記ニッケル15
0の厚さは約5μm(約3μmから約7μmの範囲)であり、前記金の厚さは約0
.75μm(約0.5μmから約1μmの範囲)である。 言換えれば、ニッケル/金はi)側縁領域、ii)高密度領域及びiii)非高密度
領域における回路を覆うようにメッキされ、非高密度領域における非回路部分の
みが、電気ニッケル/金めっきを行なう間、バス接続メッキの通路として裸銅の
ままに維持される。
160を定義付けると同時に、高密度領域又は側縁領域を完全に開放させた状態
に維持させ、電気メッキ法によりニッケル/金をメッキする。前記ニッケル15
0の厚さは約5μm(約3μmから約7μmの範囲)であり、前記金の厚さは約0
.75μm(約0.5μmから約1μmの範囲)である。 言換えれば、ニッケル/金はi)側縁領域、ii)高密度領域及びiii)非高密度
領域における回路を覆うようにメッキされ、非高密度領域における非回路部分の
みが、電気ニッケル/金めっきを行なう間、バス接続メッキの通路として裸銅の
ままに維持される。
【0019】
<ト>マスクとして金160を用い、非高密度回路における銅をエッチングする
。
。
【0020】
<チ>支持板(FR4又はBT材120)をラミネートする。
【0021】
<リ>最終的な仕上げを行なう。
【0022】
以上のプロセス例において、注意すべきことは半田マスク170を使用しない
ことであるが、非金表面領域の保護層として半田マスク170の使用が必要な場
合は、次のいずれかの方法を選択することができる。
ことであるが、非金表面領域の保護層として半田マスク170の使用が必要な場
合は、次のいずれかの方法を選択することができる。
【0023】
a)前記ステップ7を修正し、乾式フィルムマスクを用いて自然な金マスク1
60に加えて銅領域を保護して、メッキされたバス領域をエッチングにより露出
させると共に、続く付加の半田マスク170の印刷及び穿孔ステップによって、
銅の表面全体を完全に被覆する。又は、 b)非ニッケル/金/銅の領域が必要でなければ、単にステップ7に続いて半
田マスク171のステップを加入すればいい。
60に加えて銅領域を保護して、メッキされたバス領域をエッチングにより露出
させると共に、続く付加の半田マスク170の印刷及び穿孔ステップによって、
銅の表面全体を完全に被覆する。又は、 b)非ニッケル/金/銅の領域が必要でなければ、単にステップ7に続いて半
田マスク171のステップを加入すればいい。
【0024】
次に、前記修正ステップa)を選択した場合のプロセスを説明する。
<イ>孔110を形成する。
【0025】
<ロ>PTH130と銅を厚さ約2μmから約6μmの範囲に薄くメッキする。
【0026】
<ハ>高密度領域又は溝側縁に近い領域135に銅回路パターンをプリエッチン
グする。
グする。
【0027】
<ニ>溝を刳りぬく。
【0028】
<ホ>PTHと前記銅140を最終厚さ(約15μmから約25μmの範囲)に完
全にメッキする。
全にメッキする。
【0029】
<ヘ>乾式フィルム開口により非高密度領域におけるニッケル/金領域150−
160を定義付けると同時に、高密度領域又は側縁領域を完全開放状態に維持し
て、電気メッキ法によりニッケル/金150−160をメッキする。
160を定義付けると同時に、高密度領域又は側縁領域を完全開放状態に維持し
て、電気メッキ法によりニッケル/金150−160をメッキする。
【0030】
<ト>維持する銅の領域を乾式フィルムで被覆すると共に、銅をエッチングする
(これと同時に、高密度領域又は側縁の近辺領域において自然のエッチングマス
クとしてニッケル/金を使用する)。
(これと同時に、高密度領域又は側縁の近辺領域において自然のエッチングマス
クとしてニッケル/金を使用する)。
【0031】
<チ>半田マスク170を塗布して非露出部分を保護する。前記半田マスクの厚
さは約20μmから約30μmであるが、厚さ50μmの厚い半田マスク170を
使用しても良い。
さは約20μmから約30μmであるが、厚さ50μmの厚い半田マスク170を
使用しても良い。
【0032】
<リ>支持板をラミネートする(FR4又はBT材)。
【0033】
<ヌ>最終的な仕上げを行なう。
【0034】
又、前記修正ステップb)を選択した場合は、次の様なプロセスになる。
<イ>孔110を形成する。
【0035】
<ロ>PTH130(メッキされたスルーホール)と銅を厚さ約2μmから約6
μmの範囲に薄くメッキする。
μmの範囲に薄くメッキする。
【0036】
<ハ>高密度領域、又は溝側縁に近い領域135に銅回路パターンをプリエッチ
ングする。
ングする。
【0037】
<ニ>溝210を刳りぬく。
【0038】
<ホ>溝210を刳りぬく。
【0039】
<ヘ>PTHと前記銅140を最終厚さ(約15μmから25μmの範囲)に完全
にメッキする。
にメッキする。
【0040】
<ト>乾式フィルム開口により非高密度領域におけるニッケル/金領域150−
160を定義付けると同時に、高密度領域又は側縁領域を完全開放状態に維持し
て、電気メッキ法によりニッケル/金150−160をメッキする。
160を定義付けると同時に、高密度領域又は側縁領域を完全開放状態に維持し
て、電気メッキ法によりニッケル/金150−160をメッキする。
【0041】
<チ>金160を用いて、非高密度回路領域に銅をエッチングする。
【0042】
<リ>半田マスク170を塗布し露出しない部分を保護する。前記半田マスクの
厚さは約20μmから約30μmであるが、厚さ50μmの厚い半田マスク170
を使用しても良い。
厚さは約20μmから約30μmであるが、厚さ50μmの厚い半田マスク170
を使用しても良い。
【0043】
<ヌ>支持板をラミネートする(FR4又はBT120材)。
【0044】
<ル>最終的な仕上げを行なう。
【0045】
次に、バリを更に減少させるための精度の高いプロセス手順を説明する。
これはバリを更に減少するために元のプロセスに二つのステップを追加する。
<ハ−1>紫外線硬化インクを前記PTHに詰め、紫外線により該インクを硬化
させて前記PTHを塞ぐ。 <ニ−1>前記PTHの裏表面(溝210を刳りぬいた後の半分)に被覆した前記
紫外線硬化インクを水酸化ナトリウム(NaOH)ストリッパーで剥離する。
<ハ−1>紫外線硬化インクを前記PTHに詰め、紫外線により該インクを硬化
させて前記PTHを塞ぐ。 <ニ−1>前記PTHの裏表面(溝210を刳りぬいた後の半分)に被覆した前記
紫外線硬化インクを水酸化ナトリウム(NaOH)ストリッパーで剥離する。
【0046】
前記ステップ<ハ−1>は、本発明において全ての変更を含むプロセスにおけ
るステップ<ハ>の後に行われるものであり、前記ステップ<ニ−1>は全ての
変更を含むプロセスにおけるステップ<ニ>の後に行われるものである。
るステップ<ハ>の後に行われるものであり、前記ステップ<ニ−1>は全ての
変更を含むプロセスにおけるステップ<ニ>の後に行われるものである。
【0047】
追加する以上のステップによりプロセス時間とコストは増加するが、バリ31
0の発生する可能性をより一層減少させることができると共に、溝を刳りぬく際
に前記紫外線硬化インクで薄銅層を被覆しているため、銅125、130及び1
40の剥離を防止できる。 前記PTHを塞ぐ材料として紫外線硬化インクを例示したが、本発明はこれに
限らず、溝を刳りぬく前に塗布し溝を刳りぬいた後に剥離できるものであれば、
それらの材料又は手段を用いてもよい。
0の発生する可能性をより一層減少させることができると共に、溝を刳りぬく際
に前記紫外線硬化インクで薄銅層を被覆しているため、銅125、130及び1
40の剥離を防止できる。 前記PTHを塞ぐ材料として紫外線硬化インクを例示したが、本発明はこれに
限らず、溝を刳りぬく前に塗布し溝を刳りぬいた後に剥離できるものであれば、
それらの材料又は手段を用いてもよい。
【0048】
以上のように、本発明の好ましい実施の形態を説明したが、本発明に対する種
々の変更や修正などについては、当該技術に熟練する者であれば容易に達成する
ことは明らかであり、その全ての変更や修正は本発明に含まれるものとする。
々の変更や修正などについては、当該技術に熟練する者であれば容易に達成する
ことは明らかであり、その全ての変更や修正は本発明に含まれるものとする。
本発明の上記目的、他の目的、特徴、及び利点は、添付図面参照の下、以下の好
適な実施の形態の詳細な説明から明らかにされる。
適な実施の形態の詳細な説明から明らかにされる。
【図1】スルーホールを有する基板コア材の等角投像図である。
【図2】銅メッキ被覆層を有する同基板の等角投影図である。
【図3】半田マスク層が塗布された同基板の等角投影図である。
【図4】乾式フィルム開口を有するニッケル/金領域を示す等角投影図である
。
。
【図5】溝を刳りぬくための線を示す等角投影図である。
【図6】(A)〜(B)図5の刳りぬき線に沿った断面図及び平面図である。
【図7】本発明に係わるプラスチックチップキャリヤを複数組み合わせた状態
を説明する図である。
を説明する図である。
【図8】本発明を組み合わせた一つのプラスチックチップキャリヤの平面図で
ある。
ある。
【図9】同基板の底面図である。
【図10】本発明を結合した一つのプラスチックチップキャリヤの角部におけ
る構成を示す一部平面図である。
る構成を示す一部平面図である。
【図11】本発明を結合した城型チップキャリヤの等角投影図である。
【図12】従来のプロセスの欠点を説明する図である。
─────────────────────────────────────────────────────
フロントページの続き
(81)指定国 EP(AT,BE,CH,CY,
DE,DK,ES,FI,FR,GB,GR,IE,I
T,LU,MC,NL,PT,SE),AU,BR,C
A,CN,JP,KR,MX
(72)発明者 ジョニー マ
タイワン,タオユーアンシェン,ピングチ
ェン,ピングチェン・インダストリアル・
ゾーン,クングーヤェー,サード・ロー
ド,ナンバー5
(72)発明者 スコット チェン
タイワン,タオユーアンシェン,ピングチ
ェン,ピングチェン・インダストリアル・
ゾーン,クングーヤェー,サード・ロー
ド,ナンバー5
(72)発明者 ポール ウ
アメリカ合衆国カリフォルニア州95070,
サラトガ,エディンバラ・ドライブ20090
Fターム(参考) 4K024 AA09 AB02 BA09 BB11 BC02
FA07 FA08 GA16
Claims (10)
- 【請求項1】 複数の刳りぬき可能な孔を有するキャリヤ基板に導電性金属メッキを施して、
導電性金属メッキされたチップキャリヤ基板を形成する工程と、該導電性金属メ
ッキされたチップキャリヤに一つ又は複数の溝を刳りぬく工程とを含むプラスチ
ックチップキャリヤの製造プロセスにおいて、 前記導電性金属メッキ工程は、(a)前記一つ又は複数の溝を刳りぬく前に、
厚さが約2μmから約6μmの薄い導電性金属メッキを形成するようにメッキを施
し、(b)前記溝を刳りぬいた後に、前記導電性金属メッキを最終的な厚さに厚
くすることで、バリを防止することを特徴とする、プラスチックチップキャリヤ
の製造プロセス。 - 【請求項2】 前記導電性金属が銅であり、前記最終的な厚さが約15μmから約25μmの範
囲であることを特徴とする、請求項1に記載のプラスチックチップキャリヤの製
造プロセス。 - 【請求項3】 薄い導電性金属メッキとパターンエッチングの後、紫外線硬化インク等を塗布
することにより溝を刳りぬく際に薄い導電性金属メッキを保護する被覆層を形成
し、その被覆層を溝の刳りぬき後に剥離し、 前記被覆層はバッキング支持を提供すると共に、前記金属メッキ層の剥離を防
止することを特徴とする、請求項1に記載のプラスチックチップキャリヤの製造
プロセス。 - 【請求項4】 前記導電性金属が銅であり、前記最終的な厚さが約15μmから約25μmの範
囲であることを特徴とする、請求項3に記載のプラスチックチップキャリヤの製
造プロセス。 - 【請求項5】 導電性金属メッキされた基板と、前記導電性金属メッキ及び基板を貫通する一
つ又は複数の機械刳りぬき部とを有するプラスチックチップキャリヤにおいて、 前記導電性金属メッキは、前記一つ又は複数の機械刳りぬき部が形成される前
に施される第1の薄導電性金属層と、前記機械刳りぬきの後に最終的な金属メッ
キの厚さにするために施される少なくとも一つの第2の厚導電性金属層とを備え
てなることを特徴とする、プラスチックチップキャリヤ。 - 【請求項6】 前記第1の薄導電性金属層は、厚さが約2μmから約6μmの範囲であることを
特徴とする、請求項5に記載のプラスチックチップキャリヤ。 - 【請求項7】 前記最終的な厚さが約15μmから約25μmの範囲であることを特徴とする、
請求項6に記載のプラスチックチップキャリヤ。 - 【請求項8】 前記導電性金属が銅であることを特徴とする、請求項5に記載のプラスチック
チップキャリヤ。 - 【請求項9】 前記導電性金属が銅であることを特徴とする、請求項6に記載のプラスチック
チップキャリヤ。 - 【請求項10】 前記導電性金属が銅であることを特徴とする、請求項7に記載のプラスチック
チップキャリヤ。 【発明の属する技術分野】 【0001】 本発明は新しい城型ビアホールの製造プロセスに関し、特に従来の製造プロセ
スにおいて生じるバリや異物粒子によって開回路や短絡回路が発生することによ
る、電気接触の信頼性の低下を防止できる城型ビアホールの製造プロセス及びそ
の製品に関するものである。 【0002】 【本発明に関連する出願】 本出願は1999年4月29日、仮出願番号60/131,492の「プラス
チックチップキャリヤのバリ無し城型(半円筒形ビア)の製造プロセス及びその
製品」基づくものである。 【0003】 【従来の技術】 従来、リードレスチップキャリヤはセラミック材及びそのプロセスによって作
られ、非常に高価であったが、コストダウンをはかるために、リードレスチップ
キャリヤの代わりにプラスチックチップキャリヤが開発され、コストを今までの
三分の一に抑えることができるようになった。 【0004】 【発明が解決しようとする課題】 ところで、この新しいプラスチックチップキャリヤ220が完全に従来のセラ
ミック製の物の代替物として機能するには、欠かせない条件が一つある。それは
、円筒形のメッキスルーホールから半円筒形を刳りぬくことで、形成される半円
筒形(城型)のサイドピン135に、精度の高い構成及び表面仕上げを施すこと
である。 しかしながら、従来のプラスチックキャリヤの製造技術ではバリ310が発生
し易く、製造直後に生じる開回路や短絡回路、及び使用中に生じる開回路や短絡
回路等のトラブルの要因となっていた。 【0005】 本発明は前記の問題に鑑みてなされたものであり、従来の製造プロセスにおい
て生じるバリや異物粒子によって開回路や短絡回路が発生することによる電気接
触の信頼性の低下を防止できる城型ビアホールの製造プロセスの提供を目的とし
、この発明によれば、キャリヤ基板に銅メッキを施すことにより銅メッキチップ
キャリヤを形成する工程と、該銅メッキチップキャリヤに一つ又は複数の溝を刳
りぬく工程とを含むリードレス半導体チップキャリヤの製造プロセスにおいて発
生するバリや異物粒子を、解消又は最小限に抑えることができる。 【0006】 また、本発明における改良点は、その一つ又は複数の溝の刳りぬき作業に先立
って、約2μmから約6μmの薄いメッキ層で銅メッキ処理を行なうことによりバ
リの発生を防止することである。前記溝を刳りぬいた後、メッキによって銅を厚
くし、最終的に約15μmから約25μmの範囲に達することが好ましい。更に、
もう一つの改良は前記薄い銅メッキを施した後紫外線(UV)の照射により硬化
するインクを保護層として塗布することである。このUV硬化インク層は刳りぬ
きを行なっている間薄い銅メッキ層を保護すると共に、前記溝の刳りぬく後に剥
離され又は取り除かれる。又、このUV被覆層はバッキング支持を提供すると共
に、溝を刳りぬく際に薄い膜銅メッキ層が剥離されてバリの形成を防止する役割
を持つ。 【0007】 以上により、銅メッキされた基板と、該銅メッキと基板を貫通する一つ又は複
数の機械刳りぬき部とを有するリードレス半導体チップキャリヤにおいて、前記
銅メッキは、溝の機械刳りぬき作業前に施され、厚さが約2μmから約6μmの第
1の薄膜銅メッキ層を含んでいる。そして、前記機械刳りぬき作業の後に施され
、厚さを約15μmから約25μmの好ましい範囲にするための少なくとも一つの
厚銅層が提供される。 【0008】
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CN102573289A (zh) * | 2010-12-15 | 2012-07-11 | 相互股份有限公司 | 侧边具有导电接触件的积层印刷电路板模组及其制造方法 |
US9173292B1 (en) * | 2011-03-11 | 2015-10-27 | Hittite Microwave Corporation | Edge launch transition for a printed circuit board |
KR20150004118A (ko) * | 2013-07-02 | 2015-01-12 | 삼성디스플레이 주식회사 | 표시 장치용 기판, 상기 표시 장치용 기판의 제조 방법, 및 상기 표시 장치용 기판을 포함하는 표시 장치 |
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Family Cites Families (36)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3949125A (en) | 1965-05-14 | 1976-04-06 | Roberts Arthur H | Molded solid plastics articles and a method for their manufacture |
US3401126A (en) | 1965-06-18 | 1968-09-10 | Ibm | Method of rendering noble metal conductive composition non-wettable by solder |
US3429040A (en) | 1965-06-18 | 1969-02-25 | Ibm | Method of joining a component to a substrate |
US3436818A (en) | 1965-12-13 | 1969-04-08 | Ibm | Method of fabricating a bonded joint |
US3564522A (en) | 1966-12-16 | 1971-02-16 | Data Disc Inc | Transducer with thin film coil and semiconductor switching |
US3672986A (en) * | 1969-12-19 | 1972-06-27 | Day Co Nv | Metallization of insulating substrates |
US4229248A (en) | 1979-04-06 | 1980-10-21 | Intel Magnetics, Inc. | Process for forming bonding pads on magnetic bubble devices |
EP0082902B1 (fr) | 1981-12-29 | 1985-11-27 | International Business Machines Corporation | Procédé pour souder les broches aux oeillets des conducteurs formés sur un substrat céramique |
US4504283A (en) | 1982-07-22 | 1985-03-12 | Superior Finishers, Incorporated | Cushioned abrasive articles, and method of manufacture |
JPS5980946A (ja) * | 1982-10-30 | 1984-05-10 | Ngk Insulators Ltd | セラミツクリ−ドレスパツケ−ジおよびその製造法 |
JPS59125642A (ja) | 1983-01-05 | 1984-07-20 | Nec Corp | リ−ドレスチツプキヤリア |
DE3331691A1 (de) | 1983-09-02 | 1985-03-21 | Basf Ag, 6700 Ludwigshafen | Als positiv arbeitendes aufzeichnungsmaterial geeignetes lichtempfindliches, haertbares gemisch |
JPS6035545A (ja) | 1983-09-12 | 1985-02-23 | Hitachi Ltd | リードレス型セラミツク・チツプ・キヤリア |
US4546541A (en) | 1983-10-14 | 1985-10-15 | Applied Magnetics Corporation | Method of attaching electrical conductors to thin film magnetic transducer |
DE3675734D1 (de) | 1985-09-30 | 1991-01-03 | Siemens Ag | Bauelement fuer die oberflaechenmontage und verfahren zur befestigung eines bauelements fuer die oberflaechenmontage. |
JPS62136865A (ja) | 1985-12-11 | 1987-06-19 | Hitachi Ltd | モジユ−ル実装構造 |
US4761699A (en) | 1986-10-28 | 1988-08-02 | International Business Machines Corporation | Slider-suspension assembly and method for attaching a slider to a suspension in a data recording disk file |
JPH07112041B2 (ja) | 1986-12-03 | 1995-11-29 | シャープ株式会社 | 半導体装置の製造方法 |
US4790894A (en) * | 1987-02-19 | 1988-12-13 | Hitachi Condenser Co., Ltd. | Process for producing printed wiring board |
US4929469A (en) * | 1988-07-06 | 1990-05-29 | Hayakawa Rubber Co., Ltd. | Method of forming a tentative surface protective coating |
US5574629A (en) | 1989-06-09 | 1996-11-12 | Sullivan; Kenneth W. | Solderless printed wiring devices |
US4996623A (en) | 1989-08-07 | 1991-02-26 | International Business Machines Corporation | Laminated suspension for a negative pressure slider in a data recording disk file |
US4999699A (en) | 1990-03-14 | 1991-03-12 | International Business Machines Corporation | Solder interconnection structure and process for making |
US5121190A (en) | 1990-03-14 | 1992-06-09 | International Business Machines Corp. | Solder interconnection structure on organic substrates |
US5243142A (en) * | 1990-08-03 | 1993-09-07 | Hitachi Aic Inc. | Printed wiring board and process for producing the same |
US5128746A (en) | 1990-09-27 | 1992-07-07 | Motorola, Inc. | Adhesive and encapsulant material with fluxing properties |
JP2678958B2 (ja) | 1992-03-02 | 1997-11-19 | カシオ計算機株式会社 | フィルム配線基板およびその製造方法 |
US5334857A (en) | 1992-04-06 | 1994-08-02 | Motorola, Inc. | Semiconductor device with test-only contacts and method for making the same |
EP0584386A1 (de) * | 1992-08-26 | 1994-03-02 | International Business Machines Corporation | Leiterplatte und Herstellungsverfahren für Leiterplatten |
US5319159A (en) * | 1992-12-15 | 1994-06-07 | Sony Corporation | Double-sided printed wiring board and method of manufacture thereof |
US5397240A (en) * | 1993-10-26 | 1995-03-14 | International Business Machines Corporation | Electrical connector |
JPH07154070A (ja) * | 1993-12-01 | 1995-06-16 | Nec Corp | 印刷配線板の製造方法 |
US5840402A (en) * | 1994-06-24 | 1998-11-24 | Sheldahl, Inc. | Metallized laminate material having ordered distribution of conductive through holes |
JP3301896B2 (ja) | 1995-09-07 | 2002-07-15 | 新光電気工業株式会社 | チップキャリア用基板及びその製造方法 |
FR2772998B1 (fr) * | 1997-12-23 | 2000-02-11 | Aerospatiale | Dispositif et procede d'interconnexion entre deux dispositifs electroniques |
US6365979B1 (en) * | 1998-03-06 | 2002-04-02 | Kabushiki Kaisha Toshiba | Semiconductor device and manufacturing method thereof |
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