JP2003234451A - 半導体装置およびその製造方法 - Google Patents
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Abstract
プサイズ以下の縮小は不可能であり、回路基板への3次
元実装ではリペアが困難である。 【解決手段】 本発明のように、配線基板11としてセ
ラミック多層基板を用いたスタック型半導体装置の形態
を採ることによって、通常の面実装部品と同様の取り扱
いが可能な、半導体チップサイズ以下の実装面積が実現
する。
Description
の製造方法は、配線基板に複数の半導体チップを搭載し
た半導体装置およびその製造方法に関するものであり、
特に、配線基板の基材がセラミックからなる半導体装置
およびその製造方法に関するものである。
プを搭載した半導体装置およびその製造方法が提案さ
れ、特に半導体チップどうしを積層して、配線基板に対
する実装面積を縮小した半導体装置およびその製造方法
が実現されている。
参照しながら説明する。
である。
ム1のダイパッド部2に半導体チップ3を搭載し、封止
樹脂部4の裏面に露出した外部端子部5と半導体チップ
3の電極6とが金属細線7により電気的に接続されてい
る。
板8に第1の半導体チップ9および第2の半導体チップ
10を積層している。
来の半導体装置の場合、以下の課題が考えられる。
しか配置されないため、実装面積を半導体チップサイズ
以下にはすることは出来ない。
板へ半導体装置を直接実装する方法では、実装面積を半
導体チップサイズ以下にすることは可能であるものの、
各工場のアセンブリラインに、フリップチップボンディ
ングライン、ワイヤボンディングライン、チップコート
ライン等専用ラインを持たなくてはならず、且つベアチ
ップを扱うためクリーンルームを持つ必要があり多大な
設備投資が必要になるという問題があった。
する方法では、半導体チップがパッケージ化されていな
いために、実装後搭載したチップが不良であることが判
った時に不良半導体チップのみの交換が困難であるとい
う問題があった。
ック化した半導体チップからの外部入出力端子を自由に
引き回すことは困難である。
着によって形成されているため、層間のデラミネーショ
ンが懸念され、特に接着強度が低い配線やビアを基板周
辺部に配置することは出来ず、配線禁止領域を基板周辺
部に設けなければならず、配線基板が大きなものになっ
てしまう。
合、樹脂基板では高価なダイヤモンドブレード等を用い
てダイシングの工程が必要となる。
は、前記従来の課題を解決するものであり、配線基板の
基材としてセラミックを採用することで、特に、複数の
半導体チップが搭載された場合の配線基板に要求される
特性に対応できる半導体装置およびその製造方法を提供
するものである。
るために、本発明の半導体装置は、第1の半導体チップ
と、配線基板の第1の配線電極とが突起電極によって接
続され、前記第1の半導体チップの裏面に第2の半導体
チップの裏面が接着され、前記第2の半導体チップの電
極と前記配線基板の第2の配線電極とが金属細線により
接続され、前記第1の半導体チップ、前記第2の半導体
チップおよび前記金属細線が第1の樹脂によって封止さ
れた半導体装置であって、前記配線基板はセラミックか
らなり、裏面に外部端子を有し、前記第1の配線電極、
前記第2の配線電極は、前記配線基板の内部で電気的に
接続されていることを特徴とする半導体装置である。
を直接実装する形態を採らないので、通常の表面実装部
品と同等に扱うことが出来、半導体装置のリペア性が改
善される。さらに、配線基板は表面に前記第1の半導体
チップ上の突起電極とのフリップチップ接続に対応する
複数の第1の電極と、その外側に前記第2の半導体チッ
プとの金属細線による接続のための複数の第2の電極
と、裏面に半導体装置外部との入出力端子とを持つセラ
ミック多層基板であり、前記複数の第1の電極と前記複
数の第2の電極の一部または全てが基板内において結線
されている。この基板内の結線によって半導体装置外部
との入出力端子の削減が可能となり、配線基板の小型化
が可能となる。
配線基板とのフリップチップ接続は、熱可塑性導電性接
着剤によって接続され、該第1の半導体チップと該配線
基板との間隙に第2の樹脂が設けられている。
板との間に生じる熱膨張係数の差による応力を熱可塑性
導電性接着剤により緩和し、フリップチップ接続部が破
壊され、電気的接続が出来なくなることを防止する。
該配線基板とのフリップチップ接続は樹脂の硬化収縮力
によって、該第一の半導体チップ上の突起電極と該配線
基板が接触し接続されている。
電極と配線基板との電気的接続は樹脂応力によって圧接
されているのみなので、第1の半導体チップと配線基板
との間に生じる熱膨張係数の差による応力による電気的
接続の破壊は発生しない。
より、ビアまたは内外層配線または外部端子端から基板
外周部までの距離0.2mm以下に配置可能であり、ビア
の直径が0.1〜0.07mmであり、ビアの中心間距離
が最短150μmに配置される。
脂基板やビルドアップ基板では、樹脂の張り合わせや樹
脂の積み上げによって配線基板を構成しているために層
間のデラミネーションが発生しうるので、デラミネーシ
ョンしやすいビアまたは内外層配線または外部端子端を
配線基板の内側に配置し基板外周部に禁止領域を設け幅
0.2mm以上の額縁が必要となるが、この発明によれ
ば、セラミック多層基板を用いることにより、配線基板
が一つの焼結体を為すことにより、デラミネーションは
発生せず、実質的に0.2mmもの額縁は必要とされな
い。また配線基板外形サイズを小型化することが可能と
なり半導体装置が小型化される。
m/℃である。
係数を合わせることができ、実質的に配線基板に対して
配線基板は不動のものとなるので、配線基板と配線基板
間には応力は限りなく小さくなり、配線基板と配線基板
間に生じる熱応力を緩和することが出来る。
セラミック多層基板を材料とし、表面に第1の電極、第
2の電極、裏面に外部との入出力端子を持つ配線基板に
搭載されている半導体装置の製造方法であって、第1の
半導体チップ上に突起電極を形成する工程と、前記突起
電極に導電性接着剤を供給する工程と、前記第1の半導
体チップ上の前記導電性接着剤が供給された前記突起電
極と、前記セラミック多層基板表面上の第1の電極とを
フリップチップ接合する工程と、第2の樹脂を前記第1
の半導体チップと前記セラミック多層基板との隙間と周
辺部とに注入し熱硬化させる工程と、前記第1の半導体
チップの裏面に第2の半導体チップを回路面を上にして
マウントする工程と、前記半導体チップ上の電極と、前
記セラミック多層基板表面上の、前記第1の電極の外側
に形成された前記第2の電極とを、金属細線にて接続す
る工程と、前記セラミック多層基板上に搭載された、前
記第1の半導体チップ、前記第2の樹脂、前記第2の半
導体チップ、前記金属細線と、前記セラミック多層基板
表面の前記第2の電極を覆うよう第1の樹脂にて封止す
る工程とを備える。
面に第1の電極、第2の電極、裏面に外部との入出力端
子を持つ配線基板に搭載されている半導体装置の製造方
法であって、第1の半導体チップ上に突起電極を形成す
る工程と、前記セラミック多層基板と第1の半導体チッ
プ間に絶縁性樹脂を供給する工程と、前記第1の半導体
チップ上の前記突起電極と、前記セラミック多層基板表
面上の第1の電極とをフリップチップ接合すると同時に
前記第1の半導体チップ上から熱と荷重をかけ絶縁性樹
脂を熱硬化させる工程と、前記第1の半導体チップの裏
面に第2の半導体チップを回路面を上にしてマウントす
る工程と、前記半導体チップ上の電極と、前記セラミッ
ク多層基板表面上の、前記第1の電極の外側に形成され
た前記第2の電極とを、金属細線にて接続する工程と、
前記セラミック多層基板上に搭載された、前記第1の半
導体チップ、前記第2の樹脂、前記第2の半導体チッ
プ、前記金属細線と、前記セラミック多層基板表面の前
記第2の電極を覆うよう第1の樹脂にて封止する工程と
を備える。
体装置が連結整列しており、複数個連結整列したまま、
前記の製造工程を終えた後、スナップ割りにて個々の半
導体装置に個片化する工程を備える半導体装置の製造方
法である。
線基板厚さの1/5から1/2の範囲で溝が形成されて
いる。
が可能となり、破断面の均一化共に破断応力の低減が可
能となる。
その製造方法の一実施形態について、図面を参照しなが
ら説明する。
面図である。
1の半導体チップ12と第2の半導体チップ13が搭載
されている。この第1の半導体チップ12と第2の半導
体チップ13は絶縁性接着剤14で裏面同士で張り合わ
されている。この半導体装置において、第1の半導体チ
ップ12と第2の半導体チップ13の組み合わせ例とし
ては、350個の電極を持つDSP−半導体チップ(デ
ジタル シグナル プロセッサ)9mm□と250個の電
極を持つアプリケーション用半導体チップ7.5mm□を
あげることが出来る。
起電極15が形成されている。第2の半導体チップ13
の表面上には、電極16が形成されている。
応して第1の電極17を配置し、その周辺に第2の電極
18を配置している。且つ、配線基板11内層にて第1
の電極17および第2の電極18の相互接続をその一部
または全てで行っており、配線基板11の裏面に外部接
続端子19と電気的に接続されている。また、外部接続
端子19は配線基板11の裏面においてマトリックス上
に配置されている。また、配線基板11への実装性、ワ
イヤボンド性を考慮し、配線基板11上の第1の電極1
7、第2の電極18、外部接続端子19には、Ni3〜
5μm、Au0.05〜0.10μmのメッキが施されて
いる。例として、配線基板11はアルミナセラミックス
を用い、350個の電極を持つDSP−半導体チップ
(デジタル シグナル プロセッサ)と250個の電極
を持つアプリケーション用半導体チップとして、1層1
00μmのセラミックスを4層構造とし、内部で142
個の端子を接続し外部接続端子数を72個の端子を削減
し529個の端子として12mm□の配線基板に0.5mm
ピッチで外部接続端子19をマトリックス上に並べ配線
基板とした。
と配線基板11の第1の電極17は、熱可塑性導電性接
着剤23を介してフリップチップ方式により接続されて
いる。第2の半導体チップ13上の電極16と配線基板
11の第2の電極18は、金属細線21を介してワイヤ
ボンディング方式により接続されている。第1の半導体
チップ12、第2の半導体チップ13、金属細線21お
よび、配線基板11の表面は第1の樹脂22にて覆われ
ており、第1の半導体チップ12の表面、突起電極15
および熱可塑性導電性接着剤23は第2の樹脂24にて
覆われている。
について、図面を参照しながら説明する。
配線基板を示す図である。
線基板11においては、表面上に、第1の半導体チップ
12の突起電極との接続のために、複数の第1の電極1
7が形成され、さらに第1の電極17の外周には、第2
の半導体チップ13の電極との接続のために、複数の第
2の電極18が形成されている。この第1の電極17と
第2の電極18は、例えば第1の電極17aと第2の電
極18aのように配線基板11内部にて接続され外部接
続端子19に出力してもよいし、第1の電極17bと第
2の電極18bのように基板内部にて自由に引き回し、
任意の外部接続端子19に出力してもよい。また、第1
の電極17、第2の電極18、外部接続端子19の配置
は、必ずしも図に示すものに限定されるものではない。
製造方法の各工程を示す断面図である。
によって200μmの厚さになっている第1の半導体チ
ップ12上に、金属部材により第1の半導体チップ12
の突起電極15を形成する。本実施形態においては、φ
25μmの金属細線を用いてワイヤボンディング法によ
り、直径が40〜60μmの二段突起電極を形成する。
突起電極の直径のサイズは、キャピラリの形状によって
制御し、第1の半導体チップ12の突起電極15のピッ
チによって決めるが、例えば、突起電極15のピッチが
80μm程度の場合、1辺が50μm程度の電極サイズが
望ましい。なお、突起電極15の形成には、メッキ法な
どを用いてもよい。
る円盤上にドクターブレード法を用いて、適当な厚みに
形成された熱可塑性導電性接着剤23に第1の半導体チ
ップ12の突起電極15を押し当てた後、静かに引き上
げる方法(転写法)によって、熱可塑性導電性接着剤2
3を、第1の半導体チップ12上の突起電極15に供給
する。
チップ方式によって、熱可塑性導電性接着剤23が供給
された第1の半導体チップ12の突起電極15と、配線
基板11上の第1の電極17とを位置合わせし、一定時
間、一定温度で放置し接合する。本実施形態では、熱可
塑性導電性接着剤23を用いて、120℃の温度で2時
間の加熱環境によって接合は完了する。
象を利用し第1の半導体チップ12と配線基板11間に
第2の樹脂24を注入し、硬化する。第2の樹脂24の
注入には、第2の樹脂24が第2の電極18まで広がら
ないように注意しなければならない。本実施形態では、
第1の半導体チップ12が10mm□の場合、10〜12
mm3を3回程度に分けて18G程度の細いノズルを使い
注入する。そして、150℃で2時間加熱することで、
第2の樹脂24を硬化させる。
によって150μmの厚さになっている第2の半導体チ
ップ13を第1の半導体チップ12の裏面に裏面同士を
合わせて、絶縁性接着剤14を用いて搭載する。本実施
形態では、絶縁性接着剤14の硬化方法は、第2の半導
体チップ13のウエハ裏面に絶縁性接着剤14を形成し
ておき、第2の半導体チップ13を切り出す際、絶縁性
接着剤14をも同時に切り出し、第1の半導体チップ1
2上に熱と圧力をかけ、瞬時に硬化させ、第1の半導体
チップ12と第2の半導体チップ13とを接着させる。
絶縁性接着剤14の硬化条件としては、150℃の温度
で、40g/cm2程度の圧力を与えることが望ましい。
導体チップ13上の電極16とそれに対応する第2の電
極18とを、金属細線21を用いてワイヤボンド法にて
電気的に接続する。
21の接続部を含む搭載面を、熱硬化性の第1の樹脂2
2によって封止する。本実施形態では、封止は金型を用
いて130〜150℃で注入し、バッチオーブンで15
0℃で5時間程度硬化完了する。なお、封止は本実施の
方法に限らず、印刷法、ポッティング法等を用いてもよ
い。
50個の電極を有するDSP−半導体チップ(デジタル
シグナル プロセッサ)9mm□と250個の電極を持
つアプリケーション用半導体チップ7.5mm□は、12
mm□(225mm2)、0.5mmピッチの外部接続端子1
9の半導体装置となる。
面図である。
1の半導体チップ12と第2の半導体チップ13が搭載
されている。この第1の半導体チップ12と第2の半導
体チップ13は絶縁性接着剤14で裏面同士で張り合わ
されている。この半導体装置において、第1の半導体チ
ップ12と第2の半導体チップ13の組み合わせ例とし
ては、350個の電極を持つDSP−半導体チップ(デ
ジタル シグナル プロセッサ)9mm□と250個の電
極を持つアプリケーション用半導体チップ7.5mm□と
をあげることが出来る。
起電極15が形成されている。第2の半導体チップ13
の表面上には、電極16が形成されている。
プ12上の突起電極15に接続されている第1の電極1
7を配置し、その周辺に第2の半導体チップ13上の電
極16に接続されている第2の電極18を配置してい
る。且つ、配線基板11内層にて第1の電極17および
第2の電極18の相互接続をその一部または全てで行っ
ており、配線基板11の裏面に外部接続端子19と電気
的に接続されている。また、外部接続端子19は配線基
板11の裏面においてマトリックス上に配置されてい
る。また、配線基板11への実装性、ワイヤボンド性を
考慮し、配線基板11上の第1の電極17、第2の電極
18、外部接続端子19には、Ni3〜5μm、Au
0.05〜0.10μmのメッキが施されている。例と
して、配線基板11として、アルミナセラミックスを用
い、350個の電極を持つDSP−半導体チップ(デジ
タル シグナル プロセッサ)と250個の電極を持つ
アプリケーション用半導体チップとして、1層100μ
mのセラミックスを4層構造とし、内部で142個の端
子を接続し外部接続端子数を72個の端子を削減し52
9個の端子として12mm□の配線基板11に0.5mmピ
ッチで外部接続端子19をマトリックス上に並べ配線基
板11とした。
電極15と配線基板11の第1の電極17は、第2の樹
脂24の硬化収縮の応力による、圧接によって電気的に
接続されている。第2の半導体チップ13に形成された
電極16と配線基板11の第2の電極18は、金属細線
21を介してワイヤボンディング方式により接続されて
いる。第1の半導体チップ12、第2の半導体チップ1
3、金属細線21および、配線基板11の表面は第1の
樹脂22にて覆われており、第1の半導体チップ12の
表面、および第1の半導体チップ12に形成された突起
電極15は第2の樹脂24にて覆われている。
について説明する。
置の製造方法の各工程を示す断面図である。
によって250μmの厚さになっている第1の半導体チ
ップ12上に、金属部材により第1の半導体チップ12
の突起電極15を形成する。本実施の形態においては、
φ25μmの金線を用いてワイヤボンディング法によ
り、φ40〜60μmの二段突起電極を形成する。径の
サイズは、キャピラリの形状によって制御し、第1の半
導体チップ12の突起電極15のピッチによって決め
る。80μm程度のピッチの際には60μm程度の電極サ
イズが望ましい。なお、突起電極15の形成には、メッ
キ法などを用いてもよい。
11上に第2の樹脂24を供給する。本実施の形態にお
いては、ディスペンサにて線描し、第1の半導体チップ
12のサイズ9mm□に10〜12mm3の第2の樹脂24
を供給した。なお、第2の樹脂24の供給はこの方法に
限らず、フィルム状に第2の樹脂24を形成し、必要量
を切断し供給してもよいし、回転する円盤上にドクター
ブレード法を用いて、適当な厚みに形成された第2の樹
脂24に第1の半導体チップ12の表面を押し当てた
後、静かに引き上げる方法(転写法)によって、第1の
半導体チップ12上に第2の樹脂24を供給してもよ
い。
チップ方式によって、第1の半導体チップ12の突起電
極15と、配線基板11上の第1の電極17とを位置合
わせし、一定時間、一定温度、一定圧力を加え接合す
る。第2の樹脂24を用いた接合完了条件は、60se
c、200℃、2時間、30g/cm3である。
によって150μmの厚さになっている第2の半導体チ
ップ13を第1の半導体チップ12の裏面に裏面同士を
合わせて、絶縁性接着剤14を用いて搭載する。本実施
形態では、第2の半導体チップ13のウエハ裏面に絶縁
性接着剤14を接着しておき、第2の半導体チップ13
を切り出す際、絶縁性接着剤14をも同時に切り出し、
第1の半導体チップ12上に熱と圧力をかけ、瞬時に硬
化接着させる。好ましくは、150℃の温度で、40g
/cm2の圧力を与える。
導体チップ13上の電極16とそれに対応する第2の電
極18とを、金属細線21を用いてワイヤボンド法にて
電気的に接続する。
続部を含む搭載面を、熱硬化性の第1の樹脂22によっ
て封止する。本実施の形態において、封止は金型を用い
て130〜150℃で注入し、バッチオーブンで150
℃で5時間程度硬化完了する。尚、封止は本実施の方法
に限らず、印刷法、ポッティング法等を用いてもよい。
により、350個の電極を有するDSP−半導体チップ
(デジタル シグナル プロセッサ)9mm□と250個
の電極を有するアプリケーション用半導体チップ7.5
mm□は、12mm□(225mm 2)、0.5mmピッチの外
部接続端子19の半導体装置を実現できる。また、第1
の実施の形態に比べ、該発明の効果を損なうことなく、
製造工程の簡略化が可能となり製造コストを下げること
が出来る。
配線基板を示す断面図である。
板11a、配線基板11b、配線基板11c‥と複数個
連結している。また連結部分には配線基板11の厚さ方
向の1/3まで配線基板11の裏面方向より溝25が施
してある。この溝25は、配線基板11の焼結前に施す
ことにより、比較的簡単に形成することが出来る。本実
施の形態では、配線基板11を12mm□、400μm厚
とし、溝25を140μmの深さとし、配線基板11を
3×3のマトリックス上に配置した。
方法を示す断面図である。
15を形成する工程から、ワイヤボンド工程の前まで
は、第1または第2の実施の形態と同様であるので省略
する。
の半導体チップ13の電極16と配線基板11との第2
の電極18とを金属細線21により電気的に接続する。
示すように、ワイヤ接続部を含む搭載面を、熱硬化性の
第1の樹脂22によって一括封止する。本実施形態にお
いて、封止は金型を用いて130〜150℃で注入し、
バッチオーブンで150℃で5時間程度硬化完了する。
なお、封止は本実施の方法に限らず、印刷法、ポッティ
ング法等を用いてもよい。次に、個々の半導体装置に分
割する。本実施の形態において、分割はスナップ割りに
て行う。配線基板11には溝25が施されているので溝
25を起点として、簡単にチョコレートブレークが可能
となる。
り、半導体装置の分割において高価なダイヤモンドブレ
ード等のダイサーを用いる必要がなく、簡単な設備また
は手作業で半導体装置の個片化が可能となる。また、第
1および第2の実施の形態に比べ、発明の効果を損なう
ことなく、製造の効率化を図ることが出来る。
断面図である。
板11との電気的、機械的接合は半田26を用いて行わ
れている。ここで、配線基板11が松下ALIVH基板であ
る場合について説明する。ALIVH基板は熱膨張係数7.
3ppm/Kのセラミック多層基板を用いる。配線基板11
は熱膨張係数7.0ppm/Kの物性値であり、配線基板1
1の熱膨張係数とほとんど一致する、従って、配線基板
11に対して半導体装置はほとんど不動となり応力は緩
和される。このように、セラミック多層基板の材質を選
定することにより、様々に配線基板11に対応すること
が可能となる。
ずセラミック粉末をガラス粉末と溶剤と共に混合ミルに
て、回転混合粉砕を行う。さらに有機バインダーとして
添加し、さらに混合する。このセラミック粉末は通常ア
ルミナを主成分としており、セラミック粉末とガラス粉
末の比によって焼成後の熱膨張係数を変えることが出来
る。充分混合を行った後、得られる泥しょう、いわゆる
スラリーは、グリーンシート成形のために搬送シート上
に任意の厚さで塗布される。厚みの調整にはドクターブ
レード法等を用いて行う。搬送シート上のスラリーは赤
外線および熱風を用いて溶剤を乾燥させることにより、
弾力性に富み、導電ペースト印刷時のペースト溶剤の浸
透性に優れたグリーンシートが得られる。このグリーン
シートに対して、位置合わせ手法としてはガイド穴を有
した保持枠に貼り付けて行う。次に、グリーンシートの
表裏の電気的導通が必要な部分に機械的加工法にて穴を
設ける。この穴に印刷法にてWを主成分とした導電性ペ
ーストを充填する。次に、グリーンシート表面に必要な
回路を印刷した後乾燥させ、印刷された回路を適当な加
重にてグリーンシート中に埋没される。この目的は、グ
リーンシート表面を平坦化させ、次工程の積層工程の不
良率を低減させるためである。積層工程においては、保
持枠のガイド穴にて精度よく積層されたグリーンシート
を加圧する。その後、焼成することにより一体のセラミ
ック多層基板は完成する。
製造方法は、半導体装置と配線基板との線膨張係数の違
いによる接合部への応力を緩和し、信頼性を向上するこ
とができるものである。
造方法は、配線基板の基材として、セラミックを用い、
パッケージの小型化、軽量化を可能にし、且つ、配線基
板上に半導体チップをスタック化することによって実装
面積をチップサイズ以下にすることを可能とし、高密度
で低コストな実装を提供することが可能となる。
各工程を示す断面図
各工程を示す断面図
各工程を示す断面図
各工程を示す断面図
各工程を示す断面図
基板を示す断面図
の各工程を示す断面図
図
Claims (10)
- 【請求項1】 第1の半導体チップと、配線基板の第1
の配線電極とが突起電極によって接続され、前記第1の
半導体チップの裏面に第2の半導体チップの裏面が接着
され、前記第2の半導体チップの電極と前記配線基板の
第2の配線電極とが金属細線により接続され、前記第1
の半導体チップ、前記第2の半導体チップおよび前記金
属細線が第1の樹脂によって封止された半導体装置であ
って、前記配線基板はセラミックからなり、裏面に外部
端子を有し、前記第1の配線電極、前記第2の配線電極
は、前記配線基板の内部で電気的に接続されていること
を特徴とする半導体装置。 - 【請求項2】 第1の半導体チップと配線基板との間に
は、第2の樹脂が形成されていることを特徴とする請求
項1に記載の半導体装置。 - 【請求項3】 第1の半導体チップの電極に形成された
突起電極と配線基板の第1の配線電極とは、熱可塑性導
電性接着剤によって接続されていることを特徴とする請
求項1に記載の半導体装置。 - 【請求項4】 配線基板はセラミックからなる基材の層
と配線層とが積層されており、前記基材の層と前記配線
層との各層において、ビアまたは内外層配線または外部
端子端から基板外周部までの距離0.2mm以下に配置可
能であり、ビアの直径が0.1〜0.07mmであり、ビ
アの中心間距離が最短150μmであることを特徴とす
る請求項1に記載の半導体装置。 - 【請求項5】 配線基板の線膨張係数が3〜20ppm/
℃であることを特徴とする請求項1に記載の半導体装
置。 - 【請求項6】 セラミック多層基板を材料とし、表面に
第1の電極、第2の電極、裏面に外部との入出力端子を
持つ配線基板に搭載されている半導体装置の製造方法で
あって、第1の半導体チップ上に突起電極を形成する工
程と、前記突起電極に導電性接着剤を供給する工程と、
前記第1の半導体チップ上の前記導電性接着剤が供給さ
れた前記突起電極と、前記セラミック多層基板表面上の
第1の電極とをフリップチップ接合する工程と、第2の
樹脂を前記第1の半導体チップと前記セラミック多層基
板との隙間と周辺部とに注入し熱硬化させる工程と、前
記第1の半導体チップの裏面に第2の半導体チップを回
路面を上にしてマウントする工程と、前記半導体チップ
上の電極と、前記セラミック多層基板表面上の、前記第
1の電極の外側に形成された前記第2の電極とを、金属
細線にて接続する工程と、前記セラミック多層基板上に
搭載された、前記第1の半導体チップ、前記第2の樹
脂、前記第2の半導体チップ、前記金属細線と、前記セ
ラミック多層基板表面の前記第2の電極を覆うよう第1
の樹脂にて封止する工程とを備える半導体装置の製造方
法。 - 【請求項7】 セラミック多層基板を材料とし、表面に
第1の電極、第2の電極、裏面に外部との入出力端子を
持つ配線基板に搭載されている半導体装置の製造方法で
あって、第1の半導体チップ上に突起電極を形成する工
程と、前記セラミック多層基板と第1の半導体チップ間
に絶縁性樹脂を供給する工程と、前記第1の半導体チッ
プ上の前記突起電極と、前記セラミック多層基板表面上
の第1の電極とをフリップチップ接合すると同時に前記
第1の半導体チップ上から熱と荷重をかけ絶縁性樹脂を
熱硬化させる工程と、前記第1の半導体チップの裏面に
第2の半導体チップを回路面を上にしてマウントする工
程と、前記半導体チップ上の電極と、前記セラミック多
層基板表面上の、前記第1の電極の外側に形成された前
記第2の電極とを、金属細線にて接続する工程と、前記
セラミック多層基板上に搭載された、前記第1の半導体
チップ、前記第2の樹脂、前記第2の半導体チップ、前
記金属細線と、前記セラミック多層基板表面の前記第2
の電極を覆うよう第1の樹脂にて封止する工程とを備え
る半導体装置の製造方法。 - 【請求項8】 第1の半導体チップと配線基板の間に第
2の樹脂が形成され、前記第1の半導体チップの裏面か
ら加熱しながら加圧して、前記第2の樹脂を硬化させ、
突起電極と第1の配線電極とが接続されることを特徴と
する請求項6または請求項7に記載の半導体装置。 - 【請求項9】 該セラミック多層基板を材料とした配線
基板は複数個の半導体装置が連結整列しており、複数個
連結整列したまま、請求項6または請求項7のいずれか
の製造工程を終えた後、スナップ割りにて個々の半導体
装置に個片化する工程を備える半導体装置の製造方法。 - 【請求項10】 配線基板は、各個片分割部に配線基板
裏面より配線基板厚さの1/5から1/2の範囲で溝が
形成されていることを特徴とする請求項9に記載の半導
体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002029250A JP2003234451A (ja) | 2002-02-06 | 2002-02-06 | 半導体装置およびその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002029250A JP2003234451A (ja) | 2002-02-06 | 2002-02-06 | 半導体装置およびその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2003234451A true JP2003234451A (ja) | 2003-08-22 |
Family
ID=27773616
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002029250A Pending JP2003234451A (ja) | 2002-02-06 | 2002-02-06 | 半導体装置およびその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2003234451A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005142312A (ja) * | 2003-11-06 | 2005-06-02 | Renesas Technology Corp | 半導体装置およびその製造方法ならびに配線基板の製造方法 |
US7239164B2 (en) | 2004-08-04 | 2007-07-03 | Sharp Kabushiki Kaisha | Stack type semiconductor apparatus package and manufacturing method thereof |
JP2014512691A (ja) * | 2011-04-22 | 2014-05-22 | テセラ インコーポレイテッド | 積層された下向き接続ダイを有するマルチチップモジュール |
JP7391247B2 (ja) | 2020-06-24 | 2023-12-04 | クゥアルコム・インコーポレイテッド | スタックダイを用いる半導体ダイ(「ダイ」)モジュールを容易にするための分割された両面のメタライゼーション構造を用いる集積回路(ic)パッケージ、および関連する製造方法 |
-
2002
- 2002-02-06 JP JP2002029250A patent/JP2003234451A/ja active Pending
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