JP2003005699A - プラズマディスプレイパネルの駆動方法 - Google Patents

プラズマディスプレイパネルの駆動方法

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Abstract

(57)【要約】 【課題】 一本のスキャン電極が共用される２行の表示
ラインの内、一方側の表示ラインをアドレス放電が発生
しない電荷状態にし、他方側の表示ラインをアドレス放
電が可能な電荷状態にした上で、アドレス放電を発生さ
せることにより、ＡＬｉＳ構造のＰＤＰでプログレッシ
ブ表示を行う。 【解決手段】 隣接する電極間で表示ラインを形成する
よう配置された複数の表示電極と、それらの表示電極と
交差する方向に配置された複数のアドレス電極とを備
え、アドレス放電を発生させる際に、隣り合う２行の表
示ラインで一本の表示電極がスキャン電極として共用さ
れる電極構造を有するＰＤＰを駆動する際、一本のスキ
ャン電極が共用される２行の表示ラインの内、一方側の
表示ラインをアドレス用の放電が可能な電荷状態にし、
他方側の表示ラインをアドレス用の放電が発生しない電
荷状態にした上で、アドレス用の放電を発生させ、これ
によりプログレッシブ表示を行う。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、プラズマディスプ
レイパネル（ＰＤＰ）の駆動方法に関し、さらに詳しく
は、一対の基板間に複数の表示電極が隣接する電極との
間で面放電を生じるように配置され、それらの表示電極
と交差する方向に複数のアドレス電極（信号電極）が配
置されたパネル構造を有するプラズマディスプレイパネ
ルの駆動方法に関する。
【０００２】
【従来の技術】上述のようなＰＤＰでは、複数の表示電
極は画面の列方向に等間隔に配置されており、隣合う表
示電極間が全て面放電可能な表示ラインとなる。そし
て、表示電極と交差する複数のアドレス電極は画面の行
方向に配置され、表示ラインとアドレス電極との交差部
がセル領域（単位発光領域）となる。
【０００３】ところで、一般に、面放電型のＰＤＰで
は、２本の表示電極で面放電のための電極対を構成す
る。このため、上述の構造のＰＤＰでは、隣り合う２行
の表示ラインに一本の表示電極がスキャン電極として共
用されることになる。つまり、点灯すべきセルを選択す
るためのアドレス放電を発生させる際に、奇数行の表示
ラインと偶数行の表示ラインとで一本のスキャン電極が
共用される。したがって、一般に表示形式はインタレー
ス形式となる。なお、この表示電極が等間隔に配置され
た構造のＰＤＰを、この明細書では、ＡＬｉＳ（Altern
ate Lighting of Surfaces）構造のＰＤＰと呼ぶ。
【０００４】
【発明が解決しようとする課題】上述のＡＬｉＳ構造の
ＰＤＰは、表示ライン毎に一対の表示電極を配置した構
造のＰＤＰよりも、少ない表示電極数で同じセル数を確
保でき、セルの高密度化に適しているという構造上のメ
リットを有する。しかしながら、インタレース形式は、
表示ラインを線順次で表示する、いわゆるプログレッシ
ブ形式に比べ、表示品位の点で劣る。このため、このＡ
ＬｉＳ構造のＰＤＰを用いたプログレッシブ形式の駆動
が種々提案されている。
【０００５】このＡＬｉＳ構造のＰＤＰでは、上述した
ように、点灯セルの選択のために表示電極をスキャン電
極として用いてスキャンパルスを印加する際、表示電極
に対して一本おきにスキャンパルスを印加する。このよ
うに、一本のスキャン電極が２行の表示ラインで共用さ
れるので、この２行の表示ラインを独立に選択する手法
が必要である。
【０００６】この手法としては、特開２０００−１８１
４０２号公報に記載のような方法が知られている。この
方法では、表示電極にスキャンパルスを印加する前に補
助放電を発生させ、この補助放電の有無で２行の表示ラ
インの一方を選択する。しかし、この方法では、スキャ
ンパルスの前に補助パルスを印加する必要があるので、
アドレシングに多くの時間がかかり、実用的ではない。
また、駆動回路が複雑になるという問題もある。
【０００７】本発明は、このような事情を考慮してなさ
れたもので、一本のスキャン電極が共用される２行の表
示ラインの内、一方をアドレス放電が発生しない電荷状
態にし、他方をアドレス放電が可能な電荷状態にした上
で、アドレス放電を発生させることにより、ＡＬｉＳ構
造のＰＤＰでプログレッシブ表示を行えるようにしたプ
ラズマディスプレイパネルの駆動方法を提供するもので
ある。
【０００８】
【課題を解決するための手段】本発明は、放電空間を形
成する一対の基板間に複数の表示電極とそれらの表示電
極と交差する複数のアドレス電極とを備え、隣接する表
示電極間に面放電による表示ラインが設定されるととも
に、表示ラインとアドレス電極との交差部にセルが設定
され、点灯すべきセルを選択するためのアドレス放電を
発生させる際に、隣り合う２行の表示ラインで一本の表
示電極がスキャン電極として共用される電極構造を有す
るプラズマディスプレイパネルの駆動方法であって、一
本のスキャン電極が共用される２行の表示ラインの内、
一方側の第１の表示ラインをアドレス用の放電が発生し
ない電荷状態にし、他方側の第２の表示ラインをアドレ
ス用の放電が可能な電荷状態にした上で、第２の表示ラ
インにアドレス用の放電を発生させ、次に、第２の表示
ラインをアドレス用の放電が発生しない電荷状態にし、
第１の表示ラインをアドレス用の放電が可能な電荷状態
にした上で、第１の表示ラインにアドレス用の放電を発
生させ、その後、第１および第２の表示ラインで同時に
面放電を発生させることでプログレッシブ表示を行うこ
とを特徴とするプラズマディスプレイパネルの駆動方法
である。
【０００９】本発明では、一本のスキャン電極が共用さ
れる２行の表示ラインを、電荷の有無で選択するように
している。すなわち、一本のスキャン電極が共用される
２行の表示ラインの内、一方をアドレス放電が発生しな
い電荷状態にし、他方をアドレス放電が可能な電荷状態
にした上で、アドレス放電を発生させるようにしてい
る。アドレス放電が発生しない電荷状態と、アドレス放
電が可能な電荷状態は、それぞれ容易に実現できるた
め、十分な駆動マージンを確保したプログレッシブ表示
が可能となる。
【００１０】
【発明の実施の形態】本発明において、一対の基板とし
ては、ガラス、石英、セラミック等の基板や、これらの
基板上に、電極、絶縁膜、誘電体層、保護膜等の所望の
構成物を形成した基板が含まれる。
【００１１】表示電極としては、ＩＴＯ、ＳｎＯ2 など
の透明電極材料で形成された電極や、Ａｇ、Ａｕ、Ａ
ｌ、Ｃｕ、Ｃｒなどの金属電極材料で形成された電極を
用いることができる。具体的には、例えば、ＩＴＯ、Ｓ
ｎＯ2 などの幅の広い透明電極と、電極の抵抗を下げる
ための、例えばＡｇ、Ａｕ、Ａｌ、Ｃｕ、Ｃｒ及びそれ
らの積層体（例えばＣｒ／Ｃｕ／Ｃｒの積層構造）等か
らなる金属製の幅の狭いバス電極から構成された電極な
どが用いられる。表示電極は、Ａｇ、Ａｕについては印
刷法を用い、その他については蒸着法、スパッタ法等の
成膜法とエッチング法を組み合わせることにより、所望
の本数、厚さ、幅及び間隔で形成することができる。
【００１２】アドレス電極は、表示電極と交差する方向
に複数配置されていればよい。通常、表示電極は画面の
列方向に平行に配置され、アドレス電極は画面の行方向
に平行に配置される。このアドレス電極は、スキャン用
の表示電極との交差部でアドレス放電を発生するもので
あり、Ａｇ、Ａｕ、Ａｌ、Ｃｕ、Ｃｒなどの金属電極材
料で形成された電極を用いることができる。このアドレ
ス電極は、背面側の基板に形成されるため透明である必
要はなく、具体的には、例えば、Ａｇ、Ａｕ、Ａｌ、Ｃ
ｕ、Ｃｒ及びそれらの積層体（例えばＣｒ／Ｃｕ／Ｃｒ
の積層構造）等から構成される。アドレス電極も、表示
電極と同様に、Ａｇ、Ａｕについては印刷法を用い、そ
の他については蒸着法、スパッタ法等の成膜法とエッチ
ング法を組み合わせることにより、所望の本数、厚さ、
幅及び間隔で形成することができる。
【００１３】本ＰＤＰは、隣接する表示電極間に面放電
による表示ラインが設定され、表示ラインとアドレス電
極との交差部にセルが設定される。そして、点灯すべき
セルを選択するためのアドレス放電を発生させる際に、
隣り合う２行の表示ラインで一本の表示電極がスキャン
電極として共用される電極構造となっている。
【００１４】以下、図面に示す実施の形態に基づき本発
明を説明するが、本発明はこれに限定されるものではな
く、種々の変更が可能である。
【００１５】図１は本発明の駆動方法が適用されるＡＬ
ｉＳ構造のＰＤＰを部分的に示す斜視図である。このＰ
ＤＰは、カラー表示用のＡＣ型３電極面放電構造のＰＤ
Ｐであり、全体的には、一対の基板間に複数の表示電極
が配置され、それらの表示電極と交差する方向に複数の
アドレス電極が配置された構造となっている。
【００１６】ＰＤＰ１０は、前面側の基板１１を含む前
面側のパネルアセンブリと、背面側の基板２１を含む背
面側のパネルアセンブリから構成されている。前面側の
基板１１と背面側の基板２１はガラスで形成されてい
る。
【００１７】前面側の基板１１の内側面には、画面の列
方向に平行に複数の表示電極Ｘ，Ｙが隣接する電極間で
面放電を発生できるよう等間隔に配列されている。これ
らの表示電極Ｘ，Ｙは、隣接する表示電極Ｘ（Ｘ電極と
もいう）と表示電極Ｙ（Ｙ電極ともいう）との間で表示
用の面放電を発生させるものである。この面放電は、表
示用の放電であるため一般に表示放電と呼ばれるが、点
灯を維持するための放電であるため、維持放電またはサ
スティン放電とも呼ばれる。また、この意味で表示電極
は、維持電極またはサスティン電極とも呼ばれる。
【００１８】表示電極Ｘ，Ｙは、ＩＴＯ、ＳｎＯ2 など
の幅の広い透明電極１２と、電極の抵抗を下げるため
の、例えばＡｇ、Ａｕ、Ａｌ、Ｃｕ、Ｃｒ及びそれらの
積層体（例えばＣｒ／Ｃｕ／Ｃｒの積層構造）等からな
る金属製の幅の狭いバス電極１３から構成されている。
表示電極Ｘ，Ｙは、Ａｇ、Ａｕについては印刷法を用
い、その他については蒸着法、スパッタ法等の成膜法と
エッチング法を組み合わせることにより、所望の本数、
厚さ、幅及び間隔で形成する。アドレシングの際には、
表示電極Ｙがスキャン電極として用いられる。
【００１９】透明電極１２は、ベルト形状であるもの
や、放電セル対応部のみ幅を広くしたもの、放電セルご
とに分離されバス電極で共通接続されるものなどが使用
できる。
【００２０】誘電体層１７は、例えば、低融点ガラスフ
リットにバインダと溶剤を加えたガラスペーストを、前
面側の基板１１上にスクリーン印刷法で塗布し、焼成す
ることにより形成する。
【００２１】誘電体層１７の上には、表示の際の放電に
より生じるイオンの衝突による損傷から誘電体層１７を
保護するための保護膜１８が設けられる。この保護膜１
８は、例えば、ＭｇＯ、ＣａＯ、ＳｒＯ、ＢａＯ等から
なる。
【００２２】背面側の基板２１の内側面には、表示電極
Ｘ，Ｙと直交するように、画面の行方向に平行に複数の
アドレス電極Ａ（Ａ電極ともいう）が形成されている。
これらのアドレス電極Ａは、スキャン用の表示電極との
交差部でアドレス放電を発生するものであり、例えばＡ
ｇ、Ａｕ、Ａｌ、Ｃｕ、Ｃｒ及びそれらの積層体（例え
ばＣｒ／Ｃｕ／Ｃｒの積層構造）等から構成される。ア
ドレス電極Ａも、表示電極Ｘ，Ｙと同様に、Ａｇ、Ａｕ
については印刷法を用い、その他については蒸着法、ス
パッタ法等の成膜法とエッチング法を組み合わせること
により、所望の本数、厚さ、幅及び間隔で形成する。誘
電体層２４は、誘電体層１７と同じ材料、同じ方法を用
いて形成される。
【００２３】隔壁２９は、アドレス電極Ａ間に対応する
位置の誘電体層２４上に、サンドブラスト法、印刷法、
フォトエッチング法等により形成する。例えば、低融点
ガラスフリット、バインダ、溶剤等からなるガラスペー
ストを誘電体層２４上に塗布して乾燥させた後、サンド
ブラスト法で切削して、焼成することにより形成するこ
とができる。また、バインダに感光性の樹脂を使用し、
マスクを用いた露光及び現像の後、焼成することにより
形成することも可能である。
【００２４】蛍光体層２８Ｒ，２８Ｇ，２８Ｂは、蛍光
体粉末とバインダとを含む蛍光体ペーストを隔壁２９間
の溝内にスクリーン印刷、又はディスペンサーを用いた
方法などで塗布し、これを各色毎に繰り返した後、焼成
することにより形成する。この蛍光体層２８Ｒ，２８
Ｇ，２８Ｂは、蛍光体粉末とバインダとを含むシート状
の蛍光体層材料（いわゆるグリーンシート）を使用し、
フォトリソ法で形成することもできる。この場合、所望
の色のシートを基板上の表示領域全面に貼り付けて、露
光、現像を行い、これを各色毎に繰り返すことで、対応
する隔壁間に各色の蛍光体層を形成することができる。
【００２５】ＰＤＰ１０は、上記した前面側のパネルア
センブリと背面側のパネルアセンブリとを、表示電極
Ｘ，Ｙとアドレス電極Ａとが直交するように対向配置
し、周囲を封止し、隔壁２９で囲まれた空間にネオンと
キセノンの混合ガスなどの放電ガスを充填することによ
り作製される。このＰＤＰ１０では、表示電極Ｘ，Ｙと
アドレス電極Ａとの交差部の放電空間が表示の最小単位
である１つのセル領域（単位発光領域）となる。
【００２６】図２は上述したＡＬｉＳ構造のＰＤＰを平
面的にみた状態を示す説明図である。この構造のＰＤＰ
では、上述したように、画面の列方向に表示電極Ｘn，
Ｙnが平行に配置され、それと直交して画面の行方向に
アドレス電極Ａが平行に配置され、アドレス電極Ａ間に
は隔壁２９がアドレス電極Ａと平行に配置されている。
表示電極の数は、画面の列方向の放電セルの数プラス１
本分、つまり表示ラインＬの数＋１本分配置され、アド
レス電極Ａの数は画面の行方向の放電セルの数と同じだ
け配置されている。
【００２７】表示ラインＬは、表示電極Ｘ1，Ｙ1間が第
１表示ラインＬ1、表示電極Ｙ1，Ｘ 2間が第２表示ライ
ンＬ2、表示電極Ｘ2，Ｙ2間が第３表示ラインＬ3、表示
電極Ｘn，Ｙn間が第（２ｎ−１）表示ラインＬ2n-1、表
示電極Ｘn，Ｙn+1間が第２ｎ表示ラインＬ2nとなる。
【００２８】図３は上述したＡＬｉＳ構造のＰＤＰの詳
細構成を示す部分拡大図である。この図に示すように、
表示放電は、隔壁２９と隔壁２９で挟まれた空間の表示
電極間で発生するため、隔壁２９で挟まれた表示電極
Ｘ，Ｙ間の放電領域が放電セルＣとなる。
【００２９】図４（ａ）および図４（ｂ）はカラー表示
のための階調駆動方式を示す説明図である。カラー表示
用のＰＤＰでは、一般的に次のような階調駆動方式で駆
動を行う。
【００３０】まず、動画を表示するための１フレームの
期間（多くの場合１／６０秒）を、輝度に重み付けをし
た複数のサブフレームで構成する。例えば２５６階調の
表示を行う場合には、１フレームをｓｆ1 ─ｓｆ8 の８
つのサブフレームで構成し、これらのサブフレームの表
示期間、つまりセルの放電回数を１：２：４：８：１
６：３２：６４：１２８の比に設定する。
【００３１】そして、各サブフレームを、表示領域内の
全てのセルの壁電荷を均一にするリセット期間ＴＲと、
点灯セルを選択するアドレス期間ＴＡと、選択されたセ
ルを輝度に応じた回数だけ放電（点灯）させる表示期間
ＴＳとで構成し、サブフレームの表示毎に、輝度に応じ
てセルを点灯させて、８つのサブフレームを表示するこ
とで、１フレームの表示を行う。図４（ｂ）では、輝度
の相対比が“３２”のサブフレームを示している。
【００３２】なお、表示のためのアドレス方式には、書
き込みアドレス方式と消去アドレス方式があり、書き込
みアドレス方式では、リセット期間ＴＲで全てのセルの
壁電荷を消去し、アドレス期間ＴＡで点灯すべきセルに
壁電荷を選択的に形成するアドレスを行い、表示期間Ｔ
Ｓに移行する。消去アドレス方式では、リセット期間Ｔ
Ｒでアドレス準備として全てのセルに壁電荷を形成し、
アドレス期間ＴＡで非点灯のセルの壁電荷を選択的に消
去するアドレスを行い、表示期間ＴＳに移行する。
【００３３】上述したＡＬｉＳ構造のＰＤＰでも、基本
的にはこのような階調駆動方式で駆動を行うが、ＡＬｉ
Ｓ構造のＰＤＰでは、点灯セルの選択のためにＹ電極を
スキャン電極として用いてスキャンパルスを印加する
際、奇数行の表示ラインＬ1,3, 5,... と偶数行の表示ラ
インＬ2,4,6,... とで、それぞれ一本のＹ電極が共用さ
れる。したがって、以下の駆動を行って２本の表示ライ
ンＬを選択する。
【００３４】図５は本発明によるＰＤＰの駆動方法の第
１実施形態の印加電圧波形を示す説明図である。ＡＬｉ
Ｓ構造のＰＤＰでは、スキャン電極として用いるＹ電極
と、スキャン電極として用いないＸ電極が交互に配置さ
れている。Ｙ電極はスキャンパルスを印加するため個別
の制御が可能となっている。Ｘ電極は、Ｘ電極のみに注
目して数えた配列順位が奇数であるか偶数であるかによ
って、第１組（以下Ｘodd 電極とする）と第２組（以下
Ｘeven電極とする）に分類し、第１組であるＸodd 電極
と第２組であるＸeven電極を、それぞれ共通に接続して
いる。
【００３５】そして、アドレス期間の前半でＸodd −Ｙ
電極間の表示ラインについてのアドレシングを行い、後
半でＸeven−Ｙ電極間の表示ラインについてのアドレシ
ングを行った後、全ての表示ラインを同時に表示する。
【００３６】具体的には、まず、リセット期間ＴＲを、
第１リセット期間ＴＲ1 と第２リセット期間ＴＲ2 とで
構成する。さらに第１リセット期間ＴＲ1 を、第１工程
ＴＲ1aと第２工程ＴＲ1bとで構成し、第２リセット期間
ＴＲ2 を、第１工程ＴＲ2aと第２工程ＴＲ2bとで構成す
る。
【００３７】また、アドレス期間ＴＡを、第１アドレス
期間ＴＡ1 と第２アドレス期間ＴＡ2 で構成する。表示
のアドレス方式は書き込みアドレス方式を用いる。表示
期間ＴＳについては、プログレッシブ形式の表示を行う
ので、全ての表示ラインを同時に表示する。
【００３８】第１リセット期間の第１工程ＴＲ1aにおい
ては、Ａ電極とＹ電極に、それぞれ図に示すような波形
の電圧を印加し、Ａ電極からＹ電極に向けて放電を発生
させ、Ｙ電極上に壁電荷を形成する。これにより、Ｘod
d −Ｙ電極間とＸeven−Ｙ電極間の全ての表示ライン
を、初期化のための放電を発生させないかぎり次のアド
レス期間で放電が発生しない電荷状態にする（以下これ
を「アドレス不能化」と定義する）。
【００３９】次に、第１リセット期間の第２工程ＴＲ1b
において、Ｘodd −Ｙ電極間で放電を発生させて、Ｙ電
極のＸodd 電極側の表示ラインのみを初期化し、その表
示ラインをアドレシング可能な状態にする。次に、第１
アドレス期間ＴＡ1 において、Ｘodd −Ｙ電極間で放電
を発生させ、Ｙ電極からみてＸodd 電極側に位置する表
示ラインのアドレシングを行う。
【００４０】次に、第１リセット期間の第１工程ＴＲ1a
と同様に、第２リセット期間の第１工程ＴＲ2aにおい
て、Ａ電極からＹ電極に向けて放電を発生させ、Ｙ電極
上に壁電荷を形成する。これにより、Ｘodd −Ｙ電極間
とＸeven−Ｙ電極間を、初期化のための放電を発生させ
ないかぎり次のアドレス期間で放電が発生しない電荷状
態にする（アドレス不能化）。
【００４１】次に、第２リセット期間の第２工程ＴＲ2b
において、Ｘeven−Ｙ電極間で放電を発生させて、Ｙ電
極のＸeven電極側の表示ラインのみを初期化し、その表
示ラインをアドレシング可能な状態にする。次に、第２
アドレス期間ＴＡ2 において、Ｘeven−Ｙ電極間で放電
を発生させ、Ｙ電極からみてＸeven電極側に位置する表
示ラインのアドレシングを行う。
【００４２】そして、共用のＹ電極からＸodd 電極とＸ
even電極の両方の電極に向けて電圧を印加して表示放電
を発生させた後、その逆にＸodd 電極とＸeven電極の両
方の電極から共用のＹ電極に向けて電圧を印加して表示
放電を発生させ、これを繰り返すことで、全ての表示ラ
インを同時に表示する。
【００４３】ここで、第２リセット期間の第１工程ＴＲ
2aでは、以下の条件を満たすようにする。 前半（第１アドレス期間ＴＡ1 ）にアドレス放電した
セルの電荷を、消去せずにそのまま維持して、表示放電
に利用できるようにする。 前半にアドレス放電しなかったセルを、後半（第２ア
ドレス期間ＴＡ2 ）で放電が発生しない電荷状態にす
る。 前半にアドレス放電しなかったセルに対し、表示放電
時に放電が発生するほどの電荷を蓄積しない。
【００４４】この条件は、前半と後半のアドレシングの
最初に、アドレシング時と同極性・同電圧の鈍波（傾斜
パルス）をＡ−Ｙ電極間に印加することによって実現で
きる。これは、次の理由による。まず、後半の第２リセ
ット期間の第１工程ＴＲ2aで印加する電圧は、前半のア
ドレシング時と同極性であるので、の条件は問題なく
満たす。
【００４５】また、アドレシングと同電圧で印加するた
め、次のアドレシングでは反応しない。よっての条件
を満たす。さらに、Ａ−Ｙ電極間に印加する鈍波のみで
は、表示放電が可能な電荷は蓄積されないので、の条
件も満たす。
【００４６】ここで、〜の条件を満たせば、第２リ
セット期間の第１工程ＴＲ2aでＹ電極に印加する電圧波
形は、鈍波である必要はない。例えば、Ａ−Ｙ電極間に
細幅パルスを印加してもよい。
【００４７】本実施形態では、Ｙ電極のＸodd 電極側の
アドレシングとＸeven電極側のアドレシングの内、Ｘod
d 電極側のアドレシングを先に行ったが、その逆にＸev
en電極側のアドレシングを先に行うようにしてもよい。
【００４８】また、第１リセット期間の第１工程ＴＲ1a
でも、第２リセット期間の第１工程ＴＲ2aに印加する電
圧波形と同様の電圧波形を印加しているが、駆動の可否
という点では、この電圧波形は印加する必要がない。な
ぜなら、第１アドレス期間ＴＡ1 で、Ｘeven−Ｙ電極間
で誤放電が発生しても、このＸeven−Ｙ電極間について
は、次の第２リセット期間の第１工程ＴＲ2aと第２工程
ＴＲ2bで初期化された後、改めて第２アドレス期間ＴＡ
2 でアドレシングが行われるからである。ただし、第１
アドレス期間ＴＡ1 でＸeven−Ｙ電極間で誤放電が発生
することによる背景発光の増加が問題になるため、第１
リセット期間の第１工程ＴＲ1aに、本実施形態のような
電圧波形を挿入することが望ましい。
【００４９】以上が第１実施形態の全体像であるが、こ
の第１実施形態のシーケンスと駆動波形についてより詳
細に説明しておく。なお、説明には上記第１実施形態の
説明と重複する部分もある。
【００５０】第１実施形態の詳細なシーケンスを図６に
示す。先述したように、第１実施形態のシーケンスは、
大きく分けて、第１リセット期間ＴＲ1 、第１アドレス
期間ＴＡ1 、第２リセット期間ＴＲ2 、第２アドレス期
間ＴＡ2 、およびサスティン期間ＴＳからなる。
【００５１】なお、先述した第１実施形態の全体説明で
は、第１リセット期間ＴＲ1 を、第１工程ＴＲ1aと第２
工程ＴＲ1bの２つのシーケンスで構成するよう説明した
が、詳細には、第２工程ＴＲ1bはさらに書き込みと電荷
調整との２つのシーケンスからなる。したがって、ここ
では、第１リセット期間ＴＲ1 を第１工程ＴＲ1a，第２
工程ＴＲ1b，第３工程ＴＲ1cの３つのシーケンスで構成
するものとして説明する。
【００５２】また、第２リセット期間ＴＲ2 も、第１工
程ＴＲ2aと第２工程ＴＲ2bの２つのシーケンスで構成す
るよう説明したが、詳細には、第２工程ＴＲ2bもさらに
書き込みと電荷調整との２つのシーケンスからなる。し
たがって、ここでは、第２リセット期間ＴＲ2 も第１工
程ＴＲ2a，第２工程ＴＲ2b，第３工程ＴＲ2cの３つのシ
ーケンスで構成するものとして説明する。
【００５３】全体の動作としては、先述したように、表
示電極Ｘを、それらのみ注目して数えた配列順位が奇数
か偶数かでＸodd 電極とＸeven電極に分け、Ｘodd 電極
を使用する表示ラインに対しては第１アドレス期間でア
ドレスを行い、Ｘeven電極を使用する表示ラインに対し
ては第２アドレス期間でアドレスを行った上で、サステ
ィン期間に全表示ラインを動作させることにより、プロ
グレッシブ表示を行う。
【００５４】第１リセット期間ＴＲ1 は、次の第１アド
レス期間ＴＡ1 におけるアドレス放電を正常に動作させ
るための準備期間である。第１アドレス期間ＴＡ1 で
は、Ｘodd 電極を使用する表示ラインに対してのみアド
レスを行う。したがって、第１リセット期間ＴＲ1 で
は、Ｘodd 電極を使用する表示ラインをアドレス放電が
可能な状態にし、Ｘeven電極を使用する表示ラインをア
ドレス放電が発生しない状態にする。
【００５５】まず、第１リセット期間の第１工程ＴＲ1a
において、全表示ラインをアドレス放電が不可能な電荷
状態にする（アドレス不能化）。その上で、Ｘodd 電極
を使用する表示ラインのみ、第２工程ＴＲ1bで書き込み
を行い、第３工程ＴＲ1cで電荷を調整し、アドレス放電
が可能な状態にする。この第２工程ＴＲ1bおよび第３工
程ＴＲ1cでは、Ｘeven電極を使用する表示ラインは反応
させず、アドレス放電が発生しない状態のままにする。
【００５６】次に、第１アドレス期間ＴＡ1 において、
Ｙ電極にスキャンパルスを上から順次印加し、Ａ電極に
アドレスパルスを印加することによりアドレスを行う。
第１アドレス期間ＴＡ1 は、Ｘodd 電極を使用する表示
ラインのみがアドレス放電可能な状態であるため、Ｙ電
極のＸodd 電極と隣接する表示ラインのみがアドレスさ
れる。アドレスされる表示ラインは順に表示ライン１，
４，５，８，９，…で、以下２ライン毎にアドレスされ
る。したがって、Ａ電極に印加されるアドレスパルスも
これらの順番に合わせる必要がある。
【００５７】第２リセット期間ＴＲ2 は、次の第２アド
レス期間ＴＡ2 におけるアドレス放電を正常に動作させ
るめの準備期間である。第２アドレス期間ＴＡ2 では、
第１アドレス期間ＴＡ1 とは逆に、Ｘeven電極を使用す
る表示ラインに対してのみアドレスを行う。よって、こ
の第２リセット期間ＴＲ2 では、第１リセット期間ＴＲ
1 の、Ｘodd 電極を使用する表示ラインとＸeven電極を
使用する表示ラインを逆にしたシーケンスとなる。
【００５８】第２アドレス期間ＴＡ2 は、第１アドレス
期間ＴＡ1 と同様、Ｙ電極にスキャンパルスを上から順
次印加し、Ａ電極にアドレスパスルを印加することによ
りアドレスを行うシーケンスである。第２アドレス期間
ＴＡ2 は、Ｙ電極のＸeven電極と隣接する表示ラインの
みがアドレス可能であるため、アドレスされる表示ライ
ンは順に表示ライン２，３，６，７，…で、以下２ライ
ン毎にアドレスされる。
【００５９】以上で、全ての表示ラインのアドレスが完
了する。この後、サスティン期間ＴＳで維持放電を行う
ことによって、プログレッシブ表示を行う。
【００６０】図７は詳細な駆動波形を示す説明図であ
る。本駆動波形は以下の電圧パルスで構成されている。 ・Ｘ電極に印加される、到達電圧Ｖq の鈍波パルスＰrx
1 ・Ｘ電極に印加される、電圧Ｖx の方形波パルスＰrx2 ・Ｘ電極に印加される、電圧Ｖs の方形波パルスＰrx3 ・Ｙ電極に印加される、到達電圧Ｖy の鈍波パルスＰry
1 ・Ｙ電極に印加される、到達電圧Ｖs の方形波パルスＰ
ry2 ・Ｙ電極に印加される、最低電圧Ｖy 、振幅Ｖscのスキ
ャンパルスＰy ・Ａ電極に印加される、電圧Ｖa の方形波パルスＰra ・Ａ電極に印加される、電圧Ｖa のアドレスパルスＰa ・Ｘ電極およびＹ電極に印加される、電圧Ｖs のサステ
ィンパルスＰs
【００６１】各電圧の典型例を次に示す。 Ｖq ＝−１４０Ｖ、Ｖx ＝９０Ｖ、Ｖs ＝１７０Ｖ、Ｖ
y ＝−１７０Ｖ、 Ｖsc＝１２０Ｖ、Ｖa ＝７０Ｖ
【００６２】第１リセット期間ＴＲ1 の第１工程ＴＲ1
a，第２工程ＴＲ1b，第３工程ＴＲ1cは以下のようにな
る。第１工程ＴＲ1a（アドレス不能化）は、パルスＰra
とパルスＰry1 で構成され、Ｘ電極はＸodd 電極および
Ｘeven電極ともに０Ｖ（接地レベル）である。パルスＰ
raとパルスＰry1 が印加された状態は、アドレス時にＡ
−Ｙ電極間に印加される電圧状態と同じであるため、第
１工程ＴＲ1aの後はアドレス放電が発生しない電荷状態
となる。パルス幅は１００マイクロ秒程度である。
【００６３】第２工程ＴＲ1b（Ｘodd 電極側のみの書き
込み）は、Ｘodd 電極はパルスＰrx1 、Ｘeven電極はパ
ルスＰrx3 、Ｙ電極はパルスＰry2 、Ａ電極は０Ｖで構
成される。ここで、Ｘodd 電極はＹ電極と逆極性であ
り、Ｘeven電極はＹ電極と同極性であるため、Ｘodd 電
極側のみ書き込まれる。パルス幅は１００マイクロ秒程
度である。
【００６４】第３工程ＴＲ1c（電荷調整）は、Ｘodd 電
極はパルスＰrx2 、Ｘeven電極は０Ｖ、Ｙ電極はパルス
Ｐry1 、Ａ電極は０Ｖで構成される。Ｘodd 電極側で、
第２工程ＴＲ1bで書き込まれた電荷がパルスＰrx2 およ
びパルスＰry1 で調整され、アドレスに適した電荷状態
となる。Ｘeven電極側は、第２工程ＴＲ1bで書き込まれ
ていないため、ここでは反応しない。パルス幅は１２０
マイクロ秒程度である。
【００６５】第１アドレス期間ＴＡ1 は、Ｘodd 電極は
パルスＰrx2 、Ｘeven電極は０Ｖ、Ｙ電極はパルスＰy
、Ａ電極はパルスＰa で構成され、Ｘodd 電極を使用
する表示ラインがアドレスされる。各スキャンパルスの
幅は１．２〜１．７マイクロ秒である。
【００６６】第２リセット期間ＴＲ2 は、第１リセット
期間ＴＲ1 のＸodd 電極とＸeven電極を入れ替えた波形
となり、Ｘeven電極のみをアドレスが可能な状態にす
る。第２アドレス期間ＴＡ2 は、Ｘeven電極はパルスＰ
rx2 、Ｘodd 電極は０Ｖ、Ｙ電極はパルスＰy 、Ａ電極
はパルスＰa で構成され、Ｘeven電極を使用する表示ラ
インがアドレスされる。各スキャンパルスの幅は１．２
〜１．７マイクロ秒である。
【００６７】サスティン期間ＴＳは、Ｘ電極およびＹ電
極に交互にパルスＰs を印加することによって維持放電
を行う。
【００６８】図８および図９は本発明によるＰＤＰの駆
動方法の第２実施形態を示す説明図である。図８は電圧
の印加パターンを示すブロック図であり、図９は印加電
圧波形を示している。本実施形態は、第１実施形態の変
形例であり、第１実施形態を簡略化した駆動方法であ
る。
【００６９】第１実施形態の駆動における、前半の第１
リセット期間の第１工程ＴＲ1aと第２工程ＴＲ1bの電圧
印加、つまり前半の初期化は必ずしも必要ではない。な
ぜなら、前サブフレーム（前回のサブフレーム）で後半
にアドレシングした表示ラインにおいては、前サブフレ
ームで表示放電しなかったセル（すなわちアドレス放電
しなかったセル）は、そのままアドレシングが可能であ
り、初期化は必要がないからである。
【００７０】前サブフレームで表示放電したセルは、表
示放電で蓄積された電荷を調整することによって、アド
レシングが可能なセルとなる。すなわち、この電荷の調
整では、Ａ−Ｙ電極間に生じる壁電圧を、Ａ−Ｙ電極間
の放電開始電圧からアドレス時のＡ−Ｙ電極間の印加電
圧を減じた値以上にし、かつ、Ｘ−Ｙ電極間に生じる壁
電圧を、Ｘ−Ｙ電極間の放電開始電圧から表示放電時の
Ｘ−Ｙ電極間の印加電圧を減じた値以下にする。
【００７１】この電荷の調整を行うことで、前サブフレ
ームで表示放電したセルがアドレシング可能なセルとな
るので、前サブフレームの後半にアドレスした表示ライ
ンを、次サブフレームの前半にアドレスすれば、前半の
初期化は電荷の調整のみで代用でき、初期化は後半のみ
でよい。
【００７２】このため、本実施形態では、サブフレーム
毎に、前半にアドレスする表示ライン（前半のアドレス
ライン）と後半にアドレスする表示ライン（後半のアド
レスライン）を入れ替えるようにしている。
【００７３】すなわち、奇数番目のサブフレーム（奇数
サブフレーム）で、前半にＸodd −Ｙ電極間を、後半に
Ｘeven−Ｙ電極間をアドレシングし、偶数番目のサブフ
レーム（偶数サブフレーム）で、前半にＸeven−Ｙ電極
間を、後半にＸodd −Ｙ電極間をアドレシングする。
【００７４】偶数番目のサブフレーム（偶数サブフレー
ム）における動作は次のようになる。Ｘodd −Ｙ電極間
は、第１リセット期間ＴＲ21において、前サブフレーム
（すなわち奇数サブフレーム）の表示放電時に、Ｘodd
電極が陽極の状態で終端されているため、前サブフレー
ムで点灯したセルはアドレシング時に反応しない電荷状
態となる。
【００７５】一方、前サブフレームで点灯しなかったセ
ルは、前サブフレームの第２リセット期間の第１工程Ｔ
Ｒ12a でアドレシングが行われない電荷状態となり、こ
の状態が継続している。したがって、Ｘodd −Ｙ電極間
は常にアドレシングが行われない電荷状態となる。
【００７６】また、Ｘeven−Ｙ電極間は、第１リセット
期間ＴＲ21において、前サブフレームの表示放電時に、
Ｘeven電極が陰極の状態で終端されているため、前サブ
フレームで点灯したセルはアドレシング時に反応する電
荷状態となる。ただし、この状態では、第１アドレス期
間ＴＡ21でアドレス放電が発生しなくても表示放電が可
能なほどの電荷が蓄積されているため、本実施形態のよ
うに鈍波パルスで電荷を減じることで、電荷の調整を行
う必要がある。
【００７７】一方、前サブフレームで点灯しなかったセ
ルは、前サブフレームの第２リセット期間の第２工程Ｔ
Ｒ12b でアドレシングが可能な電荷状態となり、この状
態が継続している。したがって、Ｘodd −Ｙ電極間は常
にアドレシングが可能な電荷状態となっている。第１ア
ドレス期間ＴＡ21以降は、第１実施形態と同様である。
【００７８】本実施形態のメリットは以下の点にある。 １サブフレーム中に初期化を行うのが第１実施形態の
半分ですむため、第１実施形態に比べ背景発光が半分に
なる。 前半の初期化が簡略化されるため、１サブフレームに
要する時間が短縮される。
【００７９】以上が第２実施形態の全体像であるが、こ
の第２実施形態のシーケンスと駆動波形についてより詳
細に説明しておく。なお、説明には上記第２実施形態の
説明と重複する部分もある。
【００８０】第２実施形態の詳細なシーケンスを図１０
に示す。先述したように、第２実施形態のシーケンス
は、サブフレームを奇数番目と偶数番目に分け、奇数サ
ブフレームと偶数サブフレームを交互に繰り返す。
【００８１】なお、先述した第２実施形態の全体説明で
は、奇数サブフレームの第２リセット期間ＴＲ12を、第
１工程ＴＲ12a と第２工程ＴＲ12b の２つのシーケンス
で構成するよう説明したが、詳細には、第２工程ＴＲ12
b はさらに書き込みと電荷調整との２つのシーケンスか
らなる。したがって、ここでは、奇数サブフレームの第
２リセット期間ＴＲ12を第１工程ＴＲ12a ，第２工程Ｔ
Ｒ12b ，第３工程ＴＲ12c の３つのシーケンスで構成す
るものとして説明する。
【００８２】また、偶数サブフレームの第２リセット期
間ＴＲ22も、第１工程ＴＲ22a と第２工程ＴＲ22b の２
つのシーケンスで構成するよう説明したが、詳細には、
第２工程ＴＲ22b もさらに書き込みと電荷調整との２つ
のシーケンスからなる。したがって、ここでは、偶数サ
ブフレームの第２リセット期間ＴＲ22も第１工程ＴＲ22
a ，第２工程ＴＲ22b ，第３工程ＴＲ22c の３つのシー
ケンスで構成するものとして説明する。
【００８３】それぞれのサブフレームは、第１実施形態
のサブフレームから、第１リセット期間ＴＲ1 のうち、
第１工程ＴＲ1aと第２工程ＴＲ1bを省略したシーケンス
をとる。また、奇数サブフレームと偶数サブフレームの
違いは、奇数サブフレームが、Ｘodd 電極を使用する表
示ラインを第１アドレス期間ＴＡ11でアドレスし、Ｘev
en電極を使用する表示ラインを第２アドレス期間ＴＡ12
でアドレスするのに対し、偶数サブフレームは、Ｘeven
電極を使用する表示ラインを第１アドレス期間ＴＡ21で
アドレスし、Ｘodd 電極を使用する表示ラインを第２ア
ドレス期間ＴＡ22でアドレスすることである。
【００８４】このようなシーケンスをとると、第２アド
レス期間でアドレスした表示ラインは、次のサブフレー
ムでは第１アドレス期間でアドレスすることになる。こ
のとき、第１リセット期間ＴＲ11，ＴＲ21のアドレス不
能化と書き込みのシーケンスを省略することが可能であ
る。その理由は次の通りである。
【００８５】偶数サブフレームの第１リセット期間ＴＲ
21が電荷調整のみでよい理由を以下に説明する。まず、
Ｘodd 電極を使用する表示ラインは、偶数サブフレーム
での第１アドレス期間ＴＡ21でアドレスが不可能な状態
である必要がある。ここで、奇数サブフレームの第１ア
ドレス期間ＴＡ11で、アドレス放電が発生しなかった場
合は、第２リセット期間ＴＲ12の第１工程ＴＲ12a でア
ドレス放電が不可能な状態になり、その後反応しないの
で、次の偶数サブフレームの第１リセット期間は不要で
ある。また、奇数サブフレームの第２アドレス期間ＴＡ
12で、アドレス放電が発生した場合は、サスティン期間
ＴＳ1 で放電するが、このサスティンをアドレスが不可
能な状態（具体的には、Ｘ電極が陽極となる状態）で終
わらせることによって、第１リセット期間が不要とな
る。
【００８６】次に、Ｘeven電極を使用する表示ライン
は、偶数サブフレームでの第１アドレス期間ＴＡ21でア
ドレスが可能な状態である必要がある。ここで、奇数サ
ブフレームの第２アドレス期間ＴＡ12で、アドレス放電
が発生しなかった場合（したがってサスティンでも放電
ない）は、そのままアドレス放電が可能な状態にあるの
で、次の偶数サブフレームの第１リセット期間は不要で
ある。また、奇数サブフレームの第２アドレス期間ＴＡ
12で、アドレス放電が発生した場合（したがってサステ
ィンで放電する）は、サスティン放電で生じた電荷を調
整するのみで、アドレス放電が可能な状態になる。
【００８７】以上より、偶数サブフレームの第１リセッ
ト期間ＴＲ21は電荷調整のみでよい。また、奇数サブフ
レームの第１リセット期間ＴＲ11においても同様のこと
がいえる。したがって、偶数サブフレームと奇数サブフ
レームの双方の第１リセット期間のアドレス不能化と書
き込みのシーケンスを省略することができる。
【００８８】図１１は詳細な駆動波形を示す説明図であ
る。第１実施形態と異なる点は、前述のように、奇数サ
ブフレームと偶数サブフレームで、第１と第２のアドレ
ス期間が入れ替わることと、第１リセット期間ＴＲ11お
よびＴＲ21が、電荷調整（第１実施形態におけるＴＲ1
c）のみで省略されていることである。
【００８９】奇数サブフレームの第１リセット期間ＴＲ
11は、Ｘodd 電極はパルスＰrx2 、Ｘeven電極は０Ｖ、
Ｙ電極はパルスＰry1 、Ａ電極は０Ｖで構成される。Ｘ
odd電極側で、前のサブフレームのサスティン放電時に
生じた電荷がパルスＰrx2 およびパルスＰry1 で調整さ
れ、アドレスに適した電荷状態となる。Ｘeven電極側は
反応しない。第１アドレス期間ＴＡ11は、第１実施形態
の第１リセット期間ＴＡ1 と同様であり、Ｘodd 電極を
使用する表示ラインがアドレスされる。
【００９０】第２リセット期間ＴＲ12は、第１実施形態
の第２リセット期間ＴＲ2 と同様であり、Ｘeven電極の
みをアドレスが可能な状態にする。第２アドレス期間Ｔ
Ａ12は、第１実施形態の第２アドレス期間ＴＡ2 と同様
であり、Ｘeven電極を使用する表示ラインがアドレスさ
れる。
【００９１】サスティン期間ＴＳ1 は、Ｘ電極およびＹ
電極に交互にパルスＰs を印加することによって維持放
電を行う。また、サスティンの最後は、次のサブフレー
ムの第１アドレス期間ＴＡ21においてＸodd 電極を使用
する表示ラインがアドレスしないように、Ｘodd 電極を
陽極で終わらせる。偶数サブフレームは、奇数サブフレ
ームのＸodd 電極とＸeven電極を入れ替えることにより
行う。
【００９２】図１２（ａ）〜図１２（ｄ）は本発明によ
るＰＤＰの駆動方法の第３実施形態を示す説明図であ
る。図１２（ａ）〜図１２（ｃ）は本実施形態で用いる
サブフレームＡ〜サブフレームＣの電圧の印加パターン
を示すブロック図であり、サブフレームＡ〜サブフレー
ムＣ内の各ブロックにおける印加電圧波形は、第２実施
形態で示したものと同じである。図１２（ｄ）は１フレ
ーム内のサブフレームの構成を示している。本実施形態
は第１実施形態と第２実施形態を組み合わせたものであ
る。
【００９３】一般に、ＡＣ型ＰＤＰは、１フレームを画
像表示の最小単位として制御することが多く、１フレー
ムを複数のサブフレームで構成する。前述したように、
１フレームを構成する時間は決まっており、多くの場
合、約１６．７ミリ秒（１／６０秒）であるが、１サブ
フレームを構成する時間は流動的である。なぜなら、電
力を制限するため表示放電のパルス数を変更する必要が
あるためである。
【００９４】したがって、１フレーム中にはサブフレー
ムの他に空白の時間が存在する。第２実施形態の駆動方
法は、前サブフレームの電荷を利用する駆動であるた
め、サブフレーム間で誤作動があると正常に機能しな
い。このため、サブフレーム間に空白の時間が存在する
と、電荷の消滅等で誤動作を起こす可能性がある。
【００９５】本実施形態は、この点を考慮したものであ
り、本実施形態では３種類のサブフレームを用いる。図
１２（ａ）で示すサブフレームＡは、第１実施形態の印
加電圧波形を有し、図１２（ｂ）で示すサブフレーム
Ｂ、および図１２（ｃ）で示すサブフレームＣは、第２
実施形態の印加電圧波形を有している。
【００９６】図１２（ｄ）に示すように、１フレーム中
のサブフレーム構成は、サブフレームＡを先頭に置く。
このサブフレームは、前の電荷がどのような状態でも正
常に機能する。以降、サブフレームＢとサブフレームＣ
を交互に繰り返す。フレーム内の空白は、フレームの最
後尾にあり、ここで誤放電が発生しても、次はサブフレ
ームＡであるので問題はない。
【００９７】本実施形態においては、フレームの空白部
で誤動作が生じても正常に機能するため、信頼性の高い
駆動が実現できる。また、第２実施形態では、各フレー
ムの波形が同一である時には、１フレーム中のサブフレ
ーム数が偶数に限定される。つまり１フレーム中のサブ
フレーム数が奇数である場合、１フレームの間でサブフ
レームＢもしくはサブフレームＣが連続するため、正し
く動作しなくなるが、本実施形態ではこの問題は生じな
い。
【００９８】図１３は本発明によるＰＤＰの駆動方法の
第４実施形態の印加電圧波形を示す説明図である。本実
施形態は第２実施形態の変形例である。第２実施形態で
は、前半の初期化のみを簡略化したが、本実施形態で
は、後半の初期化も簡略化した駆動を行う。この場合、
後半の初期化を簡略化すると、前サブフレームで表示放
電しなかったセルに対しては駆動できないが、前サブフ
レームで表示放電したセルに対しては駆動可能である。
【００９９】本実施形態の前半は第２実施形態と同様で
あるが、後半の第２リセット期間の第２工程ＴＲ2bは、
電荷調整のみである。すなわち、この電荷の調整では、
Ａ−Ｙ電極間に生じる壁電圧を、Ａ−Ｙ電極間の放電開
始電圧からアドレス時のＡ−Ｙ電極間の印加電圧を減じ
た値以上にし、かつ、Ｘ−Ｙ電極間に生じる壁電圧を、
Ｘ−Ｙ電極間の放電開始電圧から表示放電時のＸ−Ｙ電
極間の印加電圧を減じた値以下にする。
【０１００】この電荷の調整により、前サブフレームで
点灯したセルのみアドレシングが可能となる。ここで、
前サブフレームで表示放電しなかったセルは反応しない
ので、背景発光がなく、また、第２実施形態より時間が
短縮されるというメリットがある。
【０１０１】図１４は本発明によるＰＤＰの駆動方法の
第５実施形態の印加電圧波形を示す説明図である。本実
施形態は第４実施形態の変形例である。先述の第４実施
形態では、書き込み駆動方式を適用していたが、本実施
形態は第４実施形態に消去駆動方式を適用したものであ
る。消去駆動方式を適用すると、第４実施形態の後半の
第２リセット期間のパルスを反転パルスで代用すること
ができる。
【０１０２】本実施形態の前半は第２実施形態とほぼ同
様である。ただし、消去駆動を行うために、スキャン電
圧は低く設定される。後半においては、第４実施形態の
第２リセット期間の第１工程ＴＲ2aと第２工程ＴＲ2bが
省略され、図１４中の第２リセット期間ＴＲ2 で反転パ
ルスが加えられている。
【０１０３】第２リセット期間ＴＲ2 では、Ｘodd −Ｙ
電極間の極性を反転することにより、前半でアドレシン
グが可能であったセルを、後半でアドレシングが不可能
な電荷状態にするとともに、前半でアドレシングが不可
能であったセルを、後半でアドレシングが可能な電荷状
態にしている。
【０１０４】本実施形態も、第４実施形態と同様に、前
サブフレームで表示放電したセルのみアドレシングが可
能である。また、消去駆動であっても、背景発光が発生
するようなことはなく、また、第４実施形態よりさらに
時間が短縮されるというメリットを有する。
【０１０５】図１５（ａ）〜図１５（ｆ）は本発明によ
るＰＤＰの駆動方法の第６実施形態を示す説明図であ
る。図１５（ａ）〜図１５（ｅ）は本実施形態で用いる
サブフレームＡ〜サブフレームＥの電圧の印加パターン
を示すブロック図であり、図１５（ｆ）はサブフレーム
の構成を示している。
【０１０６】本実施形態は、第３実施形態から第５実施
形態までを組み合わせたものである。サブフレームＡ〜
サブフレームＣの電圧の印加パターンは第３実施形態で
示したものであり、サブフレームＤの電圧の印加パター
ンは第４実施形態で示したものであり、サブフレームＥ
の電圧の印加パターンは第５実施形態で示したものであ
る。
【０１０７】これらの実施形態は次のような例に適用で
きる。前述したように、通常、ＡＣ型ＰＤＰを階調駆動
するには、１フレームを輝度に重み付けをしたサブフレ
ームで構成する。例えば、輝度の重みを２のべき乗
（１，２，４，８，…）で構成すると、８つのサブフレ
ームで２５６階調を表現できる。
【０１０８】しかし、単純にこのような構成にすると疑
似輪郭の問題が生じるため、サブフレーム数を増やして
輝度の重みを分散する手法が取られている。ここで、同
じ輝度重みをもつサブフレームを連続して配置すること
も可能である。このような場合、前サブフレームが点灯
した時のみ、点灯させるサブフレームが存在するため、
第４実施形態または第５実施形態の電圧の印加パターン
を適用することができる。
【０１０９】例えば、図１５（ｆ）に示すような輝度重
みをもつサブフレーム（ＳＦ１〜ＳＦ１２）の配列があ
る場合、サブフレーム７（ＳＦ７）とサブフレーム８
（ＳＦ８）に、サブフレームＤまたはサブフレームＥの
電圧の印加パターンを適用することができる。
【０１１０】これらの電圧の印加パターンは、サブフレ
ーム６にも同様に適用可能であるが、疑似輪郭対策にお
いては、サブフレーム６が独立に点灯可能である方がよ
いので、本実施形態では、サブフレーム６はサブフレー
ムＢの電圧の印加パターンとしている。また、サブフレ
ームＤまたはサブフレームＥの電圧の印加パターンを適
用した後は、前サブフレームの影響を受けずに独立して
駆動する必要があるため、サブフレーム９（ＳＦ９）に
はサブフレームＡの電圧の印加パターンを適用してい
る。
【０１１１】このようにして、一本のスキャン電極が共
用される２行の表示ラインの内、一方をアドレシングが
可能な電荷状態にし、他方をアドレシングが発生しない
電荷状態にした上で、アドレシングを行うことにより、
ＡＬｉＳ構造のＰＤＰを、十分な駆動マージンを確保し
ながら、プログレッシブ形式で駆動することが可能とな
る。また、背景輝度が低く、より品位の高い表示を実現
することができる。
【０１１２】
【発明の効果】本発明によれば、隣り合う２行の表示ラ
インで一本のスキャン電極を共用する構造のＰＤＰにお
いて、アドレシングの信頼性の高いプログレッシブ表示
を実現することができる。
【図面の簡単な説明】
【図１】本発明の駆動方法が適用されるＡＬｉＳ構造の
ＰＤＰを部分的に示す斜視図である。
【図２】ＡＬｉＳ構造のＰＤＰを平面的にみた状態を示
す説明図である。
【図３】ＡＬｉＳ構造のＰＤＰの詳細構成を示す部分拡
大図である。
【図４】カラー表示のための階調駆動方式を示す説明図
である。
【図５】本発明によるＰＤＰの駆動方法の第１実施形態
の印加電圧波形を示す説明図である。
【図６】第１実施形態の詳細なシーケンスを示す説明図
である。
【図７】第１実施形態の詳細な駆動波形を示す説明図で
ある。
【図８】第２実施形態の電圧の印加状態を示すブロック
図である。
【図９】第２実施形態の印加電圧波形を示す説明図であ
る。
【図１０】第２実施形態の詳細なシーケンスを示す説明
図である。
【図１１】第２実施形態の詳細な駆動波形を示す説明図
である。
【図１２】第３実施形態を示す説明図である。
【図１３】第４実施形態の印加電圧波形を示す説明図で
ある。
【図１４】第５実施形態の印加電圧波形を示す説明図で
ある。
【図１５】第６実施形態を示す説明図である。
【符号の説明】
１０ ＰＤＰ １１ 前面側の基板 １２ 透明電極 １３ バス電極 １７，２４ 誘電体層 １８ 保護膜 ２１ 背面側の基板 ２８Ｒ，２８Ｇ，２８Ｂ 蛍光体層 ２９ 隔壁 Ａ アドレス電極 Ｃ 放電セル Ｌ 表示ライン Ｘ，Ｙ 表示電極
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/288 Ｇ０９Ｇ 3/28 Ｈ Ｈ０４Ｎ 5/66 １０１ Ｂ Ｅ (72)発明者 平川 仁 神奈川県川崎市高津区坂戸３丁目２番１号 富士通日立プラズマディスプレイ株式会 社内 Ｆターム(参考） 5C058 AA11 BA01 BB16 5C080 AA05 BB05 CC03 DD03 DD08 DD09 DD22 EE29 HH02 HH04 HH05 HH07 JJ04 JJ06

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 放電空間を形成する一対の基板間に複数
    の表示電極とそれらの表示電極と交差する複数のアドレ
    ス電極とを備え、隣接する表示電極間に面放電による表
    示ラインが設定されるとともに、表示ラインとアドレス
    電極との交差部にセルが設定され、点灯すべきセルを選
    択するためのアドレス放電を発生させる際に、隣り合う
    ２行の表示ラインで一本の表示電極がスキャン電極とし
    て共用される電極構造を有するプラズマディスプレイパ
    ネルの駆動方法であって、 一本のスキャン電極が共用される２行の表示ラインの
    内、一方側の第１の表示ラインをアドレス用の放電が発
    生しない電荷状態にし、他方側の第２の表示ラインをア
    ドレス用の放電が可能な電荷状態にした上で、第２の表
    示ラインにアドレス用の放電を発生させ、次に、第２の
    表示ラインをアドレス用の放電が発生しない電荷状態に
    し、第１の表示ラインをアドレス用の放電が可能な電荷
    状態にした上で、第１の表示ラインにアドレス用の放電
    を発生させ、その後、第１および第２の表示ラインで同
    時に面放電を発生させることでプログレッシブ表示を行
    うことを特徴とするプラズマディスプレイパネルの駆動
    方法。
  2. 【請求項２】 放電空間を形成する一対の基板間に複数
    の表示電極とそれらの表示電極と交差する複数のアドレ
    ス電極とを備え、隣接する表示電極間に面放電による表
    示ラインが設定されるとともに、表示ラインとアドレス
    電極との交差部にセルが設定され、点灯すべきセルを選
    択するためのアドレス放電を発生させる際に、隣り合う
    ２行の表示ラインで一本の表示電極がスキャン電極とし
    て共用される電極構造を有するプラズマディスプレイパ
    ネルの駆動方法であって、 １フレームを複数のサブフレームで構成するとともに、
    各サブフレームに、表示電極を一本おきにスキャン電極
    として用いてスキャン電極とアドレス電極間でアドレス
    放電を発生させるアドレス期間と、表示電極間で面放電
    を発生させる表示期間とを設定し、 スキャン電極として用いない表示電極を、それらの表示
    電極のみに注目して数えた配列順位が奇数であるか偶数
    であるかによって第１組と第２組に分類し、 アドレス期間の前半に、第１組と第２組の内の一方の表
    示電極を使用する表示ラインをアドレス用の放電が発生
    しない電荷状態にし、他方の表示電極を使用する表示ラ
    インをアドレス用の放電が可能な電荷状態にした上で、
    他方の表示電極を使用する表示ラインのみアドレス放電
    を発生させ、 アドレス期間の後半に、第１組と第２組の内の他方の表
    示電極を使用する表示ラインをアドレス用の放電が発生
    しない電荷状態にし、一方の表示電極を使用する表示ラ
    インをアドレス用の放電が可能な電荷状態にした上で、
    一方の表示電極を使用する表示ラインのみアドレス放電
    を発生させ、 その後、表示期間に全ての表示ラインで同時に面放電を
    発生させることでプログレッシブ表示を行うことを特徴
    とするプラズマディスプレイパネルの駆動方法。
  3. 【請求項３】 アドレス期間の前半に、第１組と第２組
    の内の一方の表示電極を使用する表示ラインをアドレス
    用の放電が発生しない電荷状態にし、他方の表示電極を
    使用する表示ラインをアドレス用の放電が可能な電荷状
    態にすることに代えて、 前回のサブフレームの表示期間に点灯したセルの壁電荷
    を、スキャン電極とアドレス電極との間でアドレス放電
    が可能でかつ表示電極間で面放電が発生しない電荷状態
    に調整することを特徴とする請求項２記載のプラズマデ
    ィスプレイパネルの駆動方法。
  4. 【請求項４】 アドレス期間の後半に、一方の表示電極
    を使用する表示ラインをアドレス用の放電が可能な電荷
    状態にすることに代えて、 前回のサブフレームの表示期間に点灯したセルの壁電荷
    を、スキャン電極とアドレス電極との間でアドレス放電
    が可能でかつ表示電極間で面放電が発生しない電荷状態
    に調整することを特徴とする請求項３記載のプラズマデ
    ィスプレイパネルの駆動方法。
  5. 【請求項５】 アドレス期間の後半に、第１組と第２組
    の内の他方の表示電極を使用する表示ラインをアドレス
    用の放電が発生しない電荷状態にすることに代えて、 スキャン電極上の壁電荷の極性を反転させることを特徴
    とする請求項４記載のプラズマディスプレイパネルの駆
    動方法。
  6. 【請求項６】 前半または後半のアドレス期間の最初に
    おいて、アドレス電極とスキャン電極との間にアドレス
    用の放電と同極性の電圧パルスを印加することで、全て
    の表示ラインをアドレス用の放電が発生しない電荷状態
    にすることを特徴とする請求項１記載のプラズマディス
    プレイパネルの駆動方法。
  7. 【請求項７】 １フレームの期間に、アドレス期間の前
    半で第１組の表示電極を共用する表示ラインのアドレス
    放電を発生させた後、アドレス期間の後半で第２組の表
    示電極を共用する表示ラインのアドレス放電を発生させ
    るサブフレームと、アドレス期間の前半で第２組の表示
    電極を共用する表示ラインのアドレス放電を発生させた
    後、アドレス期間の後半で第１組の表示電極を共用する
    表示ラインのアドレス放電を発生させるサブフレームと
    を、交互に繰り返すことを特徴とする請求項１記載のプ
    ラズマディスプレイパネルの駆動方法。
  8. 【請求項８】 １フレームの期間に、前回のサブフレー
    ムで表示放電を行ったセルのみにアドレス放電を発生さ
    せるサブフレームが含まれることを特徴とする請求項１
    記載のプラズマディスプレイパネルの駆動方法。
  9. 【請求項９】 １フレームの期間に、電荷を形成するた
    めにアドレス用の放電を発生させるサブフレームと、電
    荷を消去するためにアドレス用の放電を発生させるサブ
    フレームとが混在することを特徴とする請求項１記載の
    プラズマディスプレイパネルの駆動方法。
  10. 【請求項１０】 電荷を形成するために発生させるアド
    レス用の放電の印加電圧と、電荷を消去するために発生
    させるアドレス用の放電の印加電圧との値が、異なるこ
    とを特徴とする請求項９記載のプラズマディスプレイパ
    ネルの駆動方法。
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