JP2001156866A5 - - Google Patents
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Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000268273A JP3890867B2 (ja) | 1999-09-17 | 2000-09-05 | 受信機および送受信機 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11-262967 | 1999-09-17 | ||
| JP26296799 | 1999-09-17 | ||
| JP2000268273A JP3890867B2 (ja) | 1999-09-17 | 2000-09-05 | 受信機および送受信機 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2001156866A JP2001156866A (ja) | 2001-06-08 |
| JP2001156866A5 true JP2001156866A5 (enExample) | 2005-10-06 |
| JP3890867B2 JP3890867B2 (ja) | 2007-03-07 |
Family
ID=26545792
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000268273A Expired - Fee Related JP3890867B2 (ja) | 1999-09-17 | 2000-09-05 | 受信機および送受信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3890867B2 (enExample) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AU2002348700A1 (en) * | 2002-01-11 | 2003-07-24 | Agere Systems (Ireland) Research Limited | Timing control in data receivers and transmitters |
| KR100466589B1 (ko) * | 2002-02-18 | 2005-01-24 | 한국전자통신연구원 | 디지털 심볼 동기 장치 및 그 방법 |
| KR100435117B1 (ko) * | 2002-10-15 | 2004-06-11 | 에스케이텔레텍주식회사 | 외부기기와 통신을 위한 이동통신 단말기의 통신 타이밍획득방법 |
| JP4684641B2 (ja) * | 2004-12-17 | 2011-05-18 | 株式会社ネットインデックス | 移動無線装置及び送信タイミング制御方法 |
| JP4551249B2 (ja) | 2005-03-14 | 2010-09-22 | 株式会社エヌ・ティ・ティ・ドコモ | 移動通信端末 |
| KR101196256B1 (ko) | 2008-12-08 | 2012-11-05 | 한국전자통신연구원 | 송수신 신호 타이밍 클럭 동기화 장치 및 그 방법 |
| JP5063667B2 (ja) * | 2009-11-27 | 2012-10-31 | インターナショナル・ビジネス・マシーンズ・コーポレーション | 無線受信機、無線通信システム、無線通信方法およびプログラム |
| JP5631220B2 (ja) * | 2011-01-07 | 2014-11-26 | 三菱電機株式会社 | シンボル推定回路及び復調回路 |
| CN114839641B (zh) * | 2022-04-25 | 2025-12-12 | 安徽欧思微科技有限公司 | 测距方法、装置、接收设备及存储介质 |
-
2000
- 2000-09-05 JP JP2000268273A patent/JP3890867B2/ja not_active Expired - Fee Related
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