JP2000307458A - Ｐｌｌ内蔵チューナｉｃ - Google Patents

Ｐｌｌ内蔵チューナｉｃ

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JP2000307458A
JP2000307458A JP11113714A JP11371499A JP2000307458A JP 2000307458 A JP2000307458 A JP 2000307458A JP 11113714 A JP11113714 A JP 11113714A JP 11371499 A JP11371499 A JP 11371499A JP 2000307458 A JP2000307458 A JP 2000307458A
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frequency signal
band
signal
pll
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Hitoshi Saito
仁 斎藤
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    • H03J1/00—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general
    • H03J1/0008—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor
    • H03J1/0041—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor for frequency synthesis with counters or frequency dividers
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J2200/00—Indexing scheme relating to tuning resonant circuits and selecting resonant circuits
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Abstract

(57)【要約】 【課題】 一種類の受信部分でＩＦ周波数とＩＦ帯域幅
及び帯域特性を各国毎に整合させることができることを
課題とする。 【解決手段】 高周波信号を中間周波数信号に変換する
位相ロックループ（ＰＬＬ）内蔵チューナ集積回路（Ｉ
Ｃ）において、前記高周波信号と局部発振周波数とで前
記中間周波数信号を出力するミキサ回路と前記中間周波
数信号を増幅するＩＦアンプとの間に挿入する前記中間
周波数信号のバンドパスフィルタを可変バンドパスフィ
ルタとしてＩＣ上に形成し、前記中間周波数信号の中心
周波数と前記中間周波数信号の帯域をデータコントロー
ルにより設定することを特徴とする。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、高周波信号を中間
周波数信号に変換する位相ロックループ（ＰＬＬ）内蔵
チューナ集積回路（ＩＣ）に関し、特に複数のテレビ放
送方式に対応したＰＬＬ内蔵チューナＩＣに関する。
【０００２】
【従来の技術】従来、高周波周波数からミキサーを介し
て中間周波数に変換する受信機が一般的である。例え
ば、ＡＭ／ＦＭ受信機のチューナとして、特開昭６０−
２２３３３５号公報には、ＡＭ中間周波回路のバンドパ
スフィルタをスイッチド・キャパシタ・フィルタにて構
成し、スイッチド・キャパシタ・フィルタを駆動するク
ロック信号をＰＬＬシンセサイザーの基準周波数発振器
の出力信号にもとづき得るように構成したことが記載さ
れている。特に、ＡＭ受信機の中間周波数が一般に４５
５ｋＨｚという低い周波数なので、中間周波数のバンド
パスフィルターとしては極めて大型のＬＣＲを用いざる
を得ず、それに代わるものとしてスイッチド・キャパシ
タ・フィルタを用いたものである。
【０００３】また、同公報には、ＡＭ受信機にＰＬＬシ
ンセサイザーを用いており、プリスケーラは基準周波数
信号ｆrefを１／Ｐに分周し、ｆref／Ｐの周波数信号を
位相比較器に供給し、プログラマブルデバイダには局部
発振器から周波数信号ｆAが供給され、プログラマブル
デバイダは１／Ｑの分周を行い、ｆA／Ｑの周波数信号
が位相比較器に供給される。この位相比較器でｆref／
ＰとｆA／Ｑとにつき位相比較を行い、両者の位相差の
出力信号をＬＰＦを通して局部発振器に供給し、基準周
波数に従った局部発振器の局部発振周波数成分を得るこ
とができる。
【０００４】また、ＢＳ（衛星放送）およびＣＳ（通信
衛星）のＩＦ信号とＡＭ変調方式を採って伝送されるＶ
ＨＦ・ＵＨＦ帯でのチューナ回路として、特開平５−２
１８８９４号公報には、中間周波数に６ＭＨｚのＣＡＴ
Ｖ信号に、１２ＭＨｚのハイビジョン信号に、２７ＭＨ
ｚのＢＳ信号などを受信するため、容易にフィルタの帯
域幅を可変できるスイッチドフィルタと、２個の周波数
変換器をシリーズに接続した１パスをＮ個並列に接続
し、それぞれのＮ種類の局部発振周波数を供給するＮパ
スフィルターとを接続して、複数の中間周波数の通過帯
域周波数に対応したことが記載されている。
【０００５】また、従来のＰＬＬ内蔵チューナＩＣの構
成として、本出願人が出願している特願平０９−２６６
４６７号に開示した構成を図５に示す。同出願明細書と
図面には、ミキサ１１とＩＦアンプ１３間のバンドパス
フィルタ３４を外付けにて構成していた。このバンドパ
スフィルタ３４はミキサー１１の２端子出力間に同調周
波数を可変できるＬＣ回路でバンドパスフィルタとして
いる。また、ＰＬＬ内蔵チューナＩＣには、ユーザが受
信希望局を選局した選局データを入力するデータインタ
ーフェース２３から、プログラムカウンタ１６による分
周比、と水晶３１を含む水晶発振器１８の基準発振周波
数を分周するリファレンスカウンタ１７による分周比と
を供給される。位相比較器１９はプログラムカウンタ１
６とリファレンスカウンタ１７との出力の位相差を検出
し、チャージポンプ２０により直流成分に変換され、チ
ューニングアンプ２１を介して電圧可変制御発振器（Ｖ
ＣＯ）３０の発振周波数を制御する。ＶＣＯ３０の出力
は局部発振周波数部１４に供給され、局部発振周波数部
１４からミキサ１１に供給されると共に、プリスケーラ
１５によって局部発振周波数部１４の周波数成分をプロ
グラムカウンタ１６が動作できる周波数に分周変換す
る。こうして、ＶＣＯ３０を含む周波数一定とするＰＬ
Ｌ回路が構成される。
【０００６】
【発明が解決しようとする課題】ところで、ＵＨＦやＶ
ＨＦのテレビジョン受像機では、図２の表に示すよう
に、ＩＦ信号の中心周波数とチャンネル帯域幅は、各国
毎の仕様が決められており、チューナパックの製造時に
外付けバンドパスフィルタを各国の仕向け地先のＩＦ周
波数に合うように外部調整する工程が必要となってい
る。特に、テレビジョン放送を受信する場合、日本では
ＩＦ周波数を５８．７５ＭＨｚ、チャンネル帯域を６Ｍ
Ｈｚ、米国ではＩＦ周波数を４５．７５ＭＨｚ、チャン
ネル帯域を６ＭＨｚ、ドイツではＩＦ周波数を３８．９
ＭＨｚ、チャンネル帯域を７ＭＨｚとして規定化されて
いる。従って、各国毎にＩＦ周波数とＩＦ帯域幅と、そ
のバースト特性や音声周波数特性を整合した帯域特性を
選択しなければならない。
【０００７】また仕向け地別にチューナの仕様を変更す
る必要があるため、品種数が多くなり、設計・開発効率
が悪いという問題がある。また外付け部品が多くなりコ
ストがアップする。
【０００８】本発明は、上記問題点を解消するために、
一種類の受信部分でＩＦ周波数とＩＦ帯域幅及び帯域特
性を各国毎に整合させることができることを課題とす
る。
【０００９】
【課題を解決するための手段】本発明は、高周波信号を
中間周波数信号に変換する位相ロックループ（ＰＬＬ）
内蔵チューナ集積回路（ＩＣ）において、前記高周波信
号と局部発振周波数とで前記中間周波数信号を出力する
ミキサ回路と前記中間周波数信号を増幅するＩＦアンプ
との間に挿入する前記中間周波数信号のバンドパスフィ
ルタを可変バンドパスフィルタとしてＩＣ上に形成し、
前記中間周波数信号の中心周波数と前記中間周波数信号
の帯域をデータコントロールにより設定することを特徴
とする。
【００１０】また、本発明は、高周波信号を中間周波数
信号に変換する位相ロックループ（ＰＬＬ）内蔵チュー
ナ集積回路（ＩＣ）において、前記高周波信号と局部発
振周波数とで前記中間周波数信号を出力するミキサ回路
と、前記中間周波数信号を増幅するＩＦアンプと、前記
ミキサ回路とＩＦアンプとの間に挿入する前記中間周波
数信号の中心周波数と帯域幅を可変する可変バンドパス
フィルタと、前記可変バンドパスフィルタに複数のバイ
アスを供給する信号コンバータと、前記信号コンバータ
に制御データを供給するデータインターフェイスと、前
記ミキサ回路に局部発振周波数を供給する局部発振器
と、前記局部発振周波数を分周するプリスケーラと、前
記データインターフェイスにより分周比を設定されるプ
ログラムカウンタと、前記データインターフェイスによ
り分周比を設定されるリファレンスカウンタと、前記プ
ログラムカウンタの出力と前記リファレンスカウンタと
の位相差を出力する位相比較器と、前記位相比較器の出
力をＤＣ電圧に変換するチャージポンプと、前記チャー
ジポンプの出力を外付け電圧制御発振器（ＶＣＯ）の制
御電圧に変換するチューニングアンプと、前記にチュー
ニングアンプの出力に応じて発振周波数を可変する外付
け電圧制御発振器と、前記電圧制御発振器に接続される
局部発振器とからなることを特徴とする。
【００１１】また、本発明の特徴を概説すれば、ＰＬＬ
内蔵チューナＩＣにおいて、ミキサ回路とＩＦアンプ間
に挿入するＩＦ信号のバンドパスフィルターを可変バン
ドパスフィルタとしてＩＣ上に形成し、ＩＦ中心周波
数、およびＩＦ帯域をデータコントロールにより設定す
ることを特徴とする。
【００１２】
【発明の実施の形態】本発明による実施形態について、
図面を参照しつつ詳細に説明する。
【００１３】（１）構成の説明 図１に本発明の実施形態による構成ブロック図を示す。
本実施形態のＰＬＬ内蔵チューナＩＣは、複数のテレビ
方式における中間周波数信号の中心周波数と、その帯域
幅を異にする場合に、同一の当該チューナＩＣで対応で
きる構成とするものである。ＰＬＬ内蔵チューナＩＣ
は、ミキサ１１、可変バンドパスフィルタ（ＢＰＦ）１
２、ＩＦアンプ１３、局部発振器１４よりなるアナログ
チューナ部と、データインターフェイス２３、プリスケ
ーラ１５、プログラムカウンタ１６、リファレンスカウ
ンタ１７、クリスタル発振器１８、位相比較器１９、チ
ャージポンプ２０、チューニングアンプ２１からなるＰ
ＬＬ部と、データインターフェイス２３から可変バンド
パスフィルタ（ＢＰＦ）１２の中心周波数と帯域幅とを
制御する信号コンバータ２２とから構成される。
【００１４】外付け部品として、クリスタル発振子３１
が本ＩＣのクリスタル発振器１８の入力端子に接続され
る。チューニングアンプの出力電圧により制御される、
外付け電圧制御発振器（ＶＣＯ）回路３０が局部発振器
１４に接続される。
【００１５】ＰＬＬ選局信号はクロック信号がＣＬＫ端
子に、データ信号がＤＡ端子に、イネーブル信号がＥＮ
端子に入力される。可変バンドパスフィルタ１２はＬＣ
Ｒ共振器もしくはアクティブフィルタである。
【００１６】図３に可変バンドパスフィルタ１２の構成
例を示す。ＬＣＲタイプではＩＣ基板上にＩＦ信号入力
に直列抵抗Ｒ１が接続され、この抵抗Ｒ１の他端にイン
ダクタンスＬと、可変容量Ｃとしてのバラクタダイオー
ドとを並列に接続し、出力側に直列抵抗Ｒ２がバイアス
１を印加して出力とし、可変抵抗としてゲートにバイア
ス２を印加したＦＥＴＱ１を形成する。
【００１７】また、図４に示すアクティブフィルタは、
ローパスフィルタＬＰＦとハイパスフィルタＨＰＦとを
直列に接続し、バンドパスフィルタを構成する。ローパ
スフィルタＬＰＦは直列抵抗Ｒ３と整合抵抗Ｒ４とバラ
クタダイオードＣ１とバイアス１でゲインを変化する可
変利得オペアンプＱ２と帰還用バラクタダイオードＣ２
とで構成され、ローパスフィルタＬＰＦとハイパスフィ
ルタＨＰＦ間に結合バラクタダイオードＣ３を配置し、
ハイパスフィルタＨＰＦは直列バラクタダイオードＣ４
と基準電位に接続した接地抵抗Ｒ５とバイアス２でゲイ
ンを変化する可変利得オペアンプＱ３と帰還用抵抗Ｒ６
とにより構成されている。
【００１８】この可変バンドパスフィルタ１２及びアク
ティブ型バンドパスフィルタ１２の中心周波数と帯域
は、可変容量Ｃとしてのバラクタダイオードへのバイア
ス１とＦＥＴＱ１へのバイアス２とにより、また各アク
ティブフィルタのゲインと可変容量をバイアス１，２と
で制御することで行う。可変容量Ｃ１乃至Ｃ４はバラク
タダイオードで形成する。
【００１９】また、図１に示すチューニングアンプ２１
は、チャージポンプ２０によって位相誤差に応じたＤＣ
電圧をＶＣＯ３０の共振回路のバラクタに適切な電圧に
変換するものであり、リファレンスカウンタ１７はＸ't
al発振器１８の水晶発振周波数を所定の基準発振周波数
に変換する分周比を決定するカウンタである。
【００２０】（２）動作の説明 図１において、ＲＦ入力に入力されるＲＦ信号はミキサ
１１により中間周波数ＩＦに変換される。ＩＦ信号はＩ
Ｆバンドパスフィルタ１２を通過後、ＩＦアンプ１３に
て増幅されて、ＩＦ端子に出力される。通常ＩＦ端子出
力はＩＦ増幅器により増幅し、復調検波回路によってベ
ースバンド信号に変換される。
【００２１】局部発振器１４の発振周波数はＰＬＬ回路
によりコントロールされる。ＰＬＬ回路へは局部発振器
１４の発振周波数設定データ（選局データ）ＤＡが送ら
れる。設定データはプログラムカウンタ１６とリファレ
ンスカウンタ１７の分周比設定データで構成される。
【００２２】ＰＬＬ回路は、基準周波数をリファレンス
カウンタ１７から得られ、水晶振動子３１の共振周波数
によって安定した発振周波数を得て、リファレンスカウ
ンタで基準周波数を得るように分周される。この基準周
波数とプログラマブルカウンタ１６からの周波数とを位
相比較器１９で比較され、チャージポンプ２０でその位
相差に応じたＤＣ電圧に変換され、チューニングアンプ
２１でそのＤＣ電圧を制御電圧に電圧変換してＶＣＯ３
０を励起する。ＶＣＯはバラクタダイオードと並列キャ
パシタ、共振コイル等からなり、チューニングアンプ２
１からの制御電圧に応じた共振周波数を変化する。この
ＶＣ３０と局部発振器１４とで発振回路を構成する。局
部発振器１４の発振周波数信号はミキサ１１に供給され
ると共にプリスケーラ１５に供給されて、発振周波数よ
りも低い周波数に分周されて、プログラマブルカウンタ
１６によってデータインターフェース２３からの制御に
よる所定の分周比で分周される。
【００２３】本実施形態では、分周比設定データに追加
して、ＩＦバンドパスフィルタ１２の中心周波数および
帯域を決定するデータが送られる。データ設定の一例を
図２に示す。データインターフェイスから設定データが
信号コンバータ２２に送られ、信号コンバータ２２は予
め決定されたバイアス信号を出力し、ＢＰＦの通過帯域
特性、中心周波数を制御する。ＬＣＲ型ＢＰＦの場合、
図３のバイアス１、バイアス２を制御することにより、
バラクタダイオードＣの容量値、ＦＥＴＱ１の線形状態
のＯＮ抵抗を制御することにより行う。
【００２４】また、図４に示すアクティブフィルタ型可
変バンドパスフィルタの場合、バイアス１で可変利得オ
ペアンプＱ２のゲインを変化することによりローパスフ
ィルタの通過周波数を変化し、バラクタダイオードＣ
１，Ｃ２，Ｃ３の容量を可変利得オペアンプＱ２の入力
バイアスと出力バイアスとで可変して、中心周波数と、
通過周波数特性を変化して通過帯域特性を制御してい
る。また、バイアス２で可変利得オペアンプＱ３のゲイ
ンを変化することによりハイパスフィルタの通過周波数
を変化し、バラクタダイオードＣ４の容量を可変利得オ
ペアンプＱ３の出力バイアスとで可変して、通過周波数
特性を変化して帯域特性を制御している。
【００２５】このように、ＢＰＦ１２の構成で、アクテ
ィブフィルタ１２の場合、図４のバイアス１、バイアス
２を制御することにより、オペアンプＱ２，Ｑ３のゲイ
ンおよび、バラクタダイオードＣ１乃至Ｃ４のバイアス
を変更して容量を変更することで行う。
【００２６】また、データインターフェイス２３から制
御信号を供給される信号コンバータ２２は、可変バンド
パスフィルタ１２の中心周波数と帯域幅特性を変化する
バイアス１，２に供給するＢＰＦ制御信号にコンバート
して出力する。信号コンバータ２２内には、Ａ／Ｄ変換
器を備え、デジタル信号の００もしくは０１等を簡単な
このデジタル−アナログ変換器（Ａ／Ｄコンバータ）で
アナログ電圧に変換し、可変ＢＰＦの制御信号端子（バ
イアス１、バイアス２）に接続する。
【００２７】ここで、例えば、図２に示す日本と米国Ｕ
ＳのＩＦ周波数とチャンネル帯域とに応じて、制御デー
タとしてＩＦ中心周波数に”００”，”０１”と、チャ
ンネル帯域に”００”，”００”を供給して、信号コン
バータ２２によってＩＦ中心周波数に５８．７５ＭＨｚ
と４５．７５ＭＨｚとに調整され、チャンネル帯域を６
ＭＨｚとなるバイアス１，２を供給する制御信号に変換
する。他のドイツ及び中国向けの場合も同様に、ＩＦ中
心周波数とチャンネル帯域についても、データインター
フェース２３から信号コンバータ２２に制御データをそ
れぞれ供給され、バイアス１，２に適切なバイアス信号
となる制御信号に変換して供給し、所望のＩＦ中心周波
数とチャンネル帯域特性を得ている。
【００２８】また、ＶＣＯ３０と局部発振器１４の関係
は、局部発振器１４はＩＣ上に構成される発振用のトラ
ンジスタ回路であり、本発明でいうＶＣＯ３０は、前記
局部発振器１４に外部接続される可変容量としてのバラ
クタダイオードやコイルよりなる、共振回路を指してお
り、バラクタダイオードのバイアスを図１のチューニン
グアンプ２１の出力電圧で制御することにより発振周波
数をコントロールする。なお、このＶＣＯと局部発振器
とは、ＩＣパッケージの内外を明示するために便宜上区
別したものである。
【００２９】
【発明の効果】本発明によれば、従来のチューナパック
の製造時に外付けバンドパスフィルタを各国の仕向け地
先のＩＦ周波数に合うように、外部調整していた工程が
不要となる。ＩＦ出力の同調特性を、出力周波数、帯域
をすべてデータによりコントロールすることが可能とな
り、汎用性が増すためコストダウンが可能となる。また
従来の外付け部品をＩＣ化することによりチューナパッ
クの小型化が可能となり、部品のバラツキを小さくで
き、ＰＬＬ内蔵チューナＩＣの信頼性を向上する。
【図面の簡単な説明】
【図１】本発明のＰＬＬ内蔵チューナＩＣとその周辺の
構成ブロック図である。
【図２】本発明のＰＬＬ内蔵チューナＩＣに用いる中心
周波数と帯域の説明図である。
【図３】本発明のＰＬＬ内蔵チューナＩＣのバンドパス
フィルタの構成図である。
【図４】本発明のＰＬＬ内蔵チューナＩＣのバンドパス
フィルタの構成図である。
【図５】従来のＰＬＬ内蔵チューナＩＣの構成ブロック
図である。
【符号の説明】
１０ＰＬＬ内蔵チューナＩＣ １１ミキサ １２可変バンドパスフィルタ（ＢＰＦ） １３ＩＦアンプ １４局部発振器 １５プリスケーラ １６プログラムカウンタ １７リファレンスカウンタ １８クリスタル発振器 １９位相比較器 ２０チャージポンプ ２１チューニングアンプ ２２信号コンバータ ２３データインターフェイス ３０外付け電圧制御発振器（ＶＣＯ）回路 ３１クリスタル発振子 ３４外付けＢＰＦ
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｈ０４Ｎ 5/50 Ｈ０３Ｌ 7/18 Ｂ Ｆターム(参考） 5C025 AA14 AA17 AA25 BA01 BA20 BA24 5C026 AA05 AA13 AA19 5J098 AA03 AA05 AA11 AA15 AA16 AB02 AB08 AC02 AC09 AC12 AC15 AC18 AC27 AD15 AD28 CA02 CA04 CA05 CB01 CB06 CB10 5J106 AA04 CC01 CC15 CC21 CC39 CC52 CC53 CC55 DD05 DD32 GG06 HH10 PP03 QQ12 RR04 5K020 AA02 BB09 DD12 DD15 EE04 GG04 GG06 GG07 GG09 GG10 GG11 HH06 HH13 LL00 MM02 MM11 MM12 MM13

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 高周波信号を中間周波数信号に変換する
    位相ロックループ（ＰＬＬ）内蔵チューナ集積回路（Ｉ
    Ｃ）において、前記高周波信号と局部発振周波数とで前
    記中間周波数信号を出力するミキサ回路と前記中間周波
    数信号を増幅するＩＦアンプとの間に挿入する前記中間
    周波数信号のバンドパスフィルタを可変バンドパスフィ
    ルタとしてＩＣ上に形成し、前記中間周波数信号の中心
    周波数と前記中間周波数信号の帯域特性をデータコント
    ロールにより設定することを特徴とするＰＬＬ内蔵チュ
    ーナＩＣ。
  2. 【請求項２】 請求項１に記載のＰＬＬ内蔵チューナＩ
    Ｃにおいて、前記可変バンドパスフィルタは複数のテレ
    ビ放送方式における前記中間周波数信号の中心周波数と
    前記中間周波数の帯域特性を異にする場合に対応して前
    記データコントロールにより設定することを特徴とする
    ＰＬＬ内蔵チューナＩＣ。
  3. 【請求項３】 請求項１又は２に記載のＰＬＬ内蔵チュ
    ーナＩＣにおいて、前記可変バンドパスフィルタはバラ
    クタダイオードを用いたＬＣＲ型可変バンドパスフィル
    タ、又はアクティブ型可変バンドパスフィルタであるこ
    とを特徴とするＰＬＬ内蔵チューナＩＣ。
  4. 【請求項４】 高周波信号を中間周波数信号に変換する
    位相ロックループ（ＰＬＬ）内蔵チューナ集積回路（Ｉ
    Ｃ）において、前記高周波信号と局部発振周波数とで前
    記中間周波数信号を出力するミキサ回路と、前記中間周
    波数信号を増幅するＩＦアンプと、前記ミキサ回路と前
    記ＩＦアンプとの間に挿入する前記中間周波数信号の中
    心周波数と帯域幅を可変する可変バンドパスフィルタ
    と、前記可変バンドパスフィルタに複数のバイアスを供
    給する信号コンバータと、前記信号コンバータに制御デ
    ータを供給するデータインターフェイスと、前記ミキサ
    回路に局部発振周波数を供給する局部発振器と、前記局
    部発振周波数を分周するプリスケーラと、前記データイ
    ンターフェイスにより分周比を設定されるプログラムカ
    ウンタと、前記データインターフェイスにより分周比を
    設定されるリファレンスカウンタと、前記プログラムカ
    ウンタの出力と前記リファレンスカウンタとの位相差を
    出力する位相比較器と、前記位相比較器の出力をＤＣ電
    圧に変換するチャージポンプと、前記チャージポンプの
    出力を外付け電圧制御発振器（ＶＣＯ）の制御電圧に変
    換するチューニングアンプと、前記にチューニングアン
    プの出力に応じて発振周波数を可変する外付け電圧制御
    発振器と、前記電圧制御発振器に接続される局部発振器
    とからなることを特徴とするＰＬＬ内蔵チューナＩＣ。
  5. 【請求項５】 請求項４に記載のＰＬＬ内蔵チューナＩ
    Ｃにおいて、前記可変バンドパスフィルタはバラクタダ
    イオードを用いたＬＣＲ型可変バンドパスフィルタ、又
    はアクティブ型可変バンドパスフィルタであることを特
    徴とするＰＬＬ内蔵チューナＩＣ。
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