DE69735919T2 - Ein verfahren zur herstellung einer monolithischen mikrowellenschaltung mit dicken leitern - Google Patents
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Description
- HINTERGRUND DER ERFINDUNG
- 1. Gebiet der Erfindung
- Die vorliegende Erfindung bezieht sich auf ein Verfahren zur Herstellung einer monolithischen, integrierten Mikrowellenschaltung (MMIC) mit leitenden Elementen für integrierte, passive Bauelemente.
- 2. Beschreibung des verwandten Standes der Technik
- Die Herstellung einer Halbleiterschaltung ist ein kompliziertes Verfahren. Dieses wird sogar noch komplizierter, wenn eine monolithische Mikrowellenschaltung mit einem oder mehreren passiven Bauelementen in eine MMIC zu integrieren ist. Jeder Kondensator macht zum Beispiel Mehrebenenleiterplatten, jeder Widerstand eine Schicht aus Material mit einer vorgegebenen Leitfähigkeit sowie mit vorgegebenen Dimensionen und jeder Induktor einen Metallleiter von hoher Qualität erforderlich. Der Begriff „leitend", wie hier verwendet, ist so zu interpretieren, dass er sowohl Materialien mit höherer Leitfähigkeit, wie zum Beispiel Metalle, als auch Materialien mit geringerer Leitfähigkeit, wie zum Beispiel dotierte Halbleiter, umfasst.
- Des Weiteren sollten zur Minimierung von elektrischen Verlusten auf Mikrowellenfrequenzen dicke Metallleiter zur Herstellung elektrischer Verbindungen mit den passiven Bauelementen sowie für die Induktorwicklungen verwendet werden. Der Begriff „dick", wie hier für eine Metallleiterschicht verwendet, ist so zu interpretieren, dass hiermit eine Schichtdicke von mindestens zweimal der Skintiefe des Metallleiters auf der höchsten Mikrowellenbetriebsfrequenz von, von dem Leiter geführten Signalen gemeint ist.
- Bekannte Verfahren zur Ausbildung leitender Elemente in integrierten Schaltkreisen sind übermäßig kompliziert, oder es können mit diesen keine integrierten Schaltkreise hergestellt werden, welche zum Betrieb auf Mikrowellenfrequenzen gänzlich geeignet sind. Zum Beispiel offenbart
US 4 789 648 ein offensichtlich einfaches Verfahren zur Herstellung von Mehrebenen-Metall/Isolatorschichten auf einem Substrat und zur Ausbildung von strukturierten, Strom leitenden Leitungen gleichzeitig mit Leitungen, bei denen ein Verbindungsstift verwendet wird (connecting stud lines). Jedoch ist es mit Schwierigkeiten verbunden, eine, in dem Verfahren verwendete Metall-Ätzstoppschicht nach Ausführen des Ätzschrittes vollständig zu entfernen. Dadurch wird die Verwendung der Metall-Ätzstoppschicht in Bereichen, in denen später aufgebrachte, leitende Schichten nicht elektrisch zu verbinden sind, effektiv verhindert. - ZUSAMMENFASSUNG DER ERFINDUNG
- Der Erfindung liegt als Aufgabe zugrunde, eine Kombination aus Schritten und Materialien vorzusehen, welche zur effektiven Herstellung einer MMIC mit dicken, metallischen Leitern zur Ausbildung eines oder mehrerer passiver Bauelemente und/oder zur Herstellung elektrischer Verbindungen mit solchen Bauelementen vorteilhaft sind.
- Weiterhin liegt der Erfindung als Aufgabe zugrunde, ein Verfahren vorzusehen, mit welchem eine, solche dicken, metallischen Leiter aufweisende Mehrebenenstruktur leicht hergestellt werden kann, während die Leistung der MMIC durch Verhinderung einer RF-Wechselwirkung mit einem Substrat, auf dem die Struktur vorgesehen wird, verbessert wird.
- Gemäß der vorliegenden Erfindung wird eine solche MMIC unter Anwendung eines Verfahrens vorgesehen, wonach:
- – mindestens eine Isolationsschicht auf einem isolierenden Siliciumsubstrat ausgebildet wird;
- – auf die mindestens eine Isolationsschicht eine vorgegebene Struktur aus einem leitenden Ätzstoppmaterial, welches in ein Isoliermaterial umwandelbar ist, aufgebracht wird. Diese Struktur weist mindestens eine Fläche, welche leitend bleiben muss und mindestens eine Fläche, welche in Isoliermaterial umzuwandeln ist, auf;
- – auf die Struktur aus Ätzstoppmaterial und auf freiliegende Flächen der mindestens einen Isolationsschicht eine erste Schicht aus LTO-Material mit einer Dicke, welche der Dicke der dicken, metallischen Leiter entspricht, aufgebracht wird;
- – durch die erste Schicht aus LTO-Material in einer ersten Teilstruktur entsprechend der mindestens einen Fläche, welche in Isoliermaterial umzuwandeln ist, geätzt wird. Hierdurch wird mindestens ein Hohlraum ausgebildet, welcher der mindestens einen Fläche entspricht und diese freilegt;
- – die freiliegende, mindestens eine Fläche aus dem leitenden Ätzstoppmaterial in ein Isoliermaterial umgewandelt wird;
- – durch die erste Schicht aus LTO-Material in einer zweiten Teilstruktur entsprechend dem mindestens einen Teil der mindestens einen Fläche aus dem leitenden Ätzstoppmaterial, welche leitend bleiben muss, geätzt wird. Hierdurch wird mindestens ein Hohlraum ausgebildet, welcher dem mindestens einen Teil entspricht und diesen freilegt;
- – die Hohlräume entsprechend der mindestens einen Fläche und dem mindestens einen Teil mit einem Metallleitermaterial gefüllt werden, um jeweilige, dicke Leiter auszubilden.
- Vorzugsweise weist das Siliciumsubstrat einen spezifischen Widerstand auf, welcher größer als 100 Ohm-cm ist, und die mindestens eine Isolationsschicht weist eine RF-Isolationsschicht aus einem Oxidmaterial mit einer größeren Dicke als 2,0 μm auf, um eine RF-Wechselwirkung mit dem Substrat dauerhaft zu verhindern.
- KURZBESCHREIBUNG DER ZEICHNUNG
- Ausführungsbeispiele der Erfindung sind in der Zeichnung dargestellt und werden im Folgenden näher beschrieben. Es zeigen:
-
1 – einen Überblick über die Bauelemente einer ersten Anordnung von, gemäß der vorliegenden Erfindung hergestellten MMIC-Komponenten; -
2A bis2E – sukzessive Querrisse entlang der Linie II-II in1 in verschiedenen Stufen der Herstellung; -
3A bis3E – sukzessive Querrisse entlang Linie III-III in1 in verschiedenen Stufen der Herstellung; -
4A bis4E – sukzessive Querrisse in verschiedenen, erfindungsgemäßen Herstellungsstufen einer zweiten Anordnung der gleichen MMIC-Komponenten wie in1 dargestellt. - BESCHREIBUNG DER BEVORZUGTEN AUSFÜHRUNGSBEISPIELE
-
1 zeigt in Draufsicht die Bauelemente von drei passiven Mikrowellenkomponenten, welche in Mehrfachschichten, die auf einem Substrat S aufgebracht wurden, eingebettet sind. Die Komponenten umfassen einen Widerstand R, einen Induktor L und einen Kondensator C, welche, um die Anordnung und Zusammenschaltung der Komponenten deutlich darstellen zu können, so wiedergegeben sind, als seien alle anderen Schichten der MMIC transparent. Bei dieser exemplarischen Anordnung von Schaltungselementen, welche gemäß der vorliegenden Erfindung vorgesehen werden kann, sind der Widerstand, der Induktor und der Kondensator durch streifenförmige Übertragungsleitungen T elektrisch in Reihe geschaltet. - Die
2 ,3 und4 zeigen sukzessive Stadien, in welchen die Mikrowellenschaltungselemente von1 gemäß einem exemplarischen Ausführungsbeispiel der vorliegenden Erfindung ausgebildet und untereinander verbunden werden. Genauer gesagt: -
2A –2E zeigen sukzessive Querrisse entlang Linie II-II von1 , welche u.a. die Ausbildung von Teilen des Widerstands R und des Induktors L zeigen; -
3A –3E zeigen sukzessive Querrisse entlang Linie III-III von1 , welche u.a. die Ausbildung von Teilen des Kondensators C zeigen; und -
4A –4E zeigen sukzessive Querrisse eines Kondensators C', eines Widerstands R' und eines Induktors L', welche in gleicher Weise wie diese von1 ausgebildet werden, jedoch nebeneinander angeordnet sind. - Bei Beschreiben der bevorzugten Verfahrensschritte gemäß der vorliegenden Erfindung werden die
2 ,3 und4 zusammen betrachtet, da diese zusammengefasst eine umfangreichere Darstellung der Verfahrensschritte als eine einzelne Betrachtung dieser Figuren bieten. - Die
2A ,3A und4A zeigen ein erstes Stadium der Ausbildung der Mikrowellenschaltungselemente, welches erreicht wird, nachdem die folgenden Verfahrenschritte ausgeführt wurden: - – Ausbildung eines Silicium-auf-Isolator-(SOI)-Substrats durch ein Bond-und-Rückätzverfahren unter Verwendung von zwei verschiedenen einkristallinen Siliciumscheiben. Eine der Scheiben weist eine dünne Epitaxialschicht mit einer anderen Dotierung als das angrenzende Substratmaterial auf. Die Oberflächen der beiden Scheiben werden dann oxidiert und diese Siliciumdioxidoberflächen durch Erhitzen, z.B. in einem Ofen, thermisch miteinander verbunden.
- – Unter
Anwendung eines chemisch-mechanischen Polierverfahrens wird die
Scheibe mit der Epitaxialschicht fast bis auf die Epitaxialschicht abgeschliffen.
Der Rest dieser Scheibe wird dann bis zu der Epitaxialschicht chemisch
selektiv geätzt,
woraufhin ein Siliciumsubstrat S, eine Siliciumdioxid-Isolationsschicht
10 und eine Siliciumschicht12 verbleiben. Vorzugsweise weist das Substrat S einen größeren spezifischen Widerstand als 100 Ohm-cm auf, um elektrische Verluste zu minimieren. Die Oxidisolationsschicht10 dient u.a. als RF-Isolationsschicht and sollte eine größere Dicke als 2,0 μm auf weisen. Die Siliciumschicht12 weist vorzugsweise eine Dicke im Bereich von etwa 0,2–1,5 μm für Mikrowellenanwendungen auf. - – Ausbildung
einer vorgegebenen Struktur aus leitendem Ätzstoppmaterial auf der Isolationsschicht
10 , welche auf dieser Schichtebene als leitende Elemente der Mikrowellenschaltungselemente dient. In diesem Beispiel erfolgt dieses durch Implantieren einer Dotierungssubstanz in Bereiche14 der Siliciumschicht12 , in welchen Elektroden der Kondensatoren C oder C' ausgebildet werden sollen. Die verbleibenden Bereiche13 der Siliciumschicht12 werden, zum Beispiel durch thermische Oxidation, in eine isolierende Oxidschicht umgewandelt. Alternativ kann die Struktur aus Ätzstoppmaterial durch Eliminieren von Schicht12 und Aufbringen von Metallschichtelektroden unmittelbar auf die Isolationsschicht10 ausgebildet werden. Die Siliciumschicht12 kann jedoch bei aktiven Bauelementen, welche irgendwo auf dem Substrat ausgebildet werden können, verwendet werden. - – Aufbringen
einer Isolationsschicht
16 , z.B. einer Schicht aus Siliciumdioxid mit einer Dicke von etwa 0,05 μm, auf die Siliciumschicht12 , einschließlich der Bereiche14 . Dieses kann zum Beispiel durch ein thermisches Oxidationsverfahren erfolgen. Alternativ kann, wenn Metallschichtelektroden für Kondensatorelektroden an Stelle der dotierten Siliciumbereiche14 verwendet werden, eine dielektrische Schicht auf den Metallelektroden, zum Beispiel durch chemisches Aufdampfen eines Oxids, wie z.B. Siliciumdioxid, aufgebracht werden. - – Aufbringen
einer vorgegebenen Struktur aus einem leitenden Ätzstoppmaterial, wie z.B. einer dotierten
Schicht aus polykristallinem Silicium mit einer Dicke von etwa 0,5 μm, auf die
Isolationsschicht
16 , was zum Beispiel durch chemisches Aufdampfen erfolgen kann. Diese Struktur wird durch geformte Flächen18 des polykristallinen Siliciums dort gebildet, wo Ätzstopps, Widerstände und/oder Elektroden, z.B. für Kondensatoren, erforderlich sind. Aus den1 und3 ist ersichtlich, dass in dem bevorzugten Ausführungsbeispiel die Kondensatorelektroden18 und14 ineinander greifen, wobei die Elektroden18 gemeinsam eine erste kapazitive Platte und die Elektroden14 gemeinsam eine zweite kapazitive Platte bilden. Dieses ermöglicht die Zusammenschaltung der Elektroden in jeder Platte durch Metallleiter, um die ,geringer-als-Metall'-Leitfähigkeiten der dotierten Siliciumelektroden auszugleichen. - – Aufbringen,
z.B. durch chemisches Aufdampfen, einer dicken Niedertemperaturoxid-(LTO)-Schicht
20 , z.B. einer Schicht aus Siliciumoxid mit einer größeren Di cke als 3 μm, z.B. 5 μm, auf die dotierten Bereiche18 aus polykristallinem Silicium und auf die freiliegende Isolationsschicht16 oder10 . Als geeignet wird ein LTO-Material angesehen, welches eine Bearbeitung bei Temperaturen unterhalb etwa 450°C zulässt. - – Selektive Ätzung durch
die LTO-Schicht
20 in einer ersten Teilstruktur entsprechend bestimmten Flächen18 aus dem dotierten, polykristallinem Silicium, welche nicht leitend bleiben müssen. In den in den1 bis4 dargestellten Beispiele sind als solche Flächen all diese anzusehen, auf welchen weder ein Widerstandselement noch eine kapazitive Platte auszubilden ist. Vorzugsweise wird die Ätzung durch ein Verfahren, wie z.B. anisotropes, reaktives Ionenätzen, vorgenommen. Dieser Ätzschritt wird fortgesetzt, bis die ausgewählten Flächen18 freigelegt sind, wodurch sich Hohlräume in der LTO-Schicht entsprechend den ausgewählten Flächen18 bilden. - Die
2B ,3B , und4B zeigen ein zweites Stadium der Ausbildung der Mikrowellenschaltungselemente, welches nach Ausführen des folgenden, zusätzlichen Verfahrensschritts eintritt: - – Oxidieren,
z.B. durch thermische Oxidation, der freiliegenden Flächen
18 aus Ätzstoppmaterial, um diese in Isolierflächen18' umzuwandeln. Es sei erwähnt, dass dieser Schritt ausgeführt wird, um sicherzustellen, dass eng beabstandete Flächen18 , die nicht leitend bleiben müssen, nicht zusammen elektrisch kurzgeschlossen werden. Wenn es zum Beispiel dazu gekommen ist, dass Flächen18 , welche sich unter dem Induktor L befinden, miteinander in Kontakt kommen, verhindert die Umwandlung dieser Flächen in ein Isoliermaterial18' ein Kurzschließen von benachbarten Wicklungen aus dem dicken, leitenden Material, welche den Leiter bilden. Sind keine solchen eng beabstandeten Flächen vorhanden, kann dieser Oxidationsschritt eliminiert werden, und die Ätzschritte G und I können als Einzelschritt ausgeführt werden. - Die
2c ,3c und4c zeigen eine dritte Stufe der Herstellung der Mikrowellenschaltungselemente, welche nach Ausführen der folgenden, zusätzlichen Verfahrenschritte eintritt: - – Selektive Ätzung durch
die LTO-Schicht
20 und die Isolationsschicht16 in einer zweiten Teilstruktur entsprechend Teilen der verbleibenden Flächen18 sowie der Flächen14 , mit welchen elektrische Verbindungen über dicke Metallleiter herzustellen sind. Auch in diesem Fall erfolgt die Ätzung vorzugsweise durch ein Verfahren wie z.B. anisotropes, reaktives Ionenätzen. Dieser Ätzschritt wird fortgesetzt, bis die verbleibenden Flächen18 und14 freigelegt sind, wodurch Hohlräume in der LTO-Schicht entsprechend Positionierungen, welche für die Ausbildung der dicken Metallleiter vorgesehen sind, gebildet werden. - – Aufbringen
einer dünnen
Haftschicht
22 , wie z.B. einer etwa 100 nm dicken Schicht aus Titan. Diese Schicht sieht eine Haftfläche für den aufzubringenden, dicken Metallleiter vor und wirkt als Barriere gegen Diffusion des Metallleiters, z.B. Kupfer, in benachbarte Oxidmaterialien. In den2C und3C wird die Schicht22 durch ein Verfahren, wie z.B. Sputtern, auf alle freiliegenden Oberflächen der LTO-Schicht sowie auf die freiliegenden Oberflächen14 ,18 und18' aufgebracht.4C zeigt einen alternativen Schritt, in welchem die dünne Titanhaftschicht durch ein Verfahren, wie z.B. Sputtern in Kombination mit Ionenätzen, auf die Hohlraumwände und auf die freiliegenden Oberflächen14 ,18 und18' selektiv aufgebracht wird. - – Aufbringen,
z.B. durch chemische Aufdampfung, einer dicken Metallschicht
24 , wie z.B. Kupfer, auf die Haftschicht22 . Dieser Beschichtungsschritt wird fortgesetzt, bis die dicke Metallschicht die Hohlräume der LTO-Schicht füllt. Ein konformes, chemisches Aufdampfen, wie in den2C und3C dargestellt, wird auf Grund seiner Einfachheit vorgezogen. Bei Anwenden dieser Verfahrensart wird die Metallbeschichtung einfach fortgesetzt, bis die Hohlräume in der LTO-Schicht gefüllt sind und deren Oberfläche über der Haftschicht22 bedeckt ist. Alternativ kann, wie in4C dargestellt, eine selektive, chemische Aufdampfung angewandt werden. In diesem Verfahren wird das metallische Material selektiv in die Hohlräume abgeschieden und auf das Haftmaterial22 in den Hohlräumen aufgebracht. - Die
2D ,3D und4D zeigen eine vierte Stufe der Ausbildung der Mikrowellenschaltungselemente, welche nach Ausführen der folgenden, zusätzlichen Verfahrensschritte eintritt. - – Entfernen
von metallischem Material
24 , welches auf der Oberseite der LTO-Schicht20 aufgebracht wurde. Wie in4C dargestellt, sollte kein solches Material vorhanden sein, wenn eine selektive, chemische Aufdampfung angewandt wurde. Wenn jedoch, wie in den2C und3C , die konforme, chemische Aufdampfung angewandt wurde, kann die Metallbeschichtung auf der Oberseite der LTO-Schicht durch ein Verfahren, wie z.B. chemisch-mechanisches Polieren, abgetragen werden. Solche Polierverfahren werden zum Beispiel von S.P. Murarka et al. in Inlaid Copper Multilevel Interconnections Using Planarization by Chemical-Mechanical Polishing, Material Research Society Bulletin, Juni 1993, sowie von J.M. Steigerwald et al. in Electrochemical Effects on Chemical Mechanical Polishing and Corrosion Rate of Copper Films, Material Research Society Bulletin, Juni 1993, beschrieben. - – Selektives
Aufbringen einer Passivierungsschicht
26 auf die freiliegenden Oberflächen der dicken Metallschicht24 . Dieses kann zum Beispiel durch Herstellen einer selektiven Reaktion der Metallschicht24 mit einer Siliciumverbindung, wie z.B. SiH4, erfolgen. - Die
2E ,3E und4E zeigen eine fünfte Stufe der Herstellung der Mikrowellenschaltungselemente, welche nach Ausführen der folgenden, zusätzlichen Verfahrensschritte eintritt: - – Aufbringen
einer zweiten LTO-Schicht
28 mit einer Dicke von etwa 0,3 μm auf die Flächen der ersten LTO-Schicht20 und Passivierungsschicht26 . - – Selektive Ätzung durch
die LTO-Schicht
28 , z.B. durch ein konventionelles, photolithographisches Belichtungs- und Ätzverfahren, in einer Struktur entsprechend Flächen, in welchen ein elektrischer Kontakt mit der dicken Metallschicht24 herzustellen ist. - – Aufbringen
einer Metallschicht
30 in einer Struktur entsprechend Leiterbahnen, wie z.B. die streifenförmigen Übertragungsleitungen T von1 , welche in elektrischen Kontakt mit freiliegenden Flächen der dicken Metallschicht24 kommen müssen. Dieses erfolgt durch ein konventionelles, photolithographisches Belichtungs- und Ätzverfahren, wie z.B. Sputtern, photographische Belichtung sowie reaktives Ionenätzen. Vorzugsweise enthält die Metallschicht30 ein Material wie z.B. Aluminium und weist eine Dicke auf, welche im Vergleich zu der Schicht24 relativ gering ist, z.B. 1,5 bis 5,0. Es können ebenfalls Aluminiumlegierungen, wie z.B. Al-Cu und Al-Cu-Si, verwendet werden, insbesondere dann, wenn Elektromigration oder Aluminium-Spiking zu Problemen wird.
Claims (10)
- Verfahren zur Herstellung einer integrierten, monolithischen Mikrowellenschaltung mit dicken Metallleitern, wonach a) eine Silicium-auf-Isolator-Schichtstruktur auf einem Siliciumsubstrat ausgebildet wird, b) die Siliciumschicht in mindestens einem vorgegebenen Bereich dotiert wird, um eine Schicht aus einem leitenden Material vorzusehen, c) eine Isolationsschicht zumindest auf dem leitenden Material aufgebracht wird, d) eine Schicht aus einem leitenden Ätzstoppmaterial, welches in ein Isoliermaterialumgewandelt werden kann, auf die Isolationsschicht in einer vorgegebenen Struktur aus Flächen aufgebracht wird, wobei die Struktur mindestens eine Fläche, welche leitend bleiben muss und mindestens eine Fläche, welche in Isoliermaterial umzuwandeln ist, aufweist, e) auf die Schicht aus leitendem Ätzstoppmaterial und auf die freiliegenden Flächen der Isolationsschicht eine erste Schicht aus LTO-Material mit einer Dicke entsprechend dieser der dicken Metallleiter aufgebracht wird, f) durch die erste Schicht aus LTO-Material in einer ersten Teilstruktur entsprechend der mindestens einen Fläche aus dem leitenden Ätzstoppmaterial, welches in das Isoliermaterial umzuwandeln ist, geätzt wird, um die mindestens eine Fläche freizulegen und mindestens einen Hohlraum in dem LTO-Material entsprechend der mindestens einen Fläche auszubilden, g) die freiliegende, mindestens eine Fläche aus dem leitenden Ätzstoppmaterial in ein Isoliermaterial umgewandelt wird, h) durch die erste Schicht aus LTO-Material in einer zweiten Teilstruktur entsprechend mindestens einem Teil der mindestens einen Fläche aus dem leitenden Ätzstoppmaterial, welche leitend bleiben muss, geätzt wird, um diesen Teil freizulegen und mindestens einen Hohlraum in dem LTO-Material entsprechend diesem Teil auszubilden, i) eine Haftschicht auf Wände, welche die in der Schicht aus LTO-Material gebildeten Hohlräume definieren, und auf den freiliegenden, mindestens einen Teil aufgebracht wird, j) die Hohlräume entsprechend der mindestens einen Fläche und dem mindestens einen Teil mit einem metallischen Leitermaterial gefüllt werden, um an der dünnen Haftschicht zu haften und jeweilige, dicke Leiter auszubilden.
- Verfahren nach Anspruch 1, wonach: a) eine leitende Passivierungsschicht auf freiliegende Teile der dicken Leiter selektiv aufgebracht wird, b) eine zweite Schicht aus LTO-Material auf die Passivierungsschicht und auf freiliegende Flächen der ersten Schicht aus LTO-Material aufgebracht wird, c) durch die zweite Schicht aus LTO-Material selektiv geätzt wird, um mindestens eine Fläche der Passivierungsschicht freizulegen, über welche ein elektrischer Kontakt mit einem jeweiligen dicken Leiter herzustellen ist, d) eine leitende Schicht auf die freiliegende, mindestens eine Fläche der Passivierungsschicht selektiv aufgebracht wird, um den elektrischen Kontakt herzustellen.
- Verfahren nach Anspruch 1 oder 2, wobei das Siliciumsubstrat einen größeren spezifischen Widerstand als 100 Ohm-cm aufweist.
- Verfahren nach Anspruch 1 oder 2, wobei das leitende Ätzstoppmaterial dotiertes, polykristallines Silicium enthält.
- Verfahren nach Anspruch 4, wobei das leitende Ätzstoppmaterial durch Oxidation in ein Isoliermaterial umgewandelt wird.
- Verfahren nach Anspruch 1, wobei mindestens eine Fläche aus dem Ätzstoppmaterial, welche leitend bleiben muss, eine Elektrode aufweist.
- Verfahren nach Anspruch 6, wobei die Elektrode ein Element eines Kondensators aufweist.
- Verfahren nach Anspruch 1, wobei mindestens eine Fläche aus dem Ätzstoppmaterial, welche leitend bleiben muss, einen Widerstand aufweist.
- Verfahren nach Anspruch 1, wobei mindestens einer der dicken Leiter einen Induktor aufweist.
- Verfahren nach Anspruch 9, wobei der mindestens eine dicke Leiter eine Wicklung eines Induktors bildet.
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Family
ID=24596794
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- 1997-04-30 EP EP97916615A patent/EP0838090B1/de not_active Expired - Lifetime
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- 1997-04-30 JP JP53968697A patent/JP4145354B2/ja not_active Expired - Fee Related
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WO1997042654A2 (en) | 1997-11-13 |
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KR100435137B1 (ko) | 2004-07-16 |
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8364 | No opposition during term of opposition | ||
8328 | Change in the person/name/address of the agent |
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|
8327 | Change in the person/name/address of the patent owner |
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8339 | Ceased/non-payment of the annual fee |