DE3446643C2 - - Google Patents
Info
- Publication number
- DE3446643C2 DE3446643C2 DE3446643A DE3446643A DE3446643C2 DE 3446643 C2 DE3446643 C2 DE 3446643C2 DE 3446643 A DE3446643 A DE 3446643A DE 3446643 A DE3446643 A DE 3446643A DE 3446643 C2 DE3446643 C2 DE 3446643C2
- Authority
- DE
- Germany
- Prior art keywords
- silicon
- titanium
- film
- layer
- capacitor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 41
- 239000010410 layer Substances 0.000 claims description 41
- 239000004065 semiconductor Substances 0.000 claims description 36
- 239000000758 substrate Substances 0.000 claims description 31
- 239000003990 capacitor Substances 0.000 claims description 26
- 238000000034 method Methods 0.000 claims description 24
- 230000003647 oxidation Effects 0.000 claims description 22
- 238000007254 oxidation reaction Methods 0.000 claims description 22
- 239000010936 titanium Substances 0.000 claims description 21
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 20
- 229910052719 titanium Inorganic materials 0.000 claims description 20
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 19
- 229910052710 silicon Inorganic materials 0.000 claims description 19
- 239000010703 silicon Substances 0.000 claims description 18
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 15
- 239000002131 composite material Substances 0.000 claims description 13
- 229910052715 tantalum Inorganic materials 0.000 claims description 13
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 13
- 239000000463 material Substances 0.000 claims description 12
- 229910052751 metal Inorganic materials 0.000 claims description 11
- 239000002184 metal Substances 0.000 claims description 11
- 239000003989 dielectric material Substances 0.000 claims description 9
- 230000005669 field effect Effects 0.000 claims description 6
- 238000004519 manufacturing process Methods 0.000 claims description 5
- 150000001875 compounds Chemical class 0.000 claims description 4
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 claims description 3
- 229910001218 Gallium arsenide Inorganic materials 0.000 claims description 3
- 229910052732 germanium Inorganic materials 0.000 claims description 3
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 claims description 3
- -1 for example Chemical compound 0.000 claims description 2
- 239000002344 surface layer Substances 0.000 claims description 2
- 229910021332 silicide Inorganic materials 0.000 claims 5
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims 5
- 239000010408 film Substances 0.000 description 63
- 239000010409 thin film Substances 0.000 description 31
- UGACIEPFGXRWCH-UHFFFAOYSA-N [Si].[Ti] Chemical compound [Si].[Ti] UGACIEPFGXRWCH-UHFFFAOYSA-N 0.000 description 20
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 13
- 235000012239 silicon dioxide Nutrition 0.000 description 13
- 239000000377 silicon dioxide Substances 0.000 description 13
- OGIDPMRJRNCKJF-UHFFFAOYSA-N titanium oxide Inorganic materials [Ti]=O OGIDPMRJRNCKJF-UHFFFAOYSA-N 0.000 description 11
- 230000008018 melting Effects 0.000 description 9
- 238000002844 melting Methods 0.000 description 9
- 239000012535 impurity Substances 0.000 description 8
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N Titan oxide Chemical compound O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 6
- 229910052782 aluminium Inorganic materials 0.000 description 5
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 5
- 229910008484 TiSi Inorganic materials 0.000 description 4
- 230000015572 biosynthetic process Effects 0.000 description 4
- 238000005468 ion implantation Methods 0.000 description 4
- 150000003377 silicon compounds Chemical class 0.000 description 4
- 238000004544 sputter deposition Methods 0.000 description 4
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 3
- 229910004298 SiO 2 Inorganic materials 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 238000010438 heat treatment Methods 0.000 description 3
- 238000004518 low pressure chemical vapour deposition Methods 0.000 description 3
- 230000015654 memory Effects 0.000 description 3
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 230000007257 malfunction Effects 0.000 description 2
- 229910044991 metal oxide Inorganic materials 0.000 description 2
- 150000004706 metal oxides Chemical class 0.000 description 2
- 230000001590 oxidative effect Effects 0.000 description 2
- 229910052698 phosphorus Inorganic materials 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- 238000000206 photolithography Methods 0.000 description 2
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Chemical compound [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- 238000007743 anodising Methods 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000002305 electric material Substances 0.000 description 1
- 238000005566 electron beam evaporation Methods 0.000 description 1
- 238000010894 electron beam technology Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000010348 incorporation Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000009830 intercalation Methods 0.000 description 1
- 230000002687 intercalation Effects 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- HEHINIICWNIGNO-UHFFFAOYSA-N oxosilicon;titanium Chemical compound [Ti].[Si]=O HEHINIICWNIGNO-UHFFFAOYSA-N 0.000 description 1
- BPUBBGLMJRNUCC-UHFFFAOYSA-N oxygen(2-);tantalum(5+) Chemical compound [O-2].[O-2].[O-2].[O-2].[O-2].[Ta+5].[Ta+5] BPUBBGLMJRNUCC-UHFFFAOYSA-N 0.000 description 1
- 238000002161 passivation Methods 0.000 description 1
- 238000001259 photo etching Methods 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 230000000717 retained effect Effects 0.000 description 1
- 238000003860 storage Methods 0.000 description 1
- 229910001936 tantalum oxide Inorganic materials 0.000 description 1
- 238000007740 vapor deposition Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body
- H01L27/10—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body including a plurality of individual components in a repetitive configuration
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66083—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by variation of the electric current supplied or the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. two-terminal devices
- H01L29/66181—Conductor-insulator-semiconductor capacitors, e.g. trench capacitors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/32105—Oxidation of silicon-containing layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
- H01L21/82—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components
- H01L21/84—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components the substrate being other than a semiconductor body, e.g. being an insulating body
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/014—Capacitor
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/043—Dual dielectric
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/081—Insulators
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/118—Oxide films
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S148/00—Metal treatment
- Y10S148/147—Silicides
Description
Die Erfindung bezieht sich auf ein Verfahren zur Herstellung von
Halbleiterelementen, bei dem ein Halbleitersubstrat, das eine Si
liziumoberflächenschicht aufweist, vorbereitet wird, bei dem ein
dünner Film aus einen Metall mit hohem Schmelzpunkt auf der Sili
ziumoberfläche gebildet wird, bei den eine oxidationsbeständige
Maske auf einem Teil der Oberfläche des leitfähigen Dünnfilmes ge
bildet wird, bei dem das durch die Maske nicht abgedeckte Teil
oxidiert wird, wobei der von der Maske abgedeckte Teil als leit
fähiger Dünnfilm erhalten bleibt.
Ein derartiges Verfahren ist aus der DE-OS 31 22 437 bekannt. Bei
diesem Verfahren wird der Dünnfilm auf einer Polykristallsilizium
schicht gebildet, die wiederum auf einer das Substrat abdeckenden
Siliziumoxidschicht gebildet wird. Der dünne Film wird seinerseits
von einer Polykristallsiliziumschicht abgedeckt. Erst darauf wird
die die Oxidation verhindernde Maske gebildet. Das Herstellen eines
derartigen Halbleiterelementes ist kompliziert, da viele Schritte
notwendig sind. Da die dünne Schicht sowohl auf der Unterseite als
auch auf der Oberseite durch die Polykristallsiliziumschicht abge
deckt ist, kann sie nicht großflächig in einen isolierenden Film
durch Oxidation umgewandelt werden.
Die Erfindung bezieht sich außerdem auf ein Verfahren der ein
gangs beschriebenen Art, bei dem jedoch ein Halbleitersubstrat
aus einem sich von Silizium unterscheidenden Material, wie Ger
manium oder Galliumarsenid verwandt wird und als erster Schritt
ein Film von Silizium auf dem Substrat gebildet wird.
Aus IEEE Transactions on Electron Devices, Vol. ED-27, No. 8,
August 1980, Seiten 1390 bis 1394, ist ein Verfahren bekannt, bei
welchem eine Schicht aus Polysilizium durch Oxidation in Silizium
oxid umgewandelt wird, während Teile, die durch eine oxidationsbe
ständige Maske, die aus Siliziumnitrid bestehen kann, abgedeckt
sind, nicht oxidiert werden.
Bei einem solchen Halbleiterelement, das zwei Arten von lei
tenden und isolierenden Dünnfilmen, die auf dem Halbleiter
substrat gebildet sind, aufweist, wird der leitende Dünnfilm
als Verbindungsschicht oder als Material zur Verringerung des
Widerstandes verwendet, während der isolierende Film als Iso
lationsmaterial oder als dielektrisches Material verwendet
wird.
Wenn der isolierende Film als dielektrisches Material ver
wendet werden soll, dann wird im allgemeinen dazu ein Si
liziumdioxidfilm (SiO2) angewendet, und wenn der leitfähige
Film als Verbindungsschicht verwendet werden soll, dann wird
im allgemeinen dazu eine Aluminiumschicht oder eine poly
kristalline Siliziumschicht angewendet.
Ein Halbleiterelement mit zwei Arten leitfähiger und isolie
render Dünnfilme, die auf dem Halbleitersubstrat gebildet
sind, wird zum Beispiel für Halbleiterspeicherelemente, so
genannte dynamische wahlfreie Zugriffsspeicher (im folgenden
als D-RAM bezeichnet), bei denen eine Mehrzahl von Speicher
zellen, von denen jede einen MOS-Feldeffekttransistor und einen
Kondensator aufweist, auf dem Substrat gebildet werden, ver
wendet. In dem D-RAM wird der isolierende Film als dielektri
sches Material für den Kondensator verwendet, während der lei
tende Film als eine Verbindungsschicht angewendet wird.
In den letzten Jahren werden solche D-RAMs hoher Integrations
dichte unterworfen, dies bedeutet fein strukturierte Kon
struktion und somit eine Verringerung der Flächen, in denen
die Kondensatoren gebildet sind. Zur Verhinderung von Fehl
funktionen solcher D-RAMs wurden D-RAMs vorgeschlagen, die
als dielektrisches Material für die Kapazität ein zusammenge
setztes Oxid verwenden, das Siliziumdioxid und ein Oxid eines
Metalls, das einen hohen Schmelzpunkt, wie zum Beispiel
Tantal hat, zur Vergrößerung der Ladungsmenge der elektri
schen Ladungen, aufweist. Die Dielektrizitätskonstante eines
solchen Metalloxids ist mehr als zweimal so groß wie die von
Siliziumdioxid. Beispiele solcher D-RAMs sind in "Interfacial
Oxidation of Ta2O5-Si-Systems for High-Density D-RAM" von
T. Kato et al; 1983 Symposium on VLSI Technology, Seite 86,
und Japanische Patent-Offenlegungsschrift Nr. 24 541/1982
offenbart.
Fig. 4 stellt eine Schnittansicht eines D-RAMs, wie in der
japanischen Patent-Offenlegungsschrift Nr. 24 541/1982 offen
bart, dar. Bei dem in Fig. 4 gezeigten D-RAM wird ein MOS-
Feldeffekttransistor mit einem Drain-Teil 8 und einem Source-
Teil 9, die beide auf der Hauptoberfläche des Siliziumsub
strats 1 vom p-Typ vorgesehen sind, und einer Gate-Elektrode
7a, die aus einem polykristallinen Siliziumfilm besteht, der
auf der oberen Oberfläche des Siliziumdioxidfilms 6 vorge
sehen ist, gebildet, und ein Kondensator wird aus dem Silizium
substrat 1 vom p-Typ, einem zusammengesetzten Oxidfilm 5, be
stehend aus Tantaloxid und Siliziumoxid, und einem polykri
stallinen Siliziumfilm 7b gebildet, während Verbindungsschich
ten mit Aluminiumdünnfilmen 11a und 11b gebildet werden.
Bei einem Verfahren zur Herstellung eines D-RAMs mit dem zuvor
erwähnten Aufbau, wird ein Siliziumdioxidfilm 3 auf der oberen
Oberfläche des Siliziumsubstrats 1 vom p-Typ, die mit einem
dicken Feldoxidfilm 2 versehen ist, gebildet, und ein Tantal
dünnfilm 4 wird durch Zerstäuben (Sputtern) auf der oberen
Oberfläche des Siliziumdioxidfilms 3 wie in Fig. 1 gezeigt,
gebildet.
Dann wird, wie in Fig. 2 gezeigt, der Siliziumdioxidfilm 3
und der Tantaldünnfilm 4 teilweise mit Hilfe eines Photoätz
verfahrens in einem gewünschten Muster entfernt, und eine
Wärmebehandlung wird zum Umformen der Restbereiche des Sili
ziumdioxid-Dünnfilms 3 und des Tantaldünnfilms 4 in einen zu
sammengesetzten Oxidfilm 5 angewendet, während ein Silizium
dioxid-Dünnfilm 6 auf dem freigelegten Bereich des Silizium
substrats 1 gebildet wird.
Dann wird, wie in Fig. 3 gezeigt, ein polykristalliner Sili
ziumdünnfilm, der als Gate-Elektrode 7a eines MOS-Feldeffekt
transistors dient und eine Elektrode 7b eines Kondensators in
einem ausgewählten Muster gebildet, gefolgt von der Bildung
eines Drain-Bereichs 8 und eines Source-Bereichs 9 durch
Ionenimplantation mit ca. 80 KV.
Daran anschließend wird ein Siliziumdioxid-Dünnfilm 10 über
der gesamten Oberfläche des so erhaltenen Gegenstandes ge
bildet, wobei Kontaktlöcher in den Bereichen des Silizium
dioxid-Dünnfilms 6 in dem Drain-Bereich 8 und dem Source-
Bereich 9 gebildet werden, gefolgt von der Bildung einer
Verbindungsschicht 11a aus einem Aluminiumdünnfilm, der mit
dem Source-Bereich 9 verbunden ist und einer Verbindungs
schicht 11b aus einem Aluminiumdünnfilm, der mit dem Drain-
Bereich 8 verbunden ist, wodurch man einen Gegenstand mit
einem Aufbau wie in Fig. 4 gezeigt erhält.
Während die Speicherkapazität des Kondensators in dem D-RAM
mit dem zuvor erwähnten Aufbau vergrößert wird, werden jedoch
dazu Schritte zur Bildung des dielektrischen Materialbereichs
des Kondensators alleine benötigt, d. h. der Schritt zur
Bildung des Siliziumdioxid-Dünnfilms 3 der Schritt zur Bil
dung des Tantal-Dünnfilms 4 und ein Schritt zur Durchführung
der Maskenjustierung etc., wodurch die Anzahl der Schritte
vergrößert wird.
Andererseits wird unter Berücksichtigung des MOS-Feldeffekt
transistors die Verwendung einer geschichteten Folie, die aus
einem Film aus einer Siliziumverbindung eines Metalls mit
hohem Schmelzpunkt auf einem polykristallinen Siliziumfilm
als Verbindungsschicht, die mit jeder Gate-Elektrode und dem
Source-Bereich verbunden ist, gebildet wird, in der japani
schen Patent-Offenlegungsschrift Nr. 88 783/1979 vorgeschlagen.
Wenn die geschichtete Folie der Siliziumverbindung des Metalls
mit hohem Schmelzpunkt, die, wie in der japanischen Patent
offenlegungsschrift Nr. 88 783/1979 vorgeschlagen, auf dem
polykristallinen Siliziumfilm vorgesehen ist, als Verbindungs
schicht 11a zur Verbindung mit dem Source-Bereich 9 angewendet
wird (und die Verbindungsschicht 11b mit dem Drain-Bereich 8
verbunden ist), dann wird in der zuvor erwähnten japanischen
Patent-Offenlegungsschrift Nr. 24 541/1982 die polykristalline
Siliziumschicht und die Schicht aus einer Metall-Silizium-
Verbindung nach der Bildung des MOS-Typ-Transistors und des
Kondensators gebildet, wodurch die Anzahl der Schritte weiter
gesteigert wird.
Aus IEEE Electron Device Letters, Band EDL-4, Nr. 8, August
1983, Seiten 277 bis 279 ist es bekannt, daß auf Source-/
Draingebieten und auf Gateelektroden abgeschiedenes Titan
silizid bei der Oxidation SiO2 gibt, während Titanoxid und
Siliziumoxid auf einem Feldoxid entsteht.
Es ist daher Aufgabe der Erfindung, ein Verfahren mit wenigen
Schritten zu schaffen, bei dem aus einer Schicht durch ent
sprechende Behandlung sowohl ein gut leitfähiger Teil als
auch als Dielektrikum eines Kondensators einer Halbleiterspeicherzelle
geeigneter, isolierender Teil mit einer hohen Dielektrizitätskonstante
gebildet werden.
Diese Aufgabe wird durch ein Verfahren gelöst, das durch die
Merkmale des Anspruches 1 gekennzeichnet ist.
Weitere Eigenschaften des Verfahrens zur Herstellung von Halb
leiterelementen ergeben sich aus der Beschreibung eines Ausfüh
rungsbeispieles anhand der Figuren. Von den Figuren zeigen:
Fig. 1 bis 4 Querschnittansichten eines herkömmlichen
Verfahrens zur Herstellung eines D-RAMs
wie in Fig. 4 gezeigt, in der Reihenfolge
der Schritte; und
Fig. 5 bis 11 Querschnittansichten eines Verfahrens zur
Herstellung eines Halbleiterelements gemäß
einer Ausführungsform der Erfindung in der
Reihenfolge der Schritte.
Mit Bezug auf die Fig. 5 bis 11 wird nun eine Ausführungs
form des erfindungsgemäßen Verfahrens, das auf ein D-RAM an
gewendet ist, beschrieben. Es muß erwähnt werden, daß in
dieser Ausführungsform ein leitender Dünnfilm, der auf dem
Halbleitersubstrat gebildet wird, in Verbindung mit einem
Dünnfilm steht, der zur Verringerung des Widerstandes eines
Bit-Zeilenbereichs angebracht ist und ebenfalls als Source-
Bereich in einem MOS-Typ-Transistor eines D-RAMs dient, und
ein isolierender Dünnfilm steht in Verbindung mit einer
Schicht aus dielektrischem Material eines Kondensators in dem
D-RAM.
Zunächst wird, wie in Fig. 5 gezeigt, ein dicker Feldoxid
film 13 mit einem gewünschten Muster auf der einen Hauptober
fläche eines Halbleitersubstrats 12 aus Silizium vom p-Typ
vorgesehen.
Dann wird, wie in Fig. 6 gezeigt, ein dünner Film aus Titan
(Ti), das ein Metall mit hohem Schmelzpunkt ist, mit einem
Verfahren wie z. B. Zerstäuben oder Elektronenstrahlaufdampfen
(EB), mit einer Dicke von ungefähr 400 bis 500 Å gebildet,
und die auf diese Weise erhaltene Anordnung wird in einer
nicht-oxidierenden Atmosphäre von ungefähr 600 bis 700°C
erhitzt. Während dieser Zeit verbindet sich Titan, das auf
der freigelegten Oberfläche des Halbleitersubstrats 12 vorge
sehen ist, mit Silizium in dem Substrat 12, um in eine leit
fähige Siliziumverbindung bestehend aus Titan und Silizium
umgewandelt zu werden, die dann einen Titan-Silizium-Verbin
dungsfilm (TiSix) 14 bildet, wobei der Titanbereich 15, der
auf der oberen Oberfläche des Feldoxidfilms 13 vorgesehen
ist, im nicht-reagierten Zustand verbleibt. Daran anschließend
werden zur Bestimmung von VTH des MOS-Feldeffekttransistors
in dem D-RAM Verunreinigungen vom p-Typ durch Ionenimplanta
tion in die Hauptoberfläche des Halbleitersubstrats 12 in
einen Bereich, auf dem eine Gate-Elektrode des MOS-Typ-Tran
sistors vorgesehen ist, injiziert, um eine Verunreinigungs
schicht 16 vom p-Typ zu bilden, während zur Vergrößerung der
Kapazität eines Kondensators in dem D-RAM Verunreinigungen
vom n-Typ durch Ionenimplantation in den anderen Teil der
Hauptoberfläche in einen Bereich zur Bildung des Kondensators,
um einen p-n-Übergang 17 zu erhalten, injiziert werden. Dann
wird der Titan-Dünnfilm 15 von dem Feldoxidfilm 13 entfernt.
Während dieser Zeit wird der Titan-Dünnfilm 15 allein auf
selbstjustierende Weise entfernt, da der Titan-Dünnfilm 15
auf dem Feldoxidfilm 13 und der Titan-Silizium-Verbindungs
film 14 auf der freigelegten Oberfläche des Halbleitersub
strats 12 aus sich gegenseitig unterscheidendem Material ge
bildet sind.
Dann wird, wie in Fig. 7 gezeigt, eine oxidationsbeständige
Maske 18 aus einem Siliziumnitritfilm auf der oberen Ober
fläche des Titan-Silizium-Verbindungsfilms 14 in einem Teil
zur Bildung eines Bit-Zeilenbereichs gebildet, der aus einem
Teil zur Bildung eines Source-Bereichs des MOS-Typ-Transistors
und einem Bereich, der im Zusammenhang mit dem Source-Bereich
in dem D-RAM gebildet wird, besteht, und daran anschließend
wird die Anordnung in einer Oxidations-Atmosphäre von unge
fähr 600 bis 1000°C erhitzt. Da zu dieser Zeit der von der
oxidationbeständigen Maske 18 bedeckte Teil des Titan-Sili
zium-Verbindungsfilms 14 nicht der Oxidationsatmosphäre aus
gesetzt wird, wird derselbe auch nicht oxidiert und verbleibt
als Titan-Silizium-Verbindungsfilm 14a, während der andere
Teil des Titan-Siliziumoxidfilms 14, der nicht durch die
oxidationsbeständige Maske 18 bedeckt ist, der Oxidations
atmosphäre ausgesetzt wird, und somit oxidiert wird und in
einen zusammengesetzten Oxidfilm 19 aus Titanoxid (TiOx) und
Siliziumoxid (SiOx) umgewandelt wird.
Im konkreten Fall wird die zuvor erwähnte Umwandlung des
Titan-Silizium-Verbindungsfilms 14 in einen zusammengesetzten
Oxidfilm 19 auf folgende Weise durchgeführt: Da, wenn der
Titan-Silizium-Verbindungsfilm 14 auf eine Temperatur niedri
ger als 700°C erhitzt wird, Titan hauptsächlich oxidiert
wird, während Silizium hauptsächlich oxidiert wird, wenn der
selbe auf eine Temperatur höher als 900°C erhitzt wird, wird
der Titan-Silizium-Verbindungsfilm 14 zunächst bei einer Tem
peratur geringer als 700°C oxidiert, so daß der Oxidations
prozeß der Titan-Silizium-Verbindung (TiSix) mit der zeit
lichen Abfolge TiSix/Si → TiOx/TiSix/Si → TiOx/Si verläuft,
und im Anschluß daran wird die Temperatur auf über 900°C er
höht, wodurch TiOx/Si in TiOx/SiO2/Si umgewandelt wird, um
einen zusammengesetzten Oxidfilm 19, in dem eine Titanoxid
schicht (TiOx) überlappend mit einer Siliziumdioxidschicht
(SiOx) gebildet wird, vorzusehen.
Dann wird, wie in Fig. 8 gezeigt, ein polykristalliner Sili
ziumfilm durch ein chemisches Dampfabscheideverfahren bei
geringem Druck (LPCVD) gebildet, gefolgt von einer Einlagerung
von Verunreinigungen wie z. B. Phosphor zur Verringerung des
Widerstandes mit Hilfe eines Wärmediffusionsverfahrens,
wodurch eine erste Gate-Elektrode 20 mit Hilfe von Photolitho
graphie und Ätzen gebildet wird, die als die eine Elektrode
des Kondensators in dem D-RAM dient. Dann wird der freige
legte Bereich des zusammengesetzten Oxidfilms 19 durch Ätzen
in selbstjustierender Weise unter Verwendung der ersten Gate-
Elektrode 20 und der oxidationsbeständigen Maske 18 als
Masken entfernt. Zu dieser Zeit wird der Bereich des zusam
mengesetzten Oxidfilms 19, der neben der ersten Gate-Elektrode
20 erhalten geblieben ist, so verwendet, daß dieser als di
elektrisches Material 19a für den Kondensator in dem D-RAM
dient.
Dann wird, wie in Fig. 9 gezeigt, die oxidationsbeständige
Maske 18 entfernt, gefolgt von einer Wärmebehandlung in einer
Oxidationsatmosphäre von ungefähr 900 bis 1000°C zur Bildung
eines Siliziumoxidfilms 21 über der gesamten Hauptoberfläche
des Halbleitersubstrats 12. Obwohl der Siliziumoxidfilm 20
auch auf der Oberfläche der Titan-Silizium-Verbindungsschicht
14a gebildet wird, verbleibt die Titan-Silizium-Verbindungs
schicht 14a neben dem Oxidfilm 21.
Dann wird, wie in Fig. 10 gezeigt, ein polykristalliner Si
liziumfilm auf der oberen Oberfläche des Siliziumoxidfilms 21
mit einem Verfahren wie zum Beispiel LPCVD gebildet, gefolgt
von der Einlagerung von Verunreinigungen wie zum Beispiel
Phosphor mit Hilfe eines Wärmediffusionsverfahrens etc. zur
Verringerung des Widerstandes, wodurch mit Photolithographie
und Ätzen eine zweite Gate-Elektrode 22 gebildet wird, die
als Gate-Elektrode des MOS-Typ-Transistors in dem D-RAM dient.
Dann werden, wie in Fig. 11 gezeigt, Verunreinigungen vom
n-Typ wie zum Beispiel Arsen (As) durch Ionenimplantation in
den Bereich neben der Titan-Silizium-Verbindungsschicht 14a
injiziert, die zur Verringerung des Widerstandes des Bit-
Reihenbereichs, bestehend aus dem Source-Bereich des MOS-Typ-
Transistors und einem Bereich, der im Zusammenhang mit dem
Source-Bereich in dem D-RAM gebildet ist, angepaßt ist, um
einen Bit-Zeilenbereich 23, der ebenfalls als Source-Bereich
dient, zu bilden. Zu dieser Zeit wird mindestens der Source-
Bereich in dem Bit-Zeilenbereich 23 durch die zweite Gate-
Elektrode 22 und den Feldoxidfilm 13 selbstjustiert. Danach
wird ein dünner Siliziumoxidfilm 24 mit einer Dicke von unge
fähr 50 bis 100Å auf der Oberfläche der zweiten Gate-Elek
trode 22 durch thermische Oxidation etc. gebildet. Zu dieser
Zeit wird die Filmdicke des Siliziumoxidfilms 21 auf der
oberen Oberfläche der Titan-Silizium-Verbindungsschicht 14a
ebenfalls vergrößert. Dann wird ein Phosphor etc. enthalten
der dicker Siliziumoxidfilm 25 mit einem Verfahren wie zum
Beispiel chemischer Dampfabscheidung (CVD) gebildet, gefolgt
von Schritten zur Bildung von Kontakten, Aluminiumdrähten
und einem Passivierungsfilm, wodurch das D-RAM fertigge
stellt wird.
Das erfindungsgemäß so aufgebaute D-RAM arbeitet ähnlich wie
ein herkömmliches D-RAM. Beim Schreiben eines "H" wird zum
Beispiel der MOS-Typ-Transistor der ausgewählten Speicher
zelle in den leitfähigen Zustand geschaltet, so daß elektri
sche Ladungen in dem Kondensatorbereich, der unter der ersten
Gate-Elektrode 20, dem zusammengesetzten Oxidfilm 19a und dem
Bereich der Oberfläche des Halbleitersubstrats 12 direkt
unter der ersten Gate-Elektrode 20 und in einem Kondensator-
Bereich in dem p-n-Übergang 17 durch die Bit-Zeile, der mit
der Titan-Silizium-Verbindungsschicht 14a und einem Bit-
Zeilenbereich 23 gebildet wird, und in dem leitenden MOS-Typ-
Transistor abgespeichert werden, wodurch "H" in die Speicher
zelle geschrieben wird. Beim Lesen des geschriebenen "H"
werden die in dem Kondensatorbereich gespeicherten elektri
schen Ladungen über den leitenden MOS-Typ-Transistor und die
Bit-Zeile gelesen. Ein ähnlicher Vorgang wird in Bezug auf
das Schreiben und Lesen eines "L" durchgeführt.
Das so gebildete D-RAM mit dem zuvor beschriebenen Aufbau hat
die folgenden Vorteile:
Erstens, da als dielektrisches Material für den Kondensator
in dem D-RAM der zusammengesetzte Oxidfilm 19a aus dem Titan
oxidfilm und dem Siliziumoxidfilm angewendet wird, ergibt
sich eine Dielektrizitätskonstante von 85,8 bis 170, wenn
Titandioxid (TiO2) als Titanoxidfilm verwendet wird, dessen
Dielektrizitätskonstante 19 bis 38mal größer als die von
Siliziumdioxid mit 4,5 bis 4,6 ist. Weiterhin ist, da der
Siliziumoxidfilm unter dem Titanoxidfilm vorgesehen ist, die
Grenzschicht mit dem Halbleitersubstrat 12 stabilisiert,
während die gesamte Spannungsfestigkeit des isolierenden Films
in dem Kondensator verbessert ist. Dementsprechend ist die in
dem Kondensator speicherbare elektrische Ladungsmenge auch
auf einer kleinen Fläche vergrößert, und somit kann der Unter
schied zwischen "H" und "L" groß gemacht werden, wodurch Fehl
funktionen vermieden werden.
Zweitens, da die Bit-Zeile den Source-Bereich des MOS-Typ-
Transistors einschließt, und der Bit-Zeilenbereich, der im
Zusammenhang mit dem Source-Bereich gebildet ist, mit einem
Verunreinigungsbereich, der auf der Hauptoberfläche des Halb
leitersubstrats vorgesehen ist, und mit der Titan-Silizium-
Verbindungsschicht 14a, die ohmschen Kontakt mit dem Verun
reinigungsbereich in dem D-RAM hat, gebildet ist, ist der
Widerstand der Bit-Zeile bemerkenswert verringert. Daher
können die Verluste in der Bit-Zeile extrem reduziert werden,
während Hochgeschwindigkeitsbetrieb beim Einschreiben und
Auslesen möglich ist.
Drittens, da das dielektrische Material für den Kondensator
und die Titan-Silizium-Verbindungsschicht 14a zur Verringerung
des Widerstandes des Source-Bereichs des MOS-Typ-Transistors
und der Bit-Zeile, die im Zusammenhang mit dem Source-Bereich
gebildet ist, aus demselben Anfangsmaterial hergestellt sind,
d. h. einer Titan-Silizium-Verbindung, kann die Anzahl der
Schritte verringert werden.
Obwohl Titan als Metall mit hohem Schmelzpunkt in der zuvor
erwähnten Ausführungsform angewendet wird, kann eine ähnliche
Wirkung durch Verwendung anderer Metalle mit hohem Schmelz
punkt, wie z. B. Tantal (Ta), erzielt werden.
Weiterhin kann, obwohl der Titandünnfilm durch eine Wärme
behandlung in einer nicht-oxidierenden Atmosphäre zur Bildung
eines Titan-Silizium-Verbindungsdünnfilms 14 siliziert ist,
solch ein Titan-Silizium-Verbindungsdünnfilm direkt auf der
Hauptoberfläche des Halbleitersubstrats 12 durch ein Verfahren
wie z. B. Zerstäubung und Elektronenstrahlaufdampfung gebildet
werden.
Zusätzlich kann, obwohl das Silizium-Halbleitersubstrat als
Halbleitersubstrat in der oben beschriebenen Ausführungsform
angewendet ist, das Halbleitersubstrat auch aus Germanium- oder
Galliumarsenid, mit einem Titan-Silizium-Verbindungsfilm, der
nach der Bildung des Siliziumfilms auf dem Halbleitersubstrat
gebildet wird, hergestellt werden.
Weiterhin kann, obwohl ein thermisches Oxidationsverfahren
zur Bildung des zusammengesetzten Oxidfilms in der oben be
schriebenen Ausführungsform angewendet wird, derselbe auch
durch Verfahren wie z. B. ein Anodisierungsverfahren und ein
Plasma-Oxidierungsverfahren gebildet werden.
Weiterhin kann, obwohl das Halbleitersubstrat vom p-Typ in
der oben beschriebenen Ausführungsform verwendet ist, ein
Halbleitersubstrat vom n-Typ mit Bereichen vom p-Typ und
Bereichen vom n-Typ, die entgegengesetzt wie in der zuvor er
wähnten Ausführungsform vorgesehen sind, ebenso verwendet
werden.
Zusätzlich sind, obwohl zwei Arten isolierender und leitfähi
ger Verbindungen des Metalls mit hohem Schmelzpunkt als di
elektrisches Material für den Kondensator und als Material zur
Verringerung des Widerstands der Bit-Zeile in dem D-RAM je
weils verwendet werden, solche Verbindungen nicht auf diese
Verwendung beschränkt, sondern können als dielektrisches Ma
terial für den Kondensator und als Material der Verbindungs
schicht, die mit dem Source-Bereich des MOS-Typ-Transistors
in dem D-RAM verbunden ist, verwendet werden. Weiterhin kann
dasselbe als dielektrisches Material für den Kondensator und
als Material für eine Zwischenschicht einer mehrfach geschich
teten Verbindungsschicht in dem D-RAM verwendet werden. We
sentlich ist, daß die Verbindungen als isolierende und lei
tende Schichten auf dem Halbleiterelement, in dem die iso
lierenden und leitenden Schichten auf dem Halbleitersubstrat
gebildet werden, verwendet werden können.
Obwohl die obige Beschreibung der Ausführungsform mit Bezug
auf ein D-RAM durchgeführt wurde, ist die Erfindung nicht auf
ein D-RAM beschränkt, und kann z. B. auf ein Halbleiterelement
mit einer Elektrodenschicht, die auf dem Halbleitersubstrat
mit einem komplizierten Muster, wie z. B. den Zähnen eines
Kamms oder radiale Formen gebildet ist, angewendet werden.
In diesem Fall wird die Elektrodenschicht aus einer Silizium
verbindung eines Metalls mit hohem Schmelzpunkt hergestellt
und die isolierende Schicht, die mit einem komplizierten
Muster entsprechend dem Muster der Elektrodenschicht gebildet
wird, wird aus einem zusammengesetzten Oxid, bestehend aus
Siliziumoxid und Metalloxid, hergestellt.
Claims (4)
1. Verfahren zur Herstellung von Halblei
terbauelementen mit:
- a) Bilden eines dünnen Metallfilms (14) aus Titan oder Tantal auf der Oberfläche eines Halbleitersubstrats (12) mit einer Siliziumoberflächenschicht,
- b) und Reagieren des dünnen Metallfilms (14) aus dem Titan oder Tantal mit dem Silizium zum Bilden eines leitfähigen dünnen Titan- oder Tantalsilizidfilms (14),
- c) Bilden einer oxidationsbeständigen Maske (18) auf einem Teil der Oberfläche des leitfähigen dünnen Titan- oder Tantalsili zidfilms (14),
gekennzeichnet durch
- d) Umwandeln des nicht durch die Maske (18) abgedeckten Teiles (19) des leitfähigen dünnen Titan- oder Tantalsilizidfilms (14) in einen isolierenden Film (19a) eines zusammengesetzten oder zweilagigen Oxides aus Siliziumoxid und Titan- oder Tan taloxid durch Oxidation des nicht abgedeckten Teils (19), wo bei der von der Maske (18) abgedeckte Teil (14a) als leitfä higer dünner Titan- oder Tantalsilizidfilm (14) erhalten bleibt.
2. Verfahren nach Anspruch 1,
durch gekennzeichnet, daß
- e) das Halbleitersubstrat (12) hergestellt wird aus Silizium oder einer sich von Silizium unterscheidenden Verbindung wie zum Beispiel Germa nium- oder Galliumarsenid, auf der ein Siliziumfilm gebildet wird.
3. Verfahren nach Anspruch 1 oder 2,
durch gekennzeichnet,
- f) daß das Halbleiterbauelement ein Halbleiterspeicher mit einer Mehrzahl von Zeilen ist, von denen jede einen MOS-Feldef fekttransistor und einen Kondensator aufweist,
- g) daß ein Material mit geringem Widerstand im Source-Bereich des Transistors von dem leitfähigen Titan- oder Tantalsili zidfilm (14a) gebildet wird
- h) und daß ein dielektrisches Material für den Kondensator von dem isolierenden Film (19a) gebildet wird.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58242631A JPS60132353A (ja) | 1983-12-20 | 1983-12-20 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE3446643A1 DE3446643A1 (de) | 1985-06-27 |
DE3446643C2 true DE3446643C2 (de) | 1993-05-13 |
Family
ID=17091921
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19843446643 Granted DE3446643A1 (de) | 1983-12-20 | 1984-12-20 | Verfahren zur herstellung von halbleiterelementen |
Country Status (4)
Country | Link |
---|---|
US (1) | US4665608A (de) |
JP (1) | JPS60132353A (de) |
KR (1) | KR900001395B1 (de) |
DE (1) | DE3446643A1 (de) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5027166A (en) * | 1987-12-04 | 1991-06-25 | Sanken Electric Co., Ltd. | High voltage, high speed Schottky semiconductor device and method of fabrication |
JP2569115B2 (ja) * | 1988-04-15 | 1997-01-08 | 株式会社日立製作所 | 半導体装置 |
US5036020A (en) * | 1990-08-31 | 1991-07-30 | Texas Instrument Incorporated | Method of fabricating microelectronic device incorporating capacitor having lowered topographical profile |
US5470398A (en) * | 1990-09-25 | 1995-11-28 | Matsushita Electric Industrial Co., Ltd. | Dielectric thin film and method of manufacturing same |
US5206187A (en) * | 1991-08-30 | 1993-04-27 | Micron Technology, Inc. | Method of processing semiconductor wafers using a contact etch stop |
US5449941A (en) * | 1991-10-29 | 1995-09-12 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor memory device |
KR960005681B1 (ko) * | 1992-11-07 | 1996-04-30 | 금성일렉트론주식회사 | 반도체 메모리 장치의 캐패시터 제조방법 |
JP2630292B2 (ja) * | 1995-02-27 | 1997-07-16 | 日本電気株式会社 | 半導体装置の製造方法 |
US5593924A (en) * | 1995-06-02 | 1997-01-14 | Texas Instruments Incorporated | Use of a capping layer to attain low titanium-silicide sheet resistance and uniform silicide thickness for sub-micron silicon and polysilicon lines |
CN1171304C (zh) * | 1995-11-20 | 2004-10-13 | 株式会社日立制作所 | 半导体存储器及其制造方法 |
US6660610B2 (en) * | 1996-07-08 | 2003-12-09 | Micron Technology, Inc. | Devices having improved capacitance and methods of their fabrication |
EP1106982B1 (de) * | 1999-12-10 | 2005-02-09 | Endress + Hauser GmbH + Co. KG | Druckmessgerät |
Family Cites Families (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5514531B1 (de) * | 1969-06-18 | 1980-04-17 | ||
US3741880A (en) * | 1969-10-25 | 1973-06-26 | Nippon Electric Co | Method of forming electrical connections in a semiconductor integrated circuit |
US4158613A (en) * | 1978-12-04 | 1979-06-19 | Burroughs Corporation | Method of forming a metal interconnect structure for integrated circuits |
JPS5847862B2 (ja) * | 1979-08-30 | 1983-10-25 | 富士通株式会社 | 半導体記憶装置及びその製造方法 |
JPS56137657A (en) * | 1980-03-29 | 1981-10-27 | Chiyou Lsi Gijutsu Kenkyu Kumiai | Manufacture of semiconductor device |
GB2077993A (en) * | 1980-06-06 | 1981-12-23 | Standard Microsyst Smc | Low sheet resistivity composite conductor gate MOS device |
US4285761A (en) * | 1980-06-30 | 1981-08-25 | International Business Machines Corporation | Process for selectively forming refractory metal silicide layers on semiconductor devices |
JPS5724541A (en) * | 1980-07-21 | 1982-02-09 | Nec Corp | Preparation of metal oxide semiconductor |
GB2083946A (en) * | 1980-09-15 | 1982-03-31 | Gen Electric | Method of making integrated circuits |
US4339869A (en) * | 1980-09-15 | 1982-07-20 | General Electric Company | Method of making low resistance contacts in semiconductor devices by ion induced silicides |
US4419142A (en) * | 1980-10-24 | 1983-12-06 | Tokyo Shibaura Denki Kabushiki Kaisha | Method of forming dielectric isolation of device regions |
US4403394A (en) * | 1980-12-17 | 1983-09-13 | International Business Machines Corporation | Formation of bit lines for ram device |
DE3132809A1 (de) * | 1981-08-19 | 1983-03-10 | Siemens AG, 1000 Berlin und 8000 München | Verfahren zum herstellen von integrierten mos-feldeffekttransistoren, insbesondere von komplementaeren mos-feldeffekttransistorenschaltungen mit einer aus metallsiliziden bestehenden zusaetzlichen leiterbahnebene |
DE3211761A1 (de) * | 1982-03-30 | 1983-10-06 | Siemens Ag | Verfahren zum herstellen von integrierten mos-feldeffekttransistorschaltungen in siliziumgate-technologie mit silizid beschichteten diffusionsgebieten als niederohmige leiterbahnen |
-
1983
- 1983-12-20 JP JP58242631A patent/JPS60132353A/ja active Granted
-
1984
- 1984-10-11 KR KR1019840006294A patent/KR900001395B1/ko not_active IP Right Cessation
- 1984-12-14 US US06/682,594 patent/US4665608A/en not_active Expired - Fee Related
- 1984-12-20 DE DE19843446643 patent/DE3446643A1/de active Granted
Also Published As
Publication number | Publication date |
---|---|
DE3446643A1 (de) | 1985-06-27 |
KR850005139A (ko) | 1985-08-21 |
JPS60132353A (ja) | 1985-07-15 |
JPH0311552B2 (de) | 1991-02-18 |
KR900001395B1 (ko) | 1990-03-09 |
US4665608A (en) | 1987-05-19 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE3916228C2 (de) | Halbleiterspeichervorrichtung mit Stapelkondensatorzellenstruktur und Verfahren zu ihrer Herstellung | |
DE1903961C3 (de) | Integrierte Halbleiterschaltung und Verfahren zu ihrer Herstellung | |
DE4127967C2 (de) | MOS-Transistor mit Gate-Drain-Elektrodenüberlapp und Verfahren zu seiner Herstellung | |
DE4028488C2 (de) | Verfahren zur Herstellung einer Halbleiterspeichervorrichtung | |
DE3929129C2 (de) | ||
DE19630310C2 (de) | Halbleitervorrichtung mit einem Kondensator und Verfahren zu deren Herstellung | |
DE4221511C2 (de) | Verfahren zum Bilden von Bitstellenleitungen auf einem Halbleiterwafer | |
DE10142580B4 (de) | Verfahren zur Herstellung einer Grabenstrukturkondensatoreinrichtung | |
DE4420365C2 (de) | Halbleiterbauelement-Isolierverfahren und integrierte Schaltungen für eine Speicheranordnung | |
DE4010618C2 (de) | Verfahren zur Herstellung einer Halbleitervorrichtung | |
DE4007582C2 (de) | Verfahren zum Herstellen von mindestens zwei Kontakten in einem Halbleiterbauelement | |
DE3844388A1 (de) | Dynamische direktzugriffspeichereinrichtung | |
DE3446643C2 (de) | ||
DE10163345A1 (de) | Ein Kondensator für Halbleiterelemente und ein Verfahren zur Herstellung | |
DE3122437A1 (de) | Verfahren zum herstellen eines mos-bauelements | |
DE10136400B4 (de) | Verfahren zur Herstellung einer Metallkarbidschicht und Verfahren zur Herstellung eines Grabenkondensators | |
DE19842704C2 (de) | Herstellverfahren für einen Kondensator mit einem Hoch-epsilon-Dielektrikum oder einem Ferroelektrikum nach dem Fin-Stack-Prinzip unter Einsatz einer Negativform | |
DE10109564A1 (de) | Grabenkondensator und Verfahren zu seiner Herstellung | |
DE19521006A1 (de) | Halbleiterbauelement und Verfahren zu seiner Herstellung | |
DE2541651A1 (de) | Ladungsuebertragungsvorrichtung | |
DE3927176C2 (de) | ||
EP0867926A1 (de) | Herstellverfahren für eine Kondensatorelektrode aus einem Platinmetall | |
DE3411960C2 (de) | ||
DE4016347C2 (de) | Verfahren zum Herstellen einer dynamischen RAM-Speicherzelle | |
DE4140173C2 (de) | DRAM und Verfahren zu dessen Herstellung |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
OR8 | Request for search as to paragraph 43 lit. 1 sentence 1 patent law | ||
8105 | Search report available | ||
8110 | Request for examination paragraph 44 | ||
8125 | Change of the main classification |
Ipc: H01L 21/90 |
|
D2 | Grant after examination | ||
8364 | No opposition during term of opposition | ||
8320 | Willingness to grant licences declared (paragraph 23) | ||
8339 | Ceased/non-payment of the annual fee |