DE102016122568A1 - Nitridhalbleitervorrichtung und verfahren zur herstellung derselben - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 225
- 150000004767 nitrides Chemical class 0.000 title claims abstract description 216
- 238000004519 manufacturing process Methods 0.000 title claims description 12
- 238000000034 method Methods 0.000 title claims description 8
- 239000000758 substrate Substances 0.000 claims abstract description 100
- 238000002955 isolation Methods 0.000 claims description 35
- 230000005669 field effect Effects 0.000 claims description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 32
- 229910052710 silicon Inorganic materials 0.000 description 32
- 239000010703 silicon Substances 0.000 description 32
- 239000000463 material Substances 0.000 description 15
- 239000004642 Polyimide Substances 0.000 description 9
- 229920001721 polyimide Polymers 0.000 description 9
- 229910002601 GaN Inorganic materials 0.000 description 8
- 238000005530 etching Methods 0.000 description 8
- 238000000926 separation method Methods 0.000 description 8
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 7
- 239000002019 doping agent Substances 0.000 description 7
- 230000015572 biosynthetic process Effects 0.000 description 6
- 238000012986 modification Methods 0.000 description 5
- 230000004048 modification Effects 0.000 description 5
- 239000004020 conductor Substances 0.000 description 4
- 238000002161 passivation Methods 0.000 description 4
- 230000005533 two-dimensional electron gas Effects 0.000 description 4
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 239000011777 magnesium Substances 0.000 description 3
- 239000000203 mixture Substances 0.000 description 3
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- RNQKDQAVIXDKAG-UHFFFAOYSA-N aluminum gallium Chemical compound [Al].[Ga] RNQKDQAVIXDKAG-UHFFFAOYSA-N 0.000 description 2
- 230000004888 barrier function Effects 0.000 description 2
- PMHQVHHXPFUNSP-UHFFFAOYSA-M copper(1+);methylsulfanylmethane;bromide Chemical compound Br[Cu].CSC PMHQVHHXPFUNSP-UHFFFAOYSA-M 0.000 description 2
- 238000013461 design Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 238000002347 injection Methods 0.000 description 2
- 239000007924 injection Substances 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- IJGRMHOSHXDMSA-UHFFFAOYSA-N nitrogen Substances N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- 229910052757 nitrogen Inorganic materials 0.000 description 2
- -1 nitrogen ions Chemical class 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- BUHVIAUBTBOHAG-FOYDDCNASA-N (2r,3r,4s,5r)-2-[6-[[2-(3,5-dimethoxyphenyl)-2-(2-methylphenyl)ethyl]amino]purin-9-yl]-5-(hydroxymethyl)oxolane-3,4-diol Chemical compound COC1=CC(OC)=CC(C(CNC=2C=3N=CN(C=3N=CN=2)[C@H]2[C@@H]([C@H](O)[C@@H](CO)O2)O)C=2C(=CC=CC=2)C)=C1 BUHVIAUBTBOHAG-FOYDDCNASA-N 0.000 description 1
- PIGFYZPCRLYGLF-UHFFFAOYSA-N Aluminum nitride Chemical compound [Al]#N PIGFYZPCRLYGLF-UHFFFAOYSA-N 0.000 description 1
- MHYQBXJRURFKIN-UHFFFAOYSA-N C1(C=CC=C1)[Mg] Chemical compound C1(C=CC=C1)[Mg] MHYQBXJRURFKIN-UHFFFAOYSA-N 0.000 description 1
- FYYHWMGAXLPEAU-UHFFFAOYSA-N Magnesium Chemical compound [Mg] FYYHWMGAXLPEAU-UHFFFAOYSA-N 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- 238000005299 abrasion Methods 0.000 description 1
- 238000012993 chemical processing Methods 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 230000000779 depleting effect Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000011049 filling Methods 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 238000000227 grinding Methods 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 238000005468 ion implantation Methods 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 229910052749 magnesium Inorganic materials 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 238000012545 processing Methods 0.000 description 1
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 1
- 229910010271 silicon carbide Inorganic materials 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 238000000638 solvent extraction Methods 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 239000010936 titanium Substances 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
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- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
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- H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
- H01L27/085—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only
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Abstract
Eine Nitridhalbleitervorrichtung umfasst ein leitfähiges Substrat und eine Nitridhalbleiterschicht. Die Nitridhalbleitervorrichtung ist auf dem leitfähigen Substrat angeordnet. Die Nitridhalbleitervorrichtung umfasst eine erste Transistorstruktur einer lateralen Bauart und eine zweite Transistorstruktur einer lateralen Bauart umfasst. Das leitfähige Substrat umfasst ein erstes Potentialsteuergebiet und ein zweites Potentialsteuergebiet, das zur Steuerung eines Potentials unabhängig von dem ersten Potentialsteuergebiet befähigt ist. Bei einer Draufsicht auf die Nitridhalbleiterschicht überlappt die erste Transistorstruktur mit dem ersten Potentialsteuergebiet und die zweite Transistorstruktur überlappt mit dem zweiten Potentialsteuergebiet.
Description
- TECHNISCHES GEBIET
- Die vorliegende Erfindung betrifft eine Nitridhalbleitervorrichtung und ein Verfahren zu deren Herstellung.
- STAND DER TECHNIK
- Die Druckschrift ”GaN Monolithic Inverter IC using Normally-off Gate Injection Transistors with Planar Isolation on Si Substrate", IEDM Tech. Dig. 2009, S. 165–168” (nachstehend als Druckschrift 1 bezeichnet) offenbart eine Nitridhalbleitervorrichtung, die eine Vielzahl von in einer Nitridhalbleiterschicht bereitgestellten Transistorstrukturen aufweist. Bei der Nitridhalbleitervorrichtung gemäß der Druckschrift 1 ist eine Vielzahl von lateralen Transistorstrukturen in der in einem Siliziumsubstrat bereitgestellten Nitridhalbleiterschicht ausgebildet. In einer Nitridhalbleitervorrichtung ist ein Halbleiterschaltkreis durch Einbeziehung einer Vielzahl von Transistorstrukturen darin ausgebildet.
- ERFINDUNGSZUSAMMENFASSUNG
- Bei einer lateralen Nitridhalbleitervorrichtung kann es einen Fall geben, bei dem ein leitfähiges Substrat auf ein spezifisches Potential (z. B. Massepotential) festgelegt ist. Falls in diesem Fall die Transistorstrukturen unabhängig voneinander arbeiten, kann es einen Fall geben, bei dem eine Potentialdifferenz zwischen einer Hauptelektrode von jeder der Transistorstrukturen und dem leitfähigen Substrat unter den Transistorstrukturen variiert. Folglich können die Charakteristiken von jeder der Transistorstrukturen von einem Auslegungswert abweichen, und ein normaler Betrieb des Halbleiterschaltkreises kann scheitern, wodurch ein Mangel an Zuverlässigkeit bewirkt wird. Die vorliegende Erfindung stellt eine Technik bereit, eine Nitridhalbleitervorrichtung mit einer hohen Verlässlichkeit zu realisieren.
- Eine erfindungsgemäße Nitridhalbleitervorrichtung umfasst: ein leitfähiges Substrat mit einer Leitfähigkeitseigenschaft; und eine Nitridhalbleiterschicht, die auf dem leitfähigen Substrat angeordnet ist, sowie eine erste Transistorstruktur einer lateralen Bauart und eine zweite Transistorstruktur einer lateralen Bauart umfasst. Das leitfähige Substrat umfasst ein erstes Potentialsteuergebiet und ein zweites Potentialsteuergebiet. Das zweite Potentialsteuergebiet ist zur Steuerung des Potentials unabhängig von dem ersten Potentialsteuergebiet befähigt. Bei der erfindungsgemäßen Nitridhalbleitervorrichtung überlappt bei Draufsicht auf die Nitridhalbleiterschicht die erste Transistorstruktur mit dem ersten Potentialsteuergebiet. Bei der Draufsicht auf die Nitridhalbleiterschicht überlappt darüber hinaus die zweite Transistorstruktur mit dem zweiten Potentialsteuergebiet.
- Da das leitfähige Substrat eine Vielzahl von darin bereitgestellten Potentialsteuergebieten aufweist (das erste Potentialsteuergebiet und das zweite Potentialsteuergebiet), kann bei der vorstehend beschriebenen Nitridhalbleitervorrichtung das Potential des leitfähigen Substrates für jedes der Potentialsteuergebiete eingestellt werden. Folglich kann die Potentialdifferenz zwischen einem Paar von Hauptelektroden (typischerweise eine Elektrode auf einer Seite eines niedrigeren Potentials) und dem leitfähigen Substrat für jede der Transistorstrukturen eingestellt werden. Das bedeutet, die entsprechenden Potentialdifferenzen zwischen einer der Hauptelektroden und dem leitfähigen Substrat können bei allen der Transistorstrukturen gleich gemacht werden. Insbesondere umfasst die Definition ”die entsprechenden Potentialdifferenzen zwischen einer der Hauptelektroden und dem leitfähigen Substrat, die gleich sind” den Fall, dass die Potentialdifferenz null ist (d. h., den Fall eines Kurzschlusses). Darüber hinaus bedeutet die Definition ”die Nitridhalbleiterschicht, die eine erste Transistorstruktur einer lateralen Bauart und eine zweite Transistorstruktur einer lateralen Bauart umfasst”, dass zumindest zwei laterale Transistorstrukturen in der Nitridhalbleiterschicht angeordnet sind, und es kann einen Fall geben, bei dem drei oder mehr laterale Transistorstrukturen angeordnet sind. Ebenso können hinsichtlich des Begriffes ”leitfähiges Substrat” nur zumindest zwei Potentialsteuergebiete anzuordnen sein, und es kann einen Fall geben, bei dem drei oder mehr Potentialsteuergebiete angeordnet sind.
- Die Erfindung stellt ebenso ein Verfahren zur Herstellung einer Nitridhalbleitervorrichtung bereit. Das Herstellungsverfahren umfasst die Schritte: Ausbilden einer Nitridhalbleiterschicht; Ausbilden einer Vielzahl von Transistorstrukturen; und Auftrennen in Potentialsteuergebiete. Bei dem Ausbilden der Nitridhalbleiterschicht wird die Nitridhalbleiterschicht auf einem leitfähigen Substrat ausgebildet. Bei dem Ausbilden der Vielzahl von Transistorstrukturen wird eine Vielzahl von Transistorstrukturen in der Nitridhalbleiterschicht ausgebildet. Bei dem Auftrennen in die Potentialsteuergebiete wird das leitfähige Substrat in die Vielzahl von Potentialsteuergebiete aufgetrennt, die mit der Fähigkeit der Steuerung des Potentials unabhängig voneinander eingerichtet sind.
- KURZBESCHREIBUNG DER ZEICHNUNG
-
1 zeigt eine Schnittansicht einer Nitridhalbleitervorrichtung bei einem ersten Ausführungsbeispiel; -
2 zeigt eine Schnittansicht einer Nitridhalbleitervorrichtung bei einem zweiten Ausführungsbeispiel; -
3 zeigt eine Schnittansicht einer Nitridhalbleitervorrichtung bei einem dritten Ausführungsbeispiel; -
4 zeigt eine Schnittansicht einer Nitridhalbleitervorrichtung bei einem vierten Ausführungsbeispiel; -
5 zeigt einen Herstellungsschritt der Nitridhalbleitervorrichtung bei dem vierten Ausführungsbeispiel; -
6 zeigt einen Herstellungsschritt der Nitridhalbleitervorrichtung bei dem vierten Ausführungsbeispiel; -
7 zeigt einen Herstellungsschritt der Nitridhalbleitervorrichtung bei dem vierten Ausführungsbeispiel; -
8 zeigt einen Herstellungsschritt der Nitridhalbleitervorrichtung bei dem vierten Ausführungsbeispiel; und -
9 zeigt eine Darstellung eines Halbleiterschaltkreises, der von jeder der Nitridhalbleitervorrichtungen bei dem ersten bis vierten Ausführungsbeispiel ausgebildet ist. - AUSFÜHRLICHE BESCHREIBUNG
- Einige der hierin offenbarten technischen Merkmale sind nachstehend zusammengefasst. Insbesondere weist jeder der nachstehend beschriebenen Punkte eigenständige technische Nützlichkeit auf.
- Die erfindungsgemäße Nitridhalbleitervorrichtung umfasst ein leitfähiges Substrat und eine Nitridhalbleiterschicht. Als Material für das leitfähige Substrat können Silizium, Siliziumkarbid, Galliumnitrid, oder Ähnliches angewendet werden. Das leitfähige Substrat kann durch Einführen von Dotierstoffen in eines dieser Materialien ausgebildet werden. Insbesondere können die Dotierstoffe entweder n-Dotierstoffe oder p-Dotierstoffe sein. Das leitfähige Substrat kann in eine Vielzahl von Potentialsteuergebieten aufgetrennt sein, die mit der Fähigkeit der Steuerung des Potentials unabhängig voneinander eingerichtet sind. Die Vielzahl von Potentialsteuergebieten kann ein erstes Potentialsteuergebiet und ein zweites Potentialsteuergebiet aufweisen. Das bedeutet, das leitfähige Substrat kann zumindest das erste Potentialsteuergebiet und das zweite Potentialsteuergebiet umfassen, das zur Steuerung des Potentials unabhängig von dem ersten Potentialsteuergebiet befähigt ist.
- Jedes der Potentialsteuergebiete kann von einem anderen Potentialsteuergebiet durch ein Isolationsgebiet isoliert sein. Das bedeutet, zwischen dem ersten Potentialsteuergebiet und dem zweiten Potentialsteuergebiet kann das Isolationssteuergebiet bereitgestellt sein, das zur elektrischen Isolation des ersten Potentialsteuergebietes und des zweiten Potentialsteuergebietes eingerichtet ist. Das Isolationsgebiet kann eine Isolationseigenschaft aufweisen. Das Isolationsgebiet kann durch eine physikalische Verarbeitung des leitfähigen Substrates ausgebildet sein. Beispielsweise kann ein Teil des leitfähigen Substrates zur Bereitstellung eines Graben angeätzt sein, der sich von einer vorderen Oberfläche zu einer hinteren Oberfläche des leitfähigen Substrates erstreckt, und die Potentialsteuergebiete können voneinander durch den Graben isoliert sein. In diesem Fall ist der Graben das Isolationsgebiet. Insbesondere kann ein Isolator in dem Graben eingebettet sein. Als Isolator kann beispielsweise Polyimid angegeben sein. Alternativ kann das Isolationsgebiet durch eine chemische Verarbeitung des leitfähigen Substrates ausgebildet sein. Zum Beispiel kann ein Teil des leitfähigen Substrates oxidiert sein, um dabei ein Isolationsgebiet auszubilden.
- Die Nitridhalbleiterschicht ist auf dem leitfähigen Substrat bereitgestellt. Die Nitridhalbleiterschicht kann eine Schicht sein, deren allgemeine Formel als InXAlYGa1-X-YN (0 ≤ X ≤ 1, 0 ≤ Y ≤ 1, 0 ≤ 1 – X – Y ≤ 1) wiedergegeben werden kann. Die Nitridhalbleiterschicht kann eine Schicht sein, die durch Stapeln von Nitridhalbleitern mit unterschiedlichen Zusammensetzungen erhalten wird. Beispielsweise kann die Nitridhalbleiterschicht einen Heteroübergang umfassen. Bei einem Teil einer vorderen Oberfläche der Heteroübergangsschicht kann ein p-Nitridhalbleitergebiet bereitgestellt sein. Das p-Nitridhalbleitergebiet kann eine Wirkung aufweisen, dass ein Teil einer zweidimensionalen Elektronengasschicht, die sich nahe einer Heteroübergangsgrenzschicht ausbildet, verarmt wird. Die Nitridhalbleiterschicht kann eine epitaxiale Schicht sein. Insbesondere kann die Nitridhalbleiterschicht auf dem leitfähigen Substrat mit einer dazwischen eingebrachten Pufferschicht bereitgestellt sein. Die Pufferschicht kann ein anderer Nitridhalbleiter sein mit einer Zusammensetzung, die von der Zusammensetzung der Nitridhalbleiterschicht unterschiedlich ist. Darüber hinaus kann die Pufferschicht einen höheren Widerstand als das leitfähige Substrat aufweisen. Mit einem höheren Widerstand kann die Pufferschicht verhindern, dass die Potentialsteuergebiete in eine leitfähige Verbindung miteinander gebracht werden, und unabsichtlich äquipotential sind. Falls insbesondere das leitfähige Substrat und die Nitridhalbleiterschicht aus demselben Material ausgebildet sind, kann auf die Pufferschicht verzichtet werden. In diesem Fall kann eine Halbleiterschicht mit einem höheren Widerstand als das leitfähige Substrat zwischen dem leitfähigen Substrat und der Nitridhalbleiterschicht bereitgestellt sein.
- Innerhalb der Nitridhalbleiterschicht kann eine Vielzahl von lateralen Transistorstrukturen bereitgestellt sein. Die Vielzahl von lateralen Transistorstrukturen kann eine erste Transistorstruktur und eine zweite Transistorstruktur aufweisen. Das bedeutet, die Nitridhalbleiterschicht kann darin ausgebildet zumindest eine erste Transistorstruktur einer lateralen Bauart und eine zweite Transistorstruktur einer lateralen Bauart aufweisen. Die erste Transistorstruktur kann in der Nitridhalbleiterschicht angeordnet sein, sodass sie dem vorstehend beschriebenen ersten Potentialsteuergebiet entspricht, und die zweite Transistorstruktur kann in der Nitridhalbleiterschicht so angeordnet sein, dass sie dem vorstehend beschriebenen zweiten Potentialsteuergebiet entspricht. Bei einer Draufsicht auf die Nitridhalbleiterschicht kann insbesondere die erste Transistorstruktur mit dem ersten Potentialsteuergebiet, und die zweite Transistorstruktur mit dem zweiten Potentialsteuergebiet überlappen.
- Insbesondere bedeutet der vorstehend beschriebene Begriff ”überlappen” nicht, dass in der Draufsicht die erste Transistorstruktur vollständig mit dem ersten Potentialsteuergebiet übereinstimmt (die zweite Transistorstruktur vollständig mit dem zweiten Potentialsteuergebiet übereinstimmt). Solange der größte Teil der ersten Transistorstruktur mit dem ersten Potentialsteuergebiet überlappt, kann beispielsweise ein Teil der ersten Transistorstruktur mit dem zweiten Potentialsteuergebiet überlappen. In gleicher Weise kann ein Teil der zweiten Transistorstruktur mit dem ersten Potentialsteuergebiet überlappen, solange der größte Teil der zweiten Transistorstruktur mit dem zweiten Potentialsteuergebiet überlappt. Im Einzelnen muss bei der Draufsicht ein Raum zwischen einem Paar der Hauptelektroden bei der ersten Transistorstruktur nur innerhalb des ersten Potentialsteuergebietes gelegen sein, und ein Äußeres des Raums zwischen dem Paar der Hauptelektroden kann innerhalb des zweiten Potentialsteuergebietes gelegen sein. Ein Raum zwischen einem Paar von Hauptelektroden bei der zweiten Transistorstruktur muss gleichermaßen nur innerhalb des zweiten Potentialsteuergebietes gelegen sein, und ein Äußeres des Raums zwischen dem Paar der Hauptelektroden kann innerhalb des ersten Potentialsteuergebietes gelegen sein.
- Jede der Transistorstrukturen kann ein Schottky-Gatetransistor, ein MOS-Transistor, oder Ähnliches sein. Darüber hinaus kann eine andere Halbleitstruktur als die laterale Transistorstruktur innerhalb der Nitridhalbleiterschicht bereitgestellt sein. Beispielsweise kann eine laterale Diodenstruktur in der Nitridhalbleiterschicht bereitgestellt sein. Die Diodenstruktur kann eine PN-Diode, eine Schottky-Barrierendiode mit einer JBS-Struktur (Schottky-Barrieren-Übergang), oder Ähnliches sein.
- Innerhalb der Nitridhalbleiterschicht kann eine Bauelementisolationsstruktur bereitgestellt sein, die zur elektrischen Isolation der Vielzahl von Transistorstrukturen voneinander eingerichtet ist. Die Bauelementisolationsstruktur kann die Transistorstruktur und die Diodenstruktur elektrisch isolieren. Bei der Draufsicht auf die Nitridhalbleiterschicht kann die Bauelementisolationsstruktur mit dem vorstehend beschriebenen Isolationsgebiet überlappen. Die Bauelementisolationsstruktur kann durch Ionenimplantation in einen Teil der vorderen Oberfläche der Nitridhalbleiterschicht ausgebildet sein. Insbesondere beabsichtigt der Begriff ”überlappen” hierbei ebenfalls nicht, dass die Bauelementisolationsstruktur vollständig mit dem Isolationsgebiet überlappen soll. Zumindest ein Teil der Bauelementisolationsstruktur kann mit nur einem Teil des Isolationsgebietes überlappen.
- Das leitfähige Substrat kann an einer hinteren Oberfläche der Nitridhalbleiterschicht bereitgestellt sein, und das zu der Transistorstruktur verbundene Paar von Hauptelektroden kann auf der vorderen Oberfläche der Nitridhalbleiterschicht bereitgestellt sein. Das Paar der Hauptelektroden kann eine Elektrode auf einer Seite eines höheren Potentials, die zu einer Seite eines höheren Potentials verbunden ist, und eine Elektrode auf einer Seite eines niedrigeren Potentials, die zu einer Seite eines niedrigeren Potentials verbunden ist, umfassen. Darüber hinaus kann jede des Paares von Hauptelektroden zu dem entsprechenden Potentialsteuergebiet kurzgeschlossen sein. Im Einzelnen kann eine der ersten Transistorstruktur entsprechende des Paares von Hauptelektroden zu dem ersten Potentialsteuergebiet kurzgeschlossen sein, und eine der zweiten Transistorstruktur entsprechende des Paares von Hauptelektroden kann zu dem zweiten Potentialsteuergebiet kurzgeschlossen sein.
- Eine der vorstehend beschriebenen Hauptelektroden kann zu dem Potentialsteuergebiet über eine Leiterbahn verbunden sein. Alternativ kann ein sich von der vorderen Oberfläche der Nitridhalbleiterschicht zu dem leitfähigen Substrat erstreckendes Durchgangsloch bereitgestellt, und das Durchgangsloch kann mit einem leitfähigen Element gefüllt sein, sowie eine der vorstehend beschriebenen Hauptelektroden und das Potentialsteuergebiet können über das leitfähige Element verbunden sein. Insbesondere kann die Nitridhalbleitervorrichtung ein leitfähiges Teil aufweisen, mit dem das sich von der vorderen Oberfläche zu der hinteren Oberfläche der Nitridhalbleiterschicht erstreckende Durchgangsloch gefüllt ist. Im Einzelnen kann eine Vielzahl von sich jeweils von der vorderen Oberfläche zu der hinteren Oberfläche der Nitridhalbleiterschicht erstreckenden Durchgangslöchern bereitgestellt sein, und jedes der Durchgangslöcher kann mit dem leitfähigen Element gefüllt sein. Die Vielzahl von leitfähigen Elementen kann ein erstes leitfähiges Element und ein zweites leitfähiges Element aufweisen. In diesem Fall kann eine der ersten Transistorstruktur entsprechende der Hauptelektroden zu dem ersten Potentialsteuergebiet über das erste leitfähige Element kurzgeschlossen sein, und eine der zweiten Transistorstruktur entsprechende der Hauptelektroden kann zu dem zweiten Potentialsteuergebiet über das zweite leitfähige Element kurzgeschlossen sein. Insbesondere kann die Elektrode auf der Seite des niedrigeren Potentials von dem Paar der Hauptelektroden zu dem Potentialsteuergebiet kurzgeschlossen sein.
- Gemäß dem erfindungsgemäßen Herstellungsverfahren wird eine Nitridhalbleitervorrichtung mit einer Vielzahl von Transistorstrukturen, die in einer auf einem leitfähigen Substrat bereitgestellten Nitridhalbleiterschicht bereitgestellt sind, erhalten. Das Herstellungsverfahren kann die Schritte umfassen: Ausbilden einer Nitridhalbleiterschicht; Ausbilden einer Vielzahl von Transistorstrukturen; und Auftrennen in Potentialsteuergebiete. Bei dem Ausbilden der Nitridhalbleiterschicht wird die Nitridhalbleiterschicht auf einem leitfähigen Substrat ausgebildet. Bei dem Ausbilden der Transistorstrukturen wird eine Vielzahl von Transistorstrukturen in der Nitridhalbleiterschicht ausgebildet. Bei dem Auftrennen in die Potentialsteuergebiete wird das leitfähige Substrat in eine Vielzahl von Potentialsteuergebieten aufgetrennt, die zur Fähigkeit des Steuerns des Potentials unabhängig voneinander eingerichtet sind. Jeder der Schritte der Vielzahl von Transistorstrukturen oder des Auftrennens in die Potentialsteuergebiete kann vor dem anderen durchgeführt werden. Darüber hinaus kann das Ausbilden der Vielzahl von Transistorstrukturen während des Auftrennens in die Potentialsteuergebiete durchgeführt werden. Insbesondere kann die Nitridhalbleiterschicht auf dem leitfähigen Substrat durch Zusammenfügen des leitfähigen Substrates und der Nitridhalbleiterschicht bereitgestellt werden. Alternativ kann die Nitridhalbleiterschicht auf dem leitfähigen Substrat kristallin aufgewachsen (epitaxial aufgewachsen) werden. Eine Pufferschicht kann auf dem leitfähigen Substrat aufgewachsen werden, und nachfolgend kann die Nitridhalbleiterschicht kristallin aufgewachsen werden. Falls die Nitridhalbleiterschicht epitaxial aufgewachsen werden soll, kann insbesondere beispielsweise kein SOI-Substrat für das epitaxiale Wachstum verwendet werden. Das bedeutet, die Nitridhalbleiterschicht kann nicht von dem leitfähigen Substrat isoliert werden, und jede der Transistorstrukturen ist unweigerlich durch das Potential des leitfähigen Substrates betroffen. Die vorliegend offenbarte Technik ist in dem Fall nützlich, dass die Nitridhalbleiterschicht eine epitaxiale Schicht ist.
- Bei dem Auftrennen in die Potentialsteuergebiete kann ein sich von der vorderen Oberfläche zu der hinteren Oberfläche des leitfähigen Substrates erstreckender Graben ausgebildet werden. Durch Ausbilden des Grabens wird das leitfähige Substrat zur Ausbildung einer Vielzahl von Potentialsteuergebieten dabei physisch aufgeteilt, die gegenseitig isoliert (elektrisch unabhängig) sind. Bei dem Auftrennen in die Potentialsteuergebiete kann eine Dicke des leitfähigen Substrates vor Ausbildung des Grabens verringert werden. Eine Tiefe des Grabens kann flach gemacht werden, wodurch das Auftrennen in die Potentialsteuergebiete erleichtert wird (Ätzen). Darüber hinaus kann bei dem Auftrennen in die Potentialsteuergebiete der Graben mit einem Isolationsmaterial nach dem Ausbilden des Grabens aufgefüllt werden. Insbesondere kann bei dem Auftrennen in die Potentialsteuergebiete zur Auftrennung des leitfähigen Substrates in eine Vielzahl von Potentialsteuergebieten dadurch ein Teil des leitfähigen Substrates derart geändert werden, dass es eine Isolationseigenschaft aufweist.
- Ausführungsformen
- Eine Nitridhalbleitervorrichtung
100 ist nachstehend unter Bezugnahme auf1 beschrieben. Die Nitridhalbleitervorrichtung100 weist eine in einer gemeinsamen Nitridhalbleiterschicht12 bereitgestellte Vielzahl von Transistorstrukturen auf. Insbesondere umfasst die Nitridhalbleitervorrichtung100 eine erste Transistorstruktur50a , eine zweite Transistorstruktur50b und eine dritte Transistorstruktur50c . Jede der Transistorstrukturen50a ,50b und50c ist eine laterale Transistorstruktur. Insbesondere kann in der nachstehenden Beschreibung die Buchstaben a, b und c wegelassen sein, falls eine den Transistorstrukturen50a ,50b und50c gemeinsame Struktur beschrieben ist. - Die Nitridhalbleiterschicht
12 ist an einer vorderen Oberfläche eines Siliziumsubstrates2 mit einer dazwischen eingefügten Pufferschicht4 bereitgestellt. Das Siliziumsubstrat2 weist darin eingebrachte p-Dotierstoffe auf. Die Dicke des Siliziumsubstrates2 ist auf 400 bis 600 μm eingestellt. Das Siliziumsubstrat2 ist ein Beispiel eines leitfähigen Substrates. Darüber hinaus ist ein Material der Pufferschicht4 Aluminiumnitrid (AlN). Die Nitridhalbleiterschicht12 umfasst eine erste Nitridhalbleiterschicht6 , eine zweite Nitridhalbleiterschicht8 und eine dritte Nitridhalbleiterschicht10 . Die zweite Nitridhalbleiterschicht8 ist auf einer vorderen Oberfläche der ersten Nitridhalbleiterschicht6 bereitgestellt, und die Nitridhalbleiterschicht10 ist auf einer vorderen Oberfläche der zweiten Nitridhalbleiterschicht8 bereitgestellt. Die Nitridhalbleiterschicht10 ist auf einem Teil einer vorderen Oberfläche der zweiten Nitridhalbleiterschicht8 bereitgestellt. Ein Material der ersten Nitridhalbleiterschicht6 ist Galliumnitrid (GaN), ein Material der zweiten Nitridhalbleiterschicht8 ist Aluminiumgalliumnitrid (AlGaN) und ein Material der dritten Nitridhalbleiterschicht10 ist Galliumnitrid. Die erste Nitridhalbleiterschicht6 und die zweite Nitridhalbleiterschicht8 bilden einen Heteroübergang. Jede der Nitridhalbleiterschichten6 und8 ist undotiert, während die dritte Nitridhalbleiterschicht10 Magnesium (Mg) als p-Dotierstoff enthält. Eine Dotierstoffkonzentration der dritten Nitridhalbleiterschicht10 ist auf 7 × 1018 bis 2 × 1019 cm–3 eingestellt. Insbesondere kann als Material der Pufferschicht4 Aluminiumgalliumnitrid ebenso anstelle des Aluminiumnitrids verwendet werden. Bauelementisolationsstrukturen24 sind in der Nitridhalbleiterschicht12 bereitgestellt. Jede Bauelementisolationsstruktur24 erstreckt sich von der vorderen Oberfläche der zweiten Nitridhalbleiterschicht8 zu einer Innenseite der ersten Nitridhalbleiterschicht6 . Das bedeutet, die Bauelementisolationsstrukturen24 unterteilen eine Heteroübergangsgrenzschicht zwischen den ersten und zweiten Nitridhalbleiterschichten6 und8 . Die Transistorstrukturen50a ,50b und50c sind elektrisch voneinander durch die Bauelementisolationsstrukturen24 getrennt. Das bedeutet, ein Bereich von jeder der Transistorstrukturen50a ,50b und50c ist durch die benachbarten Bauelementisolationsstrukturen24 abgegrenzt. Insbesondere sind die Bauelementisolationsstrukturen24 durch das Einbringen von Stickstoffionen (N) in die Nitridhalbleiterschicht12 ausgebildet. - Auf einer vorderen Oberfläche der Nitridhalbleiterschicht
12 sind eine Sourceelektrode14 , eine Drainelektrode22 und eine Gateelektrode18 bereitgestellt. Die Sourceelektrode14 und die Drainelektrode22 sind auf der vorderen Oberfläche der zweiten Nitridhalbleiterschicht8 einzeln bereitgestellt. Die Gateelektrode18 ist an einer vorderen Oberfläche der dritten Nitridhalbleiterschicht10 bereitgestellt. Die Gateelektrode18 und die dritte Nitridhalbleiterschicht10 bilden einen Gateabschnitt20 jeder Transistorstruktur50 . Der Gateabschnitt20 ist zwischen der Sourceelektrode14 und der Drainelektrode22 bereitgestellt. Ein Material der Gateelektrode18 ist Nickel (Ni). Jede der Sourceelektrode14 und der Drainelektrode22 ist eine geschichtete Elektrode, die aus Titan und Aluminium ausgebildet ist. Die Sourceelektrode14 und die Drainelektrode22 sind von dem Gateabschnitt20 durch eine Passivierungsschicht16 isoliert. Als Passivierungsschicht16 wird Siliziumnitrid (SiN), Siliziumoxid (SiO2), oder Ähnliches angewendet. - Das Siliziumsubstrat
2 weist eine Vielzahl von darin ausgebildeten Gräben28 auf. Jeder der Gräben28 erstreckt sich von der vorderen Oberfläche (auf einer Seite der Nitridhalbleiterschicht12 ) zu einer hinteren Oberfläche des Siliziumsubstrates2 . Jeder Graben28 ist mit Polyimid26 gefüllt. Das Siliziumsubstrat2 wird durch die Gräben28 in ein erstes Potentialsteuergebiet2a , ein zweites Potentialsteuergebiet2b und ein drittes Potentialsteuergebiet2c aufgeteilt. Die Potentialsteuergebiete2a ,2b und2c sind voneinander isoliert, und zur Steuerung eines Potentials unabhängig voneinander befähigt. Jeder der Gräben28 ist zu dem in dem Siliziumsubstrat2 bereitgestellten Isolationsgebiet äquivalent. Das erste Potentialsteuergebiet2a ist zu der Sourceelektrode14a , das zweite Potentialsteuergebiet2b ist zu der Sourceelektrode14b und das dritte Potentialsteuergebiet2c ist zu der Sourceelektrode14c durch entsprechende (nicht gezeigte) Leiterbahnen verbunden. Bei einer Draufsicht auf die Nitridhalbleiterschicht12 (d. h. bei Betrachtung entlang einer Richtung orthogonal auf die vordere Oberfläche der Nitridhalbleiterschicht12 ) überlappen insbesondere die Gräben28 mit den Bauelementisolationsstrukturen24 . - Die ersten, zweiten und dritten Transistorstrukturen
50a ,50b und50c sind in der Nitridhalbleiterschicht12 platziert, um den ersten, zweiten und dritten Potentialsteuergebieten2a ,2b und2c jeweils zu entsprechen. Im Einzelnen überlappen bei der Draufsicht auf die Nitridhalbleiterschicht12 die erste Transistorstruktur50a mit dem ersten Potentialsteuergebiet2a , die zweite Transistorstruktur50b überlappt mit dem zweiten Potentialsteuergebiet2b und die dritte Transistorstruktur50c überlappt mit dem dritten Potentialsteuergebiet2c . Insbesondere werden gemäß nachstehender ausführlicher Beschreibung die Gräben28 durch Ätzen eines Teils des Siliziumsubstrates von der hinteren Oberfläche (in Richtung der Seite der Nitridhalbleiterschicht12 ) ausgebildet. Bei dieser Gelegenheit können die Böden der Gräben28 eine Innenseite der Pufferschicht4 erreichen. - Nachstehend ist die Transistorstruktur
50 beschrieben. Die Transistorstruktur50 ist ein HFET (Heterostruktur-Feldeffekttransistor) der selbstsperrenden (sog. normalerweise abgeschalteten) Bauart, und verwendet als Kanal eine nahe der Heteroübergangsgrenzschicht ausgebildete zweidimensionale Elektronengasschicht. Falls im Einzelnen eine positive Spannung an die Drainelektrode22 angelegt, eine Massespannung an die Sourceelektrode14 angelegt und eine positive Spannung (eine AN-Spannung) an den Gateabschnitt20 angelegt wird, passieren von der Sourceelektrode14 implantierte Elektronen die zweidimensionale Elektronengasschicht, und bewegen sich in Richtung der Drainelektrode22 . Falls an den Gateabschnitt20 keine AN-Spannung angelegt wird, erstreckt sich eine Verarmungsschicht von der Nitridhalbleiterschicht10 in Richtung der Heteroübergangsgrenzschicht. Die Verarmungsschicht verarmt die Elektronen in der zweidimensionalen Elektronengasschicht, wodurch bewirkt wird, dass die Bewegung der Elektronen von der Sourceelektrode14 in Richtung der Drainelektrode22 gestoppt wird. Das bedeutet, falls an den Gateabschnitt20 keine AN-Spannung angelegt wird, behält die Transistorstruktur50 einen AUS-Zustand bei, und falls eine AN-Spannung an den Gateabschnitt20 angelegt wird, schaltet die Transistorstruktur50 zu einem AN-Zustand. Die Transistorstruktur50 ist ein Transistor einer selbstsperrenden Bauart. - Gemäß vorstehender Beschreibung sind bei der Nitridhalbleitervorrichtung
100 die Potentialsteuergebiete2a ,2b und2c befähigt, voneinander unabhängig ein Potential zu steuern. Auch, falls die Sourceelektroden14a ,14b und14c unterschiedliche Potentiale aufweisen, kann dementsprechend sichergestellt werden, dass die entsprechenden Transistorstrukturen50a ,50b und50c zwischen der Sourceelektrode14 und dem Potentialsteuergebiet (dem Siliziumsubstrat)2 dieselbe Potentialdifferenz zeigen (oder keine Potentialdifferenz zeigen). Eine Abweichung eines Betriebs von jeder der Transistorstrukturen50a ,50b und50c von einem Auslegungswert kann gehemmt werden. - Nachstehend ist unter Bezugnahme auf
9 ein Halbleiterschaltkreis60 , der die Nitridhalbleitervorrichtung100 verwendet, beschrieben. Der Halbleiterschaltkreis60 umfasst vier Transistoren70 ,72 ,74 und76 . Die Transistoren70 ,72 ,74 und76 bilden einen vollständigen Brückenschaltkreis. Im Einzelnen sind die Transistoren70 und72 in Serie, die Transistoren74 und76 sind in Serie und die Transistoren70 und74 sind parallel verbunden. Eine Eingabe-/Ausgabeleiterbahn65 ist zwischen den Transistoren70 und72 verbunden. Darüber hinaus ist eine Eingabe-/Ausgabeleiterbahn63 zwischen den Transistoren74 und76 verbunden. - Die Transistoren
70 und74 sind zu einer Leiterbahn62 eines höheren Potentials verbunden und bilden einen oberen Schaltkreiszweig. Die Transistoren72 und76 sind zu einer Leiterbahn64 eines niedrigeren Potentials verbunden und bilden einen unteren Schaltkreiszweig. Gateleiterbahnen70g ,72g ,74g und76g sind zu den jeweiligen Transistoren70 ,72 ,74 und76 verbunden. Jede der Gateleiterbahnen70g ,72g ,74g und76g ist zu einer Steuerung66 verbunden. Die Steuerung66 kann unterschiedliche Steuerungssignale zu den jeweiligen Gateleiterbahnen70g ,72g ,74g und76g ausgeben. Das bedeutet, die Transistoren70 ,72 ,74 und76 können unabhängig voneinander angesteuert werden. Darüber hinaus sind Feedbackdioden70a ,72a ,74a und76a zu den jeweiligen Transistoren70 ,72 ,74 und76 verbunden. - Die Transistorstrukturen
50a ,50b und50c gemäß1 können für jeden der Transistoren70 ,72 ,74 und76 angewendet werden. Zum Beispiel kann die erste Transistorstruktur50a den Transistor70 bilden, die zweite Transistorstruktur50b kann den Transistor74 bilden und die dritte Transistorstruktur50c kann den Transistor72 bilden. Insbesondere kann eine Transistorstruktur, die dem Transistor76 entspricht, in der Nitridhalbleiterschicht12 bereitgestellt sein. In diesem Fall variiert ein Source-Potential jedes der Transistoren70 und74 (der Transistorstrukturen50a und50b ). Im Fall der Nitridhalbleitervorrichtung100 jedoch sind das zu der Sourceelektrode14a verbundene erste Potentialsteuergebiet2a und das zu der Sourceelektrode14b verbundene zweite Potentialsteuergebiet2b von anderen Potentialsteuergebieten elektrisch unabhängig. Dementsprechend kann die Potentialdifferenz zwischen der Sourceelektrode und dem Potentialsteuergebiet (dem Substrat) in jeder der Transistorstrukturen50a und50b gleich der Potentialdifferenz zwischen der Sourceelektrode und dem Potentialsteuergebiet in jeder der anderen Transistorstrukturen gleichgemacht werden. Insbesondere variiert bei der Halbleiterschaltung60 das Source-Potential von jedem der Transistoren72 und76 nicht. Dementsprechend können die Sourceelektroden der Transistoren72 und76 zu einem gemeinsamen Potentialsteuergebiet verbunden sein. Falls beispielsweise die dritte Transistorstruktur50c gemäß1 den Transistor72 gemäß9 bildet, und falls die Transistorstruktur, die dem Transistor76 entspricht, in der Nitridhalbleiterschicht12 bereitzustellen ist, kann ein Potentialsteuergebiet in dieser Transistorstruktur in leitfähiger Verbindung mit dem Potentialsteuergebiet2c in der Transistorstruktur50c stehen. Jedoch können die Sourceelektroden der Transistoren72 und76 zu den Potentialsteuergebieten verbunden sein, die jeweils zur unabhängigen Steuerung der Potentiale befähigt sind. Beispielsweise kann die erste Transistorstruktur50a den Transistor72 , und die zweite Transistorstruktur50b kann den Transistor76 bilden. In diesem Fall stehen das Potentialsteuergebiet2a in dem Transistor72 und das Potentialsteuergebiet2b in dem Transistor76 nicht in leitfähiger Verbindung, und sind zur unabhängigen Steuerung eines Potentials befähigt. - Alternativ kann die erste Struktur
50a den Transistor70 bilden, die zweite Transistorstruktur50b kann den Transistor72 bilden und die dritte Transistorstruktur50c kann den Transistor76 bilden. Auch in diesem Fall sind das erste Potentialsteuergebiet2a und das zweite Potentialsteuergebiet2b elektrisch unabhängig, und somit kann sichergestellt werden, dass die Transistoren70 und72 die gleiche Potentialdifferenz zwischen der Sourceelektrode und dem Potentialsteuergebiet zeigen. Insbesondere kann auch in diesem Fall eine Transistorstruktur, die dem Transistor74 entspricht, in der Nitridhalbleiterschicht12 bereitgestellt werden. - Nachstehend ist unter Bezugnahme auf
2 eine Nitridhalbleitervorrichtung200 bei einem zweiten Ausführungsbeispiel beschrieben. Die Nitridhalbleitervorrichtung200 ist eine Abwandlung der Nitridhalbleitervorrichtung100 , und unterscheidet sich von der Nitridhalbleitervorrichtung100 darin, dass eine Diodenstruktur in der Nitridhalbleiterschicht12 bereitgestellt ist. Hinsichtlich der Nitridhalbleitervorrichtung200 ist die Beschreibung von zu denen der Nitridhalbleitervorrichtung100 gleichen Strukturen durch Anfügen derselben Bezugszeichen wie denen an die Nitridhalbleitervorrichtung100 weggelassen. - Die Nitridhalbleitervorrichtung
200 umfasst die erste Transistorstruktur50a , die zweite Transistorstruktur50b und eine Diode50d . Die Diode50d umfasst die Nitridhalbleiterschicht12 , eine Anodenelektrode32 , und eine Kathodenelektrode30 . Die Anodenelektrode32 und die Kathodenelektrode30 sind voneinander entfernt auf der Nitridhalbleiterschicht12 platziert. Die Anodenelektrode32 und die Kathodenelektrode30 sind gegeneinander durch die Passivierungsschicht16 isoliert. Auch bei der Nitridhalbleitervorrichtung200 kann jede der ersten und zweiten Transistorstrukturen50a und50b jeden der Transistoren70 ,72 ,74 und76 bilden (siehe9 ). Darüber hinaus kann die Diode50d jede der Dioden70a ,72a ,74a und76a bilden. Insbesondere können alle der Transistoren70 ,72 ,74 und76 und der Dioden70a ,72a ,74a und76a gemäß9 in der Nitridhalbleiterschicht12 bereitgestellt sein. - Eine Nitridhalbleitervorrichtung
300 bei einem dritten Ausführungsbeispiel ist nachstehend unter Bezugnahme auf3 beschrieben. Die Nitridhalbleitervorrichtung300 ist eine Abwandlung der Nitridhalbleitervorrichtung100 , und unterscheidet sich von der Nitridhalbleitervorrichtung100 darin, wie die Sourceelektrode14 und das Siliziumsubstrat2 (jeder der Potentialsteuergebiete2a bis2c ) verbunden sind. Hinsichtlich der Nitridhalbleitervorrichtung300 ist die Beschreibung von zu denen der Nitridhalbleitervorrichtung100 gleichen Strukturen durch Anfügen derselben Bezugszeichen wie denen an die Nitridhalbleitervorrichtung100 weggelassen. - Bei der Nitridhalbleitervorrichtung
300 sind Durchgangslöcher42 bereitgestellt, die sich jeweils von der vorderen Oberfläche der Nitridhalbleiterschicht12 zu dem Siliziumsubstrat2 erstrecken. Jedes der Durchgangslöcher42 ist mit einem leitfähigen Element40 gefüllt. Ein Material des leitfähigen Elementes40 ist Aluminium. Das Durchgangsloch42 wird mit dem leitfähigen Element40 durch eine Sputter-Methode oder Ähnliches gefüllt. Das leitfähige Element40 verbindet jede Sourceelektrode14 und die dieser Sourceelektrode entsprechenden Potentialsteuergebiete2a ,2b oder2c . Das bedeutet, das leitfähige Element40 schließt die Sourceelektrode14a und das erste Potentialsteuergebiet2a , die Sourceelektrode14b und das zweite Potentialsteuergebiet2b , und die Sourceelektrode14c und das dritte Potentialsteuergebiet2c kurz. Durch Verwendung der in der Nitridhalbleiterschicht12 platzierten leitfähigen Elemente40 kann bei der Nitridhalbleitervorrichtung300 entsprechend auf die Sourceelektroden14 und die Potentialsteuergebiete2a bis2c verbindende Leiterbahnen verzichtet werden. Insbesondere isoliert jedes Durchgangsloch42 nicht die Transistorstrukturen50a ,50b und50c voneinander. An einer Innenseite jeder der Transistorstrukturen50a ,50b und50c erstreckt sich das Durchgangsloch42 von der vorderen Oberfläche der Nitridhalbleiterschicht12 zu dem Siliziumsubstrat2 . - Nachstehend ist unter Bezugnahme auf
4 bei einem vierten Ausführungsbeispiel eine Nitridhalbleitervorrichtung400 beschrieben. Die Nitridhalbleitervorrichtung400 ist eine Abwandlung der Nitridhalbleitervorrichtung100 , und eine Dicke eines Siliziumsubstrates402 unterscheidet sich von der Dicke des Siliziumsubstrates2 bei der Nitridhalbleitervorrichtung100 . Im Einzelnen ist die Dicke des Siliziumsubstrates402 auf 50 bis 100 μm eingestellt. In dem Siliziumsubstrat402 sind Gräben428 bereitgestellt, und die Gräben428 sind mit Polyimid426 befüllt. Andere Strukturen der Nitridhalbleitervorrichtung400 sind denen bei der Nitridhalbleitervorrichtung100 gleich, und somit ist die Beschreibung durch Anfügen derselben Bezugszeichen wie denen an die Nitridhalbleitervorrichtung100 weggelassen. - Nachstehend ist ein Verfahren zur Herstellung der Nitridhalbleitervorrichtung
400 unter Bezugnahme auf die5 bis8 beschrieben. Zunächst wird gemäß5 die Pufferschicht4 , deren Material AlN ist, auf einer vorderen Oberfläche eines Siliziumsubstrates402d aufgewachsen. Die Pufferschicht4 wird bei ungefähr 700°C aufgewachsen. Danach wird die erste Nitridhalbleiterschicht6 , deren Material GaN ist, kristallin aufgewachsen, die zweite Nitridhalbleiterschicht8 , deren Material AlGaN ist, kristallin aufgewachsen, und die dritte Nitridhalbleiterschicht10d , deren Material GaN ist, kristallin aufgewachsen. Ein Ausbildungsschritt einer Nitridhalbleiterschicht ist abgeschlossen. Falls die dritte Nitridhalbleiterschicht10d kristallin aufgewachsen wird, wird Cp2Mg (Cyclopentadienylmagnesium) in ein Ausgangsmaterialgas eingeführt. Jede der Nitridhalbleiterschichten6 ,8 und10d wird bei ungefähr 1000°C kristallin aufgewachsen. Insbesondere ist eine Dicke des Siliziumsubstrates402d auf 400 bis 600 μm eingestellt. Insbesondere kann die Pufferschicht4 , deren Material AlGaN ist, auf einer vorderen Oberfläche des Siliziumsubstrates402d aufgewachsen werden. - Nachfolgend wird zum Abschließen des Siliziumsubstrates
402 gemäß6 eine hintere Oberfläche des Siliziumsubstrates402d abgeschliffen, dessen Dicke auf 50 bis 100 μm eingestellt ist. Die Dicke des Siliziumsubstrates402 gemäß6 ist dieselbe wie die Dicke des Siliziumsubstrates402 gemäß4 . Nachfolgend wird gemäß7 ein Teil des Siliziumsubstrates402 zur Ausbildung der Gräben428 angeätzt. Die Gräben428 sind den Gräben428 gemäß4 äquivalent. Durch Abschleifen des Siliziumsubstrates402d kann die Tiefe des Grabens428 verringert werden, wodurch ein Ausbildungsschritt der Gräben erleichtert wird (siehe1 zum Vergleich). Der Ausbildungsschritt der Gräben428 bewirkt, dass das Siliziumsubstrat402 in Potentialsteuergebiete402a ,402b und402c aufgeteilt wird. - Nachfolgend werden zur Ausbildung der Transistorstrukturen
50 gemäß8 die Sourceelektroden14 , die Drainelektroden22 , die Gateelektroden18 und Ähnliches auf der vorderen Oberfläche der Nitridhalbleiterschicht12 ausgebildet. Bei jeder Transistorstruktur50 wird eine Ätzmaske (nicht gezeigt) auf einem Teil einer vorderen Oberfläche der dritten Nitridhalbleiterschicht10d bei7 ausgebildet, und ein Abschnitt der dritten Nitridhalbleiterschicht10d , bei der keine Ätzmaske ausgebildet ist, wird angeätzt, bis die zweite Nitridhalbleiterschicht8 freigelegt ist. Die dritte Nitridhalbleiterschicht10 (10a bis10c ) gemäß8 ist dadurch abgeschlossen. Nachfolgend wird eine Ätzmaske (nicht gezeigt) auf einem Teil der vorderen Oberflächen der zweiten Nitridhalbleiterschicht8 und den dritten Nitridhalbleiterschichten10a bis10c ausgebildet, und Stickstoffionen (N) werden in einen Abschnitt implantiert, bei dem keine Ätzmaske ausgebildet ist. Die Bauelementisolationsstrukturen24 sind abgeschlossen. Nachfolgend wird die Ätzmaske entfernt, und die Gateelektroden18 , die Sourceelektroden14 , die Drainelektroden22 und die Passivierungsschicht16 werden durch ein bekanntes Verfahren ausgebildet, um dabei einen Transistorstrukturausbildungsschritt abzuschließen. - Nachfolgend werden die Gräben
428 mit dem Polyimid426 gefüllt. Ein Aufteilungsschritt in die Potentialsteuergebiete wird wie vorstehend abgeschlossen, und die Nitridhalbleitervorrichtung400 gemäß4 wird abgeschlossen. Insbesondere ist bei der vorstehenden Beschreibung ein Beispiel beschrieben, bei dem der Transistorstrukturausbildungsschritt während des Aufteilungsschrittes in die Potentialsteuergebiete durchgeführt wird. Alternativ kann der Aufteilungsschritt in die Potentialsteuergebiete nach dem Abschluss des Transistorstrukturausbildungsschrittes durchgeführt werden. Falls die Gräben428 mit dem Polyimid426 gefüllt werden, wird zumindest der Füllschritt der Gräben428 mit dem Polyimid426 nach dem Abschluss des Transistorstrukturausbildungsschrittes durchgeführt, um eine Verschlechterung des Polyimids aufgrund der während der Elektrodenausbildung erzeugten Wärme zu verhindern. Insbesondere können die Gräben428 nicht mit dem Polyimid426 gefüllt werden. Sobald in diesem Fall die Gräben428 ausgebildet sind, ist der Aufteilungsschritt in die Potentialsteuergebiete abgeschlossen. Falls die Gräben428 nicht mit dem Polyimid426 gefüllt werden, kann egal welcher des Aufteilungsschrittes in die Potentialsteuergebiete und des Transistorstrukturausbildungsschrittes früher als der andere durchgeführt werden. Falls darüber hinaus die Gräben428 ausgebildet werden, können die Böden der Gräben428 das Innere der Pufferschicht4 erreichen. - Insbesondere ist die Dicke des Siliziumsubstrates
402d dieselbe wie die Dicke des Siliziumsubstrates2 bei der Nitridhalbleitervorrichtung100 (siehe1 ). Dementsprechend kann durch Beseitigung des Abschleifens gemäß6 die Nitridhalbleitervorrichtung400 durch im Wesentlichen dieselben Schritte wie die bei der Nitridhalbleitervorrichtung100 hergestellt werden. Darüber hinaus kann durch Entfernen der dritten Nitridhalbleiterschicht10d in einem Bereitstellungsbereich für die erste Diode50d bei dem Ätzschritt der dritten Nitridhalbleiterschicht10d gemäß8 die Nitridhalbleitervorrichtung200 durch im Wesentlichen dieselben Schritte wie die bei der Nitridhalbleiterschicht100 hergestellt werden. Durch Hinzufügen eines Ausbildungsschrittes der Durchgangslöcher42 , von denen sich jedes von der vorderen Oberfläche der Nitridhalbleiterschicht12 zu dem Siliziumsubstrat2 erstreckt, kann bei dem Transistorstrukturausbildungsschritt die Nitridhalbleiterschicht300 im Wesentlichen durch dieselben Schritte wie die bei der Nitridhalbleitervorrichtung100 hergestellt werden. - Bei den vorstehend beschriebenen Ausführungsbeispielen sind die Nitridhalbleitervorrichtung mit drei in der Nitridhalbleiterschicht bereitgestellten Transistorstrukturen (d. h. die Nitridhalbleitervorrichtungen
100 ,300 und400 ) und die Nitridhalbleitervorrichtung mit in der Nitridhalbleiterschicht bereitgestellten zwei Transistorstrukturen und einer Diodenstruktur (d. h. die Nitridhalbleitervorrichtung200 ) gezeigt. Jedoch ist die Anzahl der in der Nitridhalbleiterschicht bereitgestellten Transistoren nicht auf diejenigen der vorbeschriebenen Ausführungsbeispiele begrenzt. Die vorliegend offenbarte Technik kann für jede der Nitridhalbleitervorrichtungen mit zwei oder mehr Transistorstrukturen in einer gemeinsamen Nitridhalbleiterschicht verwendet werden. - Bei den vorstehend beschriebenen Ausführungsbeispielen ist darüber hinaus ein Beispiel beschrieben, bei dem die Sourceelektrode (die Elektrode auf der Seite des niedrigeren Potentials) und das Potentialsteuergebiet verbunden sind (d. h. kurzgeschlossen sind). Die hierin offenbarte Technik kann jedoch ebenso auf eine Abwandlung angewendet werden, bei der beispielsweise zwischen der Sourceelektrode und dem Potentialsteuergebiet eine Potentialdifferenz vorliegt. Wichtig ist hierbei, dass ein Substrat in eine Vielzahl von Potentialsteuergebieten aufgeteilt wird, und das Potential von jedem der Potentialsteuergebiete unabhängig von anderen Potentialsteuergebieten gesteuert wird.
- Vorstehend sind konkrete Beispiele der vorliegenden Erfindung detailliert beschrieben, jedoch sind dies nur Beispiele und begrenzen somit den Umfang der Patentansprüche nicht. Die in den Patentansprüchen beschriebene Technologie umfasst verschiedene Abwandlungen und Änderungen der konkreten, vorstehend vertretenen Beispiele. Die in der vorliegenden Beschreibung und Zeichnung erklärten technischen Elemente üben eigenständig oder in Kombinationen technischen Nutzen aus, und sind nicht auf die ursprünglich offenbarten Kombinationen beschränkt. Darüber hinaus verwirklicht die in der vorliegenden Beschreibung und der Zeichnung ausgeführte Technologie eine Vielzahl von Wirkungen gleichzeitig, und weist aufgrund der Verwirklichung einer solchen Wirkung technischen Nutzen auf.
- Eine Nitridhalbleitervorrichtung umfasst ein leitfähiges Substrat und eine Nitridhalbleiterschicht. Die Nitridhalbleitervorrichtung ist auf dem leitfähigen Substrat angeordnet. Die Nitridhalbleitervorrichtung umfasst eine erste Transistorstruktur einer lateralen Bauart und eine zweite Transistorstruktur einer lateralen Bauart umfasst. Das leitfähige Substrat umfasst ein erstes Potentialsteuergebiet und ein zweites Potentialsteuergebiet, das zur Steuerung eines Potentials unabhängig von dem ersten Potentialsteuergebiet befähigt ist. Bei einer Draufsicht auf die Nitridhalbleiterschicht überlappt die erste Transistorstruktur mit dem ersten Potentialsteuergebiet und die zweite Transistorstruktur überlappt mit dem zweiten Potentialsteuergebiet.
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Nicht-Patentliteratur
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- GaN Monolithic Inverter IC using Normally-off Gate Injection Transistors with Planar Isolation on Si Substrate”, IEDM Tech. Dig. 2009, S. 165–168 [0002]
Claims (13)
- Nitridhalbleitervorrichtung mit: einem leitfähigen Substrat, das eine Leitfähigkeitseigenschaft aufweist; und einer Nitridhalbleiterschicht, die auf dem leitfähigen Substrat angeordnet ist, und eine erste Transistorstruktur einer lateralen Bauart sowie eine zweite Transistorstruktur einer lateralen Bauart umfasst, wobei das leitfähige Substrat ein erstes Potentialsteuergebiet und ein zweites Potentialsteuergebiet umfasst, das zur Steuerung des Potentials unabhängig von dem ersten Potentialsteuergebiet befähigt ist, und bei einer Draufsicht auf die Nitridhalbleiterschicht die erste Transistorstruktur mit dem ersten Potentialsteuergebiet und die zweite Transistorstruktur mit dem zweiten Potentialsteuergebiet überlappt.
- Nitridhalbleitervorrichtung nach Anspruch 1, wobei ein Isolationsgebiet zwischen dem ersten Potentialsteuergebiet und dem zweiten Potentialsteuergebiet angeordnet ist, wobei das Isolationssteuergebiet zur elektrischen Isolation des ersten Potentialsteuergebietes und des zweiten Potentialsteuergebietes voneinander eingerichtet ist.
- Nitridhalbleitervorrichtung nach Anspruch 2, wobei das Isolationsgebiet ein Graben ist, der zwischen den ersten Potentialsteuergebiet und dem zweiten Potentialsteuergebiet angeordnet ist.
- Nitridhalbleitervorrichtung nach Anspruch 2 oder 3, wobei eine Bauelementisolationsstruktur in der Nitridhalbleiterschicht angeordnet ist, wobei die Bauelementisolationsstruktur zur elektrischen Isolation der ersten Transistorstruktur und der zweiten Transistorstruktur voneinander eingerichtet ist, und bei der Draufsicht auf die Nitridhalbleiterschicht die Bauelementisolationsstruktur mit dem Isolationsgebiet überlappt.
- Nitridhalbleitervorrichtung nach einem der Ansprüche 1 bis 4, wobei eine Halbleiterschicht, die einen höheren Widerstand als das leitfähige Substrat aufweist, zwischen dem leitfähigen Substrat und der Nitridhalbleiterschicht angeordnet ist.
- Nitridhalbleitervorrichtung nach einem der Ansprüche 1 bis 5, wobei eine der ersten Transistorstruktur entsprechende eines Paares von Hauptelektroden zu dem ersten Potentialsteuergebiet kurzgeschlossen ist, und eine der zweiten Transistorstruktur entsprechende eines Paares von Hauptelektroden zu dem zweiten Potentialsteuergebiet kurzgeschlossen ist.
- Nitridhalbleitervorrichtung nach Anspruch 6, weiter mit einem leitfähigen Element, mit dem ein sich von einer vorderen Oberfläche der Nitridhalbleiterschicht zu dem leitfähigen Substrat erstreckendes Durchgangsloch gefüllt ist, wobei das leitfähige Element ein erstes leitfähiges Element und ein zweites leitfähiges Element aufweist, wobei die eine der ersten Transistorstruktur entsprechende des Paares von Hauptelektroden zu dem ersten Potentialsteuergebiet über das erste leitfähige Element kurzgeschlossen ist, und die eine der zweiten Transistorstruktur entsprechende des Paares von Hauptelektroden zu dem zweiten Potentialsteuergebiet über das zweite leitfähige Element kurzgeschlossen ist.
- Nitridhalbleitervorrichtung nach einem der Ansprüche 1 bis 7, wobei zumindest eine der ersten Transistorstrukturen und der zweiten Transistorstrukturen einem oberen Zweig eines vollständigen Brückenschaltkreises entspricht, wobei die eine der ersten Transistorstruktur entsprechende des Paares von Hauptelektroden eine Sourceelektrode ist, und die eine der zweiten Transistorstruktur entsprechende des Paares von Hauptelektroden eine Sourceelektrode ist.
- Nitridhalbleitervorrichtung nach einem der Ansprüche 1 bis 8, wobei jede der ersten Transistorstruktur und der zweiten Transistorstruktur eine Heteroübergangs-Feldeffekttransistorstruktur ist.
- Nitridhalbleitervorrichtung nach einem der Ansprüche 1 bis 9, wobei die Nitridhalbleiterschicht eine epitaxiale Schicht ist.
- Herstellungsverfahren für eine Nitridhalbleitervorrichtung, mit den Schritten: Ausbilden einer Nitridhalbleiterschicht auf einem leitfähigen Substrat; Ausbilden einer Vielzahl von Transistorstrukturen in der Nitridhalbleiterschicht; und Auftrennen des leitfähigen Substrates in eine Vielzahl von Potentialsteuergebieten, die mit der Fähigkeit einer Potentialsteuerung unabhängig voneinander eingerichtet sind.
- Verfahren nach Anspruch 11, wobei das Auftrennen des leitfähigen Substrates ein Ausbilden eines sich von einer vorderen Oberfläche zu einer hinteren Oberfläche des leitfähigen Substrates erstreckender Grabens aufweist.
- Verfahren nach Anspruch 12, wobei das Auftrennen des leitfähigen Substrates ein Verringern einer Dicke des leitfähigen Substrates vor der Ausbildung des Grabens aufweist.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015232371A JP6261553B2 (ja) | 2015-11-27 | 2015-11-27 | 窒化物半導体装置及びその製造方法 |
JP2015-232371 | 2015-11-27 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE102016122568A1 true DE102016122568A1 (de) | 2017-06-01 |
Family
ID=58693329
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102016122568.1A Ceased DE102016122568A1 (de) | 2015-11-27 | 2016-11-23 | Nitridhalbleitervorrichtung und verfahren zur herstellung derselben |
Country Status (5)
Country | Link |
---|---|
US (1) | US9666580B1 (de) |
JP (1) | JP6261553B2 (de) |
KR (1) | KR101871599B1 (de) |
CN (1) | CN107017255B (de) |
DE (1) | DE102016122568A1 (de) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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- 2016-10-12 US US15/291,744 patent/US9666580B1/en active Active
- 2016-11-23 KR KR1020160156420A patent/KR101871599B1/ko active IP Right Grant
- 2016-11-23 DE DE102016122568.1A patent/DE102016122568A1/de not_active Ceased
- 2016-11-25 CN CN201611054323.4A patent/CN107017255B/zh active Active
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CN107017255B (zh) | 2020-09-01 |
CN107017255A (zh) | 2017-08-04 |
JP2017098511A (ja) | 2017-06-01 |
JP6261553B2 (ja) | 2018-01-17 |
US20170154885A1 (en) | 2017-06-01 |
KR101871599B1 (ko) | 2018-06-26 |
KR20170062393A (ko) | 2017-06-07 |
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