CN1809862A - 液晶显示装置 - Google Patents

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Abstract

本发明披露了一种具有改良显示特性的液晶显示装置。时钟发生器将第一时钟信号和第二时钟信号施加于栅极驱动器，以控制栅极驱动信号的脉冲宽度。在运行下一阶段之前，在当前阶段将与多条栅极线的第一端部连接的放电晶体管放电。这些栅极线包括第一栅极驱动器、以及在第一栅极驱动器以异常状态运行时用于运行这些栅极线的第二栅极驱动器。因此，液晶显示装置可以高速运行，并且可以防止栅极驱动信号被延迟。

Description

液晶显示装置
技术领域
本发明涉及一种LCD(液晶显示)装置，更具体地，涉及一种具有改良显示特性的液晶显示装置。
背景技术
通常，液晶显示(LCD)装置包含两个基片，每个均包括设置在其内表面上的电极、以及置于两个基片之间的液晶层。在液晶显示装置中，将电压施加于电极以重新排列液晶分子并控制通过液晶层透射的光量，从而获得所需要的图像。
目前，薄膜晶体管显示器(TFT-LCD)是液晶显示器最通用的类型。将多个电极设置在两个基片的每个基片上并且将薄膜晶体管(TFT)用于开关提供给各电极的电源。通常将薄膜晶体管设置在两个基片的一侧上。一般而言，将其中将薄膜晶体管分别设置在单元像素区域中的液晶显示器分为非晶硅类型TFT-LCD(非晶硅TFT-LCD)和多晶硅类型TFT-LCD(多晶硅TFT-LCD)。
与非晶硅TFT-LCD装置相比，多晶硅TFT-LCD装置具有较低功率消耗和较低廉价格的优点，但是其缺点在于其制造工艺复杂。因此，多晶硅TFT-LCD装置主要用于诸如移动电话这样的小型液晶显示器，而非晶硅TFT-LCD装置由于其可容易地用于大屏幕和高的生产率，可其用于笔记本式个人电脑(PC)、液晶显示监测器、高分辨率(HD)电视等等这样的大型显示器。
最近，大量的研究和开发成果已经集中在减小用于非晶硅TFT-LCD装置的组装方法的步骤数，其通过数据驱动电路和栅极驱动电路与像素阵列一起同时形成在玻璃基片上实现，该组装方法类似于多晶硅TFT-LCD装置的组装方法。其它研究焦点范围包括用于提高运行速度和液晶显示器分辨率的方法，如通过在移动时间周期内运行TFT-LCD装置的更多信号线。
发明内容
本发明的实施例提供了一种可以进行高速运行的液晶显示器。
本发明的另一实施例提供了一种可以防止栅极驱动信号被延迟的液晶显示器。
本发明的再一个实施例提供了一种具有冗余功能且可以防止栅极驱动信号被延迟的液晶显示器。
在本发明的一个方面中，液晶显示装置包括：定时控制器，用于响应外部信号输出图像信号、第一定时信号、第二定时信号、及时钟发生控制信号；时钟发生器，用于产生第一时钟信号和具有与第一时钟信号不同相位的第二时钟信号，用于在第一周期控制第一时钟信号和第二时钟信号以确定栅极驱动信号的电压电平，以及用于在第二周期控制要进行充电或放电的第一时钟信号和第二时钟信号；栅极驱动器，用于响应第一定时信号、第一时钟信号、及第二时钟信号顺次输出栅极驱动信号；数据驱动器，用于响应第二定时信号输出图像信号；以及液晶面板，包括用于接收图像信号的多条数据线、用于接收栅极驱动信号的多条栅极线、以及用于响应栅极驱动信号输出图像信号与数据线和栅极线连接的开关装置。
在另一方面中，液晶显示器包括：液晶面板，包括沿第一方向延伸的多条栅极线、沿第二方向延伸的多条数据线、具有与栅极线连接的第一电极和与数据线连接的第二电极的开关装置、以及与开关装置的第三电极连接的像素电极；栅极驱动器，与栅极线连接，用于向栅极线顺次施加栅极驱动信号；数据驱动器，与数据线连接，用于向数据线施加数据驱动信号；以及放电器，用于响应施加于下一个栅极线的第一栅极驱动信号，放电施加于当前栅极线的第二栅极驱动信号。
在再一个方面中，液晶显示器包括：液晶面板，包括沿第一方向延伸的多条栅极线、沿与第一方向垂直的第二方向延伸的多条数据线、具有与栅极线连接的第一电极和与数据线连接的第二电极的开关装置、以及与开关装置的第三电极连接的像素电极；第一栅极驱动器，与栅极线的第一端部连接，用于向栅极线顺次施加栅极驱动信号；第二栅极驱动器，与栅极线的第二端部连接，用于当第一栅极驱动器处于异常状态时向栅极线顺次施加栅极驱动信号；数据驱动器，与数据线连接，用于向数据线施加数据驱动信号；第一放电器，用于当运行第一栅极驱动器时响应施加于下一个栅极线的第一栅极驱动信号，放电施加于当前栅极线的第二栅极驱动信号；以及第二放电器，用于当运行第二栅极驱动器时响应第二栅极驱动信号，放电第二栅极驱动信号。
根据实施例的液晶显示器，这种液晶显示装置可以高速运行，这是由于第一时钟信号和第二时钟信号分别具有用于确定栅极驱动信号的电压电平的第一周期以及用充电或放电第一时钟信号和第二时钟信号的第二周期。
而且，在运行下一阶段之前与多条栅极线连接的第一端部放电晶体管在当前阶段放电，从而防止栅极驱动信号被延迟。
此外，栅极线包括第一栅极驱动器、及当第一栅极驱动器处于异常状态时用于运行栅极线的第二栅极驱动器。因此，尽管第一栅极驱动器运行异常，液晶显示装置由于第二栅极驱动器而可以正常运行。
附图说明
通过参照附图进行以下详细描述，本发明的上述及其它优点将变得更加显而易见，其中：
图1是根据本发明一具体实施例的液晶显示装置方框图；
图2是示出图1所示的时钟发生器方框图；
图3是图2所示的相应元件的定时图；
图4是图2所示的D-触发器电路图；
图5是图4所示的D-触发器定时图；
图6是示出图2所示的第一电压施加电路的电路图；
图7是示出图2所示的第二电压施加电路的电路图；
图8是示出图2所示的充电/放电电路的电路图；
图9是来自图2所示的时钟发生器的第一时钟信号及第二时钟信号的波形；
图10是用于输出来自图2所示的时钟发生器的第一时钟信号及第二时钟信号所需电流的波形；
图11是根据第一时钟信号及第二时钟信号在相应阶段模拟的输出波形图；
图12及图13是根据本发明另一具体实施例的时钟发生控制信号的波形；
图14是示出根据本发明另一具体实施例的液晶显示装置示意图；
图15是示出图14所示的放电器示意图；
图16是在图15所示的放电器的模拟波形；
图17是图14所示的液晶显示器的栅极驱动信号波形；
图18是传统栅极驱动信号的波形；
图19是根据图14所示的根据本发明具体实施例的栅极驱动信号波形；
图20及图21是示出根据本发明其它具体实施例的液晶显示装置的示意图；
图22是示出图20所示的第一栅极驱动器电路图；
图23是从图22所示的第一栅极驱动器输出的波形；
图24是示出在向图20所示的第二栅极驱动器的第一电源电压输入端施加第一电源电压时第一栅极驱动器的输出信号的波形；以及
图25是示出在向图20所示的第二栅极驱动器的第一时钟信号及第二时钟信号输入端施加第二电源电压时第一栅极驱动器的输出信号的波形。
具体实施方式
图1是根据本发明一具体实施例的液晶显示装置方框图。
参照图1，液晶显示装置400包括在其上设置栅极驱动器110和数据驱动器120的液晶面板100、响应外部信号控制液晶面板100的定时控制器200、以及用于产生施加于栅极驱动器110的第一和第二时钟信号CKV和CKVB的时钟发生器300。
定时控制器200产生定时信号以控制栅极驱动器110和数据驱动器120。定时控制器200响应由外部装置提供的H-sync(水平同步)信号将水平开始信号STH施于数据驱动器120。数据驱动器120响应来自定时控制器200的水平开始信号STH将由定时控制器200提供的图像信号转换成模拟图像数据并将模拟图像数据提供给数据线。定时控制器200响应由外部装置提供的V-sync(垂直同步)信号将第一垂直开始信号STV施于时钟发生器300。
定时控制器200向时钟发生器300施加用于确定栅极驱动信号的周期的栅极时钟信号CPV、用于允许栅极驱动信号的允许信号OE、以及用于控制第一时钟信号及第二时钟信号CKV和CKVB的充电或放电的充电/放电控制信号CHC。
液晶面板100包括沿第一方向延伸的多条栅极线G1～Gn、沿与第一方向垂直的第二方向延伸的多条数据线D1～Dm、与栅极线G1～Gn和数据线D1～Dm连接的TFT 130、以及与TFT 130连接的像素电极140。
液晶显示器100包括用于向栅极线G1～Gn上顺次施加栅极驱动信号的栅极驱动器110和向数据线D1～Dm施加数据信号的数据驱动器120。液晶面板100还包括TFT基片、滤色器基片、以及置于TFT基片和滤色器基片之间的液晶层。将栅极线G1～Gn、数据线D1～Dm、TFT 130、以及像素电极140设置在TFT基片上。
数据驱动器120响应水平开始信号STH生成施加于液晶面板100的相应像素的数据信号。由数据驱动器120生成的数据信号是用于充电相应像素的充电电压。
栅极驱动器110包括移位寄存器，在该移位寄存器中，将多个阶段(stage)接连地彼此连接并将栅极线G1～Gn分别与多个阶段连接。因此，多个阶段依次向栅极线G1～Gn输出栅极驱动信号。即，响应具有与第一垂直开始信号相反相位的第二垂直开始信号STVB向栅极线G1～Gn依次施加具有高电平周期的栅极驱动信号，以控制施加于相应像素的数据信号。栅极信号包括足以驱动与栅极线G1～Gn连接的TFT 130的电压电平。若响应栅极信号运行TFT130，则数据信号通过TFT 130施加到像素电极140以充电液晶层。
时钟发生器300响应栅极时钟信号CPV及允许信号OE，输出具有相反相位的第一及第二时钟信号CKV、CKVB。将第一时钟信号CKV施加到栅极驱动器110的奇数阶段，而将第二时钟信号CKVB施加到栅极驱动器110的偶数阶段。
时钟发生器300包括第一及第二电压施加电路(未示出)和充电/放电电路(未示出)。第一及第二电压施加电路产生具有预定电压的第一时钟信号及第二时钟信号CKV和CKVB以响应栅极时钟信号CPV、允许信号OE、和第一垂直开始信号STV确定栅极驱动信号的电平。充电/放电电路响应栅极时钟信号CPV和充电/放电CHC，控制要进行充电或放电的第一时钟信号及第二时钟信号CKV和CKVB。时钟发生器300输出第二垂直信号STVB到栅极驱动器110以顺次将来自栅极驱动器110的第一垂直开始信号STV施加于栅极线G1～Gn。
因此，第一时钟信号CKV和第二时钟信号CKVB在第一周期具有预定电压，并且在第二周期进行充电或放电。通过控制第一时钟信号CKV和第二时钟信号CKVB，栅极驱动信号的脉冲宽度减小，从而栅极驱动器110可以进行高速运行。
而且，时钟发生器300可以使用栅极时钟信号CPV及允许信号OE，而无需施于时钟发生器300的另外控制信号，以产生第一时钟信号及第二时钟信号CKV和CKVB。
图2是示出图1所示的时钟发生器方框图，图3是图2所示的相应元件的定时图。
参照图2，时钟发生器300包括用于输出第一时钟允许信号OCS(奇数时钟脉冲)和第二时钟允许信号ECS(偶数时钟脉冲)的D-触发器310、用于响应第一时钟允许信号OCS输出第一定时CKV的第一电压施加电路320、用于响应第二时钟允许信号ECS输出第二时钟信号CKVB的第二电压施加电路330、以及用于充电或放电第一时钟信号CKV和第二时钟信号CKVB的充电/放电电路340。
D-触发器310接收垂直开始信号STV并与允许信号OE同步，以分别通过第一接线端QB和第二接线端Q输出第一时钟允许信号ECS和第二时钟允许信号OCS。该允许信号OE通过栅极信号的时间延迟来延迟来自栅极驱动器110的输出。即，当在第一周期1H延迟栅极驱动信号时允许信号OE具有高电平。
第一电压施加电路320响应栅极时钟信号CPV、允许信号OE、及第一时钟允许信号OCS输出在第一周期具有预定电压的第一时钟信号CKV。第二电压施加电路330响应栅极时钟信号CPV、允许信号OE、及第一时钟允许信号ECS输出在第一周期维持预定电压的第二时钟信号CKVB。充电/放电电路340接收栅极时钟信号CPV，并且在关闭第一电压施加电路及第二电压施加电路320和330时充电/放电第一时钟信号及第二时钟信号CKV、CKVB。
如图3所示，栅极时钟信号CPV具有第一周期1H且允许信号OE在第一周期1H产生，以及当栅极驱动信号被延迟时具有预定负载的高电平。
在栅极时钟信号CPV具有高电平且允许信号OE具有低电平的第三周期t3，运行第一及第二电压施加电路320、330。在栅极时钟信号CPV具有低电平且允许信号OE具有低电平或高电平的第四周期t4，运行充电/放电电路340。在位于第三周期与第四周期t3、t4之间的第五周期，第一及第二电压施加电路320、330和充电/放电电路340均处于操纵失灵状态。在第五周期，栅极时钟信号CPV和允许信号OE分别具有低电平或高电平。
下面，将详细地描述时钟发生器300。
图4是图2所示的D-触发器电路图，而图5是图4所示的D-触发器定时图。
参照图4和图5，若响应具有与第一垂直开始信号STV相反相位的第二垂直开始信号STVB清除D-触发器310，则由D-触发器310的第一接线端QB输出的第二时钟允许信号ECS具有高电平。即，D-触发器310接收第一垂直开始信号STV并响应通过其时钟接线端CLK输入的允许信号OE输出作为一个周期具有两个高电平(2H)的第一时钟允许信号OCS和第二时钟允许信号ECS。第一时钟允许信号OCS允许第一电压施加电路320输出施加于栅极驱动器110的奇数阶段的第一时钟信号CKV，而第二时钟允许信号ECS允许第二电压施加电路330输出施加于栅极驱动器110的偶数阶段的第二时钟信号CKVB。
图6是示出图2所示的第一电压施加电路的电路图，而图7是示出图2所示的第二电压施加电路的电路图。
参照图6，第一电压施加电路320包括用于响应具有高电平的第一时钟允许信号OCS将第一电源电压Von提供给第一时钟信号CKV的第一电源电压供给部321、以及用于响应具有低电平的第一时钟允许信号OCS将第二电源电压Voff提供给第一时钟信号CKV的第二电源电压供给部323。
第一电源电压供给部321包括接通电压发生器321a和用于控制接通电压发生器321a运行的第一控制器321b。
第一控制器321b包括第一晶体管T1、第二晶体管T2、第一电阻器R1、及第二电阻器R2。
第一晶体管T1包括与用于允许信号OE的接线端连接的发射极以及与第二晶体管T2的发射极连接的集电极。将第一电阻器R1连接于第一晶体管T1的基极和用于第一时钟允许信号OCS的接线端之间。第二晶体管T2包括与接通电压发生器321a连接的集电极。将第二电阻器R2连接于第二晶体管T2的基极和用于栅极时钟信号CPV的接线端之间。
因此，第一晶体管T1响应第一时钟允许信号OCS和允许信号OE之间的电压差被接通，而第二晶体管T2响应由第一晶体管T1提供的允许信号OE和栅极时钟信号CPV之间的电压差被接通，从而控制接通电压(on-voltage)发生部321a的运行。
接通电压发生部321a包括第三晶体管T3、第三电阻器R3、第四电阻器R4、第五电阻器R5。
第三晶体管T3包括与用于第一电源电压Von的接线端连接的发射极和与第一时钟信号CKV连接的集电极。将第三电阻器R3连接于第三晶体管T3的发射极和基极之间。将第四电阻器R4和第五电阻器R5串联连接于第三晶体管T3的基极和第二晶体管T2的集电极之间。因此，第三晶体管T3通过接线端输出第一时钟信号CKV。
第二电源电压供给部323包括切断电压(off-voltage)发生器323a和用于控制切断电压发生器323a的第二控制器323b。
第二控制器323b包括第四晶体管T4、第五晶体管T5、和第六至第十一电阻器R6～R11。
第四晶体管T4包括与用于栅极时钟信号CPV的接线端连接的发射极和与第五晶体管T5连接的集电极。将第六电阻器R6连接于第四晶体管T4的发射极和基极之间。将第七电阻器R7和第八电阻器R8串联连接于第三晶体管T4的基极和用于允许信号OE的接线端之间。第五晶体管T5包括与切断电压发生器323a连接的集电极。将第九电阻器R9连接于第五晶体管T5的发射极和基极之间。将第十电阻器R10和第十一电阻器R11串联连接于第五晶体管T5的基极和用于第一时钟允许信号OCS的接线端之间。
第四晶体管T4响应栅极钟信号CPV和允许信号OE之间的电压差输出栅极钟信号CPV，而第五晶体管T5响应由第四晶体管T4输出的栅极时钟信号CPV和第一时钟允许信号OCS之间的电压差输出栅极时钟信号CPV。将由第五晶体管T5输出的栅极时钟信号CPV提供给切断电压发生器323a。
切断电压发生器323a包括第六晶体管T6、第十二电阻器R12、第十三电阻器R13、和第十四电阻器R14。
第六晶体管T6包括与用于第二电源电压Voff的接线端连接的发射极和与第一时钟信号CKV连接的集电极。将第十二电阻器R12连接于第五晶体管T5的集电极和并联的第十三和第十四电阻器R13、R14的第一接线端之间，将第十三电阻器R13与第六晶体管T6的发射极连接并将第十四电阻器R14与第六晶体管T6的基极连接。因此，若将第六晶体管T6响应由第二控制器323b输出的栅极时钟信号CPV被接通，则第二电源电压Voff通过用于第一时钟信号CKV的接线端被输出。
在图6中，第一至第六晶体管T1、T2、T3、T4、T5、和T6是双极性结型晶体管。
参照图7，第二电压施加电路330包括用于响应具有高电平的第二时钟允许信号ECS向第二时钟信号CKVB提供第一电源电压Von的第一电源电压供给部331以及用于响应具有低电平的第二时钟允许信号ECS向第二时钟信号CKVB提供第二电源电压Voff的第二电源电压供给部333。
第一电源电压供给部331包括接通电压发生部331a和用于控制接通电压发生部331a运行的第一控制器331b。
第一控制器331b包括第一晶体管T1、第二晶体管T2、第一电阻器R1、和第二电阻器R2。
第一晶体管T1包括与用于允许信号OE的接线端连接的发射极以及与第二晶体管T2的发射极连接的集电极。将第一电阻器R1连接于第一晶体管T1的基极和用于第二时钟允许信号ECS的接线端之间。第二晶体管T2包括与接通电压发生器321a连接的集电极。将第二电阻器R2连接于第二晶体管T2的基极和用于栅极时钟信号CPV的接线端之间。
因此，第一晶体管T1响应第二时钟允许信号ECS和允许信号OE之间的电压差被接通，而第二晶体管T2响应由第一晶体管T1提供的允许信号OE和栅极时钟信号CPV之间的电压差被接通，从而控制接通电压发生部331a的运行。
接通电压发生部331a包括第三晶体管T3、第三电阻器R3、第四电阻器R4、和第五电阻器R5。
第三晶体管T3包括与用于第一电源电压Von的接线端连接的发射极和与第二时钟信号CKVB连接的集电极。将第三电阻器R3连接于第三晶体管T3的发射极和基极之间。将第四电阻器R4和第五电阻器R5串联连接于第三晶体管T3的基极和第二晶体管T2的集电极之间。因此，第三晶体管T3通过接线端输出第二时钟信号CKVB。
第二电源电压供给部333包括切断电压发生器333a和用于控制切断电压发生器323a的第二控制器333b。
第二控制器333b包括第四晶体管T4、第五晶体管T5、和第六至第十一电阻器R6～R11。
第四晶体管T4包括与用于栅极时钟信号CPV的接线端连接的发射极和与第五晶体管T5连接的集电极。将第六电阻器R6连接于第四晶体管T4的发射极和基极之间。将第七电阻器R7和第八电阻器R8串联连接于第三晶体管T4的基极和用于允许信号OE的接线端之间。第五晶体管T5包括与切断电压发生器333a连接的集电极。将第九电阻器R9连接于第五晶体管T5的发射极和基极之间。将第十电阻器R10和第十一电阻器R11串联连接于第五晶体管T5的基极和用于第二时钟允许信号ECS的接线端之间。
第四晶体管T4响应栅极钟信号CPV和允许信号OE之间的电压差输出栅极钟信号CPV，而第五晶体管T5响应由第四晶体管T4输出的栅极时钟信号CPV和第二时钟允许信号ECS之间的电压差输出栅极时钟信号CPV。将由第五晶体管T5输出的栅极时钟信号CPV提供给切断电压发生器333a。
切断电压发生器333a包括第六晶体管T6、第十二电阻器R12、第十三电阻器R13、和第十四电阻器R14。
第六晶体管T6包括与用于第二电源电压Voff的接线端连接的发射极和与第二时钟信号CKVB连接的集电极。将第十二电阻器R12连接于第五晶体管T5的集电极和并联的第十三和第十四电阻器R13、R14的第一接线端之间，将第十三电阻器R13与第六晶体管T6的发射极连接并将第十四电阻器R14与第六晶体管T6的基极连接。因此，若将第六晶体管T6响应由第二控制器333b输出的栅极时钟信号CPV被接通，则第二电源电压Voff通过用于第二时钟信号CKVB的接线端被输出。
在图7中，第一至第六晶体管T1、T2、T3、T4、T5、和T6是双极性结型晶体管。
图8是示出图2所示的充电/放电电路的电路图。
参照图8，充电/放电电路340包括用于充电/放电第一及第二时钟信号CKV、CKVB的充电器341、用于驱动充电器341的充电驱动器342、和用于控制充电驱动器342的充电控制器343。
充电控制器343包括第一至第三晶体管T1～T3、和第一至第十电阻器R1～R10。
第一晶体管T1包括与用于栅极时钟信号CPV的接线端连接的发射极以及与第四电阻器R4的第一接线端连接的集电极。将第二电阻器R1和第三电阻器R3连接于串联的第一晶体管T1和接地端V0的基极之间。将第四电阻器R4与并联的第五电阻器R5和第六电阻器R6连接。将第五电阻器R5与第二晶体管T2的基极连接，并将第六电阻器R6与第二晶体管T2的发射极连接。
第三晶体管T3包括与用于第一电源电压Von的接线端连接的发射极和通过第十电阻器R10与第二晶体管T2连接的集电极。将第七电阻器R7连接于第三晶体管T3的发射极和基极之间。将第八电阻器R8和第九电阻器R9串联连接于第三晶体管T3的基极和用于栅极时钟信号CPV的接线端之间。
充电驱动器342包括第四晶体管T4、第五晶体管T5、和第十一至第十四电阻器R11～R14。
第四晶体管T4包括与用于第二时钟信号CKVB的接线端连接的发射极和通过第十二电阻器R12与用于第一时钟信号CKV的接线端连接的集电极。将第十一电阻器R11连接于第四晶体管T4的基极和用于充电/放电控制信号CHC的接线端之间。第五晶体管T5包括与第十二电阻器R12连接的发射极和通过第十三电阻器R13与用于第二时钟信号CKVB的接线端连接的集电极。将第十四电阻器R14连接于第五晶体管T5的基极和用于充电/放电控制信号CHC的接线端之间。
充电器341包括连接于用于第一时钟信号CKV和接地端V0的接线端之间的第一电容器C1和连接于用于第二时钟信号CKVB和接地端V0的接线端之间的第二电容器C2。
因此，若将第一及第二电压施加电路320、330的第三及第六晶体管T3、T6关闭并且栅极时钟信号CPV具有低电平，则运行充电/放电电路340。即，若栅极时钟信号CPV具有低电平，则关闭充电控制器343的第一晶体管T1和第二晶体管T2。通过响应栅极时钟信号CPV和第一电源电压Von接通的第三晶体管T3，将第一电源电压Von施加到充电驱动器342。
因此，响应第一电源电压Von和充电/放电控制信号CHC接通充电驱动器342的第四晶体管T4以充电第二电容C2。通过用于第二时钟信号CKVB的接线端将充电到第二电容C2的充电电压输。将第一电容器C1进行放电并通过用于第一时钟信号CKV的接线端将放电电压输出。
响应充电/放电控制信号CHC接通充电驱动器342的第五晶体管T5并且在第一结点N1处提高电势。因此，将第一电容器C1进行充电并通过用于第一时钟信号CKV的接线端将充电电压输出。将第二电容器C2进行放电并通过用于第二时钟信号CKVB的接线端将放电电压输出。
若将第一及第二电压施加电路320、330关闭且栅极时钟信号CPV具有低电平，则将第一及第二时钟信号CKV、CKVB进行充电或放电。
当第一及第二电压施加电路320、330不运行时，与第三晶体管T3的集电极连接的第十电阻器R10延迟要施加于充电驱动器342的第一电源电压Von以驱动充电/放电电路340。因此，可以防止第一电压施加电路320、第二电源施加电路330、和充电/放电电路340在第五周期内一起运行。
图9是来自图2所示的时钟发生器的第一时钟信号及第二时钟信号的模拟波形，而图10是用于输出来自图2所示的时钟发生器的第一时钟信号及第二时钟信号所需电流的模拟波形。在图9和图10中，第一电源电压Von和第二电源电压Voff分别为20伏特和14伏特。
参照图9及图10，第一时钟信号CKV在第一周期t1具有第一电源电压Von且在第二周期t2具有一定斜度的第一极性。第二时钟信号CKVB在第一周期t1具有与第一时钟信号CKV相反相位的第二电源电压Voff且在第二周期t2具有与第一极性相反的一定斜度的第二极性。
第一时钟信号和第二时钟信号CKV、CKVB分别具有作为1H的第一周期和第二周期t1、t2，并且在第二周期t2将具有彼此相反相位的第一时钟信号CKV和第二时钟信号CKVB进行充电或放电。这样，由于将时钟发生器300减少约一半的传统波形，因此可将时钟发生器300的功率消耗降低。
将功率消耗(P)定义为以下方程式：
P∝fΔV2C                                      (1)
若电压转换减小，则时钟发生器300的功率消耗(P)可以减小约四分之一，这是因为功率消耗(P)与电压转换的平方成比例。即，用于产生第一时钟信号和第二时钟信号CKV、CKVB的时钟发生器300的功率消耗(P)可以减小。
图11是根据第一时钟信号及第二时钟信号在相应阶段模拟的输出波形图。
参照图11，在第二时钟信号CKVB的上升边缘处，从第i阶段输出第i个栅极驱动信号。当从第i+1个阶段输出的第i+1个栅极驱动信号到达电压V1时，将第i个栅极驱动信号进行放电。因此，可将在高电平处维持的第i个栅极驱动信号时间量减小。
若栅极驱动器110接收第一及第二时钟信号CKV、CKVB，可以调整栅极驱动信号的脉冲宽度，并且可将液晶显示器400以高速运行。
在图1至图11中，将栅极时钟信号CPV和允许信号OE作为用于控制第一及第二电压施加电路320、330和充电/放电电路340的时钟发生控制信号进行描述。然而，时钟发生控制信号并不局限于列举的具体实施例。
图12和图13是根据本发明另一具体实施例的时钟发生控制信号的波形。
参照图12，时钟发生控制信号包括具有1H周期的第一控制信号CT1和具有部分与第一控制信号CT1相反相位及1H周期的第二控制信号CT2。第一及第二控制信号CT1、CT2控制第一及第二电压施加电路320、330和充电/放电电路340的运行。
具体而言，在第一控制信号CT1具有高电平且第二控制信号CT2具有低电平的第三周期t3，运行第一及第二电压施加电路320、330。在第一控制信号CT1具有低电平且第二控制信号CT2具有高电平的第四周期t4，运行充电/放电电路340。而且，在第一控制信号CT1和第二控制信号CT2具有低电平的第五周期t5，不运行第一及第二电压施加电路320、330和充电/放电电路340。提供的第五周期t5位于第三周期t3及第四周期t4之间。因此，可以防止第一电压施加电路320、第二电压施加电路330、和充电/放电电路340同时运行。
如图13所示，时钟发生控制信号包括分别具有1H周期的第三控制信号CT3和第四控制信号CT4。若第三控制信号CT3具有低电平，则第四控制信号CT4产生高电平。第三控制信号CT3和第四控制信号CT4控制第一及第二电压施加电路320、330和充电/放电电路340的运行。
具体而言，在第三控制信号CT3具有高电平且第四控制信号CT4具有低电平的第三周期t3，运行第一及第二电压施加电路320、330。在第三控制信号CT3具有低电平且第四控制信号CT4具有高电平的第四周期t4，运行充电/放电电路340。而且，在第三控制信号CT3和第四控制信号CT4具有低电平的第五周期t5，不运行第一及第二电压施加电路320、330和充电/放电电路340。提供的第五周期t5位于第三周期t3及第四周期t4之间。因此，可以防止第一电压施加电路320、第二电压施加电路330、和充电/放电电路340同时运行。
图14是示出根据本发明另一具体实施例的液晶显示装置示意图，图15是示出图14所示的放电器示意图，图16是在图15所示的放电器的模拟波形，而图17是图14所示的液晶显示器的栅极驱动信号波形。
参照图14，液晶显示装置500包括设置有栅极驱动器110、数据驱动器120、及放电器150的液晶面板100。
液晶面板500包括沿第一方向延伸的多条栅极线G1-Gn、沿与第一方向垂直的第二方向延伸的多条数据线D1-Dm、具有与栅极线G1-Gn连接的第一电极131和与数据线D1-Dm连接的第二电极132的TFT 130、以及与TFT 130的第三电极133连接的像素电极140。TFT 130通过第二电极132接收数据信号并且响应施加于第一电极131的栅极驱动信号向像素电极140提供该数据信号。
与栅极线G1-Gn的第一端部连接的栅极驱动器110向栅极线G1-Gn依次施加栅极驱动信号。与数据线D1-Dm连接的数据驱动器120向数据线D1-Dm施加数据信号。
将放电器150分别与栅极线G1-Gn的第二端部连接。如图15所示，放电器150响应施加于下一个栅极线Gi+1的第一栅极驱动信号放电施加于当前栅极线Gi的第二栅极驱动信号，从而第二栅极驱动信号具有第二电源电压Voff。“i”是大于“1”且小于“n”的自然数。
放电器150包括具有与当前栅极线Gi连接的第一电极155a、与用于第二电源电压输入端Voff的接线端连接的第二电极155b、以及与下一个栅极线Gi+1连接的第三电极155c的放电晶体管155。
也就是说，若第一栅极驱动信号的电压电平大于放电晶体管155的阈值电压，则放电晶体管155放电第二栅极驱动信号到第二电源电压Voff。
如图16及图17所示，若第一栅极驱动信号增加到大于放电晶体管155的阈值电压，则放电晶体管155放电第二栅极驱动信号到第二电源电压Voff。因此，放电晶体管155在上拉第一栅极驱动信号之前充分放电第二栅极驱动信号，从而可以防止第二栅极驱动信号被延迟。
图18是传统栅极驱动信号的波形，而图19是根据图14所示的根据本发明具体实施例的栅极驱动信号波形。在图18及图19中，将向位于与栅极线G1-Gn的栅极线G1连接的多个开关装置之间的第一开关装置施加的第一栅极驱动信号Vfirst、向位于与栅极线G1-Gn的栅极线G1连接的多个开关装置之间的中心开关装置施加的第二栅极驱动信号Vcenter、以及向位于与栅极线G1-Gn的栅极线G1连接的多个开关装置之间的最后一个开关装置施加的第三栅极驱动信号Vend进行描述。
参照图18，第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend在约140μs处被完全放电，并且每个分别在不同时间达到第二电源电压Voff。
参照图19，第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend在约136μs处被完全放电。因此，比较与如图8所示的传统第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend的延迟时间，本发明实施例的第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend的延迟时间可以缩短约4μs。而且，由于第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend同时达到第二电源电压Voff，从而改善了第一、第二、第三栅极驱动信号Vfirst、Vcenter、Vend的延迟特性。
图20及图21是示出根据本发明另一实施例的液晶显示装置的示意图。
参照图20，液晶显示装置600包括第一栅极驱动器160、第二栅极驱动器170、数据驱动器120、第一放电器180、及第二放电器190。
在液晶面板600包括沿第一方向延伸的多条栅极线G1-Gn、沿与第一方向垂直的第二方向延伸的多条数据线D1-Dm、具有与栅极线G1-Gn连接的第一电极131和与数据线D1-Dm连接的第二电极132的TFT 130、以及与TFT 130的第三电极133连接的像素电极140。TFT 130通过第二电极132接收数据信号并且响应施加于其第一电极131的栅极驱动信号向像素电极140提供该数据信号。
与栅极线G1-Gn的第一端部连接的第一栅极驱动器160向栅极线G1-Gn依次施加栅极驱动信号。若将栅极驱动信号施加于栅极线G1-Gn，则与数据线D1-Dm连接的数据驱动器120向数据线D1-Dm施加数据信号。
若第一栅极驱动器160处于异常运行状态，则与栅极线G1-Gn的第二端部连接的第二栅极驱动器170向栅极线G1-Gn依次施加栅极驱动信号。因此，尽管第一栅极驱动器160处于异常运行，当第二栅极驱动器170处于正常状态时，液晶显示装置600也可以正常状态运行。
第一及第二栅极驱动器160、170分别包括彼此接连地连接的多个阶段的移位寄存器。移位寄存器的相应阶段具有相同的结构。
如图20所示，第一栅极驱动器160包括用于接收来自外部装置的诸如第一垂直开始信号STV、第一时钟信号CKV、第二时钟信号CKVB、第一电源电压Von、及第二电源电压Voff这样的信号的五个输入端。
第二栅极驱动器170还包括五个输入端。当第一栅极驱动器160处于正常状态运行时，第二栅极驱动器170接收第一垂直开始信号STV、第一电源电压Von、和第二电源电压Voff。即，第二栅极驱动器170接收替代第一时钟信号CKV和第二时钟信号CKVB的第一电源电压Von以及替代用于第一电源电压Von的第二电源电压Voff。因此，当第一栅极驱动器160处于正常状态运行时第二栅极驱动器170维持偏压状态。
然而，若第一栅极驱动器160处于异常状态运行，则第二栅极驱动器170接收第一时钟信号CKV，第二时钟信号CKVB、和第一电源电压Von，以便可以向栅极线G1-Gn输出栅极驱动信号。
为了防止栅极驱动信号被延迟，若运行第一栅极驱动器160，则将第一放电器180与栅极线G1-Gn的第二端部连接。若运行第二栅极驱动器170，则将第二放电器190与栅极线G1-Gn的第一端部连接以防止栅极驱动信号被延迟。
第一放电器180包括具有与当前栅极线的第一端部连接的第一电极、与用于第二电源电压Voff的接线端连接的第二电极、以及与下一栅极线的第一端部连接的第三电极的第一放电晶体管。因此，第一放电晶体管响应从第一栅极驱动器160施加到下一栅极线的第一栅极驱动信号运行，以放电施加于当前栅极线的第二栅极驱动信号为第二电源电压Voff。
第二放电器190包括具有与当前栅极线的第二端部连接的第一电极、与用于第二电源电压Voff的接线端连接的第二电极、以及与下一栅极线的第二端部连接的第三电极的第二放电晶体管。因此，第二放电晶体管响应从第二栅极驱动器170施加到下一栅极线的第一栅极驱动信号运行，以放电施加于当前栅极线的第二栅极驱动信号为第二电源电压Voff。
在图20中，分别邻接栅极线G1-Gn的第一端部和第二端部设置第一栅极驱动器和第二栅极驱动器160、170。然而，分别可以邻接栅极线G1-Gn的第二端部和第一端部设置第一栅极驱动器和第二栅极驱动器160、170。
在图21中，在液晶显示装置700中，将第二栅极驱动器170与栅极线G1-Gn的第一端部连接，而将第一栅极驱动器160与栅极线G1-Gn的第二端部连接。当第一栅极驱动器160处于异常状态运行时，运行第二栅极驱动器170。
图22是示出图20所示的第一栅极驱动器电路图，而图23是图22所示的第一栅极驱动器的输出波形。第一栅极驱动器160具有彼此接连地连接的多个阶段的移位寄存器。移位寄存器的相应阶段具有相同的结构。
参照图22，移位寄存器的每个阶段161包括上拉(pull-up)部161a、下拉(pill-down)部161b、上拉驱动部161c、及下拉驱动部161d。
上拉部161a包括第一NMOS晶体管NT1，其中将漏极与时钟信号输入端CKV连接，将栅极与第一结点N1连接、以及将源极与当前阶段的输出端Gout(i)连接。
下拉部161b包括第二NMOS晶体管NT2，其中将漏极与输出端Gout(i)连接，将栅极与第二结点N2连接，并且将源极与第二电源电压Voff连接。
上拉驱动部161c包括电容器C1和第三至第五NMOS晶体管NT3～NT5。将电容器C1连接于第一结点N1和输出端Gout(i)之间。第三NMOS晶体管NT13包括与第一电源电压Von连接的漏极、与接线端Gout(i-1)连接的栅极、以及与第一结点N1连接的源极。第四NMOS晶体管NT4包括与第一结点N1连接的漏极、与下一个阶段的输出端Gout(i+1)连接的栅极、以及与第二电源电压Voff连接的源极。第五NMOS晶体管NT5包括与第一结点N1连接的漏极、与第二结点N2连接的栅极、以及与第二电源电压Voff连接的源极。
下拉驱动部161d包括第六及第七NMOS晶体管NT6、NT7。第六NMOS晶体管NT6包括共同与第一电源电压Von连接的漏极和栅极以及与第二结点N2连接的源极。第七NMOS晶体管NT7包括与第二结点N2连接的漏极、第一结点N1连接的栅极、以及与第二电源电压Voff连接的源极。第六NMOS晶体管NT6与第七NMOS晶体管NT7的尺寸比率为16∶1。
若施加第一时钟信号和第二时钟信号CKV、CKVB及第一垂直开始信号STV，则每个阶段依次输出栅极驱动信号。也就是说，每个阶段响应前一个阶段的输出信号，每个阶段通过输出端Gout(i)输出作为栅极驱动信号的高电平周期的第一时钟信号CKV。
当在输出端Gout(i)处产生第一时钟信号CKV的高电平周期时，在电容器C1处引导(bootstrapped)输出电压，从而第一NMO晶体管NT11的栅极电压上升为接通电压VDD以上。因此，第一NMOS晶体管NT1维持完全接通状态。这时，第三NMOS晶体管NT3与第五NMOS晶体管NT5的尺寸比率为2∶1。因此，即使响应第一垂直开始信号STV接通第五NMOS晶体管NT5，第一NMOS晶体管NT1也转换到接通状态。
在下拉驱动部161d中，由于将第七NMOS晶体管NT7关闭且第二结点N2的电势上升为第一电源电压Von，因此接通第二NMOS晶体管NT2。这样，由输出端Gout(i)输出的栅极驱动信号电压保持第二电源电压Voff。这时，将第二结点N2的电势降到第二电源电压Voff，这是因为第七NMOS晶体管NT7响应由前一阶段的输出端Gout(i-1)输出的栅极驱动信号被接通。
即使接通第六NMOS晶体管NT6，由于第七NMOS晶体管NT7的尺寸比第六NMOS晶体管NT6的尺寸大16倍，因此第二结点N2维持第二电源电压Voff。因此，将第二NMOS晶体管NT2从接通状态转换到关闭状态。
若将由当前阶段的输出端Gout(i)输出的栅极驱动信号的电势降到第二电源电压Voff，则关闭第七NMOS晶体管NT7。因为第二结点N2通过第六NMOS晶体管NT6接收第一电源电压Von，所以第二结点N2的电势从第二电源电压Voff上升到第一电源电压Von。当接通第五NMOS晶体管NT5同时提高第二结点N2的电势，将充入电容器C1的电压放电以关闭第一NMOS晶体管NT1。
响应由具有接通电压的下一阶段的端输出端Gout(i+1)输出的栅极驱动信号的电压电平，接通第四NMOS晶体管NT4。这时，由于第四NMOS晶体管NT4的尺寸大于第五NMOS晶体管NT5的尺寸2倍，因此第一结点N1的电势迅速降低到第二电源电压Voff同时仅接通第五NMOS晶体管NT5。因此，第一NMOS晶体管NT1被关闭且第二NMOS晶体管NT2被接通，所以由当前阶段的输出端Gout(i)输出的栅极驱动信号从第一电源电压Von降到第二电源电压Voff。
尽管响应降到第二电源电压Voff的由下一阶段的输出端Gout(i+1)输出的栅极驱动信号关闭第四NMOS晶体管NT4，但是第二结点N2通过第六NMOS晶体管NT6保持第一电源电压Von且第一结点N1通过第五NMOS晶体管NT5保持第二电源电压Voff。因此，第二结点N2的电势可以保持第一电源电压并防止第二NMOS晶体管NT2被关闭。
图24是示出在向图20所示的第二栅极驱动器的第一电源电压输入端施加第一电源电压时第一栅极驱动器的输出信号的波形，而图25是示出在向图20所示的第二栅极驱动器的第一时钟信号及第二时钟信号输入端施加第二电源电压时第一栅极驱动器的输出信号的波形。
参照图24，若将第一电源电压Von施加于用于第二栅极驱动器170的第一电源电压Von的输入端，则将来自第一栅极驱动器160的相应阶段的输出波形以异常波形输出。结果，液晶显示装置的显示特性变差。
如图25所示，若将第二电源电压Voff施加于用于第二栅极驱动器170的第一和第二时钟信号CKV和CKVB的输入端，则降低来自第一栅极驱动器160的相应阶段的输出波形的电压电平。结果，第一栅极驱动器160的功率消耗提高。
因此，用于第二栅极驱动器170的第一和第二时钟信号CKV和CKVB的输入端接收第一电源电压Von，并且当第一栅极驱动器160以正常状态运行时，用于第二栅极驱动器170的第一电源电压Von的输入端接收第二电源电压Voff。
根据液晶显示装置，时钟发生器分别产生具有可确定栅极驱动信号的电压电平的第一周期以及可充电或放电第一和第二时钟信号的第二周期的第一和第二时钟信号，并且将第一和第二时钟信号施加于栅极驱动器以控制栅极驱动信号的脉冲宽度。因此，通常栅极驱动器可以驱动对应1H帧的栅极线，从而改善液晶显示装置的显示特性。
而且，由于栅极线具有与其第一端部连接的放电晶体管，在运行下一个阶段之前可将当前阶段进行放电，从而防止栅极驱动信号被延迟。
此外，栅极线包括与其第一端部连接的第一栅极驱动器以及与其第二端部连接的第二栅极驱动器。当第一栅极驱动器以异常状态运行时，第二栅极驱动器一般正常运行。因此，即使第一栅极驱动器运行异常，液晶显示装置也由于第二栅极驱动器而可以正常状态运行。
以上所述仅为本发明的优选实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (21)

1.一种液晶显示装置，包括：
定时控制器，用于响应外部信号输出图像信号、第一定时信号、第二定时信号、及时钟发生控制信号；
时钟发生器，用于产生具有彼此相反相位的第一时钟信号和第二时钟信号，并且用于在第一周期控制所述第一时钟信号和所述第二时钟信号以确定栅极驱动信号的电压电平，以及用于在第二周期控制要进行充电或放电的所述第一时钟信号和所述第二时钟信号；
栅极驱动器，用于响应所述第一定时信号、所述第一时钟信号、及所述第二时钟信号顺次输出所述栅极驱动信号；
数据驱动器，用于响应所述第二定时信号输出所述图像信号；以及
液晶面板，包括用于接收所述图像信号的多条数据线、用于接收所述栅极驱动信号的多条栅极线、以及用于响应所述栅极驱动信号输出所述图像信号与所述数据线和所述栅极线连接的开关装置。
2.根据权利要求1所述的液晶显示装置，其中，所述第一时钟信号包括在所述第一周期的第一电压和在所述第二周期的第一极性，而所述第二时钟信号包括在所述第一周期具有与所述第一电压相反相位的第二电压和在所述第二周期具有与所述第一极性相反相位的第二极性，所述第一时钟信号和所述第二时钟信号在所述第二周期分别具有一斜度。
3.根据权利要求2所述的液晶显示装置，其中，若来自下一阶段的输出电压电平高于预定电压，则将来自当前阶段的输出信号进行放电。
4.根据权利要求1所述的液晶显示装置，其中，所述时钟发生器包括：
电压施加电路，用于在所述第一周期输出具有预定电压的所述第一时钟信号和所述第二时钟信号；以及
充电/放电电路，用于当将所述电压施加电路被关闭时充电或放电所述第一时钟信号和所述第二时钟信号。
5.根据权利要求4所述的液晶显示装置，其中，所述时钟发生控制信号包括用于接通所述电压施加电路的第三周期、用于接通所述充电/放电电路的第四周期、以及用于关闭所述充电/放电电路的第五周期。
6.根据权利要求1所述的液晶显示装置，其中，所述时钟发生控制信号包括：
栅极时钟信号(CPV)，用于控制所述第一时钟信号及所述第二时钟信号以重复具有高周期；
允许信号(OE)，用于控制自所述栅极驱动器连续输出的栅极驱动信号以具有彼此不同的相位差；以及
充电/放电控制信号(CHC)，用于充电或放电所述第一时钟信号和所述第二时钟信号。
7.根据权利要求6所述的液晶显示装置，其中，所述时钟发生器包括：
D-触发器，用于接收所述第一定时信号，并响应所述OE信号分别通过其第一接线端和第二接线端输出第一时钟允许信号(OCS)和第二时钟允许信号(ECS)；
第一电压施加电路，用于响应所述CPV信号、所述OE信号、及所述OCS信号输出在所述第一周期具有预定电压的所述第一时钟信号；
第二电压施加电路，用于响应所述CPV信号、所述OE信号、及所述ECS信号输出在所述第一周期具有预定电压的所述第二时钟信号；以及
充电/放电电路，用于接收所述CPV信号和CHC信号，并且当关闭所述第一电压施加电路及所述第二电压施加电路时充电或放电所述第一时钟信号及所述第二时钟信号。
8.根据权利要求7所述的液晶显示器，其中，所述第一电压施加电路包括：
第一电源电压供给部，用于响应所述OCS信号的高周期输出作为所述第一时钟信号的第一电源电压；以及
第二电源电压供给部，用于响应所述OCS信号的低周期输出作为所述第一时钟信号的第二电源电压。
9.根据权利要求7所述的液晶显示装置，其中，所述第二电压施加电路包括：
第一电源电压供给部，用于响应所述ECS信号的高周期输出作为所述第二时钟信号的第一电源电压；以及
第二电源电压供给部，用于响应所述ECS信号的低周期输出作为所述第二时钟信号的第二电源电压。
10.根据权利要求7所述的液晶显示装置，其中，所述充电/放电电路包括：
时钟充电器，用于当将所述第二时钟信号进行放电时充电所述第一时钟信号，而当将所述第一时钟信号进行放电时充电所述第二时钟信号；以及
充电控制器，用于当所述第一电压施加电路及所述第二电压施加电路被关闭时响应所述CPV信号和所述CHC信号接通或关闭所述时钟充电器且控制所述时钟充电器的运行时间。
11.一种液晶显示装置，包括：
液晶面板，包括沿第一方向延伸的多条栅极线、沿第二方向延伸的多条数据线、具有与所述栅极线连接的第一电极和与所述数据线连接的第二电极的开关装置、以及与所述开关装置的第三电极连接的像素电极；
栅极驱动器，与所述栅极线连接，用于向所述栅极线顺次施加栅极驱动信号；
数据驱动器，与所述数据线连接，用于向所述数据线施加数据驱动信号；以及
放电器，用于响应施加于下一条栅极线的第一栅极驱动信号，放电施加于当前栅极线的第二栅极驱动信号。
12.根据权利要求11所述的液晶显示装置，其中，所述放电器包括晶体管，将所述晶体管的第一电极与所述当前栅极线连接且将第二电极与放电电压输入端连接，用于响应所述第一栅极驱动信号放电所述第二栅极驱动信号。
13.根据权利要求11中所述的液晶显示装置，其中所述栅极驱动器接收第一时钟信号和与所述第一时钟信号具有相反相位的第二时钟信号，并且所述第一时钟信号及所述第二时钟信号分别在第一周期确定所述栅极驱动信号的电平且在第二周期进行充电或放电。
14.根据权利要求13所述的液晶显示装置，其中，所述第一时钟信号包括在所述第一周期的第一电压和在所述第二周期的第一极性，而所述第二时钟信号包括在所述第一周期的具有与所述第一电压相反相位的第二电压和在所述第二周期的具有与第一极性相反相位的第二极性，所述第一时钟信号和所述第二时钟信号分别在所述第二周期具有一斜度。
15.一种液晶显示装置，包括：
液晶面板，包括沿第一方向延伸的多条栅极线、沿与所述第一方向垂直的第二方向延伸的多条数据线、具有与所述栅极线连接的第一电极和与所述数据线连接的第二电极的开关装置、以及与所述开关装置的第三电极连接的像素电极；第一栅极驱动器，与所述栅极线的第一端部连接，用于向所述栅极线顺次施加栅极驱动信号；
第二栅极驱动器，与所述栅极线的第二端部连接，用于当所述第一栅极驱动器处于异常状态时向所述栅极线顺次施加所述栅极驱动信号；
数据驱动器，与所述数据线连接，用于向所述数据线施加数据驱动信号；
第一放电器，用于当运行所述第一栅极驱动器时响应施加于下一条栅极线的第一栅极驱动信号，放电施加于当前栅极线的第二栅极驱动信号；以及
第二放电器，用于当运行所述第二栅极驱动器时响应所述第二栅极驱动信号，放电所述第二栅极驱动信号。
16.根据权利要求15所述的液晶显示装置，还包括与所述第一栅极驱动器连接的外部连接端，其中所述外部连接端包括：
第一输入端，用于接收开始信号；
第二输入端，用于接收第一时钟信号；
第三输入端，用于接收具有与第一时钟信号相反相位的第二时钟信号；
第四输入端，用于接收第一电源电压；以及
第五输入端，用于接收第二电源电压。
17.根据权利要求16所述的液晶显示装置，其中，所述第一时钟信号及所述第二时钟信号分别在第一周期确定所述栅极驱动信号的电平，而在第二周期进行充电或放电。
18.根据权利要求15所述的液晶显示装置，还包括与所述第二栅极驱动器连接的外部连接端，其中所述外部连接端包括：
第一输入端，用于接收开始信号；
第二输入端，用于选择性接收第一时钟信号和第一电源电压；
第三输入端，用于选择性接收具有与第一时钟信号相反相位的第二时钟信号和第二电源电压；
第四输入端，用于选择性接收所述第一电源电压和所述第二电源电压；以及
第五输入端，用于接收所述第二电源电压。
19.根据权利要求18所述的液晶显示装置，其中，所述第一时钟信号和所述第二时钟信号包括用于确定所述栅极驱动信号的电平的第一周期，以及分别用于充电或放电所述第一时钟信号和所述第二时钟信号的第二周期。
20.根据权利要求15所述的液晶显示装置，其中，所述第一放电器包括第一晶体管，将所述第一晶体管的第一电极与所述当前栅极线连接且将第二电极与放电电压输入端连接，用于响应所述第一栅极驱动信号放电所述第二栅极驱动信号。
21.根据权利要求15中所述的液晶显示装置，其中，所述第二放电器包括第二晶体管，将所述第二晶体管的第一电极与所述当前栅极线连接且将第二电极与放电电压输入端连接，用于响应所述第一栅极驱动信号放电所述第二栅极驱动信号。
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