CN1331149C - 相位频率比较装置 - Google Patents

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Abstract

本发明提供一种相位频率比较装置以调整摆动时钟信号同相于摆动信号，包括：第一逻辑门，分别接收第一保护信号以及第二保护信号与输出第三保护信号；第一触发器，接收该第三保护信号，并在以摆动时钟信号触发时，输出第一输出信号；第二触发器，接收第三保护信号，并在摆动信号触发时，输出第二输出信号；第二逻辑门，分别接收第一输出信号及第二输出信号与产生第四保护信号；第三逻辑门，分别接收第三保护信号及第四保护信号输出第五保护信号；及控制信号产生器，用以根据第五保护信号逻辑电平决定是否比较摆动信号及摆动时钟信号的相位。

Description

相位频率比较装置
技术领域
本发明涉及一种控制摆动时钟的光驱与方法，特别涉及一种应用保护机制可避免相位-频率比较器误判摆动时钟与摆动信号的相位差的方法与光驱。
背景技术
在现代的信息社会中，如何整理储存大量的信息，是信息业界最关心的课题之一。在各种储存媒介中，光盘(optical disc)以其轻薄的体积，高密度的储存容量，成为最普遍的高容量数据储存媒介之一。然而，随着多媒体技术的发展，由于一般的CD光盘其容量大约仅有650MB左右，因此已经无法满足使用者的需求，所以业界便另提出新的光盘规格以增加单一光盘可储存数据的容量，例如已知的多功能数字盘(digital versatile disc，DVD)，其大小与一般的CD光盘相同，但是其容量却远大于CD光盘。
虽然只读型(read-only)的多功能数字盘已经普遍地使用，然而，如同已知可录式CD光盘(CD-R disc)及可重复写入式CD光盘(CD-RW disc)的发展，因为该可录式CD光盘与该可重复写入式CD光盘可便利地提供使用者记录所要的数据，因此对于多功能数字盘而言，业界亦随之制订可录式多功能数字盘及可重复写入式多功能数字盘的规格，以便让使用者可如同利用可录式CD光盘与可重复写入式CD光盘记录数据一般地利用可录式多功能数字盘及可重复写入式多功能数字盘来记录大量的数据。如业界所已知，可录式多功能数字盘及可重复写入式多功能数字盘可区分为不同的规格，例如符合DVD+R规格的可录式多功能数字盘与符合DVD+RW规格的可重复写入式多功能数字盘可完全地兼容于目前广泛被使用的DVD激光视盘机(DVD-Video player)与DVD只读光驱(DVD-ROM drive)。
为便于储存数据的管理，多功能数字盘上用来储存数据的区域亦会如同CD光盘一般地区分成许多小记录区(frame)，而多功能数字盘上所储存的信息都会依照一定的规画储存在多功能数字盘上的各记录区中。所以，要将信息写入一可写式多功能数字盘时，光盘烧录机必须要先确定该可写式多功能数字盘上各记录区的规画情形，才能正确地将资料写入该可写式多功能数字盘中。为了要记录与各记录区相关的信息，可写式多功能数字盘也有特殊的构造来记录相关的信息以寻址(addressing)所记录的数据。对于符合DVD+R规格的可录式多功能数字盘与符合DVD+RW规格的可重复写入式多功能数字盘来说，该信息即为地址数据(address in pregroove，ADIP)。如业界所已知，DVD+R盘与DVD+RW盘上均设置有用来记录上述地址数据的摆动轨迹，因此DVD+R光驱与DVD+RW光驱便可读取该摆动轨迹来产生摆动信号(wobble signal)，由于摆动信号是以相变方式来记录地址数据，因此DVD+R光驱与DVD+RW光驱需先依据该摆动信号产生相对应的非相位调制的摆动时钟，以便一地址数据译码器来译码该摆动信号以撷取出所要的地址数据，换句话说，若摆动信号不稳定，则地址数据译码器便无法顺利地由摆动信号读出所要的地址数据。
发明内容
本发明提供一种相位频率比较装置用以调整一摆动时钟信号同相于一摆动信号，包含有：一第一逻辑门，其输入端分别接收一第一保护信号以及一第二保护信号，并根据逻辑运算的结果输出一第三保护信号；一第一触发器，连结至第一逻辑门，其输入端接收第三保护信号，用以当摆动时钟信号触发时，输出第三保护时钟信号为一第一输出信号；一第二触发器，连结至第一逻辑门，其输入端接收第三保护信号，用以当摆动信号触发时，输出第三保护时钟信号为一第二输出信号；一第二逻辑门，连接至第一触发器以及第二触发器，输入端分别接收第一输出信号以及第二输出信号，并根据逻辑运算的结果输出一第四保护信号；一第三逻辑门，连接至第二逻辑门，其输入端分别接收第三保护信号以及第四保护信号，并根据逻辑运算的结果输出一第五保护信号；以及一控制信号产生器，分别接收摆动时钟信号、摆动信号以及第五保护信号，用以根据第五保护信号的逻辑电平，决定是否比较摆动信号以及摆动时钟信号的相位。
本发明另提供一种相位频率比较的方法，用以调整一摆动时钟信号同步于一摆动信号，包含有：将一第一保护信号以及一第二保护信号执行一第一逻辑运算，用以输出一第三保护信号；当摆动时钟信号触发时，输出第三保护信号形成一第一输出信号；当摆动信号触发时，输出第三保护信号形成一第二输出信号；将第一输出信号以及第二输出信号执行一第二逻辑运算，用以输出一第四保护信号；以及将第三保护信号以及第四保护信号执行一第三逻辑运算，用以输出一第五保护信号；其中根据该第五保护信号的逻辑电平，决定是否比较摆动信号以及摆动时钟信号的相位。
本发明光驱(DVD+R光驱或DVD+RW光驱)是应用具有保护机制的时钟产生电路，该保护机制可延长一保护信号的重置时间，因此可避免相位-频率比较器误判摆动时钟与摆动信号的相位关系。
附图说明
图1为本发明光驱的功能方块示意图。
图2为图1所示的相位-频率比较器的功能方块示意图。
图3为图2所示的相位-频率比较器的操作示意图。
附图符号说明
10               光驱           12、14    低通滤波器
16、18、 20      限幅器         22        相位-频率比
                                          较器
24               回路滤波器     26        压控振荡器
28               地址数据译码   29        保护电路
                 器
32、34、36 OR    逻辑门         38、40    反相器
42、44           触发器         46        控制信号产生
                                          器
具体实施方式
请参阅图1，图1为本发明光驱10的功能方块示意图。光驱10包含有多个低通滤波器(low-pass filter，LPF)12、14，多个限幅器(slicer)16、18、20，一相位-频率比较器(phase-frequencydetector，PFD)22，一回路滤波器(loop filter)24，一压控振荡器(voltage-controlled oscillator，VCO)26，一地址数据译码器(ADIP decoder)28，以及一保护电路29。如业界所已知，地址数据是以相位调制方式记录在摆动信号Wobble中，而光盘上的每二个记录区是对应93个摆动周期，其中8个摆动周期是以相位调制方式来记录地址数据，因此光驱10必须依据相位调制的摆动信号Wobble先产生一非相位调制的摆动时钟WobbleCLK，然后才可经由摆动时钟WobbleCLK与摆动信号Wobble的XOR逻辑运算来撷取出摆动信号Wobble中相位调制周期所对应的逻辑值，所以，摆动信号Wobble会先经由一低通滤波器12处理以产生一输出信号S1，然后再经由限幅器16将输出信号S1转换为对应方波波形的输出信号S2。此外，输出信号S1亦会输入另一低通滤波器14以转换为一输出信号S3，请注意，低通滤波器12是对应一低Q值(Q factor)，而低通滤波器14则对应一高Q值。接着，输出信号S3再经由限幅器18而转换为对应方波波形的输出信号S4。
相位-频率比较器22，回路滤波器24，压控振荡器26，以及限幅器20可视为一时钟产生电路(clock generator)，用来产生所需的摆动时钟WobbleCLK。如图1所示，当压控振荡器26接收一控制电压Vc后便依据控制电压Vc的电压电平产生摆动时钟WobbleCLK至地址数据译码器28，同时摆动时钟WobbleCLK会经由限幅器20转换为具有方波波形的输出信号S5，然后，相位-频率比较器22便可比较输出信号S5与输出信号S4之间的相位差，并依据相位差产生控制信号UP、DN至回路滤波器24，最后回路滤波器24便依据控制信号UP与控制信号DN来输出控制电压Vc至压控振荡器26以调整摆动时钟WobbleCLK的频率。
一般而言，回路滤波器24会包含有电压提升电路(charge pump)以依据控制信号UP、DN调整控制电压Vc的大小，而控制电压Vc的大小是用来驱动压控振荡器26调整其输出的摆动时钟WobbleCLK的频率。举例来说，若输出信号S5的上升缘(rising edge)提前于输出信号S4的上升缘前形成，则会触发相位-频率比较器22产生控制信号DN以用来降低控制电压Vc，亦即降低摆动时钟WobbleCLK的频率而延长输出信号S5的下一回上升缘的产生时间，以便修正目前输出信号S5的相位领先输出信号S4的相位的状态，而当输出信号S4的上升缘稍后形成时，相位-频率比较器22会触发控制信号UP产生一脉冲(impulse)，并随即同时重置控制信号UP、DN而完成一次相位校正的操作；相反地，若输出信号S4的上升缘提前于输出信号S5的上升缘前形成，则会触发相位-频率比较器22产生控制信号UP以用来提升控制电压Vc，亦即增加摆动时钟WobbleCLK的频率而提早输出信号S5的下一回上升缘的产生时间，以便修正目前输出信号S5的相位落后输出信号S4的相位的状态，而当输出信号S5的上升缘稍后形成时，相位-频率比较器22会触发控制信号DN产生一脉冲，并随即同时重置控制信号UP、DN而完成一次相位校正的操作。此外，当输出信号S4与输出信号S5同相时，输出信号S4与输出信号S5的上升缘会同时触发相位-频率比较器22产生控制信号UP的脉冲与控制信号DN的脉冲，并随即会同时重置控制信号UP与控制信号DN，由于控制信号UP与控制信号DN是分别用来提升与降低控制电压Vc，且控制信号UP与控制信号DN被触发的持续时间(duration)相同，因此当输出信号S4与输出信号S5同相时，控制电压Vc会保持不变而驱使压控振荡器26继续维持目前的摆动时钟WobbleCLK。最后，地址数据译码器28便可根据对应摆动信号Wobble的输出信号S2与摆动时钟WobbleCLK来执行一XOR逻辑运算以撷取摆动信号Wobble中相位调制的动周期所对应的逻辑值，并利用该逻辑值来判断摆动信号Wobble是否记录同步单元(sync unit)或数据单元(data unit)而为有效的地址数据ADIP。
如前所述，摆动时钟WobbleCLK是依据摆动信号Wobble所产生，然而，摆动信号Wobble却包含有相位调制的摆动周期，因此当摆动信号Wobble的相位调制周期影响输出信号S4时，对于相位-频率比较器22来说，若其直接依据对应摆动信号Wobble的输出信号S4来驱动输出信号S5同步于输出信号S4，则此时由于相位调制的摆动周期的干扰，不稳定的输出信号S4会造成相位-频率比较器22误动作而驱使压控振荡器26不停地调整摆动时钟WobbleCLK，亦即若摆动时钟WobbleCLK的频率原本已锁定摆动信号Wobble的非相位调制周期所对应的频率，然而当摆动信号Wobble的相位调制周期影响输出信号S4后，摆动时钟WobbleCLK的频率会因为输出信号S4的影响而随之不稳定，所以必须重新进行同步摆动时钟WobbleCLK的时钟周期与摆动信号Wobble的非相位调制周期的操作。
因此，在光驱10中，保护电路29便用来依据对应摆动信号Wobble的输出信号S3产生一保护信号P1，亦即保护电路29可检测输出信号S3中受摆动信号Wobble的8个相位调制周期影响的时段，同时于该时段中持续输出对应一逻辑值(例如”1”)保护信号P1至相位-频率比较器22。当相位-频率比较器22接收到保护信号P1时，相位-频率比较器22便会停止输出控制信号UP、DN，所以回路滤波器24便会保持目前的控制电压Vc，对于压控振荡器26来说，当控制电压Vc对应一固定的电压电平时，摆动时钟WobbleCLK的频率亦会对应一定值，换句话说，当保护电路29检测到输出信号S3中的不稳定周期后，其经由输出保护信号P1来保护摆动时钟WobbleCLK不受摆动信号Wobble的相位调制周期所影响。
地址数据译码器28是依据摆动时钟WobbleCLK来译码输出信号S2以输出摆动信号Wobble以相位调制方式所记录的地址数据ADIP，因此当摆动时钟WobbleCLK的时钟周期与摆动信号Wobble的非相位调制周期同步，且地址数据译码器28可成功地译码摆动信号Wobble产生所要的地址数据ADIP后，地址数据译码器28便可预测摆动信号Wobble的相位调制周期影响相位-频率比较器22的时序。举例来说，依据DVD+R与DVD+RW的规格可知，一光盘上的每二个记录区会对应93个摆动周期，其中8个摆动周期是以相位调制方式来记录地址数据ADIP，而其余的85个摆动周期是为非相位调制的信号，所以地址数据译码器28先自8个相位调制周期撷取出地址数据ADIP，而在85个摆动周期后，地址数据译码器28又成功地自接连的8个相位调制周期撷取出地址数据ADIP，所以地址数据译码器28便可预测摆动信号Wobble于后续85个摆动周期后会对应相位调制的摆动周期，因此地址数据译码器28便可于该相位调制的摆动周期影响相位-频率比较器22的时序之前一预定时间即输出一保护信号P2至相位-频率比较器22，亦即地址数据译码器28可触发保护信号P2对应一逻辑值(例如”1”)直到相位调制的摆动周期结束为止。保护信号P2与保护信号P1具有相同的功用，亦即当相位-频率比较器22接收到保护信号P2时，相位-频率比较器22便会停止输出控制信号UP、DN，所以回路滤波器24便会保持目前的控制电压Vc，由于控制电压Vc对应一固定的电压电平，所以摆动时钟WobbleCLK的频率亦会对应一定值。
如上所述，本实施例的相位-频率比较器22是依据保护信号P1、P2来避免摆动信号Wobble的相位调制周期干扰摆动时钟WobbleCLK，亦即相位-频率比较器22使用一保护机制来确保摆动时钟WobbleCLK的时钟周期可正确地同步于摆动信号Wobble的非相位调制周期。请同时参阅图2与图3，图2为图1所示的相位-频率比较器22的功能方块示意图，而图3为图2所示的相位-频率比较器22的操作示意图。相位-频率比较器22包含有多个OR逻辑门32、34、36，多个反相器38、40，多个触发器42、44，以及一控制信号产生器46。相位-频率比较器22的操作说明如下，首先，保护电路29所输出的保护信号P1与地址数据译码器28所输出的保护信号P2经由OR逻辑门32执行一OR逻辑运算后产生一保护信号P3，一般而言，在地址数据译码器28可使用摆动时钟WobbleCLK成功地撷取地址数据ADIP前，相位-频率比较器22主要是利用保护电路29所输出的保护信号P1来避免摆动时钟WobbleCLK受摆动信号Wobble干扰，然而，当压控振荡器26可产生所要的摆动时钟WobbleCLK后，由于地址数据译码器28此时可预测摆动信号Wobble中相位调制周期的时序，因此，相位-频率比较器22主要是利用地址数据译码器28所输出的保护信号P2来避免摆动时钟WobbleCLK受摆动信号Wobble干扰，所以相位-频率比较器22便利用OR逻辑门32来输出保护信号P3以同时涵盖两保护信号P1、P2对摆动时钟WobbleCLK所提供的保护功能。
然后，保护信号P3会同时输入触发器42、44的数据输入端D，当触发器42、44的时钟端CLK受一上升缘所触发时，触发器42、44的数据输入端D所保持的逻辑值才会传递数据输出端Q，且数据输出端Q会保持数据输入端D的逻辑值。本实施例中，输出信号S4、S5是分别经由反相器38、40反转其逻辑值后输入触发器42、44的时钟端CLK，亦即当输出信号S4、S5对应一下降缘(falling edge)时，触发器42、44会将数据输入端D所保持的逻辑值传递至数据输出端Q。如图3所示，在时间t4时，OR逻辑门32所输出的保护信号P3才由一低逻辑电平转变至一高逻辑电平(上升缘)，而输出信号S4直到时间t7时由一高逻辑电平转变至一低逻辑电平(下降缘)，所以对于触发器44而言，其时钟端CLK因为上升缘触发而将数据输入端D的逻辑值传递至数据输出端Q，亦即触发器44的数据输出端Q在时间t7前会对应低逻辑电平，而在时间t7时则对应高逻辑电平。当触发器44的数据输出端Q驱使OR逻辑门34的一输入端对应高逻辑电平后，OR逻辑门34所输出的保护信号P4便会在时间t7时由低逻辑电平转变至高逻辑电平。同样地，在时间t8时，输出信号S5会由一高逻辑电平转变至一低逻辑电平(下降缘)，所以对于触发器42而言，其时钟端CLK因为上升缘触发而将数据输入端D的逻辑值传递至数据输出端Q，亦即触发器44的数据输出端Q在时间t8前会对应低逻辑电平，而在时间t8时则对应高逻辑电平，由于OR逻辑门34是执行一OR逻辑运算，因此当触发器42的数据输出端Q驱使OR逻辑门34的另一输入端亦对应高逻辑电平后，OR逻辑门34所输出的保护信号P4仍会继续维持高逻辑电平。
此外，在时间t10时，OR逻辑门32所输出的保护信号P3会由高逻辑电平转变至低逻辑电平(下降缘)，而输出信号S4稍后在时间t12时由高逻辑电平转变至低逻辑电平(下降缘)，所以对于触发器44而言，其时钟端CLK因为上升缘触发而将数据输入端D的逻辑值传递至数据输出端Q，亦即触发器44的数据输出端Q在时间t12前会对应高逻辑电平，而在时间t12时则对应低逻辑电平。当触发器44的数据输出端Q驱使OR逻辑门34的一输入端对应低逻辑电平时，由于触发器42的数据输出端Q仍保持高逻辑电平，所以OR逻辑门34所输出的保护信号P4在时间t12时仍会对应高逻辑电平。然而，在时间t13时，输出信号S5会由高逻辑电平转变至低逻辑电平(下降缘)，所以对于触发器42而言，其时钟端CLK因为上升缘触发而将数据输入端D的逻辑值传递至数据输出端Q，亦即触发器44的数据输出端Q在时间t13前会对应高逻辑电平，而在时间t13时则对应低逻辑电平，由于OR逻辑门34是执行一OR逻辑运算，因此当触发器42的数据输出端Q亦驱使OR逻辑门34的另一输入端对应低逻辑电平后，OR逻辑门34所输出的保护信号P4便会由高逻辑电平转变至低逻辑电平。
本实施例中，保护信号P4与保护信号P3会进一步地经由OR逻辑门36执行一OR逻辑运算而产生一保护信号P5，如图3所示，保护信号P3是在时间t4-t10之间是对应高逻辑电平，而保护信号P4则在时间t7-t13之间对应高逻辑电平，所以，保护信号P5便会在时间t4-t13之间对应高逻辑电平。OR逻辑门36同时会将保护信号P5传递至控制信号产生器46。控制信号产生器46是用来依据输出信号S4与输出信号S5之间的相位关系产生相对应的控制信号UP、DN，因此便可控制压控振荡器26调整摆动时钟WobbleCLK的频率。如图3所示，输出信号S5在时间t0时即产生上升缘，然而，输出信号S4稍后在时间t1时才产生上升缘，亦即输出信号S5的相位领先输出信号S4的相位，所以在时间t0时，控制信号产生器46会触发控制信号DN由高逻辑电平转变至低逻辑电平，而在时间t1时，控制信号产生器46会触发控制信号UP产生一脉冲，同时重置控制信号DN；同理，输出信号S4在时间t2时即产生上升缘，然而，输出信号S5稍后在时间t3时才产生上升缘，亦即输出信号S4的相位领先输出信号S5的相位，所以在时间t2时，控制信号产生器46会触发控制信号UP由高逻辑电平转变至低逻辑电平，而在时间t3时，控制信号产生器46会触发控制信号DN产生一脉冲，同时重置控制信号UP。
由于保护信号P5在时间t4-t13之间对应高逻辑电平，亦即在时间t4-t13中启动保护机制来避免摆动信号Wobble的相位调制周期干扰摆动时钟WobbleCLK，所以控制信号产生器46在时间t4-t13之间并不会触发控制信号UP、DN由高逻辑电平转变至低逻辑电平而驱使控制电压Vc产生任何变动。在时间t13后，输出信号S4在时间t14时产生上升缘，然而，输出信号S5稍后在时间t15时才产生上升缘，亦即输出信号S4的相位领先输出信号S5的相位，所以在时间t14时，控制信号产生器46可触发控制信号UP由高逻辑电平转变至低逻辑电平，而在时间t15时，控制信号产生器46可触发控制信号DN产生一脉冲，并同时重置控制信号UP；同样地，由于保护信号P5在时间t13之后是对应低逻辑电平而不启动保护机制，所以控制信号产生器46在时间t16时可成功地触发控制信号UP由高逻辑电平转变至低逻辑电平，而在时间t17时，控制信号产生器46可触发控制信号DN产生一脉冲，并同时重置控制信号UP。
本实施例中，OR逻辑门34的功能是用来延后保护机制的结束时间以确保相位-频率比较器22正常地运作，举例来说，保护信号P3在时间t10时由高逻辑电平转变至低逻辑电平，由图3可知，时间t10是介在时间t9与时间t11之间，其中输出信号S4在时间t9产生上升缘，以及输出信号S5在时间t11产生上升缘。所以，若直接使用保护信号P3来驱动控制信号产生器46而不经由OR逻辑门34的处理，对于控制信号产生器46来说，其在时间t11时触发一控制信号DN’由高逻辑电平转变至低逻辑电平，然而，输出信号S4直到时间t14才产生上升缘，所以控制信号产生器46在时间t14时触发一控制信号UP’产生一脉冲，并同时重置控制信号DN’；同样地，输出信号S5在时间t15产生上升缘，所以控制信号产生器46在时间t15时触发控制信号DN’由高逻辑电平转变至低逻辑电平，而输出信号S4直到时间t16才产生上升缘，所以控制信号产生器46在时间t16时触发控制信号UP’产生一脉冲，并同时重置控制信号DN’。如图3所示，输出信号S4与输出信号S5在时间t9-t11之间是对应一相位差，且输出信号S4的相位领先输出信号S5，然而，于保护信号P3所启动的保护机制结束后，由于保护信号P3的重置时间t10是介在时间t9与时间t11之间，因此造成输出信号S4与输出信号S5在时间t11-t14之间是对应一相位差，且输出信号S5的相位反而领先输出信号S4，换句话说，由于保护信号P3的重置时间的影响，因此可能会造成相位-频率比较器22不正常地运作。所以，本实施例中，相位-频率比较器22利用OR逻辑门34来驱使保护信号P3于输出信号S4、S5两者均已产生一下降缘时才由高逻辑电平重置至低逻辑电平(保护信号P4)，因此可避免上述相位领先关系倒置的情形。
另外，本实施例中，OR逻辑门36的功能是用来回复保护机制的开始时间以确保相位-频率比较器22正常地运作，举例来说，保护信号P3在时间t4-t10之间是对应高逻辑电平，亦即控制信号产生器46理应在时间t4即启动保护机制来避免摆动时钟WobbleCLK受摆动时钟Wobble的相位调制周期所干扰，然而，若直接使用保护信号P4来驱动控制信号产生器46而不经由OR逻辑门36的处理，对于控制信号产生器46来说，其在时间t7时才会启动保护机制，换句话说，控制信号产生器46会在时间t5-t6之间触发控制信号UP’、DN’以调整输出信号S5与输出信号S4的相位差，所以摆动时钟WobbleCLK便可能多执行一次相位校正而受相位调制周期所干扰。所以，相位-频率比较器22利用OR逻辑门36以于保护信号P3触发时即会启动保护机制(保护信号P5)，因此可避免上述控制信号产生器46不当地校正输出信号S4、S5之间的相位。
如上所述，触发器42、44(不考虑反相器38、40的运作)与控制信号产生器46是为上升缘触发的组件，而保护信号P4的触发时间(t7)与重置时间(t13)因为反相器38、40的作用而由输出信号S4、S5的下降缘所控制，且控制信号产生器46便需依据输出信号S4、S5的上升缘来产生控制信号UP、DN。然而，于本发明光驱10中，保护信号P4的触发时间与重置时间亦可直接由输出信号S4、S5的上升缘所控制，以及控制信号产生器46则依据输出信号S4、S5的下降缘来产生控制信号UP、DN，亦即需调整图2所示的电路架构，其中输出信号S4、S5不经由反相器38、40而直接输入触发器42、44的时钟端CLK，以及输出信号S4、S5需先经由反相器38、40处理后才传递至控制信号产生器46。
本发明光驱(DVD+R光驱或DVD+RW光驱)是应用具有保护机制的时钟产生电路，该保护机制可延长一保护信号的重置时间，因此可避免相位-频率比较器误判摆动时钟与摆动信号的相位关系。本发明光驱是利用保护机制来校正保护信号以便时钟产生电路可迅速地产生所要的摆动时钟，此外，本发明光驱亦利用保护机制来校正保护信号以便时钟产生电路可稳定地维持所要的摆动时钟，综合上述，本发明光驱于执行数据烧录时可具有较佳效能。
以上所述仅为本发明的较佳实施例，凡依本发明申请专利范围所做的均等变化与修饰，皆应属本发明专利的涵盖范围。

Claims (12)

1.一种相位频率比较器，用以调整一目标时钟信号同相于一输入信号，包含有：
一第一逻辑门，其输入端分别接收一第一保护信号以及一第二保护信号，并根据逻辑运算的结果输出一第三保护信号，从而当该第一保护信号或该第二保护信号有效时，使该第三保护信号有效，其中该第一保护信号以及该第二保护信号为分别来自保护电路与地址数据解码器的、防止该相位频率比较器调整该目标时钟信号同相于该输入信号的保护信号；
一第一触发器，连结至该第一逻辑门，其输入端接收该第三保护信号，用以当该目标时钟信号触发时，输出该第三保护时钟信号为一第一输出信号；
一第二触发器，连结至该第一逻辑门，其输入端接收该第三保护信号，用以当该输入信号触发时，输出该第三保护时钟信号为一第二输出信号；
一第二逻辑门，连接至该第一触发器以及该第二触发器，其输入端分别接收该第一输出信号以及该第二输出信号，并根据逻辑运算的结果输出一第四保护信号，从而当该第一输出信号或该第二输出信号有效时，使该第四保护信号有效；
一第三逻辑门，连接至该第二逻辑门，其输入端分别接收该第三保护信号以及该第四保护信号，并根据逻辑运算的结果输出一第五保护信号，从而当该第三保护信号或该第四保护信号有效时，使该第五保护信号有效；以及
一控制信号产生器，分别接收该目标时钟信号、该输入信号以及该第五保护信号，用以根据该第五保护信号的逻辑电平，决定是否比较该输入信号的相位以及该目标时钟信号的相位；
其中，当该第五保护信号有效时，停止比较该输入信号的相位以及该目标时钟信号的相位；其中当该第五保护信号无效时，比较该输入信号的相位以及该目标时钟信号的相位以输出一电压控制信号，用以调整该目标时钟信号同相于该输入信号。
2.如权利要求1所述的相位频率比较器，其中，该第一逻辑门、该第二逻辑门以及该第三逻辑门皆为一或门。
3.如权利要求1所述的相位频率比较器，其中，该第五保护信号有效电平为高逻辑电平，以及该第五保护信号无效电平为低逻辑电平。
4.如权利要求1所述的相位频率比较器，其中，该第一触发器以及该第二触发器皆为下降缘触发的D型触发器。
5.如权利要求1所述的相位频率比较器，其中，更包含有：
一第一反相器，连接至该第一触发器的触发端，用以当该目标时钟信号输入该第二触发器的触发端前，先反相该目标时钟信号；以及
一第二反相器，连接至该第二触发器的触发端，用以当该输入信号输入该第二触发器的触发端前，先反相该输入信号。
6.如权利要求5所述的相位频率比较器，其中，该第一触发器以及该第二触发器皆为上升缘触发的D型触发器。
7.一种相位频率比较的方法，用以调整一目标时钟信号同步于一输入信号，包含有：
将一第一保护信号以及一第二保护信号执行一第一逻辑运算，用以输出一第三保护信号，从而当该第一保护信号或该第二保护信号有效时，使该第三保护信号有效，其中该第一保护信号以及该第二保护信号为分别来自保护电路与地址数据解码器的、防止该相位频率比较器调整该目标时钟信号同相于该输入信号的保护信号；
当该目标时钟信号触发时，输出该第三保护信号形成一第一输出信号；
当该输入信号触发时，输出该第三保护信号形成一第二输出信号；
将该第一输出信号以及该第二输出信号执行一第二逻辑运算，用以输出一第四保护信号，从而当该第一输出信号或该第二输出信号有效时，使该第四保护信号有效；以及
将该第三保护信号以及该第四保护信号执行一第三逻辑运算，用以输出一第五保护信号，从而当该第三保护信号或该第四保护信号有效时，使该第五保护信号有效；
其中，根据该第五保护信号是否有效，决定是否比较该输入信号的相位以及该目标时钟信号的相位。
8.如权利要求7所述的相位频率比较的方法，其中，当该第五保护信号有效时，停止比较该输入信号的相位以及该目标时钟信号的相位。
9.如权利要求7所述的相位频率比较的方法，其中，当该第五保护信号无效时，比较该输入信号的相位以及该目标时钟信号的相位以输出一电压控制信号，用以调整该目标时钟信号同相于该输入信号。
10.如权利要求7所述的相位频率比较的方法，其中，当该目标时钟信号由逻辑高电平转换成逻辑低电平时，输出该第三保护信号形成一第一输出信号。
11.如权利要求7所述的相位频率比较的方法，其中，当该输入信号由逻辑高电平转换成逻辑低电平时，输出该第三保护信号形成一第二输出信号。
12.如权利要求7所述的相位频率比较的方法，其中，该第五保护信号有效电平为高逻辑电平，以及该第五保护信号无效电平为低逻辑电平。
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