CN100365732C - 判断地址数据的方法 - Google Patents

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Abstract

本发明涉及一种地址数据判断的方法，其包含有依据该摆动信号产生一摆动时钟；依据摆动信号与摆动时钟产生一运算数据；将运算数据取样后比较取样信号的各位与包含一地址数据的理想位串的各位，并依据对应不同逻辑值的位数总合产生一第一逻辑位数，以及依据对应相同逻辑值的位数总合产生一第二逻辑位数；以及依据第一逻辑位数与第二逻辑位数判断该运算数据是否对应该地址数据。

Description

判断地址数据的方法
技术领域
本发明涉及一种判断地址数据的方法，特别涉及一种计数逻辑值相同的位数与逻辑值相异的位数来判断地址数据的方法。
背景技术
虽然已知光盘烧录机可便利地提供使用者记录所要的数据，然而一般光盘的容量有限而逐渐无法满足使用者对于多媒体数据储存的需求，因此业界便另提出新的光盘规格以增加原先一般光盘可储存数据的容量，例如已知的多功能数字盘(digital versatile disc，DVD)，其大小与一般的CD光盘相同，但是其容量却远大于CD光盘。对于多功能数字盘而言，业界亦随之制订可录式多功能数字盘及可重复写入式多功能数字盘的规格，以便让使用者可如同利用可录式CD光盘与可重复写入式CD光盘记录数据一般地利用可录式多功能数字盘及可重复写入式多功能数字盘来记录大量的数据。如业界所已知，可录式多功能数字盘及可重复写入式多功能数字盘可区分为不同的规格，例如符合DVD+R规格的可录式多功能数字盘与符合DVD+RW规格的可重复写入式多功能数字盘可完全地兼容于目前广泛被使用的DVD激光视盘机(DVD-Video player)与DVD只读光驱(DVD-ROM drive)。
如同CD光盘一般，为便于内储信息的管理，多功能数字盘上储存数据的区域亦会被区分成许多小记录区(frame)，且多功能数字盘上所储存的信息会依照一定的规画储存在多功能数字盘上的各记录区中。所以，要将信息写入一可写式多功能数字盘时，光盘烧录机必须要先确定该可写式多功能数字盘上各记录区的规画情形，才能正确地将资料写入该可写式多功能数字盘中。为了要记录与各记录区相关的信息，可写式多功能数字盘也有特殊的构造来记录相关的信息以寻址所记录的数据。对于符合DVD+R规格的可录式多功能数字盘与符合DVD+RW规格的可重复写入式多功能数字盘来说，该信息即为地址数据(address in pregroove，ADIP)。
地址数据是以相位调制(phase modulation)方式记录在摆动信号中，而光盘上的二记录区是对应93个摆动周期，其中8个摆动周期是以相位调制方式来记录地址数据，所以光驱必须使用一地址数据译码器(ADIP decoder)来撷取出该地址数据。请参阅图1，图1为已知光驱系统10的示意图。光驱系统10是应用一光驱12来读取一光盘14上所储存的数据以及将数据烧录于光盘14上，而光驱12中设置有一读写头(pick-up head)16，一摆动时钟产生电路(wobble clock generator)18，一地址数据译码器20，以及一控制电路(controller)22。此外，地址数据译码器20包含有一XOR逻辑运算电路24以及一判断逻辑电路(decision logic)26，而摆动时钟产生电路18中设置有一锁相环(phase lock loop，PLL)28以及一分频电路(frequencydivider)29。当光驱12对光盘12进行数据读取操作时，读写头16可依据一预定激功率输出一入射激光Li至光盘12的轨道15上一预定位置，然后该预定位置会依据入射激光Li而产生一相对应的反射激光Lr至读写头16，因此读写头16便可接收反射激光Lr，并转换该反射激光Lr为一相对应的电气信号。如业界所已知，对于符合DVD+R规格或DVD+RW规格的光盘14而言，当光盘14出厂时，在光盘14的反射面上，除了用来写入位“0”与“1”的数据轨道外，另设置有凸出于该反射面的摆动轨道，亦即该数据轨道是位于突出的摆动轨道间所形成的沟槽(groove)内，而该摆动轨道则记载着地址数据以便可顺利地读取该数据轨道上所记录的数据，以及便于将数据写入该数据轨道上。
当读写头16接收上述摆动轨道所产生的反射激光Lr后，读写头16即将反射激光Lr转换为摆动信号WBL，并同时输出摆动信号WBL至摆动时钟产生电路18与地址数据译码器20。接着，摆动时钟产生电路18便根据摆动信号WBL(具有相位调制的摆动周期)来产生相对应的非相位调制的摆动信号WBLCLK。如图1所示，摆动信号WBL先输入锁相环28，而锁相环28便可依据相位调制的摆动信号WBL先产生一非相位调制的高频时钟信号WOBCLK，然后再经由分频电路29来产生所需的摆动信号WBLCLK，此外，高频时钟信号WOBCLK亦可经由分频电路29来产生其它频率的时钟信号以作为光驱12中其它组件的驱动时钟，例如产生一时钟信号WBLCLK2，其频率是为摆动信号WBLCLK的频率的两倍。然后，XOR逻辑运算电路24便对摆动信号WBLCLK与摆动信号WBL进行XOR逻辑运算来产生一运算数据ADIP_PRE，最后，判断逻辑电路26便决定运算数据ADIP_PRE是否为有效的地址数据ADIP。若运算数据ADIP_PRE包含有效的地址数据ADIP，则判断逻辑电路26会将地址数据ADIP输出至控制电路22，因此控制电路22便可依据地址数据ADIP得知光盘14上的轨道信息，以便控制数据写入光盘14与自光盘14读取数据。
图2、3、4分别为已知摆动信号30a、30b、30c的示意图。对于图2所示的摆动信号30a而言，其包含有8个摆动周期W0、W1、W2、W3、W4、W5、W6、W7以相位调制方式来记录对应地址数据的信息，而在摆动周期W0启始时，摆动信号30a即产生180°的相位变化，此外摆动周期W3与摆动周期W4之间，摆动信号30a亦产生180°的相位变化，因此摆动信号30a是对应地址数据的同步单元(ADIP sync unit)，如前所述，摆动时钟产生电路18可产生摆动时钟WBLCLK，由图2可知，摆动时钟WBLCLK是为非相位调制的信号，因此XOR逻辑运算电路24可经由XOR逻辑运算来得到以相位调制方式记录的地址数据ADIP，换句话说，若以摆动时钟WBLCLK的一周期为单位，位串“11110000”即表示摆动信号30a是为一同步单元。对于图3所示的摆动信号30b而言，其包含有8个摆动周期W0、W1、W2、W3、W4、W5、W6、W7以相位调制方式来记录对应地址数据的信息，而在摆动周期W0启始时，摆动信号30b即产生180°的相位变化，此外摆动周期W0与摆动周期W1之间以及摆动周期W5与摆动周期W6之间，摆动信号30b亦分别产生180°的相位变化，因此摆动信号30b即对应地址数据的一数据单元(ADIP data unit)，且该数据单元是为逻辑值“0”，同样地，XOR逻辑运算电路24可经由XOR逻辑运算处理摆动信号30b与摆动时钟WBLCLK来得到以相位调制方式记录的地址数据ADIP，换句话说，若以摆动时钟WBLCLK的一周期为单位，位串“10000011”即表示摆动信号30b是为逻辑值“0”的数据单元。对于图4所示的摆动信号30c而言，其包含有8个摆动周期W0、W1、W2、W3、W4、W5、W6、W7以相位调制方式来记录对应地址数据的信息，而在摆动周期W0启始时，摆动信号30c即产生180°的相位变化，此外摆动周期W0与摆动周期W1之间、摆动周期W3与摆动周期W4之间以及摆动周期W5与摆动周期W6之间，摆动信号30c亦分别产生180°的相位变化，因此摆动信号30c即对应地址数据的一数据单元，且该数据单元是为逻辑值“1”，同样地，XOR逻辑运算电路24可经由XOR逻辑运算处理摆动信号30c与摆动时钟WBLCLK来得到以相位调制方式记录的地址数据ADIP，换句话说，若以摆动时钟WBLCLK的一周期为单位，位串“10001100”即表示摆动信号30c是为逻辑值“1”的数据单元。
已知每93个摆动周期中，8个摆动周期是以相位调制方式来记录对应地址数据的同步单元或数据单元，因此当XOR逻辑运算电路24不断对摆动信号WBL与摆动时钟WBLCLK进行XOR逻辑运算而输出运算数据ADIP_PRE时，若运算数据ADIP_PRE此时具有一位串“11110000”，则表示摆动信号WBL记录一同步单元，所以判断逻辑电路比较运算数据ADIP_PRE与位串“11110000”即可决定运算数据ADIP_PRE是否为所要的地址数据ADIP，同样地，若运算数据ADIP_PRE此时具有一位串“10000011”，则表示摆动信号WBL记录一数据单元(逻辑值“0”)，所以判断逻辑电路比较运算数据ADIP_PRE与位串“10000011”即可决定运算数据ADIP_PRE是否为所要的地址数据ADIP，以及若运算数据ADIP_PRE此时具有一位串“10001100”，则表示摆动信号WBL记录另一同步单元(逻辑值“1”)，所以判断逻辑电路比较运算数据ADIP_PRE与位串“10001100”即可决定运算数据ADIP_PRE是否为所要的地址数据ADIP。
图2至图4所示的摆动信号30a、30b、30c是为记录同步位与数据位的理想波形，然而，读写头16实际上输出的摆动信号WBL会受各种因素影响，例如光盘14旋转时产生震动以及读写头16的输出功率不稳定等均会影响读写头16所接收的反射激光Lr，因此造成摆动信号30a、30b、30c的实际波形受干扰而偏移理想波形，所以已知技术于判断摆动信号WBL时，判断逻辑电路26是执行多个比较运算来决定运算数据ADIP_PRE是否为所要的地址数据ADIP。举例来说，判断逻辑电路26比较运算数据ADIP_PRE与一预定位串“10000111”，虽然该预定位串“10000111”与理想位串“10000011”不同，然而，当运算数据ADIP_PRE等于该预定位串“10000111”时，判断逻辑电路26亦会判断运算数据ADIP_PRE是为一数据单元(逻辑值“0”)，换句话说，判断逻辑电路26使用该预定位串“10000111”是考虑前述干扰对摆动信号30b的影响。所以，当判断逻辑电路26判断运算数据ADIP_PRE是否为所要的地址数据ADIP时，判断逻辑电路26必须使用多个预定位串来逐一检测运算数据ADIP_PRE为同步单元(对应位串“11110000”)或数据单元(对应位串“10000011”或位串“10001100”)，因此判断逻辑电路26必须应用大量缓存器来记录该多个预定位串，且判断逻辑电路26需要复杂的逻辑运算电路来执行上述比较运算。
发明内容
因此本发明提供一种计数逻辑值相同的位数与逻辑值相异的位数来判断地址数据的方法，以解决上述问题。
本发明译码相位调制的摆动信号以判断地址数据的方法，包含有：(a)依据摆动信号产生一非相位调制的摆动时钟；(b)依据摆动信号与摆动时钟产生一运算数据；(c)取样运算数据后，将取样信号的各位与包含一地址数据的位串的各位比较，并依据对应不同逻辑值产生至少一第一逻辑位数，以及依据对应相同逻辑值产生至少一第二逻辑位数；以及(d)依据第一逻辑位数与第二逻辑位数判断该运算数据是否对应该地址数据。
由于本发明地址数据判断方法利用一运算数据与一理想位串之间对应相异逻辑值的第一逻辑位数以及对应相同逻辑值的第二逻辑位数来筛选该运算数据是否对应该理想位串而记录相对应的地址数据。因此，本发明地址数据判断方法仅需比较该第一、第二逻辑位数与第一、第二临界值即可判断该运算数据是否记录地址数据。换句话说，本发明地址数据判断方法可减少光驱中储存组件的用量来降低生产成本，以及降低光驱中判断逻辑电路的复杂度。
附图说明
图1为已知光驱系统的示意图。
图2、3、4分别为已知摆动信号的示意图。
图5为本发明地址数据判断方法的流程图。
图6为本发明地址数据判断方法的操作示意图。
附图符号说明
10  光驱系统       12  光驱
14  光盘           16  读写头
18  摆动时钟产生电 20  地址数据译码器
路
22  控制电路       24  XOR逻辑运算电
路
26  判断逻辑电路   28  锁相环
29  分频电路       30a、30b、30c  摆动信号
具体实施方式
图5为本发明地址数据判断方法的流程图。本发明地址数据判断方法执行于一光驱系统中，用来译码相位调制的摆动信号以判断出所要的地址数据，而光驱系统可以是一DVD+R光驱或一DVD+RW光驱。本发明地址数据判断方法的执行主要包含有下列步骤：
步骤100：使用一参考时钟WBLCLK2来取样运算数据ADIP_PRE以产生一取样信号ADIP_S；
步骤102：对取样信号ADIP_S与一理想位串进行XOR逻辑运算来计算逻辑值相异的第一位数N1，以及对取样信号ADIP_S与该理想位串进行AND逻辑运算来计算逻辑值相同的第二位数N2；
步骤104：第一位数N1是否不大于一第一临界值？若是，则执行步骤106；否则，执行步骤110；
步骤106：第二位数N2是否不小于一第二临界值？若是，则执行步骤108；否则，执行步骤110；
步骤108：判断运算数据ADIP_PRE包含地址数据ADIP；
步骤110：判断运算数据ADIP_PRE不包含地址数据ADIP。
图6为本发明地址数据判断方法的操作示意图。首先，本实施例利用参考时钟WBLCLK2来取样运算数据ADIP_PRE，由于运算数据ADIP_PRE是由摆动信号WBL与摆动时钟WBLCLK经由XOR逻辑运算产生，而参考时钟WBLCLK2的频率是为摆动时钟WBLCLK的频率的两倍，因此若原先运算数据ADIP_PRE以摆动时钟WBLCLK的每一上升缘(rising edge)进行取样是对应N个位，则同样的运算数据ADIP_PRE经由参考时钟WBLCLK2的每一上升缘进行取样则会对应2N个位，换句话说，运算数据ADIP_PRE所产生的取样信号ADIP_S便可具有较高的分辨率(步骤100)。另外，对于地址数据ADIP来说，其同步单元所对应的理想位串S1经由参考时钟WBLCLK2取样后是为“1111111100000000”(S1)，其数据单元所对应的理想位串S2、S3经由参考时钟WBLCLK2取样后则分别为“1100000000001111”(S2)(逻辑值“0”)与“1100000011110000”(S3)(逻辑值“1”)。
如图6所示，假设运算数据ADIP_PRE于时间T1-T2之间对应八个摆动周期，而其相对应取样信号ADIP_S’为“1100000000001111”，然后依据取样信号ADIP_S’与理想位串S1、S2、S3来进行XOR逻辑运算以产生如图6所示的逻辑取样信号R1、R2、R3，以及依据取样信号ADIP_S’与理想位串S1、S2、S3来进行AND逻辑运算以产生如图6所示的逻辑运算结果R1’、R2’、R3’。接着，再依据逻辑运算结果R1、R2、R3、R1’、R2’、R3’来计算取样信号ADIP_S’与理想位串S1、S2、S3之间逻辑值相异的第一位数与逻辑值相同的第二位数(步骤102)。本实施例是将取样信号ADIP_S’与理想位串S1、S2、S3划分为两区段来计算第一位数与第二位数，亦即对于取样信号ADIP_S’来说，其于时间T1-T3(四个摆动周期)的位串“11000000”对应一第一区段，而其于时间T3一T2(四个摆动周期)的位串“0000111”对应一第二区段。明显地，理想位串S1、S2、S3的第一区段分别对应“11111111”、“11000000”、“11000000”，以及理想位串S1、S2、S3的第二区段分别对应“00000000”、“00001111”、“11110000”。
以取样信号ADIP_S’的第一、第二区段与理想位串S1的第一、第二区段的比较为例，由逻辑运算结果R1可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S1的第一区段中逻辑值相异的位，所以将逻辑运算结果R1第一区段中逻辑值为“1”的个数即为对应理想位串S1第一区段逻辑值相异的位数，可以得到逻辑位数D11为6(“00111111”)，同样地，由逻辑运算结果R1可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S1的第二区段中逻辑值相异的位，所以将逻辑运算结果R1第一区段中逻辑值为“1”的个数即为对应理想位串S1第一区段逻辑值相异的位数，可以得到逻辑位数D12为4(“00001111”)。此外，由逻辑运算结果R1’可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S1的第一区段中逻辑值相同的位，所以逻辑位数D13为2(“11000000”)。同样地，由逻辑运算结果R1’可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S1的第二区段中逻辑值相同的位，所以逻辑位数D14为0(“00000000”)。
然后，分别比较上述逻辑位数D11、D12、D13、D14与预定的第一、第二临界值Hi1和Hi2(i为1或2，表示为第一区段或第二区段的临界值，第一临界值是用来检视XOR运算的结果，而第二临界值是用来检视AND运算的结果，且每一区段都分别有对应的第一和第二临界值)。例如设定对应第一区段的第一临界值H11和H21皆为2，以及设定对应第二区段的第一临界值H12为6。请注意，第一、第二区段的第一、第二临界值是为可调整的，用来依据光驱系统10的需求设定理想位串S1可容忍的误差范围。由于此时逻辑位数D11、D12均大于2(步骤104)，所以经过XOR运算后的取样信号ADIP_S’的第一、第二区段与理想位串S1的相对应第一、第二区段具有太多逻辑值相异的位，因此便可判断运算数据ADIP_PRE于时间T1-T2中并非对应地址数据ADIP的同步单元。请注意，由于理想位串S1于第二区段对应于“00000000”，因此当进行AND逻辑运算时，逻辑运算结果R1’在第二区段的每一位均对应逻辑值“0”，所以对于取样信号ADIP_S’与理想位串S1的比较而言，步骤106并未应用于第二区段来判断经过AND运算后的取样信号ADIP_S’的第二区段与理想位串S1的第二区段是否具有大量逻辑值相同的位；相反地，本实施例仅由逻辑位数D12(“00001111”)即可得知取样信号ADIP_S’与理想位串S1于第二区段的位差异，亦即若逻辑位数D12越大(亦即不同的位数越多)，则经过XOR运算后的取样信号ADIP_S’与理想位串S1之间的差异也越大，所以若步骤104应用于第二区段而判断经过XOR运算后的取样信号ADIP_S’的第二区段与理想位串S1的第二区段具有少量逻辑值相异的位(D12小)，则等效地表示经过AND运算后的取样信号ADIP_S’的第二区段与理想位串S1的第二区段具有大量逻辑值相同的位(D14大)。
以取样信号ADIP_S’的第一、第二区段与理想位串S2的第一、第二区段的比较为例，由逻辑运算结果R2可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S2的第一区段中逻辑值相异的位，所以逻辑位数D21为0(“00000000”)，同样地，由逻辑运算结果R2可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S2的第二区段中逻辑值相异的位，所以逻辑位数D22亦为0(“00000000”)。此外，由逻辑运算结果R2’可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S2的第一区段中逻辑值相同的位，所以逻辑位数D23为2(“11000000”)，同样地，由逻辑运算结果R2’可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S2的第二区段中逻辑值相同的位，所以逻辑位数D24为4(“00001111”)。
然后，分别比较上述逻辑位数D21、D22、D23、D24与预定的第一、第二临界值H11、H21、H12、H22，例如设定对应第一区段的第一、第二临界值H11、H12分别为1与1，以及设定对应第二区段的第一、第二临界值H21、H22分别为1与3。同样地，第一、第二区段的第一、第二临界值是为可调整的，用来依序需求设定理想位串S2可容忍的误差范围。由于此时逻辑位数D21(为0)和D22(为0)均不大于1(步骤104)，因此表示经过XOR运算后的取样信号ADIP_S’的第一、第二区段与理想位串S2的第一、第二区段没有逻辑值相异的位，亦即比较结果ADIP_PRE于时间T1-T2中可能是对应理想位串S2，所以需再检测取样信号ADIP_S’的第一、第二区段与理想位串S2的第一、第二区段是否具有大量逻辑值相同的位(亦即此时需要考虑AND运算结果)，此时逻辑位数D23(为2)和D24(为4)分别不小于1与3(步骤106)，换句话说，可判断运算数据ADIP_PRE于时间T1-T2中是对应地址数据ADIP的数据单元(逻辑值“0”)。
以取样信号ADIP_S’的第一、第二区段与理想位串S3的第一、第二区段的比较为例，由逻辑运算结果R3可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S3的第一区段中逻辑值相异的位，所以逻辑位数D31为0(“00000000”)，同样地，由逻辑运算结果R3可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S3的第二区段中逻辑值相异的位，所以逻辑位数D32为8(“11111111”)。此外，由逻辑运算结果R3’可知逻辑值为“1”的位表示取样信号ADIP_S’的第一区段与理想位串S3的第一区段中逻辑值相同的位，所以逻辑位数D33为2(“11000000”)，同样地，由逻辑运算结果R3’可知逻辑值为“1”的位表示取样信号ADIP_S’的第二区段与理想位串S3的第二区段中逻辑值相同的位，所以逻辑位数D34为0(“00000000”)。
然后，分别比较上述逻辑位数D31、D32、D33、D34与预定的第一、第二临界值H11、H21、H12、H22，例如设定对应第一区段的第一、第二临界值H11、H12分别为1与1，以及设定对应第二区段的第一、第二临界值H21、H12分别为1与3。同样地，第一、第二区段的第一、第二临界值是为可调整的，用来依序需求设定理想位串S3可容忍的误差范围。由于此时逻辑位数D31虽不大于1，然而逻辑位数D32却大于1(步骤104)，因此表示取样信号ADIP_S’的第二区段与理想位串S3的第二区段具有太多逻辑值相异的位，因此便可判断运算数据ADIP_PRE于时间T1-T2中并非对应地址数据ADIP的数据单元(逻辑值“1”)。
如业界所已知，摆动时钟WBLCLK的一个时钟周期等于32T，而本实施例是以参考时钟WBLCLK2取样运算数据ADIP_PRE来产生取样信号ADIP_S，由于参考时钟WBLCLK2的频率是为摆动时钟WBLCLK的频率的两倍，换句话说，参考时钟WBLCLK2的一个时钟周期等于16T，所以判断逻辑电路26每隔16T便会产生取样信号ADIP_S的一位，而取样信号ADIP_S’亦需不断地更新以持续地进行地址数据ADIP的判断程序，换句话说，每一次判断地址数据ADIP的操作需于16T内完成。本实施例中，判断取样信号ADIP_S’是否可视为理想位串S1、S2、S3的其一时，是将相对应逻辑运算结果R1、R1’、R2、R2’、R3、R3’划分为两区段来分别累计逻辑位数D11、D12、D13、D14、D21、D22、D23、D24、D31、D32、D33、D34，其主要目的是可降低计算上述位数所需的时间以符合16T的时间限制。以逻辑运算结果R1、R1’与逻辑位数D11、D12、D13、D14为例，由于每一区段包含有8个位，因此若逻辑运算结果R1的第一区段中8个位均具有逻辑值“1”，则位数D11的最大十进制值为8，同样地，其它逻辑位数D12、D13、D14的最大十进制值亦为8，由于一4位加法器(4 bits adder)即可记录二进制值“1000”来表示十进制值8，因此图1所示的判断逻辑电路26便需使用八个4位加法器(4 bits adder)来同时计算逻辑位数D11、D12、D13、D14、D21、D22、D23、D24、D31、D32、D33、D34。由于每一区段包含有8个位，换句话说，各4位加法器需执行8次加法运算以累加该8个位的逻辑值，若4位加法器执行一次加法运算需耗费1T的时间，因此步骤102的执行可于8T的时间中完成，所以判断地址数据ADIP的操作便可符合16T的时间限制。
经由上述流程，时间T1-T2之间的八个摆动周期被判断为记录地址数据ADIP的数据单元(逻辑值“0”)，然而由图6所示的运算数据ADIP_PRE于时间T4-T5所对应的波形可明显地得知该八个摆动周期被误判为记录地址数据ADIP的数据单元(逻辑值“0”)，因此为了避免仅比对八个摆动周期而忽略该八个摆动周期前与该八个摆动周期后的干扰影响，所以本实施例另揭露使用八个以上的摆动周期来进行图5所示的流程，以便进一步地提升本发明方法判断地址数据的准确度。举例来说，于原先八个摆动周期前多选取两个摆动周期，以及于原先八个摆动周期后多选取两个摆动周期来判断时间T1-T2之间的八个摆动周期是否记录地址数据ADIP，亦即以时间T4-T5之间的十个摆动周期来进行前述逻辑值相异的位数以及逻辑值相同的位数的运算。同样地，相对应取样信号ADIP_S亦划分为两区段来降低计算上述位数所需的时间以符合16T的时间限制。由于每一区段对应12位，亦即位数的最大十进制值为12，所以图1所示的判断逻辑电路26此时亦使用四个4位加法器来同时计算对应理想位串S1、S2、S3位数，此外，若4位加法器执行一次加法运算需耗费1T的时间，因此步骤102的执行可顺利地于12T的时间中完成，因此判断地址数据ADIP的操作便可符合16T的时间限制。请注意，此时理想位串S1在两区段分别对应“000011111111”与“000000000000”，理想位串S2在两区段分别对应“000011000000”与“000011110000”，以及理想位串S3在两区段分别对应“000011000000”与“111100000000”。
此外，当利用八个以上的摆动周期来进行图5所示的流程时，若原先八个摆动周期前(时间T1前)的波形受干扰，以及原先八个摆动周期后(时间T2后)的波形受干扰，则步骤102所算出的第一位数即明显地增加，所以经由步骤104即可轻易地判断时间T1-T2之间的八个摆动周期并非记录着地址数据ADIP。综合上述，经由额外摆动周期的辅助，本发明地址数据判断方法可大幅地增进判断地址数据的准确率。
相较于已知技术，本发明地址数据判断方法利用运算数据ADIP_PRE与一理想位串之间对应相异逻辑值的第一位数以及对应相同逻辑值的第二位数来筛选运算数据ADIP_PRE是否对应该理想位串而记录相对应的地址数据ADIP，其中是设定第一、第二临界值来判断该第一、第二位数的数量。若该第一位数大于该第一临界值则表示运算数据ADIP_PRE与该理想位串之间具有过多相异逻辑值的位，所以运算数据ADIP_PRE并非记录对应该理想位串的地址数据ADIP；同样地，若该第二位数小于该第二临界值则表示运算数据ADIP_PRE与该理想位串之间具有过少相同逻辑值的位，所以运算数据ADIP_PRE亦并非记录对应该理想位串的地址数据ADIP。因此，本发明地址数据判断方法仅需比较该第一、第二位数与该第一、第二临界值即可判断运算数据ADIP_PRE是否记录地址数据ADIP，然而，对于已知技术而言，其需使用多个缓存器来记录地址数据ADIP的各种可能位串，以便后续可经由多次比较运算来判断运算数据ADIP_PRE是否记录地址数据ADIP，换句话说，本发明地址数据判断方法可降低光驱中储存组件的用量，以及降低光驱中判断逻辑电路的复杂度。
以上所述仅为本发明的较佳实施例，凡依本发明申请专利范围所做的均等变化与修饰，皆应属本发明专利的涵盖范围。

Claims (11)

1.一种判断一运算数据是否包含一数据地址的方法，该运算数据是根据一相位调制的输入信号产生一非相位调制的高频时钟信号，然后再经由分频电路来产生所需要的目标时钟信号，之后将该输入信号以及该目标时钟信号执行一异或逻辑运算而产生，该方法包含有：
将一取样信号区分成多个取样信号区段，该取样信号使用一参考时钟来取样上述运算数据而产生，该参考时钟是由分频器对该高频时钟信号进行分频而产生；
分别将每一个该取样信号区段与一对应理想位串区段执行一异或逻辑运算以得到多个第一逻辑位数；以及
分别将每一个该第一逻辑位数与一对应第一临界值比较用以判断该运算数据是否包含该数据地址；
其中，若该异或逻辑运算的结果无法得知该运算数据是否包含该数据位置，则将每一个该取样信号区段分别与该对应理想位串区段执行一与逻辑运算。
2.如权利要求1所述的判断一运算数据是否包含一数据地址的方法，其中更包含：取样该运算数据以得到该取样信号。
3.如权利要求2所述的判断一运算数据是否包含一数据地址的方法，其中，取样频率为该目标时钟信号的2倍。
4.如权利要求1所述的判断一运算数据是否包含一数据地址的方法，其中，该输入信号为一光盘的摆动信号，该目标时钟信号为摆动时钟信号。
5.如权利要求1所述的判断一运算数据是否包含一数据地址的方法，其中，多个该第一逻辑位数则分别为多个该取样信号区段与对应该理想位串区段间不同位的数目。
6.如权利要求1所述的判断一运算数据是否包含一数据地址的方法，其中，若多个该第一逻辑位数至少一个大于对应该第一临界值，则判断该运算数据不含该地址数据。
7.如权利要求1所述的判断一运算数据是否包含一数据地址的方法，其中，若多个该第一逻辑位数皆不大于该第一临界值，则分别将每一个该取样信号区段以及对应该理想位串区段执行该与逻辑运算以得到多个第二逻辑位数。
8.如权利要求7所述的判断一运算数据是否包含一数据地址的方法，其中，多个该第二逻辑位数则分别为多个该取样信号区段与对应该理想位串区段间相同位的数目。
9.如权利要求7所述的判断一运算数据是否包含一数据地址的方法，其中更包含将多个该第二逻辑位数分别与多个对应的第二临界值比较。
10.如权利要求9所述的判断一运算数据是否包含一数据地址的方法，其中，若多个该第二逻辑位数至少一个小于对应该第二临界值，则判断该运算数据不含该地址数据。
11.如权利要求9所述的判断一运算数据是否包含一数据地址的方法，其中，若多个该第二逻辑位数皆不小于对应该第二临界值，则判断该运算数据包含该地址数据。
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