CN110084361B - 一种运算装置和方法 - Google Patents

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Abstract

本申请提供了一种运算装置和方法，所述装置包括：存储器、控制器单元、互联模块和运算单元，其中，存储器用于存储数据块，互联模块，用于连接运算单元中的计算器以使得运算单元构成第一计算拓扑结构，以及接收数据块，将数据块发送至运算单元；控制器单元，用于从寄存器单元内提取运算指令，将运算指令译码成执行指令，执行指令用于控制运算单元执行运算操作，将运算指令对应的操作域传输至数据访问单元；运算单元，用于根据执行指令调用运算单元中的计算器对运算指令对应的操作域对应的数据块执行运算操作得到运算结果。本申请提供的技术方案具有计算速度快，功耗低的优点。

Description

一种运算装置和方法
技术领域
本申请涉及人工智能领域，具体地涉及一种运算装置和方法。
背景技术
卷积神经网络是近年来广泛应用于模式识别、图像处理等领域的一种高效识别算法，它具有结构简单、训练参数少和适应性强、平移、旋转、缩放等特点。由于CNN/DNN的特征检测层通过训练数据进行学习，所以在使用CNN/DNN时，避免了显示的特征抽取，而隐式地从训练数据中进行学习；再者由于同一特征映射面上的神经元权值相同，所以网络可以并行学习，这也是卷积网络相对于神经元彼此相连网络的一大优势。
在已有的计算机领域应用中，与卷积运算相关的应用十分普遍。本申请专注于卷积神经网络，目前可以执行此种运算的主流装置如下：
在现有技术中，一种进行卷积神经网络运算的已知方案是使用通用处理器，该方法通过通用寄存器堆和通用功能部件来执行通用指令，从而执行卷积神经网络运算。然而，该方法的缺点之一是单个通用处理器多用于标量计算，在进行卷积神经网络运算时运算性能较低。而使用多个通用处理器并行执行时，通用处理器之间的相互通讯又有可能成为性能瓶颈，影响计算的速度，计算的功耗较高。
发明内容
本申请提供一种运算装置和方法，解决现有技术中存在的性能瓶颈，提高计算的速度，降低计算的功耗的问题。
本申请的一个方面提供了一种运算装置，存储器、控制器单元、互联模块和运算单元，其中，
所述存储器，用于存储数据块，所述数据块包括n维数据，n为大于等于1的整数；
所述互联模块，用于连接运算单元中的计算器以使得所述运算单元构成第一计算拓扑结构，以及接收数据块，将数据块发送至运算单元；
所述控制器单元，用于从寄存器单元内提取运算指令，将运算指令译码成执行指令，执行指令用于控制运算单元执行运算操作，将运算指令对应的操作域传输至所述数据访问单元；
所述运算单元，用于根据所行指令调用所述运算单元中的计算器对运算指令对应的操作域对应的数据块执行运算操作得到运算结果，将运算结果传输至所述数据访问单元以及存储在所述存储器内；
所述运算单元包括主运算模块和多个从运算模块，所述多个从运算模块用于将接收输入数据和运算指令对应的操作域对应的数据块执行卷积运算得到的中间向量，将所述中间向量通过所述互联模块转发至所述主运算模块；所述主运算模块用于将所有中间向量拼接成中间结果，并对所述中间结果执行非线性函数运算得到指令结果；
所述主运算模块包括：
查表部，用于存储有多个线性函数的斜率值和截距值，其中，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
线性拟合部，用于根据查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y；
子主运算模块，用于将中间结果的所有元素值对应的函数值y组合起来得到指令结果。
本申请的另一方面提供了一种运算方法，所述方法由运算装置执行，所述运算装置包括寄存器单元、存储器、数据访问单元、控制器单元和运算单元，其中，
所述控制器单元从所述寄存器单元的首地址读取第一IO指令，根据所述第一IO指令译出第一控制信号，所述数据访问单元根据所述第一控制信号从存储器读取相应的所有运算指令，并将其缓存在所述寄存器单元中；
所述控制器单元从所述寄存器单元读入第二IO指令，根据所述第二IO指令译出第二控制信号，所述数据访问单元根据所述第二IO指令译出的控制信号从所述存储器读取运算单元需要的所有数据块；
所述控制器单元从寄存器单元读入第一CONFIG指令，根据所述第一CONFIG指令译出第三控制信号，所述运算装置根据所述第三控制信号配置该层神经网络计算需要的各种常数；
所述控制器单元从寄存器单元读入第二COMPUTE指令，根据第二COMPUTE指令译出第四控制信号，所述互连模块根据所述第四控制信号将卷积窗口内的输入数据发给计所述算单元内的各计算器；
所述乘法运算器将卷积核w与输入数据Xi执行乘法运算以后得到第一结果，将所述第一结果输入到所述加法运算器执行加法运算得到第二结果，将所述第二结果和偏置b执行加法运算得到第三结果，将所述第三结果输入到激活运算器执行激活运算得到输出结果s，将所述输出结果s传输至所述数据访问单元存储到存储介质内，所述激活运算包括非线性函数运算；
或者，所述运算单元中的多个从运算模块将卷积核w与输入数据Xi执行卷积运算得到中间向量，并将所述中间向量发送到所述运算单元中的主运算模块；
所述主运算模块将所有的中间向量拼接成中间结果；
所述主运算模块中的线性拟合部根据主运算模块中的查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y，其中，所述查表部存储有多个线性函数的斜率值和截距值，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
所述主运算模块中的子主运算模块将中间结果的所有元素值对应的函数值y组合起来得到输出结果s，将所述输出结果s传输至所述数据访问单元存储到存储介质内。
第三方面，提供一种芯片，所述芯片集成第一方面提供的运算装置。
第四方面，提供一种电子设备，所述电子设备包括第三方面提供的芯片。
第五方面，提供一种计算机可读存储介质，其特征在于，其存储用于电子数据交换的计算机程序，其中，所述计算机程序使得计算机执行第二方面提供的方法。
第六方面，提供一种计算机程序产品，所述计算机程序产品包括存储了计算机程序的非瞬时性计算机可读存储介质，所述计算机程序可操作来使计算机执行第二方面所述的方法。
本申请提供的运算装置及配套指令，将参与计算的输入数据和卷积核暂存在高速暂存存储器上(Scratchpad Memory)。在仅发送同一条指令的情况下，卷积神经网络运算单元中可以更加灵活有效地支持不同宽度的数据，并可以解决数据存储中的相关性问题，从而提升了包含大量卷积神经网络计算任务的执行性能，本申请采用的指令具有精简的格式，使得指令集使用方便、支持的向量长度灵活，所以其具有计算速度快，功耗低的优点。
本申请可以应用于以下(包括但不限于)场景中：数据处理、机器人、电脑、打印机、扫描仪、电话、平板电脑、智能终端、手机、行车记录仪、导航仪、传感器、摄像头、云端服务器、相机、摄像机、投影仪、手表、耳机、移动存储、可穿戴设备等各类电子产品；飞机、轮船、车辆等各类交通工具；电视、空调、微波炉、冰箱、电饭煲、加湿器、洗衣机、电灯、燃气灶、油烟机等各类家用电器；以及包括核磁共振仪、B超、心电图仪等各类医疗设备。
附图说明
图1为本申请实施例提供了一种运算装置的结构示意图；
图2a是本申请实施例提供的主运算模块的结构图；
图2b是本申请实施例提供的非线性函数运算装置的内部结构图；
图2c是本申请实施例中线性拟合部的内部结构图；
图2d是本申请实施例的非线性函数运算的原理图；
图3示出了根据本申请实施例的运算装置中主运算模块结构的示例框图；
图4a示出了根据本申请实施例的运算装置中从运算模块结构的示例框图；
图4b示出了根据本申请实施例的用于运算装置中从运算模块结构的示例框图；
图5示出了根据本申请实施例的运算方法的示例框图。
具体实施方式
本申请提供一种运算装置及配套指令集，包括存储单元、寄存器单元和卷积神经网络运算单元，存储单元中存储有输入输出数据和卷积核，寄存器单元中存储有输入输出数据和卷积核存储的地址，卷积神经网络运算单元根据运算指令在寄存器单元中获取数据地址，然后，根据该数据地址在存储单元中获取相应的输入数据和卷积核，接着，根据获取的输入数据和卷积核进行卷积神经网络运算，得到卷积神经网络运算结果。本申请将参与计算的输入数据和卷积核暂存在外部存储空间(例如，高速暂存存储器)上，使得卷积神经网络运算过程中可以更加灵活有效地支持不同宽度的数据，提升包含大量卷积神经网络计算任务的执行性能。
参阅图1，图1提供了一种运算装置，该运算装置包括：存储器111(可选的)、寄存器单元112、互联模块113、运算单元114、控制器单元115和数据访问单元116；
其中，运算单元114包括：加法计算器、乘法计算器、比较器、激活运算器中至少二种。
互联模块113，用于连接运算单元113中的计算器以使得所述运算单元构成第一计算拓扑结构，以及接收数据块，将数据块发送至运算单元。
寄存器单元112，寄存器单元还可以有其它的替代单元，例如指令缓存，高速暂存存储器等，用于存储该运算指令、数据块的在存储介质的地址、运算指令对应的计算拓扑结构。
该运算指令可以包括：操作域以及操作码，以卷积计算指令为例，如表1所示，其中，寄存器0、寄存器1、寄存器堆2、寄存器3、寄存器4可以为操作域。其中，每个寄存器0、寄存器1、寄存器2、寄存器3、寄存器4可以是一个或者多个寄存器。
表1
Figure BDA0001956230880000061
存储器111可以为片外存储器，当然在实际应用中，当为片内存储器时，该片内存储器可以为缓存，具体的，可以为高速暂存缓存，用于存储数据块，该数据块具体可以为n维数据，n为大于等于1的整数，例如，n＝1时，为1维数据，即向量，如n＝2时，为2维数据，即矩阵，如n＝3或3以上时，为多维数据。
控制器单元115，用于从寄存器单元112内提取运算指令、该运算指令对应的操作域以及该运算指令对应的第一计算拓扑结构，将该运算指令译码成执行指令，该执行指令用于控制运算单元执行运算操作，将该操作域传输至数据访问单元116。
数据访问单元116，用于从存储器111中提取该操作域对应的数据块，并将该数据块传输至互联模块113。
互联模块113、用于接收数据块，将该数据块发送至运算单元114。
运算单元114，用于该执行指令调用运算单元114的计算器对该数据块执行运算操作得到运算结果，将该运算结果传输至数据访问单元存储在存储器内。一个实施例里，运算单元114，用于按第一计算拓扑结构以及该执行指令调用计算器对数据块执行运算操作得到运算结果，将该运算结果传输至数据访问单元存储在存储器内。
运算单元114还可以包括主运算模块和多个从运算模块，所述多个从运算模块用于将接收输入数据和运算指令对应的操作域对应的数据块执行卷积运算得到的中间向量，将所述中间向量通过所述互联模块转发至所述主运算模块；所述主运算模块用于将所有中间向量拼接成中间结果，并对所述中间结果执行非线性函数运算得到指令结果。
所述主运算模块包括：
查表部，用于存储有多个线性函数的斜率值和截距值，其中，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
线性拟合部，用于根据查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y；
所述子主运算模块，用于将中间结果的所有元素值对应的函数值y组合起来得到指令结果。
可选的，所述主运算模块，用于将中间结果与偏置数据相加，然后执行非线性函数运算。
可选的，所述非线性函数包括：sigmoid，tanh，relu或softmax。
可选的，所述互连模块为以下任一种结构：树状结构、环状结构、网格状结构、分级互连、总线结构。
可选的，存储器111(可选的)、寄存器单元112、互联模块113、运算单元114、控制器单元115和数据访问单元116以通过硬件电路(例如包括但不限于FPGA、CGRA、专用集成电路ASIC、模拟电路和电阻器等)实现。
在一种可选的实施例中，上述第一计算拓扑结构可以为：乘法运算器-加法运算器-加法运算器-激活运算器。
下面通过不同的运算指令来说明如图1所示的运算装置的具体计算方法，这里的运算指令以卷积计算指令为例，该卷积计算指令可以应用在神经网络中，所以该卷积计算指令也可以称为卷积神经网络。对于卷积计算指令来说，其实际需要执行的公式可以为:s＝s(∑wxi+b),其中，即将卷积核w乘以输入数据xi，进行求和，然后加上偏置b后做激活运算s(h)，得到最终的输出结果s。依据该公式即可以得到该计算拓扑结构为，乘法运算器-加法运算器-(可选的)激活运算器。
上述卷积计算指令可以包括指令集，该指令集包括：卷积神经网络指令，有不同功能的卷积神经网络COMPUTE指令以及CONFIG指令、IO指令、NOP指令、JUMP指令和MOVE指令。在一种实施例中，COMPUTE指令包括：
卷积神经网络指令，根据该指令，装置分别从存储器(优选的高速暂存存储器或者标量寄存器堆)的指定地址取出指定大小的输入数据和卷积核，在卷积运算部件中做卷积运算直接得到输出结果。即该指令不执行后续的操作，直接做卷积运算得到输出结果。
卷积神经网络sigmoid指令，根据该指令，装置分别从存储器(优选的高速暂存存储器或者标量寄存器堆)的指定地址取出指定大小的输入数据和卷积核，在卷积运算部件中做卷积操作，优选的，然后将输出结果做sigmoid激活；
卷积神经网络TanH指令，根据该指令，装置分别从存储器(优选的高速暂存存储器)的指定地址取出指定大小的输入数据和卷积核，在卷积运算部件中做卷积操作，优选的，然后将输出结果做TanH激活；
卷积神经网络ReLU指令，根据该指令，装置分别从存储器(优选的高速暂存存储器)的指定地址取出指定大小的输入数据和卷积核，在卷积运算部件中做卷积操作，优选的，然后将输出结果做ReLU激活；以及
卷积神经网络group指令，根据该指令，装置分别从存储器(优选的高速暂存存储器)的指定地址取出指定大小的输入数据和卷积核，划分group之后，在卷积运算部件中做卷积操作，优选的，然后将输出结果做激活。
CONFIG指令在每层人工神经网络计算开始前配置当前层计算需要的各种常数。
IO指令实现从外部存储空间读入计算需要的输入数据以及在计算完成后将数据存回至外部空间。
NOP指令负责清空当前装置内部所有控制信号缓存队列中的控制信号，保证NOP指令之前的所有指令全部指令完毕。NOP指令本身不包含任何操作；
JUMP指令负责控制将要从寄存器单元读取的下一条指令地址的跳转，用来实现控制流的跳转；
MOVE指令负责将装置内部地址空间某一地址的数据搬运至装置内部地址空间的另一地址，该过程独立于运算单元，在执行过程中不占用运算单元的资源。
如图1所示的运算装置执行卷积计算指令的方法具体可以为：
控制器单元115从寄存器单元112内提取卷积计算指令、卷积计算指令对应的操作域，控制器单元将该操作域传输至数据访问单元。
数据访问单元从存储器内提取该操作域对应的卷积核w和偏置b(当b为0时，不需要提取偏置b)，将卷积核w和偏置b传输至运算单元。
计算单元的乘法运算器将卷积核w与输入数据Xi执行乘法运算以后得到第一结果，将第一结果输入到加法运算器执行加法运算得到第二结果，将第二结果和偏置b执行加法运算得到第三结果，将第三结果输到激活运算器执行激活运算得到输出结果s，将输出结果s传输至数据访问单元存储至存储器内。其中，每个步骤后都可以直接输出结果传输到数据访问存储至存储器内。另外，将第二结果和偏置b执行加法运算得到第三结果这一步骤为可选步骤，即当b为0时，不需要这个步骤。
本申请提供的技术方案通过一个指令即卷积计算指令即实现了卷积的计算，在卷积计算的中间数据(例如第一结果、第二结果、第三结果)均无需存储或提取，减少了中间数据的存储以及提取操作，所以其具有减少对应的操作步骤，提高卷积的计算效果的优点。
如图2a所示，上述主运算模块的结构具体可以包括：
查表部，用于存储有多个线性函数的斜率值和截距值，其中，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
线性拟合部，用于根据查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y；
所述主运算单元，用于将中间结果的所有元素值对应的函数值y组合起来得到指令结果。
控制器单元用于控制查表部和线性拟合部的操作，数据传输等行为。查表部为存储器，用于存储多个线性函数的斜率值和截距值，并根据浮点数获取相应的斜率值k和截距值b；线性拟合部根据查表得到的斜率值k和截距值b，得到相应的线性函数y＝kx+b，并将浮点数代入线性函数，得到线性函数的函数值，以作为浮点数在非线性函数中的函数值。本申请将非线性函数拟合为多个线性函数，只需针对不同的自变量选择相应的线性函数，故在运算时只需要进行简单的加法和乘法运算，因此简化硬件设计，并提高运算速度，同时降低芯片功耗和面积。
本申请提供一种运算装置，用于根据一输入的浮点数计算非线性函数的函数值，装置包括：
控制器单元，用于对查表部，线性拟合部进行控制。控制单元可以是本装置专有的模块；当本装置作为其他装置的一部分(即作为子模块)的时候，控制单元也可以是其他装置的控制单元的一部分，即通过父模块的控制单元对查表部，线性拟合部进行控制。
查表部，其中包含斜率截距存储部，以及选择部。斜率截距存储部中，存储有多个线性函数的斜率值和截距值，其中，多个线性函数由非线性函数分段线性拟合而得到。选择部根据浮点数获取相应的斜率值k和截距值b的存储位置，以此获得相应的斜率和截距；由于通过一组斜率值和截距值可以确定一个线性函数，因此，斜率值和截距值在存储时要有对应关系；
线性拟合部，用于根据从查表部输出的斜率，截距位置，从斜率截距存储部中取得的斜率值k和截距值b，用于计算线性函数y＝k×x+b，其中x为装置的输入浮点数，即自变量，y为装置的输出。线性拟合部中包含乘法器和加法器，用于计算上述线性函数。本申请的原理是，将复杂的非线性函数拟合为多段线性函数，应该可知，分段的区间越小，线性函数与非线性函数的函数值越接近，亦即精度越高。确定输入的浮点数落入分段中的哪一段，由此确定出此段对应的线性函数，并将浮点数代入线性函数中，得到相应的函数值。
根据本申请的一种实施方式，查表部包括斜率截距存储部和选择部，其中，斜率截距存储部用于存储多个线性函数所对应的斜率值和截距值，选择部用于根据浮点数，计算出应该选择的斜率k和截距b在斜率截距存储部中所在的位置。选择部中包含配置部，用于配置选择过程中所需要的参数，包括斜率，截距，以及其他参数。配置部中还包括一个参数存储部，用于存放除斜率，截距之外的其他参数。
配置部所配置的其他参数包括：
N：区间数，用于将非线性函数的自变量分段为N个区间，在每个区间内，将非线性函数拟合为一个线性函数，分别得到N个线性函数，并获取N个线性函数的斜率值和截距值，其中，将N个线性函数的斜率值和截距值存储于斜率截距存储部，每组斜率值和截距值一一对应于N个区间中一个区间的序号index，并将序号index存储于选择部，其中，序号index的取值范围为[0,N-1]。因此，选择部根据浮点数落入哪个区间，获取相应的区间的序号index，并根据序号index在斜率截距存储部得到相应的斜率值k和截距值b。
r：自变量的取值范围。，当参数配置为r时，非线性函数自变量取值范围为(-r，r)，并将边界值r的指数部分作为一偏移值bias输入至选择部，所述选择部根据浮点数及偏移值bias，确定序号index，并根据所述序号index得到对应的斜率值和截距值。需要说明的是，线性函数不可能覆盖所有非线性函数的取值，故可设定非线性函数自变量取值范围为(-r，r)，以是的在(-r，r)中进行线性拟合。在设定好后，输入的浮点数落入(-r，r)中，这样只需根据浮点数所在区间就可得到相应的序号index，
bias：偏移值。用于处理当输入不落入自变量取值范围的情况。，具体包括：
在选择部进行选择之前，配置部将从外部传入数据存储到配置部中的参数存储部，以及斜率截距存储部。此数据的来源可以是寄存器，片上存储器，片外存储器等，此数据传输由控制单元进行控制。
选择部的具体执行过程如下，其中，所有数据，如bias，exp存放选择部内部的存储单元中(如：寄存器)，计算操作通过选择部中的运算单元进行。
当bias-exp<0时，在所述浮点数为正数情况下，index取N-1，在所述浮点数为负数情况下序号index取0，其中，exp为所述浮点数的指数部分；
当0≤bias-exp<W-1时，
index＝2W-1+2W-1-m-1+frac[F-1:F-(W-1-m-1)+1]
其中，frac为浮点数的尾数部分，W为序号index的位宽，并且，W＝log2N，m＝bias–exp，F为所述浮点数的尾数的位宽，然后将index的每一位和所述浮点数的符号位进行异或运算；
当bias-exp≥W-1，index最高位为浮点数的符号位取反，低W-1位均为浮点数的符号位。
根据本申请的一种实施方式，线性拟合部包括乘法器和加法器，其中，乘法器用于将查表部输出的的斜率值k与浮点数相乘，得到相乘结果，加法器用于将乘法器得到相乘结果与查表部输出的截距值b相加，得到最后的函数值y。
本申请提供还一种非线性函数运算方法，用于根据一输入的浮点数计算非线性函数的函数值，方法包括：
S0，控制器控制配置部对装置进行配置，包括前述的各种参数，不同线性函数的斜率和截距。
S1，控制器控制选择部根据输入的浮点数，计算出对应的序号index，用于选择出相应的斜率值k和截距值b，其中，这些斜率和截距为预先准备好的，根据需要拟合的非线性函数进行分段插值计算出来的，并预先存储在与本装置相连接的外部存储器上；
S2，根据S1得到的斜率值k和截距值b，控制器控制线性拟合部，进行线性函数y＝k×x+b的计算。
上述步骤具体而言：
S0中配置部的配置方法，具体还包括：
配置部通过配置参数N，将所述非线性函数的自变量分段为N个区间，在每个区间内，选择部根据所述配置的参数bias，N，计算出输入浮点数对应的区间序号，根据此序号，找到斜率截距存储部中相应的斜率和截距，线性拟合部将斜率和输入浮点数相乘，其结果和截距相加，即得到最后的输出结果(非线性函数的拟合结果)。本装置将非线性函数拟合为一个线性函数，分别得到N个线性函数，并获取所述N个线性函数的斜率值和截距值，其中，每组斜率值和截距值一一对应于N个区间中一个区间的序号index，序号index的取值范围为[0,N-1]。
步骤S0还包括，配置部配置参数r，设定非线性函数自变量取值范围为(-r，r)，并将边界值r的指数部分作为一偏移值bias；此步骤还包括，根据浮点数及所述偏移值bias，确定序号index，并根据序号index得到对应的斜率值和截距值。
上述步骤S1中，选择部根据浮点数及所述配置部中的参数偏移值bias，确定序号index，包括：
当bias-exp<0时，在输入浮点数为正数情况下，index取N-1，在所述浮点数为负数情况下序号index取0，其中，exp为所述浮点数的指数部分；
当0≤bias-exp<W-1时，
index＝2W-1+2W-1-m-1+frac[F-1:F-(W-1-m-1)+1]
其中，frac为所述浮点数的尾数部分，W为序号index的位宽，并且，W＝log2N，m＝bias–exp，F为浮点数的尾数的位宽，然后将index的每一位和所述浮点数的符号位进行异或运算；
当bias-exp≥W-1，index最高位为浮点数的符号位取反，低W-1位均为浮点数的符号位。
为使本申请的目的、技术方案和优点更加清楚明白，以下结合具体实施例，并参照附图，对本申请进一步详细说明。
图2a是本申请实施例提供的主运算模块的结构图，如图2a所示，装置包括查表部5和线性拟合部6，其中，查表部5用于根据由输入的自变量的值x，以及外部配置进来的偏移量bias，查找到对应的分段线性拟合的斜率和截距。
查表部5包括序号选择部1和斜率截距存储部2，序号选择部1用于根据输入的自变量值x和配置的偏移量bias计算出index，斜率截距存储部2用于根据序号选择部1计算出的index，选出斜率及截距。
线性拟合部6用于根据查表部5得到的斜率和截距通过线性拟合的方法得到最后结果。线性拟合部6包括乘法器3和加法器4，其中，乘法器3用于计算k*x，加法器4用于计算k*x+b。
图2b是本申请实施例提供的非线性函数运算装置的内部结构图，查表部5的输入值是非线性函数的自变量，以及偏移值。序号选择部1根据所述自变量x和偏移量计算出index。
斜率截距存储部2中，Table_k和Table_b里存储了非线性函数分段线性拟合的直线斜率和截距，Table_k和Table_b里的值是可以配置的，在开始计算之前，它们的值应该已完成配置。根据以上所述算出的index，可以选出要使用的斜率Table_k[index],和截距Table_b[index]。
图2c是本申请实施例中线性拟合部的内部结构图，线性拟合部6有三个输入，x表示自变量，即外部输入需要进行非线性变换的值，k和b是查表得到的截距和斜率，输出是最终的结果f(x)，线性拟合部6实现的运算是：f(x)＝k*x+b。
图2d是本申请实施例的非线性函数运算的原理图，查表部3的输入是自变量x，查找部件3根据x的值找到对应的斜率k和截距b，并将k和b输出，在乘法器4中计算k*x，并将结果和b输出，在加法器5中计算k*x+b，计算得到最终的结果。
以下通过计算非线性函数
Figure BDA0001956230880000141
以进一步解释本申请，将非线性函数的自变量分段为N＝64个区间，取值范围r设为7.75，即取值区间为(-7.75,7.75)，通过线性拟合以上函数所得到的插值表为：
table_k＝[0,0.00048656316525353121,0.00061973162484223741,0.00078928936655365655,0.0010051440297105911,0.0012798783909594086,0.0016294587358847128,0.0020741221116775564,0.0026394821537513336,0.0033578984220486922,0.0042701575375603202,0.0054275134806431417,0.0068941251757849761,0.0087499054356052815,0.011093746329263701,0.014046996903534316,0.017756918346970331,0.022399600632704755,0.028181459980468879,0.035337917880121604,0.044127182785956003,0.054816271160400852,0.067655703617413618,0.082839110694275894,0.10044501610076587,0.12036137423557895,0.14220006304664759,0.16521866898611015,0.18827848066541336,0.20987496057486665,0.22827132183028082,0.24173985504038351,0.24887167444405783,0.24887167444405978,0.24173985504038323,0.22827132183028037,0.20987496057486754,0.18827848066541422,0.16521866898610904,0.14220006304664773,0.1203613742355779,0.10044501610076662,0.082839110694276047,0.067655703617414242,0.054816271160399312,0.044127182785955642,0.035337917880122131,0.028181459980469011,0.022399600632704762,0.017756918346970005,0.014046996903534123,0.011093746329263798,0.0087499054356035919,0.0068941251757841807,0.0054275134806434523,0.0042701575375596592,0.0033578984220488948,0.0026394821537508726,0.002074122111678265,0.0016294587358859139,0.0012798783909593549,0.001005144029710878,0.00078928936655333173,0.00061973162484123137,0.00048656316525207165,0]
table_b＝[0,0.0041993251816466815,0.0051986385576176901,0.0064299574345850303,0.0079452052890187242,0.009807238238936004,0.012091883136726765,0.01489024369806616,0.018311254971669941,0.022484429652995856,0.027562682295467392,0.033725030746198308,0.041178847029904868,0.050161149061534412,0.060938175678893231,0.073802158887859029,0.089063797665378613,0.10703847125951904,0.12802378192384653,0.15226575415464311,0.17991125218316206,0.21094542275377304,0.24511595347355658,0.28185147996324666,0.32019008490568668,0.35874483153772002,0.39574347031640295,0.42918193126900617,0.45711585573612518,0.47807264767380625,0.4915012059787659,0.49811232472098371,0.49994440545964863,0.50005559454035076,0.50188767527901634,0.50849879402123443,0.52192735232619281,0.54288414426387344,0.57081806873099528,0.60425652968359678,0.6412551684622817,0.67980991509431143,0.71814852003675334,0.75488404652644192,0.78905457724623107,0.82008874781683905,0.84773424584535517,0.87197621807615311,0.8929615287404804,0.9109362023346228,0.92619784111214154,0.93906182432110619,0.94983885093847398,0.95882115297009929,0.96627496925379974,0.97243731770453612,0.97751557034700309,0.98168874502833281,0.98510975630192921,0.98790811686326541,0.99019276176106386,0.9920547947109799,0.99357004256541748,0.99480136144239018,0.99580067481836443,1]
令输入自变量x为16位浮点小数0.25，其指数exp为13，尾数frac为b’0000000000，bias为17，m为bias–exp＝4，落入0≤bias-exp<W-1区间，可得index为26-1+26-1-4-1+frac[16-1:16-(6-1-4-1)+1]，即25+20+0＝33。
根据index从上述插值表中选出斜率k为k[33]＝0.248871674444，截距b为b[33]＝0.50005559454，k×x+b的值为0.562273513151，而根据函数采用线性拟合方式算出的结果为0.562176500886，误差为-9.7012265e-05。
综上所述，本申请通过采用线性拟合方式，避免了复杂运算，如对数计算，通过采用乘法，加法这类速度更快的运算操作，提高计算速度，同时，避免了复杂的硬件设计，例如log2x的运算部件，降低了芯片面积和功耗。
图3示出了根据本申请实施例的用于执行卷积神经网络正向运算的装置中主运算模块5的结构的示例框图。如图5所示，主运算模块5包括第一子运算模块51、第一数据依赖关系判定单元52和第一存储单元53。
其中，第一子运算模块51接收来自控制器单元的控制信号，完成主运算模块5的各种运算功能。第一数据依赖关系判定单元52是第一子运算模块51读写第一存储单元53的端口，保证第一存储单元53中数据的读写一致性。同时，第一数据依赖关系判定单元52也负责将从第一存储单元53读取的数据通过互连模块4发送给从运算模块，而从运算模块6的输出数据通过互连模块4直接发送给第一子运算模块51。控制器单元2输出的指令发送给计算单元51和第一数据依赖关系判定单元52，来控制其行为，第一子运算单元还用于根据查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y。
第一存储单元53用于缓存主运算模块5在计算过程中用到的输入数据和输出数据，第一存储单元53还用于存储有多个线性函数的斜率值和截距值，其中，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b。
第一数据依赖关系判定单元52是第一子运算模块51读写第一存储单元53的端口，保证第一存储单元53中数据的读写一致性。同时，第一数据依赖关系判定单元52也负责将从第一存储单元53读取的数据通过互连模块4发送给从运算模块，而从运算模块6的输出数据通过互连模块4直接发送给第一子运算模块51。控制器单元2输出的指令发送给计算单元51和第一数据依赖关系判定单元52，来控制其行为。
图4a以及图4b示出了根据本申请实施例的用于执行卷积神经网络正向运算的装置中从运算模块6的结构的示例框图。如图4a以及图4b所示，每个从运算模块6包括每个从运算模块6包括第二子运算模块61、数据依赖关系判定单元62、第二存储单元63和第三存储单元64。
第二子运算模块61接收控制器单元2发出的控制信号并进行神经网络运算。
第二数据依赖关系判定单元62负责计算过程中对第二存储单元63的读写操作。第二数据依赖关系判定单元62执行读写操作之前会首先保证指令之间所用的数据不存在读写一致性冲突。例如，所有发往数据依赖关系单元62的控制信号都会被存入数据依赖关系单元62内部的指令队列里，在该队列中，读指令的读取数据的范围如果与队列位置靠前的写指令写数据的范围发生冲突，则该指令必须等到所依赖的写指令被执行后才能够执行。
第二存储单元63缓存该从运算模块6的输入数据和输出标量数据。
第三存储单元64缓存该从运算模块6在计算过程中需要的权值数据。
第一数据依赖关系判定单元和第二数据依赖关系判定单元通过以下方式保证读写不存在一致性冲突：判断尚未执行的控制信号与正在执行过程中的控制信号的数据之间是否存在依赖关系，如果不存在依赖关系，确定数据的读写不存在一致性冲突，如果存在依赖关系，确定数据的读写存在一致性冲突。
图5是本申请实施例提供的运算方法的流程图，应用于运算装置，运算装置包括寄存器单元、存储器、数据访问单元、控制器单元和运算单元，如图5所示，执行运算方法的过程包括：
在步骤S5B1，在寄存器单元的首地址处预先存入第一IO指令。
在步骤S5B2，控制器单元从所述寄存器单元的首地址读取第一IO指令，根据第一IO指令译出第一控制信号，数据访问单元根据所述第一控制信号从存储器读取相应的所有运算指令，并将其缓存在寄存器单元中。
在步骤S5B3，控制器单元从寄存器单元读入第二IO指令，根据第二IO指令译出第二控制信号，数据访问单元根据第二IO指令译出的控制信号从存储器读取运算单元需要的所有数据块(例如，包括输入数据、用于作快速的激活函数运算的插值表、用于配置运算器件参数的常数表、偏置数据等)。
在步骤S5B4，控制器单元从寄存器单元读入第一CONFIG指令，根据第一CONFIG指令译出第三控制信号，运算装置根据第三控制信号配置该层神经网络计算需要的各种常数。例如，运算单元根据控制信号里的参数配置单元内部寄存器的值，所述参数包括例如激活函数需要的数据。
在步骤S5B5，控制器单元从寄存器单元读入第二COMPUTE指令，根据第二COMPUTE指令译出第四控制信号，互连模块根据第四控制信号将卷积窗口内的输入数据发给计算单元内的各计算器。
在步骤S5B6，乘法运算器将卷积核w与输入数据Xi执行乘法运算以后得到第一结果，将第一结果输入到加法运算器执行加法运算得到第二结果，将第二结果和偏置b执行加法运算得到第三结果，将第三结果输入到激活运算器执行激活运算得到输出结果s，将输出结果s传输至所述数据访问单元存储到存储介质内；
或者，在步骤S5B7，运算单元中的多个从运算模块将卷积核w与输入数据Xi执行卷积运算得到中间向量，并将中间向量发送到运算单元中的主运算模块；
在步骤S5B8，主运算模块将所有的中间向量拼接成中间结果；
在步骤S5B9，主运算模块中的线性拟合部根据主运算模块中的查表部得到的斜率值k和截距值b，得到元素值对应的线性函数y＝kx+b，并将中间结果的元素值代入元素值对应的线性函数计算得到函数值y，其中，查表部存储有多个线性函数的斜率值和截距值，多个线性函数由非线性函数分段线性拟合而得到，查表部根据中间结果的元素值获取相应的斜率值k和截距值b；
在步骤S5B10，主运算模块中的子主运算模块将中间结果的所有元素值对应的函数值y组合起来得到输出结果s，将输出结果s传输至数据访问单元存储到存储介质内。
可选的，所述运算装置还包括互联模块，所述方法还包括：
所述主运算模块将中间结果与偏置数据相加，然后执行非线性函数运算；
所述互联模块根据第四控制信号，将所述运算单元中的乘法计算器、加法计算器和激活计算器进行连接，使得所述运算单元构成第一计算拓扑结构。
可选的，所述方法还包括：
所述主运算模块中的第一存储单元缓存所述主运算模块在计算过程中用到的输入数据和输出数据；
所述主运算模块中的第一子运算模块完成所述主运算模块的各种运算功能；
所述主运算模块中的第一数据依赖关系判定单元保证对所述第一存储单元的数据的读写不存在一致性冲突，并负责从所述第一存储单元读取输入的数据，并通过所述互联模块将输入的数据发送给所述多个从运算模块；以及接收所述互连模块的发送的中间向量并发送到所述第一子运算模块。
可选的，所述方法还包括：
所述从运算模块中的第二子运算模块执行从所述运算模块的卷积运算中的各种算术逻辑运算；
所述从运算模块中的第二数据依赖关系判定单元负责计算过程中对所述第二存储单元和所述第三存储单元的读写操作，并保证对所述第二存储单元和所述第三存储单元的读写不存在一致性冲突；
所述从运算模块中的第二存储单元缓存数据块和所述从运算模块计算得到的输出标量；
所述从运算模块中的第三存储单元缓存所述从运算模块在计算过程中需要的卷积核数据。
可选的，所述第一数据依赖关系判定单元和所述第二数据依赖关系判定单元通过以下方式保证读写不存在一致性冲突：判断尚未执行的控制信号的数据与正在执行过程中的控制信号的数据之间是否存在依赖关系，如果不存在依赖关系，则确定出数据的读写不存在一致性冲突，如果存在依赖关系，则确定出数据的读写存在一致性冲突。
可选的，在所述将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y方面，所述方法包括：
所述线性拟合部中的乘法器将斜率值k与中间元素结果值相乘，得到中间结果；
所述线性拟合部中的加法器将所述中间结果与所述截距值b相加，得到函数值y。
可选的，在所述多个线性函数由所述非线性函数分段线性拟合而得到方面，所述方法包括：
所述查表部中的配置部将所述非线性函数的自变量分段为N个区间，在每个区间内，将非线性函数拟合为一个线性函数，分别得到N个线性函数，并获取所述N个线性函数的斜率值和截距值，其中，将N个线性函数的斜率值和截距值存储于所述斜率截距存储部，每组斜率值和截距值一一对应于N个区间中一个区间的序号index，并将所述序号index存储于选择部，其中，序号index的取值范围为[0,N-1]。
可选的，所述方法还包括：
所述查表部中的配置部设定所述非线性函数自变量取值范围为(-r，r)，并将边界值r的指数部分作为一偏移值bias输入至所述选择部，所述选择部根据所述浮点数及所述偏移值bias，确定序号index，并根据所述序号index得到对应的斜率值和截距值。
可选的，所述方法还包括：
所述查表部中的配置部在bias-exp<0时，在所述浮点数为正数情况下，index取N-1，在所述浮点数为负数情况下序号index取0，其中，exp为所述浮点数的指数部分；
当0≤bias-exp<W-1时，
index＝2W-1+2W-1-m-1+frac[F-1:F-(W-1-m-1)+1]
其中，frac为所述中间结果元素值的尾数部分，W为序号index的位宽，并且，W＝log2N，m＝bias–exp，F为所述中间结果元素值的尾数的位宽，然后将index的每一位和所述中间结果元素值的符号位进行异或运算；
当bias-exp≥W-1，index最高位为所述中间结果元素值的符号位取反，低W-1位均为所述浮点数的符号位。
本申请实施例提供了一种芯片，该芯片集成上述运算装置。
本申请实施例提供了一种电子设备，所述电子设备包括上述芯片。
本申请实施例提供了一种计算机可读存储介质，其存储用于电子数据交换的计算机程序，其中，所述计算机程序使得计算机执行上述运算方法中的全部或部分步骤。
对于多层神经网络卷积层，其实现过程与单层神经网络卷积层类似，当上一层卷积神经网络执行完毕后，下一层的运算指令会将主运算单元中存储的上一层的输出数据地址作为本层的输入数据地址。同样地，指令中的卷积核和偏置数据地址也会变更至本层对应的地址。
通过采用用于执行卷积神经网络正向运算的装置和指令集，解决了CPU和GPU运算性能不足，前端译码开销大的问题。有效提高了对多层卷积神经网络正向运算的支持。
通过采用针对多层卷积神经网络正向运算的专用片上缓存，充分挖掘了输入神经元和卷积核数据的重用性，避免了反复向内存读取这些数据，降低了内存访问带宽，避免了内存带宽成为多层卷积神经网络正向运算性能瓶颈的问题。
前面的附图中所描绘的进程或方法可通过包括硬件(例如，电路、专用逻辑等)、固件、软件(例如，被具体化在非瞬态计算机可读介质上的软件)，或两者的组合的处理逻辑来执行。虽然上文按照某些顺序操作描述了进程或方法，但是，应该理解，所描述的某些操作能以不同顺序来执行。此外，可并行地而非顺序地执行一些操作。
在前述的说明书中，参考其特定示例性实施例描述了本申请的各实施例。显然，可对各实施例做出各种修改，而不背离所附权利要求所述的本申请的更广泛的精神和范围。相应地，说明书和附图应当被认为是说明性的，而不是限制性的。

Claims (16)

1.一种运算装置，其特征在于，所述运算装置包括存储器、控制器单元、互联模块和运算单元，其中，
所述存储器，用于存储数据块，所述数据块包括n维数据，n为大于等于1的整数；
所述互联模块，用于连接运算单元中的计算器以使得所述运算单元构成第一计算拓扑结构，以及接收数据块，将数据块发送至运算单元；
所述控制器单元，用于从寄存器单元内提取运算指令，将运算指令译码成执行指令，执行指令用于控制运算单元执行运算操作，将运算指令对应的操作域传输至数据访问单元；
所述运算单元，用于根据所行指令调用所述运算单元中的计算器对运算指令对应的操作域对应的数据块执行运算操作得到运算结果，将运算结果传输至所述数据访问单元以及存储在所述存储器内；
所述运算单元包括主运算模块和多个从运算模块，所述多个从运算模块用于将接收输入数据和运算指令对应的操作域对应的数据块执行卷积运算得到的中间向量，将所述中间向量通过所述互联模块转发至所述主运算模块；所述主运算模块用于将所有中间向量拼接成中间结果，并对所述中间结果执行非线性函数运算得到指令结果；
所述主运算模块包括：
查表部，用于存储有多个线性函数的斜率值和截距值，其中，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
线性拟合部，用于根据查表部得到的斜率值k和截距值b，得到所述元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y；
子主运算模块，用于将中间结果的所有元素值对应的函数值y组合起来得到指令结果；
所述查表部包括：
斜率截距存储部，用于存储多个线性函数所对应的斜率值和截距值；
选择部，用于根据浮点数在所述斜率截距存储部中选择并获取相应的斜率值k和截距值b；
所述查表部还包括：
配置部，用于将所述非线性函数的自变量分段为N个区间，在每个区间内，将非线性函数拟合为一个线性函数，分别得到N个线性函数，并获取所述N个线性函数的斜率值和截距值，其中，将N个线性函数的斜率值和截距值存储于所述斜率截距存储部，每组斜率值和截距值一一对应于N个区间中一个区间的序号index，并将所述序号index存储于选择部，其中，序号index的取值范围为[0，N-1]；
所述配置部，还用于设定所述非线性函数自变量取值范围为(-r，r)，并将边界值r的指数部分作为一偏移值bias输入至所述选择部，所述选择部根据所述浮点数及所述偏移值bias，确定序号index，并根据所述序号index得到对应的斜率值和截距值；
所述配置部，还用于当bias-exp＜0时，在所述浮点数为正数情况下，index取N-1，在所述浮点数为负数情况下序号index取0，其中，exp为所述浮点数的指数部分；
当0≤bias-exp＜W-1时，
index＝2W-1+2W-1-m-1+frac[F-1：F-(W-1-m-1)+1]其中，frac为所述中间结果元素值的尾数部分，W为序号index的位宽，并且，W＝log2N，m＝bias-exp，F为所述中间结果元素值的尾数的位宽，然后将index的每一位和所述中间结果元素值的符号位进行异或运算；
当bias-exp≥W-1，index最高位为所述中间结果元素值的符号位取反，低W-1位均为所述浮点数的符号位。
2.根据权利要求1所述的运算装置，其特征在于，所述装置还包括：
寄存器单元，用于存储运算指令、数据块在存储介质的地址、运算指令对应的计算拓扑结构；
数据访问单元，用于从所述存储器中提取运算指令对应的操作域对应的数据块，并将运算指令对应的操作域对应的数据块输至所述互联模块。
3.根据权利要求1所述的运算装置，其特征在于，所述主运算模块，用于将中间结果与偏置数据相加，然后执行非线性函数运算。
4.根据权利要求1所述的运算装置，其特征在于，所述主运算模块还包括：第一存储单元、第一子运算模块和第一数据依赖关系判定单元；
所述第一存储单元，用于缓存所述主运算模块在计算过程中用到的输入数据和输出数据；
所述第一子运算模块，用于完成所述主运算模块的各种运算功能；
所述第一数据依赖关系判定单元，用于保证对所述第一存储单元的数据的读写不存在一致性冲突，并负责从所述第一存储单元读取输入的数据，并通过所述互联模块将输入的数据发送给所述多个从运算模块；以及接收所述互联模块的发送的中间向量并发送到所述第一子运算模块。
5.根据权利要求1所述的运算装置，其特征在于，所述从运算模块包括：第二子运算模块、第二数据依赖关系判定单元、第二存储单元和第三存储单元；
所述第二子运算模块，用于完成从所述运算模块的卷积运算中的各种算术逻辑运算；
所述第二数据依赖关系判定单元，用于负责计算过程中对所述第二存储单元和所述第三存储单元的读写操作，并保证对所述第二存储单元和所述第三存储单元的读写不存在一致性冲突；
所述第二存储单元，用于缓存数据块和所述从运算模块计算得到的输出标量；
所述第三存储单元，用于缓存所述从运算模块在计算过程中需要的卷积核数据。
6.根据权利要求4或5所述的运算装置，其特征在于，第一数据依赖关系判定单元和第二数据依赖关系判定单元通过以下方式保证读写不存在一致性冲突：判断尚未执行的控制信号的数据与正在执行过程中的控制信号的数据之间是否存在依赖关系，如果不存在依赖关系，则确定出数据的读写不存在一致性冲突，如果存在依赖关系，则确定出数据的读写存在一致性冲突。
7.根据权利要求1所述的运算装置，其特征在于，所述线性拟合部包括：
乘法器，用于将查表得到的斜率值k与所述中间结果元素值相乘，得到相乘结果；
加法器，用于将乘法器得到相乘结果与查表得到的截距值b相加，得到所述线性函数的函数值y。
8.一种运算方法，其特征在于，所述方法由运算装置执行，所述运算装置包括寄存器单元、存储器、数据访问单元、控制器单元和运算单元，其中，
所述控制器单元从所述寄存器单元的首地址读取第一IO指令，根据所述第一IO指令译出第一控制信号，所述数据访问单元根据所述第一控制信号从存储器读取相应的所有运算指令，并将其缓存在所述寄存器单元中；
所述控制器单元从所述寄存器单元读入第二IO指令，根据所述第二IO指令译出第二控制信号，所述数据访问单元根据所述第二IO指令译出的控制信号从所述存储器读取运算单元需要的所有数据块；
所述控制器单元从寄存器单元读入第一CONFIG指令，根据所述第一CONFIG指令译出第三控制信号，所述运算装置根据所述第三控制信号配置层神经网络计算需要的各种常数；
所述控制器单元从寄存器单元读入第二COMPUTE指令，根据第二COMPUTE指令译出第四控制信号，所述互联模块根据所述第四控制信号将卷积窗口内的输入数据发给计所述算单元内的各计算器；
乘法运算器将卷积核w与输入数据Xi执行乘法运算以后得到第一结果，将所述第一结果输入到加法运算器执行加法运算得到第二结果，将所述第二结果和偏置b执行加法运算得到第三结果，将所述第三结果输入到激活运算器执行激活运算得到输出结果s，将所述输出结果s传输至所述数据访问单元存储到存储介质内，所述激活运算包括非线性函数运算；
或者，所述运算单元中的多个从运算模块将卷积核w与输入数据Xi执行卷积运算得到中间向量，并将所述中间向量发送到所述运算单元中的主运算模块；
所述主运算模块将所有的中间向量拼接成中间结果；
所述主运算模块中的线性拟合部根据主运算模块中的查表部得到的斜率值k和截距值b，得到元素值对应的线性函数y＝kx+b，并将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y，其中，所述查表部存储有多个线性函数的斜率值和截距值，所述多个线性函数由所述非线性函数分段线性拟合而得到，所述查表部根据所述中间结果的元素值获取相应的斜率值k和截距值b；
所述主运算模块中的子主运算模块将中间结果的所有元素值对应的函数值y组合起来得到输出结果S，将所述输出结果S传输至所述数据访问单元存储到存储介质内；
所述查表部包括：斜率截距存储部和选择部；
所述斜率截距存储部存储多个线性函数所对应的斜率值和截距值；
所述选择部根据浮点数在所述斜率截距存储部中选择并获取相应的斜率值k和截距值b；
所述多个线性函数由所述非线性函数分段线性拟合而得到，包括：
所述查表部中的配置部将所述非线性函数的自变量分段为N个区间，在每个区间内，将非线性函数拟合为一个线性函数，分别得到N个线性函数，并获取所述N个线性函数的斜率值和截距值，其中，将N个线性函数的斜率值和截距值存储于所述斜率截距存储部，每组斜率值和截距值一一对应于N个区间中一个区间的序号index，并将所述序号index存储于选择部，其中，序号index的取值范围为[0，N-1]；
所述方法还包括：
所述查表部中的配置部设定所述非线性函数自变量取值范围为(-r，r)，并将边界值r的指数部分作为一偏移值bias输入至所述选择部，所述选择部根据所述浮点数及所述偏移值bias，确定序号index，并根据所述序号index得到对应的斜率值和截距值；
所述方法还包括：
所述查表部中的配置部在bias-exp＜0时，在所述浮点数为正数情况下，index取N-1，在所述浮点数为负数情况下序号index取0，其中，exp为所述浮点数的指数部分；
当0≤bias-exp＜W-1时，
index＝2W-1+2W-1-m-1+frac[F-1：F-(W-1-m-1)+1]其中，frac为所述中间结果元素值的尾数部分，W为序号index的位宽，并且，W＝log2N，m＝bias-exp，F为所述中间结果元素值的尾数的位宽，然后将index的每一位和所述中间结果元素值的符号位进行异或运算；
当bias-exp≥W-1，index最高位为所述中间结果元素值的符号位取反，低W-1位均为所述浮点数的符号位。
9.根据权利要求8所述的方法，其特征在于，所述运算装置还包括互联模块，所述方法还包括：
所述主运算模块将中间结果与偏置数据相加，然后执行非线性函数运算；
所述互联模块根据第四控制信号，将所述运算单元中的乘法计算器、加法计算器和激活计算器进行连接，使得所述运算单元构成第一计算拓扑结构。
10.根据权利要求8所述的方法，其特征在于，所述方法还包括：
所述主运算模块中的第一存储单元缓存所述主运算模块在计算过程中用到的输入数据和输出数据；
所述主运算模块中的第一子运算模块完成所述主运算模块的各种运算功能；
所述主运算模块中的第一数据依赖关系判定单元保证对所述第一存储单元的数据的读写不存在一致性冲突，并负责从所述第一存储单元读取输入的数据，并通过所述互联模块将输入的数据发送给所述多个从运算模块；以及接收所述互联模块的发送的中间向量并发送到所述第一子运算模块。
11.根据权利要求8所述的方法，其特征在于，所述方法还包括：
所述从运算模块中的第二子运算模块执行从所述运算模块的卷积运算中的各种算术逻辑运算；
所述从运算模块中的第二数据依赖关系判定单元负责计算过程中对所述第二存储单元和所述第三存储单元的读写操作，并保证对所述第二存储单元和所述第三存储单元的读写不存在一致性冲突；
所述从运算模块中的第二存储单元缓存数据块和所述从运算模块计算得到的输出标量；
所述从运算模块中的第三存储单元缓存所述从运算模块在计算过程中需要的卷积核数据。
12.根据权利要求10或11所述的方法，其特征在于，所述第一数据依赖关系判定单元和所述第二数据依赖关系判定单元通过以下方式保证读写不存在一致性冲突：判断尚未执行的控制信号的数据与正在执行过程中的控制信号的数据之间是否存在依赖关系，如果不存在依赖关系，则确定出数据的读写不存在一致性冲突，如果存在依赖关系，则确定出数据的读写存在一致性冲突。
13.根据权利要求8所述的方法，其特征在于，所述将所述中间结果的元素值代入所述元素值对应的线性函数计算得到函数值y，包括：
所述线性拟合部中的乘法器将斜率值k与中间元素结果值相乘，得到中间结果；
所述线性拟合部中的加法器将所述中间结果与所述截距值b相加，得到函数值y。
14.一种芯片，其特征在于，所述芯片集成如权利要求1-7任意一项所述的运算装置。
15.一种电子设备，其特征在于，所述电子设备包括如权利要求14所述的芯片。
16.一种计算机可读存储介质，其特征在于，其存储用于电子数据交换的计算机程序，其中，所述计算机程序使得计算机执行如权利要求8-13任一项所述的方法。
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