CN109949735B - 显示设备的源信号驱动装置 - Google Patents

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Abstract

公开了能够以高集成密度实施通道的源信号驱动装置。源信号驱动装置配置成通过顺序地延迟提供至通道电路的使能信号的使能时间点来顺序地输出源信号。

Description

显示设备的源信号驱动装置
技术领域
本公开涉及显示设备的源信号驱动装置，并且更具体地，涉及显示设备的可以实现高集成密度通道的源信号驱动装置。
背景技术
使用液晶元件作为光源的液晶显示(LCD)设备或使用LED作为光源的发光二极管(LED)设备包括用于将各个通道的源信号提供至显示面板的源驱动器。
源驱动器可制造为半导体封装，并且通过玻璃上芯片(chip-on-glass)的方法安装在显示面板上。通常，一个显示面板配置有多个源驱动器，并且根据显示面板的尺寸和分辨率确定源驱动器的数目。
最近，半导体工艺技术的发展显著提高了半导体芯片的集成密度。因此，源驱动器可以配置成在同样的面积中包括更多数目的通道。
因此，当包括更多数目的通道的源驱动器被应用至相同的显示面板时，可以减少为显示面板配置的源驱动器的数目。
然而，源驱动器中的通道数目的增多增加了在同时输出源信号时出现高涌入电流的可能性。具体地，当在显示设备中执行与通电顺序相关的源驱动器的通道导通操作或与断电顺序相关的源驱动器的通道关闭操作时，很可能出现这种大的涌入电流。
涌入电流可降低施加至源驱动器的功率，使得接地电压Vss反弹并产生功率噪声，从而引起源驱动器的故障。此外，由涌入电流引起的应力可能导致电力线在源驱动器、外部元件和边界区域的内部或外部的迁移。
发明内容
各种实施方式涉及显示设备的源信号驱动装置，即使在具有增加的集成密度和增加的通道数目时，该源信号驱动装置也可以通过源信号的输出抑制涌入电流的发生。
此外，各种实施方式涉及显示设备的源信号驱动装置，当执行与通电顺序相关的源驱动器的通道导通操作或与断电顺序相关的源驱动器的通道关闭操作时，该源信号驱动装置可以通过源信号的输出抑制涌入电流的发生。
在实施方式中，显示设备的源信号驱动装置可包括多个通道电路、控制器和传输缓冲器，其中，多个通道电路形成在实施为芯片的一个驱动器中并被划分成多个组，并且多个通道电路中的每个配置成输出源信号，控制器配置成提供一个或多个使能信号，传输缓冲器各自配置成在一对组之间传输一个或多个使能信号、将一个或多个使能信号的使能时间点延迟预设时间以及传输一个或多个使能信号，其中，一个或多个使能信号在使能时间点由传输缓冲器逐渐延迟的同时顺序地传输至多个组，并且多个通道电路通过各个组的一个或多个使能信号在不同的使能时间点处顺序地输出源信号。
在实施方式中，显示设备的源信号驱动装置可包括多个通道电路和控制器，其中，多个通道电路形成在实施为芯片的一个驱动器中并被分成多个组，并且多个通道电路中的每个配置成输出源信号，控制器配置成为各个组提供具有不同的使能时间点的、相同数目的一个或多个使能信号，其中，多个通道电路通过各个组的一个或多个使能信号在不同的使能时间点处顺序地输出源信号。
在实施方式中，显示器的源信号驱动装置可包括多个通道电路、控制器和信号提供单元，其中，多个通道电路形成在实施为芯片的一个驱动器中并被分成多个组，并且多个通道电路中的每个配置成输出源信号，控制器配置成提供在输出源信号的使能时段期间被使能的使能数据以及在使能时段期间具有多个周期的移位时钟，信号提供单元与各个组对应，并且信号提供单元中的每个配置成向相应的组提供一个或多个使能信号，其中，使能数据和移位时钟被顺序地传输至使能信号提供单元，使能信号提供单元根据使能数据和移位时钟的传输顺序生成一个或多个使能信号，该一个或多个使能信号具有与移位时钟同步地顺序延迟的使能时间点，并且多个通道电路响应于各个组的一个或多个使能信号的不同使能时间点顺序地输出源信号。
附图说明
图1是根据本发明的实施方式的描述显示设备的布置图。
图2是示出根据本发明的实施方式的显示设备的源信号驱动装置的电路图。
图3是描述根据图2的实施方式的源信号驱动装置响应于通电顺序的操作的波形图。
图4是描述根据图2的实施方式的源信号驱动装置响应于断电顺序的操作的波形图。
图5是示出根据本发明的另一实施方式的显示设备的源信号驱动装置的电路图。
图6是示出根据本发明的又一实施方式的显示设备的源信号驱动装置的电路图。
图7是描述根据图6的实施方式的源信号驱动装置响应于通电顺序的操作的波形图。
图8是描述根据图6的实施方式的源信号驱动装置响应于断电顺序的操作的波形图。
图9至图11是描述通过调整移位时钟的频率来调整使能信号的使能时间点的方法的波形图。
具体实施方式
在下文，将参考附图详细描述本发明的实施方式。本说明书和权利要求中使用的术语不限于典型的词典定义，而是应被解释为与本发明的技术构思相一致的含义和概念。
本说明书中描述的实施方式和附图中示出的配置是本发明的优选实施方式，并且不代表本发明的全部技术构思。因此，可在提交本申请时提供能够代替实施方式和配置的各种等同和修改。
根据本发明的实施方式的具有源信号驱动装置的显示设备可被理解为液晶显示器(LCD)或包括配置为发光二极管(LED)的像素的平板显示设备。
如图1中所示，显示设备具有柔性印刷电路板(FPCB)20联接至显示面板10的配置。
显示面板10是使用玻璃作为衬底制造的、并且具有形成在预设显示区域12中的像素。显示区域12用于通过驱动像素显示图像。
源驱动器SDIC通过玻璃上芯片(chip-on-glass)方法粘结在显示面板10的显示区域12的一侧处的玻璃上。
源驱动器SDIC包括输入焊盘和输出焊盘。输出焊盘形成用于输出源信号的通道，并且电联接至通过粘结形成在玻璃上的输出线。输出线可被理解为显示面板10的显示区域12的像素联接到的电气布线。输入焊盘形成用于输入电力PWR和包含从外部提供的显示数据的输入信号SIC的通道，并且电联接至通过粘结形成在玻璃上的电力线和输入线。
FPCB 20连接至显示面板10的一侧。显示面板10和FPCB 20可通过导电粘合剂或导电粘合膜连接。通过上述连接，FPCB 20的电力线和信号线可电联接至显示面板10的输入线。电力线可被理解为用于传输与电力PWR对应的各种电压的线。通过电力线，将在下文描述的模拟电源电压AVDD、数字电源电压DVDD和接地电压VSS可被提供至显示面板10。信号线可被理解为用于传输诸如显示数据的输入信号SIG的线。
图1示出了为显示面板10配置两个源驱动器SDIC。
在本发明中，具有高集成密度且因此包括比现有技术中更多数目的通道的源驱动器被用作源驱动器SDIC。因此，显示面板10可配置成包括比现有技术中更少数目的源驱动器SDIC。例如，图1示出了为显示面板10配置两个源驱动器SDIC。当使用具有低集成密度的传统源驱动器时，可在显示面板10中配置三个或更多个源驱动器。
在本发明中，源驱动器SDIC可被理解为源信号驱动装置或源信号驱动装置的一部分。
更具体地，当参考图2在下文描述的控制器30被嵌入到源驱动器SDIC中时，源驱动器SDIC可被理解为源信号驱动装置。另一方面，当控制器30配置在源驱动器SDIC外部时，源驱动器SDIC可被理解为源信号驱动装置的不包括控制器30的部分。控制器可被理解为通常应用至显示设备的时序控制器。
根据本发明的实施方式的源信号驱动装置可如图2中示出的那样实施。根据图2的实施方式的源信号驱动装置通过延迟使能信号的使能时间点的传输缓冲器将源信号的输出时间点划分成组，从而抑制涌入电流的出现。
参考图2，根据本发明的实施方式的源信号驱动装置包括多个通道电路CH1至CH6、传输缓冲器BUF和控制器30。
通道电路CH1至CH6中的每个可配置成使用相同的电源，并且包括用于输出源信号的一个或多个部分。通道电路CH1至CH6配置成分别输出先前指定数目的源信号S1至S100、S101至S200、S201至S300、S301至S400、S401至S500和S501至S600。
在图2中，通道电路CH1至CH6中的每个包括数模转换器DAC、输出缓冲器AMP和多路复用器MUX。与以上描述的配置不同，通道电路CH1至CH6中的每个可修改成包括数模转换器DAC、输出缓冲器AMP和多路复用器MUX中的一个或多个。
通道电路CH1至CH6中的每个所包括的数模转换器DAC、输出缓冲器AMP和多路复用器MUX使用相同的模拟电源电压AVDD和公共的接地电压VSS操作。模拟电源电压AVDD可被理解为具有比控制器30中使用的数字电源电压DVDD高的电平的直流电压。
在通道电路CH1至CH6中的每个中，数模转换器DAC选择并输出与数字显示数据对应的伽马电压，输出缓冲器AMP驱动数模转换器DAC的输出电压并将该输出电压输出为源信号，以及多路复用器MUX选择性地将输出缓冲器AMP的源信号传输至显示面板10的显示区域12中的相应像素。数模转换器DAC、输出缓冲器AMP和多路复用器MUX可分别接收使能信号EN11至EN13，并且与使能信号的使能时间点同步地开始相应的操作。
多个通道电路CH1至CH6形成在实施为芯片的一个驱动器(源驱动器)中，并且被分成多个组。例如，通道电路CH1和CH2、通道电路CH3和CH4以及通道电路CH5和CH6可被划分并限定为相应的组。
源信号驱动装置可包括接收显示数据并恢复数据和时钟信号的时钟数据恢复单元(未示出)、使用恢复的时钟和数据执行数字处理的锁存器(未示出)、电平移位器(未示出)等，但是为了方便描述，将在本文中省略上述单元的详细描述。
控制器30将一个或多个使能信号提供至多个通道电路CH1至CH6。在图2中，控制器30配置成提供使能信号EN11至EN13。使能信号EN11被提供至数模转换器DAC，使能信号EN12被提供至输出缓冲器AMP，以及使能信号EN13被提供至多路复用器MUX。
传输缓冲器BUF配置成在多个通道电路CH1至CH6中所包括的一对组之间传输使能信号。此时，传输缓冲器BUF可执行放大传输信号的操作。更具体地，传输缓冲器BUF配置在通道电路CH1和CH2的组与通道电路CH3和CH4的组之间以及配置在通道电路CH3和CH4的组与通道电路CH5和CH6的组之间。传输缓冲器BUF接收使能信号EN11至EN13、将使能信号EN11至EN13的使能时间点延迟预设时间并输出使能时间点被延迟的使能信号EN11至EN13。对于该操作，传输缓冲器BUFF可包括触发器或延迟元件。
通常，源驱动器具有形成通道并且沿着芯片的一侧布置成一行或多行的输出端。根据输出端的配置，通道电路CH1至CH6还可沿着源驱动器的芯片的一侧布置以与芯片内的相应输出端对应。传输缓冲器BUF可放置在通道电路CH1至CH6之间，且因此配置成接收并输出使能信号EN11至EN13。更具体地，传输缓冲器BUF可分别放置在通道电路CH2与通道电路CH3之间(第一位置)以及通道电路CH4与通道电路CH5之间(第二位置)。例如，放置在第一位置处的传输缓冲器BUF经由通道电路CH1和CH2接收使能信号EN11至EN13，并为通道电路CH3和CH4的组提供其中使能时间点被延迟的使能信号EN11至EN13。
在每个组中，使能信号EN11至EN13可并行输入至组中所包括的通道电路或顺序地输入至组中所包括的通道电路。
因此，在图2的实施方式中，使能信号EN11至EN13分别从控制器30输出并输入至第一组的通道电路CH1的数模转换器DAC、输出缓冲器AMP和多路复用器MUX。然后，使能信号EN11至EN13顺序地传输至通道电路CH2、传输缓冲器BUF、通道电路CH3和CH4、传输电路BUF以及通道电路CH5和CH6。
在传输过程期间，使能信号EN11至EN13的使能时间点通过传输缓冲器BUF逐渐延迟。即，从传输缓冲器BUF接收使能信号的组的通道电路在比在传输缓冲器BUF之前接收到使能信号的组中的通道电路更晚的使能时间点输出源信号。
因此，多个通道电路CH1至CH6根据各个组的使能信号EN11至EN13在不同的使能时间点处顺序地输出源信号。
根据本发明的实施方式，多个通道电路CH1至CH6在不同的使能时间点处输出源信号的操作可包括在通过接通显示设备的电源的通道导通操作中或包括在通过关闭显示设备的电源的通道关闭操作中。
将参考图3描述基于接通显示设备的电源的通电顺序。
当接通显示设备的电源时，在执行初始化之后执行源驱动器的通道导通操作，并且源驱动器在通道导通操作之后正常操作。初始化与图3的时段PA对应，源驱动器的通道导通操作与图3的时段PB对应，并且源驱动器的正常操作与图3的时段PC对应。
当接通电源时，显示设备执行其中顺序地执行稳定数字电源电压DVDD、稳定模拟电源电压AVDD、设置寄存器、复位时序控制器以及导通源驱动器的通电顺序。
在通电顺序的最后一步(即，导通源驱动器)之后，执行通道导通操作。
根据本发明的实施方式的通道电路CH1至CH6通过通道导通操作在各个组的不同使能时间点处输出源信号。即，通道电路CH1和CH2的组在时间T11处与使能信号EN11至EN13同步地输出源信号S1至S200，通道电路CH3和CH4的组在时间T12处与使能时间点通过缓冲器BUF延迟的使能信号EN11至EN13同步地输出源信号S201至S400，以及通道电路CH5和CH6的组在时间T13处与使能时间点通过缓冲器BUF进一步延迟的使能信号EN11至EN13同步地输出源信号S401至S600。
由于源信号的输出时间点是响应于通电顺序而分布的，因此在输出源信号时可以抑制涌入电流的发生。
即使在基于断开电源的显示设备的断电顺序期间，根据本发明的实施方式的源信号驱动装置仍可以抑制涌入电流的发生。
将参考图4描述基于断开电源的断电顺序。
当显示设备的电源断开时，正常操作的源驱动器执行通道关闭操作。然后，源驱动器、时序控制器、寄存器和电源断电。此时，源驱动器的正常操作与图4的时段FA对应，源驱动器的通道关闭操作与图4的时段FB对应，并且在图4的时段FC中执行源驱动器、时序控制器、寄存器和电源的断电操作。
当显示设备的电源关闭时，处于正常操作状态中的源驱动器首先执行通道关闭操作。
在源驱动器的通道关闭操作之后，显示设备执行断电顺序以顺序关闭源驱动器和时序控制器。
在本实施方式中，在断电顺序的第一步骤(即，在关闭源驱动器之前)处执行通道关闭操作。根据本发明的实施方式的通道电路CH1至CH6通过通道关闭操作在各个组的不同使能时间点处停止输出源信号。即，通道电路CH1和CH2的组在时间T14处与使能信号EN11至EN13同步地停止输出源信号S1至S200，通道电路CH3和CH4的组在时间T15处与使能时间点通过缓冲器BUF延迟的使能信号EN11至EN13同步地停止输出源信号S201至S400，以及通道电路CH5和CH6的组在时间T16处与使能时间点通过缓冲器BUF进一步延迟的使能信号EN11至EN13同步地停止输出源信号S401至S600。
由于源信号的输出停止的时间点响应于断电顺序而分布，因此可以通过改变源信号来抑制涌入电流的发生。
如上所述，根据本发明的实施方式的源信号驱动装置可以通过源信号抑制涌入电流的发生。
根据本发明的实施方式的源信号驱动装置可以减少可由于涌入电流而发生的故障，并且防止各种迁移。因此，源信号驱动装置可以在确保显示设备的价格竞争力的同时简化制造过程，并且在降低故障率的同时提供设计的便利性。
根据本发明的实施方式的源信号驱动装置可以如图5中示出的那样实施，并且可以基于组分配源信号的输出时间点，从而抑制涌入电流的发生。
参考图5，根据本发明的实施方式的源信号驱动装置包括多个通道电路CH1至CH6以及控制器30。在图5的配置中，多个通道电路CH1至CH6以与图1中的多个通道电路CH1至CH6相同的方式配置。因此，将在此处省略其配置和操作的详细描述。
控制器30配置成向多个通道电路CH1至CH6中的各个组提供具有不同使能时间点的、相同数目的一个或多个使能信号。
在图5的实施方式中，控制器30向通道电路CH1和CH2的组中的数模转换器DAC、输出缓冲器AMP和多路复用器MUX提供使能信号EN1、EN4和EN7，向通道电路CH3和CH4的组中的数模转换器DAC、输出缓冲器AMP和多路复用器MUX提供使能信号EN2、EN5和EN8，以及向通道电路CH5和CH6的组中的数模转换器DAC、输出缓冲器AMP和多路复用器MUX提供使能信号EN3、EN6和EN9。
控制器30可配置成向相同的组提供具有相同使能时间点或不同使能时间点的使能信号。当使能信号的使能时间点不同时，控制器30可配置成向数模转换器DAC提供具有最早使能时间点的使能信号，并且向多路复用器MUX提供具有最晚使能时间点的使能信号。
图5例示了控制器30向通道电路CH1和CH2的组提供具有最早使能时间点的使能信号EN1、EN4和EN7，以及向通道电路CH5和CH6的组提供具有最晚使能时间点的使能信号EN3、EN6和EN9。
因此，通道电路CH1至CH6可与各个组的不同使能时间点同步地顺序输出源信号。
如上所述，控制器30为各个组提供使能信号EN1、EN4、EN7/EN2、EN5、EN8/EN3、EN6、EN9以使使能时间点具有差异。对于此操作，控制器30可产生使能信号EN1、EN4、EN7/EN2、EN5、EN8/EN3、EN6、EN9，使得各个组基于内部时钟的周期或内部延迟块的延迟而具有不同的使能时间点。
如参考图2所描述的，根据图5的实施方式的源信号驱动装置还可执行这样的操作，其中，多个通道电路CH1至CH6在显示设备的通电顺序中所包括的导通驱动器之后的通道导通操作期间以及在显示设备的断电顺序中所包括的关闭驱动器之前的通道关闭操作期间在不同的使能时间点处输出源信号。
由于该操作具有与图2至图4的实施方式相同的效果，因此将在本文中省略其重复描述。
根据本发明的实施方式的源信号驱动装置可以如图6中那样实施，并且可以基于组分配源信号的输出时间点，从而抑制涌入电流的发生。
参考图6，根据本发明的实施方式的源信号驱动装置包括多个通道电路CH1至CH6、使能信号提供单元和控制器30。在图6的配置中，多个通道电路CH1至CH6以与图5中的多个通道电路CH1至CH6相同的方式配置。因此，将在此处省略其配置和操作的详细描述。
在上述配置中，控制器30配置成提供使能数据EN和移位时钟SC。使能数据EN在用于输出源信号的使能时段期间被使能，并且移位时钟SC在使能时段期间具有多个周期。
使能信号提供单元与多个通道电路CH1至CH6中的各个组对应，并且配置成顺序地传输使能数据EN和移位时钟SC并将一个或多个使能信号提供至相应的组。
使能信号提供单元中的每个可配置为移位器SFT。
即，移位器SFT与多个通道电路CH1至CH6中的各个组对应，并且配置成顺序地传输使能数据EN和移位时钟SC并将一个或多个使能信号提供至相应的组。
移位器SFT中的每个产生一个或多个使能信号，所述一个或多个使能信号的使能时间点在使能数据EN被使能的同时与移位时钟SC同步地顺序延迟。对于此操作，移位器SFT中的每个可包括一个或多个延迟单元块，移位器SFT中的每个通过延迟单元块延迟使能数据EN并且与移位时钟SC的上升沿或下降沿同步地输出使能信号。
在图6的实施方式中，通道电路CH1至CH6被限定为各个组。
因此，移位器SFT配置成向各个通道电路CH1至CH6提供使能信号EN21至EN26。使能信号EN21至EN26具有通过相应的移位器SFT顺序延迟的不同使能时间点。
通过上述配置，使能数据EN和移位时钟SC通过移位器SFT顺序地传输。
移位器SFT向各个通道电路CH1至CH6提供使能信号EN21至EN26，该使能信号EN21至EN26的使能时间点根据使能数据ED和移位时钟SC的传输顺序与移位时钟同步地顺序延迟。
因此，通道电路CH1至CH6根据具有不同使能时间点的使能信号EN21至EN26在不同的时间点处顺序地输出源信号。
移位器SFT可配置成向数模转换器DAC、输出缓冲器AMP和多路复用器MUX提供具有相同使能时间点或不同使能时间点的使能信号。为了方便描述，在图6中，从移位器SFT输出的使能信号由一个符号进行表示。然而，实际上，可输出三个使能信号。
当具有不同使能时间点的使能信号被分别提供至数模转换器DAC、输出缓冲器AMP和多路复用器MUX时，数模转换器DAC、输出缓冲器AMP和多路复用器MUX中的使能时间点的差异可由移位器SFT内的延迟单元块的延迟时间确定。例如，数模转换器DAC可接收具有最早使能时间点的使能信号，并且多路复用器MUX可接收具有最晚使能时间点的使能信号。
如参考图2所描述的，根据图6的实施方式的源信号驱动装置还可执行这样的操作，其中，多个通道电路CH1至CH6在显示设备的通电顺序中所包括的导通驱动器之后的通道导通操作期间以及在显示设备的断电顺序中所包括的关闭驱动器之前的通道关闭操作期间在不同的使能时间点处输出源信号。
根据图6的实施方式的操作可参考图7和图8进行理解。
图7和图8示出了在用于输出源信号的使能时段期间被使能的使能数据EN以及在使能时段期间具有多个周期的移位时钟SC。
由于使能数据EN和移位时钟SC的操作具有与图2至图4的操作相同的效果，因此将在此处省略重复的描述。
在图6的实施方式中，使能时段和源信号的使能时间点可如图9至图11中所示那样变化。
对于此操作，控制器30可调整移位时钟SC的频率，使得使能信号的使能时间点如图9中示出的那样狭窄地分布或如图11中示出的那样宽泛地分布。当移位时钟SC的频率升高时，使能数据EN的使能时段可响应于升高的频率而降低，并且当移位时钟SC的频率降低时，使能数据EN的使能时段可响应于降低的频率而升高。
根据上述实施方式，源驱动器(即，源信号驱动装置)可具有增加的集成密度和增加的通道数。因此，当极有可能发生涌入电流时，源信号驱动装置可以分配源信号的输出，这使得可以实现抑制涌入电流的效果。
具体地，本实施方式可以应用至与显示设备的通电顺序相关的源驱动器的通道导通操作或与显示设备的断电顺序相关的源驱动器的通道关闭操作，从而抑制涌入电流的发生。
因此，源信号驱动装置可以减少涌入电流的发生、减少可由于涌入电流而发生的故障并且防止各种迁移。因此，源信号驱动装置可以在确保显示设备的价格竞争力的同时简化制造过程，并且在降低故障率的同时提供设计的便利性。
虽然上文已经描述了各种实施方式，但是本领域技术人员将理解，这些实施方式仅是通过示例性的方式描述的。因此，不应基于所描述的实施方式限制本文中描述的公开内容。

Claims (15)

1.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；
控制器，配置成提供一个或多个使能信号；以及
传输缓冲器，所述传输缓冲器中的每个配置成在一对组之间传输所述一个或多个使能信号、将所述一个或多个使能信号的使能时间点延迟预设时间以及传输所述一个或多个使能信号，
其中，所述一个或多个使能信号在所述使能时间点由所述传输缓冲器逐渐延迟的同时顺序地传输至所述多个组，
其中，所述多个通道电路通过各个组的所述一个或多个使能信号在不同的使能时间点处顺序地输出所述源信号，以及
其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器导通之后的通道导通操作中，所述时序控制器的初始化包括在基于所述显示设备的电源接通的通电顺序中。
2.根据权利要求1所述的源信号驱动装置，其中，所述通道电路中的每个包括使用相同电源的数模转换器、输出缓冲器和多路复用器，以及所述使能信号被提供至所述数模转换器、所述输出缓冲器和所述多路复用器中的一个或多个。
3.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；
控制器，配置成提供一个或多个使能信号；以及
传输缓冲器，所述传输缓冲器中的每个配置成在一对组之间传输所述一个或多个使能信号、将所述一个或多个使能信号的使能时间点延迟预设时间以及传输所述一个或多个使能信号，
其中，所述一个或多个使能信号在所述使能时间点由所述传输缓冲器逐渐延迟的同时顺序地传输至所述多个组，
其中，所述多个通道电路通过各个组的所述一个或多个使能信号在不同的使能时间点处顺序地输出所述源信号，以及
其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器关闭之前的通道关闭操作中的一个或多个中，所述时序控制器的初始化包括在基于所述显示设备的电源断开的断电顺序中。
4.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；以及
控制器，配置成为所述多个组提供用于各个组的、具有不同的使能时间点的相同数目的一个或多个使能信号，
其中，所述多个通道电路通过用于所述各个组的所述一个或多个使能信号在不同的使能时间点处顺序地输出所述源信号，
其中，所述通道电路中的每个包括数模转换器、输出缓冲器和多路复用器，所述数模转换器、所述输出缓冲器和所述多路复用器使用相同的电源并且响应于数字数据执行产生源信号的顺序过程，以及
其中，具有相同的使能时间点的第一使能信号至第三使能信号被提供至所述数模转换器、所述输出缓冲器和所述多路复用器。
5.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；以及
控制器，配置成为所述多个组提供用于各个组的、具有不同的使能时间点的相同数目的一个或多个使能信号，
其中，所述多个通道电路通过用于所述各个组的所述一个或多个使能信号在不同的使能时间点处顺序地输出所述源信号，
其中，所述通道电路中的每个包括数模转换器、输出缓冲器和多路复用器，所述数模转换器、所述输出缓冲器和所述多路复用器使用相同的电源并且响应于数字数据执行产生所述源信号的顺序过程，
其中，所述数模转换器接收第一使能信号，所述输出缓冲器接收第二使能信号，以及所述多路复用器接收第三使能信号，以及
其中，在所述第一使能信号至所述第三使能信号中，所述第一使能信号的第一使能时间点是最早的，并且所述第三使能信号的第三使能时间点是最晚的。
6.根据权利要求4或5所述的源信号驱动装置，其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器导通之后的通道导通操作中，所述时序控制器的初始化包括在基于所述显示设备的电源接通的通电顺序中。
7.根据权利要求4或5所述的源信号驱动装置，其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器关闭之前的通道关闭操作中的一个或多个中，所述时序控制器的初始化包括在基于所述显示设备的电源断开的断电顺序中。
8.根据权利要求4或5所述的源信号驱动装置，其中，所述控制器基于内部时钟的周期产生所述一个或多个使能信号，使得所述各个组的所述一个或多个使能信号具有不同的使能时间点。
9.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；
控制器，配置成提供在输出所述源信号的使能时段期间被使能的使能数据以及在所述使能时段期间具有多个周期的移位时钟；以及
信号提供单元，与各个组对应，并且所述信号提供单元中的每个配置成向所对应的组提供一个或多个使能信号，
其中，所述使能数据和所述移位时钟被顺序地传输至所述使能信号提供单元，
其中，所述使能信号提供单元根据所述使能数据和所述移位时钟的传输顺序生成所述一个或多个使能信号，所述一个或多个使能信号具有与所述移位时钟同步地顺序延迟的使能时间点，
其中，所述多个通道电路响应于不同的使能时间点通过所述各个组的所述一个或多个使能信号顺序地输出所述源信号，
其中，所述通道电路中的每个包括数模转换器、输出缓冲器和多路复用器，所述数模转换器、所述输出缓冲器和所述多路复用器使用相同的电源并且响应于数字数据执行产生所述源信号的顺序过程，以及
其中，具有相同的使能时间点的第一使能信号至第三使能信号被提供至所述数模转换器、所述输出缓冲器和所述多路复用器。
10.显示设备的源信号驱动装置，包括：
多个通道电路，形成在实施为芯片的一个驱动器中，所述多个通道电路被划分成多个组，以及所述多个通道电路中的每个配置成输出源信号；
控制器，配置成提供在输出所述源信号的使能时段期间被使能的使能数据以及在所述使能时段期间具有多个周期的移位时钟；以及
信号提供单元，与各个组对应，并且所述信号提供单元中的每个配置成向所对应的组提供一个或多个使能信号，
其中，所述使能数据和所述移位时钟被顺序地传输至所述使能信号提供单元，
其中，所述使能信号提供单元根据所述使能数据和所述移位时钟的传输顺序生成所述一个或多个使能信号，所述一个或多个使能信号具有与所述移位时钟同步地顺序延迟的使能时间点，
其中，所述多个通道电路响应于不同的使能时间点通过所述各个组的所述一个或多个使能信号顺序地输出所述源信号，
其中，所述通道电路中的每个包括数模转换器、输出缓冲器和多路复用器，所述数模转换器、所述输出缓冲器和所述多路复用器使用相同的电源并且响应于数字数据执行产生所述源信号的顺序过程，
其中，所述数模转换器接收第一使能信号，所述输出缓冲器接收第二使能信号，以及所述多路复用器接收第三使能信号，以及
其中，在所述第一使能信号至所述第三使能信号中，所述第一使能信号的第一使能时间点是最早的，并且所述第三使能信号的第三使能时间点是最晚的。
11.根据权利要求10所述的源信号驱动装置，其中，所述使能信号提供单元中的每个配置为移位器，并且基于所述移位时钟的周期提供具有不同的使能时间点的所述第一使能信号至所述第三使能信号。
12.根据权利要求9或10所述的源信号驱动装置，其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器导通之后的通道导通操作中，所述时序控制器的初始化包括在基于所述显示设备的电源接通的通电顺序中。
13.根据权利要求9或10所述的源信号驱动装置，其中，所述多个通道电路通过所述一个或多个使能信号在所述不同的使能时间点处输出所述源信号的操作包括在时序控制器的初始化和所述驱动器关闭之前的通道关闭操作中的一个或多个中，所述时序控制器的初始化包括在基于所述显示设备的电源断开的断电顺序中。
14.根据权利要求9或10所述的源信号驱动装置，其中，所述使能信号提供单元中的每个配置为移位器并且基于所述移位时钟的周期提供所述使能时间点被顺序地延迟的所述一个或多个使能信号。
15.根据权利要求9或10所述的源信号驱动装置，其中，所述控制器通过调整所述移位时钟的频率以调整所述各个组的所述一个或多个使能信号的所述使能时间点，进而调整所述多个通道电路的涌入电流的量。
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