CN105654882A - 显示面板及其驱动方法 - Google Patents

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Abstract

公开了一种显示面板及其驱动方法。该显示面板包括移位寄存器，该移位寄存器具有被配置为使多条扫描线的扫描脉冲移位并输出的多个级。各个级包括：上拉晶体管和下拉晶体管，该上拉晶体管和该下拉晶体管串联连接并且在它们之间限定输出节点；驱动器，其具有连接至上拉晶体管的栅极的第一节点以及连接至下拉晶体管的栅极的第二节点；以及节点控制器，其连接至第一节点、第二节点和输出节点。在各个级中，所述节点控制器被配置为响应于控制信号在第一节点和第二节点处选择性地施加基准电压。

Description

显示面板及其驱动方法
技术领域
本公开的实施方式涉及显示面板及其驱动方法。
背景技术
信息技术的当前发展状态着重于使用显示装置作为向用户传达信息的优选媒介。显示装置的示例包括诸如有机发光二极管(OLED)显示器和液晶显示器的平板显示器。
通常，诸如平板显示器的显示装置包括显示面板，其包括按照矩阵或阵列形式排列的多个像素以及用于驱动像素和显示面板的其它组件的驱动器。在彩色显示面板的情况下，各个像素可被分成红色、绿色和蓝色子像素以用于再现一定范围的颜色。驱动器可包括向显示面板供应扫描脉冲的扫描驱动器以及向显示面板供应数据信号的数据驱动器。
扫描驱动器通常向扫描线供应扫描脉冲以逐步地选择显示面板的各行子像素来进行操作，数据驱动器通常向显示面板中的与各个不同列的子像素关联的数据线供应数据信号。在操作中，为通过扫描脉冲选择的行中的子像素供应数据信号，所选择的子像素响应于该数据信号发射光。针对所有行重复该处理，以使得显示面板显示图像。
在一些配置中，扫描驱动器可利用移位寄存器从扫描线到扫描线使扫描脉冲移位。为此，移位寄存器可具有连接到扫描线的多个级(stage)，其中各个级由多个晶体管组成。优选地，级必须稳定地维持连接到该级的扫描线的电压。然而，在一些情况下，在扫描驱动器的操作期间，级内的一些节点可能未偏置，因此浮置。不利的是，这些浮置节点可能受外部噪声的影响，因此可能导致包括扫描线的电压改变等的多个异常操作，这可导致显示面板的异常操作。
此外，由于留在浮置节点中的任何电荷所导致的应力，级中的晶体管的寿命可能缩短。在特定配置中，这些电荷可坚持达相当长的时间周期。具体地讲，由于使用氧化物半导体的晶体管的截止电流非常低，所以使晶体管的栅极处的任何遗留电荷自然地放电可花费相对长的时间。因此，晶体管由于这些遗留电荷而受到应力。
发明内容
本公开的各个方面提供了一种能够稳定地驱动扫描驱动器并且增加构成扫描驱动器的晶体管的寿命和可靠性的显示面板及其驱动方法。
本公开的一方面涉及一种显示面板及其驱动方法。该显示面板包括移位寄存器，该移位寄存器具有被配置为使多条扫描线的扫描脉冲移位并输出的多个级。各个级包括：上拉晶体管和下拉晶体管，它们串联连接(couple)并且在它们之间限定输出节点；驱动器，其具有连接至上拉晶体管的栅极的第一节点以及连接至下拉晶体管的栅极的第二节点；以及节点控制器，其连接至第一节点、第二节点和输出节点。在各个级中，所述节点控制器被配置为响应于控制信号在第一节点和第二节点处选择性地施加基准电压。
本公开的另一方面涉及一种具有显示面板的显示装置，所述显示面板具有多条扫描线、定时控制器和扫描驱动器，该扫描驱动器包括被配置为针对所述多条扫描线中的每一条生成扫描线信号的多个扫描级。所述多个扫描级中的每一个包括：上拉晶体管和下拉晶体管，它们串联连接并且限定所述多条扫描线中的对应一条的输出节点；驱动器，其被配置为在上拉晶体管的第一栅极和下拉晶体管的第二栅极处生成驱动器控制信号；以及节点控制器，其被配置为根据来自定时控制器的控制信号选择性地将基准电压节点与第一栅极、第二栅极和输出节点连接和断开(decouple)。
本公开的另一方面涉及一种操作显示装置的方法。该方法包括以下步骤：在定时控制器处生成用于节点控制器的控制信号，该节点控制器被配置为选择性地将基准电压节点与扫描驱动器级的上拉晶体管的第一栅极、扫描驱动器级的下拉晶体管的第二栅极和扫描驱动器级的输出节点连接和断开。所述生成步骤涉及：在第一时间周期期间，配置用于将基准电压节点与第一栅极、第二栅极和输出节点断开的控制信号；以及在第一时间周期之后的第二时间周期期间，配置用于将基准电压节点与第一栅极、第二栅极和输出节点连接的控制信号。
附图说明
附图被包括以提供对本公开的各个方面的进一步理解，并且被并入本公开并构成本公开的一部分，附图例示了本公开的各个方面，并且与说明书一起用来说明本公开的原理。附图中：
图1是示出根据本公开的一个方面的显示装置的框图；
图2是示出图1所示的显示装置中的子像素的配置的示例的电路图；
图3示出图1所示的扫描驱动器的移位寄存器的配置的示例；
图4示出图3所示的级的配置的示例；
图5是详细示出图4所示的节点控制器的电路图；
图6和图7是示出根据本公开的一个方面的显示装置的驱动方法的示例的波形图；
图8是示出图1所示的显示装置的电源切断时序处理中的扫描驱动器的移位寄存器的输出电压的波形图；
图9是示出根据是否存在节点控制器的控制信号而变化的扫描驱动器的输出电压的波形图；
图10是示出根据本公开的一个方面的电源切断时序的波形图；
图11是示出根据本公开的另一方面的电源切断时序的波形图；以及
图12是示出图4所示的级的电路配置的示例的电路图。
具体实施方式
参照附图描述本公开的各个方面，其中贯穿附图使用相似的标号来指代相似或等同的元件。附图未按比例绘制，提供它们仅是为了例示本公开的各个方面。下面参照示例应用来描述本公开的多个方面以用于例示。应该理解，阐述许多具体细节、关系和方法以提供本公开的各个方面的充分理解。然而，相关领域的普通技术人员将易于理解，本公开的各个方面可在没有这些具体细节中的一个或更多个的情况下或者利用其它方法来实践。在其它情况下，熟知结构或操作未详细示出，以避免使本公开的各个方面模糊。本公开的各个方面不受所示的动作或事件的顺序限制，因为一些动作可按照不同的顺序发生和/或与其它动作或事件同时发生。另外，实现根据本公开的各个方面的方法不要求所有示出的动作或事件。
参照图1，示出了根据本公开的一方面的显示装置10的框图。如图1所示，显示装置10包括显示面板100、显示面板驱动器105和电源单元150。然而，本公开可以想到显示装置10可包括图1中未示出的一个或更多个其它组件。
本公开可以想到显示面板100可利用各种平板显示器技术来实现，包括(但不限于)有机发光二极管(OLED)显示器技术、液晶显示器(LCD)技术和电泳显示器(EPD)技术。显示面板100可被分成：显示区域100A，其中形成有通过从数据线DL和扫描线GL施加的信号来驱动的子像素SP；以及非显示区域100B，其中形成有各种信号线或焊盘。响应于数据信号被供应给与子像素SP之一关联的数据线DL，同时扫描脉冲被供应给与子像素SP之一关联的行，每一个子像素SP被配置为发射光。
显示面板驱动器105包括定时控制器110、数据驱动器120和扫描驱动器130。显示面板驱动器105被配置为将输入图像的像素数据施加到像素。然而，本公开可以想到显示面板驱动器可以包括图1中未示出的其它组件。
在操作中，显示面板驱动器105的定时控制器110从外部主机系统200接收定时信号tH。这些可包括(但不限于)垂直同步信号、水平同步信号、数据使能信号和/或点时钟信号。此后，定时控制器110基于所接收到的定时信号tH生成用于控制数据驱动器120(tD)和扫描驱动器130(tG)的操作定时的定时控制信号，以分别在数据线DL和扫描线GL上生成数据信号和扫描脉冲，以用于利用显示面板100生成图像。
主机系统200可按照各种方式来实现。例如，主机系统可被实现为电视系统、机顶盒、导航系统、DVD播放器、蓝光播放器、个人计算机(PC)、家庭影院系统或者电话系统等中的一个。在操作中，主机系统200从视频源获得输入图像并且将输入图像的像素数据RGB发送给定时控制器110。另外，主机系统将定时信号tH发送给定时控制器110，使得这些定时信号tH与像素数据RGB同步。另外，主机系统200可对来自外部电源或电池的电功率进行整流，以生成输入电压Vin。然后输入电压Vin被供应给电源单元150。
显示面板驱动器105的数据驱动器120通过从定时控制器110接收视频数据RGB’和数据定时控制信号tD来操作。在本公开的特定方面，像素数据RGB和视频数据RGB’可相同。接收视频数据RGB’的数据驱动器120然后可响应于数据定时控制信号tD将视频数据RGB’转换为伽马补偿电压，生成与视频数据RGB’对应的数据信号，并且将该数据信号供应给数据线DL。为此，数据驱动器120可包括多个源极驱动器集成电路(IC)。源极驱动器IC可通过玻璃上芯片(COG)工艺或者卷带自动结合(TAB)工艺来连接到数据线DL。
扫描驱动器130可包括电平移位器135和移位寄存器140。在操作中，电平移位器135使包括从定时控制器110接收的时钟信号CLKx和至少一个起始信号Vst的各种信号的电压电平移位，并且将所述各种信号供应给移位寄存器140。
输入到电平移位器135的信号可以是晶体管-晶体管逻辑(TTL)电平在0V与3.3V之间摇摆的信号。电平移位器135使输入信号电压移位并且将输入信号电压转换为电压在选通低电压VGL与选通高电压VGH之间摇摆的信号。选通低电压VGL可被设定为小于晶体管的阈值电压的电压(例如，-10V)，如下面参照图10和图11所示。选通高电压VGH可被设定为等于或大于晶体管的阈值电压的电压(例如，+20V)，也如下面参照图10和图11所示。为了指定VGL和VGH，“晶体管”表示构成移位寄存器140的晶体管和像素内的晶体管。移位寄存器140的晶体管和像素的晶体管可通过相同的制造工艺同时形成在显示面板100的基板上。
移位寄存器140可包括多个级，各个级响应于时钟信号CLKx和起始信号Vst使扫描脉冲移位并输出。各个级连接到至少一条扫描线GL，并且将扫描脉冲输出给所述一条扫描线GL。在一些方面，移位寄存器140可通过面板内栅极(GIP)工艺形成在显示面板100的非显示区域100B中。在一些方面，电平移位器135可按照集成电路(IC)的形式被安装在连接到显示面板100的外部基板上，或者可被安装在显示面板100的非显示区域100B中。
电源单元150被配置为从主机系统200接收输入电压Vin并且生成驱动显示面板驱动器110、120、130和显示面板100所需的驱动电压。在操作中，电源单元150调节输入电压Vin并且生成各种电平的驱动电压。在特定方面，电源单元150可使用DC-DC转换器、电荷泵、调节器等来调节输入电压Vin。在一些方面，电源单元150可与电源IC芯片集成。由电源单元150提供的驱动电压可被配置为提供用于显示面板驱动器的驱动电压、供应给数据驱动器120的伽马基准电压、选通高电压VGH、选通低电压VGL以及LCD的公共电压Vcom或者OLED显示器的像素驱动电压ELVDD(取决于所使用的显示面板技术)。然而，本公开还可以想到电源单元可被配置为根据显示装置10的配置生成其它驱动电压。
在一些方面，显示装置10可包括电源开关，该电源开关可由于用户的操作或者其它原因而被关闭。另选地，显示装置10可依赖于外部电源或电池。然而，在电源被切断的情况下，不管来源如何，本公开可以想到电源单元150可检测输入电压Vin的放电并且基于先前设定的电源切断时序自动地使任何驱动电压放电。
现在转向图2，示出了根据本公开的一方面的子像素SP的示例性配置。如图2所示，子像素SP可连接到第一扫描线GL1和第一数据线DL1。具体地讲，如图2所示，子像素SP可包括开关晶体管SW，该开关晶体管SW具有连接到第一扫描线GL1的栅节点G、连接到第一数据线DL1的源节点D以及连接到像素电路PC的漏节点D。在操作中，当通过第一扫描线GL1提供适当的信号时，响应于通过开关晶体管SW由第一数据线DL1供应的数据信号来驱动像素电路PC。
子像素SP可按照各种方式来实现。例如，子像素SP可被实现为包括液晶元件的液晶显示面板或者包括有机发光元件的OLED显示面板。然而，像素电路PC的具体配置可根据所使用的显示装置技术的类型而变化。
当显示面板100的子像素SP被实现为液晶元件时，显示面板100可按照多个模式来实现以用于调节液晶的角度并调节光发射。这些模式的示例包括(但不限于)：扭曲向列(TN)模式、垂直配向(VA)模式、面内切换(IPS)模式、边缘场切换(FFS)模式或者电控双折射(ECB)模式。当显示面板100的子像素SP被实现为有机发光元件时，显示面板100可被实现为顶部发射型显示面板、底部发射型显示面板或者双发射型显示面板等。然而，本公开可以想到子像素不限于上面所列的技术或模式。
现在转向图3，示出了扫描驱动器130的移位寄存器140的示例性配置。图4示出图3所示的移位寄存器140的级的示例性配置。
如图3所示，移位寄存器140包括多个级STi(i＝1,2,…N)，例如级ST1至ST4。级STi在响应于至少一个时钟信号CLKi(例如，与级ST1至ST4对应的时钟信号CLK1至CLK4)使起始信号Vst移位的同时，通过对应的输出端子20i(例如，与级ST1至ST4对应的输出端子201至204)输出扫描脉冲。
尽管图3示出了移位寄存器140中的分立的级ST1至ST4，各个级与分立的对应时钟信号CLK1至CLK4关联，但是本公开的各个方面不限于图3所示的布置方式。本公开可以想到，级可利用各种电路设计来实现以获得相同的效果，并且可根据电路配置包括更多或更少的时钟信号。因此，在一些方面，各个级STi可接收各种信号作为输入。
现在转向图4，各个级STi可包括上拉晶体管Tpu、下拉晶体管Tpd、驱动器22和节点控制器24。上拉晶体管Tpu经由源节点和漏节点或电极连接在时钟节点CLK与输出端子20i之间。级STi的时钟信号CLKi在时钟节点处被供应给上拉晶体管Tpu。上拉晶体管Tpu的栅节点或栅极连接到第一节点N1(即，Q节点)。上拉晶体管Tpu响应于第一节点N1处的电压将选通高电压VGH供应给输出端子20i。
在操作中，时钟信号CLKi在选通高电压VGH与选通低电压VGL之间摆动。在执行电源切断时序(将稍后详细描述)的处理中，可将选通高电压VGH或者等于或大于选通高电压VGH的电压供应给时钟线。由于在电源切断时序中时钟信号CLKi的电压没有摆动并且从选通高电压VGH放电，所以在图10和图11所示的电源切断时序中可在时钟节点处临时供应选通高电压VGH。
下拉晶体管Tpd经由源节点和漏节点或电极连接在输出端子20i与基准节点REF之间。选通低电压VGL或VSS电压在基准节点REF处被供应给下拉晶体管Tpd。下拉晶体管Tpd的栅节点或栅极连接到第二节点N2(即，QB节点)。下拉晶体管Tpd响应于第二节点N2的电压将选通低电压VGL供应给输出端子20。
驱动器22响应于通过一条或更多条信号线(未示出)供应的信号来控制第一节点N1和第二节点N2处的电压。驱动器22因此可通过控制第一节点N1和第二节点N2的电压来交替地使上拉晶体管Tpu和下拉晶体管Tpd导通和截止。
独立于驱动器22，节点控制器24还控制第一节点N1、第二节点N2和输出端子20i处的电压。例如，节点控制器24可响应于控制信号CS将预定电压(例如，选通低电压VGL)供应给第一节点N1、第二节点N2和输出端子20i。控制信号CS由定时控制器110生成，并且控制信号CS的电压可通过电平移位器135恰当地移位。
当选通低电压VGL被供应给第一节点N1和第二节点N2时，上拉晶体管Tpu和下拉晶体管Tpd切换为截止状态，并且稳定地维持截止状态。当选通低电压VGL被供应给输出端子20i时，输出端子20i的电压维持在选通低电压VGL。结果，留在第一节点N1、第二节点N2、输出端子20i以及连接到输出端子20i的扫描线上的电荷被放电。下面参照驱动波形来详细描述节点控制器24的操作。
现在转向图5，示出了节点控制器24的示例性配置。如上所述，节点控制器24迫使浮置节点或者说可浮置节点处于某一特定电位。换言之，在没有施加扫描脉冲时的特定周期(例如，图6的截止周期)期间将被浮置的节点被主动地供应有选通低电压VGL或另一基准电压。这样，那些可浮置节点(例如，第一节点N1、第二节点N2、输出端子20i)和扫描线上的电压可被稳定为具有最小噪声的特定电位。在本公开中，提供第一节点N1、第二节点N2和输出端子20i作为级中的可浮置节点的示例。然而，应该理解，级中的可浮置节点不限于上述节点。可浮置节点可包括晶体管之间的节点，所述节点可在显示驱动器105的操作期间同时被维持在截止状态。
如上所述，节点控制器24包括连接到级的可浮置节点(例如，第一节点N1、第二节点N2)和输出端子的晶体管。在显示装置的电源切断时序期间，节点控制器24可被配置为将其晶体管(例如，T1、T2和T3)的导通状态维持比用于实现级的其它晶体管更长的时间周期。将节点控制器24的晶体管置于截止状态中的延迟旨在确保使级内的节点、级的输出端子以及连接到输出端子的扫描线放电的时间。由于级的节点被更彻底地放电，所以连接到那些节点的晶体管不太可能由于留在节点中的电荷而受到应力。因此，显示装置的寿命和可靠性可得到改进。例如，因为本文所述的方法导致在停止供电时去除遗留电荷，所以由于这些电荷而受到应力的器件的寿命可得到改进。
如图5所示，节点控制器24的示例性配置包括第一晶体管T1、第二晶体管T2和第三晶体管T3。第一晶体管T1连接在节点N1与基准节点REF之间以便响应于在第一晶体管T1的栅节点或栅极处提供的控制信号CS为第一节点N1提供放电路径。具体地讲，当在第一晶体管T1的栅节点处供应控制信号CS时，第一晶体管T1导通，连接节点N1和基准节点REF。因此，来自电源单元150的选通低电压VGL被施加在第一节点N1处，使第一节点N1处的任何多余电荷放电。
类似地，第二晶体管T2被配置为响应于控制信号CS使第二节点N2放电。即，第二晶体管T2连接在第二节点N2与基准节点REF之间以便响应于在第二晶体管T2的栅节点或栅极处提供的控制信号CS为第二节点N2提供放电路径。具体地讲，当控制信号CS被供应给第二晶体管T2的栅节点时，第二晶体管T2导通，将节点N2连接到基准节点REF。因此，在第二节点N2处施加选通低电压VGL，使第二节点N2处的任何多余电荷放电。
另外，类似于第一晶体管T1和第二晶体管T2，第三晶体管T3被配置为响应于控制信号CS使输出端子20i放电。即，第三晶体管T3连接在输出端子20i与基准节点REF之间以便响应于在第三晶体管T3的栅节点或栅极处提供的控制信号CS为输出端子20i提供放电路径。具体地讲，当控制信号CS被供应给第三晶体管T3的栅节点时，第三晶体管T3导通，将输出端子20i连接到基准节点REF。因此，选通低电压VGL被施加在输出端子20i处，使输出端子20i处的任何多余电荷放电。
控制信号CS的电压可根据驱动处理(即，根据用于晶体管T1至T3的晶体管的类型)被设定为选通低电压VGL、选通高电压VGH、等于或大于选通高电压VGH的电压、或者介于选通低电压VGL和选通高电压VGH之间的电压。
本公开可以想到节点控制器24的配置不限于图5所示的布置方式。例如，如之前参照图12进一步详细讨论的，节点控制器24还可包括附加晶体管，以用于使驱动器22中或者级STi中的其它地方的能够作为浮置节点操作的任何节点放电。
鉴于上文，本公开可以想到一种使浮置节点放电的方法，其涉及在电源切断时序期间通过经由控制信号CS增加晶体管的导通周期来将节点控制器24的晶体管维持在导通状态比级STi的其它晶体管更长的时间周期。然而，本公开的各个方面不限于此。例如，如下面参照图10和图11更详细地示出的，存在各种方法，包括增加控制信号CS的电压的时间常数的方法、延迟控制信号CS的电压的方法等。
现在转向图6和图7，示出了例示根据本公开的一方面的显示装置的示例性驱动方法的波形图。
首先参照图6，示出了不同帧频的波形。具体地讲，施加到显示面板100的像素的数据的更新周期可根据帧频而变化。即，扫描驱动器130可在定时控制器110的控制下调节供应给显示面板100的扫描脉冲的数量。在一些配置中，扫描脉冲的数量可基于所呈现的图像的类型。例如，当运动图像显示在显示面板100上时(例如，视频或者具有大量运动或变化的其它图像)，扫描驱动器130可基于先前设定的帧频供应扫描脉冲。相比之下，当不动的图像显示在显示面板100上时(例如，静止图像或者具有少量运动或变化的其它图像)，扫描驱动器130可基于较低的帧频供应扫描脉冲。
在一个特定配置中，当运动图像显示在显示面板100上时，扫描驱动器130可每秒向各条扫描线供应60个扫描脉冲，以提供60Hz的帧频。相比之下，当不动的图像显示在显示面板100上时，扫描驱动器130可每秒向各条扫描线供应一个扫描脉冲，以提供1Hz的帧频。因此，本公开可以想到扫描驱动器130可基于输入图像的时间变化来调节供应给各条扫描线的扫描脉冲的数量，以提供不同的帧频(例如，30Hz、15Hz、120Hz等)。这些帧频的变化可通过定时控制器110的控制来提供。
鉴于上文，本公开可以想到提供向各条扫描线供应扫描脉冲的扫描周期(或者寻址周期)(本文中称作第一周期P1)与不向各条扫描线供应扫描脉冲的周期(本文中称作第二周期P2)。第二周期P2可包括在显示面板100上显示图像的各个帧周期之间的不供应扫描脉冲的空白时间。
在图6和图7中，“截止周期”指示该第二周期P2。因此，图6和图7中的帧周期由供应扫描脉冲的第一周期P1与不供应扫描脉冲的第二周期P2来限定。例如，当按照1Hz的帧频驱动扫描驱动器130时，如图7所示，从约59/60秒至一秒的周期被设定为第二周期P2。
当在第二周期P2期间第一节点N1和第二节点N2被设定为浮置状态时，存在输出端子20i的电压可能由于外部噪声而改变的概率。即，噪声可改变电荷，因此改变节点N1和N2中的任一个处的电压，使得晶体管Tpu或Tpd中的任一个的状态改变。在这些改变的情况下，输出端子20i处的电压也可能改变。因此，在本公开的一些实施方式中，通过节点控制器24控制第一节点N1、第二节点N2和输出端子20i的电压，使得在第二周期P2期间使输出端子20i的电压放电或者稳定。
因此，级STi如下操作。在向输出端子20i供应扫描脉冲的第一周期P1期间，控制信号CS被设定为使节点控制器24的第一晶体管、第二晶体管和第三晶体管T1～T3截止的电压(例如，选通低电压VGL)。因此，通过驱动器22控制第一节点N1和第二节点N2的电压。即，在第一周期P1期间，级STi的上拉晶体管Tpu和下拉晶体管Tpd根据驱动器22的操作而正常操作，并且向输出端子20i供应扫描脉冲，而对影响节点N1和N2的噪声没有任何明显担心。
在输出端子20i处不供应扫描脉冲的第二周期P2期间，控制信号CS被设定为使节点控制器24的第一晶体管、第二晶体管和第三晶体管T1～T3导通的第一导通电压V1。在第二周期P2期间，驱动器22可向第一节点N1和第二节点N2施加特定电压或者可不向第一节点N1和第二节点N2施加特定电压。在任一情况下，当节点控制器24的晶体管导通时，基准节点REF处的电压被供应给第一节点N1和第二节点N2。因此，防止第一节点N1和第二节点N2处于浮置状态。
第一导通电压V1可以是介于提供给级STi的选通低电压VGL与选通高电压VGH之间的任何电压，只要第一导通电压V1足以使包括在节点控制器24中的晶体管(例如，T1～T3)导通即可。当节点控制器24的第一晶体管T1至第三晶体管T3导通时，选通低电压VGL被供应给第一节点N1、第二节点N2和输出端子20。由于选通低电压VGL被供应给第一节点N1和第二节点N2，所以第一节点N1和第二节点N2不处于浮置状态，并且上拉晶体管Tpu和下拉晶体管Tpd被稳定地维持在截止状态。另外，由于选通低电压VGL按照与第一节点N1和第二节点N2相同的方式通过第三晶体管T3被供应给输出端子20，所以输出端子20的电压可被稳定地维持在选通低电压VGL。
使用单独的节点控制器24和控制信号CS使得在第二周期P2期间主动地在第一节点N1和第二节点N2上供应选通低电压VGL，这使得即使存在外部噪声，上拉晶体管Tpu和下拉晶体管Tpd也易于维持截止状态。因此，可确保扫描驱动器130的可靠性。
从上文显而易见的是，在周期P1和P2中输出端子20i的电压不同地维持在选通低电压VGL。具体地讲，下拉晶体管Tpd用在第一周期P1中，第三晶体管T3用在第二周期P2中。由于这样减少下拉晶体管Tpd的使用，所以与在第一周期P1和第二周期P2二者期间依赖于同一下拉晶体管的传统扫描驱动器相比，该配置可进一步降低下拉晶体管Tpd的栅极偏置应力并且可改进扫描驱动器130的寿命和可靠性。
本公开还可以想到，在第二周期P2期间用作控制信号CS的第一导通电压V1被设定为介于选通低电压VGL和选通高电压VGH之间的电压。这样，可减小节点控制器24的晶体管的栅极偏置应力，继而减小晶体管的阈值电压Vth的变化。因此，在电源切断时序的处理中可进一步确保扫描驱动器130的可靠性。
更具体地讲，当包括在节点控制器24中的晶体管T1、T2和T3被连续地驱动时，各个晶体管的阈值电压Vth响应于栅源电压Vgs(Vg-Vs)和电压施加时间而移位，并且各个晶体管的操作特性改变。然而，晶体管(T1～T3)的阈值电压Vth将不会移位超过栅源电压Vgs。
本发明的该实施方式通过用作在第二周期P2期间施加的控制信号CS的介于选通低电压VGL和选通高电压VGH之间的第一电压V1防止了包括在节点控制器24中的晶体管T1、T2和T3的阈值电压大于在第二周期P2期间施加的电压(即，第一导通电压V1)。
在本公开的一些实施方式中，不同的电压可用于第二周期P2期间以及显示装置的电源切断时序期间的控制信号CS。如上所述，在第二周期P2期间施加的控制信号CS的第一导通电压V1可以是介于选通低电压VGL和选通高电压VGH之间的电压。因此，包括在节点控制器24中的晶体管T1、T2和T3的阈值电压无法移位超过在第二周期P2期间施加的栅源电压Vgs。
例如，当控制信号CS为0V并且选通低电压VGL被设定为-10V时，包括在节点控制器24中的晶体管T1、T2和T3的阈值电压可不移位至超过10V的电压。因此，在显示装置的电源切断时序期间，控制信号CS的电压被设定为比用作第二周期P2期间的控制信号CS的第一导通电压V1大的电压。例如，在电源切断时序的处理中，控制信号CS的电压可使用选通高电压VGH或者大于选通高电压VGH的电压。这样，可确保在显示装置的电源切断时序期间通过控制信号CS使节点控制器24的晶体管T1、T2和T3导通。
图8描绘了示出在图1所描绘的显示装置的电源切断时序的处理中扫描驱动器的移位寄存器的输出电压的波形图。
如图8中所描绘的，当停止向显示装置供电时，选通高电压VGH被临时供应给连接到扫描驱动器的移位寄存器140的信号线，然后在电源切断时序的处理中被放电。结果，移位寄存器140内的晶体管以及连接到扫描线GL1至GLn的像素的薄膜晶体管(TFT)临时导通，任何遗留电荷被放电。
更具体地讲，当停止供电时，在电源切断时序的处理中，选通高电压VGH被临时供应给连接到移位寄存器140的外部信号线。例如，选通高电压VGH可被临时地并且同时地供应给包括向移位寄存器140供应选通低电压VGL的低电位电源线、供应时钟CLK的时钟线、供应选通高电压VGH的高电位电源线、供应控制信号CS的控制信号线等的信号线。另外，如果存在用于驱动驱动器22的单独的信号线，则可与上述信号线同时地向该单独的信号线供应选通高电压VGH。
选通高电压VGH是使移位寄存器140的晶体管导通的电压。因此，当选通高电压VGH被施加给连接到移位寄存器140的信号线时，包括在移位寄存器140中的晶体管导通。
如图8中所描绘的，当选通高电压VGH如上所述被供应给所有信号线时，选通高电压VGH被同时输出给所有扫描线GL1至GLn并且使各个子像素SP的开关晶体管(例如，TFT)导通。在此示例中，数据驱动器120将黑色数据信号或者接地电平电压GND供应给数据线DL1至DLm并且将子像素SP初始化为预定状态。此后，切断向连接到移位寄存器140的信号线的选通高电压VGH的供应，并且引起信号线的电压的自然放电以及移位寄存器140上的任何遗留电荷的自然放电。
本发明的实施方式可延迟被供应有控制信号CS的信号线(以下称作“控制信号供应线”)的放电，使得控制信号供应线上的遗留电荷比其它信号线更缓慢地放电。因此，包括在节点控制器24中的晶体管(例如，由控制信号供应线驱动的晶体管)可将导通状态维持比其它晶体管更长的时间周期。
图9描绘了示出根据是否存在节点控制器的控制信号而变化的扫描驱动器的输出电压的波形图。
如图9中所描绘的，当通过控制信号供应线驱动的移位寄存器140的晶体管的导通状态没有被维持比移位寄存器140的其它晶体管更长的时间周期时，任何遗留电荷在电源切断之后没有完全放电。如图9中所描绘的，“t1”是电源切断时序起始时间。在这种情况下，由于上拉晶体管Tpu和下拉晶体管Tpd的漏极和源极的电压、第一节点N1的电压以及第二节点N2的电压同时下降，所以电荷留在第一节点N1和第二节点N2上。遗留电荷可导致晶体管的劣化。具体地讲，如果晶体管被实现为具有低截止电流的氧化物半导体晶体管，则节点N1和N2上的任何遗留电荷可能没有自然地放电并且可能长时间周期遗留。因此，上拉晶体管Tpu和下拉晶体管Tpd可在大量应力下操作。
当控制信号供应线连接到根据本发明的实施方式的移位寄存器140并且控制节点控制器24时，节点控制器24的晶体管T1、T2和T3可将导通状态维持比其它晶体管更长的时间周期。因此，第一节点N1、第二节点N2和输出端子20中的每一个上的任何遗留电荷可被完全放电。因此，可改进扫描驱动器的稳定性。
本发明的实施方式在电源切断时序的处理中将节点控制器24的晶体管维持在导通状态比移位寄存器140的其它晶体管更长的时间周期。
增加节点控制器24中的晶体管的导通状态的持续时间的方法的示例可通过将控制信号供应线的电压维持比其它信号线更长的时间周期来实现。换言之，在向控制信号供应线以外的信号线的选通高电压VGH的供应停止之后，控制信号供应线的电压可维持在高电位电压达预定时间周期。因此，包括在节点控制器24中的晶体管可维持导通状态。在本文所公开的实施方式中，高电位电压可以是选通高电压VGH或者大于选通高电压VGH的电压。
增加包括在节点控制器24中的晶体管的导通状态的持续时间的方法的另一示例可包括通过恰当地调节控制信号供应线的时间常数来增加控制信号供应线的自然放电时间，以将节点控制器24的晶体管维持在导通状态比其它晶体管更长的时间周期。可使用其它方法来增加节点控制器24的晶体管的导通状态并且使连接到节点控制器24的晶体管的节点上的遗留电荷放电。
图10描绘了示出根据本发明的实施方式的电源切断时序的波形图。
如图10中所描绘的，电源单元150可感测输入电压Vin的改变，并且当输入电压Vin下降至等于或小于预定基准电压的值时开始电源切断时序。电源单元150可在电源切断时间t0开始减小输入电压Vin，并且可在输入电压Vin达到基准电压时的时间t1将放电控制信号DSC的电压反相为低逻辑电压。
当放电控制信号DSC的电压被反相为低逻辑电压时，选通低电压VGL以及第一选通高电压VGH1和第二选通高电压VGH2可被放电为0V的接地电平电压。电源单元150的VGH输出端子当中的第二选通高电压VGH2所输出到的第一输出端子的时间常数可大于第一选通高电压VGH1所输出到的第二输出端子的时间常数。可通过连接到输出端子的电阻和电容器的电容来调节时间常数。结果，第一选通高电压VGH1和第二选通高电压VGH2可响应于放电控制信号DSC在时间t1开始同时放电。在此示例中，第一选通高电压VGH1在时间t3达到0V，第二选通高电压VGH2在时间t4达到0V。
在第一周期P1期间时钟CLKx在第一选通高电压VGH1与选通低电压VGL之间摇摆。时钟CLKx对应于如图3至图5中所描绘的时钟CLK1至CLK4，其用于控制移位寄存器140的移位定时。在电源切断时序中，时钟CLKx在时间t0下降至选通低电压VGL，然后在时间t1上升至第一选通高电压VGH1。时钟CLKx在时间t1之后响应于第一选通高电压VGH1放电而放电，并且在时间t3达到0V。负DC电源VSS维持负DC电压(例如，-10V)直至时间t1，并且在时间t1上升至第一选通高电压VGH1。然后，负DC电源VSS放电并且在时间t3达到0V。
控制节点控制器24的控制信号CS可被配置为在第一周期P1期间维持选通低电压VGL，并且在第二周期P2期间可被反相为第二选通高电压VGH2。在电源切断时序中，在控制信号CS的电压在时间t1上升至第二选通高电压VGH2之后，由于控制信号CS的放电的延迟，控制信号CS的电压在时间t4达到0V。因此，本发明的此实施方式可进一步增加在电源切断时序中包括在节点控制器24中的晶体管的导通状态的持续时间。可使用上述方法以外的另选方法来增加包括在节点控制器24中的晶体管的导通状态的持续时间并且使连接到晶体管的节点上的遗留电荷放电。
图11描绘了示出根据本发明的另一实施方式的电源切断时序的波形图。
如图11中所描绘的，电源单元150可感测输入电压Vin的改变，并且当输入电压Vin下降至等于或小于预定的第一基准电压的值时可开始电源切断时序。电源单元150可在电源切断时间t0开始减小输入电压Vin，并且可在输入电压Vin达到第一基准电压时的时间t1将第一放电控制信号DSC1的电压反相为低逻辑电压。此后，电源单元150可将第一放电控制信号DSC1延迟并且在时间t2将第二放电控制信号DSC2的电压反相为低逻辑电压。
选通低电压VGL和第一选通高电压VGH1可响应于第一放电控制信号DSC1在时间t1开始放电。第二选通高电压VGH2可响应于第二放电控制信号DSC2在时间t2开始放电。结果，由于第二选通高电压VGH2开始放电比第一选通高电压VGH1晚，所以第一选通高电压VGH1在时间t3达到0V，第二选通高电压VGH2在时间t4达到0V。
时钟CLKx在第一周期P1期间在第一选通高电压VGH1与选通低电压VGL之间摇摆。在电源切断时序中，时钟CLKx在时间t0下降至选通低电压VGL，然后在时间t1上升至第一选通高电压VGH1。时钟CLKx在时间t1之后响应于第一选通高电压VGH1放电而放电，并且在时间t3达到0V。负DC电源VSS维持负DC电压(例如，-10V)直至时间t1，并且在时间t1上升至第一选通高电压VGH1。然后，负DC电源VSS放电并且在时间t3达到0V。
控制节点控制器24的控制信号CS可被配置为在第一周期P1期间维持选通低电压VGL，并且在第二周期P2期间可被反相为第二选通高电压VGH2。在电源切断时序中，在控制信号CS的电压在时间t1上升至第二选通高电压VGH2之后，由于控制信号CS的放电的延迟，控制信号CS的电压在时间t4达到0V。因此，本发明的此实施方式可进一步增加在电源切断时序中包括在节点控制器24中的晶体管的导通状态的持续时间。
图12描绘了示出图4中所描绘的级的电路配置的示例的电路图。本发明的此实施方式不限于图12中所描绘的级的电路配置。例如，根据本发明的此实施方式的级可具有任何已知的另选电路配置。
如图12中所描绘的，驱动器22可包括一个上拉晶体管Tpu以及两个下拉晶体管Tpd1和Tpd2。
节点控制器24的第二晶体管T2_1可连接在QB1节点(例如，第二节点N2)与低电位电源线之间，节点控制器24的另一第二晶体管T2_2可连接在QB2节点(例如，另一第二节点N2’)与低电位电源线之间。
驱动器22可包括正向晶体管Tf、反向晶体管Tr以及第十一至第十七晶体管T11至T17。正向晶体管Tf可由于前一级的扫描脉冲而导通。反向晶体管Tr可由于下一级的扫描脉冲而导通。正向电压源V_F的电压可被设定为选通高电压源VDD的选通高电压VGH，反向电压源V_R的电压可被设定为选通低电压源VSS的选通低电压VGL。
第一AC电压Vac1可被生成为在选通高电压VGH与选通低电压VGL之间摇摆的AC电压，但不限于此。在各个帧中第一AC电压Vac1的极性反转。由于驱动器22的配置和驱动方法是已知的，所以描述供应扫描脉冲的处理。
当驱动器22被正向驱动时，前一级的起始信号Vst或扫描脉冲可被供应给Vout(P-2)，正向晶体管Tf和第十七晶体管T17可导通。当正向晶体管Tf导通时，正向电压源V_F的电压可被供应给Q节点。当第十七晶体管T17导通时，选通低电压VGL可被供应给QB1节点。
当正向电压源V_F的电压被供应给Q节点时，上拉晶体管Tpu、第十三晶体管T13和第十六晶体管T16可导通。
当第十三晶体管T13和第十七晶体管T17导通时，选通低电压源VSS的选通低电压VGL可被供应给QB1节点。因此，第一下拉晶体管Tpd1和第十一晶体管T11可截止。另外，由于下一级的QB2节点(未示出)，第二下拉晶体管Tpd2可维持截止状态。
当第十六晶体管T16导通时，选通低电压VGL可被供应给第三节点N3。在这种情况下，由于第一AC电压Vac1被设定为正电压，第十四晶体管T14可导通。因此，在第十六晶体管T16的导通周期期间，选通低电压VGL和第一AC电压Vac1可被同时供应给第三节点N3。
在本文所公开的实施方式中，第十六晶体管T16可被形成为尺寸大于第十四晶体管T14。因此，第三节点N3可维持选通低电压VGL。当第三节点N3被设定为选通低电压VGL时，第十五晶体管T15截止。
当上拉晶体管Tpu导通时，输出端子20接收第一时钟CLK1。在上拉晶体管Tpu的导通周期期间，上拉晶体管Tpu可将作为扫描脉冲的第一时钟CLK1的高电平电压(例如，选通高电压源VDD的选通高电压VGH)供应给输出端子20。
此后，下一级的扫描脉冲可被供应给Vout(P+3)，因此，反向晶体管Tr可导通。当反向晶体管Tr导通时，反向电压源V_R的电压可被供应给Q节点。当反向电压源V_R的电压被供应给Q节点时，上拉晶体管Tpu、第十三晶体管T13和第十六晶体管T16截止。
在这种情况下，由于第一AC电压Vac1被设定为正电压，所以第十四晶体管T14导通。因此，第三节点N3的电压被设定为高电平电压。当第三节点N3的电压被设定为高电平电压时，第十五晶体管T15导通。
当第十五晶体管T15导通时，正的第一AC电压Vac1被供应给QB1节点。当正的第一AC电压Vac1被供应给QB1节点时，第一下拉晶体管Tpd1和第十一晶体管T11导通。
当第十一晶体管T11导通时，选通低电压VGL被供应给Q节点。当第一下拉晶体管Tpd1导通时，选通低电压源VSS的选通低电压VGL被供应给输出端子20。此后，各个级可重复地执行上述处理并且将扫描脉冲供应给扫描线。
控制上拉晶体管Tpu的Q节点、控制两个下拉晶体管Tpd1和Tpd2的QB节点以及用于使输出端子20上的任何遗留电荷放电的节点控制器24的晶体管T1至T3可全部连接。
另外，驱动器22可具有未连接到外部信号线的节点。例如，在图12中所描绘的驱动器22中，第三节点N3不直接连接到外部信号线并且可根据驱动方法临时地处于浮置状态。节点控制器24还可包括连接在可根据驱动器22的操作处于浮置状态的节点与选通低电压源VSS之间的晶体管(例如，第四晶体管T4)。节点控制器24所包括的附加晶体管的数量不受限制，并且可根据可处于浮置状态的驱动器22的节点的数量而变化。
按照与连接到Q节点、QB节点和输出端子的节点控制器24的晶体管T1至T3的操作相同的方式，第四晶体管T4可被配置为响应于控制信号CS而导通和截止。换言之，在没有供应扫描脉冲的第二周期P2期间，第四晶体管T4导通，并且选通低电压VGL被供应给第四晶体管T4。因此，第四晶体管T4被驱动以使得第三节点N3不处于浮置状态。另外，在电源切断时序的处理中，第四晶体管T4可使任何遗留电荷从不直接连接到外部信号线的第三节点N3放电。由于上面描述了节点控制器24的操作处理，所以省略其进一步的描述。
如上所述，本发明的实施方式被配置为使得扫描驱动器的各个级包括节点控制器。该节点控制器将浮置状态的节点控制在特定状态下，并且可使扫描线的电压稳定，而不管噪声如何。
另外，本发明的该实施方式可利用节点控制器使上拉晶体管和下拉晶体管截止达预定时间周期，因此可改进晶体管的寿命和可靠性。本发明的实施方式可在停止供电时利用节点控制器去除任何遗留电荷，从而改进晶体管的寿命。
尽管参照其多个例示性实施方式描述了实施方式，应该理解，本领域技术人员可以想到将落入本公开的原理的范围内的许多其它修改和实施方式。更具体地讲，在本公开、附图和所附权利要求书的范围内，可在组成部件和/或主题组合布置方式方面进行各种变化和修改。除了在组成部件和/或布置方式方面的变化和修改以外，对于本领域技术人员而言，另选使用也将是显而易见的。
相关申请的交叉引用
本申请要求2014年12月2日提交的韩国专利申请No.10-2014-0170605的权益，通过引用将其全部内容整体并入本文。

Claims (19)

1.一种显示装置，该显示装置包括：
显示面板，该显示面板具有多条扫描线；
定时控制器；以及
扫描驱动器，该扫描驱动器包括被配置为针对所述多条扫描线中的每一条生成扫描线信号的多个扫描级，所述多个扫描级中的每一个包括：
上拉晶体管和下拉晶体管，所述上拉晶体管和所述下拉晶体管串联连接并且限定所述多条扫描线中的对应一条的输出节点，
驱动器，该驱动器被配置为在所述上拉晶体管的第一栅极和所述下拉晶体管的第二栅极处生成驱动器控制信号，以及
节点控制器，该节点控制器被配置为根据来自所述定时控制器的控制信号选择性地将基准电压节点与所述第一栅极、所述第二栅极和所述输出节点连接和断开。
2.根据权利要求1所述的显示装置，其中，来自所述定时控制器的所述控制信号被配置为在第一时间周期期间使所述节点控制器中的器件截止以提供所述断开，并且其中，来自所述定时控制器的所述控制信号被配置为在第二时间周期期间使所述器件导通以提供所述连接。
3.根据权利要求2所述的显示装置，其中，所述器件被配置为在所述第二时间周期期间利用延迟使所述第一栅极、所述第二栅极和所述输出节点放电。
4.根据权利要求2所述的显示装置，其中，在所述第二时间周期的起始处，来自所述定时控制器的所述控制信号被反相为使一个或更多个晶体管导通的电压。
5.根据权利要求2所述的显示装置，其中，所述节点控制器中的所述器件包括：
第一晶体管，该第一晶体管串联连接在所述第一栅极与基准电压节点之间；
第二晶体管，该第二晶体管串联连接在所述第二栅极与所述基准电压节点之间；以及
第三晶体管，该第三晶体管串联连接在所述输出节点与所述基准电压节点之间，
其中，所述第一晶体管的栅极、所述第二晶体管的栅极和所述第三晶体管的栅极被设置为从所述定时控制器接收所述控制信号。
6.根据权利要求5所述的显示装置，其中，所述节点控制器中的所述器件还包括串联连接在所述驱动器的一部分与所述基准电压节点之间的至少一个第四晶体管，其中，所述至少一个第四晶体管的所述栅极被设置为从所述定时控制器接收所述控制信号。
7.一种操作显示装置的方法，该方法包括以下步骤：
在定时控制器处生成用于节点控制器的控制信号，该节点控制器被配置为选择性地将基准电压节点与扫描驱动器级的上拉晶体管的第一栅极、所述扫描驱动器级的下拉晶体管的第二栅极和所述扫描驱动器级的输出节点连接和断开，生成所述控制信号的步骤包括以下步骤：
在第一时间周期期间，配置用于将所述基准电压节点与所述第一栅极、所述第二栅极和所述输出节点断开的所述控制信号，以及
在所述第一时间周期之后的第二时间周期期间，配置用于将所述基准电压节点与所述第一栅极、所述第二栅极和所述输出节点连接的所述控制信号。
8.根据权利要求7所述的方法，其中，所述节点控制器包括将所述基准电压节点连接到所述第一栅极、所述第二栅极和所述输出节点中的每一个的一个或更多个晶体管，并且其中，所述第二时间周期期间的配置所述控制信号的步骤包括以下步骤：
在所述第二时间周期的第一部分期间，将所述控制信号反相为用于使所述一个或更多个晶体管导通的电压，以及
在所述第二时间周期的第二部分期间，利用延迟使所述电压放电至基准电压以用于使所述一个或更多个晶体管截止。
9.根据权利要求8所述的方法，其中，所述放电在所述第二时间周期结束之前完成。
10.根据权利要求7所述的方法，该方法还包括以下步骤：
检测对所述显示装置的输入电压的变化；
响应于所述检测将放电信号反相为低逻辑电压；
确定所述放电信号处于所述低逻辑电压；以及
响应于确定所述放电信号处于所述低逻辑电压，使所述扫描驱动器级的多条电压供应线放电。
11.根据权利要求10所述的方法，其中，所述多条电压供应线包括两条或更多条高压供应线，并且其中，所述放电包括按照不同的速率使所述两条或更多条高压供应线放电。
12.根据权利要求10所述的方法，该方法还包括以下步骤：
在所述第一时间周期期间响应于所述检测，将时钟信号设定为所述低逻辑电压；
在所述第二时间周期的开始处将所述时钟信号设定为高逻辑电压；以及
在所述第二时间周期期间使所述时钟信号放电至基准电压。
13.根据权利要求10所述的方法，该方法还包括以下步骤：
在所述第二时间周期的开始处将基准电压节点设定为高逻辑电压；
在所述第二时间周期期间使所述基准电压节点放电至所述基准电压。
14.一种显示装置，该显示装置包括：
移位寄存器，该移位寄存器包括被配置为使多条扫描线的扫描脉冲移位并输出的多个级，其中，所述多个级中的每一个包括：
上拉晶体管和下拉晶体管，所述上拉晶体管和所述下拉晶体管串联连接并且在所述上拉晶体管和所述下拉晶体管之间限定输出节点；
驱动器，该驱动器具有连接至所述上拉晶体管的栅极的第一节点以及连接至所述下拉晶体管的栅极的第二节点；以及
节点控制器，该节点控制器连接至所述第一节点、所述第二节点和所述输出节点，
其中，所述上拉晶体管被配置为响应于所述驱动器在所述第一节点处供应导通电压，在所述输出节点处供应高逻辑电压，其中，所述下拉晶体管被配置为响应于所述驱动器在所述第二节点处供应导通电压，在所述输出节点处供应低逻辑电压，并且其中，所述节点控制器被配置为响应于控制信号在所述第一节点和所述第二节点处选择性地施加基准电压。
15.根据权利要求14所述的显示装置，其中，所述节点控制器包括连接在所述第一节点与基准电压源之间的第一晶体管、连接在所述第二节点与所述基准电压源之间的第二晶体管以及连接在输出端子与所述基准电压源之间的第三晶体管。
16.根据权利要求15所述的显示装置，其中，所述导通电压介于高逻辑电压与所述低逻辑电压之间并且大于所述第一晶体管、所述第二晶体管和所述第三晶体管中的每一个的阈值电压。
17.根据权利要求15所述的显示装置，其中，所述节点控制器还包括串联连接在所述驱动器的内部节点与所述基准电压源之间的至少一个第四晶体管。
18.根据权利要求14所述的显示装置，该显示装置还包括用于生成所述控制信号的定时控制器。
19.根据权利要求18所述的显示装置，其中，所述定时控制器被配置为生成所述控制信号以具有延迟。
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