CN103094242A - 嵌埋电容组件的封装基板及其制法 - Google Patents

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Abstract

一种嵌埋电容组件的封装基板及其制法，该封装基板包括：具有芯层、开口及线路层的本体、置于该开口中的第一电容组件；形成于该第一电容组件上的结合层、置于该结合层上的第二电容组件、以及设于该本体及该开口上以覆盖该第一及第二电容组件的介电层。借由结合层将第一及第二电容组件堆栈于本体的开口中，使单一层的芯层中嵌埋两层的电容组件，以达到多功能的需求。

Description

嵌埋电容组件的封装基板及其制法
技术领域
本发明有关一种封装基板及其制法，尤指一种嵌埋电容组件的封装基板及其制法。
背景技术
随着半导体封装技术的演进，半导体装置(Semiconductor device)已开发出不同的封装型态，而为降低封装高度以满足产品微小化(或薄化)的需求，于是提供一具有开口的封装基板中，再将半导体组件嵌埋于该开口中，而此种封装件不仅能缩减整体半导体装置的体积，且能提升电性功能，因此成为一种封装的趋势。
请参阅图1A至图1D，其为现有嵌埋电容组件的封装基板1的制法。如图1A所示，提供一本体1a，该本体1a包含具有相对的第一表面10a与第二表面10b的芯层10、连通该第一及第二表面10a，10b的开口100、及形成于该第一及第二表面10a，10b上的线路层101，且该芯层10中还具有导电通孔102，以电性连接该第一及第二表面10a，10b上的线路层101。
接着，将一电容组件11置于该开口100中，且该电容组件11的左、右两端具有电极垫110a，110b。
如图1B所示，于芯层10的第一表面10a、该电容组件11上侧及开口100的部分壁面上形成第一介电材14a。
如图1C所示，压合第二介电材(图未示)于该芯层10的第二表面10b、该电容组件11下侧及该开口100上，以令该第二介电材与该第一介电材14a合成为介电层14，以固定该电容组件11。
如图1D所示，于该介电层14上形成电性连通该电容组件11的线路增层结构16，且该线路增层结构16具有增层介电层160、设于该增层介电层160上的增层线路层161、及形成于该增层介电层160中的导电盲孔162，以借由该导电盲孔162电性连接各该增层线路层161、该线路层101及电容组件11的电极垫110a，110b。
接着，于该线路增层结构16上形成绝缘保护层17，该绝缘保护层17具有多个开孔170，以外露该线路增层结构16的部分表面。
然而，现有嵌埋电容组件的封装基板1的制法中，嵌埋电容组件11的数量与密度受限于芯层10面积与线路层101及增层线路层161的设计，所以一层芯层10内仅能嵌埋一层的电容组件11，导致封装基板1的功能受限，难以达到多功能的需求。
此外，若为达到多功能的需求，往往需堆栈另一嵌埋电容组件的封装基板，因而增加整体结构的高度，导致无法满足产品微小化(或薄化)的需求。
因此，如何克服上述现有技术中的种种问题，实已成目前亟欲解决的课题。
发明内容
鉴于上述现有技术的种种缺陷，本发明提供一种嵌埋电容组件的封装基板及其制法，使单一层的芯层中嵌埋两层的电容组件，以达到多功能的需求。
本发明所揭示的嵌埋电容组件的封装基板包括：本体，其包含芯层、贯穿该芯层的开口及形成于该芯层表面上的线路层；第一电容组件，其置于该开口中，且该第一电容组件的相对两端具有第一电极垫；结合层，其形成于该开口中的第一电容组件上；第二电容组件，其置于该结合层上，与该第一电容组件收纳于该开口中，且该第二电容组件的相对两端具有第二电极垫；以及介电层，其设于该本体及该开口上，以覆盖该第一电容组件及第二电容组件。
本发明还提供一种嵌埋电容组件的封装基板的制法，其包括：提供一本体，该本体包含芯层、设于该芯层上的开口及形成于该芯层表面上的线路层；将第一电容组件置于该开口中；于该第一电容组件上形成结合层；将第二电容组件置于该结合层上，使该第一及第二电容组件收纳于该开口中；以及于该本体及该开口上形成介电层，以覆盖该第一电容组件及第二电容组件。
由上可知，本发明的嵌埋电容组件的封装基板及其制法，借由结合层将第一及第二电容组件堆栈于一本体的开口中，使单一层的芯层中嵌埋两层的电容组件，以增加封装基板对嵌埋电容组件的组合性与选择性的功能，以可达到多功能的需求。
此外，相比于现有技术，本发明因无需再堆栈另一嵌埋电容组件的封装基板，即可达到多功能的需求，所以本发明可降低整体结构的高度，因而有效满足产品微小化(或薄化)的需求。
附图说明
图1A至图1D为现有嵌埋电容组件的封装基板的制法的剖视示意图；以及
图2A至图2G为本发明嵌埋电容组件的封装基板的制法的剖视示意图；其中，图2F’为图2F的另一实施例。
主要组件符号说明
1，2               封装基板
1a，2a             本体
10，20             芯层
10a，20a           第一表面
10b，20b           第二表面
100，200           开口
101，201a，201b    线路层
102，202           导电通孔
11                 电容组件
110a，110b         电极垫
14，24，24’       介电层
14a，24a           第一介电材
16，26a，26b       线路增层结构
160，260           增层介电层
161，261           增层线路层
162，262           导电盲孔
17，27             绝缘保护层
170，270           开孔
21                 第一电容组件
21a，23a           上侧
21b，23b           下侧
210a，210b         第一电极垫
22                 结合层
23                 第二电容组件
230a，230b         第二电极垫
25                 粘着材
261a，261b         表面
29                 承载件。
具体实施方式
以下借由特定的具体实施例说明本发明的实施方式，本领域技术人员可由本说明书所揭示的内容轻易地了解本发明的其它优点及功效。
须知，本说明书所附图式所绘示的结构、比例、大小等，均仅用以配合说明书所揭示的内容，以供本领域技术人员的了解与阅读，并非用以限定本发明可实施的限定条件，所以不具技术上的实质意义，任何结构的修饰、比例关系的改变或大小的调整，在不影响本发明所能产生的功效及所能达成的目的下，均应仍落在本发明所揭示的技术内容得能涵盖的范围内。同时，本说明书中所引用的如“上”、“下”、“左”、“右”及“一”等用语，也仅为便于叙述的明了，而非用以限定本发明可实施的范围，其相对关系的改变或调整，在无实质变更技术内容下，也当视为本发明可实施的范畴。
请参阅图2A至图2G，其为本发明嵌埋电容组件的封装基板2的制法的剖视示意图。
如图2A所示，提供一本体2a，该本体2a包含具有相对的第一表面20a与第二表面20b的芯层20、连通该第一及第二表面20a，20b的开200、及形成于该第一及第二表面20a，20b上的线路层201a，201b，且该芯层20中还具有导电通孔202，以电性连接该第一及第二表面20a，20b上的线路层201a，201b。
接着，于该芯层20的第二表面20b上结合一承载件29，以封盖该开口200的一侧，再将一具有上、下侧21a，21b的第一电容组件21置于该开口200中，使该第一电容组件21的下侧21b结合于该承载件29上。于本实施例中，该第一电容组件21的左、右两端具有第一电极垫210a，210b，且该第一电极垫210a，210b由上侧21a延伸至下侧21b，但有关第一电容组件的结构并无特别限制，特此述明。
如图2B所示，于该第一电容组件21的全部上侧21a上形成结合层22。于本实施例中，该结合层22为介电材或绝缘材。
如图2C所示，将一具有上、下侧23a，23b的第二电容组件23以其下侧23b置于该结合层22上，使该第一及第二电容组件21，23收纳于该开口200中。于本实施例中，该第二电容组件23的左、右两端具有第二电极垫230a，230b，且该第二电极垫230a，230b由上侧23a延伸至下侧23b，但有关第二电容组件的结构并无特别限制，特此述明。
如图2D所示，于该第二电容组件23位于该开口200端的一侧形成第一介电材24a。于本实施例中，该第一介电材24a覆盖该芯层20的第一表面20a、线路层201a及第二电容组件23的上侧23a，且该第一介电材24a延伸于该开口200的部分壁面与该第二电容组件23的左、右侧面之间、及该开口200的部分壁面与该结合层22的左、右部分侧面之间。
如图2E所示，移除该承载件29，以令该芯层20的第二表面20b、该第一电容组件21的下侧21b及其上的第一电极垫210a，210b外露出该开口200。
如图2F所示，压合第二介电材(图未示)于该芯层20的第二表面20b、该第一电容组件21位于该开口200端的一侧(如图所示的下侧21b)及该开口200上，使该第二介电材与该第一介电材24a合成为介电层24，以固定该第一及第二电容组件21，23。
所述的介电层24形成于该芯层20的第一及第二表面20a，20b上，以覆盖该第一电容组件21及第二电容组件23，且延伸于该开口200壁面与该第一电容组件21之间、该开口200壁面与该第二电容组件23之间、及该开口200壁面与该结合层22之间。
于另一实施例中，如图2F’所示，也可先形成粘着材25于该第一电容组件21与该开口200壁面之间、该结合层22与该开口200壁面之间、及该第二电容组件23与该开口200壁面之间，以固定该第一及第二电容组件21，23，再于该芯层20的第一及第二表面20a，20b、该第一电容组件21的下侧21b、及该第二电容组件23的上侧23a上形成该介电层24’。
于该封装基板2的后续工艺中，可如图2G所示，其为接续图2F工艺，于该介电层24上(如图所示的芯层20的第一及第二表面20a，20b上方)形成线路增层结构26a，26b，且该第一电容组件21及第二电容组件23均与该线路增层结构26a，26b电性连通。于本实施例中，该线路增层结构26a，26b具有增层介电层260、设于该增层介电层260上的增层线路层261、及形成于该增层介电层260中的导电盲孔262，以借由该导电盲孔262电性连接各该增层线路层261，且部分的导电盲孔262电性连接该线路层201a，201b、该第一电容组件21的第一电极垫210a，210b及第二电容组件23的第二电极垫230a，230b。
接着，于该线路增层结构26a，26b上形成绝缘保护层27，该绝缘保护层27具有多个开孔270，以外露该线路增层结构26a，26b的最外层的增层线路层261的部分表面261a，261b。
本发明通过将第一及第二电容组件21，23借由结合层22以相堆栈收纳于该开口200中，使单一层的芯层20中可嵌埋两层的电容组件，不仅可增加嵌埋电容组件的组合性与选择性的功能，且可避免嵌埋电容组件的数量与密度受限于芯层20面积与线路层及增层线路层的设计。
此外，本发明的制法因可于该开口200中堆栈收纳多个电容组件，而无需再堆栈另一嵌埋电容组件的封装基板，即可达到多功能的需求，所以有效降低整体结构的高度。
再者，若该结合层22为介电材，可与该介电层24合成为一体，以具有较佳的结合力，而可更佳地固定该第一及第二电容组件21，23，进而提升产品的可靠度
本发明还提供一种嵌埋电容组件的封装基板2，其包括：具有芯层20、开口200及线路层201a，201b的本体2a、置于该开口200中的第一电容组件21、形成于该第一电容组件21上的结合层22、置于该结合层22上的第二电容组件23、以及设于该本体2a及该开口200上的介电层24，24’。
所述的本体2a中，该芯层20具有相对的第一表面20a与第二表面20b，且该开口200连通该第一及第二表面20a，20b，此外该芯层20中还具有导电通孔202，以电性连接该线路层201a，201b。
所述的第一电容组件21收纳于该开口200中，且其左、右两端具有第一电极垫210a，210b。
所述的结合层22仅位于该开口200中，且形成该结合层22的材料为介电材或绝缘材。
所述的第二电容组件23收纳于该开口200中，且其左、右两端具有第二电极垫230a，230b。
所述的介电层24，24’设于该芯层20的第一及第二表面20a，20b与线路层201a，201b上，以覆盖该第一电容组件21及第二电容组件23。于一实施例中，该介电层24还设于该第一电容组件21与该开口200壁面之间、及该第二电容组件23与该开口200壁面之间，以固定该第一及第二电容组件21，23。于另一实施例中，以粘着材25形成于该第一电容组件21与该开口200壁面之间、及该第二电容组件23与该开口200壁面之间，以固定该第一及第二电容组件21，23。
所述的封装基板2还包括设于该介电层24上的线路增层结构26a，26b、及设于该线路增层结构26a，26b上的绝缘保护层27，该第一及第二电容组件21，23均与该线路增层结构26电性连通，且该绝缘保护层27具有多个开孔270，以外露该线路增层结构26a，26b的部分表面261a，261b。
综上所述，本发明的嵌埋电容组件的封装基板及其制法，借由结合层将两个电容组件收纳于一本体的开口中，使单一层的芯层中嵌埋两层的电容组件，以达到多功能的需求。
此外，本发明因无需再堆栈另一嵌埋电容组件的封装基板，即可达到多功能的需求，所以有效降低整体结构的高度，以满足产品微小化(或薄化)的需求。
上述实施例仅用以例示性说明本发明的原理及其功效，而非用于限制本发明。任何本领域技术人员均可在不违背本发明的精神及范畴下，对上述实施例进行修改。因此本发明的权利保护范围，应如权利要求书所列。

Claims (19)

1.一种嵌埋电容组件的封装基板，其包括：
本体，其包含芯层、贯穿该芯层的开口及形成于该芯层表面上的线路层；
第一电容组件，其置于该开口中，且该第一电容组件的相对两端具有第一电极垫；
结合层，其形成于该开口中的第一电容组件上；
第二电容组件，其置于该结合层上，与该第一电容组件收纳于该开口中，且该第二电容组件的相对两端具有第二电极垫；以及
介电层，其设于该本体及该开口上，以覆盖该第一电容组件及第二电容组件。
2.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该芯层中还形成有导电通孔，以电性连接该线路层。
3.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该芯层还具有相对的第一表面与第二表面，且该开口连通该第一及第二表面。
4.根据权利要求3所述的嵌埋电容组件的封装基板，其特征在于，该介电层设于该芯层的第一及第二表面上。
5.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该结合层的材料为介电材或绝缘材。
6.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该介电层还设于该第一电容组件与该开口壁面之间、及该第二电容组件与该开口壁面之间，以固定该第一及第二电容组件。
7.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该封装基板还包括粘着材，其形成于该第一电容组件与该开口壁面之间、及该第二电容组件与该开口壁面之间，以固定该第一及第二电容组件。
8.根据权利要求1所述的嵌埋电容组件的封装基板，其特征在于，该封装基板还包括设于该介电层上的线路增层结构，且该第一电容组件及第二电容组件均与该线路增层结构电性连通。
9.根据权利要求8所述的嵌埋电容组件的封装基板，其特征在于，该封装基板还包括设于该线路增层结构上的绝缘保护层，该绝缘保护层具有多个开孔，以外露该线路增层结构的部分表面。
10.一种嵌埋电容组件的封装基板的制法，其包括：
提供一本体，该本体包含芯层、贯穿该芯层的开口及形成于该芯层表面上的线路层；
将第一电容组件置于该开口中；
于该第一电容组件上形成结合层；
将第二电容组件置于该结合层上，使该第一及第二电容组件收纳于该开口中；以及
于该本体及该开口上形成介电层，以覆盖该第一电容组件及第二电容组件。
11.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，该芯层中还形成有导电通孔，以电性连接该线路层。
12.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，该芯层还具有相对的第一表面与第二表面，且该开口连通该第一及第二表面。
13.根据权利要求12所述的嵌埋电容组件的封装基板的制法，其特征在于，该介电层压合于该芯层的第一及第二表面上。
14.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，形成该结合层的材料为介电材或绝缘材。
15.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，该介电层还形成于该第一电容组件与该开口壁面之间、及第二电容组件与该开口壁面之间，以固定该第一及第二电容组件。
16.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，该制法还包括于形成该介电层之前，形成粘着材于该第一电容组件与该开口壁面之间、及第二电容组件与该开口壁面之间，以固定该第一及第二电容组件。
17.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于还包括于该介电层上形成线路增层结构，且该第一电容组件及第二电容组件均与该线路增层结构电性连通。
18.根据权利要求17所述的嵌埋电容组件的封装基板的制法，其特征在于，该制法还包括于该线路增层结构上形成绝缘保护层，该绝缘保护层具有多个开孔，以外露该线路增层结构的部分表面。
19.根据权利要求10所述的嵌埋电容组件的封装基板的制法，其特征在于，形成该介电层的工艺包括：
于该第一电容组件位于该开口端的一侧结合承载件；
于该第二电容组件位于该开口端的一侧形成第一介电材；
移除该承载件；以及
于该本体、该第一电容组件位于该开口端的一侧、及该开口上形成第二介电材，以与该第一介电材形成该介电层。
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