WO2016165184A1 - 双栅极氧化物半导体tft基板的制作方法及其结构 - Google Patents
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Definitions
- the existing method for fabricating a dual-gate oxide semiconductor TFT substrate suitable for an OLED mainly includes the following steps:
- Step 1 as shown in FIG. 1 , a substrate 100 is provided, a first metal layer is deposited on the substrate 100, and the first metal layer is patterned by a first mask process to form a first bottom gate 210 and a bottom gate 220; a bottom gate insulating layer 310 is deposited on the first bottom gate 210, the second bottom gate 220, and the substrate 100;
- Step 9 As shown in FIG. 9, a first flat layer is deposited on the red/green/blue resist layer 900, and the first flat layer is patterned by the eleventh mask process to form the first flat layer 1000. ;
- Step 11 As shown in FIG. 11, a second flat layer is deposited on the first flat layer 1000 and the anode 1100, and the second flat layer is patterned by the thirteenth mask process to form the second flat layer 1200.
- Two side regions of the first oxide semiconductor layer and two side regions of the second oxide semiconductor layer are ion-doped conductor layers;
- the top gate insulating layer corresponds to both sides of the first oxide semiconductor layer a first via hole is respectively disposed on the upper side of the second oxide semiconductor layer, and a second via hole is disposed on the upper side of the second oxide semiconductor layer, and a third via hole is disposed above the oxide conductor layer;
- the gate insulating layer and the top gate insulating layer are provided with a fourth via hole corresponding to the first bottom gate and the second bottom gate;
- the top gate insulating layer, the passivation layer, and the second planar layer correspond to the oxidation a fifth via hole is disposed above the conductor layer;
- FIG. 6 is a schematic diagram of a conventional step 6 of a method for fabricating a dual gate oxide semiconductor TFT substrate suitable for an OLED;
- step 5 is a schematic diagram of step 5 of a method for fabricating a dual gate oxide semiconductor TFT substrate according to the present invention.
- the material of the first flat layer 4 is an organic photoresist for covering and protecting the red/green/blue resist layer 3.
- Plasma treatment of the bottom gate insulating layer 31 improves the film quality of the bottom gate insulating layer 31.
- Step 7 as shown in FIG. 19, the first top gate 71, the first source 81, the first drain 82, the second top gate 72, the second source 83, and the second drain 84, And deposition on the top gate insulating layer 32 Passivation layer 8.
Landscapes
- Thin Film Transistor (AREA)
- Electroluminescent Light Sources (AREA)
Abstract
一种双栅极氧化物半导体TFT基板的制作方法及其结构,双栅极氧化物半导体TFT基板的制作方法使用半色调掩膜板进行一道光罩制程既能够完成氧化物半导体层的图案化,又能够通过离子掺杂得到氧化物导体层(53');通过一道光罩制程同时对底栅绝缘层(31)与顶栅绝缘层(32)进行图案化处理;通过一道光罩制程同时对第二、第三金属层进行图案化处理,得到第一源极(81)、第一漏极(82)、第二源极(83)、第二漏极(84)、第一顶栅极(71)、及第二顶栅极(72);通过一道光罩制程同时对第二平坦层(9)、钝化层(8)、及顶栅绝缘层(32)进行图案化处理,光罩制程减少至九道,有效简化了制程,提高了生产效率,降低了生产成本。
Description
本发明涉及显示技术领域,尤其涉及一种适用于OLED的双栅极氧化物半导体TFT基板的制作方法及其结构。
平面显示装置具有机身薄、省电、无辐射等众多优点,得到了广泛的应用。现有的平面显示装置主要包括液晶显示装置(Liquid Crystal Display,LCD)及有机发光二极管显示装置(Organic Light Emitting Display,OLED)。
目前,在有源阵列平面显示装置中,TFT基板通常采用单栅极氧化物半导体薄膜晶体管(Single-Gate TFT)。双栅极氧化物半导体薄膜晶体管(Dual-Gate)相比单栅极氧化物半导体薄膜晶体管具有更优的性能,如电子迁移率更高,开态电流较大、亚阈值摆幅更小、阈值电压的稳定性及均匀性更好、栅极偏压及照光稳定性更好等。在OLED显示装置中,阈值电压的重要性尤为突出,稳定、均匀的阈值电压能够使OLED的显示亮度较均匀,显示品质较高。
在OLED的制程中,为了降低制作难度以及避免有机发光材料色度与亮度的恶化不均,通常采用白色有机发光二级管搭配彩色滤光片(Color Filter,CF)的显示方法。白光OLED显示装置中的彩色滤光片主要在TFT基板的阵列制程中完成,即采用彩色滤光片制备于阵列基板(Color Filter On Array,COA)技术。
现有的适用于OLED的双栅极氧化物半导体TFT基板的制作方法主要包括如下步骤:
步骤1、如图1所示,提供基板100,在基板100上沉积第一金属层,通过第一道光罩制程对第一金属层进行图案化处理,形成第一底栅极210、及第二底栅极220;在第一底栅极210、第二底栅极220、及基板100上沉积底栅绝缘层310;
步骤2、如图2所示,通过第二道光罩制程对底栅绝缘层310进行图案化处理,以暴露出部分第一底栅极210;
步骤3、如图3所示,在底栅绝缘层310上沉积氧化物半导体层,通过第三道光罩制程对氧化物半导体层进行图案化处理,得到分别位于第一底栅极210、第二底栅极220上方的第一氧化物半导体层410、及第二氧化物
半导体层420;
步骤4、如图4所示,在第一氧化物半导体层410、第二氧化物半导体层420、及底栅绝缘层310上沉积刻蚀阻挡层,通过第四道光罩制程对刻蚀阻挡层进行图案化处理,形成刻蚀阻挡层500;
步骤5、如图5所示,在刻蚀阻挡层500上沉积第二金属层,通过第五道光罩制程对第二金属层进行图案化处理,形成第一源极610、第一漏极620、第二源极630、第二漏极640;第二源极630与第一底栅极210相接触;
步骤6、如图6所示,在第一源极610、第一漏极620、第二源极630、第二漏极640、及刻蚀阻挡层500上沉积钝化层,通过第六道光罩制程对钝化层进行图案化处理,形成钝化层700,在第一源极610上方形成过孔720;
步骤7、如图7所示,在钝化层700上沉积第三金属层,通过第七道光罩制程对第三金属层进行图案化处理,形成第一顶栅极810、及第二顶栅极820;
步骤8、如图8所示,在第一顶栅极810、及第二顶栅极820、及钝化层700上沉积色阻层,通过第八、第九、第十道光罩制程对色阻层进行图案化处理,形成红/绿/蓝色阻层900;
步骤9、如图9所示,在红/绿/蓝色阻层900上沉积第一平坦层,通过第十一道光罩制程对第一平坦层进行图案化处理,形成第一平坦层1000;
步骤10、如图10所示,在第一平坦层1000上沉积ITO层,通过第十二道光罩制程对ITO层进行图案化处理,形成阳极1100,阳极1100经由过孔720与第一源极610相接触;
步骤11、如图11所示,在第一平坦层1000、及阳极1100上沉积第二平坦层,通过第十三道光罩制程对第二平坦层进行图案化处理,形成第二平坦层1200。
上述适用于OLED的氧化物半导体TFT基板的制程中共需要十三道光罩制程,制程较为繁琐,生产效率较低,制程成本较高。
发明内容
本发明的目的在于提供一种适用于OLED的双栅极氧化物半导体TFT基板的制作方法,制程简单,能够减少光罩制程的次数,提高生产效率,降低生产成本。
本发明的另一目的在于提供一种适用于OLED的双栅极氧化物半导体TFT基板结构,结构简单,能够减少光罩制程的次数,有效简化制程,且
生产效率高,生产成本低。
为实现上述目的,本发明首先提供一种双栅极氧化物半导体TFT基板的制作方法,包括如下步骤:
步骤1、提供基板,在所述基板上沉积第一金属层,通过第一道光罩制程对所述第一金属层进行图案化处理,形成第一底栅极、及第二底栅极;在所述第一底栅极、第二底栅极、及基板上沉积底栅绝缘层;
步骤2、在所述底栅绝缘层上沉积色阻层,分别通过第二、第三、第四道光罩制程依次对所述色阻层进行图案化处理,形成红/绿/蓝色阻层;接着在所述红/绿/蓝色阻层上沉积第一平坦层,并通过第五道光罩制程对所述第一平坦层进行图案化处理,形成分别覆盖所述红/绿/蓝色阻层的第一平坦层;对所述底栅绝缘层进行等离子处理;
步骤3、在所述底栅绝缘层、及第一平坦层上沉积氧化物半导体层,在所述氧化物半导体层上涂覆光阻层,并使用半色调掩膜板进行第六道光罩制程:先对所述光阻层进行曝光、显影,得到分别位于所述第一底栅极、第二底栅极、及第一平坦层上方覆盖所述氧化物半导体层的第一光阻层、第二光阻层、及第三光阻层;所述第一光阻层的两侧区域、第二光阻层的两侧区域、及第三光阻层的厚度小于所述第一光阻层的中间区域、及第二光阻层的中间区域的厚度;
再利用所述第一光阻层、第二光阻层、及第三光阻层对所述氧化物半导体层进行刻蚀,使所述氧化物半导体层图案化,得到分别位于所述第一底栅极、第二底栅极、及第一平坦层上方的第一氧化物半导体层、第二氧化物半导体层、及第三氧化物半导体层;
步骤4、去除所述第一光阻层的两侧区域、第二光阻层的两侧区域、及第三光阻层;以余下的第一光阻层的中间区域、及第二光阻层的中间区域为遮蔽层,对所述第一氧化物半导体层的两侧区域、第二氧化物半导体层的两侧区域、及第三氧化物半导体层进行离子掺杂,使所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域转变为导体,使所述第三氧化物半导体层转变为氧化物导体层;之后去除余下的第一光阻层的中间区域、及第二光阻层的中间区域;
步骤5、在所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上沉积顶栅绝缘层,通过第七道光罩制程同时对所述顶栅绝缘层与底栅绝缘层进行图案化处理,形成分别位于所述第一氧化物半导体层的两侧区域上方的第一过孔、位于所述第二氧化物半导体层的两侧区域上方的第二过孔、位于所述氧化物导体层上方的第三过孔、及位于
所述第一底栅极与第二底栅极之间暴露出所述第二底栅极一侧的第四过孔;
步骤6、在所述顶栅绝缘层上沉积第二、第三金属层,通过第八道光罩制程对所述第二、第三金属层进行图案化处理,分别得到位于所述第一氧化物半导体层上方的第一顶栅极、位于所述第一顶栅极两侧的第一源极与第一漏极、位于所述第二氧化物半导体层上方的第二顶栅极、位于所述第二顶栅极两侧的第二源极与第二漏极;
所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层的两侧区域相接触,所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触,所述第一源极经由所述第三过孔与所述氧化物导体层相接触,所述第二源极经由所述第四过孔与所述第一底栅极相接触;
步骤7、在所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、及顶栅绝缘层上沉积钝化层;
步骤8、在所述钝化层上沉积第二平坦层,通过第九道光罩制程对所述第二平坦层、钝化层、及顶栅绝缘层同时进行图案化处理,得到位于所述氧化物导体层上方的第五过孔,以暴露出部分氧化物导体层,定义出发光层的形状;
所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅极、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体层构成OLED的阳极。
所述步骤3采用物理气相沉积法沉积所述氧化物半导体层。
所述步骤5采用干法刻蚀对所述顶栅绝缘层与底栅绝缘层同时进行图案化处理。
所述氧化物半导体层的材料为IGZO。
所述第一平坦层、及第二平坦层的材料为有机光阻。
所述第一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合。
本发明还提供一种双栅极氧化物半导体TFT基板结构,包括基板、设于所述基板上的第一底栅极与第二底栅极、设于所述基板、第一底栅极、
及第二底栅极上的底栅绝缘层、设于所述底栅绝缘层上的红/绿/蓝色阻层、分别设于所述红/绿/蓝色阻层上的第一平坦层、分别位于所述第一底栅极、及第二底栅极上方设于所述底栅绝缘层上的第一氧化物半导体层、及第二氧化物半导体层、设于所述第一平坦层上的氧化物导体层、设于所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上的顶栅绝缘层、位于所述第一氧化物半导体层上方设于所述顶栅绝缘层上的第一顶栅极、分别位于所述第一顶栅极两侧设于所述顶栅绝缘层上的第一源极、及第一漏极、位于所述第二氧化物半导体层上方设于所述顶栅绝缘层上的第二顶栅极、分别位于所述第二顶栅极两侧设于所述顶栅绝缘层上的第二源极、及第二漏极、设于所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、与顶栅绝缘层上的钝化层、及设于钝化层上的第二平坦层;
所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域为离子掺杂的导体层;所述顶栅绝缘层对应所述第一氧化物半导体层两侧区域的上方分别设有第一过孔,对应所述第二氧化物半导体层两侧区域的上方分别设有第二过孔,对应所述氧化物导体层上方设有第三过孔;所述底栅绝缘层、及顶栅绝缘层对应第一底栅极与第二底栅极之间设有第四过孔,所述顶栅绝缘层、钝化层、及第二平坦层对应所述氧化物导体层上方设有第五过孔;
所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层的两侧区域相接触;所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触;所述第一源极经由所述第三过孔与所述氧化物导体层相接触;所述第二源极经由所述第四过孔与所述第一底栅极相接触;所述第五过孔暴露出部分氧化物导体层;
所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体层构成OLED的阳极。
所述第一氧化物半导体层、及第二氧化物半导体层的材料为IGZO,所述氧化物导体层为IGZO半导体层进行离子掺杂制得。
所述第一平坦层、及第二平坦层的材料为有机光阻;所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合;所述第一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
本发明还提供一种双栅极氧化物半导体TFT基板结构,包括基板、设于所述基板上的第一底栅极与第二底栅极、设于所述基板、第一底栅极、及第二底栅极上的底栅绝缘层、设于所述底栅绝缘层上的红/绿/蓝色阻层、分别设于所述红/绿/蓝色阻层上的第一平坦层、分别位于所述第一底栅极、及第二底栅极上方设于所述底栅绝缘层上的第一氧化物半导体层、及第二氧化物半导体层、设于所述第一平坦层上的氧化物导体层、设于所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上的顶栅绝缘层、位于所述第一氧化物半导体层上方设于所述顶栅绝缘层上的第一顶栅极、分别位于所述第一顶栅极两侧设于所述顶栅绝缘层上的第一源极、及第一漏极、位于所述第二氧化物半导体层上方设于所述顶栅绝缘层上的第二顶栅极、分别位于所述第二顶栅极两侧设于所述顶栅绝缘层上的第二源极、及第二漏极、设于所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、与顶栅绝缘层上的钝化层、及设于钝化层上的第二平坦层;
所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域为离子掺杂的导体层;所述顶栅绝缘层对应所述第一氧化物半导体层两侧区域的上方分别设有第一过孔,对应所述第二氧化物半导体层两侧区域的上方分别设有第二过孔,对应所述氧化物导体层上方设有第三过孔;所述底栅绝缘层、及顶栅绝缘层对应第一底栅极与第二底栅极之间设有第四过孔;所述顶栅绝缘层、钝化层、及第二平坦层对应所述氧化物导体层上方设有第五过孔;
所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层两侧区域相接触;所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触;所述第一源极经由所述第三过孔与所述氧化物导体层相接触;所述第二源极经由所述第四过孔与所述第一底栅极相接触;所述第五过孔暴露出部分氧化物导体层;
所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体层构成OLED的阳极;
其中,所述第一氧化物半导体层、及第二氧化物半导体层的材料为IGZO,所述氧化物导体层为IGZO半导体层进行离子掺杂制得;
其中,所述第一平坦层、及第二平坦层的材料为有机光阻;所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合;所述第
一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
本发明的有益效果:本发明提供的一种双栅极氧化物半导体TFT基板的制作方法,使用半色调掩膜板进行一道光罩制程既能够完成氧化物半导体层的图案化,又能够通过离子掺杂得到氧化物导体层,该氧化物导体层作为OLED的阳极替代现有技术中的ITO阳极;通过一道光罩制程同时对底栅绝缘层与顶栅绝缘层进行图案化处理;通过一道光罩制程同时对第二、第三金属层进行图案化处理,得到第一源极、第一漏极、第二源极、第二漏极、第一顶栅极、及第二顶栅极;通过一道光罩制程同时对第二平坦层、钝化层、及顶栅绝缘层进行图案化处理,光罩制程减少至九道,有效简化了制程,提高了生产效率,降低了生产成本。本发明提供的一种双栅极氧化物半导体TFT基板结构,通过设置氧化物导体层来作为OLED的阳极,并将第一源极、第一漏极、第二源极、第二漏极、第一顶栅极、及第二顶栅极均设置于顶栅绝缘层上,使得TFT基板的结构简单,易于制作,能够减少光罩制程的数量,有效简化制程,提高生产效率,且生产成本低。
为了能更进一步了解本发明的特征以及技术内容,请参阅以下有关本发明的详细说明与附图,然而附图仅提供参考与说明用,并非用来对本发明加以限制。
附图中,
图1为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤1的示意图;
图2为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤2的示意图;
图3为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤3的示意图;
图4为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤4的示意图;
图5为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤5的示意图;
图6为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤6的示意图;
图7为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤7的示意图;
图8为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤8的示意图;
图9为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤9的示意图;
图10为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤10的示意图;
图11为现有的适用于OLED的双栅极氧化物半导体TFT基板制作方法的步骤11的示意图;
图12为本发明双栅极氧化物半导体TFT基板的制作方法的流程图;
图13为本发明双栅极氧化物半导体TFT基板的制作方法的步骤1的示意图;
图14为本发明双栅极氧化物半导体TFT基板的制作方法的步骤2的示意图;
图15为本发明双栅极氧化物半导体TFT基板的制作方法的步骤3的示意图;
图16为本发明双栅极氧化物半导体TFT基板的制作方法的步骤4的示意图;
图17为本发明双栅极氧化物半导体TFT基板的制作方法的步骤5的示意图;
图18为本发明双栅极氧化物半导体TFT基板的制作方法的步骤6的示意图;
图19为本发明双栅极氧化物半导体TFT基板的制作方法的步骤7的示意图;
图20为本发明双栅极氧化物半导体TFT基板的制作方法的步骤8的示意图暨本发明双栅极氧化物半导体TFT基板结构的剖面示意图。
为更进一步阐述本发明所采取的技术手段及其效果,以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图12,本发明首先提供一种适用于OLED的双栅极氧化物半导体TFT基板的制作方法,包括如下步骤:
步骤1、如图13所示,提供基板1,在所述基板1上沉积第一金属层,
通过第一道光罩制程对所述第一金属层进行图案化处理,形成第一底栅极21、及第二底栅极22;在所述第一底栅极21、第二底栅极22、及基板1上沉积底栅绝缘层31。
具体地,所述基板1为透明基板,优选地,所述基板1为玻璃基板。所述第一金属层的材料为钼(Mo)、钛(Ti)、铝(Al)、铜(Cu)中的一种或多种的堆栈组合,即所述第一底栅极21、及第二底栅极22的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。所述底栅绝缘层31的材料为氮化硅(SiNx)、氧化硅(SiOx)、或二者的组合。
步骤2、如图14所示,在所述底栅绝缘层31上沉积色阻层,分别通过第二、第三、第四道光罩制程依次对所述色阻层进行图案化处理,形成红/绿/蓝色阻层3;接着在所述红/绿/蓝色阻层3上沉积第一平坦层,并通过第五道光罩制程对所述第一平坦层进行图案化处理,形成分别覆盖所述红/绿/蓝色阻层3的第一平坦层4;对所述底栅绝缘层31进行等离子处理(plasma treatment)。
具体地,所述第一平坦层4的材料为有机光阻,用于覆盖保护所述红/绿/蓝色阻层3。对所述底栅绝缘层31进行等离子处理可改善底栅绝缘层31的膜质。
步骤3、如图15所示,在所述底栅绝缘层31、及第一平坦层4上沉积氧化物半导体层,在所述氧化物半导体层上涂覆光阻层,并使用半色调掩膜板(half-tone)进行第六道光罩制程:先对所述光阻层进行曝光、显影,得到分别位于所述第一底栅极21、第二底栅极22、及第一平坦层4上方覆盖所述氧化物半导体层的第一光阻层41、第二光阻层42、及第三光阻层43;所述第一光阻层41的两侧区域、第二光阻层42的两侧区域、及第三光阻层43的厚度小于所述第一光阻层41的中间区域、及第二光阻层42的中间区域的厚度。
再利用所述第一光阻层41、第二光阻层42、及第三光阻层43对所述氧化物半导体层进行刻蚀,使所述氧化物半导体层图案化,得到分别位于所述第一底栅极21、第二底栅极22、及第一平坦层4上方的第一氧化物半导体层51、第二氧化物半导体层52、及第三氧化物半导体层53。
具体地,采用物理气相沉积法(Physical Vapor Deposition,PVD)沉积所述氧化物半导体层。
所述氧化物半导体层的材料为铟镓锌氧化物(Indium Gallium Zinc Oxide,IGZO)。
步骤4、如图16所示,去除所述第一光阻层51的两侧区域、第二光阻
层52的两侧区域、及第三光阻层53;以余下的第一光阻层51的中间区域、第二光阻层52的中间区域为遮蔽层,对所述第一氧化物半导体层51的两侧区域、第二氧化物半导体层52的两侧区域、及第三氧化物半导体层53进行离子掺杂,使所述第一氧化物半导体层51的两侧区域、及第二氧化物半导体层52的两侧区域转变为导体,使所述第三氧化物半导体层53转变为氧化物导体层53’;之后去除余下的第一光阻层51的中间区域、及第二光阻层52的中间区域。
步骤5、如图17所示,在所述第一氧化物半导体层51、第二氧化物半导体层52、氧化物导体层53’、及底栅绝缘层31上沉积顶栅绝缘层32,通过第七道光罩制程同时对所述顶栅绝缘层32与底栅绝缘层31进行图案化处理,形成分别位于所述第一氧化物半导体层51的两侧区域上方的两第一过孔91、位于所述第二氧化物半导体层52的两侧区域上方的两第二过孔92、位于所述氧化物导体层53’上方的第三过孔93、及位于所述第一底栅极21与第二底栅极22之间暴露出所述第二底栅极22一侧的第四过孔94。
具体地,所述顶栅绝缘层32的材料为氮化硅、氧化硅、或二者的组合。
具体地,采用干法刻蚀对所述顶栅绝缘层32与底栅绝缘层31同时进行图案化处理。
步骤6、如图8所示,在所述顶栅绝缘层32上沉积第二、第三金属层,通过第八道光罩制程对所述第二、第三金属层进行图案化处理,分别得到位于所述第一氧化物半导体层51上方的第一顶栅极71、位于所述第一顶栅极71两侧的第一源极81与第一漏极82、位于所述第二氧化物半导体层52上方的第二顶栅极72、位于所述第二顶栅极72两侧的第二源极83与第二漏极84。
所述第一源极81与第一漏极82分别经由所述第一过孔91与所述第一氧化物半导体层51的两侧区域相接触,所述第二源极83与第二漏极84分别经由所述第二过孔92与所述第二氧化物半导体层52的两侧区域相接触,所述第一源极81经由所述第三过孔93与所述氧化物导体层53’相接触,所述第二源极83经由所述第四过孔94与所述第一底栅极21相接触。
具体地,所述第二、第三金属层的材料为钼、钛、铝、铜中的一种或多种的堆栈组合,即所述第一顶栅极71、第一源极81、第一漏极82、第二顶栅极72、第二源极83、及第二漏极84的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
步骤7、如图19所示,在所述第一顶栅极71、第一源极81、第一漏极82、第二顶栅极72、第二源极83、第二漏极84、及顶栅绝缘层32上沉积
钝化层8。
步骤8、如图20所示,在所述钝化层8上沉积第二平坦层9,通过第九道光罩制程对所述第二平坦层9、钝化层8、及顶栅绝缘层32同时进行图案化处理,得到位于所述氧化物导体层53’上方的第五过孔95,以暴露出部分氧化物导体层53’,定义出发光层的形状。
所述第一底栅极21、第一氧化物半导体层51、第一源极81、第一漏极82、及第一顶栅极71构成第一双栅极TFT T1,所述第二底栅22、第二氧化物半导体层52、第二源极83、第二漏极84、及第二顶栅极72构成第二双栅极TFT T2。所述氧化物导体层53’构成OLED的阳极。
具体地,所述第二平坦层9的材料为有机光阻。
上述双栅极氧化物半导体TFT基板的制作方法,使用半色调掩膜板进行一道光罩制程既能够完成氧化物半导体层的图案化,又能够通过离子掺杂得到氧化物导体层53’;通过一道光罩制程同时对底栅绝缘层31与顶栅绝缘层32进行图案化处理;通过一道光罩制程同时对第二、第三金属层进行图案化处理,得到第一源极81、第一漏极82、第二源极83、第二漏极84、第一顶栅极71、及第二顶栅极72;通过一道光罩制程同时对第二平坦层9、钝化层8、及顶栅绝缘层32进行图案化处理,光罩制程减少至九道,有效简化了制程,提高了生产效率,降低了生产成本。
请参阅图20,本发明还提供一种适用于OLED的双栅极氧化物半导体TFT基板结构,包括基板1、设于所述基板1上的第一底栅极21与第二底栅极22、设于所述基板1、第一底栅极21、及第二底栅极22上的底栅绝缘层31、设于所述底栅绝缘层31上的红/绿/蓝色阻层3、分别设于所述红/绿/蓝色阻层3上的第一平坦层4、分别位于所述第一底栅极21、及第二底栅极22上方设于所述底栅绝缘层31上的第一氧化物半导体层51、及第二氧化物半导体层52、设于所述第一平坦层4上的氧化物导体层53’、设于所述第一氧化物半导体层51、第二氧化物半导体层52、氧化物导体层53’、及底栅绝缘层31上的顶栅绝缘层32、位于所述第一氧化物半导体层51上方设于所述顶栅绝缘层32上的第一顶栅极71、分别位于所述第一顶栅极71两侧设于所述顶栅绝缘层32上的第一源极81、及第一漏极82、位于所述第二氧化物半导体层52上方设于所述顶栅绝缘层32上的第二顶栅极72、分别位于所述第二顶栅极72两侧设于所述顶栅绝缘层32上的第二源极83、及第二漏极84、设于所述第一顶栅极71、第一源极81、第一漏极82、第二顶栅极72、第二源极83、第二漏极84、与顶栅绝缘层32上的钝化层8、及设于钝化层8上的第二平坦层9。
所述第一氧化物半导体层51的两侧区域、及第二氧化物半导体层52的两侧区域为离子掺杂的导体层;所述顶栅绝缘层32对应所述第一氧化物半导体层51两侧区域的上方分别设有第一过孔91,对应所述第二氧化物半导体层52两侧区域的上方分别设有第二过孔92,对应所述氧化物导体层53’上方设有第三过孔93,所述底栅绝缘层31、及顶栅绝缘层32对应第一底栅极21与第二底栅极22之间设有第四过孔94;所述顶栅绝缘层32、钝化层8、及第二平坦层9对应所述氧化物导体层53’上方设有第五过孔95;所述第一源极81与第一漏极82分别经由所述第一过孔91与所述第一氧化物半导体层51的两侧区域相接触;所述第二源极83与第二漏极84分别经由所述第二过孔92与所述第二氧化物半导体层52的两侧区域相接触;所述第一源极81经由所述第三过孔93与所述氧化物导体层53’相接触;所述第二源极83经由所述第四过孔94与所述第一底栅极21相接触;所述第五过孔95暴露出部分氧化物导体层53’。
所述第一底栅极21、第一氧化物半导体层51、第一源极81、第一漏极82、及第一顶栅极71构成第一双栅极TFT T1,所述第二底栅22、第二氧化物半导体层52、第二源极83、第二漏极84、及第二顶栅极72构成第二双栅极TFT T2。所述氧化物导体层53’构成OLED的阳极。
具体地,所述第一氧化物半导体层51、及第二氧化物半导体层52的材料为IGZO,所述氧化物导体层53’为IGZO半导体层进行离子掺杂制得。所述第一平坦层4、及第二平坦层9的材料为有机光阻;所述底栅绝缘层31、及顶栅绝缘层32的材料为氮化硅、氧化硅、或二者的组合;所述第一底栅极21、第一顶栅极71、第一源极81、第一漏极82、第二底栅极22、第二顶栅极72、第二源极83、及第二漏极84的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
上述双栅极氧化物半导体TFT基板结构,通过设置氧化物导体层53’来作为OLED的阳极,并将第一源极81、第一漏极82、第二源极83、第二漏极84、第一顶栅极71、及第二顶栅极72均设置于顶栅绝缘层32上,使得TFT基板的结构简单,易于制作,能够减少光罩制程的数量,有效简化制程,且生产成本低。
综上所述,本发明的双栅极氧化物半导体TFT基板的制作方法,使用半色调掩膜板进行一道光罩制程既能够完成氧化物半导体层的图案化,又能够通过离子掺杂得到氧化物导体层,该氧化物导体层作为OLED的阳极替代现有技术中的ITO阳极;通过一道光罩制程同时对底栅绝缘层与顶栅绝缘层进行图案化处理;通过一道光罩制程同时对第二、第三金属层进行
图案化处理,得到第一源极、第一漏极、第二源极、第二漏极、第一顶栅极、及第二顶栅极;通过一道光罩制程同时对第二平坦层、钝化层、及顶栅绝缘层进行图案化处理,光罩制程减少至九道,有效简化了制程,提高了生产效率,降低了生产成本。本发明的双栅极氧化物半导体TFT基板结构,通过设置氧化物导体层来作为OLED的阳极,并将第一源极、第一漏极、第二源极、第二漏极、第一顶栅极、及第二顶栅极均设置于顶栅绝缘层上,使得TFT基板的结构简单,易于制作,能够减少光罩制程的数量,有效简化制程,提高生产效率,且生产成本低。
以上所述,对于本领域的普通技术人员来说,可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形,而所有这些改变和变形都应属于本发明后附的权利要求的保护范围。
Claims (11)
- 一种双栅极氧化物半导体TFT基板的制作方法,包括如下步骤:步骤1、提供基板,在所述基板上沉积第一金属层,通过第一道光罩制程对所述第一金属层进行图案化处理,形成第一底栅极、及第二底栅极;在所述第一底栅极、第二底栅极、及基板上沉积底栅绝缘层;步骤2、在所述底栅绝缘层上沉积色阻层,分别通过第二、第三、第四道光罩制程依次对所述色阻层进行图案化处理,形成红/绿/蓝色阻层;接着在所述红/绿/蓝色阻层上沉积第一平坦层,并通过第五道光罩制程对所述第一平坦层进行图案化处理,形成分别覆盖所述红/绿/蓝色阻层的第一平坦层;对所述底栅绝缘层进行等离子处理;步骤3、在所述底栅绝缘层、及第一平坦层上沉积氧化物半导体层,在所述氧化物半导体层上涂覆光阻层,并使用半色调掩膜板进行第六道光罩制程:先对所述光阻层进行曝光、显影,得到分别位于所述第一底栅极、第二底栅极、及第一平坦层上方覆盖所述氧化物半导体层的第一光阻层、第二光阻层、及第三光阻层;所述第一光阻层的两侧区域、第二光阻层的两侧区域、及第三光阻层的厚度小于所述第一光阻层的中间区域、及第二光阻层的中间区域的厚度;再利用所述第一光阻层、第二光阻层、及第三光阻层对所述氧化物半导体层进行刻蚀,使所述氧化物半导体层图案化,得到分别位于所述第一底栅极、第二底栅极、及第一平坦层上方的第一氧化物半导体层、第二氧化物半导体层、及第三氧化物半导体层;步骤4、去除所述第一光阻层的两侧区域、第二光阻层的两侧区域、及第三光阻层;以余下的第一光阻层的中间区域、及第二光阻层的中间区域为遮蔽层,对所述第一氧化物半导体层的两侧区域、第二氧化物半导体层的两侧区域、及第三氧化物半导体层进行离子掺杂,使所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域转变为导体,使所述第三氧化物半导体层转变为氧化物导体层;之后去除余下的第一光阻层的中间区域、及第二光阻层的中间区域;步骤5、在所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上沉积顶栅绝缘层,通过第七道光罩制程同时对所述顶栅绝缘层与底栅绝缘层进行图案化处理,形成分别位于所述第一氧化物半导体层的两侧区域上方的第一过孔、位于所述第二氧化物半导体层的两 侧区域上方的第二过孔、位于所述氧化物导体层上方的第三过孔、及位于所述第一底栅极与第二底栅极之间暴露出所述第一底栅极一侧的第四过孔;步骤6、在所述顶栅绝缘层上沉积第二、第三金属层,通过第八道光罩制程对所述第二、第三金属层进行图案化处理,分别得到位于所述第一氧化物半导体层上方的第一顶栅极、位于所述第一顶栅极两侧的第一源极与第一漏极、位于所述第二氧化物半导体层上方的第二顶栅极、位于所述第二顶栅极两侧的第二源极与第二漏极;所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层的两侧区域相接触,所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触,所述第一源极经由所述第三过孔与所述氧化物导体层相接触,所述第二源极经由所述第四过孔与所述第一底栅极相接触;步骤7、在所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、及顶栅绝缘层上沉积钝化层;步骤8、在所述钝化层上沉积第二平坦层,通过第九道光罩制程对所述第二平坦层、钝化层、及顶栅绝缘层同时进行图案化处理,得到位于所述氧化物导体层上方的第五过孔,以暴露出部分氧化物导体层,定义出发光层的形状;所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅极、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体层构成OLED的阳极。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述步骤3采用物理气相沉积法沉积所述氧化物半导体层。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述步骤5采用干法刻蚀对所述顶栅绝缘层与底栅绝缘层同时进行图案化处理。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述氧化物半导体层的材料为IGZO。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述第一平坦层、及第二平坦层的材料为有机光阻。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述第一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、 第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
- 如权利要求1所述的双栅极氧化物半导体TFT基板的制作方法,其中,所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合。
- 一种双栅极氧化物半导体TFT基板结构,包括基板、设于所述基板上的第一底栅极与第二底栅极、设于所述基板、第一底栅极、及第二底栅极上的底栅绝缘层、设于所述底栅绝缘层上的红/绿/蓝色阻层、分别设于所述红/绿/蓝色阻层上的第一平坦层、分别位于所述第一底栅极、及第二底栅极上方设于所述底栅绝缘层上的第一氧化物半导体层、及第二氧化物半导体层、设于所述第一平坦层上的氧化物导体层、设于所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上的顶栅绝缘层、位于所述第一氧化物半导体层上方设于所述顶栅绝缘层上的第一顶栅极、分别位于所述第一顶栅极两侧设于所述顶栅绝缘层上的第一源极、及第一漏极、位于所述第二氧化物半导体层上方设于所述顶栅绝缘层上的第二顶栅极、分别位于所述第二顶栅极两侧设于所述顶栅绝缘层上的第二源极、及第二漏极、设于所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、与顶栅绝缘层上的钝化层、及设于钝化层上的第二平坦层;所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域为离子掺杂的导体层;所述顶栅绝缘层对应所述第一氧化物半导体层两侧区域的上方分别设有第一过孔,对应所述第二氧化物半导体层两侧区域的上方分别设有第二过孔,对应所述氧化物导体层上方设有第三过孔;所述底栅绝缘层、及顶栅绝缘层对应第一底栅极与第二底栅极之间设有第四过孔;所述顶栅绝缘层、钝化层、及第二平坦层对应所述氧化物导体层上方设有第五过孔;所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层两侧区域相接触;所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触;所述第一源极经由所述第三过孔与所述氧化物导体层相接触;所述第二源极经由所述第四过孔与所述第一底栅极相接触;所述第五过孔暴露出部分氧化物导体层;所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体 层构成OLED的阳极。
- 如权利要求8所述的双栅极氧化物半导体TFT基板结构,其中,所述第一氧化物半导体层、及第二氧化物半导体层的材料为IGZO,所述氧化物导体层为IGZO半导体层进行离子掺杂制得。
- 如权利要求8所述的双栅极氧化物半导体TFT基板结构,其中,所述第一平坦层、及第二平坦层的材料为有机光阻;所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合;所述第一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
- 一种双栅极氧化物半导体TFT基板结构,包括基板、设于所述基板上的第一底栅极与第二底栅极、设于所述基板、第一底栅极、及第二底栅极上的底栅绝缘层、设于所述底栅绝缘层上的红/绿/蓝色阻层、分别设于所述红/绿/蓝色阻层上的第一平坦层、分别位于所述第一底栅极、及第二底栅极上方设于所述底栅绝缘层上的第一氧化物半导体层、及第二氧化物半导体层、设于所述第一平坦层上的氧化物导体层、设于所述第一氧化物半导体层、第二氧化物半导体层、氧化物导体层、及底栅绝缘层上的顶栅绝缘层、位于所述第一氧化物半导体层上方设于所述顶栅绝缘层上的第一顶栅极、分别位于所述第一顶栅极两侧设于所述顶栅绝缘层上的第一源极、及第一漏极、位于所述第二氧化物半导体层上方设于所述顶栅绝缘层上的第二顶栅极、分别位于所述第二顶栅极两侧设于所述顶栅绝缘层上的第二源极、及第二漏极、设于所述第一顶栅极、第一源极、第一漏极、第二顶栅极、第二源极、第二漏极、与顶栅绝缘层上的钝化层、及设于钝化层上的第二平坦层;所述第一氧化物半导体层的两侧区域、及第二氧化物半导体层的两侧区域为离子掺杂的导体层;所述顶栅绝缘层对应所述第一氧化物半导体层两侧区域的上方分别设有第一过孔,对应所述第二氧化物半导体层两侧区域的上方分别设有第二过孔,对应所述氧化物导体层上方设有第三过孔;所述底栅绝缘层、及顶栅绝缘层对应第一底栅极与第二底栅极之间设有第四过孔;所述顶栅绝缘层、钝化层、及第二平坦层对应所述氧化物导体层上方设有第五过孔;所述第一源极与第一漏极分别经由所述第一过孔与所述第一氧化物半导体层两侧区域相接触;所述第二源极与第二漏极分别经由所述第二过孔与所述第二氧化物半导体层的两侧区域相接触;所述第一源极经由所述第三过孔与所述氧化物导体层相接触;所述第二源极经由所述第四过孔与所 述第一底栅极相接触;所述第五过孔暴露出部分氧化物导体层;所述第一底栅极、第一氧化物半导体层、第一源极、第一漏极、及第一顶栅极构成第一双栅极TFT,所述第二底栅、第二氧化物半导体层、第二源极、第二漏极、及第二顶栅极构成第二双栅极TFT;所述氧化物导体层构成OLED的阳极;其中,所述第一氧化物半导体层、及第二氧化物半导体层的材料为IGZO,所述氧化物导体层为IGZO半导体层进行离子掺杂制得;其中,所述第一平坦层、及第二平坦层的材料为有机光阻;所述底栅绝缘层、及顶栅绝缘层的材料为氮化硅、氧化硅、或二者的组合;所述第一底栅极、第一顶栅极、第一源极、第一漏极、第二底栅极、第二顶栅极、第二源极、及第二漏极的材料为钼、钛、铝、铜中的一种或多种的堆栈组合。
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