WO2015101261A1 - 扫描驱动电路和有机发光显示器 - Google Patents

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杨楠
胡思明
张婷婷
张小宝
永井肇
黄秀颀
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昆山工研院新型平板显示技术中心有限公司
昆山国显光电有限公司
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Definitions

  • the present invention relates to the field of scan driving circuits, and in particular to a scan driving circuit and an organic light emitting display applied to a pixel circuit of a scan driving organic light emitting device.
  • a conventional organic light emitting display includes a data driver that supplies a data signal to a data line, a first scan driver that sequentially supplies a scan signal to one of the scan lines, a second scan driver that sequentially supplies a scan signal to the other scan line, and a first scan.
  • the driver and the second scan driver provide timing controllers for timing signals and high and low level signals, and display units for a plurality of pixels.
  • the function of the first scan driver and the second scan driver is to sequentially generate drive signals for the display panel to control the brightness of the pixels in the display panel.
  • the voltage value input from the third level terminal is smaller than the voltage value input from the second level terminal.
  • the first transistor M1 includes an input terminal connected to the scan signal output terminal OUT or the scan signal input terminal IN of the previous first-stage structure, a gate terminal and an output terminal connected to the first clock terminal CKL1.
  • the second transistor M2 includes a gate terminal connected to the output terminal of the first transistor M1, an input terminal connected to the second clock terminal CKL2, and an output terminal connected to the scan signal output terminal OUT.
  • the third transistor M3 includes an input terminal connected to the first level terminal VGH, a gate terminal connected to the scan signal output terminal OUT, and an output terminal.
  • the fourth transistor M4 includes an input terminal connected to the output terminal of the third transistor M3, a gate terminal connected to the first clock terminal CKL1, and an output terminal connected to the second level terminal VGL1.
  • the high level signal is input from the first level terminal VGH (it can be understood that the voltage input by the first level terminal VGH is a positive voltage), the first clock signal is input from the first clock terminal CLK1, and the second clock signal is input from the second clock terminal CLK2.
  • the cascade structure of the first scan driver and the second scan driver of the scan driving circuit includes nine transistors, and only two clock signals are used, the number of transistors used in the scan driving circuit can be small, so Improve product reliability while reducing product design and production costs.
  • the presence of the sixth transistor M6, the seventh transistor M7, the eighth transistor M8, and the ninth transistor M9 can make the output of the driving signal output terminal EM of the scan driving circuit more accurate and reliable.
  • the clock signal received by the first clock terminal CLK1 (ie, CLK1) is low, the transistors M1, M4, and M7 are both turned on, and the IN is low (capacitor C1 is charged), and the second
  • the clock signal received by the clock terminal CLK2 (ie, CLK2) is at a high level, so that the transistor M2 is turned on, and the output scan signal OUT is at a high level; the transistor M7 is turned on and the gate of the transistor M9 is also at a low level, M9 Turn on, EM is low.
  • the first low level signal (VGL1) and the second low level signal (VGL2) are the same low level signal, that is, the second low level signal input end VGL2 is connected to the second.
  • the level terminal VGL1 is equivalent to the second pole of the ninth transistor M9 being directly connected to the second level terminal VGL1. At this time, the voltage values input by the first low level signal (VGL1) and the second low level signal (VGL2) are the same.
  • the voltage value (vgl2) of the second low level signal is higher than the voltage value of the first low level signal ( Vgl1) is small, preferably the voltage value (vgl2) of the second low level signal is smaller than the voltage value (vgl1) of the first low level signal by Vth.
  • the output signal EM quickly changes from a low level to a high level by using a voltage jump and a positive feedback across the third capacitor C3.
  • the output signal EM quickly changes from a high level to a low level by using a voltage jump and a positive feedback across the third capacitor C3.
  • the third capacitor C3 is used as a positive feedback function, so that the output high and low levels are more rapid and stable, so that the load capacity and the high and low level conversion capability of the driving circuit can be improved, and the output high and low levels are closer to the power supply. Level.
  • the organic light emitting display further includes a data driver 114 and a timing controller 118.
  • the data driver 114 provides data signals to the pixel circuits 112 of the organic light emitting display
  • the second scan driver 116 provides scan signals to the pixel circuits 112 of the organic light emitting display.
  • the timing controller 118 is the first scan driver 110 and the second scan driver 116.
  • the first clock terminal, the second clock terminal, the scan signal input terminal, the first level terminal, the second level terminal, and the third level terminal provide timing signals and high and low level signals, and ELVDD supplies power to the pixel circuits 112 of all the organic light emitting displays. signal.

Abstract

一种扫描驱动电路和有机发光显示器。该扫描驱动电路包括依次输出选择信号的第一扫描驱动器和依次输出发射信号的第二扫描驱动器。该第一扫描驱动器包括多个第一级联结构，该第二扫描驱动器包括多个第二级联结构，该第一级联结构或/和该第二级联结构中的每个级联结构包括九个晶体管和一个电容。该扫描驱动电路采用了较少的时钟信号和晶体管，可以大幅度提高产品电路的可靠性，同时也降低了产品设计成本和生产成本。

Description

扫描驱动电路和有机发光显示器 技术领域
本发明涉及扫描驱动电路领域，特别是涉及一种应用于扫描驱动有机发光器件像素电路的扫描驱动电路及有机发光显示器。
背景技术
有机发光显示器是一种应用有机发光二极管(OLED)作为发光器件的显示器，相比现在的主流平板显示技术薄膜晶体管液晶显示器(TFT-LCD),有机发光显示器具有高对比度、广视角、低功耗、体积更薄等优点，有望成为继LCD之后的下一代平板显示技术，是目前平板显示技术中受到关注最多的技术之一。
传统的有机发光显示器包括向数据线提供数据信号的数据驱动器、依次向其中一路扫描线提供扫描信号的第一扫描驱动器、依次向另一路扫描线提供扫描信号的第二扫描驱动器、向第一扫描驱动器和第二扫描驱动器提供时序信号和高低电平信号的时序控制器以及多个像素的显示单元。第一扫描驱动器和第二扫描驱动器的作用是依次产生提供给显示面板的驱动信号以控制显示面板中的像素亮暗。
然而，由于传统的第一扫描驱动器和第二扫描驱动器的每个级联结构包括较多的输入时钟信号(至少3个)和包含了大量的晶体管(多于10个)，由此出现问题的风险也相应增加，生产和设计的成本和风险都较高，很难保证产品的可靠性。
发明内容
基于此，有必要提供一种能减少时钟信号和晶体管数量的扫描驱动电路。此外，还提供一种有机发光显示器。
一种扫描驱动电路，包括依次输出选择信号的第一扫描驱动器和依次输出发射信号的第二扫描驱动器，所述第一扫描驱动器包括多个第一级联结构，所述第二扫描驱动器包括多个第二级联结构，所述第一级联结构或/和所述第二级 联结构中的每个级联结构包括：第一晶体管，包括与前一级联结构的扫描信号输出端或扫描信号输入端相连的输入端、与第一时钟端连接的栅极端及输出端；第二晶体管，包括与第一晶体管的输出端连接的栅极端、与第二时钟端连接的输入端及与扫描信号输出端连接的输出端；第三晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及输出端；第四晶体管，包括与第三晶体管的输出端连接的输入端、与第一时钟端连接的栅极端及与第二电平端连接的输出端；第五晶体管，包括与第一电平端连接的输入端、与第三晶体管的输出端连接的栅极端及与扫描信号输出端连接的输出端；第六晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及输出端；第七晶体管，包括与第六晶体管的输出端端连接的输入端、与第一时钟端连接的栅极端及与第二电平端连接的输出端；第八晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及与驱动信号输出端连接的输出端；第九晶体管，包括与驱动信号输出端连接的输入端、与第六晶体管的输出端连接的栅极端及与第三电平端连接的输出端；和连接于第二晶体管的栅极端和输出端之间的第一电容。
在其中一个实施例中，所述第一级联结构和所述第二级联结构中的每个级联结构的第一时钟端接收到的信号和第二时钟端接收到的信号的频率一致，当第一时钟端接收到的信号为高电平时第二时钟端接收到的信号为低电平，当第一时钟端接收到的信号为低电平时第二时钟端接收到的信号为高电平。
在其中一个实施例中，所述第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管、第八晶体管、和第九晶体管为薄膜场效应晶体管。
在其中一个实施例中，所述第一电平端和所述第六晶体管的栅极端之间连接有第二电容。
在其中一个实施例中，所述第二电平端和所述第九晶体管的栅极端之间连接有第三电容。
在其中一个实施例中，所述驱动信号输出端和所述第九晶体管的栅极端之间连接有第三电容。
在其中一个实施例中，所述第三电平端与所述第二电平端为同一电平端。
在其中一个实施例中，从所述第三电平端输入的电压值比从所述第二电平端输入的电压值小。
在其中一个实施例中，从所述第一电平端输入的电压为高电平，从所述第二电平端和第三电平端输入的电压为低电平。
上述扫描驱动电路只用到了两个时钟信号和九个晶体管，比传统的扫描驱动电路都少，可以大幅度提高电路的可靠性，同时也降低了设计成本和生产成本。
一种有机发光显示器，包括像素电路、数据驱动器和时序控制器，还包括上述的扫描驱动电路，所述时序控制器为所述扫描驱动电路的第一时钟端、第二时钟端、扫描信号输入端、第一电平端、第二电平端和第三电平端提供时序信号和高低电平信号，所述扫描驱动电路的驱动信号输出端和像素电路的驱动信号输入端连接，以输出驱动信号驱动像素电路工作。
应用了上述扫描驱动电路的有机发光显示器使用了较少的晶体管，因此可以大幅度提高产品的可靠性，同时也降低了产品设计成本和生产成本。
附图说明
图1为第一实施例的扫描驱动电路的第一扫描驱动器的模块示意图；
图2为图1所示第一扫描驱动器的其中一个级联结构的电路示意图；
图3为图1所示第一扫描驱动器的部分信号的时序示意图；
图4为第二实施例的扫描驱动电路的第一扫描驱动器的其中一个级联结构的电路示意图；
图5为第三实施例的扫描驱动电路的第一扫描驱动器的其中一个级联结构的电路示意图；
图6为本发明实施例有机发光显示器电路模块示意图。
具体实施方式
下面结合附图，对本发明的具体实施方式进行详细描述。在下面说明书中， 为了易于理解，引用信号端口符号表示该信号。
实施例1
参考图1和图2，本实施例提供一种扫描驱动电路。该扫描驱动电路包括依次输出选择信号的第一扫描驱动器和依次输出发射信号的第二扫描驱动器。第一扫描驱动器包括多个第一级联结构，第二扫描驱动器包括多个第二级联结构。第一级联结构或/和第二级联结构中的每个级联结构可以包括如下结构。在该实施例中，第一级联结构和第二级联结构中的每个级联结构均包括第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9、第一电容C1、第二电容C2、第三电容C3、扫描信号输入端IN、扫描信号输出端OUT、第一时钟端CKL1、第二时钟端CLK2、第一电平端VGH、第二电平端VGL1、第三电平端VGL2和驱动信号输出端EM。
第一晶体管M1包括与前一级联结构的扫描信号输出端OUT或扫描信号输入端IN相连的输入端、与第一时钟端CKL1连接的栅极端及输出端。第二晶体管M2包括与第一晶体管M1的输出端连接的栅极端、与第二时钟端CKL2连接的输入端及与扫描信号输出端OUT连接的输出端。第三晶体管M3包括与第一电平端VGH连接的输入端、与扫描信号输出端OUT连接的栅极端及输出端。第四晶体管M4包括与第三晶体管M3的输出端连接的输入端、与第一时钟端CKL1连接的栅极端及与第二电平端VGL1连接的输出端。第五晶体管M5包括与第一电平端VGH连接的输入端、与第三晶体管M3的输出端连接的栅极端及与扫描信号输出端OUT连接的输出端。第六晶体管M6包括与第一电平端VGH连接的输入端、与扫描信号输出端OUT连接的栅极端及输出端。第七晶体管M7包括与第六晶体管M6的输出端端连接的输入端、与第一时钟端CKL1连接的栅极端及与第二电平端VGL1连接的输出端。第八晶体管M8包括与第一电平端VGH连接的输入端、与扫描信号输出端OUT连接的栅极端及与驱动信号输出端EM连接的输出端。第九晶体管M9包括与驱动信号输出端EM连接的输入端、与第六晶体管M6的输出端连接的栅极端及与第三电平端VGL2连接的输出端。
第一晶体管M1的栅极、第四晶体管M4的栅极和第七晶体管M7的栅极短接，第一晶体管M1的第二极、第二晶体管M2的栅极和第一电容C1的第一端短接，第二晶体管M2的第二极、第三晶体管M3的栅极、第五晶体管M5的第二极、第六晶体管M6的栅极、第八晶体管M8的栅极、第一电容C1的第一端和第二电容C2的第二端短接，第三晶体管M3的第一极、第五晶体管M5的第一极、第六晶体管M6的第一极、第八晶体管M8的第一极和第二电容C2的第一端短接，第三晶体管M3的第二极与第四晶体管M4的第一极和第五晶体管M5的栅极短接，第四晶体管M4的第二极、第七晶体管M7的第二极和第三电容C3的第二端短接，第六晶体管M4的第二极、第七晶体管M7的第一极、第三电容C3的第一端和第九晶体管M9的栅极短接，第八晶体管M8的第二极和第九晶体管M9的第一极短接。
第一晶体管M1的第一极连接扫描信号输入端IN，第二晶体管M2的第二极连接扫描信号输出端OUT，第一晶体管M1的栅极连接第一时钟端CLK1，第二晶体管M2的第一极连接第二时钟端CLK2，第三晶体管M3的第一极连接第一电平端VGH，第四晶体管M4的第二极连接第二电平端VGL1，第九晶体管M9的第二极连接第二低电平信号输入端VGL2，第八晶体管M8的第二极连接驱动信号输出端EM。
高电平信号从第一电平端VGH输入(可以理解为第一电平端VGH输入的电压为正压)，第一时钟信号从第一时钟端CLK1输入，第二时钟信号从第二时钟端CLK2输入，扫描信号从扫描信号输入端IN输入，第一低电平信号从第二电平端VGL1输入(可以理解为第二电平端VGL1输入的电压为负压)，第二低电平信号从第二低电平信号输入端VGL2输入(可以理解为第二低电平信号输入端VGL2输入的电压为负压)，驱动信号从驱动信号输出端EM输出，输出扫描信号从扫描信号输出端OUT输出。
第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9为场效应晶体管，优选为P沟道型场效应晶体管。更具体为薄膜场效应晶体管(TFT)，优选为P沟道型薄膜场效应晶体管。
由于该扫描驱动电路的第一扫描驱动器和第二扫描驱动器的级联结构均包括九个晶体管，且只需使用两个时钟信号，该扫描驱动电路使用的晶体管数量可以较少，因此可以大幅度提高产品的可靠性，同时也降低了产品设计成本和生产成本。第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9的存在可以使该扫描驱动电路的驱动信号输出端EM的输出更加准确可靠。
需要说明的是，若扫描信号输出端OUT端接有负载电容的话，第二电容C2和第三电容C3此处也可以省略。该实施例中设置第二电容C2和第三电容C3可以减小第一电平端VGH、第二电平端VGL1、第三电平端VGL2的电流值。
下面以第一扫描驱动器为例具体介绍一下多个级联结构的连接关系。
第一扫描驱动器包括N个级联结构，第一级级联结构的扫描信号输出端连接第二级级联结构的扫描信号输入端、第二级级联结构的扫描信号输出端连接第三级级联结构的扫描信号输入端……第N-1级级联结构的扫描信号输出端连接第N级级联结构的扫描信号输入端。
奇数级的级联结构的第一时钟端与偶数级的级联结构的第二时钟端短接，奇数级的级联结构的第二时钟端与偶数级的级联结构的第一时钟端短接。
第一时钟信号CLK1从第一级级联结构的第一时钟端输入，第二时钟信号CLK2从第一级级联结构的第二时钟端输入。
各级级联结构的驱动信号输出端分别输出驱动信号EM.1、EM.2、EM.3、…EM.N至多个有机发光显示器的像素电路以驱动有机发光显示器的像素电路发光。
下面结合附图描述电路在一个扫描周期T内的工作过程，请结合图1、图2和图3。其中，从第一电平端VGH输入的电压为高电平，从第二电平端VGL1和第三电平端VGL2输入的电压为低电平。第一级联结构和第二级联结构中的每个级联结构的第一时钟端CLK1接收到的信号和第二时钟端CLK2接收到的信号的频率一致，当第一时钟端CLK1接收到的信号为高电平时第二时钟端CLK2接收到的信号为低电平，当第一时钟端CLK1接收到的信号为低电平时第二时钟端CLK2接收到的信号为高电平，这相当于第一级联结构和第二级联结构中的每个级联结构的第一时钟端CLK1和第二时钟端CLK2接收到的信号的 相位相反。为了易于理解，引用信号端口符号表示该信号，即扫描信号为IN、输出扫描信号为OUT、第一时钟信号为CKL1、第二时钟信号为CLK2、驱动信号为EM。引用元件标注符号来区分不同的元件，例如第一晶体管M1为晶体管M1，第一电容C1为电容C1。
第一个时钟周期t1内：第一时钟端CLK1接收到的时钟信号(即CLK1)为低电平，晶体管M1、M4、M7都导通，IN为低电平(电容C1充电)，第二时钟端端CLK2接收到的时钟信号(即CLK2)为高电平，从而晶体管M2导通，输出扫描信号OUT为高电平；晶体管M7导通从而晶体管M9的栅极也为低电平，M9导通，EM为低电平。
第二个时钟周期t2内：CLK1为高电平，晶体管M1、M4、M7都截止，电容C1放电，CLK2为低电平。由于电容C1的耦合作用，从而晶体管M2的栅极继续为更低的低电平，使得M2导通、M3导通，同时M5截止，从而OUT为低电平；M2导通于是晶体管M6和M8都导通，而晶体管M9截止，从而EM为高电平。
第三个时钟周期t3内：CLK1为低电平，CLK2为高电平。晶体管M1、M4、M7都导通，IN为高电平，从而M2截止；M4导通从而M5导通(电容C2充电)，OUT为高电平；晶体管M7导通从而晶体管M9的栅极也为低电平(电容C3充电)，M9导通，EM为低电平。
第四个时钟周期t4内：CLK1为高电平，CLK2为低电平，IN为高电平。晶体管M1、M2、M4、M7都截止，从而M3、M5都截止，电容C2放电，从而OUT为高电平；电容C3放电，从而M9导通，EM为低电平。
于是，OUT在余下的扫描周期时间内都为高电平，EM在余下的扫描周期时间内都为低电平，实现了驱动信号EM的输出，以及扫描信号IN的一个时钟信号的推移(OUT比IN往后推移一个时钟周期)。
OUT比IN往后推移一个时钟周期，而由于CLK1与CLK2按照奇偶交错的方式连接各级级联结构，且CLK1与CLK2为高低电平刚好交错，即实现了CLK1、CLK2和OUT的同步推移，所以每一级级联结构都能输出所需的驱动信号(EM.1、EM.2、EM.3、…EM.N)。
上述扫描驱动电路只用到了两个时钟信号和9个晶体管，比传统的扫描驱动电路都少，可以大幅度提高电路的可靠性，同时也降低了设计成本和生产成本。
实施例2
请参考图4，在本实施例中，第一低电平信号(VGL1)和第二低电平信号(VGL2)为同一低电平信号，即第二低电平信号输入端VGL2连接第二电平端VGL1，相当于第九晶体管M9的第二极直接连接第二电平端VGL1，此时第一低电平信号(VGL1)和第二低电平信号(VGL2)输入的电压值相同。在电路运行过程中，当第七晶体管M7导通，则同时第九晶体管M9的栅极为低电平vgl1+Vth(vgl1第一低电平信号的电压值，为Vth为P沟道型薄膜场效应晶体管的阈值电压绝对值)，于是第九晶体管M9导通，此时第九晶体管M9的源极也为低电平(vgl1)，则相当于第九晶体管M9的栅极和漏极短路，第九晶体管M9形成二极管连接，所以第九晶体管M9的源极输出电压为vgl1+Vth，那就导致了驱动信号比所需的vgl1高了Vth。所以，为了使驱动信号输出端EM输出的驱动信号为vgl1，在其他实施例中，在驱动过程中，第二低电平信号的电压值(vgl2)比第一低电平信号的电压值(vgl1)小，优选为第二低电平信号的电压值(vgl2)比第一低电平信号的电压值(vgl1)小Vth。
需要说明的是，若扫描信号输出端OUT端接有负载电容的话，第二电容C2可以省略，但第三电容C3不可省略，第三电容C3作用在于稳定第九晶体管M9的栅极电压。
在扫描信号IN的一个扫描周期T内的第一个时钟周期t为低电平信号，其余时间为高电平信号；当扫描信号IN为低电平信号时，第一时钟信号CLK1也为低电平信号。第一时钟信号CLK1和第二时钟信号CLK2频率一致，当第一时钟信号CLK1为高电平时第二时钟信号CLK2为低电平，当第一时钟信号CLK1为低电平时第二时钟信号CLK2为高电平，即第一时钟信号CLK1和第二时钟信号CLK2的高低电平刚好交错，扫描信号IN在一个扫描周期T内首先在第一个时钟周期t内和第一时钟信号CLK1同步为低电平。
实施例3
在本实施例中，可以通过仅仅改变第三电容C3的连接方式来改进输出信号EM的迅速高电平转换。具体改变为，第三电容C3连接于驱动信号输出端EM和第九晶体管M9的栅极端之间，见图5。
需要说明的是，若扫描信号输出端OUT端接有负载电容的话，第二电容C2可以省略，但第三电容C3不可省略，第三电容C3起到正反馈作用。
电路运行过程中，第一个时钟周期t1跳到第二个时钟周期t2时，利用第三电容C3两端电压跳变和正反馈作用，输出信号EM从低电平迅速变成了高电平。第二个时钟周期t2跳到第三个时钟周期t3时，利用第三电容C3两端电压跳变和正反馈作用，输出信号EM从高电平迅速变成了低电平。本实施例中采用第三电容C3起到正反馈的作用，使得输出高低电平更加迅速稳定，因此能够提高驱动电路的带载能力和高低电平转换能力，输出高、低电平更加接近电源电平。
请参考图6，本发明提供一种有机发光显示器，其包括上述实施例1或实施例2或实施例3的扫描驱动电路和多个有机发光显示器的像素电路112。其中，扫描驱动电路包括第一扫描驱动器110和第二扫描驱动器116。第一扫描驱动器110中每一级的级联结构的驱动信号输出端(EM.1、EM.2、EM.3、…EM.N)分别和有机发光显示器件的像素电路112的驱动信号输入端连接，以分别输出驱动信号(EM.1、EM.2、EM.3、…EM.N)驱动有有机发光显示器的像素电路112。
该有机发光显示器还包括数据驱动器114以及时序控制器118。数据驱动器114分别为有机发光显示器的像素电路112提供数据信号，第二扫描驱动器116为有机发光显示器的像素电路112提供扫描信号，时序控制器118为第一扫描驱动器110和第二扫描驱动器116的第一时钟端、第二时钟端、扫描信号输入端、第一电平端、第二电平端和第三电平端提供时序信号和高低电平信号，ELVDD为全部有机发光显示器的像素电路112提供电源信号。
应用了上述扫描驱动电路的有机发光显示器，可以大幅度提高产品的可靠性，同时也降低了产品设计成本和生产成本。
以上所述实施例仅表达了本发明的几种实施方式，其描述较为具体和详细，但并不能因此而理解为对本发明专利范围的限制。应当指出的是，对于本领域的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干变形和 改进，这些都属于本发明的保护范围。因此，本发明专利的保护范围应以所附权利要求为准。

Claims (10)

  1. 一种扫描驱动电路，其特征在于，包括依次输出选择信号的第一扫描驱动器和依次输出发射信号的第二扫描驱动器，所述第一扫描驱动器包括多个第一级联结构，所述第二扫描驱动器包括多个第二级联结构，所述第一级联结构或/和所述第二级联结构中的每个级联结构包括：
    第一晶体管，包括与前一级联结构的扫描信号输出端或扫描信号输入端相连的输入端、与第一时钟端连接的栅极端及输出端；
    第二晶体管，包括与第一晶体管的输出端连接的栅极端、与第二时钟端连接的输入端及与扫描信号输出端连接的输出端；
    第三晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及输出端；
    第四晶体管，包括与第三晶体管的输出端连接的输入端、与第一时钟端连接的栅极端及与第二电平端连接的输出端；
    第五晶体管，包括与第一电平端连接的输入端、与第三晶体管的输出端连接的栅极端及与扫描信号输出端连接的输出端；
    第六晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及输出端；
    第七晶体管，包括与第六晶体管的输出端端连接的输入端、与第一时钟端连接的栅极端及与第二电平端连接的输出端；
    第八晶体管，包括与第一电平端连接的输入端、与扫描信号输出端连接的栅极端及与驱动信号输出端连接的输出端；
    第九晶体管，包括与驱动信号输出端连接的输入端、与第六晶体管的输出端连接的栅极端及与第三电平端连接的输出端；以及
    连接于第二晶体管的栅极端和输出端之间的第一电容。
  2. 根据权利要求1所述的扫描驱动电路，其特征在于，所述第一级联结构和所述第二级联结构中的每个级联结构的第一时钟端接收到的信号和第二时钟端接收到的信号的频率一致，当第一时钟端接收到的信号为高电平时第二时钟端接收到的信号为低电平，当第一时钟端接收到的信号为低电平时第二时钟端 接收到的信号为高电平。
  3. 根据权利要求2所述的扫描驱动电路，其特征在于，所述第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管、第八晶体管、和第九晶体管为薄膜场效应晶体管。
  4. 根据权利要求1所述的扫描驱动电路，其特征在于，所述第一电平端和所述第六晶体管的栅极端之间连接有第二电容。
  5. 根据权利要求1至4中任一权利要求所述的扫描驱动电路，其特征在于，所述驱动信号输出端和所述第九晶体管的栅极端之间连接有第三电容。
  6. 根据权利要求1至4中任一权利要求所述的扫描驱动电路，其特征在于，所述第二电平端和所述第九晶体管的栅极端之间连接有第三电容。
  7. 根据权利要求6所述的扫描驱动电路，其特征在于，所述第三电平端与所述第二电平端为同一电平端。
  8. 根据权利要求6所述的扫描驱动电路，其特征在于，从所述第三电平端输入的电压值比从所述第二电平端输入的电压值小。
  9. 根据权利要求6所述的扫描驱动电路，其特征在于，从所述第一电平端输入的电压为高电平，从所述第二电平端和第三电平端输入的电压为低电平。
  10. 一种有机发光显示器，包括像素电路、数据驱动器和时序控制器，其特征在于，还包括如权利要求1至9中任一权利要求所述的扫描驱动电路，所述时序控制器为所述扫描驱动电路的第一时钟端、第二时钟端、扫描信号输入端、第一电平端、第二电平端和第三电平端提供时序信号和高低电平信号，所述扫描驱动电路的驱动信号输出端和像素电路的驱动信号输入端连接，以输出驱动信号驱动像素电路工作。
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