WO2007074615A1 - 映像信号の表示制御装置および表示制御方法 - Google Patents

映像信号の表示制御装置および表示制御方法 Download PDF

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WO2007074615A1
WO2007074615A1 PCT/JP2006/324426 JP2006324426W WO2007074615A1 WO 2007074615 A1 WO2007074615 A1 WO 2007074615A1 JP 2006324426 W JP2006324426 W JP 2006324426W WO 2007074615 A1 WO2007074615 A1 WO 2007074615A1
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image display
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PCT/JP2006/324426
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Akinori Hayafuji
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Tohoku Pioneer Corporation
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Definitions

  • APL Average Picture
  • the present invention relates to a display control apparatus and a display control method for a video signal including, for example, a PLE (Peak Luminance Enhancement) control means for obtaining a level) and controlling the display brightness in the video display apparatus based on the average brightness level.
  • a PLE Peak Luminance Enhancement
  • PLE control For performing image display, the above-described PLE control is executed.
  • This PLE control calculates the average luminance level of the video signal corresponding to the entire field or frame screen, and operates to control the display luminance level for actual image display based on this average luminance level. .
  • Patent Document 1 JP-A-9 281927
  • Patent Document 2 Japanese Patent Laid-Open No. 2001-175220
  • the video screen displayed by the display device described above has a moving image display area and a non-display area.
  • Video (still image) display area may coexist.
  • Fig. 1 and Fig. 2 show an example of this.
  • the entire area indicated by symbol A indicates the entire screen of the video displayed by the display device, and the area indicated by symbol B indicates the moving image display area.
  • a non-moving image display area indicated by C is formed outside the moving image display area B in a frame shape, and is below the frame-shaped non-moving image display area C.
  • a fixed pattern such as an icon is displayed in the side area.
  • the PLE control controls the average luminance level corresponding to the entire field or frame screen ( Based on (APL), it operates to control the display brightness level of the entire screen.For example, when the screen of the moving image display area B is clear as shown in FIG. The level is lowered, and the non-video display area shown as C is controlled to appear dark.
  • the present invention has the above-described technical problem that occurs when the display means for displaying an image having a moving image display area and a non-moving image display area is configured to execute PLE control. It is an object of the present invention to provide a display control apparatus and display control method for a video signal that can eliminate the problem.
  • a preferred basic form of the display control apparatus according to the present invention made to solve the above-described problem is that a pixel is arranged at each intersection of a plurality of data lines and a plurality of scanning lines, and the input video signal is displayed.
  • a display control device for a video signal that displays an image by selectively lighting the pixel based on the display, and displays the moving image according to a lighting rate of the pixel in the moving image display area in the displayed image.
  • Variable control of light emission brightness in the area Brightness control means is provided.
  • the basic mode is that a pixel is arranged at each intersection of a plurality of data lines and a plurality of scanning lines.
  • a video signal display control method for displaying an image by selectively lighting and driving the pixels based on an input video signal, wherein the video display region sets a moving image display region in the displayed image.
  • a luminance control operation for performing variable control of light emission luminance.
  • FIG. 1 is a schematic diagram for explaining a display example when PLE control is executed when a moving image display area and a non-moving image display area coexist.
  • FIG. 2 is a schematic diagram for explaining another display example.
  • FIG. 3 is a block diagram showing a first configuration example of the display control apparatus according to the present invention.
  • FIG. 4 is a circuit configuration diagram showing a configuration example of a preferable pixel arranged in the display panel shown in FIG.
  • FIG. 5 is a timing diagram showing an example of a gradation control means made by the configuration shown in FIGS. 3 and 4.
  • FIG. 6 is a block diagram showing a second configuration example of the display control apparatus according to the present invention.
  • FIG. 7 is a schematic diagram for explaining a partition example of a moving image display area and a non-moving image display area.
  • FIG. 8 is a schematic diagram for explaining another example of partitioning.
  • FIG. 9 is a block diagram showing a third configuration example of the display control apparatus according to the present invention.
  • FIG. 10 is a block diagram showing a fourth configuration example.
  • FIG. 11 is a circuit configuration diagram showing a configuration example of preferable pixels arranged in the display panel shown in FIG.
  • FIG. 12 is a timing diagram showing an example of a gradation control unit configured by the configuration shown in FIGS. 10 and 11.
  • FIG. 13 is a block diagram showing a configuration example of an erasing timing signal generating means preferably employed in the configuration shown in FIG.
  • Tr2 lighting drive transistor
  • FIG. 3 shows the first embodiment, which is an example of a display control apparatus for an active matrix display panel.
  • an analog Z digital (AZD) converter 2 and a video signal memory (hereinafter also referred to as VRAM) 3 are connected to the controller circuit 1 and input by an analog video signal is performed.
  • the video signal is configured to be supplied to the controller circuit 1 and the AZD converter 2.
  • the controller circuit 1 generates a clock signal CK for the AZD converter 2, a write signal W and a read signal R for the VRAM 3 based on horizontal and vertical synchronization signals in the analog video signal.
  • the AZD conversion unit 2 samples an input analog video signal based on the clock signal CK supplied from the controller circuit 1, converts this into video data for each pixel, and supplies the video data to the VRAM 3 Acts as follows.
  • the VRAM 3 operates so as to sequentially write the video data supplied from the AZD conversion unit 2 to the VRAM 3 by the write signal W from the controller circuit 1.
  • a frame memory is used as the VRAM 3, and a video signal for one screen is written on a display panel described later by the above-described writing operation.
  • the video signal written to VRAM3 is read from the controller circuit 1.
  • the moving image display area setting means is expressed as moving image area setting means 4.
  • the moving image display area setting means 4 a configuration having two different functions can be appropriately employed depending on the display form of an image on a display panel to be described later.
  • One example is the case where the moving image display area B and the non-moving image display area C on the display screen A are always defined as shown in FIGS. 1 and 2, for example, and each area does not change.
  • the moving image display area setting means 4 is configured to designate a predetermined moving image display area for each pixel. That is, the moving image display area setting unit 4 operates to extract video data from the VRAM 3 corresponding to a predetermined moving image display area B and supply it to the lighting rate calculation unit 5 described later.
  • the other one is a case where the moving image display area B and the non-moving image display area C are changed by the input video signal on the display screen A shown in FIG. 1 and FIG.
  • the moving image display area setting means 4 detects the moving image display area by detecting a time change of the input video signal corresponding to each pixel. It is configured to specify in units of pixels. That is, the moving image display area setting means 4 in this case extracts the video signal from the VRAM 3 corresponding to the moving image display area B set by detecting the time change of the input video signal, and turns on the lighting rate calculation means 5 described later. Operates to supply.
  • the moving image display area setting means 4 detects the non-moving image display area (still image area) in the latter case, so that areas other than the still image area are displayed. You can also set the video display area!
  • the video signal from the VRAM 3 corresponding to the video display area from the video display area setting means 4 is supplied to the lighting rate calculation means 5, and the lighting rate calculation means 5 converts the video signal corresponding to the video display area to the video signal. Based on this, it operates to calculate the lighting rate in pixel units.
  • the lighting rate calculating means 5 can obtain a result equivalent to the function for calculating the average luminance level (APL) of the video signal already described corresponding to the moving image display area.
  • the lighting rate data in the moving image display area obtained by the lighting rate calculation means 5 is The brightness control means 6 is supplied.
  • the luminance control means 6 is configured to be supplied with the video data read from the VRAM 3, and the luminance control means 6 is used to display a moving image out of the video signals read from the VRAM 3.
  • a conversion process of the video signal is executed to change the gradation value of the corresponding video signal based on the lighting rate.
  • the luminance control means 6 corresponds to the luminance corresponding to the pixel lighting rate calculated by the lighting rate calculation means 5 among the video signals read out from the VRAM 3 and contributing to the moving image display. It operates so as to execute the process of converting to the gradation value to be performed.
  • PLE control for controlling the light emission luminance of each pixel in the moving image display area arranged on the display panel described later is realized.
  • the luminance control means 6 converts the video signal subjected to the gradation control by the PLE control into a signal form that can be driven by a data driver to be described later, and outputs it.
  • controller circuit 1 described above generates a shift clock signal, a start pulse, and the like for the scan driver 13 and the data driver 14 to be described later based on the horizontal and vertical synchronization signals in the video signal. It is configured to supply to drivers 13 and 14.
  • Reference numeral 11 shown in FIG. 3 indicates a display panel in which a large number of pixels 12 each including the light-emitting element having the above-described organic EL element power are arranged in a matrix.
  • scanning lines 21 and data lines 22 connected to the scanning driver 13 and the data driver 14, respectively are arranged in directions orthogonal to each other, and the pixels 12 including the light emitting elements are arranged at the intersecting positions thereof.
  • Each is arranged.
  • Each pixel 12 is configured to be supplied with a lighting driving voltage for the pixel from a power supply circuit 16 via a power supply line 24.
  • FIG. 4 shows a circuit configuration corresponding to one pixel arranged on the display panel 11 described above, and this shows the most basic pixel configuration when an organic EL element is used as a light emitting element.
  • a data signal Vdata corresponding to the video signal from the data driver 14 is supplied to the pixel 12 via the data line 22 arranged on the display panel to the control TFT, that is, the source of the data write transistor Trl. It is configured
  • the gate of the data writing transistor Trl is configured to be supplied with a scanning signal Select (also referred to as writing nors) via a scanning line 21 connected to the scanning driver 13.
  • the drain of the data write transistor Trl is connected to the lighting driving TFT, that is, the gate of the lighting driving transistor Tr2, and is connected to one terminal of the charge holding capacitor C1.
  • the source of the lighting drive transistor Tr2 is connected to the other terminal of the capacitor C1, and the drive voltage Vcc is supplied from the power supply circuit 16 through the power supply line 24. It is configured.
  • the drain of the lighting drive transistor Tr2 is connected to the anode terminal of an organic EL element E1 as a light emitting element, and the power sword terminal of the organic EL element E1 is connected to a reference potential point (ground) of the display panel. .
  • the circuit configuration of the pixel 12 shown in FIG. 4 includes a data write transistor Trl force 3 ⁇ 4 channel TFT and a drive transistor Tr2 force 3 ⁇ 4 channel TFT. Then, as shown in FIG. 3, the display panel 11 is configured by arranging a large number of pixels 12 having the above-described configuration in a matrix in the row and column directions.
  • a write Norse Select as a scan signal is supplied from the scan driver 13 to the gate of the control transistor Trl in the address period.
  • a current corresponding to the data signal Vdata is supplied to the capacitor C1 through the source and drain of the control transistor Trl. Current, capacitor C1 is charged
  • the charging voltage is supplied to the gate of the driving transistor Tr2, and the transistor 2 passes a current corresponding to the gate voltage and the driving voltage Vcc supplied to the drain to the EL element E1, whereby EL Element E1 emits light (lights up).
  • the transistor Trl When the application of the write pulse to the gate of the control transistor Trl is stopped, the transistor Trl becomes a so-called cutoff. However, the gate voltage of the drive transistor Tr2 is held by the electric charge accumulated in the capacitor C1, thereby maintaining the drive current to the EL element E1.
  • the EL element E1 has the data signal in the period up to the next address operation.
  • the lighting state corresponding to Vdata can be continued. Therefore, in the address period described above, the lighting or extinguishing of the pixels is controlled according to the data signal Vdata supplied from the data driver 14, and thereby the lighting period in the unit period of each pixel is individually controlled. Gradation control is realized.
  • one frame period is divided into a plurality of subframes, and each subframe is divided.
  • a control means is employed that realizes gradation control based on the cumulative number of pixel lighting periods within one frame period.
  • Fig. 5 shows an example of the gradation control.
  • one frame period is divided into seven subframes, and simple summation of the subframe periods is used.
  • This shows a simple subframe method for expressing 8 gradations from “gradation 0” to “gradation 7”.
  • the data signal Vdata for controlling the pixels to be turned on or off is supplied from the data driver 14 described above.
  • the luminance control means 6 controls the gradation of the pixels in the moving image display area in accordance with the lighting rate of the pixels corresponding to the moving image display area, and the lighting rate increases. In this case, the control is performed so as to execute the control for lowering the gradation.
  • the gradation power level (n is an integer) is reduced with respect to the gradation based on the input video signal. It works like this. Therefore, when the lighting rate is high, the lighting period in one frame period of the pixel in the moving image display area is reduced, and the light emission luminance of the pixel is suppressed. As a result, low power consumption can be realized.
  • the lighting rate of the pixel corresponding to the moving image display area when the lighting rate of the pixel corresponding to the moving image display area is small, it is input It operates to increase the gradation of the video display area by n steps (n is an integer) with respect to the gradation based on the video signal. As a result, the cumulative lighting period in one frame period of the pixels in the moving image display area is expanded, and an image with good contrast in the moving image display area can be displayed. According to the above-described embodiment, since the PLE operation is not executed in the non-moving image (still image) region, the gradation of the non-moving image region is displayed in a gradation based on the input video signal.
  • the luminance control means 6 has a moving image display area obtained by the lighting rate calculation means 5 that outputs an output voltage value from the data driver 14 supplied to each data line corresponding to the moving image display area. This is characterized in that it is configured so as to be variably controlled according to the lighting rate of the pixels.
  • the data write transistor Trl and the lighting drive transistor Tr2 in the pixel configuration shown in FIG. 4 are set to operate in the analog operation (constant current drive) region. Then, in each address period corresponding to each scanning line 21, the voltage value of the data signal Vdata from the data driver 14 supplied to each data line corresponding to the moving image display area is obtained by the lighting rate calculation means 5. It is configured to be variably controlled according to the lighting rate.
  • the voltage value written in the charge holding capacitor C1 of each pixel corresponds to the voltage value of the data signal Vdata.
  • the lighting drive transistor Tr2 operates to supply a drive current corresponding to the voltage value written in the charge holding capacitor C1 to the EL element E1. Therefore, a PLE operation is realized in which the luminance of each pixel 12 corresponding to the moving image display area is variably controlled in accordance with the lighting rate obtained by the lighting rate calculation means 5 described above.
  • the voltage value of the data signal Vdata from the data driver 14 supplied to each data line corresponding to the non-moving image display area is equal to the lighting rate. Regardless of the input video signal, it is controlled. Therefore, there is a problem that the light emission luminance of the pixels in the non-moving area is affected by the lighting rate. It can be avoided.
  • FIG. 6 shows an example of another display control device that is useful for the present invention.
  • parts that perform the same functions as the parts shown in FIG. 3 already described are denoted by the same reference numerals, and thus detailed description thereof is omitted.
  • the configuration shown in FIG. 4 can be adopted as the configuration of each pixel 12 arranged in the display panel 11.
  • the luminance control means 6 in the embodiment shown in FIG. 6 is provided in the moving picture display area obtained by the lighting rate calculating means 5 for the power supply line 24 connected to the pixels corresponding to the moving picture display area.
  • a driving voltage that is variable according to the lighting rate of the pixel is supplied, and a driving voltage having a predetermined value is supplied to the power supply line 24 connected to the pixel corresponding to the non-moving image display area. It has the characteristic in the point comprised.
  • the power supply circuit 16 is supplied with a variable voltage source EV1 whose output value is variable by luminance control (PLE control) data from the luminance control means 6, and a voltage having a predetermined value.
  • a fixed voltage source EF1 is provided.
  • the switches SI, S2,... As selection means for selectively supplying the drive voltage from the variable voltage source EV1 or the fixed voltage source EF1 to each power supply line 24 are the power supplies. Corresponding to the supply line 24.
  • the moving image display area information data set by the moving image display area setting means 4 is configured to be supplied to the controller circuit 1.
  • the controller circuit 1 receives the information data of the moving image display area and selects the switches SI, S2,... In the power supply circuit 16 to the variable voltage source EV1 or the fixed voltage source EF1 side. It is controlled so that they are connected together.
  • the power supply line 24 corresponding to the pixels of the moving image display area is connected to each of the switches SI, S2,.
  • the variable voltage source EV1 operates to be supplied with the drive voltage, and the power supply line 24 corresponding to the pixels in the non-video display area is connected to the fixed voltage source via the switches SI, S2,. It operates so that the drive voltage from EF1 is supplied.
  • the brightness control data from the brightness control means 6 is stored in each pixel 12 of the moving image display area.
  • the drive voltage is supplied from the variable voltage source EV1 whose output value is variable by the data, and the luminance of each pixel 12 corresponding to the moving image display area is thus obtained by the lighting rate calculation means 5 described above.
  • a PLE operation that is variably controlled according to the rate is realized.
  • the drive voltage from the fixed voltage source EF1 is supplied to each pixel 12 in the non-moving picture display area, each pixel 12 corresponding to the non-moving picture display area can be kept at a constant luminance.
  • the moving image display area and the non-moving image display area are divided according to the arrangement direction of the power supply lines 24 in the display panel 11. That is, when the arrangement direction of the power supply lines 24 is vertical as in the display panel 11 shown in FIG. 6, the moving image display area B and the non-moving image display area C are displayed on the screen A as shown in FIG. Is divided by vertical lines.
  • the arrangement relationship of the scanning lines 21, the data lines 22, and the power supply lines 24 shown in FIG. 6 is arranged on the display panel 11 as it is, for example, rotated by 90 degrees as shown in FIG.
  • the screen A can be configured so that the moving image display area B and the non-moving image display area C are partitioned by horizontal lines.
  • FIG. 9 shows an example of another display control device that is useful for the present invention, and this shows an example of a display control device intended for a passive matrix type display panel.
  • the controller circuit 1 In the configuration of the display control device shown in FIG. 9, the controller circuit 1, the AZD conversion unit 2, the VRAM 3, the moving image display area setting unit 4, the lighting rate calculation unit, similarly to the configuration shown in FIG. 5, the luminance control means 6 is provided. In FIG. 9, except for the controller circuit 1 and the luminance control means 6, the other configurations are omitted.
  • the luminance control means 6 in the embodiment shown in FIG. 9 has the pixel in the moving image display area obtained by the lighting rate calculating means 5 for the data line connected to the pixel corresponding to the moving image display area.
  • a driving current that is variable according to the lighting rate is supplied, and a driving current having a predetermined value is supplied to the data line connected to the pixel corresponding to the non-moving image display area.
  • anode lines Al to An as n data lines are arranged in the vertical direction (column direction), and cathode lines Kl to Km as m scanning lines are in the horizontal direction.
  • the organic EL elements El 1 to Enm constituting the pixel are connected between each anode line and the scanning line.
  • Each anode line Al to An is connected to an anode line drive circuit 32 as a data driver, and each cathode line Kl to Km is connected to and driven by a cathode line scanning circuit 33 as a scan driver.
  • the anode line drive circuit 32 includes a first group of constant current sources Ial to Ian that operate using the drive voltage VH. Signals based on PLE control from the brightness control means 6 are supplied to the first group of constant current sources Ial to Ian. As a result, the output current values (drive current values) of the first group of constant current sources la l to Ian are controlled according to the lighting rate of the pixels in the moving image display area obtained by the lighting rate calculation means 5 described above. Works like
  • the anode line drive circuit 32 includes a second group of constant current sources Ibl to Ibn, which are configured to supply a drive current having a predetermined value.
  • the first or second group of constant current sources or drive switches Sal to San as selection means capable of selecting a ground as a reference potential point are provided corresponding to the anode lines Al to An.
  • the drive switches Sal to San are configured to be switched by a command signal from the controller circuit 1.
  • the cathode line scanning circuit 33 is provided with scanning switches Skl to Skm corresponding to the respective cathode lines Kl to Km, and crosstalk that functions as a non-scanning selection potential according to a command signal from the controller circuit 1.
  • Either the reverse bias voltage source VM for preventing light emission or the ground potential functioning as a scanning selection potential is connected to the corresponding cathode line.
  • a scanning synchronization signal is supplied from the controller circuit 1 to the cathode line scanning circuit 33, whereby the cathode lines Kl to Km are sequentially connected to the ground potential (scanning selection potential). ) Is repeated.
  • the controller circuit 1 sends a drive control signal for each scanning line to the anode line driving circuit 32 in synchronization with the scanning synchronization signal. Is supplied.
  • the controller circuit 1 is supplied with information data of the moving image display area set by the moving image display area setting means 4 as already described with reference to FIG. Based on this, the controller circuit 1 controls the drive switches Sal to San so as to select the first group of constant current sources Ial to Ian when the pixels in the moving image display area are lit, and displays non-moving images.
  • the drive switches Sal to San are controlled so that the second group of constant current sources Ibl to Ibn are selected.
  • control the drive switches Sal to San so that the reference potential (ground potential) is selected.
  • the first group of constant current sources Ial to Ian whose constant current value is variable according to the brightness control (PLE control) data from the brightness control means 6 is applied to each pixel (EL element) in the moving image display area.
  • the drive current from is supplied.
  • a PLE operation is realized in which the luminance of each pixel corresponding to the moving image display area is variably controlled in accordance with the lighting rate obtained by the lighting rate calculation means 5 described above.
  • a constant drive current from the first group of constant current sources Ial to Ian is supplied to each pixel in the non-moving picture display area, so that the brightness of each pixel corresponding to the non-moving picture display area is kept constant. Can keep.
  • the moving image display area and the non-moving image display area are divided depending on the arrangement direction of the anode lines Al to An as the data lines in the display panel 31. . That is, when the arrangement direction of the anode lines Al to An is the vertical direction as in the display panel 31 shown in FIG. 9, the moving image display area B and the non-moving image display are displayed on the screen A as shown in FIG. Region C will be partitioned by a vertical line.
  • the moving image display area B and the non-moving image display area C can be configured to be partitioned by horizontal lines.
  • FIG. 10 to FIG. 13 show another example of a display control device that is useful for the present invention, which is intended for an active matrix type display panel employing a SES (Simultaneous Erasing Scan) drive system.
  • SES Simultaneous Erasing Scan
  • An example of the display control device is shown.
  • parts that perform the same functions as those shown in FIG. 6 already described are denoted by the same reference numerals, and thus detailed description thereof is omitted.
  • the pixels to be lit corresponding to the moving image display area are not lit (turned off) in the middle of one frame or one subframe period.
  • a turn-off scanning means for controlling is provided.
  • the luminance control means 6 is characterized in that the timing of the extinguishing operation in the extinction scanning means is controlled according to the lighting rate of the pixels in the moving image display area obtained by the lighting rate calculation means 5.
  • the erase timing signal generating means 8 and the erase driver 15 functioning as the above-described extinguishing scanning unit are compared with the configuration shown in FIG. Is provided.
  • the erase timing signal generation means 8 operates to adjust the output timing of the erase control signal (erase pulse) according to the synchronization signal from the controller circuit 1 and the brightness control (PLE control) data from the brightness control means 6. To do.
  • the erase timing signal generation means 8 will be described later in detail with reference to FIG.
  • the erase driver 15 functions to receive the timing signal from the erase timing signal generating means 8 and to turn off the pixel 12 during one frame or one subframe period. That is, in the display panel 11, erase signal lines 23 are arranged corresponding to the scanning lines 21 of the respective pixels 12. By supplying an erase pulse to the erase signal lines 23, the erase signal lines 23 can be handled. It operates to turn off the pixels to be turned off.
  • FIG. 11 shows an example of the configuration of a pixel that is preferably employed in the SES drive method described above.
  • the pixel configuration example shown in FIG. 11 further includes an erasing transistor Tr3 by TFT in addition to the pixel configuration shown in FIG.
  • the source and drain of the erasing transistor Tr 3 are connected to both ends of the charge holding capacitor C 1, respectively, and the gate is connected to the erasing driver via the erasing signal line 23 arranged in the display panel 11.
  • the functions of the transistors Trl and Tr2 are the same as in the example shown in FIG.
  • the gate of the erasing transistor Tr3 is in the middle of the lighting period of the EL element E1 (in the present embodiment, in the middle of one subframe period).
  • the erase driver Er is supplied from the erase driver 15 via the erase signal line 23 to turn on the transistor Tr3.
  • the electric charge charged in the capacitor C1 is erased (discharged) instantaneously.
  • the driving transistor Tr2 is cut off, and the EL element E1 is immediately turned off.
  • the lighting period in one subframe of the EL element E1 is controlled, thereby realizing multi-gradation expression.
  • FIG. 12 illustrates the PLE control of the moving image display area performed by the configuration shown in FIGS. 10 and 11.
  • one frame period is divided into a plurality of subframes, and gradation control is performed by adding up the lighting periods of pixels within one frame period by selecting this subframe. Control means to achieve this is adopted.
  • one frame period is divided into seven subframes (SF1 to SF7) for simplification of description, and each subframe in one frame period is selected, so that An example of realizing gradation expression (100% non-lighting can be regarded as one gradation, 7 + 1 gradation expression) is shown.
  • FIGS. 12 (a) and 12 (b) show an example of controlling the ratio of the lighting period and the non-lighting period for each subframe based on the luminance control data from the luminance control means 6.
  • FIG. Yes shows a large proportion of the lighting period for each subframe, and (b) shows the percentage power of the lighting period for each subframe.
  • Note that (a) and (b) show examples in which the gamma value of the gradation characteristic is the same and the dimmer characteristic is changed.
  • the lighting control shown in FIG. 12 (a) is executed in the moving image display area, and the pixel points in the moving image display area are When the lighting rate is high, the lighting control shown in Fig. 12 (b) is controlled in the moving image display area.
  • the ratio of the lighting period for each subframe is controlled so as to change between FIGS. 12 (a) and 12 (b) according to the level of the lighting rate of the pixel.
  • 12 (c) and 12 (d) illustrate the generation timings of the write pulse and the erase pulse described above when the lighting control shown in FIG. 12 (b) is realized.
  • the write pulse shown in (c) is generated in synchronization with the start of each subframe, whereby the pixel is turned on.
  • an erasure norm shown as (d) is generated, whereby the pixel is turned off.
  • the erase pulse shown in FIG. 12 (d) can be generated by the erase timing signal generating means 8 shown in FIG. 13 described next.
  • reference numeral 8a indicates a subframe counter
  • reference numeral 8b indicates a logical operation unit
  • reference numeral 8c indicates a luminance setting table. That is, the subframe counter 8a operates based on the synchronization signal from the controller 1 so as to supply a control signal synchronized with the subframe to the logical operation unit 8b.
  • the luminance setting table 8c is supplied with luminance control (PLE control) data from the luminance control means 6, and an appropriate luminance setting table is selected based on the luminance control data.
  • the lighting period for each subframe is stored as a parameter.
  • the logical operation unit 8b accesses the selected table and corresponds to the subframe numberer. Based on the stored lighting time parameter, it operates to generate the output timing signal of the erase pulse.
  • This timing The signal is supplied to the above-described erase driver 15, and the erase driver 15 operates to output an erase pulse for each subframe as described above.
  • the PLE control is performed based on the lighting rate of the pixels in the moving image display area with a specific gamma characteristic.
  • the erasure driver 15 performs an erasing operation corresponding to the moving image display area, thereby performing brightness control of the moving image display area.
  • the erasing operation by the erasing driver 15 is not executed in the non-moving image display area, and the gradation corresponding to the input video signal is made in the pixels corresponding to the non-moving image display area.
  • the moving image display region and the non-moving image display region are divided according to the arrangement direction of the erasing signal lines 23 arranged on the display panel 11. . That is, when the arrangement direction of the erasing signal line 23 is horizontal as in the display panel 11 shown in FIG. 10, the video display area B and the non-video display are displayed on the screen A as shown in FIG. Region C will be bounded by horizontal lines.
  • the arrangement relationship of the scanning lines 21, the data lines 22, and the erasing signal lines 23 shown in FIG. 10 is arranged on the display panel 11 as it is, for example, rotated by 90 degrees as shown in FIG.
  • the moving image display area B and the non-moving image display area C can be configured to be partitioned by vertical lines.

Abstract

 表示パネル11において表示される画像内の動画表示領域を設定する動画表示領域設定手段4と、この動画表示領域設定手段により設定された動画表示領域における画素の点灯率を算出する点灯率算出手段5が備えられる。フレームメモリ3から読み出された映像信号は輝度制御手段6に供給され、輝度制御手段6は前記点灯率算出手段5により算出された画素の点灯率に応じて、表示パネル11において表示される動画表示領域の発光輝度を可変制御するように動作する。

Description

明 細 書
映像信号の表示制御装置および表示制御方法
技術分野
[0001] この発明は、表示すべき映像信号の平均輝度レベル(APL= Average Picture
Level)を求めて、この平均輝度レベルに基づいて映像表示装置における表示輝 度を制御する例えば PLE (Peak Luminance Enhancement)制御手段を備えた 映像信号の表示制御装置および表示制御方法に関する。
背景技術
[0002] 例えば PDP (プラズマディスプレイパネル)などにお!、ては、画像表示を行うにあた つては、前記した PLE制御が実行される。この PLE制御はフィールドもしくはフレーム 画面全体に対応する映像信号の前記平均輝度レベルを算出し、この平均輝度レべ ルに基づいて実際に画像表示させるための表示輝度レベルを制御するように動作す る。
[0003] この場合、前記 PLE制御では同じ輝度レベルの映像信号であっても、平均輝度レ ベルが小さい場合 (画像全体が暗い場合)には、表示輝度レベルを高く設定して高 輝度な表示が行われるように制御される。これに対して平均輝度レベルが大き ヽ場 合 (画像全体が明るい場合)には、表示輝度レベルを下げて電力消費量を抑制する ように制御される。このようにして PLE制御が行われることにより、低消費電力化を実 現させることができると共に、コントラストの良好な画像を表示させることが可能となる。
[0004] 前記したように、表示すべき映像信号の平均輝度レベル APLを求め、この APUこ より表示輝度レベルを制御する PLE制御手段を備えた表示装置は、次に示す特許 文献 1および 2などに示されている。
特許文献 1 :特開平 9 281927号公報
特許文献 2:特開 2001— 175220号公報
発明の開示
発明が解決しょうとする課題
[0005] ところで、前記した表示装置によって表示される映像画面には、動画表示領域と非 動画 (静止画)表示領域が共存する場合がある。図 1および図 2はその一例を示した ものであり、符号 Aで示す全体の領域は表示装置によって表示される映像の全体画 面を示しており、符号 Bで示す領域は動画表示領域を示して 、る。
[0006] すなわち、図 1および図 2に示した例においては、動画表示領域 Bの外側に Cとして 示した非動画表示領域が額縁状に形成され、前記額縁状の非動画表示領域 Cの下 側の領域には、例えばアイコンなどの固定パターンが表示された例を示している。
[0007] 前記図 1および図 2に示したようにレイアウトされた表示画面 Aにおいて、前記した P LE制御を行った場合には、この PLE制御はフィールドもしくはフレーム画面全体に 対応する平均輝度レベル (APL)に基づいて、全体画面の表示輝度レベルを制御す るように動作するので、例えば図 1に示したように動画表示領域 Bの画面が全体に明 るい場合には、全体画面の表示輝度レベルが下げられて、 Cとして示す非動画表示 領域は暗く表示されるように制御される。
[0008] また、図 2に示したように動画表示領域 Bの画面が全体に暗い場合には、全体画面 の表示輝度レベルが上げられて、 Cとして示す非動画表示領域は明るく表示されるよ うに制御される。すなわち、非動画表示領域 Cは、動画表示領域 Bの輝度レベルに 応じて、その都度表示輝度レベルが制御されるために、ユーザに対しては非動画表 示領域において、ちらつきが発生しているような見苦しさを感じさせる結果を招来させ る。
[0009] この発明は、動画表示領域と非動画表示領域が存在する画像を表示する表示手 段にお 1、て、 PLE制御を実行するように構成した場合に発生する前記した技術的な 問題点を解消できるようにした映像信号の表示制御装置および表示制御方法を提 供することを課題とするものである。
課題を解決するための手段
[0010] 前記した課題を解決するためになされたこの発明に力かる表示制御装置における 好ましい基本形態は、複数のデータ線と複数の走査線の各交差位置に画素が配置 され、入力映像信号に基づいて前記画素を選択的に点灯駆動させることで画像を表 示する映像信号の表示制御装置であって、表示される前記画像内の動画表示領域 における画素の点灯率に応じて、前記動画表示領域における発光輝度を可変制御 する輝度制御手段を具備した構成にされる。
[0011] また、前記した課題を解決するためになされたこの発明に力かる表示制御方法に おける好まし 、基本態様は、複数のデータ線と複数の走査線の各交差位置に画素 が配置され、入力映像信号に基づいて前記画素を選択的に点灯駆動させることで画 像を表示する映像信号の表示制御方法であって、表示される前記画像内の動画表 示領域を設定する動画表示領域設定動作と、前記動画表示領域設定動作により設 定された動画表示領域における画素の点灯率を算出する点灯率算出動作と、前記 点灯率算出動作により算出された点灯率に応じて前記動画表示領域における発光 輝度の可変制御を行う輝度制御動作とが実行される点に特徴を有する。
図面の簡単な説明
[0012] [図 1]動画表示領域と非動画表示領域が共存する場合において PLE制御が実行さ れた場合の表示例を説明する模式図である。
[図 2]同じく他の表示例を説明する模式図である。
[図 3]この発明にかかる表示制御装置における第 1の構成例を示したブロック図であ る。
[図 4]図 3に示す表示パネルに配列される好ましい画素の構成例を示した回路構成 図である。
[図 5]図 3および図 4に示す構成によってなされる階調制御手段の一例を示すタイミン グ図である。
[図 6]この発明にかかる表示制御装置における第 2の構成例を示したブロック図であ る。
[図 7]動画表示領域と非動画表示領域の区画例を説明する模式図である。
[図 8]同じく他の区画例を説明する模式図である。
[図 9]この発明にかかる表示制御装置における第 3の構成例を示したブロック図であ る。
[図 10]同じく第 4の構成例を示したブロック図である。
[図 11]図 10に示す表示パネルに配列される好ましい画素の構成例を示した回路構 成図である。 [図 12]図 10および図 11に示す構成によってなされる階調制御手段の一例を示すタ イミング図である。
[図 13]図 10に示す構成において好適に採用される消去タイミング信号生成手段の 構成例を示したブロック図である。
符号の説明
1 コントローラ回路
2 AZD変換部
3 映像信号メモリ
4 動画表示領域設定手段
5 点灯率算出手段
6 輝度制御手段
8 消去タイミング信号生成手段
11, 31 表示パ不ノレ
12 画素
13, 33 走 ドライノ
13, 32 データドライノ
15 消去ドライバ (消灯走査手段)
16 電源供給回路
21 ¾査^ ζ
22 データ線
23 消去信号線
24 電源供給線
A 映像画面
B 動画表示領域
C 非動画 (静止画)表示領域
C1 電荷保持用キャパシタ
El, El l- -Enm EL素子 (発光素子)
EF1 固定電圧源 EV1 可変電圧源
Ial〜工 an 定電流源 (第 1群)
Ibl〜Ibn 定電流源 (第 2群)
Trl データ書き込みトランジスタ
Tr2 点灯駆動トランジスタ
Tr3 消去用トランジスタ
発明を実施するための最良の形態
[0014] 以下、この発明にかかる映像信号の表示制御装置および表示制御方法について、 図に示す実施の形態に基づいて説明する。なお、以下においては有機 EL (エレクト 口ルミネッセンス)素子に代表される発光素子を表示画素として用いた表示パネルを 点灯制御する例に基づいて説明する。
[0015] 図 3は、その第 1の形態を示したものであり、これはアクティブマトリクス型表示パネ ルを対象とした表示制御装置の例を示して ヽる。
[0016] 図 3に示すようにコントローラ回路 1にはアナログ Zデジタル (AZD)変換部 2およ び映像信号メモリ(以下、 VRAMとも言う。 ) 3が接続されており、アナログ映像信号に よる入力映像信号は、コントローラ回路 1および AZD変換部 2に供給されるように構 成されている。
[0017] 前記コントローラ回路 1はアナログ映像信号中における水平および垂直同期信号 に基づいて、前記 AZD変換部 2に対するクロック信号 CK、前記 VRAM3に対する 書き込み信号 Wおよび読み出し信号 Rを生成する。
[0018] 前記 AZD変換部 2は、コントローラ回路 1から供給されるクロック信号 CKに基づい て、入力されるアナログ映像信号をサンプリングし、これを 1画素ごとの映像データに 変換して VRAM3に供給するように作用する。前記 VRAM3は前記コントローラ回路 1からの書き込み信号 Wによって AZD変換部 2から供給される映像データを VRAM 3に順次書き込むように動作する。
[0019] 前記 VRAM3としては例えばフレームメモリが用いられており、前記した書き込み動 作によって、後述する表示パネルにおける一画面分の映像信号の書き込みが行わ れる。また、 VRAM3に書き込まれた映像信号は前記コントローラ回路 1からの読み 出し信号 Rを受けて読み出され、動画表示領域設定手段 4および輝度制御手段 6〖こ 供給されるように構成されている。なお、図 3においては、動画表示領域設定手段は 、動画領域設定手段 4と表記している。
[0020] 前記動画表示領域設定手段 4としては、後述する表示パネルにおける画像の表示 形態によって、二つの異なった機能を備えた構成を適宜採用することができる。その 一つは、例えば図 1および図 2に示したように表示画面 Aにおける動画表示領域 Bと 非動画表示領域 Cとが常に定められて、各領域が変化しない場合である。この場合 においては前記動画表示領域設定手段 4としては、予め定められた動画表示領域を 前記各画素単位で指定するように構成される。すなわち、動画表示領域設定手段 4 は予め定められた動画表示領域 Bに対応する VRAM3からの映像データを抽出して 、後述する点灯率算出手段 5に供給するように動作する。
[0021] また他の一つは、図 1および図 2に示した表示画面 Aにおいて、動画表示領域 Bと 非動画表示領域 Cとが入力映像信号によって変化する場合である。この場合におい ては、前記動画表示領域設定手段 4としては、前記各画素に対応する入力映像信号 の時間変化を検出することにより前記動画表示領域を検知し、その都度、動画表示 領域を前記各画素単位で指定するように構成される。すなわち、この場合の動画表 示領域設定手段 4は、入力映像信号の時間変化の検出により設定される動画表示 領域 Bに対応する VRAM3からの映像信号を抽出して、後述する点灯率算出手段 5 に供給するように動作する。
[0022] なお、前記動画表示領域設定手段 4は、前記した後者の場合にお!、て、非動画表 示領域 (静止画領域)を検知することによって、前記静止画領域以外の領域すなわ ち動画表示領域を設定するようにしてもよ!ヽ。
[0023] 前記動画表示領域設定手段 4からの動画表示領域に対応する VRAM3からの映 像信号は点灯率算出手段 5に供給され、この点灯率算出手段 5は動画表示領域に 対応する映像信号に基づいて画素単位の点灯率を算出するように動作する。なお、 前記点灯率算出手段 5は、動画表示領域に対応するすでに説明した映像信号の平 均輝度レベル (APL)を算出する機能と同等の結果を得ることができる。
[0024] 前記点灯率算出手段 5によって得られる動画表示領域における点灯率のデータは 、輝度制御手段 6に供給される。この輝度制御手段 6には前記したとおり VRAM3か ら読み出された映像データが供給されるように構成されており、前記輝度制御手段 6 は VRAM3から読み出された映像信号のうち、動画表示に対応する映像信号の階 調値を前記点灯率に基づいて変更する映像信号の変換処理を実行する。
[0025] すなわち、輝度制御手段 6は VRAM3から読み出された映像信号のうち、動画表 示に寄与する映像信号を前記点灯率算出手段 5により算出された画素の点灯率に 応じた輝度に対応する階調値に変換する処理を実行するように動作する。これ〖こより 、後述する表示パネルに配列された動画表示領域における各画素の発光輝度を制 御する PLE制御が実現される。そして、輝度制御手段 6は PLE制御による階調制御 が施された前記映像信号を、後述するデータドライバにお 、て駆動可能な信号形態 に変換して出力する。
[0026] なお、前記したコントローラ回路 1は、映像信号中における前記水平および垂直同 期信号に基づいて、後述する走査ドライバ 13およびデータドライバ 14に対するシフト クロック信号やスタートパルス等を生成し、それぞれのドライバ 13, 14に供給するよう に構成されている。
[0027] 図 3に示す符号 11は前記した有機 EL素子力 なる発光素子をそれぞれに含む多 数の画素 12をマトリクス状に配列した表示パネルを示して!/、る。この表示パネル 11 には、走査ドライバ 13、データドライバ 14にそれぞれ接続される走査線 21、データ 線 22が互いに直交する方向に配列されており、これらの交差位置に前記発光素子 を含む画素 12がそれぞれ配置されている。なお、前記各画素 12には、電源供給回 路 16より画素の点灯駆動用電圧が電源供給線 24を介して、それぞれ供給されるよう に構成されている。
[0028] 図 4は前記した表示パネル 11に配置された 1つの画素に対応する回路構成を示す ものであり、これは発光素子として有機 EL素子を用いる場合の最も基本的な画素構 成を示している。この画素 12には前記データドライバ 14からの映像信号に対応した データ信号 Vdataが、表示パネルに配列されたデータ線 22を介して制御用 TFT、 すなわちデータ書き込みトランジスタ Trlのソースに供給されるように構成されている [0029] 前記データ書き込みトランジスタ Trlのゲートには、走査ドライバ 13に接続された走 查線 21を介して走査信号 Select (これを書き込みノルスとも言う。 )力供給されるよう に構成されている。前記データ書き込みトランジスタ Trlのドレインは、点灯駆動用 T FT、すなわち点灯駆動トランジスタ Tr2のゲートに接続されると共に、電荷保持用キ ャパシタ C1の一方の端子に接続されて 、る。
[0030] また、点灯駆動トランジスタ Tr2のソースは、前記キャパシタ C1の他方の端子に接 続されると共に、電源供給線 24を介して前記した電源供給回路 16より駆動電圧 Vcc が供給されるように構成されている。前記点灯駆動トランジスタ Tr2のドレインは、発 光素子としての有機 EL素子 E1のアノード端子に接続され、この有機 EL素子 E1の力 ソード端子は、表示パネルの基準電位点 (グランド)に接続されている。
[0031] なお、図 4に示す画素 12の回路構成においては、データ書き込みトランジスタ Trl 力 ¾チャンネル型 TFTにより構成され、駆動トランジスタ Tr2力 ¾チャンネル型 TFTに より構成されている。そして、前記した構成による画素 12は、図 3に示したように行お よび列方向にマトリクス状に多数配置されて表示パネル 11が構成されて 、る。
[0032] 図 4に示した画素 12の構成において、制御トランジスタ Trlのゲートには、アドレス 期間にお 、て走査ドライバ 13より走査信号としての書き込みノルス Selectが供給さ れる。この時、データドライバ 14力も供給されるデータ信号 Vdataが画素を点灯させ るデータである場合においては、制御トランジスタ Trlのソース'ドレインを介して、デ ータ信号 Vdataに対応した電流がキャパシタ C1に流れ、キャパシタ C1は充電される
[0033] そして、その充電電圧が駆動トランジスタ Tr2のゲートに供給されて、トランジスタお 2はそのゲート電圧とドレインに供給される駆動電圧 Vccに対応した電流を前記 EL 素子 E1に流し、これにより EL素子 E1は発光(点灯)する。
[0034] 前記制御トランジスタ Trlのゲートに対する前記書き込みパルスの印加が停止され ると、トランジスタ Trlはいわゆるカットオフとなる。し力しながら、キャパシタ C1に蓄積 された電荷により駆動トランジスタ Tr2のゲート電圧が保持され、これにより EL素子 E 1への駆動電流が維持される。
[0035] したがって、 EL素子 E1は次のアドレス動作に至る期間において、前記データ信号 Vdataに対応した点灯状態を継続することができる。それ故、前記したアドレス期間 において、データドライバ 14から供給されるデータ信号 Vdataに応じて画素の点灯も しくは消灯が制御され、これにより各画素の単位期間における点灯期間が個別に制 御されて階調制御が実現される。
[0036] 図 3および図 4に示した実施の形態においては、前記した PLE制御による階調表 現を実現させるために、 1フレーム期間を複数のサブフレームに分割し、各サブフレ ームごとに画素の点灯または非点灯を制御することで、 1フレーム期間内における画 素の点灯期間の累計により階調制御を実現する制御手段が採用されている。
[0037] 図 5はその階調制御の一例を示すものであり、この例においては説明を簡素化する ために 1フレーム期間を 7つのサブフレームに分割し、サブフレーム期間の単純な累 計により"階調 0"〜"階調 7"の 8階調を表現する単純サブフレーム法を示している。 この例においてはサブフレーム期間ごとに、そのサブフレーム期間の開始時に、前 記したデータドライバ 14より画素を点灯または非点灯に制御するデータ信号 Vdata が供給される。
[0038] ここで 1つのフレーム期間を構成する第 1〜第 7のサブフレームの全てにおいて、画 素を非点灯に制御するデータ信号が供給された場合には、図 5に示すように"階調 0 "が実現される。また、第 1〜第 7のサブフレームの全てにおいて、画素を点灯状態に 制御するデータ信号が供給された場合には、図 5に示すように"階調 7"が実現される
[0039] 前記した輝度制御手段 6はすでに説明したとおり、動画表示領域に対応する画素 の点灯率に応じて、動画表示領域の画素の階調を制御するものであり、点灯率が大 きくなる場合には階調を低くする制御を実行するように動作する。これにより、動画表 示領域に対応する画素の点灯率が例えば 100%に近い状態である場合においては 、入力される映像信号に基づく階調に対して、階調力 段 (nは整数)下げるように動 作する。したがって、前記点灯率が高い場合においては、動画表示領域における画 素の 1フレーム期間における点灯期間は縮小され、当該画素の発光輝度は抑制され る。この結果、低消費電力化を実現させることができる。
[0040] 一方、動画表示領域に対応する画素の点灯率が小さくなる場合には、入力される 映像信号に基づく階調に対して、動画表示領域の階調を n段 (nは整数)上げるよう に動作する。これにより、動画表示領域における画素の 1フレーム期間における累積 点灯期間が拡大され、動画表示領域におけるコントラストの良好な画像を表示させる ことが可能となる。なお、前記した実施の形態によると、非動画 (静止画)領域におい ては PLE動作は実行されないので、非動画領域の階調は入力映像信号に基づく階 調で表示される。
[0041] 次に、前記した図 3および図 4に示した表示制御装置の構成を利用して、他の PLE 制御動作を実現させることもできる。
[0042] この実施の形態における前記輝度制御手段 6は、動画表示領域に対応する各デ ータ線に供給するデータドライバ 14からの出力電圧値を、点灯率算出手段 5により得 られる動画表示領域における画素の点灯率に応じて可変制御するように構成した点 に特徴を有する。
[0043] この場合における図 4に示す画素構成におけるデータ書き込みトランジスタ Trlお よび点灯駆動トランジスタ Tr2はアナログ動作 (定電流駆動)領域にて動作するように 設定される。そして、各走査線 21に対応するそれぞれのアドレス期間において、動画 表示領域に対応する各データ線に供給するデータドライバ 14からのデータ信号 Vda taの電圧値が、前記点灯率算出手段 5により得られる点灯率に応じて可変制御され るように構成される。
[0044] この結果、各走査線 21に対応するそれぞれのアドレス期間において、各画素の電 荷保持用キャパシタ C1に書き込まれる電圧値は、前記データ信号 Vdataの電圧値 に対応したものとなる。そして、点灯駆動トランジスタ Tr2は電荷保持用キャパシタ C1 に書き込まれた電圧値に対応した駆動電流を、前記 EL素子 E1に供給するように動 作する。したがって、動画表示領域に対応する各画素 12の輝度は、前記した点灯率 算出手段 5により得られる点灯率に応じて可変制御される PLE動作が実現される。
[0045] この場合、各走査線 21に対応するそれぞれのアドレス期間において、非動画表示 領域に対応する各データ線に供給されるデータドライバ 14からのデータ信号 Vdata の電圧値は、前記点灯率に関係なく入力映像信号に基づいて制御される。したがつ て、非動画領域における画素の発光輝度が、前記点灯率による影響を受ける問題を 回避することができる。
[0046] 図 6は、この発明に力かる他の表示制御装置の例を示すものであり。なお、図 6に 示す構成において、すでに説明した図 3に示す各部と同様の機能を果たす部分を同 一符号で示しており、したがってその詳細な説明は省略する。また、図 6に示す表示 制御装置の構成においても、表示パネル 11に配列された各画素 12の構成は、図 4 に示した構成を採用することができる。
[0047] この図 6に示す実施の形態における輝度制御手段 6は、動画表示領域に対応する 画素に接続された電源供給線 24に対して、点灯率算出手段 5により得られる動画表 示領域における画素の点灯率に応じて可変される駆動電圧を供給し、非動画表示 領域に対応する画素に接続された電源供給線 24に対しては、予め定められた値の 駆動電圧を供給するように構成した点に特徴を有する。
[0048] このために前記電源供給回路 16には、輝度制御手段 6からの輝度制御(PLE制御 )データによって出力値が可変される可変電圧源 EV1と、予め定められた値の電圧 が出力される固定電圧源 EF1が備えられている。そして、前記可変電圧源 EV1もし くは固定電圧源 EF1からの駆動電圧を、各電源供給線 24に対して選択的に供給す るための選択手段としてのスィッチ SI, S2,……が各電源供給線 24に対応して備え られている。
[0049] また、図 6に示すように動画表示領域設定手段 4により設定される動画表示領域の 情報データが、コントローラ回路 1に供給されるように構成されている。そして、前記コ ントローラ回路 1は前記動画表示領域の情報データを受けて、電源供給回路 16にお ける前記各スィッチ SI, S2,……を、前記可変電圧源 EV1もしくは固定電圧源 EF1 側に択一的に接続するように制御する。
[0050] すなわち、前記動画表示領域設定手段 4からの動画表示領域の情報に基づいて、 動画表示領域の画素に対応する電源供給線 24には、前記各スィッチ SI, S2,…… を介して可変電圧源 EV1からの駆動電圧が供給されるように動作し、非動画表示領 域の画素に対応する電源供給線 24には、前記各スィッチ SI, S2,……を介して固 定電圧源 EF1からの駆動電圧が供給されるように動作する。
[0051] したがって、動画表示領域の各画素 12には、輝度制御手段 6からの輝度制御デー タによって出力値が可変される可変電圧源 EV1からの駆動電圧が供給され、これに より、動画表示領域に対応する各画素 12の輝度は、前記した点灯率算出手段 5によ り得られる点灯率に応じて可変制御される PLE動作が実現される。一方、非動画表 示領域の各画素 12には、固定電圧源 EF1からの駆動電圧が供給されるので、非動 画表示領域に対応する各画素 12は一定の輝度に保つことができる。
[0052] なお、図 6に示した実施の形態によると、表示パネル 11における電源供給線 24の 配列方向によって、動画表示領域および非動画表示領域が区画されることになる。 すなわち、図 6に示した表示パネル 11のように電源供給線 24の配列方向が縦方向 である場合には、図 7に示したように画面 Aにおいて、動画表示領域 Bおよび非動画 表示領域 Cが縦方向の線で区画されること〖こなる。
[0053] したがって、図 6に示す走査線 21、データ線 22、電源供給線 24の配列関係を、表 示パネル 11上においてそのまま例えば 90度回転させた状態に配列することで、図 8 に示すように画面 Aにお 、て、動画表示領域 Bおよび非動画表示領域 Cが横方向の 線で区画されるよう〖こ構成させることができる。
[0054] 図 9は、この発明に力かる他の表示制御装置の例を示すものであり、これはパッシ ブマトリクス型表示パネルを対象とした表示制御装置の例を示している。
[0055] この図 9に示す表示制御装置の構成においても、すでに説明した図 6に示した構成 と同様にコントローラ回路 1、 AZD変換部 2、 VRAM3,動画表示領域設定手段 4、 点灯率算出手段 5、輝度制御手段 6が具備されるが、図 9においてはコントローラ回 路 1、輝度制御手段 6を除き、前記他の構成は省略して示している。
[0056] この図 9に示す実施の形態における輝度制御手段 6は、動画表示領域に対応する 画素に接続されたデータ線に対して、点灯率算出手段 5により得られる動画表示領 域における画素の点灯率に応じて可変される駆動電流を供給し、非動画表示領域 に対応する画素に接続されたデータ線に対しては、予め定められた値の駆動電流を 供給するように構成した点に特徴を有する。
[0057] 図 9に示す表示パネル 31には、 n本のデータ線としての陽極線 Al〜Anが縦方向( 列方向)に配列され、 m本の走査線としての陰極線 Kl〜Kmが横方向(行方向)に 配列され、各々の交差した部分 (計 n X m箇所)に、ダイオードのシンボルマークで示 した画素を構成する有機 EL素子 El l〜Enmが各陽極線と走査線との間に接続され て配置されている。そして、各陽極線 Al〜Anはデータドライバとしての陽極線ドライ ブ回路 32に接続され、各陰極線 Kl〜Kmは同じく走査ドライバとしての陰極線走査 回路 33に接続されてそれぞれ駆動される。
[0058] 前記陽極線ドライブ回路 32には、駆動電圧 VHを利用して動作する第 1群の定電 流源 Ial〜Ianが備えられている。この第 1群の定電流源 Ial〜Ianには、前記輝度制 御手段 6からの PLE制御に基づく信号が供給される。これにより第 1群の定電流源 la l〜Ianは、すでに説明した点灯率算出手段 5により得られる動画表示領域における 画素の点灯率に応じて、その出力電流値 (駆動電流値)が制御されるように動作する
[0059] 一方、陽極線ドライブ回路 32には、第 2群の定電流源 Ibl〜Ibnが備えられており、 これは予め定められた値の駆動電流を供給するように構成されている。そして、前記 第 1群または第 2群の定電流源、もしくは基準電位点としてのグランドを選択すること ができる選択手段としてのドライブスィッチ Sal〜Sanが各陽極線 Al〜Anに対応し て備えられており、このドライブスィッチ Sal〜Sanは、コントローラ回路 1からの指令 信号によって切り換えられるように構成されて 、る。
[0060] また、前記陰極線走査回路 33には、各陰極線 Kl〜Kmに対応して走査スィッチ S kl〜Skmが備えられ、コントローラ回路 1からの指令信号によって、非走査選択電位 として機能するクロストーク発光を防止するための逆バイアス電圧源 VMまたは走査 選択電位として機能するグランド電位のうちのいずれか一方を、対応する陰極線に接 続するように作用する。
[0061] これにより、陰極線を所定の周期で基準電位点 (グランド電位)に設定しながら、所 望の陽極線 Al〜Anに第 1群または第 2群の定電流源を接続することにより、前記各 EL素子を選択的に発光させるように作用する。
[0062] なお、図 9に示す実施の形態においては、コントローラ回路 1より陰極線走査回路 3 3に対して走査同期信号が供給され、これにより各陰極線 Kl〜Kmを順次グランド電 位 (走査選択電位)に設定する動作が繰り返される。またコントローラ回路 1より陽極 線ドライブ回路 32に対して走査同期信号に同期して走査ラインごとにドライブ制御信 号が供給される。
[0063] すなわち、コントローラ回路 1には、図 6に基づいてすでに説明したように動画表示 領域設定手段 4により設定される動画表示領域の情報データが供給される。コント口 ーラ回路 1は、これに基づいて動画表示領域の画素を点灯させる場合においては第 1群の定電流源 Ial〜Ianを選択するようにドライブスィッチ Sal〜Sanを制御し、非 動画表示領域の画素を点灯させる場合においては第 2群の定電流源 Ibl〜Ibnを選 択するようにドライブスィッチ Sal〜Sanを制御する。さらに画素を非点灯にする場合 には基準電位 (グランド電位)を選択するようにドライブスィッチ Sal〜Sanを制御する
[0064] したがって、動画表示領域の各画素 (EL素子)には、輝度制御手段 6からの輝度制 御(PLE制御)データによって定電流値が可変される第 1群の定電流源 Ial〜Ianか らの駆動電流が供給される。これにより、動画表示領域に対応する各画素の輝度は、 すでに説明した点灯率算出手段 5により得られる点灯率に応じて可変制御される PL E動作が実現される。一方、非動画表示領域の各画素には、第 1群の定電流源 Ial 〜Ianからの一定の駆動電流が供給されるので、非動画表示領域に対応する各画素 の輝度を一定の輝度に保つことができる。
[0065] なお、図 9に示した実施の形態においても、表示パネル 31におけるデータ線として の陽極線 Al〜Anの配列方向によって、動画表示領域および非動画表示領域が区 画されることになる。すなわち、図 9に示した表示パネル 31のように陽極線 Al〜An の配列方向が縦方向である場合には、図 7に示したように画面 Aにおいて、動画表 示領域 Bおよび非動画表示領域 Cが縦方向の線で区画されることになる。
[0066] したがって、図 9に示す直交関係にあるデータ線 Al〜An、走査線 Kl〜Kmの配 列関係を、表示パネル 31上においてそのまま例えば 90度回転させた状態に配列す ることで、図 8に示すように画面 Aにおいて、動画表示領域 Bおよび非動画表示領域 Cが横方向の線で区画されるように構成せることができる。
[0067] 図 10〜図 13は、この発明に力かるさらに他の表示制御装置の例を示すものであり 、これは SES (Simultaneous Erasing Scan)駆動方式を採用したアクティブマト リクス型表示パネルを対象とした表示制御装置の例を示している。 [0068] なお、図 10に示す構成においては、すでに説明した図 6に示す各部と同様の機能 を果たす部分を同一符号で示しており、したがってその詳細な説明は省略する。
[0069] この図 10〜図 13に示す実施の形態においては、動画表示領域に対応する点灯対 象にされる画素を、 1フレームもしくは 1サブフレーム期間の途中において非点灯(消 灯)状態に制御する消灯走査手段が具備される。そして、輝度制御手段 6は前記消 灯走査手段における消灯動作のタイミングを、点灯率算出手段 5により得られる動画 表示領域における画素の点灯率に応じて制御するようにした点に特徴を有する。
[0070] 前記した動作を実現させるために図 10に示した構成においては、すでに説明した 図 6に示す構成に対して消去タイミング信号生成手段 8および前記した消灯走査手 段として機能する消去ドライバ 15が具備されている。前記消去タイミング信号生成手 段 8は、コントローラ回路 1からの同期信号、および輝度制御手段 6からの輝度制御( PLE制御)データによって、消去制御信号 (消去パルス)の出力タイミングを調整する ように動作するものである。なお、この消去タイミング信号生成手段 8については、図 13に基づいて後で詳しく説明する。
[0071] 一方、前記消去ドライバ 15は消去タイミング信号生成手段 8からのタイミング信号を 受けて、 1フレームもしくは 1サブフレーム期間の途中において、画素 12を消灯動作 させるように機能する。すなわち表示パネル 11には、各画素 12の走査線 21に対応 して消去信号線 23が配列されており、この消去信号線 23に消去パルスを供給するこ とにより、当該消去信号線 23に対応する画素を消灯させるように動作する。
[0072] 図 11は前記した SES駆動方式にぉ 、て好適に採用される画素の構成例を示した ものである。この図 11に示す画素の構成例は、図 4に示した画素の構成に加えて TF Tによる消去用トランジスタ Tr3がさらに具備されている。そして、消去用トランジスタ T r 3のソースおよびドレインは電荷保持用キャパシタ C 1の両端にそれぞれ接続されて おり、そのゲートには表示パネル 11に配列された前記消去信号線 23を介して消去ド ライバ 15より消去パルス Eraseが供給されるように構成されて!、る。
[0073] 前記した画素の構成において、トランジスタ Trlおよび Tr2の働きは、図 4に示した 例と同様である。一方、消去トランジスタ Tr3のゲートには、前記 EL素子 E1の点灯期 間の途中(この実施の形態においては、 1サブフレーム期間の途中)のタイミングにお いて、前記消去ドライバ 15よりトランジスタ Tr3をオンさせる消去パルス Eraseが消去 信号線 23を介して供給される。
[0074] これにより、キャパシタ C1にチャージされている電荷は瞬時にして消去 (放電)され る。この結果、駆動トランジスタ Tr2はカットオフ状態となり、 EL素子 E1は直ちに消灯 される。換言すれば、消去ドライバ 15からの消去パルス Eraseの出力タイミングを制 御することで、 EL素子 E1の 1サブフレームにおける点灯期間が制御され、これにより 多階調表現を実現させることができる。
[0075] 図 12は、図 10および図 11に示した構成によってなされる動画表示領域の PLE制 御を説明するものである。この PLE制御を実現させるにあたって、この実施の形態に おいては 1フレーム期間を複数のサブフレームに分割し、このサブフレームの選択に よる 1フレーム期間内における画素の点灯期間の累計により階調制御を実現する制 御手段が採用されている。
[0076] すなわち図 12に示す例は、説明を簡素化するために 1フレーム期間を 7つのサブ フレーム(SF1〜SF7)に分割し、 1フレーム期間における各サブフレームを選択する ことで、 8つの階調表現(100%非点灯も 1つの階調と見なすことができ、 7+ 1の階調 表現)を実現する例を示して 、る。
[0077] 図 12 (a)および (b)は、前記輝度制御手段 6からの輝度制御データに基づいて、サ ブフレームごとの点灯期間と非点灯期間の割合を制御する例を示したものであり、 (a )はサブフレームごとの点灯期間の割合が大きぐまた (b)はサブフレームごとの点灯 期間の割合力 、さい場合を示している。なお、前記 (a)および (b)は共に階調特性の ガンマ値が同一で、デイマー特性が変更される例を示して 、る。
[0078] ここで、動画表示領域における画素の点灯率が低!、場合にお 、ては、動画表示領 域において図 12 (a)に示す点灯制御が実行され、動画表示領域における画素の点 灯率が高い場合においては動画表示領域において図 12 (b)に示す点灯制御が実 行されるように制御される。要するに画素の点灯率の程度に応じて、サブフレームご との点灯期間の割合が図 12 (a)と (b)の間で変化するように制御される。これにより、 特に画素の点灯率が高い場合においては 1フレーム期間内における画素の点灯期 間の累計が低く抑えられ、各画素に供給される駆動電流値を抑制させることができる [0079] 図 12 (c)および (d)は、図 12 (b)に示した点灯制御を実現させる場合の前記した書 き込みパルスおよび消去パルスの発生タイミングを説明するものである。すなわち、 図 12に示す例においては、各サブフレームのスタートに同期して(c)に示す書き込 みパルスが発生し、これにより画素は点灯状態にされる。そして、そのサブフレームの 経過途中において (d)として示す消去ノルスが発生し、これにより画素は非点灯状 態にされる。
[0080] ここで、例えば"階調 8"を実現しょうとした場合には、 1フレーム期間において、画素 は図 12 (a)または (b)に示す一連の点灯パターンが実行される。また例えば"階調 5" を実現しょうとした場合には、図 12 (a)または (b)に示す Sfl〜Sf4の期間において 点灯駆動動作が実行され、それ以降の各サブフレームの期間 Sf5〜Sf7は全て消灯 状態にされる。これにより、 1フレーム期間における画素の点灯期間の累計にしたが つた発光輝度を得ることができる。
[0081] 図 12 (d)に示す消去パルスは、次に説明する図 13に示す消去タイミング信号生成 手段 8によって生成することができる。図 13における符号 8aはサブフレームカウンタ を、符号 8bは論理演算ユニットを、さらに符号 8cは輝度設定テーブルを示している。 すなわち、サブフレームカウンタ 8aはコントローラ 1からの同期信号に基づいて、サブ フレームに同期した制御信号を論理演算ユニット 8bに供給するように動作する。
[0082] また、前記輝度設定テーブル 8cには、前記輝度制御手段 6からの輝度制御(PLE 制御)データが供給され、この輝度制御データに基づいて適切な輝度設定テーブル が選択される。なお、選択された輝度設定テーブル 8cには、各サブフレームごとの点 灯期間がパラメータとして格納されている。
[0083] そして、サブフレームカウンタ 8aより、点灯制御されるべきサブフレームナンパが論 理演算ユニット 8bに供給された場合、論理演算ユニット 8bは選択されたテーブルを アクセスし、サブフレームナンパに対応して格納されている点灯時間のパラメータに 基づ ヽて、消去パルスの出力タイミング信号を生成するように動作する。
[0084] これは図 12 (d)に示したように動画表示領域の画素の点灯率にそれぞれ対応して サブフレームごとの消去パルスの出力タイミング信号として生成される。このタイミング 信号は前記した消去ドライバ 15に供給され、消去ドライバ 15からは前記したとおり、 各サブフレームごとに消去パルスを出力するように動作する。
[0085] 前記した実施の形態によると、特定のガンマ特性を持たせた状態で、動画表示領 域の画素の点灯率に基づいて PLE制御を行うように動作する。なお、前記した消去 ドライバ 15は動画表示領域に対応して消去動作を実行し、これにより動画表示領域 の輝度制御が実行される。換言すれば、非動画表示領域においては消去ドライバ 1 5による消去動作は実行されず、非動画表示領域に対応する画素においては、入力 映像信号に基づく階調になされる。
[0086] なお、図 10〜図 13に示した実施の形態においても、表示パネル 11に配列された 消去信号線 23の配列方向によって、動画表示領域および非動画表示領域が区画さ れることになる。すなわち、図 10に示した表示パネル 11のように消去信号線 23の配 列方向が横方向である場合には、図 8に示したように画面 Aにおいて、動画表示領 域 Bおよび非動画表示領域 Cは横方向の線で区画されることになる。
[0087] したがって、図 10に示す走査線 21、データ線 22、消去信号線 23の配列関係を、 表示パネル 11上にぉ 、てそのまま例えば 90度回転させた状態に配列することで、 図 7に示すように画面 Aにお 、て、動画表示領域 Bおよび非動画表示領域 Cが縦方 向の線で区画されるように構成させることができる。

Claims

請求の範囲
[1] 複数のデータ線と複数の走査線の各交差位置に画素が配置され、入力映像信号 に基づいて前記画素を選択的に点灯駆動させることで画像を表示する映像信号の 表示制御装置であって、
表示される前記画像内の動画表示領域における画素の点灯率に応じて、前記動 画表示領域における発光輝度を可変制御する輝度制御手段を具備したことを特徴と する映像信号の表示制御装置。
[2] 表示される前記画像内の動画表示領域を設定する動画表示領域設定手段と、前 記動画表示領域設定手段により設定された動画表示領域における画素の点灯率を 算出する点灯率算出手段がさらに具備され、
前記輝度制御手段は、前記点灯率算出手段により算出された画素の点灯率に応 じて、前記動画表示領域の発光輝度を可変制御するように構成したことを特徴とする 請求項 1に記載された映像信号の表示制御装置。
[3] 前記動画表示領域設定手段では、表示される前記画像内の静止画領域を検知す ることによって、前記表示画像内の前記静止画領域以外の領域を前記動画領域とし て設定することを特徴とする請求項 2に記載された映像信号の表示制御装置。
[4] 前記動画表示領域設定手段は、予め定められた前記各画素に対応する表示領域 を指定することにより、もしくは前記各画素に対応する入力映像信号の時間変化を検 出することにより、前記動画表示領域を設定するように構成したことを特徴とする請求 項 2または請求項 3に記載された映像信号の表示制御装置。
[5] 前記輝度制御手段は、前記点灯率算出手段により算出された画素の点灯率に応 じて、前記動画表示領域を表示する映像信号の変換処理を実行するように構成した ことを特徴とする請求項 2または請求項 3に記載された映像信号の表示制御装置。
[6] 前記輝度制御手段は、前記点灯率算出手段により算出された画素の点灯率に応 じて、前記動画表示領域を表示する映像信号の変換処理を実行するように構成した ことを特徴とする請求項 4に記載された映像信号の表示制御装置。
[7] 前記映像信号の変換処理は、前記入力映像信号を前記点灯率算出手段により算 出された画素の点灯率に応じた輝度に対応する階調値に変換する処理であることを 特徴とする請求項 5に記載された映像信号の表示制御装置。
[8] 前記映像信号の変換処理は、前記入力映像信号を前記点灯率算出手段により算 出された画素の点灯率に応じた輝度に対応する階調値に変換する処理であることを 特徴とする請求項 6に記載された映像信号の表示制御装置。
[9] 前記輝度制御手段は、動画表示領域に対応する各データ線に供給するデータドラ ィバからの出力電圧値を、前記点灯率に応じて可変制御するように構成したことを特 徴とする請求項 2または請求項 3に記載された映像信号の表示制御装置。
[10] 前記輝度制御手段は、動画表示領域に対応する各データ線に供給するデータドラ ィバからの出力電圧値を、前記点灯率に応じて可変制御するように構成したことを特 徴とする請求項 4に記載された映像信号の表示制御装置。
[11] 前記輝度制御手段は、前記動画表示領域に対応する画素に接続された電源供給 線に対して、前記点灯率に応じて可変される駆動電圧を供給し、非動画表示領域に 対応する画素に接続された電源供給線に対しては、予め定められた値の駆動電圧 を供給するように構成したことを特徴とする請求項 2または請求項 3に記載された映 像信号の表示制御装置。
[12] 前記輝度制御手段は、前記動画表示領域に対応する画素に接続された電源供給 線に対して、前記点灯率に応じて可変される駆動電圧を供給し、非動画表示領域に 対応する画素に接続された電源供給線に対しては、予め定められた値の駆動電圧 を供給するように構成したことを特徴とする請求項 4に記載された映像信号の表示制 御装置。
[13] 前記電源供給線に対して、選択手段を介して前記点灯率に応じて可変される駆動 電圧または予め定められた値の駆動電圧が供給されるように構成したことを特徴とす る請求項 11に記載された映像信号の表示制御装置。
[14] 前記電源供給線に対して、選択手段を介して前記点灯率に応じて可変される駆動 電圧または予め定められた値の駆動電圧が供給されるように構成したことを特徴とす る請求項 12に記載された映像信号の表示制御装置。
[15] 前記輝度制御手段は、前記動画表示領域に対応する画素に接続された前記デー タ線に対して、前記点灯率に応じて可変される駆動電流を供給し、非動画表示領域 に対応する画素に接続された前記データ線に対しては、予め定められた値の駆動電 流を供給するように構成したことを特徴とする請求項 2または請求項 3に記載された 映像信号の表示制御装置。
[16] 前記輝度制御手段は、前記動画表示領域に対応する画素に接続された前記デー タ線に対して、前記点灯率に応じて可変される駆動電流を供給し、非動画表示領域 に対応する画素に接続された前記データ線に対しては、予め定められた値の駆動電 流を供給するように構成したことを特徴とする請求項 4に記載された映像信号の表示 制御装置。
[17] 前記データ線に対して、選択手段を介して前記点灯率に応じて可変される駆動電 流または予め定められた値の駆動電流が供給されるように構成したことを特徴とする 請求項 15に記載された映像信号の表示制御装置。
[18] 前記データ線に対して、選択手段を介して前記点灯率に応じて可変される駆動電 流または予め定められた値の駆動電流が供給されるように構成したことを特徴とする 請求項 16に記載された映像信号の表示制御装置。
[19] 前記動画表示領域に対応する点灯対象にされる画素を、 1フレームもしくは 1サブ フレーム期間の途中において非点灯 (消灯)状態に制御する消灯走査手段が具備さ れ、前記輝度制御手段は前記消灯走査手段における消灯動作のタイミングを、前記 点灯率に応じて制御するように構成したことを特徴とする請求項 2または請求項 3に 記載された映像信号の表示制御装置。
[20] 前記動画表示領域に対応する点灯対象にされる画素を、 1フレームもしくは 1サブ フレーム期間の途中において非点灯 (消灯)状態に制御する消灯走査手段が具備さ れ、前記輝度制御手段は前記消灯走査手段における消灯動作のタイミングを、前記 点灯率に応じて制御するように構成したことを特徴とする請求項 4に記載された映像 信号の表示制御装置。
[21] 非動画表示領域に対応する画素においては、前記消灯走査手段による消灯動作 が実行されな ヽように構成したことを特徴する請求項 19に記載された映像信号の表 示制御装置。
[22] 非動画表示領域に対応する画素においては、前記消灯走査手段による消灯動作 が実行されな ヽように構成したことを特徴する請求項 20に記載された映像信号の表 示制御装置。
[23] 複数のデータ線と複数の走査線の各交差位置に画素が配置され、入力映像信号 に基づいて前記画素を選択的に点灯駆動させることで画像を表示する映像信号の 表示制御方法であって、
表示される前記画像内の動画表示領域を設定する動画表示領域設定動作と、 前記動画表示領域設定動作により設定された動画表示領域における画素の点灯 率を算出する点灯率算出動作と、
前記点灯率算出動作により算出された点灯率に応じて前記動画表示領域におけ る発光輝度の可変制御を行う輝度制御動作と、
が実行されることを特徴とする映像信号の表示制御方法。
[24] 前記動画表示領域設定動作では、表示される前記画像内の静止画領域を検知す ることによって、前記表示画像内の前記静止画領域以外の領域を前記動画領域とし て設定する動作が実行されることを特徴とする請求項 23に記載された映像信号の表 示制御方法。
[25] 前記動画表示領域設定動作が、予め定められた前記各画素に対応する表示領域 を指定することにより、もしくは前記各画素に対応する入力映像信号の時間変化を検 出することにより実行されることを特徴とする請求項 23または請求項 24に記載された 映像信号の表示制御方法。
[26] 前記入力映像信号を、前記点灯率算出動作により算出された画素の点灯率に応じ た輝度に対応する階調値に変換する処理を実行することで、前記動画表示領域の 発光輝度の可変制御を行うことを特徴する請求項 23または請求項 24に記載された 映像信号の表示制御方法。
[27] 前記入力映像信号を、前記点灯率算出動作により算出された画素の点灯率に応じ た輝度に対応する階調値に変換する処理を実行することで、前記動画表示領域の 発光輝度の可変制御を行うことを特徴する請求項 25に記載された映像信号の表示 制御方法。
[28] 前記動画表示領域に対応する各データ線に供給するデータドライバからの出力電 圧値を、前記点灯率に応じて可変制御する動作を実行することにより、前記動画表 示領域の発光輝度の可変制御を行うことを特徴する請求項 23または請求項 24に記 載された映像信号の表示制御方法。
[29] 前記動画表示領域に対応する各データ線に供給するデータドライバからの出力電 圧値を、前記点灯率に応じて可変制御する動作を実行することにより、前記動画表 示領域の発光輝度の可変制御を行うことを特徴する請求項 25に記載された映像信 号の表示制御方法。
[30] 前記動画表示領域に対応する画素に接続された電源供給線に対して、前記点灯 率に応じて可変される駆動電圧を供給し、非動画表示領域に対応する画素に接続さ れた電源供給線に対しては、予め定められた値の駆動電圧を供給する動作を実行 することにより、前記動画表示領域の発光輝度の可変制御を行うことを特徴する請求 項 23または請求項 24に記載された映像信号の表示制御方法。
[31] 前記動画表示領域に対応する画素に接続された電源供給線に対して、前記点灯 率に応じて可変される駆動電圧を供給し、非動画表示領域に対応する画素に接続さ れた電源供給線に対しては、予め定められた値の駆動電圧を供給する動作を実行 することにより、前記動画表示領域の発光輝度の可変制御を行うことを特徴する請求 項 25に記載された映像信号の表示制御方法。
[32] 前記動画表示領域に対応する画素に接続された前記データ線に対して、前記点 灯率に応じて可変される駆動電流を供給し、非動画表示領域に対応する画素に接 続された前記データ線に対しては、予め定められた値の駆動電流を供給する動作を 実行することにより、前記動画表示領域の発光輝度の可変制御を行うことを特徴する 請求項 23または請求項 24に記載された映像信号の表示制御方法。
[33] 前記動画表示領域に対応する画素に接続された前記データ線に対して、前記点 灯率に応じて可変される駆動電流を供給し、非動画表示領域に対応する画素に接 続された前記データ線に対しては、予め定められた値の駆動電流を供給する動作を 実行することにより、前記動画表示領域の発光輝度の可変制御を行うことを特徴する 請求項 25に記載された映像信号の表示制御方法。
[34] 前記動画表示領域に対応する点灯対象にされる画素を、 1フレームもしくは 1サブ フレームの期間の途中において非点灯状態に制御する消灯動作のタイミングを、前 記点灯率に応じて制御する動作を実行することにより、前記動画表示領域の発光輝 度の可変制御を行うことを特徴する請求項 23または請求項 24に記載された映像信 号の表示制御方法。
前記動画表示領域に対応する点灯対象にされる画素を、 1フレームもしくは 1サブ フレームの期間の途中において非点灯状態に制御する消灯動作のタイミングを、前 記点灯率に応じて制御する動作を実行することにより、前記動画表示領域の発光輝 度の可変制御を行うことを特徴する請求項 25に記載された映像信号の表示制御方 法。
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