TWI815898B - 蝕刻方法及蝕刻裝置 - Google Patents

蝕刻方法及蝕刻裝置 Download PDF

Info

Publication number
TWI815898B
TWI815898B TW108119287A TW108119287A TWI815898B TW I815898 B TWI815898 B TW I815898B TW 108119287 A TW108119287 A TW 108119287A TW 108119287 A TW108119287 A TW 108119287A TW I815898 B TWI815898 B TW I815898B
Authority
TW
Taiwan
Prior art keywords
etching
gas
chamber
substrate
film
Prior art date
Application number
TW108119287A
Other languages
English (en)
Other versions
TW202013479A (zh
Inventor
戶田聡
菊島悟
中込健
小澤淑恵
林軍
Original Assignee
日商東京威力科創股份有限公司
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 日商東京威力科創股份有限公司 filed Critical 日商東京威力科創股份有限公司
Publication of TW202013479A publication Critical patent/TW202013479A/zh
Application granted granted Critical
Publication of TWI815898B publication Critical patent/TWI815898B/zh

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31105Etching inorganic layers
    • H01L21/31111Etching inorganic layers by chemical means
    • H01L21/31116Etching inorganic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/6719Apparatus for manufacturing or treating in a plurality of work-stations characterized by the construction of the processing chambers, e.g. modular processing chambers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02164Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon oxide, e.g. SiO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/3065Plasma etching; Reactive-ion etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67017Apparatus for fluid treatment
    • H01L21/67063Apparatus for fluid treatment for etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67017Apparatus for fluid treatment
    • H01L21/67063Apparatus for fluid treatment for etching
    • H01L21/67069Apparatus for fluid treatment for etching for drying etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67242Apparatus for monitoring, sorting or marking
    • H01L21/67248Temperature monitoring
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76801Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
    • H01L21/7682Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing the dielectric comprising air gaps

Abstract

[課題]提供一種蝕刻方法及蝕刻裝置,能夠不產生反應生成物所造成的蝕刻阻礙而以高選擇比,將基板上的材料化學蝕刻。 [解決手段]蝕刻方法,具有:在腔室內設置基板的工程,該基板具有矽氧化物系材料與其他材料,矽氧化物系材料具有蝕刻對象部位,蝕刻對象部位具有10nm以下的寬度,且具有10以上的縱橫比;將HF氣體、及OH含有氣體供應至基板,對其他材料將蝕刻對象部位選擇地蝕刻的工程。

Description

蝕刻方法及蝕刻裝置
本揭示係有關於蝕刻方法及蝕刻裝置。
專利文獻1、2揭示將矽氧化膜化學除去的化學氧化物除去處理(Chemical Oxide Removal; COR)。 [先前技術文獻] [專利文獻]
[專利文獻1]日本特開2005-39185號公報 [專利文獻2]日本特開2008-160000號公報
[發明所欲解決的問題]
本揭示提供一種蝕刻方法及蝕刻裝置,能夠不產生反應生成物所造成的蝕刻阻礙而以高選擇比,將基板上的材料化學蝕刻。 [解決問題的手段]
本揭示的一態樣的蝕刻方法,具有:在腔室內設置基板的工程,前述基板具有矽氧化物系材料與其他材料,前述矽氧化物系材料具有蝕刻對象部位,前述蝕刻對象部位具有10nm以下的寬度,且具有10以上的縱橫比對象部位選擇地蝕刻的工程;將HF氣體、及OH含有氣體供應至基板,對前述其他材料將前述蝕刻對象部位選擇地蝕刻的工程。 [發明的效果]
根據本揭示,能夠不產生反應生成物所造成的蝕刻阻礙而以高選擇比,將基板上的材料化學蝕刻。
[實施形態]
以下,參照圖式說明關於實施形態。
<過程及概要> 首先,說明關於本揭示的實施形態的蝕刻方法的過程及概要。從前,將SiO2 膜這種矽氧化物系材料化學蝕刻的COR,如專利文獻1、2所示,作為蝕刻氣體使用HF氣體及NH3 氣體。在該技術中,在SiO2 膜使HF氣體及NH3 氣體吸附,使該等如以下的(1)式所示與SiO2 反應生成固體狀的反應生成物即(NH4 )2 SiF6 (AFS),在次工程藉由加熱使AFS昇華。 6HF+6NH3 +SiO2 →2H2 O+4NH3 +(NH4 )2 SiF6 ・・・(1)
另一方面,在半導體裝置中,矽氧化物系材料,常與SiN、SiCN、金屬等各種膜共存,希望對該等膜具有高選擇性並蝕刻。因此,指向容易進行上述蝕刻反應的低溫蝕刻。
不過,在低溫的蝕刻中,蝕刻對象即矽氧化物系材料的寬度窄,縱橫比高時,具體來說寬度為10nm以下縱橫比為10以上時,因為反應生成物即AFS的生成會有阻礙蝕刻的進行的情形。蝕刻的進行若被阻礙,會有產生蝕刻停止的情形。又,因為AFS的存在也會有對其他膜的選擇性降低的情形。
在此,本揭示的一實施形態實施蝕刻方法(除去方法),具有:在腔室內設置基板的工程,該基板具有矽氧化物系材料與其他材料,矽氧化物系材料具有蝕刻對象部位,蝕刻對象部位具有10nm以下的寬度,且具有10以上的縱橫比;將HF氣體、及OH含有氣體供應至基板將矽氧化物系膜的蝕刻對象部位蝕刻的工程。
作為蝕刻氣體,使用HF氣體、及包含OH基的氣體(OH基含有氣體),例如水蒸氣(H2 O氣體)將SiO2 蝕刻時的反應式,如以下的(2)式所示。 4HF+H2 O+SiO2 →SiF4 ↑+3H2 O・・・(2)
亦即,理論上不會產生阻礙使用HF氣體及NH3 氣體時的那種蝕刻的固體狀的反應生成物。因此,即便是蝕刻對象部位的寬度窄且縱橫比高的情形,也不會產生反應生成物造成的蝕刻阻礙而能夠蝕刻矽氧化物系材料。藉此,不會發生蝕刻停止而能以高產率蝕刻。又,因為反應生成物即AFS不存在,抑制了與SiN膜等其他膜的反應,能夠提高對其他膜的蝕刻的選擇性。
<具體的實施形態> 接著,說明有關具體的實施形態。
[第1實施形態] 首先,說明關於基本的蝕刻方法即第1實施形態。 圖1為表示第1實施形態的蝕刻方法的流程圖。 首先,將矽氧化物系材料(蝕刻對象部位)、及其他材料(非蝕刻部位)共存的狀態的基板設於腔室內(步驟1)。
基板雖沒有特別限定,但例示了以矽晶圓為代表的半導體晶圓。又,矽氧化物系材料典型雖為SiO2 ,但為SiOCN等含有矽及氧的材料即可。又,矽氧化物系材料典型為膜。作為矽氧化物系材料使用的SiO2 膜,也能適用熱氧化膜、或以化學蒸鍍法(CVD法)及原子層沉積法(ALD法)成膜者。作為以CVD法及ALD法成膜的SiO2 膜,例示了作為Si前驅物使用SiH4 或氨矽烷成膜者。
作為其他材料,也可以是SiN、SiCN、金屬系材料等、Si。該等典型為膜。金屬系材料為金屬或金屬化合物,例如,可以是HfOx、Ti、Ta等。又,蝕刻對象部位與非蝕刻部位都可以是矽氧化物系材料。例如,蝕刻對象部位為SiO2 、其他材料為SiOCN等也可以。
蝕刻對象部位即SiO2 等的矽氧化物系材料,以窄寬度、且高縱橫比存在,具體來說矽氧化物系材料的寬度為10nm以下縱橫比為10以上。
作為基板,例示了例如圖2所示的那種構造。在圖2之例中,基板為在Si基體101上形成絕緣膜102,在絕緣膜102形成凹部103。凹部103內插入金屬膜(或Si膜)104。金屬膜104的表面形成SiCN(或SiCON)膜105。絕緣膜102其側壁成為SiN膜。凹部103的絕緣膜102 (成為側壁的SiN膜)與SiCN膜105之間,形成用來形成空氣間隙的SiO2 膜106。蝕刻對象部位即SiO2 膜的寬度為10 nm、縱橫比為10以上。
接著,將HF氣體及OH含有氣體供應至基板,對其他材料將蝕刻對象部位選擇地蝕刻(步驟2)。
該蝕刻以在腔室內配置基板的狀態進行。對腔室內的基板供應的HF氣體及OH含有氣體,吸附於基板表面,並使蝕刻反應進行。該等氣體之中,HF氣體帶來蝕刻作用、OH含有氣體帶來觸媒作用。觸媒作用被認為是OH基的作用。
作為OH含有氣體,較佳為能夠適用水蒸氣及醇氣體。醇氣體雖沒有特別限定,但1價的醇較佳。作為1價的醇,可以是甲醇(CH3 OH)、乙醇(C2 H5 OH)、丙醇(C3 H7 OH)、丁醇(C4 H9 OH),較佳為適用該等的至少1種。
HF氣體及OH含有氣體以外,作為稀釋氣體供應不活性氣體也可以。作為不活性氣體能使用N2 氣體或稀有氣體。作為稀有氣體較佳為Ar氣體、但He氣體等其他稀有氣體也可以。不活性氣體能夠作為將腔室內淨化的淨化氣體使用。
實施步驟2時的基板溫度,較佳為50℃以下、更佳為-20~20℃。這是因為越低溫則對共存的非蝕刻對象膜的選擇比會變高,且低溫對半導體元件的破壞較小。又,矽氧化物系材料的蝕刻速率,當基板溫度成為10℃以下時會急劇地上升、成為5℃以下又更急劇地上升。相對於此,SiN等其他材料幾乎不被蝕刻。因此,基板溫度為10℃以下、再來為5℃以下,可以得到50以上、再來為200以上的大選擇比。從該點來看,基板溫度的更佳範圍為-20~10℃、再來為-20~5℃。
實施步驟2時的腔室內的壓力,能夠設為100 mTorr~100Torr(13.3~13330Pa)的範圍。壓力相依於基板溫度,基板溫度越高成為高壓較佳。基板溫度為-20~20℃時,壓力為2~10Torr(266~1333Pa)的範圍較佳。
OH含有氣體為水蒸氣時,OH含有氣體(GOH )與HF氣體的體積比例(流量比)GOH /HF為1.5以下較佳、0.5~1.5的範圍更佳。分子內包含OH基的氣體越多,能夠使蝕刻均勻地進行。實際的流量也與裝置有關,但HF氣體:100~800sccm較佳、分子內包含OH基的氣體:100~800sccm較佳。
在步驟2中,OH含有氣體(例如水蒸氣)在HF氣體的供應開始前供應較佳。這是因為先藉由供應觸媒即分子內包含OH基的氣體使其吸附基板,不會產生之後供應的HF造成的局部蝕刻(凹坑)等而能夠進行均勻的蝕刻。
又,在步驟2中,HF氣體與分子內包含OH基的氣體,為在到達氣體供給配管及噴淋頭等的腔室前的氣體供應部未相互混合的狀態,所謂的後混合較佳。該等在氣體供給配管及噴淋頭混合的所謂的前混合時,會有在高壓環境下液化的問題。
進行步驟2的蝕刻後,停止HF氣體及分子內包含OH基的氣體,實施腔室內的最終淨化(步驟3),結束處理。
步驟3的淨化工程,能夠藉由將腔室內真空排氣而進行。在真空排氣的途中,也可以對腔室內供應NH3 氣體。藉由步驟3的淨化工程,能夠將腔室內的氟系殘留物除去。淨化工程之後,因應必要對基板進行用來除去殘渣的熱處理(步驟4)也可以。
如同專利文獻1、2,作為蝕刻氣體利用HF氣體及NH3 氣體,例如蝕刻圖2的構造的SiO2 膜106時,如圖3所示,在蝕刻的部分生成反應生成物AFS107。SiO2 膜106的寬度為10nm以下、縱橫比為10以上時,反應生成物即AFS在蝕刻的途中引起蝕刻阻礙,會發生蝕刻停止。又,藉由AFS,構成絕緣膜102的側壁的SiN膜被蝕刻,選擇比會降低。
相對於此,在本實施形態中,藉由利用HF氣體及OH含有氣體進行矽氧化物系膜的蝕刻對象部位的蝕刻,即便蝕刻對象部位的寬度為10nm以下、縱橫比為10以上,也不會發生反應生成物造成的蝕刻阻礙,且能夠相對於共存的其他材料(非蝕刻部位)以高選擇比,蝕刻矽氧化物系材料的蝕刻對象部位。
例如蝕刻圖2所示的基板的SiO2 膜106時,即便寬度為10nm以下、縱橫比為10以上,如圖4所示,能夠不產生蝕刻阻礙而形成所期望的空氣間隙108。又,能夠幾乎不蝕刻絕緣膜102的側壁的SiN膜而以高選擇比蝕刻。
在本實施形態中,如同上述,作為與矽氧化物系材料(蝕刻對象部位)共存的其他材料(非蝕刻部位),可以是從SiN、SiCN、金屬系材料(例如、HfOx、Ti、Ta等)、Si中選擇的至少1種。接著,對於該等,能夠以50以上、再來為200以上的高選擇比實現矽氧化物系材料的蝕刻。例如,蝕刻對象材料為SiO2 膜,其他材料為SiN膜時,能夠得到50以上再來為200以上的選擇比。
又,蝕刻對象部位與非蝕刻部位都可以是矽氧化物系材料。例如,蝕刻對象部位即矽氧化物系材料為SiO2 、非蝕刻部位即其他材料為SiOCN等時,也可以以高選擇比將SiO2 蝕刻。
[第2實施形態] 接著,說明有關第2實施形態。 在本實施形態中,基本上與第1實施形態一樣實施步驟1~3。
在步驟1中,作為基板,使用含有第1SiOCN材料與具有比前述第1SiOCN材料還高的C濃度的第2SiOCN材料者,將這種基板設於腔室內。第1SiOCN材料為蝕刻對象材料、第2SiOCN材料為其他材料。第1及第2SiOCN材料典型為SiOCN膜。
在步驟2中,將HF氣體及OH含有氣體供應至基板,將第1SiOCN材料對第2SiOCN材料選擇地蝕刻。亦即,蝕刻對象材料為SiOCN材料時,即便其他材料為同種的SiOCN材料,也能夠藉由調整C濃度進行選擇性蝕刻。
圖5為表示將SiOCx N膜以HF氣體及H2 O氣體蝕刻時的SiOCx N膜的C濃度與蝕刻量的關係的圖。此外,SiOCN膜為藉由CVD成膜者。如該圖所示,在C濃度為1~6at%的範圍中,對蝕刻量的C濃度的感度非常高,因C的增加蝕刻量急劇地降低。另一方面,C濃度超過6at%後蝕刻量幾乎沒有變化。
因此,若將蝕刻對象材料即第1SiOCN材料的C濃度設為1~6at%、將其他材料即第2SiOCN材料的C濃度設為比第1SiOCN材料還高,能夠以高選擇比蝕刻第1SiOCN材料。特別是將第1SiOCN材料的C濃度設為2at%以下、使第2SiOCN材料的C濃度超過6at%,選擇比會成為超過30的值。
SiOCN適合作為導電體的襯墊材料。作為襯墊材料雖使用SiON,但SiON介電率高寄生電容也高。相對於此,藉由在SiON摻雜C而作為SiOCN,能夠使寄生電容降低。又,SiOCN強度也高、且絕緣性也高。因此,SiOCN適合作為導電體的襯墊材料。
藉由將襯墊材等殘留的材料及蝕刻對象材料都設為SiOCN,將該等形成膜時,在成膜工程中,能以相同氣體系處理。因此,不需要將該等在別腔室處理,能將工程簡略化。
又,在殘留的材料為SiOCN、蝕刻對象材料為SiO2 那種不同膜的情形,雖在膜間會有產生缺陷的可能性,但藉由使兩者為同種材料,能夠抑制膜間的缺陷。
在本實施形態中,上述效果不管是蝕刻對象材料即第1SiOCN材料的形狀為如何都能奏效。但是,蝕刻對象材料即第1SiOCN材料的蝕刻對象部位的寬度為10 nm以下縱橫比為10以上時,能夠與第1實施形態發揮一樣的效果。亦即,作為蝕刻氣體使用HF氣體與NH3 氣體時,第1SiOCN材料的蝕刻對象部位的寬度為10nm以下縱橫比為10以上時,會產生反應生成物造成的蝕刻阻礙。相對於此,藉由使用HF氣體與OH含有氣體,即便第1SiOCN材料的蝕刻對象部位的寬度為10nm以下縱橫比為10以上,都能夠不產生蝕刻阻礙而將第1SiOCN材料選擇地蝕刻。亦即,具有10nm以下的寬度同時具有10以上的縱橫比的蝕刻對象部位(第1SiOCN材料)選擇地被除去。
此外,在本實施形態中,步驟2及步驟3能夠與第1實施形態同樣進行。
[第3實施形態] 接著,說明有關第3實施形態。 圖6為表示第3實施形態的蝕刻方法的流程圖。 首先,與第1實施形態的步驟1一樣,將矽氧化物系材料(蝕刻對象部位)、及其他材料(非蝕刻部位)共存的狀態的基板設於腔室內(步驟11)。蝕刻對象材料即矽氧化物系材料的蝕刻對象部位,與第1實施形態一樣,寬度為10nm以下縱橫比為10以上。
接著,與第1實施形態的步驟2一樣,將HF氣體及OH含有氣體供應至基板,對其他材料將蝕刻對象部位選擇地蝕刻(步驟12)。此時的條件與第1實施形態的步驟2一樣,但是,在步驟12中,與步驟2不同,蝕刻對象部位的蝕刻到途中為止。
接著,停止HF氣體及OH含有氣體,實施腔室內的中間淨化(步驟13)。中間淨化,能夠藉由將腔室內真空排氣而進行。又,因為若在將高縱橫比的矽氧化物系材料蝕刻後的窄蝕刻空間存在殘留物會難以除去,在真空排氣的途中對腔室內供應淨化氣體較佳。作為淨化氣體,N2 氣體及Ar氣體等不活性氣體較適合。
中間淨化後,再實施步驟12的矽氧化物系材料的蝕刻。
步驟12的次數達到預定的次數後,實施腔室內的最終淨化(步驟14),結束處理。
步驟14的最終淨化工程,能夠藉由將腔室內真空排氣而進行。在真空排氣的途中,也可以對腔室內供應NH3 氣體。藉此,能夠將腔室內的氟系殘留物除去。最終淨化工程之後,因應必要對基板進行用來除去殘渣的熱處理(步驟15)也可以。
因此第3實施形態為進行將蝕刻工程重複2次以上的預定次數的循環蝕刻者,藉此,能夠達到比第1實施形態的那種以1次蝕刻處理的情形還更有利的效果。亦即,以1次的蝕刻處理時,因為蝕刻氣體即HF氣體會長時間接觸不欲蝕刻的其他材料,被蝕刻對象膜的表面會有變粗糙、剝落的問題。不過,藉由將蝕刻工程在中間淨化前後重複進行複數次,能夠縮短HF氣體接觸非蝕刻對象膜的期間,不會產生這種問題。又,藉由重複進行複數次蝕刻工程,也能夠使蝕刻速率上升。
此外,將第3實施形態的循環蝕刻適用於第2實施形態也可以。
[第4實施形態] 接著,說明有關第4實施形態。 圖7為表示第4實施形態的蝕刻方法的流程圖。 首先,與第1實施形態的步驟1一樣,準備矽氧化物系材料(蝕刻對象部位)、及其他材料(非蝕刻部位)共存的狀態的基板(步驟21)。蝕刻對象材料即矽氧化物系材料的蝕刻對象部位,與第1實施形態一樣,寬度為10nm以下縱橫比為10以上。
接著,利用HF氣體及NH3 氣體,除去基板表面的自然氧化膜(步驟22)。該處理包含將HF氣體及NH3 氣體供應至腔室內的基板使其吸附於表面,並使其與表面的自然氧化膜(SiO2 膜)反應生成AFS的階段、及藉由加熱使AFS昇華的階段。
HF氣體及NH3 氣體所致的處理為以基板溫度:10~75℃、腔室內的壓力:0.1~3mTorr(13.3~400 Pa)、HF氣體流量:100~500sccm、NH3 氣體流量:100~500sccm的條件進行較佳。
接著,對除去自然氧化膜的基板,與第1實施形態的步驟2一樣,將HF氣體及OH含有氣體供應至基板,對其他材料將蝕刻對象部位選擇地蝕刻(步驟23)。此時的條件與第1實施形態的步驟2一樣。
進行步驟23的蝕刻後,停止HF氣體及包含OH基的氣體,實施腔室內的最終淨化(步驟24),結束處理。
步驟24的最終淨化工程,能夠藉由將腔室內真空排氣而進行。在真空排氣的途中,也可以對腔室內供應NH3 氣體。藉此,能夠將腔室內的氟系殘留物除去。最終淨化工程之後,因應必要對基板進行用來除去殘渣的熱處理(步驟25)也可以。
此外,在本實施形態中,步驟22的自然氧化膜除去之後,與第3實施形態一樣,進行將蝕刻工程重複2次以上的預定次數的循環蝕刻也可以。
如同以上,在第3實施形態中,先利用HF氣體及NH3 氣體除去自然氧化膜後,將氣體切換成HF氣體及OH含有氣體,蝕刻矽氧化物系材料。
如同上述,使用HF氣體與OH含有氣體的蝕刻,將寬度為10nm以下縱橫比為10以上的蝕刻對象部位蝕刻時也不會產生蝕刻阻礙。又,也能夠對SiN及金屬系材料等的共存的其他材料以高選擇比蝕刻。
不過,利用HF氣體及OH含有氣體的蝕刻,孵化時間長,將自然氧化膜這種形成於基板全面的氧化膜除去時,會花時間且產率降低。
另一方面,使用HF氣體及NH3 氣體的蝕刻,如同上述,在窄且高縱橫比的蝕刻對象部位的蝕刻中,雖有蝕刻阻礙及選擇比的降低之虞,在自然氧化膜的除去中不會產生這種問題。亦即,在自然氧化膜的除去中,不需要在窄空間部分的蝕刻,能夠藉由HF氣體及NH3 氣體以高速率進行AFS生成反應。又,在自然氧化膜的除去中,不需要考慮對其他材料的選擇比。
因此,在本實施形態中,能夠將從自然氧化膜的除去,到在形成於基板的矽氧化物系膜的蝕刻為止的工程,以高產率且高選擇比進行。
此外,將第4實施形態適用於第2實施形態也可以。
<處理系統> 接著,說明關於用於實施形態的蝕刻方法的實施的處理系統之一例。 圖8為表示這種處理系統的一例的概略構成圖。該處理系統1為將上述那種蝕刻對象材料即矽氧化物系材料、及其他材料共存的基板即半導體晶圓(以下,單記為晶圓)W進行蝕刻處理者。
處理系統1具備:搬入搬出部2、2個裝載鎖定室(L/L)3、2個熱處理裝置4、2個蝕刻裝置5、控制部6。
搬入搬出部2為用來將晶圓W搬入搬出者。搬入搬出部2具有將搬送晶圓W的第1晶圓搬送機構11設於內部的搬送室(L/M)12。第1晶圓搬送機構11具有將晶圓W略水平保持的2個搬送臂11a、11b。在搬送室12的長邊方向的側部設有載置台13,在該載置台13可以連接例如3個將晶圓W複數枚並列並可收容的載體C。又,鄰接於搬送室12設置使晶圓W旋轉光學求出偏心量進行對位的定位器14。
在搬入搬出部2中,晶圓W藉由搬送臂11a、11b來保持,藉由第1晶圓搬送機構11的驅動在略水平面內直進移動、或升降,藉此搬送至所期望的位置。接著,藉由對載置台13上的載體C、定位器14、裝載鎖定室3分別讓搬送臂11a、11b,進行搬入搬出。
2個裝載鎖定室(L/L)3鄰接於搬入搬出部2設置。各裝載鎖定室3以在搬送室12之間分別介在閘閥16的狀態,分別連結至搬送室12。在各裝載鎖定室3內設置搬送晶圓W的第2晶圓搬送機構17。又,裝載鎖定室3能抽真空至預定的真空度。
第2晶圓搬送機構17具有多關節臂構造,具有將晶圓W略水平保持的保持器。在該第2晶圓搬送機構17中,保持器以將多關節臂收縮的狀態位於裝載鎖定室3內。接著,藉由將多關節臂延伸,保持器到達熱處理裝置4,藉由再延伸能到達蝕刻裝置5。因此,能將晶圓W在裝載鎖定室3、熱處理裝置4、及蝕刻裝置5間搬送。
2個熱處理裝置4為對晶圓進行熱處理者,分別鄰接2個裝載鎖定室(L/L)3設置。熱處理裝置4具有可抽真空的腔室20,在其中設置的載置台上載置晶圓W。在載置台設置加熱機構,藉此將載置台上的晶圓W加熱至預定溫度。在腔室20內,導入N2 氣體等不活性氣體,將腔室20內設為減壓狀態的不活性氣體氛圍,並對晶圓W施予預定溫度的熱處理。
2個蝕刻裝置5為對晶圓W進行化學蝕刻者,分別鄰接2個熱處理裝置4設置。蝕刻裝置5的詳細將於後述。
搬送室12與裝載鎖定室(L/L)3之間設有閘閥16。又,在裝載鎖定室(L/L)3與熱處理裝置4之間設有閘閥22。再來,在熱處理裝置4與蝕刻裝置5之間設有閘閥54。
控制部6以電腦構成,具有:具備CPU的主控制部、輸入裝置(鍵盤、滑鼠等)、輸出裝置(印刷機等)、顯示裝置(顯示器等)、記憶裝置(記憶媒體)。主控制部控制處理系統1的各構成部的動作。主控制部所致的各構成部的控制藉由內藏於記憶裝置的記憶媒體(硬碟、光碟、半導體記憶體等)中記憶的控制程式即處理配方來執行。
在這樣構成的處理系統1中,將晶圓W收納於複數枚載體C內並搬送至處理系統1。在處理系統1中,以打開大氣側的閘閥16的狀態從搬入搬出部2的載體C藉由第1晶圓搬送機構11的搬送臂11a、11b的任一者將晶圓W搬送至1枚裝載鎖定室3,收授至裝載鎖定室3內的第2晶圓搬送機構17的保持器。
之後,關閉大氣側的閘閥16將裝載鎖定室3內真空排氣,接著打開閘閥54,將保持器延伸至蝕刻裝置5而將晶圓W搬送至蝕刻裝置5。
之後,使保持器回到裝載鎖定室3,關閉閘閥54,在蝕刻裝置5中藉由上述實施形態的蝕刻方法進行矽氧化物系材料的蝕刻處理。
蝕刻處理的途中或蝕刻處理結束之後,打開閘閥22、54,藉由第2晶圓搬送機構17的保持器將蝕刻處理後的晶圓W搬送至熱處理裝置4。接著藉由熱處理裝置4,將AFS等反應生成物或蝕刻殘渣等加熱除去。
熱處理裝置4中的熱處理結束後,因應必要藉由第2晶圓搬送機構17將晶圓W搬送至蝕刻裝置5進行蝕刻處理的後續。
接著,將熱處理結束後或蝕刻處理結束後的晶圓W搬送至裝載鎖定室3後,使裝載鎖定室3回到大氣環境。之後,使裝載鎖定室3的晶圓W藉由第1晶圓搬送機構11的搬送臂11a、11b的任一者回到載體C。藉此,一枚晶圓的處理結束。
<蝕刻裝置> 接著,更詳細說明上述蝕刻裝置5。 圖9為表示蝕刻裝置5的剖面圖。如圖9所示,蝕刻裝置5具有密閉構造的腔室40,在腔室40的內部,設置以使晶圓W為略水平的狀態載置的載置台42。又,蝕刻裝置5具備:對腔室40供應蝕刻氣體的氣體供應機構43、將腔室40內排氣的排氣機構44。
腔室40藉由腔室本體51及蓋部52構成。腔室本體51具有略圓筒狀的側壁部51a及底部51b,上部成為開口,該開口以蓋部52封閉。側壁部51a與蓋部52藉由密封構件(圖未示)密閉,確保腔室40內的氣密性。在蓋部52的頂壁從上方朝向腔室40內插入第1氣體導入噴嘴71及第2氣體導入噴嘴72。
於側壁部51a,在與熱處理裝置4的腔室20之間設置將晶圓W搬入搬出的搬入出口53,該搬入出口53可藉由閘閥54開關。
載置台42在俯視時形成略圓形,固定於腔室40的底部51b。載置台42的內部設有調節載置台42的溫度的溫度調節器55。溫度調節器55具備例如溫度調節用媒體(例如水等)循環的管路,藉由與在該管路內流動溫度調節用媒體進行熱交換,來調節載置台42的溫度,進行載置台42上的晶圓W的溫度控制。
氣體供應機構43具有:Ar氣體供應源61、HF氣體供應源62、N2 氣體供應源63、H2 O氣體供應源64、及供應NH3 氣體的NH3 氣體供應源65。Ar氣體供應源61及N2 氣體供應源63為除了稀釋氣體、淨化氣體以外,作為兼有作為載體氣體的功能的不活性氣體,供應N2 氣體、Ar氣體者。但是,兩者都是Ar氣體或N2 氣體也可以,又,如同上述,不活性氣體不限於Ar氣體或N2 氣體。H2 O氣體供應源64為作為OH含有氣體供應水蒸氣(H2 O氣體)者。
該等氣體供應源61~65分別連接第1~第5氣體供給配管66~70的一端。連接至HF氣體供應源62的第2氣體供給配管67,另一端連接至第1氣體導入噴嘴71。連接至Ar氣體供應源61的第1氣體供給配管66,另一端連接至第2氣體供給配管67。連接至H2 O氣體供應源64的第4氣體供給配管69,另一端連接至第2氣體導入噴嘴72。連接至N2 氣體供應源63的第3氣體供給配管68及連接至NH3 氣體供應源65的第5氣體供給配管70,另一端連接至第4氣體供給配管69。因此,HF氣體與H2 O氣體及NH3 氣體不在配管內混合,而向腔室40內供應。
第1~第5氣體供給配管66~70設有進行流路的開關動作及流量控制的流量控制器80。流量控制器80例如藉由開關閥及質量流量控制器(MFC)或流量控制系統(FCS)構成。
此外,在腔室40的上部設置噴淋頭,通過噴淋頭將上述氣體以噴淋狀供應也可以。此時,在噴淋頭內使用HF氣體及H2 O氣體未混合的後混合態樣的噴淋頭較佳。
排氣機構44具有連接形成於腔室40的底部51b的排氣口81的排氣配管82,再來,具有設於排氣配管82的用來控制腔室40內壓力的自動壓力控制閥(APC)83及用來將腔室40內排氣的真空泵84。
於腔室40的側壁,作為用來量測腔室40內的壓力的壓力計2個電容壓力計86a、86b以插入腔室40內的方式設置。電容壓力計86a成為高壓力用、電容壓力計86b成為低壓力用。載置於載置台42的晶圓W附近,設有檢出晶圓W溫度的溫度感測器(圖未示)。
作為構成蝕刻裝置5的腔室40、載置台42等各種構成部件的材質使用Al。構成腔室40的Al材可以是純的、在內面(腔室本體51的內面等)施予陽極氧化處理者也可以。另一方面,因為構成載置台42的Al的表面要求耐磨耗性,進行陽極氧化處理在表面形成耐磨耗性高的氧化被膜(Al2 O3 )較佳。
在以此方式構成的蝕刻裝置5中,藉由控制部6進行的控制,實施上述第1實施形態到第4實施形態的蝕刻方法。
首先,將形成蝕刻對象膜即矽氧化物系膜的晶圓W搬送至腔室40內,載置於載置台42。
接著,實施上述第1~第3實施形態的方法時,將H2 O氣體或加上H2 O氣體將不活性氣體即Ar氣體及N2 氣體供應至腔室40內。藉此,能夠使晶圓W的溫度穩定,並使腔室40內的壓力維持在預定壓力。接著,將HF氣體導入腔室40內,藉由HF氣體與H2 O氣體,將晶圓W的矽氧化物系材料選擇地蝕刻。第3實施形態的情形,在上述那種中間淨化前後進行循環蝕刻。
又,實施上述第4實施形態的方法時,將晶圓W載置於載置台42後,將NH3 氣體或加上NH3 氣體將不活性氣體即Ar氣體及N2 氣體供應至腔室40內。藉此,能夠使晶圓W的溫度穩定,並使腔室40內的壓力維持在預定壓力。接著,將HF氣體導入腔室40內,藉由HF氣體與NH3 氣體,使晶圓W表面的自然氧化膜與該等氣體反應,生成反應生成物即AFS。之後,將晶圓W從腔室40搬出,進行腔室40內的淨化。
從腔室40搬出的晶圓W,藉由在熱處理裝置4內的熱處理,將AFS除去。接著,將除去AFS的晶圓W再搬入腔室40內。
之後,將H2 O氣體或加上H2 O氣體將不活性氣體即Ar氣體及N2 氣體供應至腔室40內進行溫度及壓力的穩定化處理。接著,將HF氣體導入腔室40內,藉由HF氣體與H2 O氣體,將存在於晶圓W的矽氧化物系材料選擇地蝕刻。蝕刻為中間淨化前後的循環蝕刻。
第1~第4實施形態中的任一者,都在蝕刻結束後,如同上述進行腔室40內的淨化,結束蝕刻處理。淨化工程之後,因應必要將基板W搬送至熱處理裝置4,進行用來除去殘渣的熱處理也可以。
<實驗例> 接著,說明關於實驗例。
[實驗例1] 在此,準備圖2所示的構造的基板,進行其中的SiO2 膜的蝕刻。SiO2 膜為作為矽前驅物使用氨矽烷藉由ALD形成者,該蝕刻部分的寬度為5nm、深度為70nm、縱橫比為12。對於該基板,進行利用實施形態的HF氣體及水蒸氣(H2 O氣體)的蝕刻(例子A)、利用HF氣體及NH3 氣體的蝕刻(例子B),掌握時間與蝕刻深度的關係。在例子A中,以溫度:-20~20℃、壓力:2.0~10.0Torr(266~1333Pa)、HF氣體流量:100~800sccm、H2 O氣體流量:100~800sccm、N2 氣體流量:100~2000sccm的條件進行。又,在例子B中,以溫度:10~75℃、壓力:100~3000mTorr(13.3~400Pa)、HF氣體流量:100~500sccm、NH3 氣體流量:100~500sccm、N2 氣體流量:100~2000sccm、Ar氣體流量:20~500sccm的條件進行。
圖10為表示以例子A及例子B進行蝕刻時的時間與蝕刻深度的關係的圖。如該圖所示,可以得知在利用HF氣體及NH3 氣體進行蝕刻的例子B中,蝕刻深度在10 nm附近SiO2 膜的蝕刻速度急劇地變慢,在20nm附近產生蝕刻停止。相對於此,在利用HF氣體及H2 O氣體進行蝕刻的例子A中,能夠不產生蝕刻停止而到70nm為止進行SiO2 膜蝕刻。這被認為是因為在例子B中反應生成物即AFS阻礙了蝕刻,相對地在例子A中不會產生阻礙蝕刻的反應生成物。
[實驗例2] 其中,使用實施形態的HF氣體及水蒸氣(H2 O氣體),使溫度在0℃~10℃間變化,蝕刻SiO2 膜與SiN膜。作為SiO2 膜使用作為矽前驅物使用氨矽烷藉由ALD形成者,作為SiN膜使用作為矽前驅物使用六氯二矽烷(HCD)藉由CVD形成者。蝕刻時的溫度以外的條件設為壓力:2.0~10.0Torr(266~1333Pa)、HF氣體流量:100~800sccm、H2 O氣體流量:100~800sccm。
圖11為表示溫度與SiO2 膜及SiN膜的蝕刻速率的關係、以及溫度與相對於SiN膜的SiO2 膜的蝕刻選擇比的關係的圖。如該圖所示,表現出隨著溫度降低,SiO2 的蝕刻速率及相對於SiN膜的SiO2 膜的選擇比急劇地上升,在0℃相對於SiN膜的SiO2 膜的蝕刻選擇比為244.6這種極高的值。
[實驗例3] 在這裡,準備於基板上形成SiO2 膜、C濃度為8at%的SiCN膜及C濃度為5at的SiOCN膜的樣本。SiCN膜、SiOCN膜為藉由CVD成膜者。SiO2 膜為作為矽前驅物使用氨矽烷藉由ALD形成者,該寬度為5nm、深度為70nm、縱橫比為12。對於該等樣本,進行利用實施形態的HF氣體及水蒸氣(H2 O氣體)的蝕刻(例子C)、利用HF氣體及NH3 氣體的蝕刻(例子D)45sec,就SiO2 膜、SiCN膜、及SiOCN膜,掌握時間與蝕刻量的關係。此外,例子C及例子D的條件分別與例子A及例子B為相同條件。
圖12為表示以例子C(HF氣體/H2 氣體)進行SiO2 膜、SiCN膜、及SiOCN膜的蝕刻時的時間與蝕刻量的關係的圖。又,圖13為表示以例子D(HF氣體/NH3 氣體)進行SiO2 膜、SiCN膜、及SiOCN膜的蝕刻時的時間與蝕刻量的關係的圖。
如圖12所示,在使用HF氣體及H2 O氣體進行蝕刻的例子C中,能夠幾乎以一定的蝕刻速率到70nm為止進行SiO2 膜的蝕刻。又,確認到SiCN膜及SiOCN膜的蝕刻量少,SiO2 膜以高選擇比被蝕刻。
另一方面,如圖13所示,得知在使用HF氣體及NH3 氣體進行蝕刻的例子D中,SiO2 膜的蝕刻速率比例子C還慢特別是在30sec以後蝕刻又更降低。又,得知SiOCN膜的蝕刻量比例子C的情形還多,相對於SiO2 膜的SiOCN膜的選擇比比例子C還低。
<其他適用> 以上,雖利用實施形態來說明,但應注意這次揭示的實施形態,以所有的點來例示但非用來限制者。上述實施形態,在不脫離申請專利範圍及其主旨的情況下,也能夠以各種形態進行省略、置換、變更。
例如,上述實施形態的裝置不過是例示,可以使用各種構成的裝置。又,雖表示關於作為被處理基板使用半導體晶圓的情形,但不限於半導體晶圓,以LCD (液晶顯示器)用基板為代表的FPD(平面顯示器)基板、及陶瓷基板等其他基板也可以。
1:處理系統 2:搬入搬出部 3:裝載鎖定室 5:蝕刻裝置 6:控制部 40:腔室 43:氣體供應機構 44:排氣機構 101:Si基體 102:包含SiN膜側壁的絕緣膜 104:金屬膜(或Si膜) 105:SiCN膜 106:SiO2膜 108:空氣間隙 W:半導體晶圓
[圖1]表示第1實施形態的蝕刻方法的流程圖。 [圖2]表示提供蝕刻的基板的構造例的剖面圖。 [圖3]表示將圖2所示的構造的基板的SiO2 膜利用HF氣體及NH3 氣體蝕刻時的狀態的剖面圖。 [圖4]表示將圖2所示的構造的基板的SiO2 膜利用HF氣體及H2 O氣體蝕刻時的狀態的剖面圖。 [圖5]表示將SiOCx N膜以HF氣體及H2 O氣體蝕刻時的SiOCx N膜的C濃度與蝕刻量的關係的圖。 [圖6]表示第3實施形態的蝕刻方法的流程圖。 [圖7]表示第4實施形態的蝕刻方法的流程圖。 [圖8]表示用於實施形態的蝕刻方法的實施的處理系統之一例的概略構成圖。 [圖9]表示搭載於圖8的處理系統的蝕刻裝置的剖面圖。 [圖10]表示實驗例1中,以例子1及例子2進行蝕刻時的時間與蝕刻深度的關係的圖。 [圖11]表示實驗例2中的溫度與SiO2 膜及SiN膜的蝕刻速率的關係、以及溫度與相對於SiN膜的SiO2 膜的蝕刻選擇比的關係的圖。 [圖12]表示實驗例3中,以例子C(HF氣體/H2 O氣體)進行SiO2 膜、SiCN膜、及SiOCN膜的蝕刻時的時間與蝕刻量的關係的圖。 [圖13]表示實驗例3中,以例子D(HF氣體/NH3 氣體)進行SiO2 膜、SiCN膜、及SiOCN膜的蝕刻時的時間與蝕刻量的關係的圖。

Claims (16)

  1. 一種蝕刻方法,具有:在腔室內設置基板的工程,前述基板具有矽氧化物系材料、與和前述矽氧化物系材料不同的其他材料,前述矽氧化物系材料具有蝕刻對象部位,前述蝕刻對象部位具有10nm以下的寬度,且具有10以上的縱橫比;將HF氣體、及OH含有氣體供應至基板,對前述其他材料將前述蝕刻對象部位選擇地蝕刻的工程。
  2. 如請求項1記載的蝕刻方法,其中,前述OH含有氣體為水蒸氣或醇氣體。
  3. 如請求項1或請求項2記載的蝕刻方法,其中,前述其他材料為由SiN、SiCN、金屬系材料、及Si中選擇的至少1種。
  4. 如請求項1或請求項2記載的蝕刻方法,其中,前述矽氧化物系材料為SiO2,前述其他材料為由SiN、SiCN、SiOCN、金屬系材料、及Si中選擇的至少1種。
  5. 一種蝕刻方法,具有:在腔室內設置基板的工程,前述基板具有第1SiOCN材料及具有比前述第1SiOCN材料還高的C濃度的第2SiOCN材料; 將HF氣體、及OH含有氣體供應至前述腔室內的前述基板,對前述第2SiOCN材料將前述第1SiOCN材料選擇地蝕刻的工程。
  6. 如請求項5記載的蝕刻方法,其中,前述第1SiOCN材料具有蝕刻對象部位,前述蝕刻對象部位具有10nm以下的寬度,且具有10以上的縱橫比,前述蝕刻的工程,將前述蝕刻對象部位選擇地蝕刻。
  7. 如請求項5或請求項6記載的蝕刻方法,其中,前述第1SiOCN膜具有1~6at%的C濃度。
  8. 如請求項5或請求項6記載的蝕刻方法,其中,前述第1SiOCN膜具有2at%以下的C濃度。
  9. 如請求項1、2、5、6中任一項記載的蝕刻方法,其中,前述蝕刻的工程中的前述基板溫度為-20~20℃。
  10. 如請求項1、2、5、6中任一項記載的蝕刻方法,其中,前述蝕刻的工程中的前述腔室內壓力為2~10Torr(266~1333Pa)。
  11. 如請求項1、2、5、6中任一項記載的蝕刻方法,其中,前述HF氣體及前述OH含有氣體以不相互混合的方式 供應至前述腔室內。
  12. 如請求項11記載的蝕刻方法,其中,前述OH含有氣體在前述HF氣體的供應開始前供應。
  13. 如請求項1、2、5、6中任一項記載的蝕刻方法,其中,前述蝕刻的工程重複進行;該方法還具有進行中間淨化的工程;前述中間淨化具有:進行前述腔室內的排氣的工程、在進行前述排氣的工程之間,對前述腔室內供應淨化氣體的工程。
  14. 如請求項1、2、5、6中任一項記載的蝕刻方法,其中,更具有利用HF氣體及NH3氣體從前述基板的表面除去自然氧化膜的工程,前述除去的工程在前述蝕刻的工程之前進行。
  15. 如請求項1、2、5、6中任一項記載的蝕刻方法,還具有在前述蝕刻的工程之後,進行最終淨化的工程;前述最終淨化具有:進行前述腔室內的排氣的工程、在進行前述排氣的工程之間,對前述腔室內供應NH3氣體的工程。
  16. 一種蝕刻裝置,具備: 收容基板的腔室;在前述腔室內載置基板的載置台;調節前述載置台上的基板溫度的調溫部;供應包含用來蝕刻的氣體、HF氣體、及OH含有氣體的氣體供應部;將前記處理容器內排氣的排氣部;控制前述調溫部、前述氣體供應部、及前述排氣部的控制部。
TW108119287A 2018-06-08 2019-06-04 蝕刻方法及蝕刻裝置 TWI815898B (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2018-110555 2018-06-08
JP2018110555A JP7204348B2 (ja) 2018-06-08 2018-06-08 エッチング方法およびエッチング装置

Publications (2)

Publication Number Publication Date
TW202013479A TW202013479A (zh) 2020-04-01
TWI815898B true TWI815898B (zh) 2023-09-21

Family

ID=68763617

Family Applications (1)

Application Number Title Priority Date Filing Date
TW108119287A TWI815898B (zh) 2018-06-08 2019-06-04 蝕刻方法及蝕刻裝置

Country Status (5)

Country Link
US (1) US20190378724A1 (zh)
JP (1) JP7204348B2 (zh)
KR (1) KR102282188B1 (zh)
CN (1) CN110581067B (zh)
TW (1) TWI815898B (zh)

Families Citing this family (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10872778B2 (en) 2018-07-06 2020-12-22 Applied Materials, Inc. Systems and methods utilizing solid-phase etchants
CN111009459B (zh) * 2019-12-26 2022-08-16 北京北方华创微电子装备有限公司 含氟残留物去除方法、刻蚀方法和氧化层清洗方法
US11329140B2 (en) * 2020-01-17 2022-05-10 Taiwan Semiconductor Manufacturing Company, Ltd. Semiconductor device and method of manufacture
JP7065254B2 (ja) * 2020-04-10 2022-05-11 株式会社日立ハイテク エッチング方法
US11677015B2 (en) * 2020-05-13 2023-06-13 Taiwan Semiconductor Manufacturing Co., Ltd. Method of manufacturing a semiconductor device and a semiconductor device
DE102020133643A1 (de) 2020-05-13 2021-11-18 Taiwan Semiconductor Manufacturing Co., Ltd. Verfahren zur herstellung einer halbleitervorrichtung, und halbleitervorrichtung
JP2021180281A (ja) * 2020-05-15 2021-11-18 東京エレクトロン株式会社 エッチング方法およびエッチング装置
JP2022055923A (ja) * 2020-09-29 2022-04-08 東京エレクトロン株式会社 エッチング方法及びプラズマ処理装置
US11295960B1 (en) 2021-03-09 2022-04-05 Hitachi High-Tech Corporation Etching method
US20220375751A1 (en) * 2021-05-24 2022-11-24 Applied Materials, Inc. Integrated epitaxy and preclean system
KR20230103419A (ko) 2021-12-31 2023-07-07 세메스 주식회사 기판 처리 방법 및 기판 처리 장치
JP7474903B2 (ja) 2022-02-14 2024-04-25 株式会社日立ハイテク エッチング処理方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20020052121A1 (en) * 1999-08-30 2002-05-02 Micron Technology, Inc. Compositions for etching silicon with high selectivity to oxides and methods of using same
TW201700778A (zh) * 2015-01-05 2017-01-01 蘭姆研究公司 用於矽與鍺氧化物之同向性原子層蝕刻
TW201715077A (zh) * 2015-08-07 2017-05-01 應用材料股份有限公司 氧化物蝕刻選擇性系統

Family Cites Families (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100197670B1 (ko) * 1996-06-27 1999-06-15 김영환 반도체 소자의 콘택홀 형성방법
JP2000021842A (ja) * 1998-06-29 2000-01-21 Shin Etsu Handotai Co Ltd 珪素半導体単結晶基板の処理方法
JP4833512B2 (ja) 2003-06-24 2011-12-07 東京エレクトロン株式会社 被処理体処理装置、被処理体処理方法及び被処理体搬送方法
JP2006167849A (ja) * 2004-12-15 2006-06-29 Denso Corp マイクロ構造体の製造方法
WO2008088300A2 (en) * 2005-03-08 2008-07-24 Primaxx, Inc. Selective etching of oxides from substrates
JP5084250B2 (ja) 2006-12-26 2012-11-28 東京エレクトロン株式会社 ガス処理装置およびガス処理方法ならびに記憶媒体
US20110061812A1 (en) * 2009-09-11 2011-03-17 Applied Materials, Inc. Apparatus and Methods for Cyclical Oxidation and Etching
US8076250B1 (en) * 2010-10-06 2011-12-13 Applied Materials, Inc. PECVD oxide-nitride and oxide-silicon stacks for 3D memory application
JP2016012609A (ja) * 2014-06-27 2016-01-21 東京エレクトロン株式会社 エッチング方法
JP2016025195A (ja) * 2014-07-18 2016-02-08 東京エレクトロン株式会社 エッチング方法
JP6426489B2 (ja) * 2015-02-03 2018-11-21 東京エレクトロン株式会社 エッチング方法
JP6498022B2 (ja) * 2015-04-22 2019-04-10 東京エレクトロン株式会社 エッチング処理方法
KR102396111B1 (ko) * 2015-06-18 2022-05-10 삼성전자주식회사 반도체 소자 및 그 제조 방법
US9564341B1 (en) * 2015-08-04 2017-02-07 Applied Materials, Inc. Gas-phase silicon oxide selective etch
FR3041471B1 (fr) * 2015-09-18 2018-07-27 Commissariat A L'energie Atomique Et Aux Energies Alternatives Procede de formation des espaceurs d'une grille d'un transistor
JP6602699B2 (ja) * 2016-03-14 2019-11-06 株式会社Kokusai Electric クリーニング方法、半導体装置の製造方法、基板処理装置およびプログラム
CN113506731A (zh) * 2016-10-08 2021-10-15 北京北方华创微电子装备有限公司 一种集成电路的制造工艺

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20020052121A1 (en) * 1999-08-30 2002-05-02 Micron Technology, Inc. Compositions for etching silicon with high selectivity to oxides and methods of using same
TW201700778A (zh) * 2015-01-05 2017-01-01 蘭姆研究公司 用於矽與鍺氧化物之同向性原子層蝕刻
TW201715077A (zh) * 2015-08-07 2017-05-01 應用材料股份有限公司 氧化物蝕刻選擇性系統

Also Published As

Publication number Publication date
KR20190139770A (ko) 2019-12-18
US20190378724A1 (en) 2019-12-12
JP7204348B2 (ja) 2023-01-16
CN110581067B (zh) 2023-11-21
CN110581067A (zh) 2019-12-17
KR102282188B1 (ko) 2021-07-26
TW202013479A (zh) 2020-04-01
JP2019212872A (ja) 2019-12-12

Similar Documents

Publication Publication Date Title
TWI815898B (zh) 蝕刻方法及蝕刻裝置
TWI648791B (zh) Etching method
CN109216186B (zh) 蚀刻方法和残渣去除方法
KR100861851B1 (ko) 실리콘 산화막 형성 방법 및 장치
KR101503725B1 (ko) 성막 방법 및 성막 장치
US20060205231A1 (en) Film formation method and apparatus for semiconductor process
KR101802595B1 (ko) 에칭 방법 및 기억 매체
US11127597B2 (en) Etching method
KR101802580B1 (ko) 에칭 방법 및 기억 매체
US20200098575A1 (en) Etching Method, Etching Apparatus, and Storage Medium
JP6073172B2 (ja) エッチング方法
TWI796256B (zh) 基板處理方法、半導體裝置之製造方法、基板處理裝置及程式
KR20160003655A (ko) 에칭 방법
WO2020189288A1 (ja) 成膜方法および成膜装置
KR102244383B1 (ko) 클리닝 방법, 반도체 장치의 제조 방법, 기판 처리 장치 및 프로그램
KR20180111556A (ko) 에칭 방법 및 에칭 장치
KR20200143260A (ko) 에칭 방법 및 에칭 장치
US20240105443A1 (en) Method of processing substrate, method of manufacturing semiconductor device, substrate processing system, and recording medium
US20240030026A1 (en) Processing method, method of manufacturing semiconductor device, processing apparatus, and recording medium
US20240096617A1 (en) Method of processing substrate, method of manufacturing semiconductor device, substrate processing apparatus, and recording medium
WO2023181405A1 (ja) 基板処理装置、処理容器、基板保持具及び半導体装置の製造方法
JP2008243837A (ja) 成膜装置及び成膜方法並びに記憶媒体